TWI391902B - 驅動電路 - Google Patents

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TWI391902B TW097126628A TW97126628A TWI391902B TW I391902 B TWI391902 B TW I391902B TW 097126628 A TW097126628 A TW 097126628A TW 97126628 A TW97126628 A TW 97126628A TW I391902 B TWI391902 B TW I391902B
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Description

驅動電路
本發明係有關於一種驅動電路，尤指一種應用於一液晶顯示面板中的一閘極驅動電路(gate driver)，該閘極驅動電路能夠降低所需要的高壓元件(亦即電壓準位轉換器)之數量，以縮小面積。
請參考第1圖，第1圖所繪示的係為習知技術中應用於一液晶顯示面板中之一閘極驅動電路(gate driver)100的簡化方塊示意圖。如第1圖所示，閘極驅動電路100包含有：一解碼器101、複數個電壓移位器102以及複數個輸出級103，其中，複數條閘極線G1~Gm中的每一條閘極線都需要有一個對應的電壓移位器102，而電壓移位器102中所包含的複數個元件大部分都是高壓元件，因此習知技術中的閘極驅動電路100之面積一般而言都會很大，很難降低。
請參考第2圖，第2圖所繪示的係為美國專利公開案號第20070103346號中應用於一液晶顯示面板之閘極，驅動電路中的一矩陣解碼器200之簡化方塊示意圖。矩陣解碼器200的原理主要在於利用二維矩陣式解碼的方式，來減少所需要的高壓元件(亦即電壓移位器)之數量。然而，隨著目前液晶顯示面板的尺寸日趨增大，閘極線的數量也愈來愈多，因此上述的習知技術已經無 法滿足目前液晶顯示面板產業界的需求。
有鑑於此，本發明的目的之一在於提供一種能夠降低所需要的高壓元件(亦即電壓準位轉換器)之數量，以縮小面積的驅動電路，以解決上述的問題。
依據本發明之申請專利範圍，其係揭露一種驅動電路，該驅動電路包含有：Z個第一電壓準位轉換單元、B個第二電壓準位轉換單元、一第一矩陣解碼單元、C個第三電壓準位轉換單元、D個第四電壓準位轉換單元、一第二矩陣解碼單元以及一第三矩陣解碼單元。該Z個第一電壓準位轉換單元係用於分別接收Z個第一低壓數位輸入訊號其中之一，並依據該Z個第一低壓數位輸入訊號來產生Z個第一高壓數位輸入訊號；該B個第二電壓準位轉換單元係用於分別接收B個第二低壓數位輸入訊號其中之一，並依據該B個第二低壓數位輸入訊號來產生B個第二高壓數位輸入訊號；該第一矩陣解碼單元係耦接於該Z個第一電壓準位轉換單元與該B個第二電壓準位轉換單元，並且用於接收該Z個第一高壓數位輸入訊號與該B個第二高壓數位輸入訊號，並依據該Z個第一高壓數位輸入訊號與該B個第二高壓數位輸入訊號來產生(Z×B)個第一高壓數位輸出訊號；該C個第三電壓準位轉換單元係用於分別接收C個第三低壓數位輸入訊號其中之一，並依據該C 個第三低壓數位輸入訊號來產生C個第三高壓數位輸入訊號；該D個第四電壓準位轉換單元係用於分別接收D個第四低壓數位輸入訊號其中之一，並依據該D個第四低壓數位輸入訊號來產生D個第四高壓數位輸入訊號；該第二矩陣解碼單元係耦接於該C個第三電壓準位轉換單元與該D個第四電壓準位轉換單元，並且用於接收該C個第三高壓數位輸入訊號與該D個第四高壓數位輸入訊號，並依據該C個第三高壓數位輸入訊號與該D個第四高壓數位輸入訊號來產生(C×D)個第二高壓數位輸出訊號；以及該第三矩陣解碼單元係耦接於該第一矩陣解碼單元與該第二矩陣解碼單元，並且用於接收該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號，並依據該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號來產生(Z×B)×(C×D)個第三高壓數位輸出訊號。
依據本發明之申請專利範圍，其係揭露一種驅動電路，該驅動電路包含有：Z個第一電壓準位轉換單元、B個第二電壓準位轉換單元、一第一矩陣解碼單元、一矩陣解碼模組以及一第三矩陣解碼單元。該Z個第一電壓準位轉換單元係用於分別接收Z個第一低壓數位輸入訊號其中之一，並依據該Z個第一低壓數位輸入訊號來產生Z個第一高壓數位輸入訊號；該B個第二電壓準位轉換單元係用於分別接收B個第二低壓數位輸入訊號其中之一，並依據該B個第二低壓數位輸入訊號來產生B個第二高壓數位輸入訊號；該第一矩陣解碼單元係耦接於該Z個第一電壓準位轉換單 元與該B個第二電壓準位轉換單元，並且用於接收該Z個第一高壓數位輸入訊號與該B個第二高壓數位輸入訊號，並依據該Z個第一高壓數位輸入訊號與該B個第二高壓數位輸入訊號來產生(Z×B)個第一高壓數位輸出訊號；該複數組第三電壓準位轉換單元中的每一組第三電壓準位轉換單元係用於接收複數個第三低壓數位輸入訊號其中之一，並依據該複數個第三低壓數位輸入訊號來產生複數個第三高壓數位輸入訊號；該矩陣解碼模組係用於產生(C×D)個第二高壓數位輸出訊號，並且該矩陣解碼模組包含有複數個第二矩陣解碼單元，而每一個第二矩陣解碼單元係依據複數個第一輸入訊號與複數個第二輸入訊號來產生複數個輸出訊號，該複數個輸出訊號的個數等於該複數個第一輸入訊號之個數與該複數個第二輸入訊號之個數的乘積，該複數個第一輸入訊號係為一相鄰第二矩陣解碼單元之輸出或該複數組第三電壓準位轉換單元中其中一組第三電壓準位轉換單元之輸出，以及該複數個第二輸入訊號係為一相鄰第二矩陣解碼單元之輸出或該複數組第三電壓準位轉換單元中其中一組第三電壓準位轉換單元，該複數組第三電壓準位轉換單元中每一組第三電壓準位轉換單元之個數的乘積等於(C×D)；以及該第三矩陣解碼單元係耦接於該第一矩陣解碼單元與該矩陣解碼模組，並且用於接收該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號，並依據該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號來產生(Z×B)×(C×D)個第三高壓數位輸出訊號。
依據本發明之申請專利範圍，其係揭露一種驅動電路，該驅動電路包含有：複數組第一電壓準位轉換單元、一第一矩陣解碼模組、複數組第二電壓準位轉換單元、一第二矩陣解碼模組以及一第三矩陣解碼單元。該複數組第一電壓準位轉換單元中的每一組第一電壓準位轉換單元係用於接收複數個第一低壓數位輸入訊號，並依據該複數個第一低壓數位輸入訊號來產生複數個第一高壓數位輸入訊號；該第一矩陣解碼模組係用於產生(Z×B)個第一高壓數位輸出訊號，並且該第一矩陣解碼模組包含有複數個第一矩陣解碼單元，而每一個第一矩陣解碼單元係依據複數個第一輸入訊號與複數個第二輸入訊號來產生複數個輸出訊號，該複數個輸出訊號的個數等於該複數個第一輸入訊號之個數與該複數個第二輸入訊號之個數的乘積，該複數個第一輸入訊號係為一相鄰第一矩陣解碼單元之輸出或該複數組第一電壓準位轉換單元中其中一組第一電壓準位轉換單元之輸出，以及該複數個第二輸入訊號係為一相鄰第一矩陣解碼單元之輸出或該複數組第一電壓準位轉換單元中其中一組第一電壓準位轉換單元，該複數組第一電壓準位轉換單元中每一組第一電壓準位轉換單元之個數的乘積等於(Z×B)；該複數組第二電壓準位轉換單元中的每一組第二電壓準位轉換單元係用於接收複數個第二低壓數位輸入訊號，並依據該複數個第二低壓數位輸入訊號來產生複數個第二高壓數位輸入訊號；該第二矩陣解碼模組係用於產生(C×D)個第二高壓數位輸出訊號，並且該第二矩陣解碼模組包含有複數個第二矩陣解碼單元，而每一個第二矩陣解碼單元係依據複數個第三輸入訊號與複數個 第四輸入訊號來產生複數個輸出訊號，該複數個輸出訊號的個數等於該複數個第三輸入訊號之個數與該複數個第四輸入訊號之個數的乘積，該複數個第三輸入訊號係為一相鄰第二矩陣解碼單元之輸出或該複數組第二電壓準位轉換單元中其中一組第二電壓準位轉換單元之輸出，以及該複數個第四輸入訊號係為一相鄰第二矩陣解碼單元之輸出或該複數組第二電壓準位轉換單元中其中一組第二電壓準位轉換單元，該複數組第二電壓準位轉換單元中每一組第三電壓準位轉換單元之個數的乘積等於(C×D)；以及該第三矩陣解碼單元係耦接於該第一矩陣解碼模組與該第二矩陣解碼模組，並且用於接收該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號，並依據該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號來產生(Z×B)×(C×D)個第三高壓數位輸出訊號。
在本說明書以及後續的申請專利範圍當中使用了某些詞彙來指稱特定的元件，而所屬領域中具有通常知識者應可理解，硬體製造商可能會用不同的名詞來稱呼同一個元件，本說明書及後續的申請專利範圍並不以名稱的差異來作為區分元件的方式，而是以元件在功能上的差異來作為區分的準則，在通篇說明書及後續的請求項當中所提及的「包含有」係為一開放式的用語，故應解釋成「包含有但不限定於」，此外，「耦接」一詞在此係包含有任 何直接及間接的電氣連接手段，因此，若文中描述一第一裝置耦接於一第二裝置，則代表該第一裝置可以直接電氣連接於該第二裝置，或透過其他裝置或連接手段間接地電氣連接至該第二裝置。
請參考第3圖，第3圖所繪示的係為依據本發明之一第一實施例的應用於一液晶顯示面板中之一閘極驅動電路(gate driver)300的簡化方塊示意圖。如第3圖所示，閘極驅動電路300包含有：3個第一電壓準位轉換單元(LS1)311、3個第二電壓準位轉換單元(LS2)312、3個第三電壓準位轉換單元(LS3)313、3個第四電壓準位轉換單元(LS4)314、一第一矩陣解碼單元321、一第二矩陣解碼單元322、一第三矩陣解碼單元323、一第一解碼單元(D1)331、一第二解碼單元(D2)332、一第三解碼單元(D3)333、一第四解碼單元(D4)334以及81個輸出級340，其中，第一解碼單元331係耦接於該3個第一電壓準位轉換單元311，並且用於接收7位元的數位控制訊號X1~X7，並依據數位控制訊號X1~X7中的一部份數位控制訊號來產生3個第一低壓數位輸入訊號(未顯示)；第二解碼單元332係耦接於該3個第二電壓準位轉換單元312，並且用於接收數位控制訊號X1~X7，並依據數位控制訊號X1~X7中的一部份數位控制訊號來產生3個第一低壓數位輸入訊號(未顯示)；第三解碼單元係耦接於該3個第三電壓準位轉換單元313，並且用於接收數位控制訊號X1~X7，並依據數位控制訊號X1~X7中的一部份數位控制訊號X1~X7來產生3個第三低壓數位輸入訊號(未顯示)；以及第四解碼單元係耦接於 該3個第四電壓準位轉換單元314，並且用於接收數位控制訊號X1~X7，並依據數位控制訊號X1~X7中的一部份數位控制訊號X1~X7來產生3個第四低壓數位輸入訊號(未顯示)。接著，該3個第一電壓準位轉換單元311係用於分別接收該3個第一低壓數位輸入訊號其中之一，並依據該3個第一低壓數位輸入訊號來產生3個第一高壓數位輸入訊號(未顯示)；該3個第二電壓準位轉換單元312係用於分別接收該3個第二低壓數位輸入訊號其中之一，並依據該3個第二低壓數位輸入訊號來產生3個第二高壓數位輸入訊號(未顯示)；第一矩陣解碼單元321係耦接於該3個第一電壓準位轉換單元311與該3個第二電壓準位轉換單元312，並且用於接收該3個第一高壓數位輸入訊號與該3個第二高壓數位輸入訊號，並依據該3個第一高壓數位輸入訊號與該3個第二高壓數位輸入訊號來產生(3×3)個(亦即9個)第一高壓數位輸出訊號(未顯示)，換句話說，第一矩陣解碼單元321係為一(3×3)的矩陣解碼單元；該3個第三電壓準位轉換單元313係用於分別接收該3個第三低壓數位輸入訊號其中之一，並依據該3個第三低壓數位輸入訊號來產生3個第三高壓數位輸入訊號(未顯示)；該3個第四電壓準位轉換單元314係用於分別接收該3個第四低壓數位輸入訊號其中之一，並依據該3個第四低壓數位輸入訊號來產生3個第四高壓數位輸入訊號(未顯示)；該第二矩陣解碼單元322係耦接於該3個第三電壓準位轉換單元313與該3個第四電壓準位轉換單元314，並且用於接收該3個第三高壓數位輸入訊號與該3個第四高壓數位輸入訊號，並依據該3個第三高壓數位 輸入訊號與該3個第四高壓數位輸入訊號來產生(3×3)個(亦即9個)第二高壓數位輸出訊號(未顯示)，換句話說，第二矩陣解碼單元322係為一(3×3)的矩陣解碼單元；第三矩陣解碼單元323係耦接於第一矩陣解碼單元321與第二矩陣解碼單元322，並且用於接收該9個第一高壓數位輸出訊號與該9個第二高壓數位輸出訊號，並依據該9個第一高壓數位輸出訊號與該9個第二高壓數位輸出訊號來產生(9×9)個(亦即81個)第三高壓數位輸出訊號(未顯示)，換句話說，第三矩陣解碼單元323係為一(9×9)的矩陣解碼單元；以及81個輸出級340係耦接於第三矩陣解碼單元323，並且用於接收該81個第三高壓數位輸出訊號。另外，81個輸出級340係分別耦接於81條閘極線G1~G81的其中之一，換句話說，81個輸出級340與81條閘極線G1~G81係為一一相對應的。此外，由於矩陣解碼單元的內部電路架構與運作方式係為習知技術，所以為了簡潔起見，在此不多加贅述關於第一矩陣解碼單元321、第二矩陣解碼單元322以及第三矩陣解碼單元323的內部電路架構與運作方式。
接著，在此請注意，上述的實施例係僅作為本發明的舉例說明，而不是本發明的限制條件，本發明的閘極驅動電路300可以依據各種不同的所需要之輸出訊號數量來設計，舉例來說，當所需要之輸出訊號數量為160個時(亦即與習知技術中的美國專利公開案號第20070103346號之閘極驅動電路的輸出訊號數量相同，當閘極線有160條時)，閘極驅動電路300可以電路包含有： 4個第一電壓準位轉換單元(LS1) 311 、4個第二電壓準位轉換單元(LS2)312、一(4×4)的第一矩陣解碼單元321、5個第三電壓準位轉換單元(LS3)313、2個第四電壓準位轉換單元(LS4)314、一(5×2)的第二矩陣解碼單元322、一(16×10)的第三矩陣解碼單元323、一第一解碼單元(D1)331、一第二解碼單元(D2)332、一第三解碼單元(D3)333、一第四解碼單元(D4)334以及160個輸出級340。由上述的說明可以了解到本發明的閘極驅動電路與習知技術中的美國專利公開案號第20070103346號之閘極驅動電路相較之下，能夠大幅地降低所需要的高壓元件(亦即電壓準位轉換單元)之數量(例如從28個降低到15個，數量減少幅度高達46.4%)，因此本發明可以有效地縮小閘極驅動電路的面積。
請參考第4A圖以及第4B圖，第4A圖以及第4B圖所繪示的係為依據本發明之一第二實施例的應用於一液晶顯示面板中之一閘極驅動電路400的簡化方塊示意圖。如第4A圖以及第4B圖所示，閘極驅動電路400包含有：3個第一電壓準位轉換單元(LS1)411、3個第二電壓準位轉換單元(LS2)412、3個第三電壓準位轉換單元(LS3)413、3個第四電壓準位轉換單元(LS4)414、3個第五電壓準位轉換單元(LS5)415、3個第六電壓準位轉換單元(LS6)416、3個第七電壓準位轉換單元(LS7)417、3個第八電壓準位轉換單元(LS8)418、一第一解碼單元(D1)431、一第二解碼單元(D2)432、一第三解碼單元(D3)433、一第四 解碼單元(D4)434、一第五解碼單元(D5)435、一第六解碼單元(D6)436、一第七解碼單元(D7)437、一第八解碼單元(D8)438、一第一矩陣解碼模組420、一第二矩陣解碼模組425、一(81×81)的第三矩陣解碼單元429以及6561個輸出級440，其中，第一矩陣解碼模組420係包含有一(3×3)的第一矩陣解碼單元421、一(3×3)的第一矩陣解碼單元422以及一(9×9)的第一矩陣解碼單元423，以及第二矩陣解碼模組425係包含有一(3×3)的第二矩陣解碼單元421、一(3×3)的第二矩陣解碼單元422以及一(9×9)的第二矩陣解碼單元423，並且第4A圖中的第二矩陣解碼單元423係耦接於第4B圖中的第三矩陣解碼單元429；另外，6561個輸出級440係分別耦接於6561條閘極線G1~G6561的其中之一，換句話說，6561個輸出級440與6561條閘極線G1~G6561係為一一相對應的。此外，上述的實施例係僅作為本發明的舉例說明，而不是本發明的限制條件，類似於本發明之第一實施例中的閘極驅動電路300，本發明的閘極驅動電路400同樣可以依據各種不同的所需要之輸出訊號數量來設計，而為了簡潔起見，在此不多加贅述其他可據以實現的實施例。
接著，在此請注意，由於本發明之第二實施例係以本發明之第一實施例為基礎而發展出來的，第4A圖以及第4B圖中閘極驅動電路400的內部元件連接架構以及運作方式與第3圖中的閘極驅動電路300具有相同的概念，所以為了簡潔起見，在此不多加贅述關於閘極驅動電路400的內部元件連接架構以及運作方式。 此外，熟習本項相關技藝者於閱讀上述的說明內容與圖示之後應該可以清楚地瞭解只要具有由複數個矩陣解碼單元所構成的階級式矩陣解碼器(hierarchical matrix decoder)的任一閘極驅動電路，就應屬於本發明所揭露的申請專利範圍。
綜上所述，本發明所揭露的閘極驅動電路與習知技術中的閘極驅動電路相較之下，能夠大幅地降低所需要的高壓元件(亦即電壓準位轉換單元)之數量，因此本發明可以有效地縮小閘極驅動電路的面積。
以上所述僅為本發明之較佳實施例，凡依本發明申請專利範圍所做之均等變化與修飾，皆應屬本發明之涵蓋範圍。
100‧‧‧閘極驅動電路
101‧‧‧解碼器
102‧‧‧電壓移位器
103‧‧‧輸出級
G1~Gm‧‧‧閘極線
X0~Xm‧‧‧控制信號
200‧‧‧矩陣解碼器
201、202‧‧‧預先解碼器
203‧‧‧解多工器
212‧‧‧輸出級
213‧‧‧邏輯單元
214、215‧‧‧開關
216‧‧‧電壓源
221~228、230~249‧‧‧電壓移位器
G0~G159‧‧‧閘極線
X0~X159‧‧‧控制信號
300‧‧‧閘極驅動電路
311‧‧‧第一電壓準位轉換單元(LS1)
312‧‧‧第二電壓準位轉換單元(LS2)
313‧‧‧第三電壓準位轉換單元(LS3)
314‧‧‧第四電壓準位轉換單元(LS4)
321‧‧‧第一矩陣解碼單元
322‧‧‧第二矩陣解碼單元
323‧‧‧第三矩陣解碼單元
331‧‧‧第一解碼單元(D1)
332‧‧‧第二解碼單元(D2)
333‧‧‧第三解碼單元(D3)
334‧‧‧第四解碼單元(D4)
340‧‧‧輸出級
G1~G81‧‧‧閘極線
X1~X7‧‧‧數位控制訊號
411‧‧‧第一電壓準位轉換單元(LS1)
412‧‧‧第二電壓準位轉換單元(LS2)
413‧‧‧第三電壓準位轉換單元(LS3)
414‧‧‧第四電壓準位轉換單元(LS4)
415‧‧‧第五電壓準位轉換單元(LS5)
416‧‧‧第六電壓準位轉換單元(LS6)
417‧‧‧第七電壓準位轉換單元(LS7)
418‧‧‧第八電壓準位轉換單元(LS8)
420‧‧‧第一矩陣解碼模組
425‧‧‧第二矩陣解碼模組
421~423‧‧‧第一矩陣解碼單元
426~428‧‧‧第二矩陣解碼單元
429‧‧‧第三矩陣解碼單元
431‧‧‧第一解碼單元(D1)
432‧‧‧第二解碼單元(D2)
433‧‧‧第三解碼單元(D3)
434‧‧‧第四解碼單元(D4)
435‧‧‧第五解碼單元(D5)
436‧‧‧第六解碼單元(D6)
437‧‧‧第七解碼單元(D7)
438‧‧‧第八解碼單元(D8)
440‧‧‧輸出級
G1~G6561‧‧‧閘極線
X1~X13‧‧‧數位控制訊號
第1圖所繪示的係為習知技術中應用於一液晶顯示面板中之一閘極驅動電路的簡化方塊示意圖。
第2圖所繪示的係為美國專利公開案號第20070103346號中應用於一液晶顯示面板之閘極驅動電路中的一矩陣解碼器之簡化方塊示意圖。
第3圖所繪示的係為依據本發明之一第一實施例的應用於一液晶顯示面板中之一閘極驅動電路的簡化方塊示意圖。
第4A圖以及第4B圖所繪示的係為依據本發明之一第二實施例的 應用於一液晶顯示面板中之一閘極驅動電路的簡化方塊示意圖。
300‧‧‧閘極驅動電路
311‧‧‧第一電壓準位轉換單元(LS1)
312‧‧‧第二電壓準位轉換單元(LS2)
313‧‧‧第三電壓準位轉換單元(LS3)
314‧‧‧第四電壓準位轉換單元(LS4)
321‧‧‧第一矩陣解碼單元
322‧‧‧第二矩陣解碼單元
323‧‧‧第二矩陣解碼單元
331‧‧‧第一解碼單元(D1)
332‧‧‧第二解碼單元(D2)
333‧‧‧第三解碼單元(D3)
334‧‧‧第四解碼單元(D4)
340‧‧‧輸出級
G1~G81‧‧‧閘極線
X1~X7‧‧‧數位控制訊號

Claims (12)

  1. 一種驅動電路，包含有：Z個第一電壓準位轉換單元，用於分別接收Z個第一低壓數位輸入訊號其中之一，並依據該Z個第一低壓數位輸入訊號來產生Z個第一高壓數位輸入訊號；B個第二電壓準位轉換單元，用於分別接收B個第二低壓數位輸入訊號其中之一，並依據該B個第二低壓數位輸入訊號來產生B個第二高壓數位輸入訊號；一第一矩陣解碼單元，耦接於該Z個第一電壓準位轉換單元與該B個第二電壓準位轉換單元，用於接收該Z個第一高壓數位輸入訊號與該B個第二高壓數位輸入訊號，並依據該Z個第一高壓數位輸入訊號與該B個第二高壓數位輸入訊號來產生(Z×B)個第一高壓數位輸出訊號；C個第三電壓準位轉換單元，用於分別接收C個第三低壓數位輸入訊號其中之一，並依據該C個第三低壓數位輸入訊號來產生C個第三高壓數位輸入訊號；D個第四電壓準位轉換單元，用於分別接收D個第四低壓數位輸入訊號其中之一，並依據該D個第四低壓數位輸入訊號來產生D個第四高壓數位輸入訊號；一第二矩陣解碼單元，耦接於該C個第三電壓準位轉換單元與該D個第四電壓準位轉換單元，用於接收該C個第三高壓數位輸入訊號與該D個第四高壓數位輸入訊號，並依據 該C個第三高壓數位輸入訊號與該D個第四高壓數位輸入訊號來產生(C×D)個第二高壓數位輸出訊號；以及一第三矩陣解碼單元，耦接於該第一矩陣解碼單元與該第二矩陣解碼單元，用於接收該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號，並依據該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號來產生(Z×B)×(C×D)個第三高壓數位輸出訊號。
  2. 如申請專利範圍第1項所述之驅動電路，其另包含有：一第一解碼單元，耦接於該Z個第一電壓準位轉換單元，用於接收複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該Z個第一低壓數位輸入訊號；一第二解碼單元，耦接於該B個第二電壓準位轉換單元，用於接收該複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該B個第一低壓數位輸入訊號；一第三解碼單元，耦接於該C個第三電壓準位轉換單元，用於接收該複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該C個第三低壓數位輸入訊號；以及一第四解碼單元，耦接於該D個第四電壓準位轉換單元，用於 接收該複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該D個第四低壓數位輸入訊號。
  3. 如申請專利範圍第1項所述之驅動電路，其另包含有：(Z×B)×(C×D)個輸出級，耦接於該第三矩陣解碼單元，用於接收該(Z×B)×(C×D)個第三高壓數位輸出訊號。
  4. 如申請專利範圍第1項所述之驅動電路，其係為應用於一液晶顯示面板中的一閘極驅動電路(gate driver)。
  5. 一種驅動電路，包含有：Z個第一電壓準位轉換單元，用於分別接收Z個第一低壓數位輸入訊號其中之一，並依據該Z個第一低壓數位輸入訊號來產生Z個第一高壓數位輸入訊號；B個第二電壓準位轉換單元，用於分別接收B個第二低壓數位輸入訊號其中之一，並依據該B個第二低壓數位輸入訊號來產生B個第二高壓數位輸入訊號；一第一矩陣解碼單元，耦接於該Z個第一電壓準位轉換單元與該B個第二電壓準位轉換單元，用於接收該Z個第一高壓數位輸入訊號與該B個第二高壓數位輸入訊號，並依據該Z個第一高壓數位輸入訊號與該B個第二高壓數位輸入訊號來產生(Z×B)個第一高壓數位輸出訊號； 複數組第三電壓準位轉換單元，每一組第三電壓準位轉換單元用於接收複數個第三低壓數位輸入訊號其中之一，並依據該複數個第三低壓數位輸入訊號來產生複數個第三高壓數位輸入訊號；一矩陣解碼模組，用於產生(C×D)個第二高壓數位輸出訊號，該矩陣解碼模組包含有複數個第二矩陣解碼單元，每一個第二矩陣解碼單元係依據複數個第一輸入訊號與複數個第二輸入訊號來產生複數個輸出訊號，該複數個輸出訊號的個數等於該複數個第一輸入訊號之個數與該複數個第二輸入訊號之個數的乘積，該複數個第一輸入訊號係為一相鄰第二矩陣解碼單元之輸出或該複數組第三電壓準位轉換單元中其中一組第三電壓準位轉換單元之輸出，以及該複數個第二輸入訊號係為一相鄰第二矩陣解碼單元之輸出或該複數組第三電壓準位轉換單元中其中一組第三電壓準位轉換單元，該複數組第三電壓準位轉換單元中每一組第三電壓準位轉換單元之個數的乘積等於(C×D)；以及一第三矩陣解碼單元，耦接於該第一矩陣解碼單元與該矩陣解碼模組，用於接收該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號，並依據該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號來產生(Z×B)×(C×D)個第三高壓數位輸出訊號。
  6. 如申請專利範圍第5項所述之驅動電路，其另包含有： 一第一解碼單元，耦接於該Z個第一電壓準位轉換單元，用於接收複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該Z個第一低壓數位輸入訊號；一第二解碼單元，耦接於該B個第二電壓準位轉換單元，用於接收該複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該B個第一低壓數位輸入訊號；以及複數個第三解碼單元，分別對應於該複數組第三電壓準位轉換單元，每一個第三解碼單元用於接收該複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該複數個第三低壓數位輸入訊號至相對應的一組第三電壓準位轉換單元。
  7. 如申請專利範圍第5項所述之驅動電路，其另包含有：(Z×B)×(C×D)個輸出級，耦接於該第三矩陣解碼單元，用於接收該(Z×B)×(C×D)個第三高壓數位輸出訊號。
  8. 如申請專利範圍第5項所述之驅動電路，其係為應用於一液晶顯示面板中的一閘極驅動電路。
  9. 一種驅動電路，包含有：複數組第一電壓準位轉換單元，每一組第一電壓準位轉換單 元用於接收複數個第一低壓數位輸入訊號，並依據該複數個第一低壓數位輸入訊號來產生複數個第一高壓數位輸入訊號；一第一矩陣解碼模組，用於產生(Z×B)個第一高壓數位輸出訊號，該第一矩陣解碼模組包含有複數個第一矩陣解碼單元，每一個第一矩陣解碼單元係依據複數個第一輸入訊號與複數個第二輸入訊號來產生複數個輸出訊號，該複數個輸出訊號的個數等於該複數個第一輸入訊號之個數與該複數個第二輸入訊號之個數的乘積，該複數個第一輸入訊號係為一相鄰第一矩陣解碼單元之輸出或該複數組第一電壓準位轉換單元中其中一組第一電壓準位轉換單元之輸出，以及該複數個第二輸入訊號係為一相鄰第一矩陣解碼單元之輸出或該複數組第一電壓準位轉換單元中其中一組第一電壓準位轉換單元，該複數組第一電壓準位轉換單元中每一組第一電壓準位轉換單元之個數的乘積等於(Z×B)；複數組第二電壓準位轉換單元，每一組第二電壓準位轉換單元用於接收複數個第二低壓數位輸入訊號，並依據該複數個第二低壓數位輸入訊號來產生複數個第二高壓數位輸入訊號；一第二矩陣解碼模組，用於產生(C×D)個第二高壓數位輸出訊號，該第二矩陣解碼模組包含有複數個第二矩陣解碼單元，每一個第二矩陣解碼單元係依據複數個第三輸入訊號與複數個第四輸入訊號來產生複數個輸出訊號，該複數 個輸出訊號的個數等於該複數個第三輸入訊號之個數與該複數個第四輸入訊號之個數的乘積，該複數個第三輸入訊號係為一相鄰第二矩陣解碼單元之輸出或該複數組第二電壓準位轉換單元中其中一組第二電壓準位轉換單元之輸出，以及該複數個第四輸入訊號係為一相鄰第二矩陣解碼單元之輸出或該複數組第二電壓準位轉換單元中其中一組第二電壓準位轉換單元，該複數組第二電壓準位轉換單元中每一組第三電壓準位轉換單元之個數的乘積等於(C×D)；以及一第三矩陣解碼單元，耦接於該第一矩陣解碼模組與該第二矩陣解碼模組，用於接收該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號，並依據該(Z×B)個第一高壓數位輸出訊號與該(C×D)個第二高壓數位輸出訊號來產生(Z×B)×(C×D)個第三高壓數位輸出訊號。
  10. 如申請專利範圍第9項所述之驅動電路，其另包含有：複數個第一解碼單元，分別對應於該複數組第一電壓準位轉換單元，每一個第一解碼單元用於接收該複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該複數個第一低壓數位輸入訊號至相對應的一組第一電壓準位轉換單元；以及複數個第二解碼單元，分別對應於該複數組第二電壓準位轉換 單元，每一個第二解碼單元用於接收該複數個數位控制訊號，並依據該複數個數位控制訊號中至少一部份數位控制訊號來產生該複數個第二低壓數位輸入訊號至相對應的一組第二電壓準位轉換單元。
  11. 如申請專利範圍第9項所述之驅動電路，其另包含有：(Z×B)×(C×D)個輸出級，耦接於該第三矩陣解碼單元，用於接收該(Z×B)×(C×D)個第三高壓數位輸出訊號。
  12. 如申請專利範圍第9項所述之驅動電路，其係為應用於一液晶顯示面板中的一閘極驅動電路。
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