TW527840B - Synchronization of a low power oscillator with a reference oscillator in a wireless communication device utilizing slotted paging - Google Patents

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Kenneth D Easton
Nicholas K Yu
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Description

527840 五、發明說明(1) 發明背景 I .發明領域 「本發明係關於無線通訊裝置之時脈信號產生。特別本發 明係關於一種新穎及改良之於無線通訊裝置利用分時呼叫 同步化低功率振盪器與參考振盪器之方法及電。 II.相關技術之說明 典型無線通訊系統中,分時呼叫被用以延長行動站待機 時間,因而延長電池壽命。行動站例如為蜂巢式或P C S電 話或無線當地回路(W L L)手機。例如於美國專利第 5,3 9 2,2 8 7號名稱「於行動接收機減少功率消耗之裝置及 方法」1 9 9 5年2月2 1日獲頒且讓與本發明之受讓人,併述 於此以供參考,敘述之無線電話系統中,揭示一種分時呼 叫系統。 前述專利案中,敘述一種於具有發送機及一或多部接收 機的通訊系統中減少接收機的功率消耗之系統,其中來自 發送機至接收機的定期訊息被排程於「時槽」。各接收機 於監視傳輸時被指定一時槽。發送機唯有於指定的時槽發 送訊息至該接收機。接收機於其指定的時槽處於「激活 態」。如果訊息要求接收機執行額外動作,則接收機於其 指定時槽之後可保持激活態。此種激活態常稱作「叫醒」 態。 於「鈍化態」期間,此乃連續指定的時槽出現間的時間 間期,接收機可能執行任何無須與發送機協調的動作。此 段期間藉由由一或多個組件去除功率例如監視傳輸的組件
第5頁 527840 五、發明說明(2) 去除功率可節省電力。此種鈍化態常稱作「休眠」態。於 指定時槽之前不久於鈍化態期間,接收機外加功率至此等 組件並執行初始化動作。若於先前鈍化態期間,接收機的 時序信號已經偏離非與發送機同步,則初始化可能包括重 新獲得一試驗頻道信號,接收機使本身與該信號同步。 當行動站處於待機模時,換言之未完全活性接合一呼叫 時,待機時間以及電池壽命係由行動站處於休眠模消耗電 流量多達主控。於典型行動站,當行動站處於休眠模時,· >肖耗功毕約為於待機模期間平均電流 >肖耗ϊ之半。 雖然行動站處於休眠模,但須至少維持一計數器來測量 休眠時間,因此當於次一被指定的時槽時可「醒來」。於 大半行動站,使用極為準確的時間參考值例如溫度補償晶 體振盪器(TCX0)來測量休眠時間。1:外其它時脈信號產生 電路例如時脈緩衝器、時脈劃分器及其它相關時脈產生元 件典型須用以由TCX0參考值產生一有用且可靠的時脈信 號。雖然如此獲得高度準確的時脈計畫,但全部組件仍消 耗相當ΐ電流’約為3宅老j。 為了降低休眠期的電流消耗,藉此延長待機時間,提議 於脉眠模期間須關閉TCX0以及相關時脈信號產生電路,且 使用低功率較低準確度的晶體振盪器替代。由於TCX0許可 的準確度及TCX0產生的高頻於行動站醒來時最要緊,故提 議使用低功率振盪器來計量休眠間,此時準確度較為不 具關鍵重要性,且高時脈頻率解析度也較不重要。 此外,低功率低頻晶體振盪器製造上相對廉價,普遍用
第6頁 527840 五、發明說明(3) 於手錶等用途。因此供應來源易得。其比較較為準確的晶 體振盪器消耗電流也極小,約為0. 0 1 5毫安。所有此等電 流節省及成本使其用於行動站計量休眠期具有吸引力。 但此等低功率低頻晶體振盪器之缺點在於於預期的作業 溫度範圍對溫度變化敏感,變化約為60 PPM。其無法校正 且無法補償。此外時間解析度粗糙。所有此等誤差皆減低 其適當監控行動站休眠期的能力。 一種補償此等低功率晶體振盪器特有誤差之方式提示於· 美國專利第5,4 2 8,8 2 0號,名稱「適應性無線接收機控制 器方法及裝置」,1 9 9 5年6月2 7日獲頒且讓與摩托羅拉公 司。本專利案中,行動站利用低成本、低功率、低頻振盪 器來計量休眠期。低功率振盪器之特有誤差藉由依據前一 休眠期的時序準確度調適目前休眠期長度考慮在内。換言 之,若前一休眠期由於低功率振盪器的誤差導致時間過 長,則行動站於目前休眠期將提早醒來。為了決定休眠期 是否過長或過短,行動站尋找一獨特字,例如來自發送器 的訊息前言其表示被指定時槽的起點。若未接收到獨特 字,則行動站太晚被叫醒故縮短休眠期。若接收到一有效 獨特字,則行動站準時或過早叫醒,因此略微增長休眠時 間。 5,4 2 8,8 2 0專利案之一大缺點為其仰賴偶爾不正確的接 收到獨特字來找到正確的休眠期。又若獨特字未被正確接 收以及解調,則休眠期基於預期修眠期長度為錯誤長度而’ 被改變。除了獨特字未被準確接收及解調之休眠期長度理
第7頁 527840 五、發明說明(4) 由外也有若干其它理由包括通訊頻道品質條件。 需要有一種方法及電路考慮低功率振盪器的誤差來避免 先前技術的限制,同時可靠地計量行動站的休眠期。 發明概述 「本發明為一種新穎及改良之控制於分時呼叫環境下作業 的行動站之方法及電5^。本發明利用之事實為行動站於整 個叫醒時間接收到來自發送機的穩定時間參考,並監控其 被指定的呼叫時槽。於此叫醒期間,低頻時脈信號再度與 高頻時脈信號同步化,藉此避免先前技術的限制,先前技 術需要接收及解調一獨特字俾便決定適當休眠間期。 該電路包含一低功率時脈用於產生一低頻時脈信號;一 時脈信號產生器用以產生一高頻時脈信號;一同步化邏輯 電路用以使低頻時脈信號與高頻時脈信號同步化;一頻率 誤差估計器用以測量低頻時脈信號估值;及一休眠控制器 用以由時脈信號產生器去除功率用以產生校正後之休期眠 數值。較佳具體例中,電路進一步包含一可程式規劃計數 器用以計量校正後之休眠時間值,及休眠控制器使用校正 後之休眠時間值程式規劃該可程式規劃的計數器。 一具體例中,同步化邏輯電路包含至少一數位閂鎖用以 對正低頻時脈信號之上升緣至高頻時脈信號之上升緣。頻 率誤差估計器也包含一計數器用以計數每個低頻時脈信號 間期之高頻時脈信號間期數目:及一累加器,用以累加介 於每個低頻時脈信號間期之預期高頻時脈信號間期數目、 與每個低頻時脈信號間期之實際高頻時脈信號間期數目間
第8頁 527840 五 '發明說明(5) 之差值3 圖式之簡單說明 本發明之特點、目的及優點由後文詳細說明參照附圖將 顯然易明,附圖中類似參考符號表示各圖中之相同對應元 件,附圖中: 圖1為本發明之電路之功能方塊圖,以及 圖2為本發明方法之流程圖。 較佳具體例之詳細說明 本發明特別可用於無線通訊裝置或行動站例如可攜式無 線電話其係於分時呼叫環境作業。分時呼叫作業中,行動 站於其未被指定的呼叫時槽保持休眠,而在其被指定的呼 叫時槽之前即刻醒來,如前文參照併述於此之美國專利第 5,3 9 2,2 8 7 號所述。 圖1顯示本發明電路之功能方塊圖。時脈信號產生器2 0 2 產生高頻高準綠度時脈信號。較佳時脈信號產生器2 0 2包 括一參考振盪器2 0 4及一時脈合成器2 0 6 (如圖所示)。但時 脈信號產生器2 0 2可為業界已知之任一種時脈信號產生電 路。本發明未限於時脈信號產生器2 0 2的實際構造。 較佳具體例中,如業界已知,參考振盪器2 0 4可為經補 償且可校正的晶體振盪器例如TCX0或電壓控制TCX0 (VCTCX0)。參考振盪器2 0 4較佳產生高頻信號而由接收機 2 0 0用於獲得及解調R F信號。如此參考振盪器2 0 4對準確高 頻信號產生為最適化。較佳具體例中,參考振盪器2 0 4產 生1 9 . 6 8 Μ z信號或其它適當R F參考頻率1 9 . 2,1 9 . 8
第9頁 527840 五、發明說明(6) (Μ Η z )等。時脈合成器2 0 6較佳包含數位時脈產生邏輯,包 括頻率劃分器、時脈緩衝器、及其它業界習知用於時脈的 組件。較佳具體例中,由時脈合成器2 0 6產生的時脈信號 具有頻率9 . 8 3 0 4 Μ Η ζ。 當使用本發明之行動站被叫醒時,其監視其被指定的呼 叫頻道。由此被指定的呼叫頻道,行動站獲得一準確時序 參考值。接收機2 0 0如業界已知,使用參考振盪器2 0 4提供 的參考頻率,接收及解調由發送器2 0 1發送的呼叫頻道。 接收機2 0 0之一具體例之構造進一步敘述於美國專利申請 案第0 8 / 7 7 9,6 0 1號,名稱「雙模數位F Μ通訊系統」,申請 曰1 9 9 7年1月7日,讓與本發明之受讓人且併述於此以供參 考。 如前述專利案說明的接收機2 0 0包括一頻率追蹤回路, 俗稱AFC (自動頻率控制)(圖中未顯示),其響應接收自發 送器2 0 1之RF信號相位產生一頻率誤差信號由參考振盪器 使用。因發送器2 0 1發送的R F信號相位經同步化至穩定系 統時間,故接收機2 0 0可由接收得之R F信號相位導出穩定 時間參考值。外加於參考振盪器2 0 4的頻率誤差信號有助 於封閉回路追蹤接收得的RF載波頻率,結果獲得極為強勁 有力的高度準確高頻參考信號,其由參考振盪器2 0 4輸出 至時脈合成器2 0 6。相位及追蹤頻率回路為業界眾所周 知,多種不同回路可視需要用以校正參考振盪器2 0 4的頻 毕 ° 此外須注意,本發明非僅適用於有外部時間參考值可資
第10頁 527840 五、發明說明(7) 利用的用途。換言之,時脈信號產生器2 0 2可為孤立參考 值,位在行動站内部或外部。以孤立參考值為例,假設時 脈信號產生器2 0 2未經任何外部校正而充分正確。 卩寺脈信號產生器202也包括一致能輸入,於圖1標示為 F 0N/0FF」,此處致能信號可外加而開關時脈信號產生器 2 0 2。當時脈信號產生器2 0 2為開時,其產生前述時脈信 號。但當一去能信號外加至時脈信號產生器2 0 2之致能輸 入時,其停止產生前述時脈信號。電壓調節器也被去能。 此外,當時脈信號產生器2 0 2被去能時,大致全部構成時 脈信號產生器2 0 2的組件皆被關電。如此當去能信號外加 至時脈信號產生器2 0 2的致能輸入時,其大致消耗零電 流川。 它方面,低功率時脈2 2 4較佳為3 2. 7 6 8 kHz晶體振盪器 以及常見且如前述的關聯電路。但須注意於其它具體例 中,須使用其它振盪器設計而未改變本發明之性質。較佳 具體例中,低功率時脈2 2 4於行動站電源開啟時保持開 電。此乃與時脈信號產生器2 0 2相反,其於行動站於休眠 模式被關電。當行動站於休眠模式,低功率時脈2 2 4保持 電源開且產生一低頻時脈信號。 休眠控制器2 2 2程式規劃一休眠時間值至可程式規劃計 數器2 2 6。休眠間隔時間隨連續指定時槽間之時間長短以 及隨低功率時脈2 2 4之頻率誤差估值而異,容後詳述。如 業界已知,休眠控制器2 2 2可為習知微處理器,使用軟體 指令程式規劃,其連同關聯電路及記憶體一起控制休眠期
第11頁 527840 五、發明說明(8) 的進出。須注意,雖然休眠控制器係以單一功能方塊舉例 說明,但實體上可以若干組件及關聯的軟體執行。可程式 規劃計數器2 2 6如業界已知可為任一種適當計數器或計時 σσ 由低功率時脈2 2 4產生的低頻時脈信號被接收作為可程 式規劃計數器2 2 6之一輸入。藉低頻時脈信號計時,可程 式規劃計數器2 2 6根據由休眠控制器2 2 2先前程式規劃的休 眠時間長度值,倒數計數至到期為止。當可程式規劃計數 器2 2 6到期時,致能信號由休眠控制器2 2 2輸出而致能時脈 信號產生器2 0 2的輸入。藉此方式當行動站由休眠模退出 且準備監視器被指定的呼叫頻道時槽時,時脈信號產生器 2 0 2之電源開啟。 相反地,於監視器被指定的呼叫頻道時槽後,若不再有 供給行動站的訊息,則休眠控制器2 2 2發送一去能信號至 時脈信號產生器2 0 2的致能輸入,藉此關閉構成時脈信號 產生器2 0 2之大致全部時脈信號產生組件,包括參考振盪 器2 0 4及時脈合成器2 0 6,而僅留下低功率時脈2 2 4被激勵 而計時由休眠控制器2 2 2載入可程式規劃計數器2 2 6的次一 休眠期數值。 如至目前為止所述,顯然本發明藉由於休眠模期間切斷 時脈信號產生器2 0 2的電源來節省休眠模期間的電流,同 時留下低功率時脈2 2 4被激勵而計時休眠期長短。但如前 述,低功率時脈2 2 4由於其構造本質以及溫度及製造品質 有某些預期的頻率誤差。本發明藉由再度同步化低頻時脈
第12頁 527840 五、發明說明(9) 2 2 4與較為準確且穩定的時脈信號產生器2 0 2,而將低功率 時脈2 2 4的誤差考慮在内。 低功率時脈2 2 4產生低頻時脈信號被接收作為同步化邏 輯2 0 8的第一輸入。時脈信號產生器2 0 2產生的高頻時脈信 號被接收作為同步化邏輯2 0 8的第二輸入。 同步化邏輯2 0 8之較佳具體例舉例說明於圖1為三個串聯 聯結的反相閂鎖,接著為一 A N D閘其有一反相輸入。但須 注意其它數位邏輯也可未悖離本發明用以達成相同功能。 較佳具體例中,時脈信號產生器2 0 2產生的高頻時脈信 號被接收作為第一閂鎖2 1 0的時脈輸入。低功率時脈2 2 4產 生的低頻時脈信號被接收作為第一閂鎖2 1 0之資料輸入。 如業界已知,典型數位閂鎖有一架設與維持時間,且於輸 出產生如同閂鎖被計時時存在於輸入的相同邏輯值(或其 反相值)。如此第一閂鎖2 1 0的輸出為波形,其具有極為類 似低功率時脈2 2 4產生的低頻時脈信號之形狀及間期,但 若第一閂鎖2 1 0為反相閂鎖則可被反相。顯著差異在於來 自第一閂鎖2 1 0之輸出之上升或下降緣將與計時第一閂鎖 2 1 0之高頻時脈信號之上升或下降緣同步。 第一閂鎖2 1 0之輸出被接收作為第二閂鎖2 1 2的資料輸 入。同理,第二閂鎖2 1 2的輸出被接收作為第三閂鎖2 1 4的 資料輸入。全部閂鎖2 1 0 - 2 1 4皆由時脈信號產生器2 0 2產生 的高頻時脈信號計時。第二閂鎖2 1 2及第三閂鎖2 1 4執行前 文參照第一閂鎖2 1 0所述的相同同步化功能。 最後,第三閂鎖2 1 4的輸出被接收作為A N D閘2 1 6的反相
第13頁 527840 五、發明說明(1 〇) 輸入,第二閂鎖2 1 2的輸出被外加作為A N D問2丨6的非反相 ^入]如^界人士顯然易知,閃鎖210 一214及AND閘2丨6用 以將低功率時脈2 2 4產生的低頻時脈信號與時脈信號產生 哭? 0 ?產生的高頻時脈信號同步化且其用以進行緣偵測。 °°須注~意可使用更多或更少問鎖以及其它數位邏輯來替代 圖1說明者。同步化邏輯2 0 8之其它實施例對業界人士顯然 易知。但於較佳具體例中,為了防止與閃鎖關聯的任何介 稃問題,且如業界已知多個問鎖用來減少閃鎖的介穩之統 計學可能率以及結果導致低頻時脈信號波形完整性喪失。 同步化邏輯2 0 8輸出同步化低頻時脈信號至頻率誤差估 器2 1 7。較佳具體例中,頻率估計器2 1 7包含9位元向上計 數器2 1 8及1 6位元累加器2 2 0。同步化低頻時脈信號外加至 9位元向上計數器2 1 8之復置輸入。由時脈信號產生器2 0 2 產生的高頻時脈信號外加至9位元向上計數器2 1 8的時脈輸 入。較佳具體例中,9位元向上計數器2 1 8由同步化低頻時 脈信號復置至-3 0 0 ( - 1 6 0十六進位數字)。如此對各同步 化低頻時脈信號間期而言,9位元向上計數器被復置且由 - 3 0 0重新開始向上計數。因較佳具體例中由時脈信號產生 器2 0 2產生的高頻時脈信號頻率為9 · 8 3 0 4 Μ Η z,及由同步 化邏輯2 0 8產生的同步化低頻時脈信號頻率為3 2 . 7 6 8 k Η ζ,故名目上對各個同步化低頻率時脈信號間期恰有3 〇 〇 個高頻時脈信號間期。如此對每次9位元向上計數器2 1 8由 同步化低頻時脈信號被復置至-3 0 0時,名目上應藉由高頻 時脈信號的計時一路向上倒數至零。
第14頁 527840 五、發明說明(11) 因9位元向上計數器2 1 8於復置前必須已經名目上倒數計 時為零,故任何仍然保留的計數或任何超過零的計數皆代 表低功率時脈2 2 4對一低頻時脈信號間期產生的頻率誤差 估值。個別誤差計數值外加至1 6位元累加器2 2 0的輸入, 於該處被累加經過同步化低頻時脈信號之2 5 6間期。1 6位 元累加器2 2 0隨後供給頻率誤差估值至休眠控制器2 2 2。 須注意9位元向上計數器2 1 8及1 6位元累加器2 2 0之確切 位元大小及構造對本發明而言並無特殊限制。其它具有較’ 大或較小尺寸的計數器,例如8位元計數器或1 0位元計數 器可未悖離本發明供使用。又業界人士顯然易知可以類似 大小的向下計數器置換9位元向上計數器2 1 8,且被復置至 + 3 0 0。此外同理,9位元向上計數器2 1 8使用的-3 0 0復置值 僅為高頻時脈信號頻率除以同步化低頻時脈信號頻率之 值,任何其它復置值也可依據相關實際頻率使用。又另一 具體例中,計數器2 1 8本身未被復置,但可由其輸出扣除 一個常數俾便規度化頻率誤差。 此外,業界人士顯然易知1 6位元累加器2 2 0可由具有不 同大小或不同構造的裝置替代例如整合與傾銷元件。累加 頻率誤差估值經歷2 5 6週期被選用作為統計學上有意義且 方便的平均數。如此本發明非僅限於求取頻率誤差估值之 週期數。最後,須注意頻率誤差估計器2 1 7方便設計為使 用其它數位邏輯電路,其執行產生同步化低頻時脈信號之 頻率誤差估值的相同功能而未悖離本發明之範圍。 如前述,同步化低頻信號之頻率誤差估值係由1 6位元累
第15頁 527840 五、發明說明(12) 加器2 2 0供給休眠控制器2 2 2。多重累加器輸出可共同於微 處理器軟體求平均或濾波俾便產生休眠之準確頻率誤差。 又如前述,休眠控制器2 2 2響應連續指定呼叫時槽間的間 期而產生一休眠時間值。休眠控制器2 2 2以算術方式將此 頻率誤差估值加至休眠時間值而產生一校正後的休眠時間 值。然後校正後的休眠時間值用來程式規劃可程式規劃的 計數器2 2 6,藉此考慮低功率時脈2 2 4的頻率誤差。 換言之,若低功率時脈2 2 4比較較為準確的時脈信號產 生器2 0 2為損失時間,則1 6位元累加器2 2 0產生的頻率誤差 估值為負值。結果休眠控制器2 2 2將由休眠時間值扣除頻 率誤差估值。因此用於程式規劃可程式規劃計數器2 2 6的 所得校正後的休眠時間值將比否則單純基於時槽間休眠期 需要的名目休眠時間更短。如此造成可程式規劃計數器 2 2 6較早逾期,如此對次一指定時槽「準時」叫醒行動 站。若低功率時脈2 2 4比較時脈信號產生器2 0 2獲得時間增 加,則反向操作亦為真。 現在轉而餐考圖2 ’顯不如圖1電路貫施之本發明方法之 流程圖。須瞭解若干步驟可並行執行。該方法始於方塊 3 0 0,此處本發明駐在的行動站被「叫醒」,表示其已經 外加功率至全部接收與解調來自發送機2 0 1之信號所需的 全部組件。包括供電給時脈信號產生器2 0 2,故其產生高 頻時脈信號用以由接收機2 0 0及同步化邏輯2 0 8使用。 於方塊3 0 2,如業界已知,行動站再度獲得呼叫頻道且 開始監控其被指定的呼叫頻道時槽。當行動站醒來且監控
ΙΊΤ 1—lyrlf MIIJ·-1 in II ϋ 527840 五、發明說明(13) 其被指定的時槽時,方法前進至方塊3 0 4,於此處低頻時 脈信號藉前述同步化邏輯2 0 8同步化至高頻時脈信號。因 行動站於監視被指定的時槽期間可能已經醒來2 0或4 0毫 秒,故同步化邏輯2 0 8於行動站醒來時有充分時間來執行 再度同步化工作。 於方塊3 0 6,測量低頻時脈誤差估值。圖1之較佳具體例 中,此步驟係就9位元向上計數器218及16位元累加器220 說明。於方塊3 0 8,休眠控制器2 2 2響應被指定的呼叫時槽· 產生一校正後的休眠時間值(亦即介於連續被指定的呼叫 時槽間的時間間隔),及低頻時脈之頻率誤差估值。執行 此步驟後,低頻時脈2 2 4之頻率誤差被校正,行動站再度 進入休眠模經歷如前文參照圖1所述,被載入可程式規劃 計數器2 2 6的校正後的休眠時間值。 前文較佳具體例之說明係使業界人士可利用本發明。此 等具體例之多種修改對業界人士顯然易知,此處定義的一 般原則可應用至未使用本發明設施的其它具體例。如此本 發明絕非意圖囿限於此處所示具體例,反而係涵蓋符合此 處揭示之原理及新穎結構特徵之最寬廣範圍。
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Claims (1)

  1. 527840 六、申請專利範圍 1. 一種控制於分時呼叫環境作業之一行動站之電路,該 電路包含: 一低功率時脈用以產生一低頻時脈信號; 一時脈信號產生器用以產生一高頻時脈信號; 一同步化邏輯電路用以同步化低頻時脈信號與高頻時脈 信號; 一頻率誤差估計器用以測量低頻時脈誤差估值;以及 一休眠控制器用以由時脈信號產生器對校正後的休眠時_ 間值去除功率。 2. 如申請專利範圍第1項之電路,其進一步包含一可程 式規劃計數器用以計量校正後之修眠時間值,及其中該休 眠控制器可以校正後之休眠時間值程式規劃該可程式規劃 的計數器。 3. 如申請專利範圍第1項之電路,其中該同步化邏輯電 路包括至少一數位閂鎖用以對正低頻時脈信號之一緣至高 頻時脈信號之一上升緣。 4. 如申請專利範圍第1項之電路,其中該’頻率誤差估計 器包含: 一計數器用以計數每個低頻時脈信號間期之高頻時脈信 號間期數目;以及 一累加器用以累加介於每個低頻時脈信號間期之高頻時 脈信號間期預期數目與每個低頻時脈信號間期之高頻時脈 信號間期實際數目間之差值。 5 . —種控制於分時呼叫環境作業之一行動站之方法,包
    第18頁 527840 六、申請專利範圍 含下列步驟: 產生一低頻時脈信號; 產生一高頻時脈信號; 同步化該低頻時脈信號至該高頻時脈信號; 測量低頻時脈信號誤差之估值; 響應該低頻時脈誤差估值產生一校正後之休眠時間值; 以及 進入一休眠模經歷校正後之休眠時間值。 6. 如申請專利範圍第5項之方法,其進一步包含下列步 驟: 一校正後之休眠時間值程式規劃一可程式規劃計數器; 以及 計量該經校正後之休眠時間值。 7. 如申請專利範圍第5項之方法,其中該同步化低頻時 脈信號至高頻時脈信號之步驟包含對正低頻時脈信號之一 緣至該高頻時脈信號之一上升緣。 8. 如申請專利範圍第5項之方法,其中該測量低頻時脈 信號誤差估值之步驟包含下列步驟: 計數每個低頻時脈信號間期之高頻時脈信號間期數目; 以及 累加介於每個低頻時脈信號間期之高頻時脈信號間期預 期數目與每個低頻時脈信號間期之高頻時脈信號間期實際 數目間之差值。
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