TW201523557A - 用於雙行反轉架構的具有１：２多工器的驅動裝置 - Google Patents

用於雙行反轉架構的具有１：２多工器的驅動裝置 Download PDF

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Abstract

本發明提供一種驅動裝置，包括以雙行反轉架構的陣列排列的複數個畫素、1：2多工器與資料驅動單元。每一畫素包括分別對應於不同顏色的複數個子畫素。耦接至兩個畫素的1：2多工器多路傳輸資料源至對應於相同顏色與相同極性的同一列的m行的其中一個子畫素與m+1行的其中另一子畫素，其中m是正整數。資料驅動單元透過複數條資料線耦接至1：2多工器且提供資料源至1：2多工器。資料線與極性不須在子畫素之間切換，因此可幫助省電，且有利於螢幕前表現(其可能被成因於多工器的切換的假影所影響)。

Description

用於雙行反轉架構的具有1：2多工器的驅動裝置
本發明有關於一種驅動裝置，且特別是一種用於雙行反轉架構的具有1：2多工器的驅動裝置。
請參照圖1，圖1是傳統的驅動裝置的方塊圖。傳統的驅動裝置包括時序控制器10、掃描驅動器20、資料驅動器30與顯示單元40。時序控制器10控制掃描驅動器20與資料驅動器30的信號時序。顯示單元40包括以陣列排列複數個的畫素，其中每一個畫素包括分別對應於紅、綠、藍三個原色的三個子畫素R、G、B。掃描驅動器20透過複數條掃描線201、202...與20n耦接至顯示單元40的所有子畫素。資料驅動器30透過複數條資料線D11、D12、D13、D21、D22、D23、D31、D32、D33...Dm1、Dm2與Dm3耦接至顯示單元40的所有子畫素。顯示單元40可以是液晶顯示器(LCD)或發光二極體(LED)顯示單元，其中所述複數個畫素、掃描線、資料線與相關的切換電路(例如：薄膜電晶體(TFTs))是通常製作於一塊玻璃基板上。
高解析度顯示器正在發展中，例如：WQHD規格是顯示解析度為1440×2560(1440RGB×2560)畫素，且長寬比為16：9。此規格具有的畫素是720p HDTV視訊標準的四倍畫素。當此種顯示器以縱向顯示時(對於窄邊框的應用)，對於資料線(或稱為來源線)的用於充電的線路短路時間只允許非常低的多工比。所以，就目前的 典型的1：3的多工比而言，前述的線路短路時間已相當緊缺。對於更大的對角線(更高的資料線負荷)、更高的幀率或下一代的顯示解析度(4k)的情況而言，此現象將會更嚴重。對於此類型的應用，我們必須歸回到使用1：2多工器。
對於RGB的顯示，1：2多工器總是被視為是”不自然的”，因為其沒有對應於子畫素的重複性作良好的相互協調。傳統上，只有多工比為1：3N的多工器被運用，其資料線可依序的對應於每一個畫素(或N個畫素)的子畫素作定址。
請參照圖2，圖2是傳統的驅動裝置的點反轉(dot inversion)架構的示意圖。此架構顯示1：2多工器，其中六條資料線的來源信號是被多工至R1、G1、b1、r2、G2、B2、r3、g3、B3、R4、g4與b4等12個子畫素(構成三個畫素)。圖2所顯示的的架構為簡單、直接了當的多工架構，其中單一個資料線定址至不同顏色的兩個相鄰的子畫素。詳細的說，資料驅動單元210的六條資料線S(6n+1)、S(6n+2)、S(6n+3)、S(6n+4)、S(6n+5)與S(6n+6)連接至多個開關SW1、SW2。第一切換信號CKH1與第二切換信號CKH2分別控制所述開關SW1、SW2。當使用雙行(2-column)或Nx2點反轉(Nx2-dot inversion)時，相同極性的子畫素被分組而對應於一條資料線。資料線是依據以下的規則而被多工：S1→(R1,G1),S2→(b1,r2),S3→(G2,B2)...，其中大寫或小寫的字母表示對應的相反極性。然而，由線路的扇出(fanout)與多工器的薄膜電晶體(TFT)造成的寄生的電容Cp會在當資料線的電壓改變時消耗功率。此現象並無對於白色影像(每一個子畫素的信號強度為最大則產生白色)產生影響。但是，當均勻的紅色(Red)、藍色(Blue)、青色(Cyan)、黃色(Yellow)與洋紅色(Magenta)的影像被顯示時，由驅動器來的資料線是持續被切換，造成功率消耗。此情況對應於任何大面積的均勻而同顏色的影像也為真。
更進一步，另一個缺點是歸因於驅動器本身的缺點，假如個 別的伽瑪值是用於RGB三原色，則驅動積體電路必須在每一個輸出源引腳(快速地)切換伽瑪設定值。此會影響數位類比轉換器(DAC)的設計，可能是影響對於電壓梯(voltage ladder)的穩定時間(settling time)。
本發明實施例提供一種驅動裝置，可減少功率消耗且改善螢幕前表現(front-of screen performance)。
本發明實施例提供一種驅動裝置，包括複數個畫素、1：2多工器以及資料驅動單元。複數個畫素以雙行反轉架構的陣列排列，每一個畫素包括複數個分別對應於不同顏色的子畫素。此1：2多工器耦接至兩個畫素，此1：2多工器多路傳輸資料源(data source)至對應於相同顏色與相同極性的同一列的m行的其中一個子畫素與m+1行的其中另一子畫素，其中m是正整數。資料驅動單元透過複數條資料線耦接至此1：2多工器，提供資料源(data source)至此1：2多工器。
綜上所述，本發明實施例提供的驅動裝置的資料線與極性不須在子畫素之間切換，因此可幫助省電，且有利於螢幕前表現(其可能被成因於多工器的切換的假影(artefact)所影響)。
為使能更進一步瞭解本發明之特徵及技術內容，請參閱以下有關本發明之詳細說明與附圖，但是此等說明與所附圖式僅係用來說明本發明，而非對本發明的權利範圍作任何的限制。
10‧‧‧時序控制器
20‧‧‧掃描驅動器
210、510‧‧‧資料驅動單元
30‧‧‧資料驅動器
40‧‧‧顯示單元
R、G、B、R1、G1、b1、r1、g1、r2、G2、B2、b2、g2、r3、g3、B3、b3、R3、G3、R4、G4、r4、g4、b4、B0、R1、R2、B1‧‧‧子畫素
201、202、20n‧‧‧掃描線
D11、D12、D13、D21、D22、D23、D31、D32、D33、D41、D42、D43、Dm1、Dm2、Dm3、S(6n+1)、S(6n+2)、S(6n+3)、S(6n+4)、S(6n+5)、S(6n+6)、Sn-3、Sn-2、Sn-1、Sn、Sn+1、Sn+2、Sn+3、Sn+4、Sn+5、Sn+6、S1、S2、S3、S4、S5、S6、S7‧‧‧資料線
SW1、SW2、SWa、SWb‧‧‧開關
CKH1‧‧‧第一切換信號
CKH2‧‧‧第二切換信號
Pm-2、Pm-1、Pm、Pm+1、Pm+2、Pm+3、Pm+4、P4、P5‧‧‧畫素
AA‧‧‧主動區
HSW‧‧‧切換區域
+、-‧‧‧極性
O、X‧‧‧相位
m-2、m-1、m、m+1、m+2、m+3、m+4‧‧‧行
400、500、700‧‧‧多工器
P1‧‧‧輸入端
P2‧‧‧第一輸出端
P3‧‧‧第二輸出端
5‧‧‧多工單元
81、91‧‧‧邊界多工單元
Cp‧‧‧電容
圖1是傳統的驅動裝置的方塊圖。
圖2是傳統的驅動裝置的點反轉架構的示意圖。
圖3A是本發明實施例提供的具有雙行反轉的顯示單元的陣列的示意圖。
圖3B是本發明實施例提供的具有1x2點反轉的顯示單元的陣 列的示意圖。
圖3C是本發明實施例提供的具有2x2點反轉的顯示單元的陣列的示意圖。
圖4是本發明實施例提供的具有1：2多工器的雙行反轉架構的示意圖。
圖5是本發明實例提供的利用圖4的1：2多工器的雙行反轉架構的示意圖。
圖6是本發明另一實施例提供的1：2多工單元的示意圖。
圖7是本發明另一實施例提供的具有1：2多工器的雙行反轉架構的示意圖。
圖8是本發明另一實施例提供的具有1：2多工器的雙行反轉架構的示意圖。
圖9是本發明另一實施例提供的具有1：2多工器的雙行反轉架構的示意圖。
請參照圖3A，圖3A是本發明實施例提供的具有雙行反轉(2-column inversion)的顯示單元的陣列的示意圖。每一個顯示單元的畫素包括對應於原色的第一子畫素、第二子畫素與第三子畫素，其中的每一個子畫素可有界於全關(fully off)與全開(fully on)的任意的強度。所述原色可以是紅色、綠色與藍色(RGB)。可替換的，此三原色也可以分別對應於青色、洋紅色與黃色(CMY)。雙行反轉架構牽涉透過資料線對於每兩個子畫素行進行切換電壓信號的極性。例如：雙行反轉架構牽涉驅動第一個電壓信號(例如正電壓)至兩個相鄰的資料線，且驅動具有相反極性(例如負電壓)的第二電壓信號至下兩個相鄰的資料線。其他的反轉模式，例如1x2點反轉與2x2點反轉是分別繪示於圖3B與圖3C。
請同時參照圖1與圖4，圖4是本發明實施例提供的具有1：2 多工器的雙行反轉架構的示意圖。例如顯示單元的主動區AA的n×m陣列，其中n和m是正整數。在每一列，畫素Pm-1、Pm、Pm+1、Pm+2、Pm+3與Pm+4代表在m-1行、m行、m+1行、m+2行、m+3行與m+4行的畫素。此1：2多工器多路傳輸(multiplex)資料源(data source)至對應於相同顏色與相同極性的同一列的m行的其中一個子畫素與m+1行的其中另一子畫素。換句話說，單一資料線是被多路傳輸至兩個最靠近的且具有相同顏色與相同極性的子畫素。例如：資料線Sn被多路傳輸至畫素Pm-1的子畫素B(透過一個以”X”表示的開關)與畫素Pm的子畫素B(透過一個以”O”表示的開關)，其中資料線Sn提供對應於藍色的兩種相位的來源信號。同理，資料線Sn+1被多路傳輸至畫素Pm的子畫素G與畫素Pm+1的子畫素G。資料線Sn+2被多路傳輸至畫素Pm+1的子畫素R與畫素Pm+2的子畫素R。資料線Sn+3被多路傳輸至畫素Pm+1的子畫素B與畫素Pm+2的子畫素B。資料線Sn+4被多路傳輸至畫素Pm+2的子畫素G與畫素Pm+3的子畫素G。資料線Sn+5被多路傳輸至畫素Pm+3的子畫素R與畫素Pm+4的子畫素R。值得一提的是，以相同原理，資料線Sn-1提供信號至畫素Pm的子畫素R，資料線Sn+6提供信號至畫素Pm+3的子畫素B。信號源與子畫素之間的連接可以具有複數個開關(在圖4中間以”O”和”X”表示)的多工器400(在切換區域HSW)達成。使用圖2的1：2多工器來設計的優點是，子畫素是以顏色和極性來群組。
請同時參照圖1與圖5，圖5是本發明實例提供的利用圖4的1：2多工器的雙行反轉架構的示意圖。本實施例提供一驅動裝置，其包括複數個畫素Pm-1、Pm、Pm+1、Pm+2、Pm+3、Pm+4...、1：2多工器500以及資料驅動單元510。此驅動裝置可以是液晶顯示器或發光二極體顯示器，但本發明並不因此限定。所述畫素(Pm-1、Pm、Pm+1、Pm+2、Pm+3、Pm+4...)是排列成雙行反轉架構的n×m陣列。每一個畫素(Pm-1、Pm、Pm+1、Pm+2、Pm+3、 Pm+4...)包括分別對應於三原色(紅、綠與藍)的三個子畫素R、G與B。多工器500耦接至所述複數個畫素。多工器500多路傳輸同一列的且對應於相同顏色與相同極性的m行的畫素的子畫素R、G、B與m+1行的子畫素R、G、B，其中m是正整數。資料驅動單元510透過複數條資料線(Sn-1、Sn、Sn+1、Sn+2、Sn+3、Sn+4、Sn+5、Sn+6...)耦接至多工器500，且提供資料源(data source)至此多工器500。
多工器500包括複數個第一開關SW1與複數個第二開關SW2。詳細的說，在多工器500中的每一個1：2多工器包括一個第一開關SW1與一個第二開關SW2。所述第一開關SW1與第二開關SW2可以是NMOS電晶體(如圖4所示)或CMOS電晶體，但本發明並不因此限定。第一開關SW1受控於第一切換信號CKH1，第二開關SW2受控於第二切換信號CKH2。在第一個相位，第一切換信號CKH1致能第一開關SW1，使得傳送至第一開關SW1的來源信號可被傳送至對應的子畫素。在第二相位，第二切換信號CKH2致能第二開關SW2，使得傳送至第二開關SW2的來源信號可被傳送至對應的子畫素。每一個第一開關SW1以及每一個第二開關SW2分別耦接至同一行且對應於相同顏色與相同極性的m行的一個子畫素(R、G或B)以及m+1行的一個子畫素(R、G或B)。詳細的說，資料線Sn是透過第一開關SW1耦接至畫素Pm-1的子畫素B，且透過第二開關SW2耦接至畫素Pm的子畫素B。資料線Sn+1是透過第一開關SW1耦接至畫素Pm的子畫素G，且透過第二開關SW2耦接至畫素Pm+1的子畫素G。資料線Sn+2是透過第一開關SW1耦接至畫素Pm+1的子畫素R，且透過第二開關SW2耦接至畫素Pm+2的子畫素R。資料線Sn+3是透過第一開關SW1耦接至畫素Pm+1的子畫素B，且透過第二開關SW2耦接至畫素Pm+2的子畫素B。資料線Sn+4是透過第一開關SW1耦接至畫素Pm+2的子畫素G，且透過第二開關SW2耦接至畫素Pm+3的子畫 素G。資料線Sn+5是透過第一開關SW1耦接至畫素Pm+3的子畫素R，且透過第二開關SW2耦接至畫素Pm+4的子畫素R。值得一提的是，畫素群組之間的重疊在主動區AA的邊界造成不連續，以圖4的架構為例，我們需要另加兩條資料線，所增加的每一條資料線在主動區AA的兩端的其中一端。
請同時參照圖4與圖7，圖7是本發明另一實施例提供的具有1：2多工器的雙行反轉架構的示意圖。在圖4的多工器的佈線的一部分可以在空間上被重新排列，以允許更佳的線路布局、重複使用佈線層或者更大的封裝密度。此架構的其中一個例子如圖7所示。在拓樸上，圖7的線路是與圖4的實施例完全相同，且可具有使多工器700的部份的薄膜電晶體可以被整合的優點。多工器700包括以”X”表示的複數個開關與以”O”表示的複數個開關。
詳細的說，資料線Sn+1是多路傳輸至畫素Pm的子畫素G(透過一個以”X”表示的開關)與畫素Pm+1的子畫素G(透過一個以”O”表示的開關)。以相同方式，資料線Sn+2是多路傳輸至畫素Pm+1的子畫素R與畫素Pm+2的子畫素R。資料線Sn+3是多路傳輸至畫素Pm+1的子畫素B與畫素Pm+2的子畫素B。資料線Sn+4是多路傳輸至畫素Pm+2的子畫素G與畫素Pm+3的子畫素G。資料線Sn+5是多路傳輸至畫素Pm+3的子畫素R與畫素Pm+4的子畫素R。
值得一提的是，畫素Pm可被定義為一列中的起始畫素，對應於主動區AA的邊界。當在圖7中的主動區AA的邊界的不連續被考慮時，多工器的佈線對於每一列的起始/最終畫素將詳述如下。所述三個子畫素定義為依序排列的第一子畫素R、第二子畫素G與第三子畫素B。在此情況，驅動裝置更包括複數個邊界多工單元。每一個邊界多工單元對應於陣列中的其中一行的起始/最終畫素。例如：當圖7所示的畫素Pm是起始畫素，且最靠近此起始端的兩個開關構成所述邊界多工單元。每一個邊界多工單元多路傳 輸對應的資料源(如，資料線Sn)至此列的起始/最終畫素(如，畫素Pm)的第一個子畫素(如，畫素R)與起始/最終畫素的第三子畫素(如，畫素G)。
請參考圖6，圖6是本發明另一實施例提供的1：2多工單元的示意圖。多工單元5包括第一開關SWa與第二開關SWb，所述開關可以多工器700的以”X”和”O”表示且受控於第一切換信號CKH1與第二切換信號CKH2的開關來實現。多工單元5包括輸入端P1、第一輸出端P2與第二輸出端P3。輸入端P1透過資料線接收資料源。受控於第一切換信號CKH1的第一輸出端P2與受控於第二切換信號CKH2的第二輸出端P3分別耦接至對應於相同顏色與相同極性的同一列的m行的其中一個子畫素與m+1行的其中另一子畫素。例如：當多工單元2的輸入端P1是耦接至來源(資料線)S1，第一輸出端P2耦接至P0行的子畫素B1，且第二輸出端P3耦接至同一列的P1行的子畫素B1。然而，本發明並不因此限定。多工單元5可以用其他的開關來實現，例如CMOS電晶體。本技術領域具有通常知識者容易得知如何使用等效的元件替換圖6的多工單元5。
圖7繪示了本發明另一實施例提供的具有1：2多工器的雙行反轉架構。圖6的多工單元5可被使用於圖7的多工器700。資料源是由資料來源的驅動器所提供，驅動器具有複數個驅動單元(對應於資料線Sn-1、Sn、Sn+1、Sn+2、Sn+3、Sn+4、Sn+5、Sn+6...)。驅動單元與多工單元是一一對應。每三個驅動單元(Sn、Sn+1與Sn+2)視為一群組以對應於m行與m+1行的畫素。每一個驅動單元(Sn、Sn+1或Sn+2)提供相同顏色的資料源至對應的多工單元。對應於m行的多工單元5的第一輸出端P2是連接至m行的第三子畫素(B)。對應於m行的多工單元5的第二輸出端P3連接至m-1行的第三子畫素(B)，其中m-1行的第三子畫素與m行的第三子畫素為相同極性。例如：對應於m+2行的多工單元5的第一輸出端 P2是連接至m+2行的第三子畫素(B)。對應於m+2行的多工單元5的第二輸出端P3是連接至m+1行的第三子畫素(B)。更進一步，對應於m行與m+1行的多工單元5的第一輸出端P2是連接至m+1行的第二子畫素(G)。對應於m行與m+1行的多工單元5的第二輸出端P3是連接至m行的第二子畫素(G)，其中m行的第二子畫素與m+1行的第二子畫素為第二極性。對應於m+1行的多工單元5的第一輸出端P2連接至m+2行的第一子畫素(R)。對應於m+1行的多工單元5的第二輸出端P3是連接至m+1行的第一子畫素(R)，其中m+1行的第一子畫素(R)與m+2行的第一子畫素(R)為第一極性。
請參照圖8，圖8是本發明另一實施例提供的具有1：2多工器的雙行反轉架構的示意圖。在本實施例中，m行的畫素的初始/最終畫素如圖8所示。驅動裝置可進一步包括複數個邊界多工單元81。每一個邊界多工單元81對應於陣列中的其中一列的起始/最終畫素。每一個邊界多工單元81多路傳輸對應的該資料源至該列的起始/最終畫素的第一個子畫素與起始/最終畫素的第三子畫素。例如：對一列的初始畫素(P1，第一個畫素)而言，邊界多工單元81多路傳輸包括第一子畫素(R)與第三子畫素(B)的資料源，其中第一子畫素(R)與第三子畫素(B)為第二極性(-)。對最終畫素(Pm，最後一個畫素)而言，邊界多工單元81多路傳輸包括第一子畫素(R)與第三子畫素(B)的資料源，其中第一子畫素(R)與第三子畫素(B)為第二極性(-)。邊界多工單元81可與圖6的多工單元5相同，但是輸入與輸出的佈線並不相同。每一個邊界多工單元81包括輸入端P1、第一輸出端P2與第二輸出端P3、第一邊界開關SWa與第二邊界開關SWb。第一邊界開關SWa耦接於輸入端P1與第一輸出端P2之間，第二邊界開關SWb耦接於輸入端P1與第二輸出端P3之間。輸入端P1接收資料源，受控於第一切換信號CKH1的第一輸出端P2耦接於該列的起始/最終畫素的第一個子畫素(R)。受控 於第二切換信號CKH2的第二輸出端P3耦接於該列的起始/最終畫素的第三個子畫素(B)。其他多工單元對應於介於起始畫素(P1，第一個畫素)與最終畫素(Pm，最後一個畫素)之間的其他畫素(P2、P3、P4、P5...Pm-2、Pm-1)的佈線則與圖4所述的佈線相同，不再贅述。
請參照圖9，圖9是本發明另一實施例提供的具有1：2多工器的雙行反轉架構的示意圖。在本實施例中，多工單元對應於介於起始畫素與最終畫素之間的其他畫素(P2、P3、P4、P5...Pm-2、Pm-1)的佈線則與圖7所述的佈線相同，不再贅述。實施於一列的起始畫素或最終畫素的邊界多工器91與圖8的邊界多工器81不同。類似於邊界多工單元81，每一個邊界多工單元91包括輸入端P1、第一輸出端P2與第二輸出端P3、第一邊界開關SWa與第二邊界開關SWb。對一行的初始畫素P1而言，邊界多工單元91多路傳輸包括第一子畫素(R)與第三子畫素(B)的資料源。對最終畫素Pm而言，邊界多工單元91多路傳輸包括第一子畫素(R)與第三子畫素(B)的資料源。然而，因為介於起始畫素與最終畫素之間的其他畫素(P2、P3、P4、P5...Pm-2、Pm-1)的佈線，使得對應於初始畫素P1的第三子畫素B與邊界多工單元91的第二輸出端P3之間的佈線並不相同。同理，第一子畫素(R)與第一輸出端P2之間的佈線也不相同，如圖9所示。
綜上所述，本發明實施例所提供的驅動裝置採用雙行反轉架構。驅動裝置的資料線與極性不須在子畫素之間切換，因此可幫助省電，且有利於螢幕前表現(其可能被成因於多工器的切換的假影(artefact)所影響)。
以上所述僅為本發明之實施例，其並非用以侷限本發明之專利範圍。
R、G、B‧‧‧子畫素
Sn-1、Sn、Sn+1、Sn+2、Sn+3、Sn+4、Sn+5、Sn+6‧‧‧資料線
CKH1‧‧‧第一切換信號
CKH2‧‧‧第二切換信號
Pm-1、Pm、Pm+1、Pm+2、Pm+3、Pm+4‧‧‧畫素
AA‧‧‧主動區
HSW‧‧‧切換區域
+、-‧‧‧極性
O、X‧‧‧相位
m-1、m、m+1、m+2、m+3、m+4‧‧‧行
400‧‧‧多工器

Claims (10)

  1. 一種驅動裝置，包括：複數個畫素，以雙行反轉(2-column inversion)架構的陣列排列，每一個畫素包括複數個分別對應於不同顏色的子畫素；一1：2多工器，耦接至兩個該畫素，該1：2多工器多路傳輸一資料源至對應於相同顏色與相同極性的同一列的m行的其中一個子畫素與m+1行的其中另一子畫素，其中m是正整數；以及一資料驅動單元，透過複數條資料線耦接至該1：2多工器，提供該資料源至該1：2多工器。
  2. 根據請求項第1項之驅動裝置，其中該1：2多工器包括一第一開關與一第二開關，該第一開關受控於一第一切換信號，該第二開關受控於一第二切換信號，該第一開關與該第二開關分別耦接至對應於相同顏色與相同極性的同一列的m行的其中一個子畫素與m+1行的其中另一子畫素。
  3. 根據請求項第2項之驅動裝置，其中該第一開關與該第二開關是NMOS電晶體或CMOS電晶體。
  4. 根據請求項第1項之驅動裝置，其中該1：2多工器包括複數個多工單元，該多工單元包括一輸入端、一第一輸出端與一第二輸出端，該輸入端透過該資料線接收該資料源，受控於該第一切換信號的該第一輸出端與受控於該第二切換信號的該第二輸出端分別耦接至對應於相同顏色與相同極性的同一列的m行的其中一個子畫素與m+1行的其中另一子畫素。
  5. 根據請求項第4項之驅動裝置，其中該多工單元包括一第一開關與一第二開關，該第一開關耦接於該輸入端與該第一輸出端之間，該第二開關耦接於該輸入端與該第二輸出端之間。
  6. 根據請求項第2項之驅動裝置，其中該驅動裝置包括複數個1：2多工器，該資料驅動單元耦接於相鄰的兩個該1：2多工器，該第一開關與該第二開關為一對一地對應該些子畫素，其中該資料驅動 單元為相同顏色且相同極性。
  7. 根據請求項第2項之驅動裝置，其中該資料驅動單元耦接至該1：2多工器，其中該第一開關與該第二開關交錯地(interlaced)對應於相鄰的兩個子畫素，其中該資料驅動單元為相同顏色且相同極性。
  8. 根據請求項第1項之驅動裝置，更包括：複數個邊界多工單元，每一該邊界多工單元對應於陣列中的其中一列的起始/最終畫素，其中每一該邊界多工單元多路傳輸對應的該資料源至該列的起始/最終畫素的第一個子畫素與起始/最終畫素的第三子畫素。
  9. 根據請求項第8項之驅動裝置，其中該邊界多工單元包括一輸入端、一第一輸出端與一第二輸出端，該輸入端接收該資料源，受控於一第一切換信號的該第一輸出端耦接於該列的起始/最終畫素的第一個子畫素，受控於一第二切換信號的該第二輸出端耦接於該列的起始/最終畫素的第三個子畫素。
  10. 根據請求項第9項之驅動裝置，其中每一該邊界多工單元包括一第一邊界開關與一第二邊界開關，該第一邊界開關耦接於該輸入端與該第一輸出端之間，該第二邊界開關耦接於該輸入端與該第二輸出端之間。
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