SU573134A3 - Формирователь бипол рных импульсов - Google Patents
Формирователь бипол рных импульсовInfo
- Publication number
- SU573134A3 SU573134A3 SU7001477395A SU1477395A SU573134A3 SU 573134 A3 SU573134 A3 SU 573134A3 SU 7001477395 A SU7001477395 A SU 7001477395A SU 1477395 A SU1477395 A SU 1477395A SU 573134 A3 SU573134 A3 SU 573134A3
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- output
- circuits
- inputs
- pulse
- register
- Prior art date
Links
Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11C—STATIC STORES
- G11C7/00—Arrangements for writing information into, or reading information out from, a digital store
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass
- H03K5/156—Arrangements in which a continuous pulse train is transformed into a train having a desired pattern
Landscapes
- Physics & Mathematics (AREA)
- Nonlinear Science (AREA)
- Amplifiers (AREA)
- Semiconductor Memories (AREA)
Description
(54) ФОРМИРОВАТЕЛЬ БИПОЛЯРНЫХ ИМПУЛЬСОВ
отдельности к одномуИз двух выходов 15, 16 регистра 17 записи и считьшани .
В зависимости от пол рности первого разр дного импульса к первому входу 18 и 19 одной из схем ИЛИ подводитс управл ющий импульс дл пуска первого разр дного импульса, который получаетс из какой-либо одной схемы И 20, 21 (фиг. 1). Кажда из схем И 20, 21 имеет первый и второй входы. Первые входы 22, 23 св заны между собой, на их точку соединени подаетс тактовый импульс 24 дл пуска первого разр дного импульса . Вторые входы 25, 26 подключены к выходам 15, 16 регистра 17.
Таким образом, к каждому выходу 15, 16 регистра 17 подключено всего две схемы И 8, 21 (9, 20), причем схемы И 8, 20 принадлежат к усилителю 1, а схемы И 21, 9 - к усилителю 2.
Управл ющий импульс дл пуска первого разр дного импульса (фиг. 2) получаетс из какой-либо одной схем ШШ 27, 28. Кажда схема ИШ. 27, 28 имеет первый и второй входы. Первый вход схемы 27 св зан с одним выходом 29, а первый вход схемы 28 св зан с другим выходом 30 выходного каскада нелинейного усилител считьшани 31. Вторые входы 32, 33 схем ИЛИ 27, 28 служат дл записи внеицшх информации. Регистр 17 используетс в качестве регистра записи (считьшани ), следовательно, на его входы 34, 35 управлени через схемы ИЛИ 27, 28 и св зывающие звень , например конденсаторы (на чертежах не показаны), поступает выходной сигнал выходного каскада нелинейного усилител 31 считьшани кхш же внеи-кий сигнал, поданный на вход 32, 33. Выходной каскад усилител 31 счктьюани (фиг. 1) имеет только один выход 29, вследствие чего необходимо производдть перед каждой новой операцией записк .ГйЖ сброса регистра 17 на его входе 35.
Ра.бота устройства протекает следующим образом.
Перед каждой операцией записи внешних или считываемых информации регистр 17 приводитс подачей импульса сброса на его вход 35 в свое состо ние поко , в котором на выходе 15 по вл етс сигнал 1, а на выходе 16 - сигнал О, При записи информащш на выходе 29 выходного каскада нелинейного усилител 31 считьшани или же на входе 32 схемы ИЛИ по вл етс импульс, который переводит регистр 17 в рабочее состо ние, характеризуемое сигналом О на выходе 15 и соответственно, сигналом 1 на выходе 16.
По вивщийс теперь на первых входах 22, 23 схем И 20, 21 тактовый импульс 24, который соответствует сигналу 1, вызьтает на выходе схемы И 20 импульс, который через схему ИЛИ 4 поступает на усидштель 1, при этом положительный первый разр дный импульс по вл етс на нагрузке 3. За тактовым импульсом 24 непосредственно следует соответствующий сигналу 1 тактовьш импульс 12, который аналогичным образом через схему И 9 и схему ИЛИ 5 поступает на усилитель 2. При загшси информации О на входе 34 регистра 17 управл ющий импульс отсутгствует, следовательно , на нагрузку 3 подаютс отрицательный первый разр дный импульс и непосредственно следующий за ним полохжте ьный второй разр дный импульс.
Аналогично работает и электрическа схема на фиг. 2. Однако управл ю1ций иштульс дл пуска первого разр дного импульса по вл етс на выходе одной из схем ИЛИ 27, 28. Сигнал на выходе 29 или 30 выходного каскада нелинейного усилител 31 считывани или внешний сигнал на входе 32 или 33 уже имеет необходимую дл щштельноаи первого разр дного импульса ишрину. Операщ сброса регистра 17. дл перевода его в С9сто ние поко отпадает. Электрические схемы Ki фиг. 1 и 2 св заны известным образом.
Claims (1)
- Формула изобретениФормирователь Бипол рных импульсов, содержащий не шнейный усилитель с одним или с двум выходами, оконечньЬ усилители, нагруженные на общую нагрузку, внеишие источники сигналов, первые к вторые cxe.lЬI ИЛИ, регистр записи и считывани , входы которого соединены с выходагии первых схем ИЛИ, а его выходы - с входами схем И, отличающийс тем, что, с целью упрощени формировател , каждый выход нелинейного усилител соединен с входом одной из первых схем ИЛИ, пртчем их вторые входы и параллельно соединенные входы И подключены к внешним источникам сигналов , выходы схем И соединены через вторые схемы ИЛИ с оконечными усилител ми, а остальные ьходы вторьк схемИШ соединены с входамн регистр.1 записи и считыванн . / 2S 27 , /7 - 34-/ 21 7гЧЧ
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
DD14369069 | 1969-11-13 |
Publications (1)
Publication Number | Publication Date |
---|---|
SU573134A3 true SU573134A3 (ru) | 1977-09-15 |
Family
ID=5481832
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU7001477395A SU573134A3 (ru) | 1969-11-13 | 1970-09-23 | Формирователь бипол рных импульсов |
Country Status (3)
Country | Link |
---|---|
CS (1) | CS157847B1 (ru) |
DE (1) | DE2053676A1 (ru) |
SU (1) | SU573134A3 (ru) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
DE2829276C2 (de) * | 1978-07-04 | 1983-06-01 | AEG-Telefunken Nachrichtentechnik GmbH, 7150 Backnang | Schaltungsanordnung zur Wechselimpulserzeugung |
-
1970
- 1970-09-23 SU SU7001477395A patent/SU573134A3/ru active
- 1970-11-02 DE DE19702053676 patent/DE2053676A1/de active Pending
- 1970-11-12 CS CS764070A patent/CS157847B1/cs unknown
Also Published As
Publication number | Publication date |
---|---|
DE2053676A1 (de) | 1971-05-19 |
CS157847B1 (ru) | 1974-10-15 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
ES453378A1 (es) | Perfeccionamientos introducidos en un dispositivo de trata- miento de informacion. | |
KR850003610A (ko) | 반도체 메모리 장치 | |
US3017613A (en) | Negative resistance diode memory | |
GB1188535A (en) | Improvements in or relating to Signal Correlators | |
US3432831A (en) | Gated difference amplifier | |
SU573134A3 (ru) | Формирователь бипол рных импульсов | |
KR850002638A (ko) | 센스증폭기 | |
GB1268359A (en) | Improvements in or relating to assessor circuits | |
GB1295525A (ru) | ||
GB1247770A (en) | Field effect transistor logic circuits | |
GB1400784A (en) | Shift register | |
GB854680A (en) | Character identification apparatus | |
KR900010778A (ko) | 반도체 메모리장치 | |
GB1109938A (en) | Sense amplifier for memory system | |
US6353567B1 (en) | Data outputting circuit for semiconductor memory device | |
US3196288A (en) | Shifting register employing tunnel diode stages | |
SU421045A1 (ru) | Запоминающее устройство на мдп-транзисторах | |
GB1262143A (en) | Logic circuits | |
SU720425A1 (ru) | Логарифмический усилитель | |
SU703907A1 (ru) | Устройство дл селекции максимального сигнала | |
KR100560629B1 (ko) | 에코 클락 경로를 가지는 반도체 메모리 장치 | |
SU501482A1 (ru) | Логический элемент и-или/и-или-не | |
SU511627A1 (ru) | Блок считывани информации из накопител | |
SU381095A1 (ru) | Формирователь тока выборки | |
SU407392A1 (ru) |