SU1734122A1 - Адресный формирователь - Google Patents
Адресный формирователь Download PDFInfo
- Publication number
- SU1734122A1 SU1734122A1 SU904802945A SU4802945A SU1734122A1 SU 1734122 A1 SU1734122 A1 SU 1734122A1 SU 904802945 A SU904802945 A SU 904802945A SU 4802945 A SU4802945 A SU 4802945A SU 1734122 A1 SU1734122 A1 SU 1734122A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- transistor
- output
- resistor
- collector
- base
- Prior art date
Links
Landscapes
- Static Random-Access Memory (AREA)
Abstract
Изобретение относитс к микроэлектронике и может быть использовано при построении адресных формирователей ТТЛ- типа. Целью изобретени вл етс повышение надежности адресного формировател . Поставленна цель достигаетс тем, что формирователь содержит третий резистор 13, второй диод 8, третий диод 9 с соответствующими св з ми. При наличии разбаланса контактных сопротивлений транзистор, имеющий завышенное сопротивление эмиттера, удерживаетс в насыщении за счет уменьшени его тока коллектора. Это обеспечиваетс за счет перераспределени тока, протекающего через третий резистор 13. В результате функционирование формировател не нарушаетс . 1 ил. ч Ё СО ю N
Description
Изобретение относитс к микроэлектронике и может быть использовано при построении адресных формирователей ТТЛ-типа.
Известен адресный формирователь, представл ющий собой два последовательно соединенных сложных инвертора на основе стандартных вентилей типа ТТЛ.
Недостатком такого адресного формировател вл етс большое врем задержки до пр мого выхода, так как необходимо, чтобы последовательно переключились два ТТЛ вентил .
Этот недостаток устран етс при подключении входа второго инвертора к внутренней точке первого инвертора. Дл этого используетс дополнительный транзистор св зи, база-эмиттерный переход которого подключен параллельно база-эмиттерному переходу фазорасщепительного транзистора , а коллектор подключен к входу второго инвертора. Недостаток известного адресного формировател св зан с возможным разбросом сопротивлени контакта к эмиттеру. При этом возникает перехват тока в один из транзисторов, имеющий низкое сопротивление контакта к эмиттеру. Это приводит к тому, что транзистор, имеющий высокое сопротивление эмиттера, не входит в насыщение , напр жение на его коллекторе повышаетс и это может привести к нарушению работы адресного формировател .
Целью изобретени вл етс повышение надежности адресного формировател .
Поставленна цель достигаетс тем, что в адресный формирователь, содержащий первый инвертор, состо щий из четырех транзисторов, двух резисторов и первого диода, анод которого соединен с эмиттером первого транзистора, база которого соединена с первым выводом первого резистора и коллектором второго транзистора, а коллектор соединен с вторым выводом первого резистора и подключен к шине питани первого инвертора, к шине нулевого потенциала которого подключен эмиттер третьего транзистора, коллектор которого соединен с катодом первого диода и вл етс инверсным выходом формировател , а база соединена с эмиттерами второго и четвертого транзисторов и с первым выводом второго резистора, второй вывод которого соединен с эмиттером третьего транзистора, база второго транзистора вл етс входом формировател и соединена с базой четвертого транзистора, второй инвертор, выход которого вл етс пр мым выходом формировател , а вход соединен с коллектором четвертого транзистора первого инвертора, введены в первый инвертор третий резистор , второй и третий диоды, аноды которых соединены с первым выводом третьего резистора , второй вывод которого соединен с коллектором первого транзистора, база которого соединена с катодом второго диода, катод третьего диода соединен с входом второго инвертора.
На чертеже приведена схема устройства .
Устройство содержит первый 1 и второй 2 инверторы. Первый инвертор 1 состоит из четырех транзисторов 3-6, трех диодов 7 - 9, трех резисторов 10 - 12, анод первого диода 7 соединен с эмиттером первого транзистора 3, база которого соединена с первым выводом первого резистора 10 и коллектором второго транзистора 4, а коллектор соединен с вторым выводом первого резистора 10 и подключен к шине питани первого инвертора, к шине нулевого потенциала которого подключен эмиттер третьего
транзистора 5, коллектор которого соединен с катодом первого диода 7 и вл етс инверсным выходом формировател , а база соединена с эмиттерами второго 4 и четвертого 6 транзисторов и с первым выводом
второго резистора 11, второй вывод которого соединен с эмиттером третьего транзистора 5, база второго транзистора 4 вл етс входом формировател и соединена с базой четвертого транзистора 6, выход
второго инвертора 2 вл етс пр мым выходом формировател , а вход соединен с коллектором четвертого транзистора 6 первого инвертора 1, аноды второго 8 и третьего 9 диодов первого инвертора соединены с первым выводом третьего резистора 13, второй вывод которого соединен с коллектором первого транзистора 3, база которого соединена с катодом второго диода 8, а катод третьего диода 9 соединен с входом второго
инвертора.
Устройство работает следующим образом .
При отсутствии разбаланса сопротивле- ний контакта к эмиттеру у транзисторов 4 и 6 ток резистора 13 делитс поровну между коллекторами 4 и 6 (если резисторы 10 и 12 имеют одинаковый номинал). При увеличении контактного сопротивлени к эмиттеру 6 происходит перехват тока в транзистор 4. Так как ток коллектора транзистора 4 ограничен резистором 12, то практически весь ток базы втекает в базу транзистора 4, а ток базы 6 уменьшаетс . Это приводит к выходу из насыщени транзистора 6 (что особенно часто наблюдаетс при снижении коэффициента усилени под воздействием низких температур и радиации). В результате потенциал на коллекторе 6 увеличиваетс , диод 9 закрываетс и весь ток резистора 13 начинает втекать в транзистор 4, что приводит к некоторому увеличению тока базы 6 при одновременном уменьшении тока коллектора 6. Таким образом, транзистор 6 снова стремитс войти в насыщение. Резисторы 10 и 12 необходимо выбрать как можно большего номинала (их номинал определ етс необходимым уровнем лог. 1 на выходе адресного формировател дл конкретной схемотехнической реализации дешифратора), а резистор 13 необходимо выбрать как можно меньшего номинала (он ограничиваетс требовани ми по току потреблени и степени насыщени выходных транзисторов).
Таким образом, введение диодов 8 и 9, катоды которых подключены к коллекторам транзисторов 4 и 6, а аноды которых соединены с резистором 13, второй конец которого соединен с источником питани , позвол ет увеличить надежность и выход годных в процессе производства за счет предотвращени выхода из насыщени транзисторов 4 и 6 при наличии разбаланса сопротивлений в эмиттере одного из этих транзисторов.
Claims (1)
- Формула изобретени Адресный формирователь, содержащий два инвертора, первый из которых состоитиз четырех транзисторов, двух резисторов и первого диода, анод которого соединен с эмиттером первого транзистора, база которого соединена с первым выводом первого резистора и коллектором второго транзистора , а коллектор соединен с вторым выводом первого резистора и подключен к шине питани , эмиттер третьего транзистора подключен к шине нулевого потенциала, а коллектор соединен с катодом первого диода и вл етс инверсным выходом адресного формировател , база третьего транзистора соединена с эмиттерами второго и четвертого транзисторов и с первым выводом второго резистора, второй вывод которого соединен с эмиттером третьего транзистора , база второго транзистора вл етс входом адресного формировател и соединена с базой четвертого транзистора, выход второго инвертора вл етс пр мым выходом адресного формировател , а вход соединен с коллектором четвертого транзистора первого инвертора, отличающийс тем. что, с целью повышени надежности, первый инвертор содержит третий резистор, второй и третий диоды, аноды которых соединены с первым выводом третьего резистора , второй вывод которого соединен с коллектором первого транзистора, база которого соединена с катодом второго диода, катод третьего диода соединен с входом второго инвертора.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU904802945A SU1734122A1 (ru) | 1990-03-16 | 1990-03-16 | Адресный формирователь |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU904802945A SU1734122A1 (ru) | 1990-03-16 | 1990-03-16 | Адресный формирователь |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1734122A1 true SU1734122A1 (ru) | 1992-05-15 |
Family
ID=21502226
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU904802945A SU1734122A1 (ru) | 1990-03-16 | 1990-03-16 | Адресный формирователь |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1734122A1 (ru) |
-
1990
- 1990-03-16 SU SU904802945A patent/SU1734122A1/ru active
Non-Patent Citations (1)
Title |
---|
Валиев К.А., Орликовский А.А. Полупроводниковые интегральные схемы пам ти на бипол рных транзисторных структурах. - М.: Сов.радио, 1979, с. 253-254. Патент US N° 3962589, кл. G 11 С 7/00, опублик. 1980. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
KR890009003A (ko) | 반도체 집적회로 | |
GB2195506A (en) | Cascode bimos driving circuit | |
KR880010575A (ko) | 논리회로 | |
KR840002176A (ko) | 반도체 집적회로 장치 | |
KR860002904A (ko) | 에미터 결합논리(ecl)회로 | |
US4131808A (en) | TTL to MOS driver circuit | |
KR890000959A (ko) | 출력 인터페이스 회로 | |
US4112314A (en) | Logical current switch | |
US4289978A (en) | Complementary transistor inverting emitter follower circuit | |
KR890009004A (ko) | 바이폴라-cmos 회로 | |
KR890001287A (ko) | 논리 레벨 변환기 회로 | |
US4037115A (en) | Bipolar switching transistor using a Schottky diode clamp | |
SU1734122A1 (ru) | Адресный формирователь | |
US4458162A (en) | TTL Logic gate | |
US3952212A (en) | Driver circuit | |
WO1985002307A1 (en) | An improved logic level translator circuit for integrated circuit semiconductor devices having transistor-transistor logic output circuitry | |
KR870002584A (ko) | 반도체 메모리 장치 | |
US3591855A (en) | Complementary field-effect transistor buffer circuit | |
EP0076099A2 (en) | A TTL circuit | |
US4032796A (en) | Logic dot-and gate circuits | |
KR900004107A (ko) | 가속 스위칭 입력회로 | |
US5039881A (en) | High speed, low power input buffer | |
KR940006660A (ko) | 가변 전압 전류 변환 회로 | |
EP0432472A2 (en) | Signal output circuit having bipolar transistor in output stage and arranged in CMOS semiconductor integrated circuit | |
SU1058061A1 (ru) | Логический элемент |