SU1653145A1 - Устройство задержки - Google Patents
Устройство задержки Download PDFInfo
- Publication number
- SU1653145A1 SU1653145A1 SU894657034A SU4657034A SU1653145A1 SU 1653145 A1 SU1653145 A1 SU 1653145A1 SU 894657034 A SU894657034 A SU 894657034A SU 4657034 A SU4657034 A SU 4657034A SU 1653145 A1 SU1653145 A1 SU 1653145A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- output
- counter
- trigger
- channel
- Prior art date
Links
Abstract
Изобретение может быть использовано в качестве программно-управл емой задержки импульсных сигналов. Цель изобретени - сокращение аппарат- но-мощностных затрат - достигаетс путем введени в состав устройства регистра 7 пам ти и новых св зей. Кроме того, в состав устройства вход т триггер 1, элемент И 2, коммутатор 3 каналов , генератор 4 многофазного напр жени , формирователь 5, счетчик 6. Введенные отличи позвол ют, сохран точностные характеристики устройства, исключить его многоканальность, требующую большого числа счетчиков. 1 ил. (/)
Description
Изобретение относится к приборостроению и может быть использовано, в частности, в измерительной технике.
Цель изобретения - сокращение аппа-5 ратных затрат.
На чертеже приведена структурная схема устройства задержки.
Устройство задержки содержит триггер 1, элемент И 2, коммутатор 3 ка- 10 налов, генератор 4 многофазного напряжения, формирователь 5, счетчик 6 и регистр 7 памяти.
Первый вход триггера 1 является входом устройства. Информационные 15 входы счетчика 6 подключены к соответствующим разрядам шины кода задержки. Первый вход элемента И 2 является тактовым входом устройства. Второй вход элемента И 2 соединен с входом форми- 20 рователя 5 и подключен к выходу триггера 1. Выход формирователя 5 соединен с управляющим входом счетчика 6. Вход генератора 4 многофазного напряжения соединен с выходом элемента 25 И ,2. Управляющий вход регистра 7 памяти подключен к выходу формирователя 5. Информационные входы коммутатора 3 каналов подключены к выходам генератора 4 многофазного напряжения. 30
Адресные входы коммутатора 3 каналов подключены через регистр 7 памяти к соответствующим младшим разрядам шины кода задержки. Выход коммутатора 3 каналов соединен со счетным входом 35 счетчика 6, выход переполнения которого соединен с вторым входом триггера 1 и является выходом устройства.
Генератор 4 многофазного напряжения может быть реализован при помощи 40 последовательно соединенных счетчика и дешифратора, при этом вход счетчика является входом генератора, а выходы дешифратора - его выходами.
| 45
Устройство задержки работает следующим образом.
Импульсы запуска опрокидывают триггер 1, выходной уровень которого отпирает элемент И 2 и записывает при помощи формирователя 5 код задержки в регистр 7 памяти: и в счетчик 6. Счетные импульсы начинают поступать на генератор 4 многофазного напряжения. С. выходов генератора 4 сдвинутые по фазе напряжения подаются на информационные входы коммутатора 3 каналов, который через регистр 7 памяти управляется младшими разрядами шины кода задержки. На счетный вход .. счетчика 6 поступают импульсы с выхода коммутатора 3 каналов. На выходе переполнения счетчика 6 появляется импульс, временное положение которого соответствует коду задержки, поступающему на его информационные входы, и устанавливает триггер 1 в исходное состояние. Зопрещающий уровень с выхода.триггера 1 поступает на вход элемента И 2 и запрещает прохождение счетных импульсов. Устройство переходит в исходное состояние до прихода очередного импульса запуска.
Таким образом, на выходе счетчика 6 в течение одного периода следования импульсов запуска образуется прямоугольный импульс, который является задержанным относительно импульса запуска, причем величину Т задержки можно определить по формуле
Т = ^/2^ + где к и К - коды, поступающие на младшие и старшие разряды шины кода задержки соответственно;
'с - период следования тактовых импульсов;
m - число младших разрядов шины кода задержки.
Таким образом, предложенное устройство позволяет формировать задержанный сигнал с требуемой точностью, при существенно меньших аппаратно-мощностных затратах и меньшем числе связей между элементами устройства, что · выгодно отличает его от устройствапрототипа.
Claims (1)
- Формула изобретенияУстройство задержки, содержащее элемент И, коммутатор каналов, генератор многофазного напряжения формирователь, счетчик и триггер, первый вход которого является входом устройства, информационные входы счетчика подключены к соответствующим разрядам шины кода задержки, первый вход элемента И является тактовым входом устройства, второй вход элемента И соединен с входом формирователя и подключен к выходу триггера, выход формирователя соединен с управляющим входом счетчика, вход генератора многофазног.о напряжения соединен с выходом элемента И, отличающееся5 1653145 тем, что , с целью сокращения аппаратных затрат, в него введен регистр памяти, при этом управляющий вход регистра памяти подключен к выходу формирователя, информационные входы коммутатора каналов подключены к выходам генератора многофазного напряжения, адресные входы коммутатора каналов подклю чены через регистр памяти к соответствующим младшим разрядам шины кода задержки , выход коммутатора каналов соединен jco счетным входом счетчика , выход переполнения которого соединен с вторым входом триггера и является выходом устройства.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU894657034A SU1653145A1 (ru) | 1989-02-27 | 1989-02-27 | Устройство задержки |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU894657034A SU1653145A1 (ru) | 1989-02-27 | 1989-02-27 | Устройство задержки |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1653145A1 true SU1653145A1 (ru) | 1991-05-30 |
Family
ID=21431697
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU894657034A SU1653145A1 (ru) | 1989-02-27 | 1989-02-27 | Устройство задержки |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1653145A1 (ru) |
-
1989
- 1989-02-27 SU SU894657034A patent/SU1653145A1/ru active
Non-Patent Citations (1)
Title |
---|
Авторское свидетельство СССР 790221, кл. Н 03 К 3/13, 1979. Авторское свидетельство СССР № 1234956, кл. Н 03 К 5/153, 1984. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU1653145A1 (ru) | Устройство задержки | |
SU1234956A1 (ru) | Устройство дискретной задержки | |
SU1058039A1 (ru) | Распределитель импульсов | |
SU1213525A1 (ru) | Формирователь длительности импульсов | |
SU1226619A1 (ru) | Формирователь последовательности импульсов | |
SU1420648A1 (ru) | Формирователь импульсных последовательностей | |
SU1436113A1 (ru) | Генератор случайного процесса | |
SU1298907A1 (ru) | Делитель частоты импульсов | |
SU917172A1 (ru) | Цифровой измеритель временных интервалов | |
SU790099A1 (ru) | Цифровой умножитель частоты следовани импульсов | |
SU978098A1 (ru) | Преобразователь временных интервалов | |
SU1449937A1 (ru) | Цифровой измеритель временного положени середины видеоимпульсов | |
SU1381419A1 (ru) | Цифровой измеритель длительности временных интервалов | |
SU993460A1 (ru) | Пересчетное устройство | |
SU892413A2 (ru) | Измеритель интервалов между серединами импульсов | |
SU970267A1 (ru) | Цифровой регистратор формы периодических сигналов | |
SU1297003A1 (ru) | Устройство дл определени временного положени абсолютного максимума в реализации сигнала | |
SU1405116A1 (ru) | Способ интегрирующего аналого-цифрового преобразовани | |
SU1555855A1 (ru) | Управл емый кольцевой счетчик | |
SU1374430A1 (ru) | Преобразователь частоты в код | |
SU1406790A1 (ru) | Делитель частоты с переменным коэффициентом делени | |
SU1411702A1 (ru) | Устройство дл измерени интервалов времени | |
SU725238A1 (ru) | Делитель частоты следовани импульсов с переменным коэффициентом делени | |
SU864538A1 (ru) | Устройство допускового контрол | |
SU1274126A1 (ru) | Управл емый генератор импульсных последовательностей |