SU1534467A1 - Моделирующий элемент веро тностного графа - Google Patents
Моделирующий элемент веро тностного графа Download PDFInfo
- Publication number
- SU1534467A1 SU1534467A1 SU864140770A SU4140770A SU1534467A1 SU 1534467 A1 SU1534467 A1 SU 1534467A1 SU 864140770 A SU864140770 A SU 864140770A SU 4140770 A SU4140770 A SU 4140770A SU 1534467 A1 SU1534467 A1 SU 1534467A1
- Authority
- SU
- USSR - Soviet Union
- Prior art keywords
- input
- failure
- modeling
- output
- trigger
- Prior art date
Links
Landscapes
- Hardware Redundancy (AREA)
Abstract
Изобретение относитс к области вычислительной техники, может быть использовано при исследовании работоспособности систем, представл емых веро тностными графами, и позвол ет учитывать последовательность перехода элементов системы в состо ние отказа. Моделирующий элемент содержит первый и второй триггеры 1 и 2, элементы ИЛИ 3 и 4, элементы И 5 и 6, информационные входы 7 первой группы моделирующего элемента 8, информационные входы 9 второй группы моделирующего элемента 8, тактовые входы 10 и 11 моделирующего элемента 8, вход 12 установки в ноль и выходы 13 и 14 моделирующего элемента 8. Перед началом работы моделирующие элементы 8 соедин ют в соответствии с графом, представл ющим систему, и, использу , например, генераторы случайных событий, моделируют выход из стро (отказ, необнаруженный отказ) элементов системы. При этом могут быть определены такие параметры системы, как веро тность отказа, веро тность безотказной работы и веро тность частичного отказа за интервал времени. 3 ил.
Description
-xz
фиг.1
б,
13
52
lit
Ю w 41
ю чг w
75
75
Т т
ii 1,
DC 77
с 18А
18в ф
м
/ г
с 18С к
с 18м
W
Задание колич.
реализаций Лусх
19
Задание длины Запрет после реализации м реализации
Фиг.З
Claims (1)
- 45 Формула изобретения Моделирующий элемент вероятностного графа, содержащий два триггера, два элемента И, элемент ИЛИ и элемент И/ИЛИ, причем информационные входы первой группы моделирующего элемента подключены к соответствующим входам первого элемента И, выход которого подключен к первому входу элемента ИЛИ, выход которого является первым выходом моделирующего элемента, первый тактовый вход которого подключен к входу синхронизации первого триггера, прямой выход которого подключен к второму входу элемента ИЛИ и первому входу элемента И/ИЛИ, вход уровня логической которого подключены к соответствующим входам второго элемента И, выединицы моделирующего элемента подключен к информационному входу первого триггера, инверсный выход второго триггера подключен к второму входу элемента И/ИЛИ, вход установки в О моделирующего элемента подключен к входу установки в О первого триггера и к входу установки в ”0 второго триггера, вход синхронизации которого является вторым тактовым входом моделирующего элемента, информационные входы второй группы ход которого подключен к третьему 'входу элемента И/ИЛИ, выход которого является вторым выходом моделирующего элемента, отличающийс я тем, что, с целью повышения достоверности моделирования систем,, 10 представляемых вероятностным гра— j фом за счет учета последовательноети перехода элементов системы в сос тояние отказа, инверсный выход первого триггера подключен к информа15 ционному входу второго триггера.»0-------*©--->Фиг. 3
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864140770A SU1534467A1 (ru) | 1986-10-27 | 1986-10-27 | Моделирующий элемент веро тностного графа |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU864140770A SU1534467A1 (ru) | 1986-10-27 | 1986-10-27 | Моделирующий элемент веро тностного графа |
Publications (1)
Publication Number | Publication Date |
---|---|
SU1534467A1 true SU1534467A1 (ru) | 1990-01-07 |
Family
ID=21265091
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU864140770A SU1534467A1 (ru) | 1986-10-27 | 1986-10-27 | Моделирующий элемент веро тностного графа |
Country Status (1)
Country | Link |
---|---|
SU (1) | SU1534467A1 (ru) |
-
1986
- 1986-10-27 SU SU864140770A patent/SU1534467A1/ru active
Non-Patent Citations (1)
Title |
---|
Авторское свидетельство СССР К 1064281, кл. G 06 F 15/20, 1981. Авторское свидетельство СССР № 1187175, кл. С, 06 F 15/20, 1983. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
SU1534467A1 (ru) | Моделирующий элемент веро тностного графа | |
US4616335A (en) | Apparatus for suspending a system clock when an initial error occurs | |
JPS5741702A (en) | Storage device and counter using said device | |
JPS57196364A (en) | Free-running dual control system | |
SU1619387A1 (ru) | Синхронизирующее устройство | |
SU1285471A1 (ru) | Устройство управлени контролем | |
SU658560A1 (ru) | Вычитатель частот | |
SU1483622A2 (ru) | Коммутатор | |
SU1368876A1 (ru) | Генератор случайных чисел | |
SU1200270A1 (ru) | Устройство управлени шаговым режимом микропроцессора | |
SU600737A1 (ru) | Самовосстанавливающийс кольцевой счетчик | |
SU1104495A2 (ru) | Устройство управлени вводом-выводом | |
SU798816A1 (ru) | Устройство дл сравнени двоичных чисел | |
RU2093881C1 (ru) | Адаптивное устройство управления | |
SU642700A1 (ru) | Устройство дл обмена информацией | |
SU1646058A1 (ru) | Дешифратор врем импульсных кодов | |
SU1442992A1 (ru) | Устройство дл загрузки и реорганизации файла | |
SU552604A1 (ru) | Устройство дл сопр жени каналов | |
JPS6233394Y2 (ru) | ||
SU1226661A1 (ru) | Счетчик в коде "2 из @ | |
JPS5627448A (en) | Data identity detection system | |
SU1273942A1 (ru) | Устройство дл моделировани систем массового обслуживани | |
SU935946A1 (ru) | Устройство дл поиска числа,ближайшего к заданному | |
SU881734A1 (ru) | Устройство дл определени экстремальных чисел | |
RU1839263C (ru) | Устройство дл решени задач на веро тностных графах |