RU2778678C1 - Логический модуль - Google Patents
Логический модуль Download PDFInfo
- Publication number
- RU2778678C1 RU2778678C1 RU2021117933A RU2021117933A RU2778678C1 RU 2778678 C1 RU2778678 C1 RU 2778678C1 RU 2021117933 A RU2021117933 A RU 2021117933A RU 2021117933 A RU2021117933 A RU 2021117933A RU 2778678 C1 RU2778678 C1 RU 2778678C1
- Authority
- RU
- Russia
- Prior art keywords
- elements
- inputs
- majority
- input
- output
- Prior art date
Links
- 239000000126 substance Substances 0.000 abstract 1
- 238000004458 analytical method Methods 0.000 description 1
- 230000015572 biosynthetic process Effects 0.000 description 1
- 238000010586 diagram Methods 0.000 description 1
- 238000003786 synthesis reaction Methods 0.000 description 1
- 230000002194 synthesizing Effects 0.000 description 1
Images
Abstract
Изобретение относится к области вычислительной техники. Технический результат заключается в обеспечении реализации простых симметричных булевых функций, зависящих от 7 входных двоичных сигналов. Технический результат достигается за счет того, что логический модуль содержит три элемента И, два элемента ИЛИ и восемь мажоритарных элементов, причем i-й вход j-го мажоритарного элемента соединен с i-ми входами j-х элементов И, ИЛИ, вторые входы (i+3)-го, восьмого мажоритарных элементов и выход j-го элемента И подключены соответственно к выходам (i+2)-го, седьмого и второму входу (4×(j-1))-го мажоритарных элементов, выходы j-го, седьмого, восьмого мажоритарных элементов и j-й вход третьего элемента И соединены соответственно с третьими входами (11-4×j)-го, четвертого, шестого мажоритарных элементов и выходом j-го элемента ИЛИ, третьи входы пятого, восьмого и выход третьего мажоритарных элементов подключены соответственно к выходу третьего элемента И и первому входу восьмого мажоритарного элемента, а первые входы третьего, седьмого и первые входы четвертого, пятого мажоритарных элементов образуют соответственно первый и второй настроечные входы логического модуля, (i+3×(j-3))-й, седьмой информационные входы и выход которого соединены соответственно с i-м входом j-го, первым входом и выходом шестого мажоритарных элементов. 1 ил.
Description
Изобретение относится к вычислительной технике и может быть использовано для построения средств автоматики, функциональных узлов систем управления и др.
Известны логические модули (см., например, патент РФ 2542920, кл. G06F 7/57, 2015 г.), которые с помощью константной настройки реализуют любую из простых симметричных булевых функций τ(n-1)/2, τ(n+1)/2, τ3×(n-1)/4, зависящих от n аргументов - входных двоичных сигналов, при n=3.
К причине, препятствующей достижению указанного ниже технического результата при использовании известных логических модулей, относятся ограниченные функциональные возможности, обусловленные тем, что не обеспечивается реализация любой из функций τ(n-1)/2, τ(n+1)/2, τ3×(n-1)/4, при n=7.
Наиболее близким устройством того же назначения к заявленному изобретению по совокупности признаков является принятый за прототип логический модуль (патент РФ 2249844, кл. G06F 7/38, 2005 г.), который содержит элемент И, элемент ИЛИ, два мажоритарных элемента и с помощью константной настройки реализует любую из простых симметричных булевых функций τ(n-1)/2, τ(n+1)/2, τ(n-1)/4, зависящих от n аргументов - входных двоичных сигналов, при n=3.
К причине, препятствующей достижению указанного ниже технического результата при использовании прототипа, относятся ограниченные функциональные возможности, обусловленные тем, что не обеспечивается реализация любой из функций τ(n-1)/2, τ(n+1)/2, τ(n-1)/4, при n=7.
Техническим результатом изобретения является расширение функциональных возможностей за счет обеспечения реализации с помощью константной настройки любой из простых симметричных булевых функций τ(n-1)/2, τ(n+1)/2, τ(n-1)/4, зависящих от n аргументов - входных двоичных сигналов, при n=7.
Указанный технический результат при осуществлении изобретения достигается тем, что в логическом модуле, содержащем элемент И, элемент ИЛИ и два мажоритарных элемента, особенность заключается в том, что в него дополнительно введены два элемента И, элемент ИЛИ и шесть мажоритарных элементов, причем i-й вход j-го мажоритарного элемента соединен с i-ми входами j-ых элементов И, ИЛИ, вторые входы (i+3)-го, восьмого мажоритарных элементов и выход j-го элемента И подключены соответственно к выходам (i+2)-го, седьмого и второму входу (4×j-1)-го мажоритарных элементов, выходы j-го, седьмого, восьмого мажоритарных элементов и j-й вход третьего элемента И соединены соответственно с третьими входами (11-4×j)-го, четвертого, шестого мажоритарных элементов и выходом j-го элемента ИЛИ, третьи входы пятого, восьмого и выход третьего мажоритарных элементов подключены соответственно к выходу третьего элемента И и первому входу восьмого мажоритарного элемента, а первые входы третьего, седьмого и первые входы четвертого, пятого мажоритарных элементов образуют соответственно первый и второй настроечные входы логического модуля, (i+3×j-3)-й, седьмой информационные входы и выход которого соединены соответственно с i-ым входом j-го, первым входом и выходом шестого мажоритарных элементов.
На чертеже представлена схема предлагаемого логического модуля.
Логический модуль содержит элементы И 11, 12, 13, элементы ИЛИ 21, 22 и мажоритарные элементы 31,…,38, причем i-й вход элемента 3j соединен с i-ми входами элементов 1j, 2j, вторые входы элементов 3i+3, 38 и выход элемента 1j подключены соответственно к выходам элементов 3i+2, 37 и второму входу элемента 34×j-1, выходы элементов 3j, 37, 38 и j-й вход элемента 13 соединены соответственно с третьими входами элементов 311-4×j, 34, 36 и выходом элемента 2j, третьи входы элементов 35, 38 и выход элемента 33 подключены соответственно к выходу элемента 13 и первому входу элемента 38, а первые входы элементов 33, 37 и первые входы элементов 34, 35 образуют соответственно первый и второй настроечные входы логического модуля, (i+3×j-3)-й, седьмой информационные входы и выход которого соединены соответственно с i-ым входом элемента 3j, первым входом и выходом элемента 36.
Работа предлагаемого логического модуля осуществляется следующим образом. На его первом, втором настроечных входах фиксируются соответственно необходимые сигналы y1,y2 ∈{0,1} константной настройки. На его первый,…,седьмой информационные входы подаются соответственно двоичные сигналы х1,…,х7 ∈ {0,1}. На выходе мажоритарного элемента 3m имеем , где и #, ∨, ⋅ есть соответственно сигналы на первом, втором, третьем входах этого элемента и символы операций Maj, ИЛИ, И. Следовательно, сигнал на выходе элемента 36 определяется выражением
где τ3,τ4,τ6 есть простые симметричные булевы функции семи аргументов x1,…,х7 (см. стр. 126 в книге Поспелов Д.А. Логические методы анализа и синтеза схем. М: Энергия, 1974 г.).
Вышеизложенные сведения позволяют сделать вывод, что предлагаемый логический модуль обладает более широкими по сравнению с прототипом функциональными возможностями, так как с помощью константной настройки реализует любую из простых симметричных булевых функций τ(n-1)/2, τ(n+1)/2, τ(n-1)/4, зависящих от n аргументов - входных двоичных сигналов, при n=7.
Claims (1)
- Логический модуль, предназначенный для реализации простых симметричных булевых функций, содержащий элемент И, элемент ИЛИ и два мажоритарных элемента, отличающийся тем, что в него дополнительно введены два элемента И, элемент ИЛИ и шесть мажоритарных элементов, причем i-й вход j-го мажоритарного элемента соединен с i-ми входами j-х элементов И, ИЛИ, вторые входы (i+3)-го, восьмого мажоритарных элементов и выход j-го элемента И подключены соответственно к выходам (i+2)-го, седьмого и второму входу (4×j-1)-го мажоритарных элементов, выходы j-го, седьмого, восьмого мажоритарных элементов и j-й вход третьего элемента И соединены соответственно с третьими входами (11-4×j)-го, четвертого, шестого мажоритарных элементов и выходом j-го элемента ИЛИ, третьи входы пятого, восьмого и выход третьего мажоритарных элементов подключены соответственно к выходу третьего элемента И и первому входу восьмого мажоритарного элемента, а первые входы третьего, седьмого и первые входы четвертого, пятого мажоритарных элементов образуют соответственно первый и второй настроечные входы логического модуля, (i+3×j-3)-й, седьмой информационные входы и выход которого соединены соответственно с i-м входом j-го, первым входом и выходом шестого мажоритарных элементов.
Publications (1)
Publication Number | Publication Date |
---|---|
RU2778678C1 true RU2778678C1 (ru) | 2022-08-23 |
Family
ID=
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2542895C1 (ru) * | 2013-11-06 | 2015-02-27 | Федеральное государственное бюджетное образовательное учреждение высшего профессионального образования "Ульяновский государственный технический университет" | Логический преобразователь |
US9871520B1 (en) * | 2016-08-15 | 2018-01-16 | Xilinx, Inc. | Voting circuit and self-correcting latches |
RU2710877C1 (ru) * | 2019-03-13 | 2020-01-14 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Мажоритарный модуль |
RU2718209C1 (ru) * | 2019-03-14 | 2020-03-31 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический модуль |
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
RU2542895C1 (ru) * | 2013-11-06 | 2015-02-27 | Федеральное государственное бюджетное образовательное учреждение высшего профессионального образования "Ульяновский государственный технический университет" | Логический преобразователь |
US9871520B1 (en) * | 2016-08-15 | 2018-01-16 | Xilinx, Inc. | Voting circuit and self-correcting latches |
RU2710877C1 (ru) * | 2019-03-13 | 2020-01-14 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Мажоритарный модуль |
RU2718209C1 (ru) * | 2019-03-14 | 2020-03-31 | федеральное государственное бюджетное образовательное учреждение высшего образования "Ульяновский государственный технический университет" | Логический модуль |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
RU2701461C1 (ru) | Мажоритарный модуль | |
RU2621281C1 (ru) | Логический преобразователь | |
RU2472209C1 (ru) | Логический модуль | |
RU2704735C1 (ru) | Пороговый модуль | |
RU2641454C2 (ru) | Логический преобразователь | |
RU2703675C1 (ru) | Логический преобразователь | |
RU2629451C1 (ru) | Логический преобразователь | |
RU2701464C1 (ru) | Логический преобразователь | |
RU2778678C1 (ru) | Логический модуль | |
RU2393528C2 (ru) | Логический модуль | |
RU2718209C1 (ru) | Логический модуль | |
RU2676888C1 (ru) | Логический модуль | |
RU2700556C1 (ru) | Логический преобразователь | |
RU2700557C1 (ru) | Логический преобразователь | |
RU2621376C1 (ru) | Логический модуль | |
RU2634229C1 (ru) | Логический преобразователь | |
RU2629452C1 (ru) | Логический преобразователь | |
RU2709664C1 (ru) | Пороговый модуль | |
RU2700550C1 (ru) | Логический модуль | |
RU2758187C1 (ru) | Логический модуль | |
RU2776920C1 (ru) | Логический модуль | |
RU2757830C1 (ru) | Логический модуль | |
RU2758188C1 (ru) | Логический модуль | |
RU2714216C1 (ru) | Пороговый модуль | |
RU2757817C1 (ru) | Логический преобразователь |