RU2659990C1 - Цифровое четырехканальное реле с функцией реконструктивной диагностики - Google Patents

Цифровое четырехканальное реле с функцией реконструктивной диагностики Download PDF

Info

Publication number
RU2659990C1
RU2659990C1 RU2017123705A RU2017123705A RU2659990C1 RU 2659990 C1 RU2659990 C1 RU 2659990C1 RU 2017123705 A RU2017123705 A RU 2017123705A RU 2017123705 A RU2017123705 A RU 2017123705A RU 2659990 C1 RU2659990 C1 RU 2659990C1
Authority
RU
Russia
Prior art keywords
input
output
logical element
logical
decoder
Prior art date
Application number
RU2017123705A
Other languages
English (en)
Inventor
Валерий Геннадьевич Сугаков
Юрий Сергеевич Малышев
Илья Игоревич Ягжов
Original Assignee
Федеральное государственное бюджетное образовательное учреждение высшего образования "Волжский государственный университет водного транспорта" (ФГБОУ ВО ВГУВТ)
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Федеральное государственное бюджетное образовательное учреждение высшего образования "Волжский государственный университет водного транспорта" (ФГБОУ ВО ВГУВТ) filed Critical Федеральное государственное бюджетное образовательное учреждение высшего образования "Волжский государственный университет водного транспорта" (ФГБОУ ВО ВГУВТ)
Priority to RU2017123705A priority Critical patent/RU2659990C1/ru
Application granted granted Critical
Publication of RU2659990C1 publication Critical patent/RU2659990C1/ru

Links

Images

Classifications

    • G—PHYSICS
    • G01—MEASURING; TESTING
    • G01P—MEASURING LINEAR OR ANGULAR SPEED, ACCELERATION, DECELERATION, OR SHOCK; INDICATING PRESENCE, ABSENCE, OR DIRECTION, OF MOVEMENT
    • G01P3/00—Measuring linear or angular speed; Measuring differences of linear or angular speeds
    • G01P3/42—Devices characterised by the use of electric or magnetic means
    • G01P3/50—Devices characterised by the use of electric or magnetic means for measuring linear speed
    • G01P3/54—Devices characterised by the use of electric or magnetic means for measuring linear speed by measuring frequency of generated current or voltage

Landscapes

  • Physics & Mathematics (AREA)
  • General Physics & Mathematics (AREA)
  • Arrangements For Transmission Of Measured Signals (AREA)

Abstract

Изобретение относится к средствам автоматизации и может быть использовано, в частности, в системах управления электроагрегатов генераторных с приводом от двигателя внутреннего сгорания. Схема устройства включает первый 1, второй 2, третий 3 и четвертый 4 приемные датчики соответствующих уставок, дешифратор 5, первый 6, второй 7, третий 8, четвертый 9, пятый 10, шестой 11, седьмой 12, восьмой 13, девятый 14 и десятый 15 логические элементы ИЛИ, первый 16, второй 17, третий 18, четвертый 19, пятый 20 и шестой 21 логические элементы И, первый 22, второй 23, третий 24, четвертый 25, пятый 26, шестой 27, седьмой 28 и восьмой 29 логические элементы НЕ, элемент задержки 30, первый 31, второй 32, третий 33, четвертый 34, пятый 35, шестой 36, седьмой 37 и восьмой 38 формирователи коротких импульсов, первый 39 и второй 40 регистры памяти, блок памяти 41, первый 42, второй 43, третий 44 и четвертый 45 индикаторы сбоя соответствующих каналов и шину СБРОС 46. Технический результат заключается в расширении функциональных возможностей путем увеличения числа контролируемых каналов выходной информации. 2 ил.

Description

Изобретение относится к средствам автоматизации и может быть использовано в частности в системах управления электроагрегатов генераторных с приводом от двигателя внутреннего сгорания.
Известны аналоговые реле различного типа, содержащие измерительный преобразователь и выходной каскад, использующие различные способы измерения контролируемой физической величины /1, 2/.
Их недостатками являются ограниченные функциональные возможности в частности достоверность выходной информации и точность настройки.
Известен цифровой измеритель скорости вращения содержащий импульсный датчик, генератор эталонной частоты, счетчик импульсов, элемент задержки и электронные ключи /3/. Он обеспечивает удовлетворительную точность.
Его недостатком являются невысокие функциональные возможности, заключающиеся в наличии лишь одного выходного канала и невысокая достоверность выходной информации.
Известно реле частоты вращения с трехканальным выходом по числу уставок, содержащее формирователь коротких импульсов, преобразователь частоты в постоянное напряжение, три пороговых устройства с задатчиками уставок, шесть индикаторов состояния и выходное устройство с тремя каскадами /4/. Наличие трех выходных каналов расширяет возможности РЧВ.
Однако возможные сбои в измерительной части и в выходных каналах при отсутствии самодиагностики отражаются на достоверности выходной информации РЧВ и могут привести к сбою в работе системы управления.
Наиболее близким по технической сущности к изобретению является цифровое реле частоты вращения с функцией реконструктивной диагностики, содержащее формирователь коротких импульсов, первый, второй и третий числовые компараторы, к разрядам первых входов которых подключены соответствующие разряды выходов соответственно первого, второго и третьего задающего регистра, выходное устройство с тремя выходными каскадами, три индикатора и элемент задержки, выход которого подключен к сбросовым входам первого и второго счетчика и входу записи исходного числа реверсивного счетчика, а вход соединен с выходом формирователя коротких импульсов, к которому так же подключены: вход распределителя импульсов, вход записи первого регистра памяти, единичный вход второго RS-триггера и первые входы пятого и десятого логического элемента И, вторые входы которых подключены соответственно к первому и второму выходу четвертого числового компаратора, разряды первого входа которого соединены с соответствующими разрядами выхода четвертого задающего регистра, разряды второго входа - с соответствующими разрядами выхода реверсивного счетчика, суммирующий вход которого подключен к выходу четвертого логического элемента И, вычитающий вход - к выходу третьего логического элемента И, а выход заема - к сбросовому входу второго RS-триггера прямой и инверсный выходы которого соответственно соединены со вторыми входами третьего и четвертого логических элементов И, первые входы которых подключены к выходу генератора импульсов стабильной частоты, к которому так же подключены первые входы первого и второго логических элементов И, ко вторым входам которых подключены соответственно прямой и инверсный выходы первого RS-триггера, а к выходам - счетные входы соответственно первого и второго счетчика, разряды выходов которых соответственно через первый и второй электронные ключи подключены к соответствующим разрядам входа первого регистра памяти, причем управляющий вход первого электронного ключа связан со вторым выходом распределителя импульсов и сбросовым входом первого RS-триггера, а управляющий вход второго электронного ключа - с первым выходом распределителя импульсов и единичным входом первого RS-триггера, кроме того соответствующие разряды выхода первого регистра памяти подключены к соответствующим разрядам входа исходного числа реверсивного счетчика и вторых входов первого, второго и третьего числовых компараторов выходы БОЛЬШЕ которых подключены соответственно к первому, второму и третьему разрядам входа дешифратора нулевой выход которого подключен к сбросовому входу третьего RS-триггера инверсный выход которого соединен с первым входом восьмого логического элемента И, прямой выход - с первым входом девятого логического элемента И, а единичный вход - с третьим выходом дешифратора, второй выход которого подключен к вторым входам восьмого и девятого логического элемента И, четвертый выход - к входу третьего индикатора входу первого логического элемента НЕ, выход которого подключен ко второму входу шестого логического элемента И, соединенного первым входом с выходом третьего числового компаратора, а выходом - с третьим разрядом входа второго регистра памяти, первый, второй и третий разряды выхода которого подключены соответственно к входам первого, второго и третьего выходного каскада, второй разряд входа - к выходу третьего логического элемента ИЛИ, а первый разряд входа - к выходу первого логического элемента ИЛИ, первый вход которого связан с выходом первого числового компаратора, второй вход - с вторым входом второго логического элемента ИЛИ и шестым выходом дешифратора, пятый выход которого соединен со вторым входом третьего логического элемента ИЛИ и первым входом четвертого логического элемента ИЛИ, выход которого подключен к входу второго индикатора, а второй вход - к выходу восьмого логического элемента И, связанного с входом второго логического элемента НЕ, выход которого соединен со вторым входом седьмого логического элемента И, подключенного выходом к первому входу третьего логического элемента ИЛИ, а первым входом - к выходу второго числового компаратора, кроме того выход девятого логического элемента И связан с третьим входом первого логического элемента ИЛИ и первым входом второго логического элемента ИЛИ, связанного выходом со входом первого индикатора, а выход десятого логического элемента И соединен с единичным входом четвертого RS-триггера, сбросовый вход которого подключен к шине сброс, а выход пятого логического элемента И - к входу записи второго регистра памяти /5/. Три задающих регистра и три числовых компаратора по существу представляют три приемных реле. Самоконтроль обеспечивает достоверность выходной информации.
Однако это реле имеет возможность контроля лишь трех каналов информации.
Цель изобретения - расширение функциональных возможностей путем увеличения числа контролируемых каналов выходной информации.
Цель изобретения достигается тем, что цифровое четырехканальное реле с функцией реконструктивной диагностики, содержащее три приемных реле, первый формирователь коротких импульсов, дешифратор, элемент задержки, с первого по четвертый логические элементы ИЛИ, с первого по шестой логические элементы И, первый логический элемент НЕ, выход которого подключен к второму входу первого логического элемента И, второй логический элемент НЕ, выход которого подключен к второму входу второго логического элемента И, первого и второй регистры памяти, с первого по третий индикаторы состояния, причем к входу первого индикатора состояния подключен выход второго логического элемента ИЛИ, а к входу второго индикатора состояния - выход четвертого логического элемента ИЛИ снабжено четвертым приемным реле, с пятого по десятый логическими элементами ИЛИ, с третьего по восьмой логическими элементами НЕ, со второго по восьмой формирователями короткий импульсов, блоком памяти и четвертым индикатором состояния, вход которого подключен к выходу десятого логического элемента ИЛИ, первый вход которого связан с восьмым выходом дешифратора и третьим входом первого логического элемента ИЛИ, второй вход - с девятым выходом дешифратора и вторым входом седьмого логического элемента ИЛИ, третий вход - с выходом второго логического элемента И, четвертым входом четвертого элемента ИЛИ и пятым входом первого логического элемента ИЛИ, четвертый вход - с выходом шестого логического элемента И, шестым входом первого логического элемента ИЛИ и четвертым входом девятого логического элемента ИЛИ, выход которого подключен к входу третьего индикатора состояния, а третий вход связан с выходом четвертого логического элемента И, третьим входом второго логического элемента ИЛИ и пятым входом пятого логического элемента ИЛИ, выход которого подключен к входу четвертого адреса блока памяти, а первый вход - к пятнадцатому выходу дешифратора, второй вход - к одиннадцатому выходу дешифратора и второму входу девятого логического элемента ИЛИ, третий вход - к тринадцатому выходу дешифратора и второму входу четвертого логического элемента ИЛИ, четвертый вход - к четырнадцатому выходу дешифратора и второму входу второго логического элемента ИЛИ, шестой вход - к выходу пятого логического элемента И, пятому входу второго логического элемента ИЛИ и пятому входу четвертого логического элемента ИЛИ, первый вход которого связан со вторым входом восьмого логического элемента ИЛИ и пятым выходом дешифратора, четвертый выход которого соединен со вторым входом первого логического элемента ИЛИ и первым входом девятого логического элемента ИЛИ, нулевой выход дешифратора - с первым входом первого логического элемента ИЛИ, первый выход - с первым входом седьмого логического элемента ИЛИ, второй выход - с первыми входами первого и третьего логических элементов И, третий выход - с первым входом третьего логического элемента ИЛИ, шестой выход - с третьим входом восьмого логического элемента ИЛИ и первым входом второго логического элемента ИЛИ, седьмой выход - с первым входом восьмого логического элемента ИЛИ, выход которого подключен к входу третьего адреса блока памяти, разряды выхода которого являются выходами реле, а вход нулевого адреса блока памяти соединен с выходом первого логического элемента ИЛИ, вход первого адреса - с выходом седьмого логического элемента ИЛИ, вход второго адреса - с выходом третьего логического элемента ИЛИ, второй вход которого связан с четвертым входом второго логического элемента ИЛИ и выходом третьего логического элемента И, второй вход которого связан со вторым входом четвертого логического элемента И, вторым входом пятого логического элемента И, входом первого логического элемента НЕ и первым разрядом выхода второго регистра памяти, второй разряд выхода которого подключен к входу второго логического элемента НЕ и третьему входу пятого логического элемента И, первый вход которого связан с двенадцатым выходом дешифратора и первым входом шестого логического элемента И, второй вход которого соединен с третьим входом второго логического элемента И и выходом седьмого логического элемента НЕ, а третий вход - с выходом восьмого логического элемента НЕ, вход которого связан с третьим входом четвертого логического элемента И и третьим выходом второго регистра памяти, четвертый разряд выхода которого подключен к входу седьмого логического элемента НЕ, а сбросовый вход второго регистра памяти - к шине СБРОС и сбросовому входу первого регистра памяти, вход записи которого соединен с выходом элемента задержки и разряды выхода первого регистра памяти - с соответствующими разрядами входа второго регистра памяти, а соответствующие разряды входа - с соответствующими разрядами входа дешифратора и выходами соответствующих приемных реле, кроме того выход первого приемного реле подключен к входу первого формирователя коротких импульсов и входу третьего логического элемента НЕ, выход которого соединен с входом второго формирователя коротких импульсов, связанного выходом с первым входом шестого логического элемента ИЛИ, второй вход которого подключен к выходу первого формирователя коротких импульсов, третий вход - к выходу четвертого формирователя коротких импульсов, вход которого соединен с выходом четвертого логического элемента НЕ, вход которого связан с выходом второго приемного реле и входом третьего формирователя коротких импульсов, выход которого подключен к четвертому входу шестого логического элемента ИЛИ, пятый вход которого соединен с выходом шестого формирователя коротких импульсов, соединенного входом с выходом пятого логического элемента НЕ, вход которого связан с выходом третьего приемного реле и входом пятого формирователя коротких импульсов, подключенного выходом к шестому входу шестого логического элемента ИЛИ, седьмой вход которого соединен с выходом восьмого формирователя коротких импульсов, соединенного входом с выходом шестого логического элемента НЕ, вход которого соединен с выходом четвертого приемного реле и входом седьмого формирователя коротких импульсов, выход которого подключен к восьмому входу шестого логического элемента ИЛИ, связанного выходом с входом записи второго регистра памяти и входом элемента задержки, кроме того выход первого логического элемента И подключен к четвертому входу первого логического элемента ИЛИ и третьему входу четвертого логического элемента ИЛИ, а десятый выход дешифратора соединен с первыми входами второго и четвертого логических элементов И.
С третьего по шестой логические элементы НЕ и с первого по восьмой формирователи коротких импульсов совместно с шестым логическим элементом ИЛИ и их связями обеспечивают фиксацию информации на выходе приемных реле в предыдущий момент времени. Четвертое приемное реле и четвертый индикатор состояния обеспечивают контроль четвертого канала информации. С пятого по десятый логические элементы ИЛИ, блок памяти и их связи обеспечиваю дополнительный контроль по семи сбойным ситуациям.
На фиг. 1 представлена схема цифрового четырехканального реле с функцией реконструктивной диагностики, на фиг. 2 - эпюры сигналов на элементах устройства.
Реле (фиг. 1) включает первый 1, второй 2, третий 3 и четвертый 4 приемные датчики соответствующих уставок, дешифратор 5, первый 6, второй 7, третий 8, четвертый 9, пятый 10, шестой 11, седьмой 12, восьмой 13, девятый 14 и десятый 15 логические элементы ИЛИ, первый 16, второй 17, третий 18, четвертый 19, пятый 20 и шестой 21 логические элементы И, первый 22, второй 23, третий 24, четвертый 25, пятый 26, шестой 27, седьмой 28 и восьмой 29 логические элементы НЕ, элемент задержки 30, первый 31, второй 32, третий 33, четвертый 34, пятый 35, шестой 36, седьмой 37 и восьмой 38 формирователи коротких импульсов, первый 39 и второй 40 регистры памяти, блок памяти 41, первый 42, второй 43, третий 44 и четвертый 45 индикаторы сбоя соответствующих каналов и шину СБРОС 46.
Реле работает следующим образом. Датчики 1…4 настроены на параметры срабатывания соответственно U1, U2, U3 и U4, причем U4>U3>U2>U1 (фиг. 2). По мере возрастания контролируемой величины u(t) в момент времени t1 (фиг. 2) срабатывает датчик 1 и на его выходе появляется сигнал X1. На входе дешифратора 5 устанавливается код К5 (вx)=00012=110. На первом выходе дешифратора 5 появляется сигнал, который через элемент ИЛИ 7 поступает на вход первого адреса блока памяти 41, по которому записан код 00012. В результате появляется сигнал u(t)>U1 на первом выходе блока памяти 41 (код КСАУ=00012), который поступает в систему автоматического управления (САУ).
В момент времени t2 (фиг. 2) срабатывает датчик 2 и на его выходе появляется сигнал Х2. На входе дешифратора 5 устанавливается код К5 (вх)=00112=310 и появляется сигнал на третьем его выходе, который через элемент ИЛИ 8 подается на вход второго адреса блока памяти 41, по которому записан код 00112. При этом в САУ с выхода блока памяти 41 поступают два сигнала u(t)>U1 и u(t)>U2 (код КСАУ=00112).
В момент времени t3 (фиг. 2) появляется сигнал Х3 на его выходе датчика 3. На вход дешифратора 5 подается код К5 (вх)=01112=710. На седьмом выходе дешифратора 5 появляется сигнал, поступающий через элемент ИЛИ 9 подается на вход третьего адреса блока памяти 41, по которому записан код 01112. При этом в САУ с выхода блока памяти 41 поступают три сигнала u(t)>U1, u(t)>U2 и u(t)>U3 (код КCAУ=01112).
При дальнейшем возрастании контролируемой величины u(t) в момент времени t4 (фиг. 2) срабатывает датчик 4 и на его выходе появляется сигнал Х4. На входе дешифратора 5 формируется код К5 (вх)=11112=1510. Появляется сигнал на пятнадцатом выходе дешифратора 5, который через элемент ИЛИ 10 проходит на вход четвертого адреса блока памяти 41, по которому записан код 11112. С выхода блока памяти 41 в САУ поступают четыре сигнала u(t)>U1, u(t)>U2, u(t)>U3 и u(t)>U4 (код КСАУ=11112).
При уменьшении контролируемой величины u(t) в момент времени t5 (фиг. 2) исчезает сигнал Х4 на выходе датчик 4 и на входе дешифратора 5 устанавливается код К5 (вх)=01112=710. В САУ с выхода блока памяти 41 подаются три сигнала u(t)>U1, u(t)>U2 и u(t)>U3 (код КСАУ=01112).
В момент времени t6 (фиг. 2) исчезает сигнал ХЗ на выходе датчик 3 и устанавливается код К5 (вх)=00112=310 на входе дешифратора 5. При этом с выхода блока памяти 41 подаются в САУ два сигнала u(t)>U1 и u(t)>U2 (код КСАУ=00112).
Последующее уменьшение контролируемой величины u(t) приводит к исчезновению сигнала Х2 на выходе датчика 2 в момент времени t7 (фиг. 2) и установки кода К5 (вх)=00012=110 на входе дешифратора 5. В САУ с выхода блока памяти 41 подается один сигнал u(t)>U1 (код КСАУ=00012).
В момент времени t8 (фиг. 2) исчезает сигнал X1 на выходе датчика 1 и устанавливается код К5 (вх)=00002=010 на входе дешифратора 5. С нулевого выхода дешифратора 5 через элемент ИЛИ 6 подается сигнал на вход нулевого адреса блока памяти 41, по которому записан код 00002. При этом с выхода блока памяти 41 сигналы в САУ не подаются (код КСАУ=00002).
Таким образом при монотонном возрастании контролируемой величины u(t) наблюдается следующая последовательность появления кодов К5 (вх) на входе дешифратора 5 и выходе блока 41 памяти: 00002, 00012, 00112, 01112, 11112, а при монотонном убывании - 11112, 01112, 00112, 00012, 00002. Эта естественная последовательность кодов указывает на исправность каналов уставок. При этом код КСАУ на выходе блока 41 памяти совпадает с входным кодом К5 (вх) дешифратора 5 и поступает в САУ без коррекции.
При возникновении неисправности в каналах уставок на входе дешифратора 5 могут появиться сбойные коды К5 (вх): 00102, 01002, 01012, 01102, 10002, 10012, 10102, 10112, 11002, 11012 и 11102, которые требуют коррекции перед передачей в САУ. Выявление неисправного канала осуществляется путем сравнения текущего и предыдущего кодов на входе дешифратора 5, после чего с выходе блока 41 памяти выдается в САУ откорректированный код КCАУ.
С появлением сигналов X1…Х4 на выходе любого датчика 1…4 по фронту сигналов формирователи 31, 33, 35 и 37 вырабатывают импульсы, которые поступают через элемент ИЛИ 11 и элемент задержки 30 на вход записи регистра памяти 39, в который записывается текущий входной код К5 (вх) дешифратора 5. При очередном изменении кода К5 (вх) импульсом с выхода элемента ИЛИ 11 производится перезапись предыдущего кода из регистра памяти 39 в регистр памяти 40. В регистр 39 с задержкой, обеспеченной элементом 30, осуществляется запись очередного текущего кода. Когда исчезают сигналы на выходе датчиков 1…4, перезапись кодов в регистры 39 и 40 производится импульсами, сформированными по задним фронтам сигналов X1…Х4 формирователями 32, 34, 36 и 38, на которые поступают сигналы с выходов элементов НЕ 22, 23, 24 и 25 соответственно. В результате в любой момент времени и при любом характере изменения контролируемой величины в регистр памяти 39 оказывается записан текущий код, а в регистр 40 - предыдущий код К5 (вх) с входа дешифратора 5.
Коррекция сбойных кодов осуществляется следующим образом.
Код К5 (вх)=00102 на входе дешифратора 5 может появиться при сбое датчика 1 или 2. При этом появляется сигнал на втором выходе дешифратора 5, который поступает на первые входы логических элементов И 16 и 18. Если до момента изменения кода на выходе датчика 1 присутствовал сигнал, т.е. в предыдущем коде присутствует единица в первом разряде, сигнал с первого выхода регистра 40 поступает на второй вход элемента И 18. Появляется сигнал на выходе элемента И 18, который через элемент ИЛИ 12 поступает на вход индикатора 42, указывающего на сбой в канале первой уставки. Одновременно сигнал с выхода элемента И 18 поступает на вход второго адреса блока памяти 41 и на его выходах появится скорректированный код 00112. Если до момента изменения кода на выходе датчика 1 сигнал отсутствовал, то на второй вход элемента И 16 поступает сигнал с выхода логического элемента НЕ 26. Появляется сигнал на выходе элемента И16, который через элемент ИЛИ 13 подается на индикатор 43, указывающий на сбой канала второй уставки. Через элемент ИЛИ 6 сигнал с выхода элемента И16 поступает на вход нулевого адреса блока памяти 41, на выходе которого появится скорректированный код КСАУ=00002.
Код К5 (вх))=01002 появляется в случае неисправности канала третий уставки. При этом появляется сигнал на четвертом выходе дешифратора 5, который через элемент ИЛИ 14 проходит на вход индикатора 14, указывающий на сбой канала третий уставки. В то же время через элемент 6 поступает сигнал на вход нулевого адреса блока памяти 41, на выходе которого появляется скорректированный код КСАУ=00002.
Код К5 (вх)=01012 возникает при неисправности канала второй уставки. В этой ситуации появляется сигнал на пятом выходе дешифратора 5, который через элемент ИЛИ 13 подается на вход индикатора 43, диагностирующего сбой канала второй уставки. Одновременно через элемент ИЛИ 9 проходит сигнал на вход третьего адреса блока памяти 41, на выходе которого появляется скорректированный код КСАУ=01112.
Код К5 (вх)=01102 вызван неисправностью канала первой уставки. В этом случае появляется сигнал на шестом выходе дешифратора 5, поступающий через элемент ИЛИ 12 на вход индикатора 42, указывающий на сбой канала первой уставки. Сигнал с шестого выхода дешифратора 5 также через элемент ИЛИ 9 проходит на вход третьего адреса блока памяти 41, на выходе которого появляется скорректированный код КСАУ=01112.
Код К5 (вх)=10002 наблюдается при сбое канала четвертой уставки. При этом появляется сигнал на восьмом выходе дешифратора 5. Этот сигнал через элемент ИЛИ 15 поступает на вход индикатора 45, указывающего на сбой канала четвертой уставки, а через элемент ИЛИ 6 - на вход нулевого адреса блока памяти 41. На его выход подается скорректированный код КСАУ=00002.
Код К5 (вх)=10012 появляется в случае сбоя канала четвертой уставки (сбой двух каналов менее вероятен, чем сбой одного канала). В этом случае присутствует сигнал на девятом выходе дешифратора 5 с которого через элемент ИЛИ 15 сигнал проходит на вход индикатора 45, указывающего на сбой четвертого канала. Одновременно через элемент ИЛИ 7 сигнал поступает на вход первого адреса блока памяти 41, и на его выходе появляется скорректированный код КCАУ=00012.
Код К5 (вх)=10102 вызван двойной неисправностью первого и третьего канала или неисправностью второго и четвертого канала. В обоих случаях появляется сигнал на десятом выходе дешифратора 5, который поступает на первые входы логических элементов И 17 и И 19.
Если до момента изменения кода на выходах первого 1 и третьего 3 датчика присутствовал сигнал, то с первого и третьего выхода регистра 40 поступают сигналы на второй и третий входы элемента И 19. Сигнал с его выхода через элемент ИЛИ 12 подается на индикатор 42, указывающий на сбой канала первой уставки, а через элемент ИЛИ 14 - на индикатор 44, указывающий на сбой канала третий уставки. Одновременно с выхода элемента И 19 через элемент ИЛИ 10 сигнал поступает на вход четвертого адреса блока памяти 41, на выходе которого появится скорректированный код КCАУ=11112.
Если до момента изменения кода на выходах второго 2 и четвертого 4 датчика сигнал отсутствовал, то сигналы низкого уровня со второго и четвертого входа регистра 40 инвертируются элементами НЕ 27 и 28, и на второй и третий входы элемента И 17 поступают сигналы открывающие его. Сигнал с выхода элемента И 17 через элемент ИЛИ 13 включает индикатор 43, показывающий на сбой канала второй уставки, а через элемент ИЛИ 15 - индикатор 45, показывающий на сбой канала четвертой уставки. В то же время сигнал с выхода элемента И 17 через элемент ИЛИ 6 проходит на вход нулевого адреса блока памяти 41, выдающий в САУ скорректированный код КСАУ=00002.
Код К5 (вх)=10112 наблюдается при неисправности канала третий уставки. При этом появляется сигнал на одиннадцатом выходе дешифратора 5, который через элемент ИЛИ 14 поступает на вход индикатора 44, указывающего на сбой канала третий уставки. Одновременно через элемент ИЛИ 10 сигнал проходит на вход четвертого адреса блока памяти 41, на выходе которого появляется скорректированный код КСАУ=11112.
Код К5 (вх))=11002 может появиться при двойной неисправности каналов первой и второй уставки или при неисправности каналов третий и четвертой уставки. В этих случаях появляется сигнал на двенадцатом выходе дешифратора 5, поступающий на первые входы элементов И 20 и 21.
Если до момента изменения кода на выходах первого 1 и второго 2 датчика присутствовал сигнал, то на второй и третий входы элемента И 20 поступают сигналы, которые открывают элемент И 20. С его выхода через элемент ИЛИ 12 подается сигнал на индикатор 42, сообщающий о сбое канала первой уставки, а через элемент ИЛИ 13 - на индикатор 43, сообщающий о сбое канала второй уставки. В то же время с выхода элемента И 20 через элемент ИЛИ 10 проходит сигнал на вход четвертого адреса блока памяти 41, который выдает скорректированный код КСАУ=11112.
Если до момента изменения кода на выходах датчиков 3 и 4 сигнал отсутствовал, то с выхода элементов НЕ 28 и 29 на второй и третий входы элемента И 21 поступают сигналы, которые его открывают. С выхода элемента И 21 проходит сигнал через элемент ИЛИ 14 на индикатор 44, а через элемент ИЛИ 15 на индикатор 45. Индикаторы 44 и 45 указывают на сбои в третьем и четвертом каналах уставок. Одновременно с выхода элемента И 21 через элемент ИЛИ 6 проходит сигнал на вход нулевого адреса блока памяти 41, который подает в САУ скорректированный код КСАУ=00002.
Код К5 (вх)=11012 появляется в случае неисправности второго датчика 2. При этом появляется сигнал на тринадцатом выходе дешифратора 5, поступающий через элемент ИЛИ 13 на индикатор 43, указывающий на сбой канала второй уставки, а через элемент ИЛИ 10 сигнал поступает на вход четвертого адреса блока памяти 41, который выдает скорректированный код КСАУ=11112.
Код К5 (вх)=11102 наблюдается при неисправности первого датчика 1. Эта ситуация сопровождается появлением сигнала на четырнадцатом выходе дешифратора 5, который через элемент ИЛИ 12 включает индикатор 42, указывающий на сбой канала первой уставки. Одновременно сигнал через элемент ИЛИ 10 поступает на вход четвертого адреса блока памяти 41, который выдает скорректированный код КСАУ=11112.
В результате каждый сбойный код корректируется, и в САУ поступает достоверная информация.
Таким образом, реле имеет расширенные функциональные возможности, заключающиеся в повышении достоверности выходной информации путем введения функций диагностики измерительной части и каналов уставок реле и коррекции информации при сбоях по четырем каналам, что на треть больше, чем у прототипа.
Источники информации
1. Сугаков В.Г. Основы автоматизации военных передвижных источников электрической энергии: учеб. пособие. - Кстово: НФВИУ, 2003. 168 с.
2. Дудченко В.Н., Аверкиев А.Н. Измерение неэлектрических величин: конспект лекций. - Кстово: НВВИКУ, 1997. 54 с.
3. Цифровой измеритель скорости вращения. Описание изобретения к авторскому свидетельству RU 1075167, 1984.
4. Комплекс средств контроля дизеля КСКД 17.5. Техническое описание и инструкция по эксплуатации ЗУ2.008.006 ТО. 1994. С. 35-37.
5. Цифровое реле частоты вращения с функцией реконструктивной диагностики. Описание изобретения к авторскому свидетельству RU 2618495, 2017.

Claims (1)

  1. Цифровое четырехканальное реле с функцией реконструктивной диагностики, содержащее три приемных реле, первый формирователь коротких импульсов, дешифратор, элемент задержки, с первого по четвертый логические элементы ИЛИ, с первого по шестой логические элементы И, первый логический элемент НЕ, выход которого подключен к второму входу первого логического элемента И, второй логический элемент НЕ, выход которого подключен к второму входу второго логического элемента И, первого и второй регистры памяти, с первого по третий индикаторы состояния, причем к входу первого индикатора состояния подключен выход второго логического элемента ИЛИ, а к входу второго индикатора состояния - выход четвертого логического элемента ИЛИ, отличающееся тем, что с целью расширения функциональных возможностей снабжено четвертым приемным реле, с пятого по десятый логическими элементами ИЛИ, с третьего по восьмой логическими элементами НЕ, со второго по восьмой формирователями короткий импульсов, блоком памяти и четвертым индикатором состояния, вход которого подключен к выходу десятого логического элемента ИЛИ, первый вход которого связан с восьмым выходом дешифратора и третьим входом первого логического элемента ИЛИ, второй вход - с девятым выходом дешифратора и вторым входом седьмого логического элемента ИЛИ, третий вход - с выходом второго логического элемента И, четвертым входом четвертого элемента ИЛИ и пятым входом первого логического элемента ИЛИ, четвертый вход - с выходом шестого логического элемента И, шестым входом первого логического элемента ИЛИ и четвертым входом девятого логического элемента ИЛИ, выход которого подключен к входу третьего индикатора состояния, а третий вход связан с выходом четвертого логического элемента И, третьим входом второго логического элемента ИЛИ и пятым входом пятого логического элемента ИЛИ, выход которого подключен к входу четвертого адреса блока памяти, а первый вход - к пятнадцатому выходу дешифратора, второй вход - к одиннадцатому выходу дешифратора и второму входу девятого логического элемента ИЛИ, третий вход - к тринадцатому выходу дешифратора и второму входу четвертого логического элемента ИЛИ, четвертый вход - к четырнадцатому выходу дешифратора и второму входу второго логического элемента ИЛИ, шестой вход - к выходу пятого логического элемента И, пятому входу второго логического элемента ИЛИ и пятому входу четвертого логического элемента ИЛИ, первый вход которого связан со вторым входом восьмого логического элемента ИЛИ и пятым выходом дешифратора, четвертый выход которого соединен со вторым входом первого логического элемента ИЛИ и первым входом девятого логического элемента ИЛИ, нулевой выход дешифратора - с первым входом первого логического элемента ИЛИ, первый выход - с первым входом седьмого логического элемента ИЛИ, второй выход - с первыми входами первого и третьего логических элементов И, третий выход - с первым входом третьего логического элемента ИЛИ, шестой выход - с третьим входом восьмого логического элемента ИЛИ и первым входом второго логического элемента ИЛИ, седьмой выход - с первым входом восьмого логического элемента ИЛИ, выход которого подключен к входу третьего адреса блока памяти, разряды выхода которого являются выходами реле, а вход нулевого адреса блока памяти соединен с выходом первого логического элемента ИЛИ, вход первого адреса - с выходом седьмого логического элемента ИЛИ, вход второго адреса - с выходом третьего логического элемента ИЛИ, второй вход которого связан с четвертым входом второго логического элемента ИЛИ и выходом третьего логического элемента И, второй вход которого связан со вторым входом четвертого логического элемента И, вторым входом пятого логического элемента И, входом первого логического элемента НЕ и первым разрядом выхода второго регистра памяти, второй разряд выхода которого подключен к входу второго логического элемента НЕ и третьему входу пятого логического элемента И, первый вход которого связан с двенадцатым выходом дешифратора и первым входом шестого логического элемента И, второй вход которого соединен с третьим входом второго логического элемента И и выходом седьмого логического элемента НЕ, а третий вход - с выходом восьмого логического элемента НЕ, вход которого связан с третьим входом четвертого логического элемента И и третьим выходом второго регистра памяти, четвертый разряд выхода которого подключен к входу седьмого логического элемента НЕ, а сбросовый вход второго регистра памяти - к шине СБРОС и сбросовому входу первого регистра памяти, вход записи которого соединен с выходом элемента задержки и разряды выхода первого регистра памяти - с соответствующими разрядами входа второго регистра памяти, а соответствующие разряды входа - с соответствующими разрядами входа дешифратора и выходами соответствующих приемных реле, кроме того, выход первого приемного реле подключен к входу первого формирователя коротких импульсов и входу третьего логического элемента НЕ, выход которого соединен с входом второго формирователя коротких импульсов, связанного выходом с первым входом шестого логического элемента ИЛИ, второй вход которого подключен к выходу первого формирователя коротких импульсов, третий вход - к выходу четвертого формирователя коротких импульсов, вход которого соединен с выходом четвертого логического элемента НЕ, вход которого связан с выходом второго приемного реле и входом третьего формирователя коротких импульсов, выход которого подключен к четвертому входу шестого логического элемента ИЛИ, пятый вход которого соединен с выходом шестого формирователя коротких импульсов, соединенного входом с выходом пятого логического элемента НЕ, вход которого связан с выходом третьего приемного реле и входом пятого формирователя коротких импульсов, подключенного выходом к шестому входу шестого логического элемента ИЛИ, седьмой вход которого соединен с выходом восьмого формирователя коротких импульсов, соединенного входом с выходом шестого логического элемента НЕ, вход которого соединен с выходом четвертого приемного реле и входом седьмого формирователя коротких импульсов, выход которого подключен к восьмому входу шестого логического элемента ИЛИ, связанного выходом с входом записи второго регистра памяти и входом элемента задержки, кроме того, выход первого логического элемента И подключен к четвертому входу первого логического элемента ИЛИ и третьему входу четвертого логического элемента ИЛИ, а десятый выход дешифратора соединен с первыми входами четвертого и второго логических элементов И.
RU2017123705A 2017-07-04 2017-07-04 Цифровое четырехканальное реле с функцией реконструктивной диагностики RU2659990C1 (ru)

Priority Applications (1)

Application Number Priority Date Filing Date Title
RU2017123705A RU2659990C1 (ru) 2017-07-04 2017-07-04 Цифровое четырехканальное реле с функцией реконструктивной диагностики

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
RU2017123705A RU2659990C1 (ru) 2017-07-04 2017-07-04 Цифровое четырехканальное реле с функцией реконструктивной диагностики

Publications (1)

Publication Number Publication Date
RU2659990C1 true RU2659990C1 (ru) 2018-07-04

Family

ID=62815605

Family Applications (1)

Application Number Title Priority Date Filing Date
RU2017123705A RU2659990C1 (ru) 2017-07-04 2017-07-04 Цифровое четырехканальное реле с функцией реконструктивной диагностики

Country Status (1)

Country Link
RU (1) RU2659990C1 (ru)

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
RU2693296C1 (ru) * 2018-11-28 2019-07-02 Федеральное государственное унитарное предприятие "Московское опытно-конструкторское бюро "Марс" (ФГУП МОКБ "Марс") Способ защиты от сбоев и отказов электронного блока космического аппарата, вызываемых внешними воздействующими факторами, и устройство для его осуществления
RU2706198C1 (ru) * 2018-12-11 2019-11-14 Федеральное государственное бюджетное образовательное учреждение высшего образования "Волжский государственный университет водного транспорта" (ФГБОУ ВО ВГУВТ) Цифровое пятиканальное реле с функцией реконструктивной диагностики
RU2720382C1 (ru) * 2019-07-22 2020-04-29 Федеральное государственное казенное военное образовательное учреждение высшего образования "Ярославское высшее военное училище противовоздушной обороны" Министерства обороны Устройство для определения значений характеристик готовности изделия к применению

Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
WO1986000714A1 (en) * 1984-07-06 1986-01-30 Dme-Danish Micro Engineering A/S A method of monitoring the operation of a cyclically moving, power generating or power transmitting element and an apparatus for monitoring the operation of such an element
US4615410A (en) * 1983-12-14 1986-10-07 Nissan Motor Co., Ltd. Method of detecting slip of driving wheel of automotive vehicle
SU1697009A1 (ru) * 1989-10-30 1991-12-07 Научно-Производственное Объединение По Оборудованию Для Химических Волокон Цифровой измеритель частоты вращени
RU2084899C1 (ru) * 1993-07-20 1997-07-20 Сугаков Валерий Геннадьевич Измеритель частоты вращения вала
RU2618495C1 (ru) * 2016-03-30 2017-05-03 Федеральное государственное бюджетное образовательное учреждение высшего образования "Волжский государственный университет водного транспорта" (ФГБОУ ВО ВГУВТ) Цифровое реле частоты вращения с функцией реконструктивной диагностики

Patent Citations (5)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US4615410A (en) * 1983-12-14 1986-10-07 Nissan Motor Co., Ltd. Method of detecting slip of driving wheel of automotive vehicle
WO1986000714A1 (en) * 1984-07-06 1986-01-30 Dme-Danish Micro Engineering A/S A method of monitoring the operation of a cyclically moving, power generating or power transmitting element and an apparatus for monitoring the operation of such an element
SU1697009A1 (ru) * 1989-10-30 1991-12-07 Научно-Производственное Объединение По Оборудованию Для Химических Волокон Цифровой измеритель частоты вращени
RU2084899C1 (ru) * 1993-07-20 1997-07-20 Сугаков Валерий Геннадьевич Измеритель частоты вращения вала
RU2618495C1 (ru) * 2016-03-30 2017-05-03 Федеральное государственное бюджетное образовательное учреждение высшего образования "Волжский государственный университет водного транспорта" (ФГБОУ ВО ВГУВТ) Цифровое реле частоты вращения с функцией реконструктивной диагностики

Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
RU2693296C1 (ru) * 2018-11-28 2019-07-02 Федеральное государственное унитарное предприятие "Московское опытно-конструкторское бюро "Марс" (ФГУП МОКБ "Марс") Способ защиты от сбоев и отказов электронного блока космического аппарата, вызываемых внешними воздействующими факторами, и устройство для его осуществления
RU2706198C1 (ru) * 2018-12-11 2019-11-14 Федеральное государственное бюджетное образовательное учреждение высшего образования "Волжский государственный университет водного транспорта" (ФГБОУ ВО ВГУВТ) Цифровое пятиканальное реле с функцией реконструктивной диагностики
RU2720382C1 (ru) * 2019-07-22 2020-04-29 Федеральное государственное казенное военное образовательное учреждение высшего образования "Ярославское высшее военное училище противовоздушной обороны" Министерства обороны Устройство для определения значений характеристик готовности изделия к применению

Similar Documents

Publication Publication Date Title
RU2659990C1 (ru) Цифровое четырехканальное реле с функцией реконструктивной диагностики
RU2618495C1 (ru) Цифровое реле частоты вращения с функцией реконструктивной диагностики
US4092853A (en) Testing rotary movement-electrical signal transducer system, particularly for vehicle wheel anti-block transducer systems
US9103744B2 (en) Method and apparatus for redundant detection of a rotational direction
RU2671545C1 (ru) Цифровое пятиканальное реле с функцией самодиагностики
RU2706198C1 (ru) Цифровое пятиканальное реле с функцией реконструктивной диагностики
RU2707420C1 (ru) Четырехканальное цифровое реле с функцией реконструктивной диагностики
RU198966U1 (ru) Устройство для оценки вероятностно-временных характеристик формирования сигнала в информационно-управляющих системах
RU2685445C1 (ru) Цифровое n-канальное реле с функцией самодиагностики
SU796916A1 (ru) Устройство дл контрол блокапАМ Ти
SU1037259A1 (ru) Устройство дл контрол цифровых блоков
SU1644168A1 (ru) Самодиагностируемое парафазное асинхронное логическое устройство
SU766053A1 (ru) Мажоритарно-резервированный триггер
SU960826A1 (ru) Устройство дл контрол цифровых блоков
RU2631989C1 (ru) Устройство для диагностического контроля выполнения проверок
SU731418A1 (ru) Многоканальное устройство дл контрол систем регулировани
SU388288A1 (ru) Всесоюзная
RU2430464C2 (ru) Пересчетное устройство с частотно-фазовой схемой сравнения
SU1120338A1 (ru) Устройство дл контрол цифровых узлов
SU1043668A1 (ru) Устройство дл контрол счетчиков импульсов
SU942115A1 (ru) Устройство дл проверки преобразователей угла поворота вала в код
SU1134940A1 (ru) Устройство дл контрол блоков синхронизации
SU1175022A1 (ru) Устройство дл контрол серий импульсов
SU936005A1 (ru) Устройство дл контрол преобразователей угла поворота вала в код
RU2580476C1 (ru) Устройство формирования сигналов управления (2 варианта)

Legal Events

Date Code Title Description
MM4A The patent is invalid due to non-payment of fees

Effective date: 20190705