RU2028642C1 - Line voltage dip simulator - Google Patents
Line voltage dip simulator Download PDFInfo
- Publication number
- RU2028642C1 RU2028642C1 SU4908910A RU2028642C1 RU 2028642 C1 RU2028642 C1 RU 2028642C1 SU 4908910 A SU4908910 A SU 4908910A RU 2028642 C1 RU2028642 C1 RU 2028642C1
- Authority
- RU
- Russia
- Prior art keywords
- input
- output
- inputs
- voltage
- trigger
- Prior art date
Links
Images
Landscapes
- Management, Administration, Business Operations System, And Electronic Commerce (AREA)
Abstract
Description
Изобретение относится к измерительной технике. The invention relates to measuring equipment.
Известен имитатор провалов напряжения сети, содержащий генератор, последовательно соединенные делитель напряжения, первый управляемый вентиль, датчик тока и нуль-орган, второй управляющий вентиль, выход которого объединен с выходом первого управляемого вентиля, а первый вход - с входом делителя напряжения, подключенного к входу устройства, первую и вторую схемы И, триггер, выход нуль-органа соединен с первым входом второй схемы И, а ее второй вход - с прямым выходом триггера, выход второй схемы И соединен с вторым входом второго управляемого вентиля, регистр сдвига, счетчик и пусковое устройство, n-2 управляемых вентиля, первые входы которых соединены с соответствующими выходами делителя напряжения, а выходы объединены и подсоединены к входу датчика тока, селектор выходных напряжений, выходы которого соединены с вторыми входами соответствующих управляемых вентилей, а первые входы подключены через группу из m схем Иi, где 1≅i ≅m к информационным выходам m-разрядного регистра сдвига, а третьи входы объединены и подключены к выходу нуль-органа, прямой выход триггера подключен к входу выбора режима работы регистра сдвига и к второму входу второй схемы И, а счетный вход триггера соединен с первым выходом пускового устройства, второй выход которого через первую схему И подключен к входу счетчика, выход счетчика соединен с первым входом схемы совпадения, второй вход которой через селектор временных интервалов соединен с информационными выходами регистра сдвига, выход схемы совпадения соединен с вторым тактовым входом регистра сдвига и вторым входом первой схемы И, выход m разряда регистра сдвига подключен к входу пускового устройства.A well-known simulator of network voltage dips, containing a generator, a series-connected voltage divider, a first controlled valve, a current sensor and a zero-organ, a second control valve, the output of which is combined with the output of the first controlled valve, and the first input with the input of the voltage divider connected to the input devices, the first and second circuits AND, the trigger, the output of the zero-organ is connected to the first input of the second circuit And, and its second input is with the direct output of the trigger, the output of the second circuit And is connected to the second input of the second about the valve, shift register, counter and starting device, n-2 controlled valves, the first inputs of which are connected to the corresponding outputs of the voltage divider, and the outputs are combined and connected to the input of the current sensor, an output voltage selector, the outputs of which are connected to the second inputs of the corresponding controlled valves , and the first inputs are connected through a group of m circuits And i , where 1≅i ≅m to the information outputs of the m-bit shift register, and the third inputs are combined and connected to the output of the zero-organ, the direct output of the trigger is connected to the input of the shift register operating mode selection and to the second input of the second AND circuit, and the trigger counting input is connected to the first output of the starting device, the second output of which is connected through the first And circuit to the counter input, the counter output is connected to the first input of the matching circuit, the second input of which the time slot selector is connected to the information outputs of the shift register, the output of the match circuit is connected to the second clock input of the shift register and the second input of the first circuit AND, the output m of the discharge of the shift register is connected to the input USKOVA device.
Недостатком известного устройства является следующее: как известно, для питания бортовой радионавигационной аппаратуры используется не только сеть переменного тока, но и сеть постоянного тока, переходные процессы в которой также содержат жесткие дестабилизирующие факторы и которые описанное устройство имитировать не позволяет. A disadvantage of the known device is the following: as is known, not only an alternating current network, but also a direct current network is used to power the on-board radio navigation equipment, the transient processes in which also contain hard destabilizing factors and which the described device does not allow to simulate.
Целью изобретения является расширение функциональных возможностей имитатора провалов напряжения сети. The aim of the invention is to expand the functionality of a simulator of voltage dips network.
Поставленная цель достигается тем, что имитатор провалов напряжения сети, содержащий генератор, последовательно соединенные делитель напряжения, первый управляемый вентиль, датчик тока и нуль-орган, второй управляемый вентиль, выход которого объединен с выходом первого управляемого вентиля, а первый вход - с входом делителя напряжения, подключенного к входу устройства, первую и вторую схемы И, триггер, вход нуль-органа соединен с первым входом второй схемы И, а ее второй вход с прямым выходом триггера, выход второй схемы И соединен с вторым входом второго управляемого вентиля, регистр сдвига, счетчик и пусковое устройство, n-2 управляемых вентиля, первые входы которых соединены с соответствующими выходами делителя напряжения, а выходы объединены и подсоединены к входу датчика тока, селектор выходных напряжений, выходы которого соединены с вторыми входами соответствующих управляемых вентилей, а первые входы подключены через группу из m схем Иi, где 1≅i ≅m к информационным выходам m-разрядного регистра сдвига, а третьи входы объединены и подключены к выходу нуль-органа, прямой выход триггера подключен к входу выбора режима работы регистра сдвига и к второму входу второй схемы И, а счетный вход триггера соединен с первым выходом пускового устройства, второй выход которого через первую схему И подключен к входу счетчика, выход счетчика соединен с первым входом схемы совпадения, второй вход которой через селектор времени интервалов соединен с информационными выходами регистра сдвига, выход схемы совпадения соединен с вторым тактовым входом регистра сдвига и вторым входом первой схемы И, выход m разряда регистра сдвига подключен к входу пускового устройства, дополнительно снабжен последовательно соединенными источником постоянного напряжения, регулируемым элементом, причем вход источника постоянного напряжения соединен с входом устройства, блок делителей обратной связи, состоящих из m+1 делителей обратной связи, объединенные входы которых соединены с выходом регулируемого элемента, вторым селектором величин напряжений, входы которого соединены с соответствующими m выходами блока делителей обратной связи, а также блоком электронных ключей, состоящим из m+1 электронных ключей, причем первые входы m электронных ключей подключены к соответствующим выходам второго селектора величин напряжения, а их вторые входы подсоединены к соответствующим информационным выходам регистра сдвига, выходы электронных ключей объединены и подключены к второму входу блока синхронизации и управления, выход которого подсоединен к второму входу регулирующего элемента, третьи входы m электронных ключей объединены и соединены с выходом третьей схемы И, первый вход которой подключен к первому выходу устройства выбора сети, второй выход которого подключен к второму входу четвертой схемы И, при этом инверсный выход триггера соединен с вторым входом третьей схемы И и с объединенными вторыми входами группы из m схем И через четвертую схему И, выход третьей схемы И через схему И-НЕ соединен с вторым входом m+1 электронного ключа, первый вход которого соединен с выходом m+1 делителя обратной связи.This goal is achieved by the fact that the simulator of voltage drops of the network containing a generator, a series-connected voltage divider, a first controlled valve, a current sensor and a zero-organ, a second controlled valve, the output of which is combined with the output of the first controlled valve, and the first input with the input of the divider voltage connected to the input of the device, the first and second circuit And, the trigger, the input of the zero-organ is connected to the first input of the second circuit And, and its second input with a direct output of the trigger, the output of the second circuit And is connected to the second the input of the second controlled valve, shift register, counter and starting device, n-2 controlled valves, the first inputs of which are connected to the corresponding outputs of the voltage divider, and the outputs are combined and connected to the input of the current sensor, an output voltage selector, the outputs of which are connected to the second inputs of the corresponding controlled valves, and the first inputs are connected through a group of aND gates, m i, where 1≅i ≅m to information outputs of the m-bit shift register, and third inputs are coupled and connected to the output of the zero-body directly the trigger output is connected to the input of the shift register operating mode selection and to the second input of the second AND circuit, and the trigger counting input is connected to the first output of the starting device, the second output of which through the first And circuit is connected to the counter input, the counter output is connected to the first input of the matching circuit, the second input of which through the time selector of the intervals is connected to the information outputs of the shift register, the output of the matching circuit is connected to the second clock input of the shift register and the second input of the first circuit And, the output m of the register bit the shear is connected to the input of the starting device, is additionally equipped with a DC voltage source, an adjustable element, and the input of the DC voltage source is connected to the input of the device, the feedback divider unit, consisting of m + 1 feedback dividers, the combined inputs of which are connected to the output of the adjustable element , the second voltage value selector, the inputs of which are connected to the corresponding m outputs of the feedback divider block, as well as the electronic key block, with consisting of m + 1 electronic keys, with the first inputs of m electronic keys connected to the corresponding outputs of the second voltage value selector, and their second inputs connected to the corresponding information outputs of the shift register, the electronic key outputs combined and connected to the second input of the synchronization and control unit, output which is connected to the second input of the regulatory element, the third inputs m of electronic keys are combined and connected to the output of the third circuit And, the first input of which is connected to the first output the selection of the network, the second output of which is connected to the second input of the fourth circuit And, while the inverse output of the trigger is connected to the second input of the third circuit And with the combined second inputs of the group of m circuits And through the fourth circuit And, the output of the third circuit And through the circuit And NOT connected to the second input m + 1 of the electronic key, the first input of which is connected to the output m + 1 of the feedback divider.
На фиг.1 и 2 представлена блок-схема предлагаемого имитатора; на фиг.3 - схема электронного ключа; на фиг.4 - схема блока синхронизации и управления; на фиг.5 - схема имитатора режимов сети постоянного тока. Figure 1 and 2 presents a block diagram of the proposed simulator; figure 3 - circuit electronic key; figure 4 - block diagram of the synchronization and control; 5 is a diagram of a simulator of the modes of a direct current network.
Имитатор содержит генератор 1, делитель 2 напряжения, первый управляемый вентиль 3, датчик 4 тока, нуль-орган 5, второй управляемый вентиль 6, первую 7 и вторую 8 схемы И, триггер 9, регистр 10 сдвига, счетчик 11, пусковое устройство 12, m-2 управляемых вентиля 13, первые входы которых соединены с соответствующими выходами делителя 2 напряжения , а выходы объединены и подсоединены к входу датчика 4, селектор выходных напряжений 14, выходы которого соединены с вторыми входами соответствующих управляемых вентилей 13, а первый входы подключены через группу из m-схем Иi 15, где 1≅i ≅m, к информационным выходам m-разрядного регистра 10 сдвига, третьи входы схем И 15 объединены и подключены к выходу нуль-органа 5, прямой выход триггера 9 подключен к входу выбора режима работы регистра 10 и к втоpому входу второй схемы И 8, а счетный вход триггера 9 соединен с первым выходом пускового устройства 12, второй выход которого через первую схему И 7 подключен к входу счетчика 11, выход счетчика 11 соединен с первым входом схемы 16 совпадения, второй вход которого через селектор 17 временных интервалов соединен с информационными выходами регистра 10, выход схемы 16 соединен с вторым тактовым входом регистра 10 и вторым входом первой схемы И 7, выход m-разряда регистра 10 сдвига подключен к входу пускового устройства 12. Кроме того, имитатор провалов напряжения сети содержит последовательно соединенные источник 18 постоянного напряжения 18, регулирующий элемент 19, причем вход источника 18 соединен с входом устройства, блок 20 делителей обратной связи 20, состоящий из m+1 делителей обратной связи, объединенные входы которых соединены с выходом регулирующего элемента 19, второй селектор 21 величин напряжений, входы которого соединены с соответствующими m выходами блока 20 делителей обратной связи, а также блок электронных ключей 22, состоящий из m+1 электронных ключей, причем первые входы электронных ключей 22 подключены к соответствующим выходам второго селектора 21 величин напряжения, а их вторые входы подсоединены к соответствующим информационным выходам регистра 10 сдвига, выходы m+1 электронных ключей 22 объединены и подключены к второму входу блока 23 синхронизации и управления, выход которого подсоединен к второму входу регулирующего элемента 19, третьи входы m электронных ключей 22 объединены с входом схемы И-НЕ 24 и соединены с выходом третьей схемы И 25, причем выход схемы И-НЕ 24 подключен к второму входу m+1 электронного ключа 22, первый вход которого соединен с выходом m+1 делителя 20 обратной связи, первый вход третьей схемы И 25 подключен к первому выходу устройства 26 выбора сети, второй выход которого подключен к второму входу четвертой схемы И 27, причем инверсный выход триггера 9 соединен с вторым входом третьей схемы И 25 и объединенными вторыми входами группы из m схем И 15 через четвертую схему И 27.The simulator contains a
В качестве третьей 25 и четвертой 27 схем И использована микросхема 133ЛИ1. Схема И-НЕ 24 выполнена на микросхеме 133ЛИ2. Источник постоянного напряжения 18 выполнен по традиционной схеме. В качестве регулирующего элемента 19 использован транзистор 2Т245. Второй селектор 21 выходных напряжений выполнен в виде наборного поля на переключателях типа 11П1И-ПМ. Делители 20 обратной связи представляют собой обычные резистивные делители. Электронные ключи выполнены следующим образом: VT1 - транзисторная матрица 1НТ251; VT2 - транзистор 2Т630Б. As the third 25 and fourth 27 circuits I used the chip 133LI1. The I-NOT 24 circuit is made on the 133LI2 chip. The
Блок синхронизации и управления состоит из генератора пилообразного напряжения (ГПН), компаратора (К) и опорного элемента (ОЭ). ГПН содержит расширитель синхронизирующего импульса, выполненный на микросхеме 133АГ1 и RC-цепь. Компаратор выполнен на микросхеме 521САЗ, а опорный элемент представляет собой резистивный делитель стабилизированного напряжения питания +5 В. The synchronization and control unit consists of a sawtooth voltage generator (GPN), a comparator (K) and a support element (OE). GPN contains an expander of a synchronizing pulse made on a chip 133AG1 and an RC circuit. The comparator is made on a 521CAZ chip, and the reference element is a resistive divider of a stabilized supply voltage of +5 V.
Устройство выбора сети выполнено на микросхеме 133ЛАЗ. The network selection device is made on a 133LAZ chip.
Имитатор провалов напряжения сети работает следующим образом. The simulator of voltage dips works as follows.
В отсутствии провалов в сети переменного и в сети постоянного тока имитатор работает следующим образом. In the absence of dips in the AC and DC networks, the simulator works as follows.
В исходном состоянии на первом выходе первого устройства 12 присутствует уровень логического "0", а на втором - логической "1". Триггер 9 находится в исходном состоянии: на прямом выходе - "уровень логической "1", на инверсном - логического "0". Уровень логического "0" с инверсного выхода триггера 9 поступает на первый вход схемы И 27, с выхода которой сигнал низкого уровня выдает запрет на вторые входы группы из m схем И 15. Далее имитатор работает как имитатор-прототип. Кроме того, сигнал логического "0" с инверсного выхода триггера 9 поступает на второй вход схемы И 25, с выхода которой сигнал низкого уровня поступает на объединенные третьи входы m электронных ключей 22 и блокирует их. Сигнал низкого уровня с выхода схемы И 25 поступает также на вход схемы И-НЕ 24, с выхода которой сигнал высокого уровня поступает на второй вход m+1 электронного ключа 22 и открывает его. В результате этого, с выхода m+1 электронного ключа управляющий сигнал через блок 23 синхронизации и управления поступает на второй вход регулирующего элемента 19 и номинальное напряжение источника 18 постоянного напряжения проходит на второй выход имитатора. In the initial state, at the first output of the
При необходимости имитировать провал по сети переменного тока нажимает кнопку устройства 26 выбора сети. На его первом выходе появляется уровень логического "0", а на втором - логический "1", который поступает на второй вход схемы И 27. Затем нажимаем кнопку пускового устройства 12. На его первом выходе появляется уровень логической "1", а на втором уровень логического "0". Сигнал логического "0" с второго выхода пускового устройства 12 воздействует на триггер 9, в результате на прямом выходе триггера 9 - сигнал логического "0", а на инверсном - логической "1". Сигнал логической "1", проходя через схему И 27, снимает запрет с вторых входов группы из m схем Иi. Далее имитатор работает как имитатор-прототип.If necessary, simulate a dip on the AC network, presses the button of the
Чтобы имитировать провал по сети постоянного тока, необходимо нажать кнопку устройства 26 выбора сети. На его первом выходе появляется сигнал логической "1", а на втором - логического "0", затем нажать кнопку пускового устройства 12. На его первом выходе появляется уровень логической "1", а на втором - уровень логического "0". Сигнал логического "0" с второго выхода пускового устройства 12 воздействует на триггер 9, в результате на прямом выходе триггера 9 - уровень логического "0", а на инверсном - логической "1". To simulate a dip in the DC network, you must press the button of the
Сигнал логической "1" с инверсного выхода триггера 9 через схему И 25 поступает на третьи входы m электронных ключей 22 и снимает с них запрет. The logical signal "1" from the inverse output of the
Этот же сигнал, поступая на схему И-НЕ 24, воздействует на нее, в результате чего с выхода схемы И-НЕ 24 сигнал низкого уровня поступает на второй вход m+1 электронного ключа 22 и закрывает его. Сигнал логического "0" с прямого выхода триггера 9 переключает регистр 10 сдвига из режима записи в режим считывания. Сигнал логической "1" с первого выхода пускового устройства 12 поступает на первый вход схемы И 7, тем самым снимается запрет, и на выходе схемы И 7 появляются тактовые импульсы, идущие от генератора 1 на счетный вход счетчика 11. В результате на выходах регистра 10 сдвига появляются поочередно импульсы, длительности которых определяются кодом, который предварительно записывается в селектор 17 временных интервалов. В схеме 16 совпадения производится сравнение кода из селектора временных интервалов 17 и кода, поступающего из счетчика 11. Пpи их совпадении вырабатывается сигнал на переключение регистра 10 сдвига на следующий шаг. В результате выключается один из m электронных ключей 22 и включается следующий. Код, по которому производится выбор электронных ключей 22, предварительно записывается во второй селектор 21 величин напряжения, причем управляющие сигналы на соответствующие входы второго селектора 21 величин напряжений поступают с выходов соответствующих делителем 20 напряжения. При срабатывании соответствующего электронного ключа 22 сигнал с его выхода через блок 23 синхронизации и управления воздействует на регулирующий элемент 19, причем это воздействие различно при срабатывании разных электронных ключей 22. В результате на втором выходе устройства получается меняющееся напряжение в соответствии с кодом, записанным во второй селектор 21 величин напряжения. После того, как все m электронных ключей 22 срабатывают в соответствии с кодом второго селектора 21 величин напряжений, в регистре 10 сдвига вырабатывается сигнал конца цикла, который возвращает пусковое устройство 12 в исходное состояние. Срабатывает триггер 9, который запирает схему И 25. В результате m электронных ключей 22 закрываются, а на выходе схемы И-НЕ 24 появляется сигнал логической "1", который открывает m+1 электронный ключ 22. При этом с выхода блока 23 синхронизации и управления на второй вход регулирующего элемента 19 поступает сигнал управления и номинальное напряжение источника 18 постоянного напряжения проходит на второй выход устройства. The same signal, acting on the I-
Технико-экономические преимущества заявляемого имитатора заключаются в том, что, используя все признаки основного изобретения, он позволяет расширить функциональные возможности за счет имитации провалов напряжения постоянного тока. The technical and economic advantages of the inventive simulator are that, using all the features of the main invention, it allows you to expand the functionality by simulating dips in DC voltage.
Claims (1)
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU4908910 RU2028642C1 (en) | 1991-02-06 | 1991-02-06 | Line voltage dip simulator |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
SU4908910 RU2028642C1 (en) | 1991-02-06 | 1991-02-06 | Line voltage dip simulator |
Publications (1)
Publication Number | Publication Date |
---|---|
RU2028642C1 true RU2028642C1 (en) | 1995-02-09 |
Family
ID=21559244
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
SU4908910 RU2028642C1 (en) | 1991-02-06 | 1991-02-06 | Line voltage dip simulator |
Country Status (1)
Country | Link |
---|---|
RU (1) | RU2028642C1 (en) |
-
1991
- 1991-02-06 RU SU4908910 patent/RU2028642C1/en active
Non-Patent Citations (2)
Title |
---|
Авторское свидетельство СССР N 1411939, кл. H 03K 4/00, 1988. * |
Авторское свидетельство СССР N 1691791, кл. G 01R 31/28, 1989. * |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
US4354176A (en) | A-D Converter with fine resolution | |
RU2028642C1 (en) | Line voltage dip simulator | |
US4080575A (en) | Electronic time signalling device | |
JPS5663633A (en) | Character input device | |
US3976867A (en) | Calculator timer with simple base-6 correction | |
US4025774A (en) | Timing apparatus including electronic calculator circuits | |
RU2010323C1 (en) | Device for static modelling condition of test object | |
SU1603361A1 (en) | Coded word generator | |
SU1691791A1 (en) | Simulator of voltage failures of mains | |
SU1275516A1 (en) | Device for training memory of operator | |
CA1063358A (en) | Electronic time signalling device for producing a time signal at a preset time | |
SU746710A1 (en) | Device for monitoring information recording process | |
SU1365356A1 (en) | Code-to-pulse recurrence period converter | |
CA1199687A (en) | Bit generator having predetermined occurrence rate with predetermined bit distribution | |
SU1359904A1 (en) | Device for checking binary counters with consecutive input of information | |
GB1523128A (en) | Electronic digital clocks | |
SU1180878A1 (en) | Device for comparing numbers | |
SU884074A1 (en) | Random signal generator | |
SU618687A1 (en) | Digital measuring device | |
SU824415A1 (en) | Pulse series generator | |
SU1166118A1 (en) | Device for checking n-bit pulse distributor | |
SU1267593A1 (en) | Pulse generator with controlled frequency | |
SU750750A2 (en) | Morse code generator | |
SU1529207A1 (en) | Device for input of digital information | |
SU1603344A1 (en) | Device for program control with data restoration |