KR970029033A - 프로세서의 벡터 데이타 조정 장치 - Google Patents

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Abstract

본 발명은 각종 디지탈 정보를 처리하는 프로세서에 관한 것으로, 레지스터의 입출력 동작 횟수를 감소 시킴으로써 프로세서 전체의 성능을 향상시키도록 한 프로세서의 백터 데이타 조정 장치에 관한 것이다.
종래의 프로세서는 자체의 내부 워드(word) 사이즈 보다 큰 다중 데이타를 버스를 통하여 입출력하는 경우, 입출력되는 어드레스가 자체의 버스 폭과 일치하지 않는 경우, 입출력 횟수가 증가됨과 동시에 데이타가 레지스터로 옮겨지는 경우 또는 레지스터에서 데이타가 버스로 옮겨지는 경우에는 레지스터 포트를 이용한 입출력 횟수가 증가되므로, ALU가 레지스터를 억세스 할 수 있는 횟수가 감소됨으로 인하여 ALU가 연산처리 동작을 지속적으로 수행할 수 없게 되어 프로세서 전체의 성능이 저하되는 문제점이 있었다.
본 발명은 프로세서에 구비된 레지스터의 입출력 동작 횟수를 감소시킴으로써 ALU가 레지스터를 억세스 할 수 있는 횟수를 증가시켜 프로세서 전체의 성능을 향상시키게 된다.

Description

프로세서의 벡터 데이타 조정 장치
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따른 프로세서의 백터 데이타 조정장치의 구성도,
제2도는 제1도에 도시된 워드 조정로직의 구성도.

Claims (4)

  1. 입력된 정보의 워드를 위치 조정하여 출력하는 워드 조정로직과, 상기 워드 조정로직으로부터 인가되는 각 워드내에서 엔다이언을 크거나 작게 조정하여 출력하는 엔다이언 조정로직과, 상기 엔다이언 조정로직(20)으로부터 인가되는 워드를 래치하였다가 출력하는 제1래치와, 상기 제1래치로부터 인가되는 워드를 래치하였다가 출력하는 제2래치와, 상기 제2래치로부터 인가되는 워드를 래치하였다가 출력하는 제3래치와, 상기 제1래치와 제2래치로부터 인가되는 워드중에서 하나를 선택하여 레지스터 측으로 출력하는 제2선택로직을 포함하는 것을 특징으로 하는 프로세서의 백터 데이타 조정장치.
  2. 제1항에 있어서, 상기 워드 조정로직은 인가받은 제1워드의 소정 번째 비트를 다중화시켜 출력하는 제1멀티플렉서와, 입력된 제2워드의 소정 번째 비트를 다중화시켜 출력하는 제2멀티플렉서와, 입력된 제3워드의 소정 번째 비트를 다중화시켜 출력하는 제3멀티플렉서와, 인가받은 제4워드의 소정 번째 비트를 다중화시켜 출력하는 제4멀티플렉서를 포함하는 것을 특징으로 하는 프로세어의 백터 데이타 조정장치.
  3. 제1항에 있어서, 상기 엔다이언 조정로직은 상기 워드 조정로직으로부터 인가되는 워드의 제1내지 제4바이트와 소정 비트를 입력받아 다중화시켜 출력하는 다수의 멀티플렉서를 포함하는 것을 특징으로 하는 프로세어의 백터 데이타 조정장치.
  4. 제1항에 있어서, 상기 제1 및 제2선택로직은 다수의 래치를 구비하여 인가받은 다수의 소정비트 그룹을 래치하였다가 출력하는 제1래치부와, 다수의 래치를 구비하여 상기 제1래치로부터 인가받은 다수의 소정비트 그룹을 래치하였다가 출력하는 제2래치부와, 다수의 멀티플렉서를 구비하여 상기 제1래치부(61)와 제2래치부로부터 인가되는 소정비트 그룹중에서 선택신호에 따라 하나의 소정비트 그룹을 선택하여 레지스터측으로 출력하는 멀티플렉서를 포함하는 것을 특징으로 하는 프로세어의 백터 데이타 조정장치.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
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