KR950022324A - 집적회로 - Google Patents

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KR950022324A
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fsr
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헤이즈 에버트 벤자민
헨리 바이덴 로버트
조셉 지메니 2세 에드워드
Original Assignee
제이. 에이취. 폭스
에이 티 앤드 티 코포레이션
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    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04JMULTIPLEX COMMUNICATION
    • H04J3/00Time-division multiplex systems
    • H04J3/02Details
    • H04J3/06Synchronising arrangements
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  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Synchronisation In Digital Transmission Systems (AREA)
  • Time-Division Multiplex Systems (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

부호 복호기와 여러 다른 형태의 통신 장치는 적절한 시간에 디지탈 정보를 송수신하기 위해 이들을 인에이블할 타임밍 정보를 요한다. 단일 집적 회로상의 다중 부호 복호기(예,101ㆍㆍㆍㆍ104)의 경우에, 이것은 각 부호 복호기에 대해 각각의 송수신 프레임 동기 펄스(예, FST0ㆍㆍㆍFST3; FST0ㆍㆍㆍFST3)를 제공하기 위해, 일반적으로 충당한 단자를 필요로 한다. 선택적으로, 내부 레지스터가 송수신 타이밍 정보와 로드될 수 있도록 마이크로 프로세서 인터레이스가 포함된다. 그러난 상기 접근은 타이밍 유용성을 제한한다. 본 발명에 있어서, "프레임 동기 분리 펄스 (FSEP)"는 송수신 동기 펄스 사이에 시간내에 분리를 얻기 위해 집적회로(예,301)에 공급된다. 이런 방법으로 동기에 필요한 집적 회로 단자의 수를 감소시킬 수 있다.

Description

집적회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제3도는 본 발명의 예시적인 실시예도.
제4도는 프레임 타임 슬롯과 예시적인 펄스를 갖는 타이밍 다이어그램도.

Claims (5)

  1. 수신 및 송신 동기 펄스(예, FSR0ㆍㆍㆍFSR3; FST0ㆍㆍㆍFST3)를 다중 통신장치(예,302ㆍㆍ305)각각에 공급하는 경우에, 디지탈 신호를 각각 송신하고 수신하는 다중통신장치(예,302ㆍㆍ305)를 포함하는 집적회로(예,301)에 있어서, 상기 집적회로가 상기 수신 및 송신동기 펄스중 소정의 판 펄스를 수신하는 수단과, 소정의 지연시간을 갖는 프레임 분리등기 펄스(예,FSEP)를 수신하는 수단 및, 상기 수신 및 송신 동기 펄스중 다른 한 펄스를 발생하는 수단을 포함하는 것을 특징으로 하는 집적회로.
  2. 제1항에 있어서, 상기 통신 장치는 부호 복호기(DODECS)인 것을 특징으로 하는 집적회로.
  3. 제1항에 있어서, 상기 발생 수단이 시스템 클럭 신호(예, MCLK)를 수신하고 상기 스페임 분리동기 펄스의 지연시간을 카운트 하는 수단을 포함하는 것을 특징으로 하는 집적회로.
  4. 제1항에 있어서, 상기 직접회로에 의해서 수신된 상기 동기펄스는 동기펄스(예, FST0ㆍㆍㆍFST3)를 송신하고, 상기 집적 회로에 의해 발생된 상기 펄스는 동기펄스(예, FSR0ㆍㆍㆍFSR3)를 수신하는 것을 특징으로 하는 집적회로.
  5. 제1항에 있어서, 상기 직접 회로에 의해 수신된 상기 동기 펄스는 동기펄스 (예, FSR0ㆍㆍㆍFSR3)를 수신하고, 상기 직접 회로에 의해 발생된 상기 펄스는 동기펄스 (예, FST0ㆍㆍㆍFST3)를 송신하는 것을 특징으로 하는 집적회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940037714A 1993-12-30 1994-12-28 집적회로 KR0149898B1 (ko)

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