KR950015083A - 데이타 처리 시스템, 및 메모리 액세스 제어를 제공하는 방법 - Google Patents

데이타 처리 시스템, 및 메모리 액세스 제어를 제공하는 방법 Download PDF

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Abstract

데이타 처리 시스템(10 또는 28) 및 그 방법은 메모리 관리 유닛(MMU 14)을 사용한다. 처리기는 동작의 사용사 모드 및 감시 모드와 같은 두 특권 동작 모드를 갖는다. MMU(14)는 논리 어드레스 변환이 캐시 액세스 및 테이블 워크를 통해 수행되는 제1동작 모드와 제2동작 모드를 갖는다. 제2동작 모드는 제1투명 변환 레지스터(TTR 16), 제2투명 변환 레지스터(TTR 19)또는 디폴트 장소(22)중 한곳으로부터 변환 속성 비트를 제공하는 것을 포함한다. TTR(16 및 18)은 각각 다른 어드레스 공간과 다른 어드레스 메모리 크기를 맵핑할 수 있으며, 디폴트 장소(22)는 TTR(16 및 18)중 한 TTR에 의해 맵핑되지 않는 모든 메모리를 커버한다 디폴트 장소(22)는 프로그램가능하며, 기록 보호를 제공하고, 특권 모드로부터 독립된 속성 비트를 제공한다.

Description

데이타 처리 시스템, 및 메모리 액세스 제어를 제공하는 방법
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명에 따라 데이타 처리 시스템을 형성하는 블럭도.
제2도는 본 발명에 따라 또다른 데이터 처리 시스템을 형성하는 블럭도.
제3도는 본 발명에 따라 메모리 액세스 제어를 제공하는 방법의 흐름도.

Claims (3)

  1. 적어도 두 동작 모드인 정규 동작 모드의 제1동작 모드와 디폴트 동작 모드의 제2동작 모드를 갖는 메모리 관리 유닛을 가지며, 데이타 보호를 제공하는 두 특권 모드를 갖는 데이타 처리기에 있어서, 메모리 관리 유닛에 논리 어드레스를 제공하기 위한 데이타 처리기내의 회로와, 메모리 관리 유닛내의 제1 투명 변환 레지스터와, 메모리 관리 유닛내의 제2 투명 변환 레지스터와, 디폴트 동작 모드에서 작용하고, 제1투명 변환 레지스터 및 제2 투명 변환 레지스터 모두에 연결되며, 논리 어드레스의 소정수의 비트를 비교하고, 논리 어드레스의 소정수의 비트가 제1 및 제2 투명 변환 레지스터중 한 레지스터의 소정수의 비트와 동일하다면 제어 신호를 표명하는, 논리 어드레스를 수신하기 위한 비교 회로와, 특권 모드와 관련없이 다수의 속성 비트를 제공하기 위한 출력을 가지며, 다수의 속성 비트를 기억하기 위한, 메모리 관리 유닛내의 디폴트 기억 장소, 및 디폴트 동작 모드에서 작용하며, 제1투명 변환 레지스터로부터 소정수의 속성 비트를 수신하는 제1입력과 제2투명 변환 레지스터로부터 소정수의 속성 비트를 수신하는 제2입력과 특권모드와 관련없이 다수의 속성 비트를 제공하는 출력에 연결된 제3입력을 가지는 선택기 회로로서, 제1입력, 제2입력 또는 제3입력중 한 입력의 비트인 선택기 회로의 출력을 결정하는데 이용되는 제어 신호에 연결되는 상기 선태기 회로를 구비하는 데이타 처리기.
  2. 적어도 두 처리기 특권 동작 모드를 갖는 데이타 처리 시스템에 메모리 액세스 제어를 제공하는 방법에 있어서, 데이타 처리기내의 메모리 관리 유닛에 논리 어드레스를 제공하는 단계와, 논리 어드레스 부분을 제1 투명 변환 레지스터내의 소정수의 비트에 선택적으로 비교하여, 논리 어드레스 부분이 제1 투명 변환 레지스터내의 소정수 비트와 동일하다면 제1제어 신호를 표명하는 단계와, 논리 어드레스 부분을 제2투명 변환 레지스터내의 소정수의 비트에 선택적으로 비교하여, 논리 어드레스 부분이 제 2투명 변환 레지스터내의 소정수의 비트와 동일하다면 제2 제어 신호를 표명하는 단계, 및 제1제어 신호 또는 제2제어 신호중 한 신호에 기초하여, 제1투명 변환 레지스터로부터의 속성 비트, 제2투명 변환 레지스터로부터의 속성 비트 또는 처리기 특권 모드와 관련없이 속성 비트를 제공하는 디폴트 기억장소로부터의 속성비트를 선택하는 단계를 구비하는 메모리 액세스 제어 제공 방법.
  3. 적어도 두 처리기 특권 동작 모드를 갖는 데이타 처리 시스템에 메모리 액세스 제어를 제공하는 방법에 있어서, 데이타 처리기내의 메모리 관리 유닛에 논리 어드레스를 제공하는 단계와, 논리 어드레스 부분을 제1 투명 변환 레지스터내의 소정수의 비트에 비교하여, 논리 어드레스 부분이 소정수 비트와 동일하다면 제어 신호를 표명하는 단계, 및 제어신호에 기초하여, 제1투명 변환 레지스터로부터의 속성 비트, 또는 처리기 특권 모드와 관련없이 속성 비트를 제공하며 데이타 처리기에 연결된 다수 메모리 장소에 대하여 기록 액세스 허용을 제어하는 적어도 하나의 비트를 포함하는 디폴트 기억장소로 부터의 속성비트를 선택하는 단계를 구비하는 메모리 액세스 제어 제공 방법.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940027822A 1993-11-09 1994-10-28 메모리액세스제어를제공하는방법및데이타처리시스템 KR100338446B1 (ko)

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