KR940704097A - 패킷 송신 시스템에서 패킷 순차를 보존하기 위한 방법 및 장치(method and apparatus for preserving packet sequencing in a packet transmission system) - Google Patents

패킷 송신 시스템에서 패킷 순차를 보존하기 위한 방법 및 장치(method and apparatus for preserving packet sequencing in a packet transmission system)

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KR940704097A KR1019940702390A KR19940702390A KR940704097A KR 940704097 A KR940704097 A KR 940704097A KR 1019940702390 A KR1019940702390 A KR 1019940702390A KR 19940702390 A KR19940702390 A KR 19940702390A KR 940704097 A KR940704097 A KR 940704097A
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윌리암 케이. 도스
카렌 이. 로빈스
마크 에이. 예디낙
알. 리. 주니어. 헤밀톤
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Abstract

순서 에러가 도입되는 무선 채널을 통한 패킷 송신에도 불구하고, 분리된 소스 장치들(14)에 의해 발생되고 데이터 열(300)으로서 순서된 복수의 데이터 패킷들(310)의 순차적 관계를 보존하기 위한 방법 및 장치가 제1단말에서 소스 기능으로서 데이터 열 내부로부터 데이터 패킷을 식별하고, 식별된 데이터 패킷들에 대한 데이터 패킷 순차 정보를 발생하고, 소스 및 송신 데이터 패킷들의 기능으로서 데이터 패킷 순차 정보에 대응하는 값들을 저장하며, 데이터 패킷, 소스 장치 동일성 및 데이터 패킷 순차 정보를 제2단말로 송신하기 위한 방법 단계 및 장치 구조를 포함한다. 제2단말들은 제2단말 메모리로부터 제1단말 데이터 패킷 순차 정보를 검색하고, 저장된 데이터 패킷 순차 정보와 수신된 데이터 패킷 순차 정보를 비교한다. 수신된 데이터 패킷들의 비교기능으로서 수신된 데이터 패킷은 순차 정보 순차 번호들이 비교될 때는 다른 프로세싱을 위해 포워드되고, 순차번호들이 비교되지 않을 때는 순차 정보에 의해 결정된 순서로 저장된다.

Description

패킷 송신 시스템에서 패킷 순차를 보존하기 위한 방법 및 장치(METHOD AND APPARATUS FOR PRESERVING PACKET SEQUENCING IN A PACKET TRANSMISSION SYSTEM)
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 예시적인 RF패킷 송신 시스템의 블록 다이어그램, 제2도는 제1도에 도시된 것과 같은 UM 또는 CM의 블록 다이어그램, 제3도는 데이터 열과 복수의 데이터 패킷들 사이의 대응을 도시한 도면, 제4도는 데이터 패킷과 무선 송신 패킷 사이의 대응을 도시한 도면, 제5도는 제4도에 도시된 것과 같은 헤더내에 포함된 정보를 도시한 도면, 제6도는 제4도에 도시된 것과 재조립 헤더(reassembly header)내에 포함된 정보를 도시한 도면, 제7도는 제6도에 도시된 것과 같은 프로토콜 필드내에 포함된 정보를 도시한 도면, 제8도는 UM(12)가 사용자 장치(14)로부터 데이터 패킷을 수신할 때, 제2의 마이크로프로세서(13)에 의해 수행되는 단계들의 플로우챠트 다이어그램, 제9도는 UM(12) 어드레스 표를 도시한 도면, 제10도는 패킷 순차 번호 표를 도시한 도면.

Claims (12)

  1. 복수의 소스 장치들에 의해 발생되어 순서 에러를 도입하는 채널을 통해 제1단말과 제2단말 사이에서 통신되는 데이터 열 데이터 패킷들의 순차적인 관계를 보존하기 위한 방법에 있어서, 소스 장치 식별 정보의 기능으로서 데이터 열 내부로부터 데이터 패킷을 식별하는 단계; 식별된 데이터 패킷에 대한 데이터 패킷 순차 정보를 발생시키는 단계; 소스 장치의 식별 기능으로서 데이터 패킷 순차 정보에 대응하는 값들을 메모리에 저장하는 단계; 데이터 패킷, 소스 장치 식별 정보 및 패킷 순차 정보를 제1단말 소스 장치 및 데이터 패킷 순차 정보를 갖는 상기 제2단말로 송신하는 단계; 상기 제2단말에서 상기 제1단말 전송들을 수신하는 단계; 어드레스될 때, 제1단말 소스 장치 식별 정보에 의해 제1단말 데이터 패킷 순차 정보를 제2단말 메모리로부터 인출하는 단계; 인출된 데이터 패킷 순차 정보와 수신된 데이터 패킷 순차 정보를 비교하는 단계; 순차 정보 순차 번호들이 비교될 때, 다른 프로세싱을 위해 수신된 데이터 패킷을 포워드(forward)하는 단계; 및 순차 정보 순차 번호들이 비교되지 않을 때, 순차 정보에 의해 결정된 순서로 수신된 데이터 패킷들의 적어도 약간을 저장하는 단계를 포함하는 것을 특징으로 하는 데이터 열 데이터 패킷들의 순차적인 관계를 보존하기 위한 방법.
  2. 제1항에 있어서, 순차 정보 순차 번호들이 V(r)+(2n-2)로부터 V(r)+(2n-2-1)까지의 범위 안에서 비교될 때, 다른 프로세싱을 위해 수신된 데이터 패킷을 포워드시키는 단계; 순차 정보 순차 번호들이 V(r)+1로부터 V(r)+(2n-2-1)까지의 범위 안에서 비교될 때, 수신된 데이터 패킷을 저장하는 단계; 및 순차 정보 순차 번호들이 V(r)+(2n-2) 이상까지 오비교될 때(여기서, V(r)은 수신된 데이터 패킷에 대해 예상된 순차 번호를 나타내는 값이고 , n은 이 순차 번호 값 V(r)을 인코드하는데 사용되는 비트들의 수) 수신된 데이터 패킷을 폐기하는 단계를 더 포함하는 것을 특징으로 하는 데이터 열 데이터 패킷들의 순차적인 관계를 보존하기 위한 방법.
  3. 다목적 마이크로프로세서와 함께 사용하기 위한 통신 시스템 제어기에 있어서, 상기 통신 시스템 제어기가 복수의 소스 장치들에 의해 발생되어 제1단말과 제2단말 사이에서 통신되는 데이터 열 데이터 패킷들의 순차적인 관계를 보존하기 위해 상기 마이크로프로세서에 의해 실행되는 프로그램이 저장된 컴퓨터프로그램 저장 매체를 포함하고, 상기 프로그램이 소스 장치 식별 정보의 기능으로서 데이터 열 내부로부터 데이터 패킷을 식별하기 위한 수단; 식별된 데이터 패킷에 대한 데이터 패킷 순차 정보를 발생시키기 위한 수단; 상기 식별 수단 및 상기 발생 수단과 연관된 제1임의 접근 기억 장치; 메모리 어드레스 신호로서 소스 장치 식별 정보를 상기 제1메모리 공급(feeding)하기 위한 수단; 소스 장치의 식별 정보의 기능으로서 데이터 패킷 순차 정보에 대응하는 값들을 상기 제1메모리에 저장하기 위한 수단; 상기 제1임의 접근 기억 장치에 접속되어, 데이터 패킷, 소스 장치 식별 정보 및 데이터 패킷 순차 정보를 상기 제2단말로 송신하기 위한 송신기; 제1단말 송신들을 수신하기 위한 수단; 수신 수단에 접속되어, 제1단말 소스 장치 및 데이터 패킷 소스 정보를 갖는 제2임의접근 기억 장치; 상기 제2메모리에 접속되어, 상기 제2메모리가 수신된 소스 장치 식별 정보에 의해 어드레스될 때, 상기 제2메모리로부터 제1단말 데이터 패킷 순차 정보를 인출하기 위한 수단; 인출된 데이터 패킷 순차 정보 순차 번호와 수신된 데이터 패킷 순차 정보 순차 번호를 비교하기 위한 수단; 비교에 응답하여, 순차 정보 순차 번호가 비교될 때, 다른 프로세싱을 위해 수신된 데이터 패킷을 포워드하고, 순차 정보 순차 번호들이 V(r)+1로부터 V(r)+(2n-2-1)까지의 범위 안에서 비교될 때, 수신된 데이터 패킷을 저장하고, 순차 정보 순차 번호들이 V(r)+(2n-2-1)로부터 V(r)+(2n-1-1)까지의 범위안에서 비교될 때, 다른 프로세싱을 위해 수신된 데이터 패킷을 포워드하며, 순차 정보 순차 번호들이 V(r)+(2n-2) 이상까지 오비교될 때(여기서, V(r)은 수신된 데이터 패킷에 대해 예상된 순차 번호를 나타내는 값이고 , n은 이 순차 번호 값 V(r)을 인코드하는데 사용되는 비트들의 수) 수신된 데이터 패킷을 폐기하기 위한 수단을 포함하는 것을 특징으로 하는 통신 시스템 제어기.
  4. 제3항에 있어서, 상기 프로그램이 상기 복수의 제1단말 소스 장치들을 식별하기 위한 수단; 상기 복수의 소스 장치들 각각으로부터의 데이터 패킷들의 송신 이전에 상기 복수의 소스 장치들 각각에 대한 제1단말 소스 장치 식별 정보들을 각각 상기 제2단말로 송신하기 위한 수단; 메모리 어드레스 신호로서 제1단말 소스 장치 식별 정보를 제2단말 메모리에 공급하기 위한 수단; 메모리 어드레스 신호들의 기능으로서 제1단말 소스 장치 및 패킷 순차 번호 정보의 저장을 위해 제2단말 메모리내에 표들을 맵핑(mapping)하기 위한 수단; 및 초기화된 메모리 표를 어드레스하는 소스 장치 식별 정보를 갖는 제1단말 송신의 수신 이전에 제2단말 메모리 맵된 표를 초기화시키기 위한 수단을 더 포함하는 것을 특징으로 하는 통신 시스템 제어기.
  5. 제3항에 있어서, 상기 프로그램이 수신된 송신이 단말에 접속된 모든 소스 장치들과 통신되는 것인지를 결정하기 위한 수단; 및 수신된 정보에 대한 수차 번호 정보를 모든 소스 장치들과 통신되는 송신이 미리 수신되지 않았을 때, 시스템에 의해 유지되는 순차 번호 정보와 동기시키기 위한 수단을 더 포함하는 것을 특징으로 하는 통신 시스템 제어기.
  6. 제3항에 있어서, 상기 프로그램이 데이터 패킷 순차를 트랙킹(tracking)하기 위한 수단; 송신 패킷 재조립 헤더(reassembly header)를 구축하기 위한 수단; 송신 패킷을 구축하기 위한 수단; 및 송신을 위해 송신 패킷을 큐(queue)함과 동시에 패킷 타이머를 개시하기 위한 수단을 더 포함하는 것을 특징으로 하는 통신 시스템 제어기.
  7. 제6항에 있어서, 패킷 타이머의 나임 아웃 표시시 송신 윈도우 맵 상태가 가장 오래된 인식되지 않은 송신 패킷을 결정하기 위해 갱신되는 것을 특징으로 하는 통신 시스템 제어기.
  8. 제3항에 있어서, 다른 프로세싱을 위해 수신된 데이터 패킷을 포워드하기 위한 수단이 다른 핸들링(handling)을 위해 적당한 응용으로 데이터 패킷을 포워드하기 위한 수단; 상기 데이터 패킷의 수신을 나타내기 위해 수신 윈도우 비트 맵 상태를 갱신하기 위한 수단; 및 이전에 수신되고 순서에서 벗어난 임의의 패킷들이 적당한 응용으로 포워드되는지를 결정하기 위한 수단을 더 포함하는 것을 특징으로 하는 통신 시스템 제어기.
  9. 제3항에 있어서, 순차 정보 순차 번호들이 V(r)+1로부터 V(r)+(2n-2-1)까지의 범위 안에서 비교될 때, 수신된 데이터 패킷을 저장하기 위한 수단이 데이터 패킷 순차 정보에 의해 결정된 순서로 메모리에 수신된 데이터 패킷을 저장하기 위한 수단; 상기 데이터 패킷의 수신을 나타내기 위해 수신 윈도우 비트 맵 상태를 갱신하기 위한 수단; 및 순차 번호 타이머를 개시하기 위한 수단을 더 포함하는 것을 특징으로 하는 통신 시스템 제어기.
  10. 제9항에 있어서, 순차 번호의 타임 아웃 표시시 상기 저장된 데이터 패킷이 적당한 응용으로 포워드되는 것을 특징으로 하는 통신 시스템 제어기.
  11. 제3항에 있어서, 상기 데이터 패킷 순차 정보가 소스 장치 식별 정보; 소스 장치와 연관된 다음의 송신 패킷에 할당된 송신 순차 번호; 소스 장치와 연관된 가장 오래된 인식되지 않은 송신 패킷에 할당된 순차 번호 값; 인식된 순서에서 벗어난 패킷들을 관리하기 위한 송신 윈도우 비트 맵; 메모리에 저장되고, 다음에 수신될 것으로 예상되는 패킷에 대한 순차 번호를 나타내는 수신 순차 번호; 및 순서에서 벗어나게 수신된 패킷들을 관리하기 위한 수신 윈도우 비트 맵을 포함하는 것을 특징으로 하는 통신 시스템 제어기.
  12. 복수의 소스 장치들에 의해 발생되어 제1단말과 제2단말 사이에서 통신되는 데이터 열 데이터 패킷들의 순차적인 관계를 보존하기 위한 RF통신 시스템에 있어서, 상기 통신 시스템이 상기 제1단말 및 상기 제2단말을 포함하고; 상기 제1단말은 상기 복수의 소스 장치들을 식별하고, 소스 및 식별된 데이터 패킷들에 대한 발생 데이터 패킷 순차 번호의 기능으로서 데이터 열 내부로부터 데이터 패킷을 식별하기 위한 마이크로프로세서; 상기 마이크로프로세서에 접속되어, 소스 장치 식별의 기능으로서 데이터 패킷 순차 번호에 대응하는 값들의 표를 저장하기 위한 임의 접근 기억 장치; 및 상기 마이크로프로세서에 의해 제어되고 임의 접근 기억 장치에 접속되어, 데이터 패킷, 소스 장치 동일성 및 순차 번호들을 제1단말 소스 장치 및 데이터 패킷 순차 번호 정보를 갖는 상기 제2단말로 송신하기 위한 송신기를 포함하고, 상기 제2단말은 제1단말 송신들을 수신하기 위한 수신기; 상기 수신기에 접속되어, 제1단말 데이터 패킷 순차 번호 정보에 대응하는 값들의 표를 저장하기 위한 임의 접근 기억 장치; 및 상기 수신기 및 임의 접근 기억 장치에 접속되어, 상기 메모리가 소스 장치 식별 정보에 의해 어드레스될 때, 상기 임의 접근 기억 장치로부터 제1단말 데이터 패킷 순차 정보를 인출하고, 인출된 데이터 패킷 순차 번호와 수신된 데이터 패킷 순차 번호를 비교하고, 순차 정보 순차 번호가 비교될 때, 다른 프로세싱을 위한 응용으로 수신된 데이터 패킷을 포워드하고, 순차 정보 순차 번호들이 V(r)+1로부터 V(r)+(2n-2-1)까지의 범위안에서 비교될 때, 수신된 데이터 패킷을 저장하고, 순차 정보 순차 번호들이 V(r)+(2n-2)로부터 V(r)+(2n-1-1)까지의 범위안에서 비교될 때, 다른 프로세싱을 위한 응용으로 수신된 데이터 패킷을 포워드하며, 순차 정보 순차 번호들이 V(r)+(2n-2) 이상까지 오비교될 때(여기서, V(r)은 수신된 데이터 패킷에 대해 예상된 순차 번호를 나타내는 값이고 , n은 이 순차 번호 값 V(r)을 인코드하는데 사용되는 비트들의 수) 수신된 데이터 패킷을 폐기하는 마이크로프로세서를 포함하는 것을 특징으로 하는 RF통신 시스템.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019940702390A 1992-11-12 1993-10-26 패킷 송신 시스템에서 패킷 순차를 보존하기 위한 방법 및 장치(method and apparatus for preserving packet sequencing in a packet transmission system) KR940704097A (ko)

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