KR930015343A - 클램프(Clamp) 회로 - Google Patents

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KR930015343A
KR930015343A KR1019910025677A KR910025677A KR930015343A KR 930015343 A KR930015343 A KR 930015343A KR 1019910025677 A KR1019910025677 A KR 1019910025677A KR 910025677 A KR910025677 A KR 910025677A KR 930015343 A KR930015343 A KR 930015343A
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최영순
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강진구
삼성전자 주식회사
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits

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Abstract

동기펄스 분리기로부터 분리된 출력이 수평동기에 동기되어 클램핑된 출력이 왜곡되는 동기 펄스 폭을 제한하도록 하여 비디오의 신호처리에 용이하도록 한다.
수평동기 펄스를 입력으로 하는 동기펄스 분리기(10)에서는 수평 동기 펄스를 분리하여 동기펄스 분배기(30)에 인가하며 동기펄스 분배기(30)에서는 동기펄스 분리기(10)에서 지연과 왜곡된 동기펄스폭을 제한하여 클램프부(20)에 인가되며 클램프부(20)에서는 인가된 지연과 왜곡이 없는 동기펄스를 출력하도록 구성하였다.

Description

클램프(Clamp) 회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제5도는 본 발명의 클램프 회로도,
제6도는 제5도(20)의 상세도,
제7도는 제6도 동작 파형도.

Claims (1)

  1. 비디오 입력신호로부터 수평동기 펄스신호를 분리하기 위한 동기펄스 분리기(10)와, 상기 동기펄스 분리기(10)의 출력신호의 전압을 입력하는 클램프부(20)에는 출력전류로 변환하여 주는 콘버터(도시않됨)로 구성됨에 있어서, 동기 펄스분리기(10)의 출력을 입력으로 하여 동기펄스분리기(10)의 출력펄스 폭을 제한하기 위한 동기 펄스 분배기(30)와를 구비하여 이루어진 것을 특징으로 하는 클램프 회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910025677A 1991-12-31 1991-12-31 클램프(Clamp)회로 KR940007953B1 (ko)

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