KR930005650B1 - 타이머를 이용한 일정시간 지연방법 - Google Patents
타이머를 이용한 일정시간 지연방법 Download PDFInfo
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Abstract
내용 없음.
Description
제1도는 본 발명의 시스템 구성도.
제2도는 본 발명에 따른 지연 파라메터를 계산하는 순서도.
제3도는 본 발명에 따른 지연 루틴을 나타낸 순서도.
제4도는 본 발명에 따른 T초 동안의 타이머가 인터럽트가 발생되는 것을 나타낸 파형도.
본 발명은 PC에서 일정시간 동안 지연 또는 대기해야할 경우에 지연루틴(Delay Routine)을 이용하도록한 타이머를 이용한 일정시간 지연방법에 관한 것이다.
종래에는 PC에서 일정시간의 지연을 위해 특별한 지연 루틴이 없이 적당한 모조 명령어(Dummy Instruction)를 일정횟수 반복수행하도록하여 일정시간동안 지연 또는 대기해야하는 경우가 많으며, 일반적으로 정확한 시간 동안 지연시키는 체계적인 방법을 강구하기가 어려웠다.
본 발명은 상기한 종래의 문제점을 해소하기 위한 것으로서, PC에서 지연루틴을 이용하도록한 타이머를 이용한 일정시간 지연방법을 제공함에 그 목적이 있다. 이하 본 발명을 첨부도면 제1도 내지 제4도를 참조하여 상세히 설명한다.
제1도는 본 발명의 시스템 구성도로서, 중앙처리장치(CPU)(1)와, 인터럽트(Interrupt)제어기(2)와, 시스템 내부의 시계를 동작시키기 위해 일정시간(IBM PC의 경우에 0.05sec) 마다에 인터럽트가 발생되므로서 시계를 갱신(Update) 시키도록한 타이머(3)로 구성된다.
상기와 같이 구성된 본 발명은 지연루틴을 사용하여 지연 파라메터를 계산하는 방법이 제2도에 나타낸 바와같이, 인터럽트의 기능을 수행할 수 없는 상태인 인터럽트 억제기능(Disable)이 발생되었을 경우에, 단계(100)에서는 플래그(flag)=0이고 카운트=0이 된다. 다음 단계(101)에서 타이머 인터럽트가 인에이블(Enable)되는 경우에, 타이머 인터럽트가 발생했을 경우를 단계(102)에서 체크하여 첫번째 타이머 인터럽트가 발생하면 플래그=0일때 카운트는 리세트(reset) 상태가 되어 플래그=플래그+1로 되고, 두번째 인터럽트가 발생하면 플래그=1일때 플래그는 카운트가 하나더 증가한 값이 된다(단계 103).
이 전상태(단계 102)인 타이머 인터럽트가 발생되지 않았을 경우에는 단계(104)에서 모조명령어를 일정횟수 동안 반복 수행하여 단계(105)에서 카운트가 카운트를 하나더한 값과 같게되고 다음단계(106)인 플래그가 1보다 작은 경우에는 이 전단계(104)를 반복 수행하도록 하며, 플래그가 1보다 큰 경우에는 단계(107)에서 파라메터를 계산하게 된다.
상기와 같이 단계(107)에서 파라메터를 계산하도록 하므로서, IBM PC의 경우에 T초(0.05sec) 동안 마다 타이머 인터럽트가 발생되어 일정횟수동안 반복수행하고 모조명령어가 플래그 번째동안 반복되는 경우에 “파라메터=플래그/T”식으로 1초 동안에 모조명령어가 반복 수행하는 횟수로 나타내어 지게된다(제4도 참조).
제3도에서 파라메터를 계산한 값이 제4도에 나타낸 바와 같이 카운트 보다 큰 경우에는 재차 모조명령어를 일정 횟수동안 반복수행하게 되며, 카운트가 파라메터를 계산한 값보다 큰 경우에는 루틴에 의하여 1초 동안의 지연상태가 이루어지게 되는 것이다.
상기한 바와 같이 본 발명은 일정시간 동안 지연 또는 대기해야 되는 경우에 정확한 시간 동안 지연시킬 수가 있다.
Claims (1)
- 인터럽트 억제기능이 발생하여 플래그=0이고 카운트가 리세트되고, 타이머 인터럽트가 인에이블 되는 단계(100, 101)와, 타이머 인터럽트가 발생되는 경우(102), 플래그=0일때 카운트가 리세트되어 플래그=플래그+1이되고, 플래그=1일때 플래그=카운트+1이 되는 단계(103)와, 타이머 인터럽트가 발생되지 않는 경우(102), 모조명령어를 일정 횟수동안 반복 수행하여 카운트=카운트+1이 되고, 플래그가 1보다 작으면 모조명령어를 재차 수행하고, 플래그가 1보다 크면 1초 동안에 모조명령어가 반복수행하는 횟수로 파라메터를 계산하는 단계(104, 105, 106, 107)로 이루어지는 것을 특징으로 하는 타이머를 이용한 일정시간 지연방법.
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019870015497A KR930005650B1 (ko) | 1987-12-31 | 1987-12-31 | 타이머를 이용한 일정시간 지연방법 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
KR1019870015497A KR930005650B1 (ko) | 1987-12-31 | 1987-12-31 | 타이머를 이용한 일정시간 지연방법 |
Publications (2)
Publication Number | Publication Date |
---|---|
KR890011214A KR890011214A (ko) | 1989-08-14 |
KR930005650B1 true KR930005650B1 (ko) | 1993-06-23 |
Family
ID=19267777
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
KR1019870015497A KR930005650B1 (ko) | 1987-12-31 | 1987-12-31 | 타이머를 이용한 일정시간 지연방법 |
Country Status (1)
Country | Link |
---|---|
KR (1) | KR930005650B1 (ko) |
-
1987
- 1987-12-31 KR KR1019870015497A patent/KR930005650B1/ko not_active IP Right Cessation
Also Published As
Publication number | Publication date |
---|---|
KR890011214A (ko) | 1989-08-14 |
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