KR920003179B1 - 플라즈마 디스플레이 콘트롤 시스템 - Google Patents

플라즈마 디스플레이 콘트롤 시스템 Download PDF

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KR920003179B1 KR1019890007049A KR890007049A KR920003179B1 KR 920003179 B1 KR920003179 B1 KR 920003179B1 KR 1019890007049 A KR1019890007049 A KR 1019890007049A KR 890007049 A KR890007049 A KR 890007049A KR 920003179 B1 KR920003179 B1 KR 920003179B1
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가부시기가이샤 도시바
아오이 죠이치
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Abstract

내용 없음.

Description

플라즈마 디스플레이 콘트롤 시스템
제1도는 본 발명의 플라즈마 디스플레이 콘트롤 시스템의 전체구성을 도시하는 블록도.
제2도는 제1도에 도시한 플라즈마 디스플레이의 내부 구성을 도시하는 블록도.
제3도는 제2도에 도시한 디스플레이 패널과, 캐소드 드라이버 및 애노드 드라이버의 접속구성을 도시하는 블록도.
제4a도 내지 제4f도는 제3도에 도시한 실시예에 있어서 변조 펄스와, 이 변조 펄스를 기초로 생성되는 각종 계조도의 애노드 펄스를 예시한 타임 챠트.
제5a도는 상기 실시예에 있어서의 애노드 펄스폭과 계조와의 관계를 도시하는 특성도.
제5b도는 디스플레이 휘도와 계조와의 관계를 도시하는 특성도.
제6도는 제2도에 도시한 변조 펄스 발생회로를 상세히 도시하는 블록도.
제7a도 내지 제7f도는 종래의 변조 펄스와 이 변조 펄스에 의거하여 생성되는 각종 계조도의 애노드 펄스를 제4a도 내지 제4f도에 대비시켜서 도시한 타임 챠트.
제8도는 디스플레이 휘도와 애노드 펄스폭의 관계를 도시하는 도면.
제9a도 및 제9b도는 각각 계조와 애노드 펄스폭 계조와 디스플레이 휘도와의 관계를 도시하는 특성도.
* 도면의 주요부분에 대한 부호의 설명
1 : CRT 콘트롤 러 2 : 클럭 모듈
3 : 드라이버 4 : PDP(플라즈마 디스플레이)
5 : CRT 111 : 데이터 버퍼
112 : 애노드 타이밍 발생기 113 : 변조 펄스 발생회로
114 : 가변 저항기 115 : 모드 판별/클럭 발생기
116 : 캐소드 타이밍 발생회로 117 : 캐소드 드라이버
118 : 애노드 드라이버 119 : 디스플레이 패널
211, 221 : 시프트 레지스터 212 : 래치회로
본 발명은 CRT 디스플레이의 표시 타이밍으로 플라즈마 디스플레이를 표시하는 플라즈마 디스플레이 콘트롤 시스템에 관한 것이다.
종래, 플라즈마 디스플레이 유닛을 표준장비하고, 컬러 디스플레이 유닛을 임의로 접속 가능케한 퍼스털 컴퓨터, 퍼스널 워크스테이션등의 컴퓨터 시스템에 있어서 취급하는 데이터에 색요소를 가질 때 플라즈마 디스플레이 유닛에 의한 표시로서는 색별의 데이터 표현이 불가능하였다.
또, 종래에는 플라즈마 디스플레이에 있어서 계조 표시를 할 때 표시정보에 계조도를 지니게 하고 있으나, 계조 및 휘도가 일률적인 계조표시수단으로는 컬러 디스플레이에 있어서의 색별 표시와 같은 명확한 구분표시를 할 수 없다는 문제가 있었다.
본 발명의 목적은 CRT 디스플레이 장치(컬러 디스플레이장치)에 맞춘 계조 보정을 플라즈마 디스플레이의 외부 기구에서 행하지 않고 플라즈마 디스플레이 유닛내에서 쉽게 할 수 있고, 따라서 플라즈마 디스플레이 유닛측에 있어서, 계조 보정의 제어를 하지 않고 컬러 CRT 디스플레이의 표시에 맞는 계조로 플라즈마 디스플레이의 유닛의 표시를 제어할 수 있는 플라즈마 디스플레이 콘트롤 시스템을 제공하는데 있다.
상기 목적을 달성하기 위하여 본 발명은 캐소드 전극과 애노드 전극을 비치하고 색의 변화 계조를 사용하여 표시하는 플라즈마 디스플레이를 구비하고, 나아가서 옵숀 컬러 CRT 디스플레이를 접속 가능한 플라즈마 디스플레이 콘트롤에 있어서, 상기 컬러 CRT 디스플레이 및 플라즈마 디스플레이에 수직동기신호, 수평동기신호 및 계조를 갖는 표시데이터를 출력하는 컬러 CRT 디스플레이 콘트롤과, 상기 플라즈마 디스플레이의 휘도를 가변 설정하는 휘도 가변 설정수단과, 상기 CRT 디스플레이 콘트롤에서 출력된 수직동기신호 및 수평동기신호를 수취, 상기 휘도 설정 수단에 의하여 설정된 휘도를 수취, 휘도가 높아짐에 따라 점차 간격이 넓어지는 가변조 펄스를 발생하는 가변조 펄스 발생수단과, 상기 가변조 발생수단에 의하여 발생된 가변조 펄스에 의거하여 상기 표시 데이터가 표시하는 계조에 고유의 펄스폭을 지니고 상기 애노드 전극에 인가되는 애노드 펄스를 발생하는 애노드 펄스 발생수단을 구비하고, 상기 플라즈마 디스플레이를 구동하는 구동수단을 구비하고 있다.
이하, 첨부된 도면을 참조하여 본 발명의 실시예를 상세히 설명한다.
제1도는 본 발명의 플라즈마 디스플레이 콘트롤 시스템 전체의 구성을 나타내는 블록도이다.
제1도에 있어서, 2점 쇄선으로 둘러싸인 부분은 본 발명에 의한 플라즈마 디스플레이 콘트롤러를 표시한다. CRT 콘트롤러(1)는 음극선관(Cathode ray tube ; CRT)(5) 및 플라즈마 디스플레이(Plasma display ; PDP)(4)의 표시를 제어하기 위한 각종 표시제어신호를 출력한다. 즉, CRT 콘트롤러(1)는 CRT 디스플레이(5)의 표시 타이밍으로 생성된 수직동기신호(VSYNC), 수평동기신호(HSYNC) 및 표시데이터(DATA)를 출력하는 타이밍을 표시하는 인에이블 신호(ENAB)를 드라이버(3)를 통하여 CRT 디스플레이(5) 및 플라즈마 디스플레이(4)에 출력한다. 이와 같은 CRT 콘트롤러(1)로서는, 예컨대 미합중국 파라다이스사(Paradise)의 PVGA 1을 적용할 수 있다. CRT 콘트롤러(1)에서 출력되는 수직동기신호(VSYNC)와 수평동기신호(HSYNC)는 CRT 디스플레이(5) 및 플라즈마 디스플레이(4)의 표시 해상도에 따라 각각 극성이 변화된다. 클럭 모듈 (2)은 드라이버(3)를 개재하여 플라즈마 디스플레이(4)에 클럭 신호(CLK)를 공급한다.
제2도는 제1도에 도시한 플라즈마 디스플레이(4)의 내부 구성을 나타내는 블록도이다.
제2도에 있어서 데이터 버퍼(111)는 CRT 콘트롤러(1)로부터 공급된 1화소 4피트(16계조)의 표시 데이터(DATA)를 연속적으로 받아 계조 데이터(gradation data : GD)로서 출력하는 데이터 버퍼이다. 애노드 타이밍 발생기(112)는 클럭(CLK)과 표시기간 신호(ENAB)와 모드 판별/클럭발생기(115)로부터 클럭(MC)을 받아, 수평 시프트 클럭(HSC), 래치 펄스(LP)등을 출력한다. 변조 펄스 발생회로(113)는 모드 판별 클럭 발생기(115)에서 생성된 클럭(MC)과 함께 변조 펄스(MP)를 생성한다. 가변 저항기(114)는 변조 펄스 발생회로(113)에서 생성되는 변조 펄스(MP)의 펄스간격을 바꾸어서 전 계조가 똑같은 휘도 조정을 행한다. 모드 판별/클럭 발생기(115)는 수직동기신호(VSYNC)와 수평동기신호(HSYNC)의 정/부 극성에서 표시화면의 표시 해상도를 판별하고 모드 절환신호 (MS)를 출력하는 동시에, 각종의 내부 클럭(MC)을 생성한다. 캐소드 타이밍 발생회로(116)는 상기 표시기간신호(ENAB)와 모드 판별/클럭 발생기(115)에서 출력되는 수직동기신호(VSYNC), 수평동기신호(HSYNC), 모드절환신호(MS 2비트)등을 받아서, 캐소드 전극 드라이브를 위한 스캐닝 데이터(SD) 및 수식 시프트 클럭(VSC)을 받아서 캐소드 전극 드라이브를 위한 캐소드 펄스(CAP(479)를 통한 CAPO)를 출력한다. 애노드 드라이버(118)는 데이터 버퍼(111)로 부터의 계조데이터와, 애노드 타이밍 발생기(112)로부터의 수평시프트클럭(HSC) 및 래치 펄스(LP)를 받아서, 계조데이터(GD)를 수평시프트클럭(HSC)에 의하여 내부의 시프트 레지스타에 읽어 넣고, 래치 펄스(LP)에 의하여 펄스제어를 행하고, 화소 데이터를 계조에 대응한 펄스폭을 지니는 애노드 펄스(ANP(639)를 통한 ANPO)를 출력한다. 디스플레이 패널(119)은 캐소드 드라이버(117)에서 출력되는 캐소드 펄스(CAP(479)를 통한 CAPO)를 캐소드 전극에 받고, 애노드 드라이버(118)에서 출력되는 애노드 펄스(ANP(639)를 통한 ANPO)를 애노드 전극에 받아 최대 표시 해상도 640×480도트. 16계조로 표시데이터를 출력한다.
제3도는 제2도에 도시한 디스플레이 패널(119)과 캐소드 드라이버(117) 및 애노드 드라이버(118)의 접속구성을 나타내는 블록도이다. 애노드 드라이버(118)는, 계조 데이터(GD)를 수평 시프트 클럭(HSC)에 동기하여 읽어 넣는 시프트 레지스터(211)와, 시프트 레지스터(211)에 축적된 표시 데이터를 래치 펄스(LP)에 의하여 래치하는 래치회로(212) 및 래치회로(212)에 래치된 표시데이터를 제4도에 도시된 바와 같은 고휘도에 향해서 서서히 간격이 넓어지는 변조 펄스(MP)로 펄스 변조하고, 화소 데이터의 계조에 따라 고휘도에 향해서 넓어지는 폭의 비율이 커지는 제4b도 내지 제4f도에 도시된 바와 같은 펄스폭의 애노드펄스(ANP(639)를 통한 ANPO)를 출력하는 펄스폭 발생회로 구성된다.
캐소드 드라이버(117)는 시프트 레지스터(221)를 가진다. 시프트 레지스터 (221)는 캐소드 타이밍 발생회로(116)에서 출력되는 스캐닝 데이터(SD)를 동일하게 캐소드 타이밍 발생회로(116)에서 출력되는 수직시프트클럭(VSC)에 동기하여 시프트하여, 캐소드 전극 드라이브를 위한 캐소드 펄스(CAP(479)를 통한 CAPO)를 출력한다.
캐소드 전극(232)은 상기 캐소드 드라이버(117)에서 출력되는 캐소드 펄스 (CAP(479)를 통한 CAPO)를 받고, 애노드 전극(231)은 애노드 드라이버(118)에서 출력되는 애노드 펄스(ANP(639)를 통한 ANPO)를 받아서, 최대 표시 해상도 640×480도트, 16계조로 표시 데이터를 표시 출력한다.
제4a도 내지 제4f도는 변조 펄스 발생회로(113)에서 생성되어, 애노드 드라이버(118)의 펄스발생회로(213)에 공급되고, 고휘도를 향해서 넓어지는 폭의 비율이 커지는 변조 펄스(MP)와, 이 변조 펄스(MP)를 기초로 생성되는 각종 계조도의 애노드 펄스(ANP)를 예시한 타임 챠트이다. 제4a의 a는, 저휘도의 펄스 간격폭, b는 고휘도의 펄스간격, c는 저 계조의 화소 데이터 신호(＂0001＂=계조 1과 ＂0010＂=계조 2)의 펄스폭의 차, d는 고계조의 화소 데이터 상호(＂1110＂=계조 14와 ＂1111＂=계조 15)의 펄스폭의 차이다.
이 도면에서 명백한 바와 같이, 변조 펄스(MP)는 저휘도에서 고휘도로 향해서 서서히 펄스간격이 넓어진다. 따라서, 저계조의 화소 데이터(＂0001＂=계조 1)는 펄스간격이 가장 좁은 변조 펄스(MP)로 펄스 변조되고, 고계조로 될수록 펄스간격이 넓은 변조펄스(MP)로 펄스폭 변조된다. 이때의 애노드 펄스폭과 계조의 관계를 제5a도에 도시하고, 표시 휘도와 계조의 관계를 제5b도에 도시한다.
제6도는 제4a도에 보이는 변조 펄스 MP를 생성하는 회로이다, 레지스터(31)에는 초기치가 설정된다. 이 초기치는 640개의 변조 펄스에 대하여 16개의 애노드 펄스가 들어가도록 설정된다. 이 초기치는 고정치로서 레지스터(31)에 세트된다. 카운터(33)는 1을 초기치로하여 차례로 카운트해 가는 카운터이다. 가산기(35)는 레지스터(31)에서 출력되는 값에 카운터(33)의 값을 가산함으로써 변조 펄스의 폭을 점차 크게하는데 사용하는 기준치를 비교기(38)에 공급한다. 카운터(37)에는 수평동기신호(HSYNC)가 공급되고, 클럭신호(CLK)에 동기하여, HSYNC 신호를 카운트한다. 카운터(37)의 출력치는 비교기(38)에 공급된다. 비교기(38)는 카운터(37)의 값이 가산기(35)의 값과 같게될 때, 가변조 펄스MP를 출력한다.
또한, 제7a도 내지 제7f도는 종래의 변조 펄스와 이 변조 펄스를 기초로 생성되는 각종 계조도의 애노드 펄스를 상기 제4a도 내지 제4f도와 대비하여 나타낸 타임 챠트이다, 제7a도 내지 제7f도에서 명백한 바와 같이 모든 펄스 간격이 일정하다는 것을 표시하고 있다.
제8도는 표시 휘도와 애노드 펄스폭의 관계를 나타낸 도면이고, 제9a도 내지 제9b도는 상기하 종래의 펄스폭 변조에 의한 애노드 펄스폭과 변조의 관계 및 표시 휘도와 계조의 관계를 제5a도와 제5b도에 대비하여 나타낸 표이다.
상술한 실시예에 의하면, 컬러 CRT 디스플레이 장치에 맞춘 계조 보정을 플라즈마 디스플레이 유닛의 외부의 기구로 행하지 않고, 플라즈마 디스플레이 유닛내에서 쉽게 행할 수 있다. 따라서, 플라즈마 디스플레이 구동계에 있어서, 계조 보정을 조금도 의식하지 않고, CRT 디스플레이 장치의 표시 맞춘 계조로 플라즈마 디스플레이 유닛을 제어할 수 있다.

Claims (4)

  1. 캐소드 전극과 애노드 전극을 구비하고, 색의 변화 계조를 이용하여 표시하는 플라즈마 디스플레이를 구비하며,또한 컬러 CRT 디스플레이를 접속할 수 있고, 상기 컬러 CRT 디스플레이 및 플라즈마 디스플레이에 극성을 지닌 수직동기신호, 수평동기신호 및 계조를 지닌 표시데이터를 출력하는 컬러 CRT 디스플레이 콘트롤러를 구비하는 플라즈마 디스플레이 콘트롤 시스템에 있어서, 상기 플라즈마 디스플레이의 휘도를 가변 설정하는 휘도 가변 설정수단과; 상기 CRT 디스플레이 콘트롤러에서 출력된 수직동기신호 및 수평동기신호를 수취, 휘도가 높아짐에 따라 점차 간격이 넓어지는 가변조 펄스를 발생하는 가변조 펄스 발생수단과; 상기 가변조 발생수단에 의하여 발생된 가변조 펄스에 의거하여, 상기 표시 데이터가 나타나는 계조에 고유의 펄스폭을 가지고, 상기 애노드 전극에 인가되는 애노드 펄스를 발생하는 애노드 펄스 발생수단을 구비하여, 상기 플라즈마 디스플레이를 구동하는 구동수단을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 콘트롤 시스템.
  2. 제1항에 있어서, 상기 휘도 가변조 설정수단 및 구동수단을 내장하는 것을 특징으로 하는 시스템.
  3. 캐소드 전극과 애노드 전극을 구비하고, 색의 변조 계조를 이용하여 표시하는 플라즈마 디스플레이를 구비하고,또한 임의적으로 컬러 CRT 디스플레이를 접속가능케하는 플라즈마 디스플레이 콘트롤 시스템에 있어서, 상기 컬러 CRT 디스플레이 및 플라즈마 디스플레이에 극성을 지닌 수직동기신호, 수평동기신호 및 계조를 가진 표시데이터를 출력하는 컬러 CRT 디스플레이 콘트롤러와, 상기 플라즈마 디스플레이의 휘도를 가변설정하는 휘도 가변 설정수단과; 상기 CRT 디스플레이 콘트롤러에서 출력된 수직동기신호 및 수평동기신호의 극성을 판단하고 각 신호의 극성 조합에 따라서 표시 해상도를 판별하는 표시 해상도 판별 수단과; 상기 휘도 설정수단에 의하여 설정된 휘도 및 상기 표시 해상도를 판별수단에 의하여 판별된 표시 해상도에 따라서 휘도가 높아짐에 따라 점차 간격이 넓어지는 가변조 펄스를 발생하는 가변조 펄스발생수단과; 상기 가변조 발생수단에 의하여 발생된 가변조 펄스에 의거하여, 상기 표시 데이터가 나타나는 계조에 고유의 펄스폭을 지니고, 상기 애노드 전극에 인가되는 애노드 펄스를 발생하는 애노드 펄스발생수단을 구비하여, 상기 플라즈마 디스플레이를 구동하는 구동수단을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 콘트롤 시스템.
  4. 제1항에 있어서, 상기 CRT 디스플레이 콘트롤러에서 출력된 수직동기신호 및 수평동기신호의 극성을 판단하고, 각 신호의 극성 조합에 따라서 표시 해상도를 판별하는 표시 해상도 판별 수단을 추가로 구비하며, 상기 가변조 펄스 발생수단은 상기 휘도 설정 수단에 의하여 설정된 휘도 및 상기 표시 해상도 판별 수단에 의하여 판별된 표시 해상도에 따라서 휘도가 높아짐에 따라, 점차 간격이 넓어지는 가변조 펄스를 발생하는 것을 특징으로 하는 시스템.
KR1019890007049A 1988-05-28 1989-05-26 플라즈마 디스플레이 콘트롤 시스템 KR920003179B1 (ko)

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JP63130924A JPH01105295A (ja) 1987-06-19 1988-05-28 表示制御装置
JP88-130924 1988-05-28

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KR890017652A KR890017652A (ko) 1989-12-16
KR920003179B1 true KR920003179B1 (ko) 1992-04-23

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KR1019890007049A KR920003179B1 (ko) 1988-05-28 1989-05-26 플라즈마 디스플레이 콘트롤 시스템

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KR (1) KR920003179B1 (ko)

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