KR910002155A - 페이징 수신기에서의 비트 동기 회로 - Google Patents
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-
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- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04L—TRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
- H04L7/00—Arrangements for synchronising receiver with transmitter
- H04L7/0079—Receiver details
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- Synchronisation In Digital Transmission Systems (AREA)
Abstract
내용 없음
Description
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 회로도,
제2도는 본 발명에서 위상 변이 검출기의 상세 회로도.
Claims (1)
- 입력 데이터(IN)신호를 받아 상승에지 위치를 나타내는 펄스를 생성하는 디플립플롭(1), (2)를 통하여 상기 입력 데이터(IN)와 재생된 클럭간의 위상변이를 검출하는 위상 변이 검출기(4)와 상기 위상변이 검출기(4)로부터의 검출신호를 게이팅하여 2개의 신호(P0), (P1)를 출력하는 게이트회로부(5), (6), (7), (8)와 상기 게이트회로부를 통한 신호 (P0), (P1)상태에 따라 주파수를 선택 조정하기 위한 계수를 행하는 주파수 조정 카운터(9)와, 상기 주파수 조정 카운터(9)의 출력(A2)신호를 디플립플롭(10), (11)을 거쳐 입력 반아 파형을 형성하는 파형 형성기(15)와를 연결하여 상기 신호 (P0), (P1)의 위상 관계에 따라 3가지 형태로 입력데이타와 클럭 펄스간의 동기를 맞추는 것을 특징으로 하는 페이징 수신기에서의 비트 동기회로.※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019890009288A KR910002155A (ko) | 1989-06-30 | 1989-06-30 | 페이징 수신기에서의 비트 동기 회로 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| KR1019890009288A KR910002155A (ko) | 1989-06-30 | 1989-06-30 | 페이징 수신기에서의 비트 동기 회로 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| KR910002155A true KR910002155A (ko) | 1991-01-31 |
Family
ID=68084146
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| KR1019890009288A KR910002155A (ko) | 1989-06-30 | 1989-06-30 | 페이징 수신기에서의 비트 동기 회로 |
Country Status (1)
| Country | Link |
|---|---|
| KR (1) | KR910002155A (ko) |
-
1989
- 1989-06-30 KR KR1019890009288A patent/KR910002155A/ko not_active Application Discontinuation
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