KR920015717A - 동기회로 - Google Patents

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KR920015717A
KR920015717A KR1019910001049A KR910001049A KR920015717A KR 920015717 A KR920015717 A KR 920015717A KR 1019910001049 A KR1019910001049 A KR 1019910001049A KR 910001049 A KR910001049 A KR 910001049A KR 920015717 A KR920015717 A KR 920015717A
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KR1019910001049A
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윤성희
Original Assignee
김광호
삼성전자 주식회사
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03K—PULSE TECHNIQUE
    • H03K5/00—Manipulating of pulses not covered by one of the other main groups of this subclass

Landscapes

  • Physics & Mathematics (AREA)
  • Nonlinear Science (AREA)
  • Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)

Abstract

내용 없음

Description

동기회로
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 본 발명의 동기회로를 보인 블록도, 제2도는 본 발명의 동기회로의 실시예를 보인 상세회로도, 제3도의 (가)-(바)는 제2도의 각부의 동작 파형도.

Claims (4)

  1. 입력되는 1차 펄스신호(PS1)에 따라 2차 펄스신호(PS2)를 발생하는 분주기(1)와, 상기 1차 펄스신호(PS1)를 이용하여 그 1차 펄스신호(CLK1)보다 높은 주파수의 기준 펄스신호(REF)를 발생하는 기준 펄스신호 발생부(2)와, 상기 기준 펄스신호(REF)를 따라 상기 1차 및 2차 펄스신호(PS1)(PS2)의 출력을 제어하여 동기된 펄스신호(PS11)(PS21)를 출력하는 동기 제어부(3)로 구성함을 특징으로 하는 동기회로.
  2. 제1항에 있어서, 2차 펄스신호 발생부(1)는 분주기인 것을 특징으로 하는 동기회로.
  3. 제1항에 있어서, 기준신호 발생부(2)는, 1차 펄스신호((PS1)를 지연시키는 지연부와, 상기 지연부의 출력신호와 1차 펄스신호(PS1)를 배타적 논리합하여 기준 펄스신호(REF)를 출력하는 익스클루시브 오아 게이트(EOR)로 구성함을 특징으로 하는 동기회로.
  4. 제1항에 있어서, 동기 제어부(3)는, 기준신호(REF)를 클럭신호로 하고, 1차 및 2차 펄스신호(PS1)(PS2)를 입력신호로 하여 펄스신호(PS11)(PS12)를 출력하는 D형 플립플롭(31)(32)으로 구성함을 특징으로 하는 동기회로.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019910001049A 1991-01-22 1991-01-22 동기회로 KR930008421B1 (ko)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
KR970076849A (ko) * 1996-05-16 1997-12-12 윌리엄 비. 켐플러 속도 검출기를 가진 집적 회로

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