KR880003604Y1 - 디지틀 방식을 이용한 설정주파수 대역 감지회로 - Google Patents

Abstract

내용 없음.

Description

디지틀 방식을 이용한 설정주파수 대역 감지회로

제1도는 본 고안을 도시하는 회로도.

제2도는 제1도의 입력주파수에 다른 각부 출력 파형도.

* 도면의 주요부분에 대한 부호의 설명

M₁-M₂: 단안정 멀티 바이브레이터 FF₁-FF₂: 플립플롭

N₁-N₂: 반전게이트 AG₁-AG₂: 앤드(AND)게이트

R₁-R₂: 저항 C_H-C_L: 캐패시터

VR_H-VR_L: 가변저항

본 고안은 설정수파수 대역 감지회로에 관한 것으로서, 입력주파수를 디지틀 논리로 선택하는 시스템의 주파수 대역 감지회로에 관한 것이다.

종래는 입력주파수를 그대로 받아 사용되기 때문에 회로에는 외부의 혼신 주파수와 회로에 원하지 않은 주파수가 목적 신호 주파수와 같이 입력되어 회로 오동작의 원인이 되는 문제점이 있었다.

본 고안의 목적은 디지틀 방식에 의한 정확한 주파수를 체크하여 오동작을 방지하여 이어지는 다음단의 회로의 동작을 순차적으로 처리할 수 있도록 함에 있다.

본 고안의 다른 목적은 처리속도를 향상시키며 회로를 단순화함에 있다.

본 고안은 입력주파수를 입력으로하는 두개의 단안정 멀티 바이브레이터와, 상기 단안정 멀티 바이브레이터에 접속된 서로 다른 시정수를 갖는 두개의 RC 결합회로와, 상기 단안정 펄티 바이브레이터의 출력을 데이타 신호로 받아 이 입력을 입력주파수 클럭에 따라 일정간격의 순차로 지연시켜 출력하는 D 플립플롭 회로와, 설정주파수 내일때만 다음 회로로 입력 주파수를 출력토록하며 설정 주파수내가 아닐때는 타회로도 출력하는 디지틀 선택 논리게이트등으로 구성된다.

이하 본 고안의 도면을 참조하여 상세히 설명한다.

제1도는 본 고안을 도시하는 회로도로서, 제1도중 MM₁-MM₂는 단안정 멀티 바이브레이터 FF₁-FF₂는 D 플립플롭, N₁-N₂는 반전게이트(Inverter), R₁-R₂는 저항, AG₁-AG₂는 앤드(AND)게이트, C_H, C_L는 캐패시터, VR_H, VR_L는 가변저항, f₁는 입력주파수 및 그 입력단, Vcc 는 전원, f₅는 설정 주파수 내일때의 출력신호 및 그 출력단이다.

본 고안의 실시예는 입력주파수(f₁)가 단안정 멀티 바이브레이터(MM₁-MM₂)에 A단으로 입력됨과 동시에 D 플립플롭(FF₁, FF₂)의 클럭 입력단(C)에 입력되고, 전원(Vcc)이 가변저항(VR_H, VR_L)과 캐패시터(C_H, C_L)에 공급되어 단안정 멀티 바이브레이터(MM₁, MM₂)의 시정수를 조정하도록하며 또한 저항(R₁, R₂)을 통해 반전게이트(N₁-N₂)를 지나 단안정 멀티 바이브레이트(MM₁, MM₂)의 리세트단자(CD)와 B단에 입력된다. 따라서 가변저항(VR_H, VR_L)과 캐패시터(C_H, C_L)에 의해 VR_H, C_H와 VR_L, C_L의 시정수에 따라 단안정 멀티 바이브레이터(MM₁-MM₂)의 출력 펄스폭이 정해지는데, 이때 단안정 멀티 바이브레이터(MM₁)의 출력 펄스폭은 입력주파수(f₁)의 검출을 원하는 최소폭으로 조정하고, 단안정 멀티 바이브레이터(MM₂)의 출력 펄스폭은 입력주파수(f₁)의 검출을 원하는 최대폭으로 조정한다.

또한 상기 단안정 멀티 바이브레이터(MM₁, MM₂)의 출력신호를 각각 D 플립플롭(FF₁, FF₂)으로 입력하고, 상기 D 플립플롭(FF₁, FF₂)의 출력단에 연결된 앤드게이트(AG₁)로 부터 입력주파수가 원하는 대역에 있는지를 판별하여 앤드게이트(AG₂)에 의해 상기 앤드게이트(AG₁)와 입력수파수신호(f₁)를 논리곱하여 최종출력을 얻도록 한다.

이하 첨부된 제2도를 참조하여 본 고안의 동작을 상세히 설명한다.

제2(a)도는 입력주파수(f₁)의 펄스폭이 검출을 원하는 최소폭보다 작을때, 즉 원하는 검출영역의 주파수보다 입력주파수(f₁)가 높을때의 제1도 주요부의 파형도이다.

제2(a)도의 a)와 같은 파형이 입력주파수(f₁)신호로서 입력되면 단안정 멀티 바이브레이더(MM₁)는 입력주파수(f₁)의 상승에너지에서 가변저항(VR_H)과 콘덴서(C_H)에 의해 결정되언 최소 펄스폭의 출력신호를 제2(a)도의 b)와 같이 출력하고, 단안정 멀티 바이브레이터(MM₂)도 마찬가지로 가변저항(VR_L)과 콘덴서(C_L)에 의해 결정되어진 최대펄스폭의 출력신호를 제2(a)도의 d)와 같이 출력한다.

상기한 제2(a)도의 b)와 d)신호를 각각 입력으로 하는 D 플립플롭(FF₁, FF₂)은 클럭신호로서 입력되는 입력주파수(f₁)신호의 하강예지에서 D입력단이 모두 하이레벨이므로 출력단 q로 하이레벨 신호를 제2(a)도의 c)와 e)와 같이 각각 출력한다.

이에따라 D 플립플롭(FF₁)의단자와 D 플립플롭(FF₂)의 q단자를 입력으로하는 앤드게이트(AG₁)는 로우레벨이 출력되고, 상기 앤드게이트(AG₁)와 입력주파수(f₁)신호를 입력으로 하는 앤드게이트(AG₂)는 로우레벨을 출력한다.

제2(b)도는 입력주파수(f₁)의 펄스폭이 검출을 원하는 영역내에 들어 있을때, 즉 원하는 검출영역의 주파수 영역내에 입력주파수(f₁)가 있을때의 파형도로서, 이때 입력주파수(f₁)의 펄스폭은 단안정멀티 바이브레이터(MM₁, MM₂)의 출력폭 사이에 있게된다.

따라서 제2(b)도의 a)와 같은 입력주파수(f₁)의 하강예지에서, 제2(b)도의 b)의d)에 도시된 바와같이 단안정 멀티 바이브레이터(MM₁)의 출력신호는 항상 로우레벨 갖게되고 단안정 멀티 바이브레이터(MM₂)의 출력신호는 항상 하이레벨을 갖게된다.

따라서 입력주파수(f₁)를 클럭 입력으로 하는 D 플립플롭(FF₁)의 q단자 출력신호는 로우레벨, 즉 플립플롭(FF₁)의단자 출력신호는 하이레벨로 되고, 마찬가지로 D 플립플롭(FF₂)의 q 단자 출력신호는 하이레벨이 된다.

이에 따라서 상기 두 하이레벨 신호를 입력으로 하는 앤드게이트(AG₁)는 하이레벨을 앤드게이트(AG₂)의 입력단으로 출력하게 되어 입력주파수(f₁)신로를 인에이블 시킨다.

따라서 앤드게이트(AG₂)의 출력신호는 향상 원하는 대역의 주파수신호만이 출력된다.

제3(c)도의 입력주파수(f₁)의 펄스폭이 검출을 원하는 최대폭 보다 클때, 즉 원하는 검출영역의 주파수보다 입력주파수(f₁)가 낮을때의 파형도이다.

이때의 입력주파수(f₁)의 펄스폭은 단안정 멀티 바이브레이터(FF₁, FF₂)의 출력 펄스폭보다 더 크므로 입력주파수(f₁)의 하강에지에서 단안정 멀티 바이브레이터(FF₁, FF₂)의 출력신호는 모두 로우레벨을 갖게된다.

따라서 D 플립플롭(FF₁, FF₂)의 q 단자출력신호는 모두 로우가 되어, 결국 앤드게이트(AG₁)의 출력신호는 로우레벨로 출력되고 이에 따라 앤드게이트(AG₂)의 출력신호도 로우레벨이 출력된다.

따라서 상기한 세가지 동작에 따라 본 고안회로는 설정주파수 대역을 정확히 감지하여 설정주파수내에 있는 입력신호만을 앤드게이트(AG₂)를 통하여 정확히 출력할 수 있으며, 앤드게이트(AG₁)의 출력신호(f₄)는 입력주파수가 설정영역 내에 들어 있지 않음을 나타내는 신호로 사용될 수 있다.

상기한 바와같은 본 고안 회로에 의하면 설정범위내의 주파수 입력을 정확히 검출할수 있고, 또한 가변저항의 조정에 의해 주파수 대역의 설정이 용이하며, 회로자체가 간단히 구성되는 이점과 더불어, 본 고안회로를 주요회로의 입력단에 보호용으로 사용하게 되면 설정된 주파수 범위내의 신호가 아니면 회로자체를 동작시키지 않으므로 혼신 주파수및 잡음주파수에 의해 회로가 오동작하는 것을 방지할 수 있다.

Claims (1)

1. 디지틀방식의 설정 주파수 대역 감지회로에 있어서, 입력주파수(f₁)를 트리거 입력신호로 하며 서로다른 시정수를 갖도록 조정이 가능한 단안정 멀티 바이브레이터(MM₁, MM₂)와, 상기 입력주파수(f₁)를 클럭입력으로 하여 상기 각 단안정 멀티 바이브레이터(MM₁, MM₂)의 출력신호를 지연시키는 D 플립플롭(FF₁, FF₂)과, 상기 D 플립플롭(FF₁)의단자 출력신호와 상기 D 플립플롭의 q 단자 출력신호를 입력으로 하는 앤드게이트(AG₁)와, 상기 앤드케이트(AG₁)와 입력주파수(f₁)를 입력으로 하는 앤드게이트(AG₂)를 포함하여 구성되는 것을 특징으로하는 디지틀 방식을 이용한 설정주파수 대역 감지회로.