KR860006877A - 고속의 아날로그 디지탈 변환기 - Google Patents

고속의 아날로그 디지탈 변환기 Download PDF

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KR860006877A
KR860006877A KR1019860000638A KR860000638A KR860006877A KR 860006877 A KR860006877 A KR 860006877A KR 1019860000638 A KR1019860000638 A KR 1019860000638A KR 860000638 A KR860000638 A KR 860000638A KR 860006877 A KR860006877 A KR 860006877A
Authority
KR
South Korea
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analog
digital converter
analog digital
comparator
clock control
Prior art date
Application number
KR1019860000638A
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English (en)
Inventor
쪼여 벨른하르트
Original Assignee
드로스트, 후흐스
지멘스 악티엔 게젤샤프트
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Publication date
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    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
    • H03M1/00—Analogue/digital conversion; Digital/analogue conversion
    • H03M1/12—Analogue/digital converters
    • H03M1/34—Analogue value compared with reference values
    • H03M1/36—Analogue value compared with reference values simultaneously only, i.e. parallel type
    • H03M1/361—Analogue value compared with reference values simultaneously only, i.e. parallel type having a separate comparator and reference value for each quantisation level, i.e. full flash converter type
    • H—ELECTRICITY
    • H03—ELECTRONIC CIRCUITRY
    • H03M—CODING; DECODING; CODE CONVERSION IN GENERAL
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    • H03M1/12—Analogue/digital converters

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  • Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Analogue/Digital Conversion (AREA)

Abstract

내용 없음

Description

고속의 아날로그 디지탈 변환기
본 내용은 요부공개 건이므로 전문내용을 수록하지 않았음
제1도는 아날로그 디지탈 변환기의 블럭 회로도.

Claims (7)

  1. 병렬 방식으로 동작하며 클럭 신호와 아날로그 신호를 수신하기 위한 클럭 제어 비교기를 포함하고, 상기 입력에서 수신된 클럭 신호와 아날로그 신호가 샘플링 순간에 기준 전압이 아날로그 전압에 가장 가까이에 있는 클럭 제어 비교기에 대해 그들의 지연시간의 실제적 평형을 가져오도록 나중 신호에 대한 입력에 대해 배열되어 있는 것을 특징으로 하는 아날로그 디지탈 변환기.
  2. 제1항에 있어서, 입력이 클럭 제어 비교기에 대해 중앙에 배열되어 있는 것을 특징으로 하는 아날로그 디지탈 변환기.
  3. 제1항 또는 제2항에 있어서, 개별적인 클럭제어 비교기에 대해 평형을 제공하도록 클럭 신호와 아날로그 신호를 전달하는 선상에 트랙 저항이 제공되어 있는 것을 특징으로 하는 아날로그 디지탈 변환기.
  4. 상기 항중 어느 한 항에 있어서, 적어도 샘플링 순간에 기준 전압이 아날로그 전압에 가장 가까이에 있는 비교기 블럭에 대해 클럭 신호와 아날로그 신호에 대한 실질적으로 동일한 지연 시간이 제공되도록 배열되어 있는 블럭을 형성하도록 클럭 제어 비교기가 결합되어 있는 것을 특징으로 하는 아날로그 디지탈 변환기.
  5. 제4항에 있어서, 클럭 신호와 아날로그 신호를 수신하기 위한 입력이 클럭 제어 비교기 블럭에 대해 중심에 모여있는 것을 특징으로 하는 아날로그 디지탈 비교기.
  6. 제4항 또는 제5항에 있어서, 개별적인 클럭 제어 비교기 블럭에 대해 평형을 제공하도록 클럭신호와 아날로그 신호를 전송하는 선에 트랙 저항이 제공되어 있는 것을 특징으로 하는 아날로그 디지탈 변환기.
  7. 첨부된 도면을 참조하여 여기에 기술된 실질적인 아날로그 디지탈 변환기.
    ※ 참고사항 : 최초출원 내용에 의하여 공개하는 것임.
KR1019860000638A 1985-02-12 1986-01-31 고속의 아날로그 디지탈 변환기 KR860006877A (ko)

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EP0191470A1 (de) 1986-08-20
US4857932A (en) 1989-08-15
JPS61187419A (ja) 1986-08-21

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