KR860001456B1 - 무선 선택호출 수신기 - Google Patents

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닛본 덴기 가부시기가이샤
세끼모또 타다히로
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Abstract

내용 없음.

Description

무선 선택호출 수신기
제 1 도는 본 발명에 의한 무선 선택호출 수신기의 블럭 계통도.
제 2 도는 본 발명에 의한 수신기에 수신되어질 호출 신호의 포오맷을 도시한 도면.
제 3 도는 제 1 도에 도시한 수신기의 디코더의 더욱 상세한 블럭 계통도.
제 4(a)도 내지 제4(h)도는 제 3 도에 도시한 디코더의 신호 수신동작을 설명하기 위한 파형 타임 차아트.
제5(i)도 내지 제5(n)도는 제 3 도에 도시한 디코더의 메시지 정보 독출동작과 메시지 정보 보호동작을 나타내는 파형 타임 차아트.
제 6 도는 제 3 도에 도시한 디코더의 메모리 보호 회로부의 변형예를 도시한 블럭 계통도.
제 7 도는 제 6 도에 도시한 메모리 보호 회로부의 동작을 설명하기 위한 타임 차아트.
제 8 도는 제 1 도에 도시한 수신기의 디코더의 다른 실시예를 도시한 기능적인 블럭 계통도.
제 9 도는 제 8 도에 도시한 디코더 내의 데이타 메모리의 일부를 개념적으로 도시한 블럭 계통도.
제10도 및 제11도는 제 8 도에 도시한 디코더의 호출신호 수신동작과 메모리 보호 동작을 각각 도시한 플로우 차트.
* 도면의 주요부분에 대한 부호의 설명
1 : 안테나 2 : RF.IF회로
3 : 변별기기 4 : 디코더
5 : 표시 구동회로 6 : 표시장치
7 : 삭피커 구동회로 8 : 확성기
401,405 : D형 플립플롭회로 406,412 : 전이 레지스터
413 : 클럭 펄스 발생기 414,415 : 타이머
416,423 : 인버터 424,437 : AND게이트
438,443 : 게이트 444 : 카운터
445,448 : 저항기 501 : 제어기
502 : 프로그램 메모리 503 : 프로그램 카운터
504 : 데이타 메모리 505 : 카운터
506 : 산술논리연산장치 507 , 509 : 입력포오트
508 , 510 : 출력포오트 511 : LCD제어기/구동기
512 : 데이타버스 513 : P-ROM
본 발명은 무선선택 호출시에 사용하기 위한 무선 선택호출 수신기에 관한 것이다.
근래에 괄목한 만한 회로 집적기술의 발달로 적은 전력의 소모와 다기능의 더욱 콤팩트한 무선 페이징 수신기가 개발되었다. 이러한 다기능의 증가추세로 선택호출 또는 페이징 신호(각각의 가입자에게 지정된 특정한 번호)만을 송신하는 종래의 서어비스 시스템에 메시지 신호를 부가시키는 기능이 등장하게 되었다. 더우기 요구 스펙트럼의 확장과 통신의 신뢰도를 증진시키기 위해서, 이러한 페이징 및 메시지 신호들은 현재 디지탈화 되어 있다.
한편, 메세지 신호를 표시하는 것은 페이징 신호를 수신한 후에 메시지를 수신한 것을 나타내기 위한 기능을 할 때 달성된다. 수신기 내에는 다수의 메시지 신호 메모리 회로가 포함되어 있는데, 그이유는 가입자가 매우 빈번히 선택 호출되거나 수신된 모든 메시지 신호에 즉각 응답할 수 없기 때문이다. 이 메모리 회로 내에 저장된 메시지 신호는 다양한 방법에 의해 독출될 수 있다. 예를 들어, n개의 메모리 회로가 있는 경우에는 가입자가 바람직한 메시지 신호가 저장된 특정한 메모리 회로에 대응하는 스위치를 한 동작으로 작동시킬 수 있게 하기 위해 n개의 독출 스위치가 제공될 수 있다. 선택적으로, 가입자가 바람직한 메시지 신호를 독출하도록 최대로 n번 작동시키게 되는 1개의 독출 스위치가 있을 수도 있다.
모든 메세지 신호를 수신하고 이 수신된 메세지 신호들을 저장하는 것을 나타내는 기능을 갖고 있는 무선선택호출 수신기는 이 수신기의 소유자가 장기간 동안 다수의 작동을 할 수 있게하기 때문에 매우 편리하다.
그러나, 메모리 회로의 수가 개별소자나 소프트웨어에 의해 제한되므로, 따라서 메모리 회로보다 더 많은 메시지 신호가 수신되는 경우에는, 조기신호들이 도착된 순서로 소거된다. 그러므로, 다수의 기억 신호들중한 신호가 중요한 정보를 포함하고 장기간동안 저장되어야 하는 경우에도, 여분 메시지들이 도착할 때 무차별로 소거된다.
통상적으로, 수신된 메시지 신호들의 대부분은 즉각 응답되므로 곧 소거되며, 노후 메시지들을 저장하는 것은 후속 처리를 불필요하게 복잡하게 된다. 바람직한 메모리 회로가 호출하는 만큼 여러번 독출스위치가 작동해야 하는 상술한 설정에 의하여, 예를 들어, 스위칭 동작의 필요한 횟수가 대응하게 증가하게 되거나, 스위치의 수가 대응하게 커지게 된다. 더우기, 메모리 회로의 수가 커진다는 것은 가격이 그만큼 높아진다는 것을 의미한다.
그러므로, 본 발명의 목적은 종래의 수신기의 상술한 단점은 제거시키고, 스위치의 동작을 간단하게 하며 메모리 용량에 관계없이, 중요한 메시지만이 필요한 만큼 저장될 수 있게 하고 메모리 회로가 오버플로우(overflow)될 때 중요하지 않은 메시지가 순차적으로 소거되게 함으로써 메모리 회로의 수를 감소시킨 경제적인 무선 선택호출 수신기를 제공하는 것이다.
본 발명에 따르면, 복조된 페이징 신호 및 메시지 신호들을 제공하기 위하여 페이징 및 메시지 신호들로 변조된 반송파를 복조시키기 위한 장치, 검출 신호를 제공하기 위해 무선 페이징 수신기에 할당된 페이징 신호를 복조된 페이징 신호들로부터 검출하기 위한 장치, 경보신호를 발생시키기 위해 검출 신호에 응답하는 장치, 다수의 복조된 메시지 신호들을 저장하기 위한 제 1 메모리 장치, 소거되는 것을 방지하고 제 1 메모리 장치에 저장된 메시지 신호들 중 최소한 1개의 신호를 저장하기 위한 제 2 메모리 장치, 제 1 및 제 2 메모리 장치에 저장된 메시지 신호들 중 최소한 1개의 신호를 표시하니 위한 표시장치, 및 제 1 및 제 2 메모리 장치에 저장된 메시지 신호들 중 최소한 1개의 신호를 표시 장치에 선택적으로 제공하기 위해 제 1 및 제 2 메모리 장치와 표시 장치에 접속된 표시제어 장치로 구성된 무선 페이징 수신기가 제공된다. 이제부터 첨부 도면을 참조하여 본 발명의 그외의 다른 목적, 특징 및 장점에 대해서 상술하게 기술하였다.
제 1 도를 참조하면, 안테나(1)에 의해 수신된 무선반송파는 고주파-중간주파(RF-IF)회로(2)에 의해 각각 증폭되고 주파수 변환후에 변별기(3)에 의해 복조된다. 복조된 신호는 디코더(4)에 의해서 이 신호가 수신기에 지정된 페이징 신호인지 아닌지를 판결받게되며, 만약 페이징 신호라면, 하나의 출력 펄스가 스피커 주동회로(7)로 보내져, 그 수신기의 소유자가 확성기(8)에서 울리는 소리로 페이징 신호가 수신되었음을 알게 한다. 동시에 후속되는 메시지 정보를 디코더(4)내의 하나의 메모리에 저장된다. 이때에 메모리 독출스위치(10)에 폐쇄되면, 저장된 메시지중의 하나가 표시구동회로(5)를 통해서 표시장치(6)으로 공급된다.
디코더(4)내의 메모리에 저장된 메시지가 메모리가 오버플로우될 때 메시지의 엔트리 순서에 따라 소거되는 동안, 어떤 특정한 메시지는 다음에 더욱 상세히 기술하는 바와 같이 메모리 보호스위치(11) 또는 스위치(10)을 작동시킴으로써 소거되지 않고 보호될 수 있다. 이에 의해 보호된 메시지는 전원스위치(12)가 오프되거나 또다른 메시지가 다시 스위치(10 또는 11)을 작동시킴으로써 보호되지 않는한 전혀 소거되지 않게 된다. 표시선택 스위치(9)는 저장메시지만의 표시 또는 보호된 메시지의 표시 사이를 선택하게 한다.
제 1 도의 실시예에 적용된 수신신호의 구성을 나타내는 포오맷을 도시한 제 2 도를 참조하면, 부분X는 각각의 수신기에 할당된 선택 호출신호로서, 예를 들어 순환코드의 일종인 BCH(31, 21)코드로 구성되고, 부분 Y는 메시지 정보를 이송하기 위한 메시지 신호로서, 선택호출 신호와 같이 BCH(31, 21)코드로 구성된다.
제 3 도는 참조하면, 디코더(4)는 지연형(D형) 플립플롭(401∼405), 전이 레지스터(406∼412), 클럭펄스발생기(413), 타이머(414 및 415), 인버터(416∼423), AND게이트(424∼437), OR게이트(438∼443), 카운터(444) 및 저항기(445∼448)로 구성된다. 다른 전이 레지스터로부터 전이 레지스터(409∼412)를 구별하기 위해서 전이 레지스터(409)를 이제부터 MR-1이라하고, (410)은 MR-2, (411)은 MR-n, (412)는 MR-p라고 하겠다.
다음, 제 3 도에 도시한 디코더의 동작에 대해서 제 4 도와 제 5 도를 참조하여 상세히 설명하겠다. D형 플립플롭(401)은 클럭발생기(413)의 출력으로부터 유도되는 인버터(416)의 반전 출력(제4(b)도)와 변별기(3, 제 1 도)에 의해 복조된 호출신호를 동기시키고, 전이 레지스터(406)으로 동기신호를 공급한다.
결과적으로 복조 신호가 인버터(417, 418 및 419)에 의해 예정된 패턴(선택호출신호)와 동일한 것을 알게되면, 동일신호(제4(c)도)가 AND게이트(424)로부터 발생되어 스피커 구동회로(7)에 공급된다.
동시에, 플립플롬(402)는 AND게이트(425 및 426)을 통해 레지스터(408)내에 선택호출신호 직후의 인입메시지를 기입하기 위해 필요한 시간 T1의 기간을 갖는 타이머(414)를 구동시키도록 반전된다. AND게이트(426)의 다른 입력에는 클럭펄스발생기(413)으로부터 클럭펄스가 공급된다.
메시지가 전이 레지스터(408)내에 완전히 저장된 후에, 전이 레지스터(MR-n-1)의 내용은 타이머(414)로 부터의 리세트신호(제4(e)도)에 응답하는 전이 레지스터(407)의 출력에 응답하여 전이 레지스터(411, MR-n)내에 기입된다. 이와 마찬가지로, 전이 레지레지스터(409, MR-1)의 내용은 전이 레지스터(408)내에 저장된 메시지가 전이 레지스터(409, MR-1)내에 기입될 때까지 레지스터(410, MR-2)내에 기입된다(제4(e)도, 제4(f)도, 제4(g)도 및 제4(h)도 참조). 그러므로, n개의 수신 메시지들이 최대로 저장될 수 있으며 n개 이상이 수신되면, 조기 메시지들이 도착순서로 소거된다.
다음에 수신기의 소유자가 저장된 메시지들 중의 한 메시지를 독출할 수 있는 방법에 대해 기술하겠다. 표시 선택 스위치(9)를 N측으로 회전시키고, 소유자가 메모리 독출스위치(10)을 누르면 제5(i)도에 도시한 신호 I가 선정된 표시가간 T2(예를 들어, 8초)를 할당하도록 인버터(421) 및 플립플롭(403)을 통해 타이머(415)를 구동시킨다. 기간 T2동안, 제5(j)도에 도시한 신호 J는 표시 장치(6, 예를들어, 액정장치)에 메시지를 표시하도록 표시구동회로(5)로 공급된다.
만일 메모리 독출스위치(10)이 단 한번만 늘려지면, 카운터(444)는 카운팅을 시작하도록 인버터(421)을 통해 작동되고, 제5(k)도에 도시한 신호 K는 이 카운터의 Q1단자로부터 공급되며, AND게이트(427∼428)은 개방된다. 그 결과, 전이 레지스터(409, MR-1)의 내용은 OR게이트(438∼439), AND레이트(433∼434) 및 OR게이트(440∼441)을 통해 표시장치(6)에 표시된다. 표시선택 스위치(9)가 N측으로 회전되기 때문에, 인버터(422)는 AND게이트(433∼434)를 개방시키도록 고레벨 신호를 제공한다. 표시가간 T2 동안 메모리 독출 스위치(10)이 다시 한번 늘려지면, 카운터(444)는 카운트 2로 되고, 출력 L은 단자 Q2에서 나오게 되며, AND게이트(429∼430)은 MR-2의 내용을 표시하도록 개방된다. 타이머(415)가 OR게이트(443)을 통하여 리세트될 때, 기간 T2는 갱신된다(제5(j)도). 그리고, D형 플립플롭(403) 및 인버터(421)의 출력들은 메모리 독출스위치(10)이 계속 반복해서 늘려지더라도 표시구동 회로(5)가 계속 작동하도록 OR게이트(442)를 통하여 표시구동회로(5)에 공급된다.
이와 마찬가지로, 메모리 독출스위치(10)이 n번 늘려지면, AND게이트들(431∼432)는 MR-n의 내용을 표시하도록 개방된다. 그러므로, 독출스위치(10)이 n+1번 늘려지면, 카운터(444)는 MR-1의 내용을 표시하도록 카운트 1로 복귀된다. 그러므로, 메모리 독출스위치(10)이 n번 늘려질 때, 전이 레지스터(MR-1∼MR-n)내에 저장된 메시지들이 순차적으로 독출된다. 표시기간 T2가 지나면, 표시구동회로(5)는 정지되고 카운터(444)는 타이머(415)로부터의 리세트 신호에 의해 리세트된다. 그러므로 다음번에 메모리 독출스위치(10)이 늘려지면, MR-1로부터 다시 표시가 시작된다.
이제 특정메시지가 소거되지 않고 보호되는 과정에 대해 기술하겠다. 우선, 보호될 메시지가 소정 메시지를 간단히 판독하기 위한 상술한 과정과 동일한 방법에 의해 표시장치(6)에 표시되고, 메모리 보호스위치(11)이 늘려진다. 이때까지, 보호될 메시지는 OR-게이트(438∼439)로부터 메시지 보호 전이 레지스터(412, MR-p)의 입력으로 미리 공급된다. 메모리 보호스위치(11)을 누를 때, 기입 펄스가 인버터(420) 및 D형 플립플롭(404와 405)에 의해 발생되어, AND게이트(437)을 통하여 전이 레지스터(412, MR-p)에 공급된다. 이러한 방식으로, 표시된 메시지는 소거되지 않고 보호하기 위해 전이 레지스터(412, MR-p)내에 저장된다.
표시 선택스위치(9)가 P측으로 회전되면, AND게이트(435∼436)이 인버터(423)의 출력으로 개방되므로, 전이 레지스터(412, MR-p)내에 저장된 메시지는 OR게이트(440∼441)을 통하여 표시구동회로(5)로 공급된다. 이때, 메모리 독출스위치(10)이 늘리게 되면, 전이 레지스터(MR-p)로 부터의 메시지가 표시장치(6)에 표시된다. 이 과정동안, 전이 레지스터(MR-1∼MR-n)내에 저장된 메시지들은 인버터(422)의 출력이 공급되는 AND게이트(433∼434)가 폐쇄되는 것에 의해 표시구동회로(5)로 오지 못하게 된다. MR-p이 내용이 표시장치(6)에 표시될 때 또는 전혀 표시되지 않을 때, 메모리보호 메카니즘은 메모리 보호 스위치(11)이 늘려지더라도 기능을 하지 못하게 된다. 이것은 AND게이트(437)에 의해 행해진다. 저항기(445∼448)은 인버터(420∼423)의 입력들이 개방될 때 고레벨을 안전하게 하기 위한 플-업(pull-up) 저항기이다. 상술한 바와 같이, 전이 레지스터(MR-p)에 저항된 메시지는 무한정 여기에 남을 수 있고, 다른 메시지가 MR-p로 전이되거나 전원이 차단되지 않는 한 요구대로 표시될 수도 있다.
제 1 도 및 제 3 도에 도시한 실시예는 3개의 스위치, 즉, 메모리 독출스위치(10), 메모리 보호스위치(11) 및 표시선택 스위치(9)를 갖고 있지만, 예를 들어, 메모리 독출스위치(10)을 n+1번 누름으로써 보호된 메시지를 독출하도록 재배열된다면, 표시 선택스위치(9)가 생략될 수 있다. 또한, 타이머를 적당히 사용하면, 메모리 보호스위치(11)도 생략될 수 있다. 이러한 타이머의 변형예는 다음에 기술하겠다.
제 6 도는 도시한 회로에서는 스위치(11)을 생략하기 위해 타이머(449)가 제공된다. 이 회로의 기능에 대해서 제 7 도를 참조하여 기술하겠다. 메모리 독출스위치(10)이 눌러질 때 타이머(449)는 카운팅을 시작한다. 스위치(10)이 T3(예를 들면, 제7(i)도 내의 t1와 t2사이)보다 오래 눌러질 때, 타이머(449)는 고레벨 신호를 공급한다. 이 고레벨 신호에 응답하여 D형 플림플롭(404 및 405)는 표시장치(6)에 표시되는 메시지를 전이 레지스터(412, MR-p)내에 기입하기 위하여 기입펄스0(제70도)를 발생시킨다. 그러므로, 표시된 메시지는 타이머(449)에 의해 정해진 T3기간보다 더 오랜 기간동안 메모리 독출스위치(10)을 누름으로써 보호된다. 확성기(8, 제 1 도)이 기입펄스 0의 발생시에 짧은 소리를 발생시키기 위해 구동되도록 배열되어 있으면, 수신기의 소유자가 바람직한 메시지가 적당히 보호된다는 것을 확인하게 되어 매우 편리하게 된다.
제 8 도를 참조하면, LCD제어기/구동기를 갖고 있는 디코더(4')는 본 발명의 양수인인 닛본 덴기 가부시기가이샤에서 제조하여 시판하는 마이크로 프로세서 μPD 7502와 같은 단일칩 중앙처리장치(CPU)를 사용할 수 있다. 제어기(501)은 실행될 명령코드를 디코드하고, 디코드된 명령을 실행하기 위해 다른 블럭들을 제어한다. 프로그램 메모리(502)내에는 실행될 명령 그룹이 저장된다. 프로그램 카운터(503)은 프로그램 메모리(502)내에 기입된 프로그램을 어드레싱하도록 지정되어 있다. 데이타 메모리(404)는 메시지 등을 일시적으로 저장하기 위해 제공된다. 디코더(4')에 의해 요구된 클럭펄스들은 외부클럭들을 수신하는 카운터(505)에 의해 발생된다.
산술 및 논리연산 장치(ALU, 506)은 산술연산을 실행하고, 그 결과는 누산기(513)내에 저장된다. 누산기는 또한 메모리, 입출력포오트 및 레지스터들 사이에 데이타 교환을 하기 위해 사용된다.
입력포오트(507)은 변별기(3)으로부터 구형파 신호를 수신하고 메모리 독출스위치(10)으로부터 독출신호를 수신하도록 되어 있다.
출력포오트(508)은 프로그램 가능한 해독전용 메모리(p-ROM)의 내용을 독출하기 위한 어드레스 신호를 공급하는데, 이 P-ROM 메모리 내에는 수신기에 할당된 선택호출 신호가 저장된다. P-ROM (513)의 독출신호는 다른 입력포오트(509)를 통하여 디코더(4)내에 오게 된다. 경보음 신호는 출력포오트(510)을 통하여 스피커 구동회로(7)에 공급된다. LCD제어기/구동기(511)은 데이타 메모리(504)로부터 표시된 데이타를 공급하는 것에 응답하여 LCD(6)상에 데이타를 표시한다.
제 9 도를 참조하면, 데이타 메모리(504)의 일부는 4개의 메시지 메모리(MDATA1∼MDTA4), 메시지 메모리들 중의 하나 또는 다른 것들을 지정하기 위한 메모리 어드레스(MAD1∼MAD4), 보호플랙(flag) PF 및 판독카운터 RC를 포함한다. 메모리 어드레스 MAD1의 내용이, 예를 들어, "1"이라면, 메시지 메모리 MDATA1이 어드레스 된다.
제 8 도에 도시한 CPU의 상세한 설명은 1980년 5월 23일에 낫본 덴기 가부시기가이샤에서 발행한 사용자편람 μPD 7502에 기술되어 있다.
다음에 제10도 및 제11도의 플로우 차아트를 참조하여 디코더(4')의 호출신호 수신동작 및 메모리 보호 동작에 대해 설명하겠다. 다음 설명에서는, 플로우차아트의 수텝(step)번호들이 대응구, 절 또는 문장들 뒤에 각각 괄호로 표시된다. 우선 제10도를 참조하면, 전원 공급기가 턴-은 될 때(801), 각각의 메모리의 내용은 초기적으로 세트된다(802), "4"가 메모리 어드레스 MAD1로 들어가고, MAD2로는 "3", MAD3으로는 "2", 그리고 MAD4로는 "1"이 들어가며, 메시지 메모리 MDATA1∼4 보호플랙 PF 및 판독 카운터 RC 모두가 클리어 된다.
선택호출 신호가 수신된 (803) 후에는, 메시지가 수신되고(804), 동시에 경보음이 발생되며 표시가 시작된다(805), 그다음, 메모리 어드레스 MAD1이 보호되는 지의 여부가 검사되어(806), 보호되지 않는다면, 메모리 어드레스 MAD1∼4는 메모리 어드레스 MAD1에 의해 어드레스된 메시지 메모리 MDATAX(X=1, 2, 3 또는 4)가 수신된 메시지를 저장하게 하기 위해(803) 각각 하나씩 진행된다(807). 메모리 어드레스 MAD1이 보호된다면, 메모리 어드레스 MAD2∼4는 메모리 어드레스 MAD2에 의해 어드레스된 메시지 메모리 MDATAX가 수신된 메시지를 저장하게 하고 메모리 어드레스 MAD1이 보호받도록 하기 위해(810) 각각하나씩 진행된다(809). 타이머가 동작을 마친(811) 후 경보음 및 표시는 자동적으로 중지된다(812).
한편, 제11도를 참조하면, 수신기가 대기모우드(waiting mode)일 때(901), 메모리 독출스위치(10, 제 1 도)이 늘려있는지의 여부가 계속 검사되어(902), 늘려 있으면, 메모리 보호동작 또는 독출동작중의 한 동작이 시작된다. 먼저, 판독 카운터 RC는 "1"로 써트되고(903), RC의 카운트는 X레지스터로 공급되며(904), 메모리 어드레스 MAD X에 의해 어드레스된 메시지 메모리 MDATA Y(Y=1, 2, 3 또는 4)의 내용이 표시된다(904). 동시에, 표시타이머와 보호타이머가 시동되고(각각 905 및 906), 그후, 독출스위치(10)이 해제되는지의 여부가 검사된다(907).
보호 타이머의 시간(T3)이 경과될때까지 독출스위치가 계속 늘려져 있으면(908), 메모리 어드레스 MAD1에 의해 어드레스된 메시지 메모리 MDATA X가 현재 표시되는 데이타를 저장시키게 하고 각각 하나씩 3개의 다른 지정 메시지들을 전이시키게 하기 위해 메모리 보호동작이 시작된다. 그러므로, 메모리 어드레스 MAD3의 메시지가 보호되면, 이 MAD3의 어드레스가 메모리 어드레스 MAD3으로 전이되고, 메모리 어드레스 MAD1의 내용은 메모리 어드레스 MAD2로, 메모리 어드레스 MAD2의 내용은 메모리 어드레스 MAD3으로 전이된다. 그 다음, 보호 플랙 PF는 메모리 어드레스 MAD1내에 세트되고(910), 표시된 폐시지는 보호되는 것을 나타내기 위해 턴-온 및 오프된다(911), 독출스위치(10)이 해제될 때, 표시는 소거되고, 수신기는 초기 대기 모우드로 복귀한다(각각 912 및 917).
독출스위치(10)이 보호타이머에 의해 규정된 기간 T3내에 해제되면, 투틴(routine) 독출동작으로 하게 된다. 즉, 표시타이머의 시간이 경과될 때까지 표시가 계속되는가(913), 또는 독출스위치가 다시 늘려지면(914), 판독카운터(RC)가 1만큼 상향카운트되고(915) 페시지 페모리들의 내용들이 판독카운터가 4이상으로 카운트될때까지 계속 독출된다(916). 이 배열에서는, 보흐목적으로 위해 특정 페모리가 제공되질 않았지만 페모리 어드레스 MAD1에 의해 어드레스된 1개 페모리가 종종 보통 페모리로 사용되고 때로는 보호페모리로 사용된다. 이 경우에는, 페시지 자체가 전이되는 이전의 경우와는 달리, 어드레스(MAD1∼4)만이 전이되고 MAD1에 의해 어드레스된 페모리가 최후 페모리 또는 보호 페모리로 된다.
상술한 설명으로부터 명백히 알 수 있는 바와 같이, 본 발명은 무선호출 수신기가 실패없이 중요한 페시지들을 저장할 수 있게 하고 필요시에 이 페시지들을 독출할 수 있게 한다. 그러므로, 본 발명은 수신기의 신뢰도 및 경제성에 상당한 기여를 할 수 있다.

Claims (10)

  1. 복조된 페이징 신호 및 페시지 신호들을 제공하기 위하여 페이징 및 페시지 신호들로 변조된 반송파를 수신하여 복조하기 위한 장치(1-3), 검출 신호를 제공하기 위해 무선페이징 수신기에 할당된 페이징 신호를 복조된 페이징 신호들로부터 검출하기 위한 장치(4), 경보신호를 발생시키기 위해 검출 신호에 응답하는 장치(7, 8), 다수의 복조된 페시지 신호들을 저장하기 위한 제 1 페모리 장치(408-411), 소거되는 것을 방지하고 제 1 페모리 장치내에 저장된 페시지 신호들중 최소한 1개의 신호를 저장하기 위한 제 2 페모리 장치(412), 제 1 및 제 2 페모리 장치에 저장된 페시지 신호들중 최소한 1개의 신호를 표시하기 위한 표시장치(5, 6), 및 제 1 및 제 2 페모리 장치에 저장된 페시지 신호들중 최소한 1개의 신호를 표시장치에 선택적으로 제공하기 위해 제 1 및 제 2 페모리 장치와 표시 장치에 연결된 표시 제어장치(9-11, 403-405, 415, 5, 420-423, 427-448 또는 9, 10, 403-405, 415, 421-423, 427-444, 446-449)로 구성된 것을 특징으로 하는 무선 선택호출 수신기.
  2. 제 1 항에 있어서, 표시제어 장치가, 제 1 독출신호를 발생시키기 위한 제 1 스위칭 장치(10), 선정된 기간동안 타이머 신호를 발생시키기 위해 제 1 독출신호에 응답하는 타이머 장치(415), 기입 신호를 발생시키기 위한 제 2 스윗칭 장치(11), 제 1 페모리 장치(409-411)에 저장된 내용들 중 최소한 1개의 내용을 저장하기 위해 제 1 독출 또는 타이머 신호와 기입 신호에 응답하는 제 2 페모리 장치(412)내에 포함된 페모리 회로 제 2 독출 신호를 발생시키기 위한 제 3 스윗칭 장치(9), 제 1 페모리 장치(409-411)에 저장된 페시지 신호들중 최소한 1개의 신호를 표시장치에 제공하기 위해 제 1 독출 신호에 응답하는 장치(447, 427-441), 및 제2페모리 장치(412)에 저장된 페시지 신호를 표시장치에 제공하기 위해 제 1 및 제 2 독출신호에 응답하는 장치(437, 435-436, 440-441)로 구성된 것을 특징으로 하는 무선 선택호출 수신기.
  3. 제 1 항에 있어서, 표시 제어장치가, 제 1 및 제 2 독출신호들을 발생시키기 위한 제 1 스윗칭 장치(10), 제 1 의 선정된 기간동안 제 1 타이머 신호를 발생시키기 위해 제 1 독출신호에 응답하는 제 1 타이머 장치(415), 제 2 의 선정된 기간동안 제 2 타이머 신호를 발생시키기 위해 제 1 독출신호에 응답하는 제 2 타이머 장치(449), 제 1 페모리 장치(409-411)에 저장된 내용들중 최소한 1개의 내용을 제 2 페모리 장치(412)에 저장하기 위해 제 1 독출 또는 제 1 타이머 신호와 제 2 타이머 신호에 응답하는 페모리 회로 장치, 제 1 페모리 장치(409-411)에 저장된 페시지 신호들중 최소한 1개의 신호를 표시장치에 제공하기 위해 제 1 독출신호에 응답하는 장치(444, 427-441), 및 제 2 페모리 장치(412)에 저장된 페시지 신호를 표시장치에 제공하기 위해 제 2 독출신호에 응답하는 장치(437, 435-436, 440-441)로 구성된 것을 특징으로 하는 무선 선택호출 수신기.
  4. 제 1 항에 있어서, 검출장치, 제 1 및 제 2 페모리 장치 및 표시제어 장치가 1개의 단일-칩 마이크로프로세서(4')내에 형성된 것을 특징으로 하는 무선 선택호출 수신기.
  5. 페시지 신호들을 수신하여 복조하기 위한 수신장치(1-4), 다수의 복조된 페시지들을 저장하기 위한 제 1 페모리장치(408-411) 및 이 제 1 페모리(408-411)내에 저장된 페시지들을 표시하기 위한 표시장치(5, 6)으로 구성되고, 제 1 페모리가 다수의 페시지들을 각각 저장하고 다른 페모리 위치가 충만상태로 있을 때 저장될 다른 페시지를 수신할 때에 다른 페시지용의 저장실을 형성하기 위해 페모리 위치들 중 최소한 1개의 위치로부터 페시지를 자동적으로 소거하기 위한 다수의 페모리 위치(408-411)을 포함하고, 수신기가 얼마나 많은 페시지들이 제 1 페모리내에 저장하도록 수신되는지에 관계없이 저장된 페시지들 중 최소한 1개의 페시지가 계속 저장되게 하기 위한 모호장치(412)를 포함하는 것을 특징으로 하는 무선 선택호출 수신기.
  6. 제 5 항에 있어서, 보호장치가 보호된 페시지를 저장하기 위해서 다수의 페모리 위치(408-411) 이외에 다른 페모리 위치(412)를 포함하는 것을 특징으로 하는 무선 선택호출 수신기.
  7. 제 6 항에 있어서, 보호장치가 저장용의 다른 페모리 위치(412)에 다수의 저장 페시지중 한 페시지를 선택적으로 제공하기 위한 선택장치(11, 445, 420, 404, 405, 437)을 포함하는 것을 특징으로 하는 무선 페이징 수신기.
  8. 제 6 항에 있어서, 다수의 페모리 위치들(408-411) 중 한 위치로부터의 다수의 페시지들 중 한 페시지 또는 다른 페모리 위치(412)로 부터의 보호 페시지를 표시 장치(5, 6)에 선택적으로 제공하기 위한 표시 선택장치(9, 10, 403, 415, 421-423, 427-444, 446-448)을 포함하는 것을 특징으로 하는 무선 선택호출 수신기.
  9. 제 8 항에 있어서, 표시 선택장치가 다수의 페모리 어드레스를 선택적으로 발생시키기 위한 어드레스발생 장치(9, 10, 403, 415, 421-423, 437, 442-444, 446-448)을 포함하고, 페모리 어드레스들 중 최소한 한 어드레스가 다른 페모리 위치(412)에 대응하고 나머지 페모리 어드레스들이 다수의 페머리 위치(408-411)에 각각 대응하는 것을 특징으로 하는 무선 선택호출 수신기.
  10. 제 8 항에 있어서, 표시 선택장치가 다수의 페모리 위치(408-411)에 각각 대응하는 다수의 어드레스를 발생시키기 위한 어드레스 장치(10, 446, 421, 444), 지정된 페모리 위치에 저장된 페시지를 출력으로서 제공하기 위해 발생된 어드레스에 응답하는 장치(427-439), 제 1 엔에이블링 신호에 응답하여 표시 장치(5, 6)에 출력을 제공하기 위한 장치(433-434), 제 2 엔이블링 신호에 응답하여 표시 장치(5, 6) 에 다른 페모리 위치(412)의 내용들을 제공하기 위한 장치(435-436), 및 비-중첩 엔에이블링 신호를 선택적으로 발생시키기 위한 장치(9)로 구성된 것을 특징으로 하는 무선 선택호출 수신기.
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