KR20240001795A - 표시 패널 및 이를 구비한 전자 기기 - Google Patents

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KR20240001795A
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Abstract

본 발명은 제1 표시영역 및 제1 표시영역 내측의 제2 표시영역을 포함하는 기판, 제1 표시영역 및 제2 표시영역에 배치되는 복수의 발광다이오드들, 복수의 발광 다이오드들과 각각 전기적으로 연결되는 복수의 부화소회로들을 포함하고, 제2 표시영역은, 복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들; 및 복수의 부화소회로영역들 각각을 적어도 부분적으로 둘러싸는 복수의 투과영역들을 포함하고, 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들은 제1 이격영역을 사이에 두고 제1 방향을 따라 서로 이격되되, 제1 이격영역은 상기 복수의 투과영역들 중 어느 하나의 투과영역을 포함하는 표시 패널을 개시한다.

Description

표시 패널 및 이를 구비한 전자 기기{Display panel and electric apparatus}
본 발명은 표시 패널 및 이를 구비한 전지 기기에 관한 구조를 제공한다.
표시 패널은 데이터를 시각적으로 표시하는 장치이다. 근래에 표시 패널의 용도가 다양해지고 있다. 표시 패널의 두께가 얇아지고 무게가 가벼워 그 사용의 범위가 광범위해지고 있는 추세이다.
표시영역이 차지하는 면적을 확대하면서 동시에 다양한 기능을 추가하기 위한 방안으로서, 표시영역 내측에 이미지 디스플레이 이외의 기능을 부가하기 위한 표시 패널의 연구가 계속되고 있다.
다양한 기능을 부가하기 위해 카메라나 센서와 같은 컴포넌트를 배치할 수 있다. 보다 넓은 면적의 표시영역을 확보하면서 컴포넌트를 배치하기 위하여 컴포넌트를 표시영역과 중첩하여 배치할 수 있다. 컴포넌트를 배치하는 하나의 방법으로, 표시 패널이 빛이나 음향과 같은 파장이 투과할 수 있는 투과영역을 포함할 수 있다. 본 발명은 전술한 구조를 갖는 표시 패널 및 이를 포함하는 전자 기기를 개시한다.
본 발명의 일 실시예는, 제1 표시영역 및 상기 제1 표시영역 내측의 제2 표시영역을 포함하는 기판; 상기 제1 표시영역 및 상기 제2 표시영역에 배치되는 복수의 발광다이오드들; 상기 복수의 발광 다이오드들과 각각 전기적으로 연결되는 복수의 부화소회로들을 포함하고, 상기 제2 표시영역은, 복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들; 및 상기 복수의 부화소회로영역들 각각을 적어도 부분적으로 둘러싸는 복수의 투과영역들을 포함하고, 상기 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들은 제1 이격영역을 사이에 두고 제1 방향을 따라 서로 이격되되, 상기 제1 이격영역은 상기 복수의 투과영역들 중 어느 하나의 투과영역을 포함하는, 표시 패널을 개시한다.
상기 인접한 두 개의 부화소회로영역들 중 하나는 제1 색의 빛을 방출하는 제1 발광다이오드에 전기적으로 연결되고, 상기 인접한 두 개의 부화소회로영역들 중 다른 하나는 제1 색과 다른 제2색의 빛을 방출하는 제2 발광다이오드에 전기적으로 연결될 수 있다.
상기 제1 및 제2 발광 다이오드들은 상기 인접한 두 개의 부화소회로영역들 각각에 위치하는 부화소회로와 중첩할 수 있다.
상기 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들 각각에 포함된 부화소회로는 상기 제1 방향을 따라 연장된 신호선에 전기적으로 연결되되, 상기 신호선은 상기 이격영역을 가로지르도록 연장될 수 있다.
상기 복수의 부화소회로들은 데이터선 및 스캔선에 전기적으로 연결되며, 상기 신호선은 상기 데이터선 또는 스캔선을 포함할 수 있다.
상기 이격영역을 가로지르는 상기 신호선의 제1 부분은 투명 도전성 물질을 포함할 수 있다.
상기 신호선은, 상기 인접한 두 개의 부화소회로영역 중 적어도 하나의 부화소회로영역에 배치되고 금속성 물질을 포함하는 제2부분을 더 포함하고, 상기 신호선의 상기 제1 부분과 상기 제2 부분은 상기 제1 부분과 상기 제2 부분 사이에 개재된 적어도 하나의 절연층의 컨택홀을 통해 전기적으로 연결될 수 있다.
상기 제1 표시영역은, 복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들을 포함하되, 상기 복수의 부화소회로영역들 중 인접한 부화소회로영역들은 제2 이격영역을 사이에 두고 서로 이격되어 있을 수 있다.
평면 상에서 상기 제1 이격영역의 형상 및 상기 제2 이격영역의 형상은 서로 동일할 수 있다.
동일 면적 당, 상기 제2 표시영역에서 상기 제1이격영역이 차지하는 비율은 상기 제1 표시영역에서 상기 제2 이격영역이 차지하는 비율과 동일할 수 있다.
상기 투과영역의 상부에 위치하며 상기 투과영역에 중첩하고, 투광성의 유기 절연물을 포함할 수 있다.
동일 면적당, 상기 제1 표시영역에 배치된 발광다이오드들의 개수와 상기 제2 표시영역에 배치된 발광다이오드들의 개수는 동일할 수 있다.
상기 투과영역의 상부에 위치하며 상기 투과영역에 중첩하고, 투광성의 유기 절연물을 포함할 수 있다.
동일 면적당, 상기 제1 표시영역에 배치된 발광다이오드들의 개수와 상기 제2 표시영역에 배치된 발광다이오드들의 개수는 동일할 수 있다.
본 발명의 다른 실시예는, 제1 표시영역 및 제2 표시영역에 배치된 복수의 발광다이오드들을 포함하는 표시 패널; 및 상기 제2 표시영역과 중첩하게 배치되는 컴포넌트;를 포함하며, 상기 표시 패널은, 제1 표시영역 및 상기 제1 표시영역 내측의 제2 표시영역을 포함하는 기판; 상기 제1 표시영역 및 상기 제2 표시영역에 배치되는 복수의 발광다이오드들; 상기 복수의 발광 다이오드들과 각각 전기적으로 연결되는 복수의 부화소회로들을 포함하고, 상기 제2 표시영역은, 복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들; 및 상기 복수의 부화소회로영역들 각각을 적어도 부분적으로 둘러싸는 복수의 투과영역들을 포함하고, 상기 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들은 제1 이격영역 을 사이에 두고 제1 방향을 따라 서로 이격되되, 상기 제1 이격영역은 상기 복수의 투과영역들 중 어느 하나의 투과영역을 포함하는, 전자 기기를 개시한다.
상기 컴포넌트는 센서 또는 카메라를 포함할 수 있다.
상기 인접한 두 개의 부화소회로영역들 중 하나는 제1 색의 빛을 방출하는 제1 발광다이오드에 전기적으로 연결되고, 상기 인접한 두 개의 부화소회로영역들 중 다른 하나는 제1 색과 다른 제2색의 빛을 방출하는 제2 발광다이오드에 전기적으로 연결될 수 있다.
상기 제1 및 제2 발광 다이오드들은 상기 인접한 두 개의 부화소회로영역들 각각에 위치하는 부화소회로와 중첩할 수 있다.
상기 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들 각각에 포함된 부화소회로는 상기 제1 방향을 따라 연장된 신호선에 전기적으로 연결되되, 상기 신호선은 상기 이격영역을 가로지르도록 연장될 수 있다.
상기 이격영역을 가로지르는 상기 신호선의 제1 부분은 투명 도전성 물질을 포함할 수 있다.
상기 신호선은, 상기 인접한 두 개의 부화소회로영역 중 적어도 하나의 부화소회로영역에 배치되고 금속성 물질을 포함하는 제2부분을 더 포함하고, 상기 신호선의 상기 제1 부분과 상기 제2 부분은 상기 제1 부분과 상기 제2 부분 사이에 개재된 적어도 하나의 절연층의 컨택홀을 통해 전기적으로 연결될 수 있다.
상기 제1 표시영역은, 복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들을 포함하되, 상기 복수의 부화소회로영역들 중 인접한 부화소회로영역들은 제2 이격영역을 사이에 두고 서로 이격되어 있을 수 있다.
평면 상에서 상기 제1 이격영역의 형상 및 상기 제2 이격영역의 형상은 서로 동일할 수 있다.
동일 면적 당, 상기 제2 표시영역에서 상기 제1이격영역이 차지하는 비율은 상기 제1 표시영역에서 상기 제2 이격영역이 차지하는 비율과 동일할 수 있다.
본 발명의 실시예들은, 고품질의 이미지를 제공할 수 있는 표시 패널을 제공할 수 있으며, 투과영역을 포함하는 제2 표시영역의 투과율을 충분히 확보할 수 있고, 제1 표시영역 및 제2 표시영역 간의 화질의 편차를 방지할 수 있다. 이러한 효과는 예시적인 것으로, 전술한 효과에 의해 본 발명의 범위가 한정되는 것은 아니다.
도 1은 본 발명의 일 실시예에 따른 표시 패널을 포함하는 전자 기기를 나타낸 사시도이다.
도 2는 본 발명의 일 실시예에 따른 전자 기기의 일부를 나타낸 단면도이다.
도 3a 내지 도 3h는 본 발명의 실시예들에 따른 표시 패널을 개략적으로 나타낸 평면도이다.
도 4는 본 발명의 일 실시예에 따른 표시 패널의 어느 하나의 부화소에 해당하는 발광다이오드 및 발광다이오드에 전기적으로 연결된 부화소회로를 나타낸 회로도이다.
도 5는 본 발명의 일 실시예에 따른 표시 패널의 어느 하나의 부화소회로를 나타낸 평면도이다.
도 6은 본 발명의 일 실시예에 따른 표시 패널의 제1 표시영역 및 제2 표시영역에 배열된 부화소들을 나타낸 평면도이다.
도 7은 본 발명의 일 실시예에 따른 표시 패널을 개략적으로 나타낸 평면도이다.
도 8a 및 도 8b는 도 7의 A를 확대한 평면도이다.
도 9는 도 8b에 도시된 부화소회로 및 전술한 부화소회로에 연결된 발광다이오드를 나타낸 단면도이다.
도 10은 본 발명의 다른 실시예에 따른 표시 패널을 개략적으로 나타낸 평면도이다.
도 11은 본 발명의 또 다른 실시예에 따른 표시 패널을 개략적으로 나타낸 평면도이다.
도 12는 본 발명의 도 11에 도시된 부화소회로 및 전술한 부화소회로에 연결된 발광다이오드를 나타낸 단면도이다.
본 발명은 다양한 변환을 가할 수 있고 여러 가지 실시예를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 상세한 설명에 상세하게 설명하고자 한다. 본 발명의 효과 및 특징, 그리고 그것들을 달성하는 방법은 도면과 함께 상세하게 후술되어 있는 실시예들을 참조하면 명확해질 것이다. 그러나 본 발명은 이하에서 개시되는 실시예들에 한정되는 것이 아니라 다양한 형태로 구현될 수 있다.
이하, 첨부된 도면을 참조하여 본 발명의 실시예들을 상세히 설명하기로 하며, 도면을 참조하여 설명할 때 동일하거나 대응하는 구성 요소는 동일한 도면부호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.
이하의 실시예에서, 제1, 제2 등의 용어는 한정적인 의미가 아니라 하나의 구성 요소를 다른 구성 요소와 구별하는 목적으로 사용되었다.
이하의 실시예에서, 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다.
이하의 실시예에서, 포함하다 또는 가지다 등의 용어는 명세서상에 기재된 특징, 또는 구성요소가 존재함을 의미하는 것이고, 하나 이상의 다른 특징들 또는 구성요소가 부가될 가능성을 미리 배제하는 것은 아니다.
이하의 실시예에서, 막, 영역, 구성 요소 등의 부분이 다른 부분 위에 또는 상에 있다고 할 때, 다른 부분의 바로 위에 있는 경우뿐만 아니라, 그 중간에 다른 막, 영역, 구성 요소 등이 개재되어 있는 경우도 포함한다.
도면에서는 설명의 편의를 위하여 구성 요소들이 그 크기가 과장 또는 축소될 수 있다. 예컨대, 도면에서 나타난 각 구성의 크기 및 두께는 설명의 편의를 위해 임의로 나타내었으므로, 본 발명이 반드시 도시된 바에 한정되지 않는다.
어떤 실시예가 달리 구현 가능한 경우에 특정한 공정 순서는 설명되는 순서와 다르게 수행될 수도 있다. 예를 들어, 연속하여 설명되는 두 공정이 실질적으로 동시에 수행될 수도 있고, 설명되는 순서와 반대의 순서로 진행될 수 있다.
본 명세서에서 “A 및/또는 B”은 A이거나, B이거나, A와 B인 경우를 나타낸다. 그리고, “A 또는 B 중 적어도 하나”는 A이거나, B이거나, A와 B인 경우를 나타낸다.
이하의 실시예에서, 막, 영역, 구성 요소 등이 연결되었다고 할 때, 막, 영역, 구성 요소들이 직접적으로 연결된 경우, 또는/및 막, 영역, 구성요소들 중간에 다른 막, 영역, 구성 요소들이 개재되어 간접적으로 연결된 경우도 포함한다. 예컨대, 본 명세서에서 막, 영역, 구성 요소 등이 전기적으로 연결되었다고 할 때, 막, 영역, 구성 요소 등이 직접 전기적으로 연결된 경우, 및/또는 그 중간에 다른 막, 영역, 구성 요소 등이 개재되어 간접적으로 전기적 연결된 경우를 나타낸다.
x축, y축 및 z축은 직교 좌표계 상의 세 축으로 한정되지 않고, 이를 포함하는 넓은 의미로 해석될 수 있다. 예를 들어, x축, y축 및 z축은 서로 직교할 수도 있지만, 서로 직교하지 않는 서로 다른 방향을 지칭할 수도 있다.
도 1은 본 발명의 일 실시예에 따른 표시 패널을 포함하는 전자 기기를 나타낸 사시도이다.
일 실시예에 따른 전자 기기(1)는 동영상이나 정지영상을 표시하는 장치로서, 모바일 폰(mobile phone), 스마트 폰(smart phone), 태블릿 PC(tablet personal computer), 이동 통신 단말기, 전자 수첩, 전자 책, PMP(portable multimedia player), 내비게이션, UMPC(Ultra Mobile PC) 등과 같은 휴대용 전자 기기뿐만 아니라, 텔레비전, 노트북, 모니터, 광고판, 사물 인터넷(internet of things, IOT) 등의 다양한 제품의 표시 화면으로 사용될 수 있다. 또한, 일 실시예에 따른 전자 기기(1)는 스마트 워치(smart watch), 워치 폰(watch phone), 안경형 디스플레이, 및 헤드 장착형 디스플레이(head mounted display, HMD)와 같이 웨어러블 장치(wearable device)에 사용될 수 있다. 또한, 일 실시예에 따른 전자 기기(1)는 자동차의 계기판, 및 자동차의 센터페시아(center fascia) 또는 대쉬보드에 배치된 CID(Center Information Display), 자동차의 사이드 미러를 대신하는 룸 미러 디스플레이(room mirror display), 자동차의 뒷좌석용 엔터테인먼트로, 앞좌석의 배면에 배치되는 디스플레이로 사용될 수 있다. 도 1은 설명의 편의를 위하여 전자 기기(1)가 스마트 폰으로 사용되는 것을 도시한다.
도 1을 참조하면, 전자 기기(1)는 표시영역(DA) 및 표시영역(DA)에 외측의 비표시영역(NDA)을 포함할 수 있다. 전자 기기(1)는 표시영역(DA)에 이차원적으로 배열된 복수의 부화소들의 어레이를 통해 이미지를 제공할 수 있다.
비표시영역(NDA)은 이미지를 제공하지 않는 영역으로서, 표시영역(DA)을 전체적으로 둘러쌀 수 있다. 비표시영역(NDA)에는 표시영역(DA)에 배치된 부화소들에 전기적 신호나 전원을 제공하기 위한 드라이버 등이 배치될 수 있다. 비표시영역(NDA)에는 전자소자나 인쇄회로기판 등이 전기적으로 연결될 수 있는 영역인 패드가 배치될 수 있다.
표시영역(DA)은 제1 표시영역(DA1) 및 제2 표시영역(DA2)을 포함할 수 있다. 제2 표시영역(DA2)은 전자 기기(1)에 다양한 기능을 부가하기 위한 컴포넌트가 배치되는 영역으로, 제2 표시영역(DA2)은 컴포넌트 영역에 해당할 수 있다.
도 2는 본 발명의 일 실시예에 따른 전자 기기의 일부를 나타낸 단면도이다.
도 2를 참조하면, 전자 기기(1)는 표시 패널(10) 및 표시 패널(10)과 중첩하게 배치된 컴포넌트(20)를 포함할 수 있다. 컴포넌트(20)는 제2 표시영역(DA2)에 배치될 수 있다.
표시 패널(10)은 기판(100), 기판(100) 상에 배치된 표시층(200), 표시층(200) 상의 봉지층(300), 입력감지층(400), 반사방지층(600), 및 윈도우(700)를 포함할 수 있다.
기판(100)은 글래스 또는 고분자 수지를 포함할 수 있다. 예컨대, 기판(100)은 고분자 수지는 폴리에테르술폰, 폴리아크릴레이트, 폴리에테르 이미드, 폴리에틸렌 나프탈레이트, 폴리에틸렌 테레프탈레이드, 폴리페닐렌 설파이드, 폴리아릴레이트, 폴리이미드, 폴리카보네이트 또는 셀룰로오스 아세테이트 프로피오네이트 등을 포함할 수 있다. 고분자 수지를 포함하는 기판(100)은 플렉서블, 롤러블 또는 벤더블 특성을 가질 수 있다. 기판(100)은 전술한 고분자 수지를 포함하는 층 및 무기층(미도시)을 포함하는 다층 구조일 수 있다.
기판(100)의 전면(前面) 상에는 표시층(200)이 배치되고, 기판(100)의 배면(背面) 상에는 하부보호필름(175)이 배치될 수 있다. 하부보호필름(175)은 기판(100)의 배면에 부착될 수 있다. 하부보호필름(175)과 기판(100) 사이에는 점착층이 개재될 수 있다. 또는, 하부보호필름(175)은 기판(100)의 배면 상에 직접 형성될 수 있으며, 이 경우 하부보호필름(175)과 기판(100) 사이에는 점착층이 개재되지 않는다.
하부보호필름(175)은 기판(100)을 지지하고 보호하는 역할을 할 수 있다. 하부보호필름(175)은 제2 표시영역(DA2)에 대응하는 개구(175OP)를 구비할 수 있다. 하부보호필름(175)은 폴리에틸렌 테레프탈레이드(PET, polyethyeleneterephthalate) 및/또는 폴리이미드(PI, polyimide)와 같은 유기절연물을 포함할 수 있다.
표시층(200)은 복수의 부화소들을 포함할 수 있다. 각 부화소는 표시요소를 포함하며, 적색, 녹색, 또는 청색의 빛을 방출할 수 있다. 표시요소는 발광다이오드(LED)를 포함할 수 있다. 일실시예로, 발광다이오드(LED)는 유기 발광층을 포함하는 유기발광다이오드를 포함할 수 있다. 다른 실시예로, 발광다이오드(LED)는 무기물을 포함하는 무기 발광다이오드일 수 있다. 무기발광다이오드는 무기물 반도체 기반의 재료들을 포함하는 PN 접합 다이오드를 포함할 수 있다. PN 접합 다이오드에 순방향으로 전압을 인가하면 정공과 전자가 주입되고, 그 정공과 전자의 재결합으로 생기는 에너지를 빛 에너지로 변환시켜 소정의 색상의 빛을 방출할 수 있다. 전술한 무기발광다이오드는 수~수백 마이크로미터의 폭을 가질 수 있다. 일부 실시예에서, 발광다이오드(LED)는 양자점 발광다이오드를 포함할 수 있다. 발광다이오드(LED)의 발광층은 유기물을 포함하거나, 무기물을 포함하거나, 양자점을 포함하거나, 유기물과 양자점을 포함하거나, 무기물과 양자점을 포함할 수 있다.
발광다이오드(LED)는 그 아래에 배치된 트랜지스터(TFT)에 전기적으로 연결될 수 있다. 이와 관련하여, 도 2는 기판(100) 상에 버퍼층(111)이 배치되고, 버퍼층(111) 상에 트랜지스터(TFT)가 배치되며, 트랜지스터(TFT)를 덮는 절연층(IL)의 콘택홀을 통해 발광다이오드(LED)와 트랜지스터(TFT)가 전기적으로 연결된 것을 도시한다.
트랜지스터(TFT) 및 트랜지스터(TFT)에 전기적으로 연결된 발광다이오드(LED)는 제1 표시영역(DA1) 및 제2 표시영역(DA2)에 각각 배치될 수 있다. 이때, 트랜지스터(TFT) 및 발광다이오드(LED)가 배치되는 영역을 부화소회로영역(PCA)으로 지칭할 수 있다. 편의상, 제1 표시영역(DA1)에 배치되는 부화소회로영역(PCA)은 제1 부화소회로영역(PCA1), 제2 표시영역(DA2)에 배치되는 부화소회로영역(PCA)은 제2 부화소회로영역(PCA2)이라 한다. 제1 표시영역(DA1) 및 제2 표시영역(DA2)은 인접한 부화소회로영역들 사이의 이격영역(IVA)을 포함할 수 있다. 예컨대, 제1 표시영역(DA1)은 인접한 제1 부화소회로영역(PCA1)들 사이에 위치하는 제2 이격영역(IVA2)을 포함할 수 있고, 제2 표시영역(DA2)은 인접한 제2 부화소회로영역(PCA2)들 사이에 위치하는 제1 이격영역(IVA1)을 포함할 수 있다. 제2 표시영역(DA2)의 이격영역(IVA)은 제1 이격영역(IVA1)으로 지칭될 수 있고, 제1 표시영역(DA1)의 이격영역(IVA)은 제2 이격영역(IVA2)으로 지칭될 수 있다. 제1 이격영역(IVA1) 및 제2 이격영역(IVA2)은 각각 트랜지스터(TFT)들이 배치되지 않는 영역이다. 일부 실시예에서, 제1 및 제2 이격영역(IVA1, IVA2)에는 발광다이오드가 배치되지 않을 수 있다. 예컨대, 제1 이격영역(IVA1) 및 제2 이격영역(IVA2) 각각은, 인접한 부화소회로영역들 사이의 공간, 및/또는 인접한 발광다이오드(또는 발광영역)들 사이의 공간에 해당할 수 있다. 제2 표시영역(DA2)의 제1 이격영역(IVA1)은 투과영역(TA)을 포함할 수 있다.
제2 표시영역(DA2)은 투과영역(TA)을 포함할 수 있다. 투과영역(TA)은 제1 이격영역(IVA1)의 적어도 일부에 해당할 수 있다. 바꾸어 말하면, 제2 표시영역(DA2)의 제1 이격영역(IVA1)은 투과영역(TA)을 포함할 수 있다. 투과영역(TA)은 컴포넌트(20)에서 방출되는 빛 및/또는 컴포넌트(20)로 향하는 빛이 투과할 수 있는 영역이다. 표시 패널에서, 투과영역(TA)의 투과율은 약 20% 이상이거나, 약 30%이상이거나, 약 40%이상이거나, 약 50% 이상이거나, 약 60% 이상이거나, 약 70% 이상이거나, 약 75% 이상이거나, 약 80% 이상이거나, 약 85% 이상이거나, 약 90% 이상일 수 있다. 표시층(200)은 봉지부재로 밀봉될 수 있다. 일부 실시예에서, 봉지부재는 도 2에 도시된 바와 같이 봉지층(300)을 포함할 수 있다. 봉지층(300)은 적어도 하나의 무기봉지층 및 적어도 하나의 유기봉지층을 포함할 수 있다. 일 실시예로, 봉지층(300)은 제1 및 제2 무기봉지층(310, 330) 및 이들 사이의 유기봉지층(320)을 포함할 수 있다. 다른 실시예로, 봉지부재는 글래스를 포함하는 봉지기판일 수 있다.
입력감지층(400)은 봉지층(300) 상에 형성될 수 있다. 입력감지층(400)은 외부의 입력, 예컨대 손가락 또는 스타일러스펜와 같은 물체의 터치 이벤트에 따른 좌표정보를 획득할 수 있다. 입력감지층(400)은 터치전극 및 터치전극과 연결된 트레이스 라인들을 포함할 수 있다. 입력감지층(400)은 뮤추얼 캡 방식 또는 셀프 캡 방식으로 외부 입력을 감지할 수 있다.
반사방지층(600)은 도 2에 도시된 바와 같이 봉지층(300) 상에 형성될 수 있다. 반사방지층(600)은 외부에서 표시 패널를 향해 입사하는 빛(외부광)의 반사율을 감소시킬 수 있다. 반사방지층(600)은 차광부와 컬러필터들을 포함하는 필터 플레이트를 포함할 수 있다. 필터 플레이트는 각 부화소마다 배치된 컬러필터들, 차광부, 및 오버코트층을 포함할 수 있다.
윈도우(700)는 반사방지층(600) 상에 배치되며, 광학 투명 점착제(OCA)와 같은 점착층을 통해 반사방지층(600)과 결합될 수 있다. 윈도우(700)는 글래스재 또는 플라스틱재를 포함할 수 있다. 플라스틱재는 폴리에테르술폰, 폴리아크릴레이트, 폴리에테르 이미드, 폴리에틸렌 나프탈레이트, 폴리에틸렌 테레프탈레이드, 폴리페닐렌 설파이드, 폴리아릴레이트, 폴리이미드, 폴리카보네이트 또는 셀룰로오스 아세테이트 프로피오네이트 등을 포함할 수 있다.
컴포넌트(20)는 표시영역(DA) 중 제2 표시영역(DA2)에 중첩할 수 있다. 컴포넌트(20)는 근접 센서, 조도 센서, 홍채 센서, 안면 인식 센서, 및 카메라(또는 이미지 센서)를 포함할 수 있다. 컴포넌트(20)는 빛을 이용할 수 있다. 예컨대, 컴포넌트(20)는 적외선, 자외선, 가시광선 대역의 빛을 방출하거나 및/또는 수광할 수 있다. 적외선을 이용하는 근접 센서는 전자 기기(1)의 상면에 근접하게 배치된 물체를 검출할 수 있으며, 조도 센서는 전자 기기(1)의 상면으로 입사되는 광의 밝기를 감지할 수 있다. 또한, 홍채 센서는 전자 기기(1)의 상면 상에 배치된 사람의 홍채를 촬영할 수 있으며, 카메라는 전자 기기(1)의 상면 상에 배치된 물체에 관한 빛을 수광할 있다. 표시 패널(10)의 제2 표시영역(DA2)과 중첩하여 배치되는 컴포넌트(20)는 근접 센서, 조도 센서, 홍채 센서, 안면 인식 센서, 및 이미지 센서 등에 한정되지 않으며, 다양한 센서가 배치될 수 있다.
도 3a 내지 도 3h는 본 발명의 실시예들에 따른 표시 패널을 개략적으로 나타낸 평면도이다.
도 3a 내지 도 3h는 제1 및 제2 표시영역(DA10, DA2)의 다양한 배치를 나타낸다. 표시영역(DA)은 비표시영역(NDA)에 의해 전체적으로 둘러싸일 수 있다. 비표시영역(NDA)에는 패드부가 배치되며, 도 3a에 도시된 바와 같이 표시 회로 보드(30)는 비표시영역(NDA)의 연성 필름(34)을 통해 비표시영역(NDA)의 패드부에 전기적으로 연결될 수 있다. 표시 회로 보드(30)는 구부러질 수 있는 연성 인쇄 회로 보드(flexible printed circuit board, FPCB), 단단하여 잘 구부러지지 않는 강성 인쇄 회로 보드(rigid printed circuit board, PCB), 또는 강성 인쇄 회로 보드와 연성 인쇄 회로 보드를 모두 포함하는 복합 인쇄 회로 보드일 수 있다.
표시영역(DA)은 제1 표시영역(DA1) 및 제2 표시영역(DA2)을 포함할 수 있다. 제2 표시영역(DA2)은 앞서 설명한 바와 같이 컴포넌트(20)가 배치되는 일종의 컴포넌트 영역일 수 있다.
도 3a 내지 도 3e를 참조하면, 제2 표시영역(DA2)은 제1 표시영역(DA1)의 내측에 배치되며, 제1 표시영역(DA1)에 의해 전체적으로 둘러싸일 수 있다. 제2 표시영역(DA2)은 평면 상에서 원형의 형상을 가질 수 있다. 또는, 제2 표시영역(DA2)은 타원형, 사각형과 같은 다각형의 형상을 가질 수 있다.
제2 표시영역(DA2)은 다양한 위치에 배치될 수 있다. 제2 표시영역(DA2)은 도 3a에 도시된 바와 같이 평면도 상에서 표시영역(DA)의 상측의 가운데에 배치될 수 있다. 제2 표시영역(DA2)은 도 3b에 도시된 바와 같이 평면도 상에서 표시영역(DA)의 우상측에 배치될 수 있다. 또는, 제2 표시영역(DA2)은 도 3c에 도시된 바와 같이 평면도 상에서 표시영역(DA)의 중심부분에 배치될 수 있으며, 이 경우 제2 표시영역(DA2)에 대응하여 배치된 컴포넌트가 카메라를 포함하는 경우 셀프 촬영 및 화상 통화를 하는 사용자의 시선이 자연스러울 수 있다.
본 명세서의 평면도 상에서 "좌", "우", "상", "하"는 표시 패널(10)의 수직한 방향에서 전자 기기(1)를 바라보았을 때의 방향을 가리킨다. 예를 들어, "좌"는 -x 방향, "우"는 +x 방향, "상"은 +y 방향, "하"는 -y 방향을 가리킨다. 도 3a에서는 제2 표시영역(DA2)이 하나 배치된 것을 도시하나, 다른 실시예로서 제2 표시영역(DA2)은 복수개 구비될 수 있다.
제2 표시영역(DA2)은 도 3d 및 도 3e에 도시된 바와 같이 인접하게 배치된 두 개 또는 그 이상의 서브표시영역들을 포함할 수 있으며, 일 실시예로 도 3d 및 도 3e는 제1 서브표시영역(DA2-1) 및 제2 서브표시영역(DA2-2)을 도시한다. 제1 서브표시영역(DA2-1) 및 제2 서브표시영역(DA2-2)은 도 3d 및 도 3e에 도시된 바와 같이 x방향을 따라 서로 인접하게 배치되거나, y방향을 따라 서로 인접하게 배치될 수 있다. 제1 서브표시영역(DA2-1) 및 제2 서브표시영역(DA2-2)은 도 3d에 도시된 바와 같이 동일한 크기를 가지거나, 도 3e에 도시된 바와 같이 서로 다른 크기를 가질 수 있다.
제2 표시영역(DA2)은 도 3f 내지 도 3h에 도시된 바와 같이 제1 표시영역(DA1)의 일측에 배치되며, 제1 표시영역(DA1)에 의해 부분적으로 둘러싸여 제2 표시영역(DA2)의 일 측은 비표시영역(NDA)에 인접할 수 있다.
제2 표시영역(DA2)은 도 3f 및 도 3g에 도시된 바와 같이 표시영역(DA)의 일측에서 중앙를 향해 오목한 노치 타입일 수 있다. 노치 형상은 사각형, 반원형, 반타원형 등 다양하게 구비될 수 있다. 제2 표시영역(DA2)은 도 3h에 도시된 바와 같이 x방향을 따라 연장된 바 타입일 수 있다.
도 4는 본 발명의 일 실시예에 따른 표시 패널의 어느 하나의 부화소에 해당하는 발광다이오드 및 발광다이오드에 전기적으로 연결된 부화소회로를 나타낸 회로도이다.
도 4를 참조하면, 부화소회로(PC)는 발광다이오드(LED)에 전기적으로 연결된다. 부화소회로(PC)는 복수의 트랜지스터들 및 스토리지 커패시터(storage capacitor)를 포함할 수 있으며, 트랜지스터들 및 스토리지 커패시터는 도전성 라인들에 전기적으로 연결될 수 있다. 도전성 라인들은 신호라인(SWL, SIL, EL, DL), 초기화전압라인(VIL), 및 구동전압라인(PL)을 포함할 수 있다.
도 4는 각 부화소회로(PC)가 신호라인(SWL, SIL, EL, DL), 초기화전압라인(VIL), 및 구동전압라인(PL)에 연결된 것을 도시하고 있으나, 본 발명은 이에 한정되지 않는다. 또 다른 실시예로서, 신호라인(SWL, SIL, EL, DL) 중 적어도 어느 하나, 초기화전압라인(VIL)과 구동전압라인(PL) 등은 이웃하는 부화소회로(PC)들에서 공유될 수 있다.
일 실시예로, 도 4는 부화소회로(PC)가 구동 트랜지스터(driving TFT, T1), 스위칭 트랜지스터(switching TFT, T2), 보상 트랜지스터(T3), 제1초기화 트랜지스터(T4), 동작제어 트랜지스터(T5), 발광제어 트랜지스터(T6) 및 제2초기화 트랜지스터(T7)를 포함하는 것을 도시한다.
신호라인은 스캔신호(GW)를 전달하는 제1 스캔라인(SWL), 제1초기화 트랜지스터(T4)와 제2초기화 트랜지스터(T7)에 이전 스캔신호(SI)를 전달하는 제2 스캔라인(SIL), 동작제어 트랜지스터(T5) 및 발광제어 트랜지스터(T6)에 발광제어신호(EM)를 전달하는 발광제어라인(EL), 제1 스캔라인(SWL)과 교차하며 데이터신호(Dm)를 전달하는 데이터라인(DL)을 포함한다. 구동전압라인(PL)은 구동 트랜지스터(T1)에 구동전압(ELVDD)을 전달하며, 초기화전압라인(VIL)은 구동 트랜지스터(T1) 및 발광다이오드의 제1전극(예컨대, 애노드)을 초기화하는 초기화전압(Vint)을 전달한다.
스토리지 커패시터(Cst)는 구동 트랜지스터(T1)의 게이트전극에 연결된 제1전극(CE1) 및 제2전극(CE2)을 포함한다. 제2전극(CE2)은 구동전압라인(PL)에 연결되어 있으며, 발광다이오드(LED)의 제2전극은 공통전압(ELVSS)에 연결되어 있다. 이에 따라, 발광다이오드(LED)는 구동 트랜지스터(T1)로부터 구동전류(ILED)를 전달받아 발광함으로써 빛을 방출할 수 있다.
도 4에서는 보상 트랜지스터(T3)와 제1초기화 트랜지스터(T4)가 듀얼 게이트전극을 갖는 것으로 도시하고 있으나, 보상 트랜지스터(T3)와 제1초기화 트랜지스터(T4)는 한 개의 게이트전극을 가질 수 있다.
도 4는 부화소회로(PC)가 7개의 트랜지스터와 1개의 스토리지 커패시터를 포함하는 것을 설명하였으나, 본 발명은 이에 한정되지 않는다. 트랜지스터 및 스토리지 커패시터의 개수는 부화소회로(PC)의 디자인에 따라 6개 이하이거나 8개 이상인 것과 같이 다양하게 변경될 수 있다.
도 4에서는 제1초기화 트랜지스터(T4)와 제2초기화 트랜지스터(T7)가 제2 스캔라인(SIL)에 연결된 경우를 도시하였으나, 본 발명은 이에 한정되지 않는다. 또 다른 실시예로서, 제1초기화 트랜지스터(T4)는 제2 스캔라인(SIL)에 연결되어 이전 스캔신호(GI)에 따라 구동하고, 제2초기화 트랜지스터(T7)는 해당하는 부화소회로(PC)의 이전 행 또는 이후 행에 배치된 부화소회로(PC)의 제1스캔라인 또는 제2스캔라인에 연결될 수 있다.
도 5는 본 발명의 일 실시예에 따른 표시 패널의 어느 하나의 부화소회로를 나타낸 평면도이다. 도 5의 부화소회로는 표시 패널의 제1표시영역, 및 제2표시영역 각각에 배치되는 부화소회로로서, 각 부화소회로가 배치된 영역(또는 각 부화소회로가 차지하는 면적)을 부화소회로영역(PCA)이라 한다.
일 실시예로, 각 부화소회로는 도 5에 도시된 바와 같이 구동 트랜지스터(T1), 스위칭 트랜지스터(T2), 보상 트랜지스터(T3), 제1초기화 트랜지스터(T4), 동작제어 트랜지스터(T5), 발광제어 트랜지스터(T6) 및 제2초기화 트랜지스터(T7)를 포함할 수 있다.
구동 트랜지스터(T1), 스위칭 트랜지스터(T2), 보상 트랜지스터(T3), 제1초기화 트랜지스터(T4), 동작제어 트랜지스터(T5), 발광제어 트랜지스터(T6) 및 제2초기화 트랜지스터(T7)는, 부화소회로영역(PCA)에서 반도체층(1130)을 따라 배치될 수 있다.
반도체층(1130)의 일 부분들은, 구동 트랜지스터(T1), 스위칭 트랜지스터(T2), 보상 트랜지스터(T3), 제1초기화 트랜지스터(T4), 동작제어 트랜지스터(T5), 발광제어 트랜지스터(T6) 및 제2초기화 트랜지스터(T7) 각각의 반도체층에 해당한다. 바꾸어 말하면, 구동 트랜지스터(T1), 스위칭 트랜지스터(T2), 보상 트랜지스터(T3), 제1초기화 트랜지스터(T4), 동작제어 트랜지스터(T5), 발광제어 트랜지스터(T6) 및 제2초기화 트랜지스터(T7)의 반도체층들은 서로 연결되며 다양한 형상으로 굴곡질 수 있다.
도 5는 반도체층(1130)을 따라 구동 트랜지스터(T1), 스위칭 트랜지스터(T2), 보상 트랜지스터(T3), 제1초기화 트랜지스터(T4), 동작제어 트랜지스터(T5), 발광제어 트랜지스터(T6) 및 제2초기화 트랜지스터(T7)가 형성된 것을 도시하나, 본 발명은 이에 한정되지 않는다. 다른 실시예로, 일부 트랜지스터는 반도체층(1130)을 따라 형성될 수 있으나, 나머지 트랜지스터는 반도체층(1130)과 공간적으로 그리고 전기적으로 분리된 다른 반도체층을 따라 형성될 수 있다. 예컨대, 보상 트랜지스터(T3) 및/또는 제1초기화 트랜지스터(T4)는 도 5에 도시된 반도체층(1130)과 다른 물질을 포함하는 반도체층을 따라 형성될 수 있다. 일부 실시예로서, 반도체층(1130)이 실리콘계 반도체물질을 포함하는 경우, 보상 트랜지스터(T3) 및/또는 제1초기화 트랜지스터(T4)가 형성된 반도체층은 산화물계 반도체물질을 포함할 수 있다.
반도체층(1130)은 채널영역 및 채널영역 양측의 소스영역 및 드레인영역을 포함하는데, 소스영역 및 드레인영역은 해당하는 트랜지스터의 소스전극 및 드레인전극으로 이해될 수 있다. 이하는 편의상, 소스영역 및 드레인영역을 각각 소스전극 및 드레인전극으로 부른다.
구동 트랜지스터(T1)는 구동 채널영역에 중첩하는 구동 게이트전극(G1) 및 구동 채널영역 양측의 구동 소스전극(S1) 및 구동 드레인전극(D1)을 포함한다. 구동 게이트전극(G1)과 중첩하는 구동 채널영역은 오메가 형상과 같이 절곡된 형상을 가짐으로써 좁은 공간 내에 긴 채널길이를 형성할 수 있다. 구동 채널영역의 길이가 긴 경우 게이트 전압의 구동 범위(driving range)가 넓어지게 되어 유기발광다이오드(OLED)에서 방출되는 빛의 계조를 보다 정교하게 제어할 수 있으며, 표시 품질을 향상시킬 수 있다.
스위칭 트랜지스터(T2)는 스위칭 채널영역에 중첩하는 스위칭 게이트전극(G2) 및 스위칭 채널영역 양측의 스위칭 소스전극(S2) 및 스위칭 드레인전극(D2)을 포함한다. 스위칭 드레인전극(D2)은 구동 소스전극(S1)과 연결될 수 있다.
보상 트랜지스터(T3)는 듀얼 트랜지스터로, 2개의 보상 채널영역에 중첩하는 보상 게이트전극(G3)들을 구비할 수 있으며, 보상 채널영역의 양 측에 배치된 보상 소스전극(S3) 및 보상 드레인전극(D3)을 포함할 수 있다. 보상 트랜지스터(T3)는 후술할 노드연결선(1174)을 통해 구동 트랜지스터(T1)의 구동 게이트전극(G1)과 연결될 수 있다.
제1초기화 트랜지스터(T4)는 듀얼 트랜지스터로, 2개의 제1초기화 채널영역에 중첩하는 제1초기화 게이트전극(G4)을 구비하며, 양측에 배치된 제1초기화 소스전극(S4) 및 제1초기화 드레인전극(D4)을 포함할 수 있다.
동작제어 트랜지스터(T5)는 동작제어 채널영역에 중첩하는 동작제어 게이트전극(G5) 및 동작제어 채널영역의 양측에 위치하는 동작제어 소스전극(S4) 및 동작제어 드레인전극(D5)을 포함할 수 있다. 동작제어 드레인전극(D5)은 구동 소스전극(S1)과 연결될 수 있다.
발광제어 트랜지스터(T6)는 발광제어 채널영역에 중첩하는 발광제어 게이트전극(G6), 및 발광제어 채널영역의 양측에 위치하는 발광제어 소스전극(S6) 및 발광제어 드레인전극(D6)을 포함할 수 있다. 발광제어 소스전극(S6)은 구동 드레인전극(D1)과 연결될 수 있다.
제2초기화 트랜지스터(T7)는 제2초기화 채널영역에 중첩하는 제2초기화 게이트전극(G7), 및 제2초기화 채널영역의 양측에 위치하는 제2초기화 소스전극(S7) 및 제2초기화 드레인전극(D7)을 포함할 수 있다.
전술한 반도체층(1130) 상에는 절연층(들)을 사이에 두고 제1 스캔라인(SWL), 제2 스캔라인(SIL), 발광제어라인(EL), 및 구동 게이트전극(G1)이 배치될 수 있다.
제1 스캔라인(SWL), 제2 스캔라인(SIL), 발광제어라인(EL)은 각각 제1방향(x방향)을 따라 연장될 수 있다. 제1 스캔라인(SWL)의 일 부분들은 스위칭 게이트전극(G2) 및 보상 게이트전극(G3)에 해당할 수 있다. 제2 스캔라인(SIL)의 일 부분들은 각각 제1초기화 게이트전극(G4) 및 제2초기화 게이트전극(G7)에 해당할 수 있다. 발광제어라인(EL)의 일 부분들은 동작제어 게이트전극(G5) 및 발광제어 게이트전극(G6)에 해당할 수 있다
구동 게이트전극(G1)은 고립된 전극(isolated electrode)으로, 노드연결선(1174)을 통해 보상 트랜지스터(T3)와 연결될 수 있다. 전술한 제1 스캔라인(SWL), 제2 스캔라인(SIL), 발광제어라인(EL), 및 구동 게이트전극(G1) 상에는 절연층(들)을 사이에 두고, 전극전압라인(HL)이 배치될 수 있다.
전극전압라인(HL)은 데이터라인(DL) 및 구동전압라인(PL)과 교차하도록 제1방향을 따라 연장될 수 있다. 전극전압라인(HL)의 일부는 구동 게이트전극(G1)의 적어도 일부를 커버하며, 구동 게이트전극(G1)과 함께 스토리지 커패시터(Cst)를 형성할 수 있다. 예컨대, 구동 게이트전극(G1)은 스토리지 커패시터(Cst)의 제1전극(CE1)이 되고 전극전압라인(HL)의 일부는 스토리지 커패시터(Cst)의 제2전극(CE2)이 될 수 있다.
스토리지 커패시터(Cst)의 제2전극(CE2)은 후술할 구동전압라인(PL)과 전기적으로 연결된다. 이와 관련하여, 전극전압라인(HL)은 전극전압라인(HL) 상에 배치된 구동전압라인(PL)과 콘택홀(CNT)을 통해 접속될 수 있다. 따라서, 전극전압라인(HL)은 구동전압라인(PL)과 동일한 전압 레벨(예, 정전압)을 가질 수 있다. 전극전압라인(HL)은 횡방향 구동전압라인일 수 있다.
전극전압라인(HL) 상에는 절연층(들)을 사이에 두고 데이터라인(DL), 구동전압라인(PL), 초기화연결선(1173), 및 노드연결선(1174)이 배치될 수 있다.
데이터라인(DL), 구동전압라인(PL)은 제2방향(y방향)으로 연장될 수 있다. 데이터라인(DL)은 콘택홀(1154)을 통해 스위칭 트랜지스터(T2)의 스위칭 소스전극(S2)에 접속될 수 있다. 데이터라인(DL)의 일부는 스위칭 소스전극일 수 있다.
초기화연결선(1173)의 일단은 콘택홀(1152)을 통해 제1 및 제2초기화 트랜지스터(T4, T7)에 연결되고, 타단은 콘택홀(1151)을 통해 후술할 초기화전압라인(VIL)과 연결될 수 있다.
노드연결선(1174)의 일단은 콘택홀(1156)을 통해 보상 드레인전극(D3)에 연결되고, 타단은 콘택홀(1157)을 통해 구동 게이트전극(G1)에 접속할 수 있다.
데이터라인(DL), 구동전압라인(PL), 초기화연결선(1173), 및 노드연결선(1174) 상에는 절연층(들)을 사이에 두고 초기화전압라인(VIL)이 배치될 수 있다.
초기화전압라인(VIL)은 제1방향(x방향)으로 연장될 수 있다. 초기화전압라인(VIL)은 초기화연결선(1173)을 통해 제1 및 제2초기화 구동 트랜지스터(T4, T7)에 연결될 수 있다. 초기화전압라인(VIL)은 전극전압라인(HL)과 동일한 층 상에 배치되고, 동일한 물질을 포함할 수 있다.
도 4 및 도 5는 구동 트랜지스터(T1), 스위칭 트랜지스터(T2), 보상 트랜지스터(T3), 제1초기화 트랜지스터(T4), 동작제어 트랜지스터(T5), 발광제어 트랜지스터(T6) 및 제2초기화 트랜지스터(T7)가 P타입 MOSFET인 것을 설명하고 있으나, 본 발명은 이에 한정되지 않는다. 다른 실시예로서, 일부 트랜지스터는 N타입 MOSFET일 수 있다. 예컨대, 제1초기화 트랜지스터(T4) 및 제2초기화 트랜지스터(T7)가 N타입 MOSFET일 수 있으며, 이 경우 제1초기화 트랜지스터(T4) 및 제2초기화 트랜지스터(T7) 각각의 반도체는 다른 트랜지스터들의 반도체와 다른 물질을 포함하고 다른 층 상에 배치될 수 있다.
도 6은 본 발명의 일 실시예에 따른 표시 패널의 제1 표시영역 및 제2 표시영역에 각각 배열된 부화소들을 나타낸 평면도이다.
도 6을 참조하면, 제1 및 제2 표시영역(DA1, DA2)에는 적색 부화소(R), 녹색 부화소(G) 및 청색 부화소(B)가 배치될 수 있다. 적색 부화소(R), 녹색 부화소(G) 및 청색 부화소(B)는 발광다이오드를 통해 서로 다른 색의 빛을 방출할 수 있다.
제1 표시영역(DA1)의 적색 부화소(R), 녹색 부화소(G) 및 청색 부화소(B)의 배열, 개구율(단위면적당 발광영역의 비율) 및/또는 개수는, 제2 표시영역(DA2)의 적색 부화소(R), 녹색 부화소(G) 및 청색 부화소(B)의 배열, 개구율, 및/또는 개수와 동일할 수 있다. 예컨대, 동일 면적당 제1 표시영역(DA1)의 부화소들의 배열 및/또는 개수는 제2 표시영역(DA2)의 부화소들의 배열 및/또는 개수와 동일할 수 있다. 부화소들, 예컨대 적색 부화소(R), 녹색 부화소(G) 및 청색 부화소(B)각각은 발광다이오드를 포함하기에, 부화소들의 배열 및/또는 개수가 같다고 함은 발광다이오드들의 배열 및/또는 개수가 동일하다는 것을 나타낼 수 있다. 예컨대, 동일 면적 당, 제1 표시영역(DA1)에 배치된 발광다이오드들의 배열 및/또는 개수는, 제2 표시영역(DA2)에 배치된 발광다이오드들의 배열 및/또는 개수와 동일할 수 있다.
적색 부화소(R), 녹색 부화소(G) 및 청색 부화소(B)는 펜타일TM 타입으로 배치될 수 있다. 제1 행(1N)에는 복수의 적색 부화소(R)와 복수의 청색 부화소(B)가 교대로 배치되어 있으며, 인접한 제2 행(2N)에는 복수의 녹색 부화소(G)가 소정 간격 이격되어 배치되어 있고, 인접한 제3 행(3N)에는 청색 부화소(B)와 적색 부화소(R)가 교대로 배치되어 있으며, 인접한 제4 행(4N)에는 복수의 녹색 부화소(G)가 소정 간격 이격되어 배치되어 있고, 이러한 부화소의 배치가 제N 행까지 반복되어 있다. 이 때, 청색 부화소(B) 및 적색 부화소(R)의 크기(또는 폭)는 녹색 부화소(G)의 크기(또는 폭)보다 크게 구비될 수 있다.
제1 행(1N)에 배치된 복수의 적색 부화소(R) 및 청색 부화소(B)와 제2 행(2N)에 배치된 복수의 녹색 부화소(G)는 서로 엇갈려서 배치되어 있다. 따라서, 제1 열(1M)에는 적색 부화소(R) 및 청색 부화소(B)가 교대로 배치되어 있으며, 인접한 제2 열(2M)에는 복수의 녹색 부화소(G)가 소정 간격 이격되어 배치되어 있고, 인접한 제3 열(3M)에는 청색 부화소(B) 및 적색 부화소(R)가 교대로 배치되어 있으며, 인접한 제4 열(4M)에는 복수의 녹색 부화소(G)가 소정 간격 이격되어 배치되어 있으며, 이러한 부화소의 배치가 제M 열까지 반복되어 있다.
이와 같은 부화소 배열 구조를 다르게 표현하면, 제2 부화소(Pb)의 중심점을 사각형의 중심점으로 하는 가상의 사각형(VS)의 꼭지점 중에 서로 마주보는 제1 꼭지점과 제3 꼭지점에는 제1 부화소(Pa)가 배치되며, 나머지 꼭지점인 제2 꼭지점과 제4 꼭지점에 제3 부화소(Pc)가 배치되어 있다고 표현할 수 있다. 이 때, 가상의 사각형(VS)은 직사각형, 마름모, 정사각형 등 다양하게 변형될 수 있다.
이러한 부화소 배열 구조를 펜타일TM 매트릭스(PentileTM Matrix) 구조, 또는 펜타일TM 구조라고 하며, 인접한 부화소를 공유하여 색상을 표현하는 렌더링(Rendering) 구동을 적용함으로써, 작은 수의 부화소로 고해상도를 구현할 수 있다.
도 6은 제1 표시영역(DA1)에 배치된 제1 부화소(P1)들이 펜타일TM 매트릭스 구조로 배치된 것으로 도시하나, 본 발명이 이에 한정되는 것은 아니다. 예컨대 제1 부화소(P1)들, 예컨대 제1 부화소(Pa), 제2 부화소(Pb), 및 제3 부화소(Pc)는 스트라이프(stripe) 구조, 모자이크(mosaic) 배열 구조, 델타(delta) 배열 구조 등 다양한 형상으로 배치될 수 있다.
도 6에 도시된 바와 같이, 제1 표시영역(DA1) 및 제2 표시영역(DA2)은 동일한 부화소들의 배치를 가질 수 있다. 제1 표시영역(DA1)의 부화소들의 밀도 및 제2 표시영역(DA2)의 부화소들의 밀도는 서로 동일할 수 있다. 바꾸어 말하면, 동일 면적 당 제1 표시영역(DA1)의 부화소들의 개수(또는 면적)은 제2 표시영역(DA2)의 개수(또는 면적)과 동일할 수 있다.
도 7은 본 발명의 일 실시예에 따른 표시 패널을 개략적으로 나타낸 평면도이다.
도 7을 참조하면, 표시 패널(10)은 표시영역(DA) 및 주변영역(PA)을 포함할 수 있다. 표시영역(DA)은 제1 및 제2 표시영역(DA1, DA2)을 포함할 수 있다. 제1 표시영역(DA1) 및 제2 표시영역(DA2)은 이차원적으로 배열된 발광다이오드들을 이용하여 이미지를 디스플레이할 수 있다.
제1 및 제2 표시영역(DA1, DA2)에는 발광다이오드들이 배치되고, 발광다이오드들에 각각 전기적으로 연결되는 부화소회로들은 제1 표시영역(DA1) 및 제2 표시영역(DA2)에 배치된다. 예컨대, 제1 표시영역(DA1)에 배치된 제1 발광다이오드(ED1)들에 전기적으로 연결된 제1 부화소회로(PC1)들은 제1 표시영역(DA1)에 배치되고, 제2 표시영역(DA2)에 배치된 제2 발광다이오드(ED2)들과 전기적으로 연결된 제2 부화소회로(PC2)들은 제2 표시영역(DA2)에 배치될 수 있다.
제1 부화소회로(PC1)는 제1 방향(예, x방향)을 따라 연장된 스캔선(SL) 및 제2 방향(예, y방향)을 따라 연장된 데이터라인(DL)에 전기적으로 연결된다. 제2 부화소회로(PC2)는 제1 방향(예, X방향)을 따라 연장된 스캔선(SL) 및 제2 방향(예, y방향)을 따라 연장된 데이터라인(DL)에 전기적으로 연결된다.
제1 부화소회로(PC1)는 앞서 도 5에서 설명한 제1 표시영역(DA1)의 부화소회로영역(PCA)에 배치될 수 있다. 일 실시예로, 제1 부화소회로(PC1)에 전기적으로 연결된 제1 발광다이오드(ED1)는 제1 표시영역(DA1)의 부화소회로영역(PCA)에 배치될 수 있다. 제2 부화소회로(PC2)는 제2 표시영역(DA2)의 부화소회로영역(PCA)에 배치될 수 있다. 일 제2 부화소회로(PC2)에 전기적으로 연결된 제2 발광다이오드(ED2)는 제2 표시영역(DA2)의 부화소회로영역(PCA)에 배치될 수 있다. 인접한 부화소회로영역(PCA)은 서로 이격되어 배치될 수 있고, 인접한 부화소회로영역(PCA) 사이에는 제1 및 제2 이격영역(IVA1, IVA2)들이 배치될 수 있다. 예컨대, 제2 표시영역(DA2)은 제2 발광다이오드(ED2) 및 제2 부화소회로(PC2)가 배치된 부화소회로영역(PCA)을 적어도 부분적으로 둘러싸는 제1 이격영역(IVA1)을 포함할 수 있고, 제1 표시영역(DA1)은 제1 발광다이오드(ED1) 및 제1 부화소회로(PC1)가 배치된 부화소회로영역을 적어도 부분적으로 둘러싸는 제2 이격영역(IVA2)이 배치될 수 있다.
또한, 제2 표시영역(DA2)의 제1 이격영역(IVA1)은 투과영역(TA)을 포함할 수 있다. 투과영역(TA)은 인접한 제2 발광다이오드(ED2)들 및 제2 부화소회로(PC2)들 사이에 위치할 수 있다. 일 실시예로, 제2 표시영역(DA2) 중 제2 발광다이오드(ED2)들 및 제2 부화소회로(PC2)들이 배치되지 않은 영역이 투과영역(TA)에 해당할 수 있다.
주변영역(PA)에는 각 제1 부화소회로(PC1) 및 제2 부화소회로(PC2)에 신호를 제공하기 위한 제1 구동회로(SDRV1) 및 제2 구동회로(SDRV2)가 배치될 수 있다.
제1 구동회로(SDRV1)는 스캔선(SL)을 통해 제1 부화소회로(PC1)들 및 제2 부화소회로(PC2)들 각각에 스캔 신호를 인가할 수 있다. 제2 구동회로(SDRV2)는 제1 표시영역(DA1)을 중심으로 제1 구동회로(SDRV1)의 반대편에 위치할 수 있다. 제1 표시영역(DA1)의 제1 부화소회로(PC1)들 및 제2 표시영역(DA2)의 제2 부화소회로(PC2)들 중 일부는 제1 구동회로(SDRV1)와 전기적으로 연결될 수 있고, 나머지는 제2 구동회로(SDRV2)에 전기적으로 연결될 수 있다.
패드(PAD)는 기판(100)의 일측에 배치될 수 있다. 패드(PAD)는 절연층에 의해 덮이지 않고 노출되어 회로 보드(30)와 연결될 수 있다. 회로 보드(30)에는 제어구동부(32)가 배치될 수 있다.
제어구동부(32)는 제1 구동회로(SDRV1)와 제2 구동회로(SDRV2)에 전달하는 제어 신호를 생성할 수 있다. 제어구동부(32)는 데이터구동회로를 포함할 수 있으며, 데이터구동회로는 데이터 신호를 생성할 수 있다. 생성된 데이터 신호는 표시 패널(10)의 주변영역(PA)에 배치된 팬아웃 배선(FW) 및 팬아웃 배선(FW)과 연결된 데이터라인(DL)을 통해 제1 부화소회로(PC1)들 및 제2 부화소회로(PC2)에 전달될 수 있다. 다른 실시예로, 데이터구동회로는 기판(100)의 주변영역(PA)에 배치될 수 있다.
주변영역(PA)에는 구동전압공급선(11) 및 공통전압공급선(13)이 배치될 수 있다. 구동전압공급선(11)은 부화소회로, 예컨대 제1 및 제2 부화소회로(PC1, PC2) 각각에 구동전압을 인가할 수 있고, 공통전압공급선(13)은 발광다이오드, 예컨대 제1 및 제2 발광다이오드(ED1, ED2)의 제2 전극(캐소드)에 공통전압을 인가할 수 있다.
구동전압공급선(11)은 패드(PAD)와 표시영역(DA)의 일측 사이에 배치될 수 있으며, 공통전압공급선(13)은 일측이 개방된 루프형상을 가지며, 평면상에서 표시영역(DA)을 부분적으로 둘러쌀 수 있다. 구동전압공급선(11)은 표시영역(DA)을 지나는 구동전압라인(PL)에 전기적으로 연결될 수 있다.
제1 및 제2 발광다이오드(ED1, ED2), 제1 및 제2 부화소회로(PC1, PC2), 패드(PAD), 제1 및 제2 구동회로(SDRV1, SDRV2), 구동전압공급선(11) 및 공통전압공급선(13) 등은 기판(100) 상에 배치된다. 도 7에 도시된 표시 패널(10)의 형상은 기판(100)의 형성과 실질적으로 동일할 수 있다. 따라서, 표시 패널(10)이 표시영역(DA) 및 주변영역(PA)을 포함한다고 함은, 기판(100)이 표시영역(DA) 및 주변영역(PA)을 포함하는 것을 나타낼 수 있다.
도 8a 및 도 8b는 도 7의 A를 확대한 평면도이다. 설명의 편의를 위하여, 도 8a는 부화소회로영역들 및 이격영역들을 나타내고, 도 8b은 도 8a의 부화소회로영역들 및 이격영역들에 배치된 구성요소들을 나타낸다.
도 8a를 참조하면, 제2 표시영역(DA2)은 복수의 제2 부화소회로영역(PCA2)들 및 복수의 제1 이격영역(IVA1)들을 포함할 수 있고, 제1 표시영역(DA1)은 복수의 제1 부화소회로영역(PCA1)들 및 복수의 제2 이격영역(IVA2)들을 포함할 수 있다.
도 8a 및 도 8b를 참조하면, 제1 부화소회로영역(PCA1)은 제1 부화소회로(PC1)이 배치된 영역이며, 제2 부화소회로영역(PCA2)은 제2 부화소회로(PC2)이 배치된 영역이다. 제1 부화소회로영역(PCA1) 및 제2 부화소회로영역(PCA2)에 각각 배치된 제1 부화소회로(PC1) 및 제2 부화소회로(PC2)의 구조는 앞서 도 5를 참조하여 설명한 바와 같다. 바꾸어 말하면, 제1 부화소회로영역(PCA1)의 제1 부화소회로(PC1)는 도 5에서 설명한 부화소회로영역(PCA)의 부화소회로(PC)와 같고, 제2 부화소회로영역(PCA2)의 제2 부화소회로(PC2)는 도 5에서 설명한 부화소회로영역(PCA)의 부화소회로(PC)와 같다.
제2 이격영역(IVA2)은 제1 부화소회로영역(PCA1)을 적어도 부분적으로 둘러싸는 영역으로, 제1 부화소회로영역(PCA1)와 달리 트랜지스터, 커패시터, 및/또는 다이오드와 같은 전자요소들이 배치되지 않은 영역이다. 제1 이격영역(IVA1)은 제2 부화소회로영역(PCA2)를 적어도 부분적으로 둘러싸는 영역으로, 제2 부화소회로영역(PCA2)와 달리 트랜지스터, 커패시터, 및/또는 다이오드와 같은 전자요소들이 배치되지 않은 영역이다. 일 실시예로, 도 8a은 제1 이격영역(IVA1)들 및 제2 이격영역(IVA2)들이 각각 평면상에서 대략 'L'자 형태인 것을 도시한다.
도 8a에 도시된 바와 같이, 제1 부화소회로영역(PCA1)는 제1 표시영역(DA1)에서 행과 열을 이루도록 배열되되, 이웃한 제1 부화소회로영역(PCA1)들 사이에는 제2 이격영역(IVA2)이 배치될 수 있다. 제2 부화소회로영역(PCA2)는 제2 표시영역(DA2)에서 행과 열을 이루도록 배열되되, 이웃한 제2 부화소회로영역(PCA2)들 사이에는 제1 이격영역(IVA1)이 배치될 수 있다. 다르게 말하면, 도 8b에 도시된 바와 같이 제1 부화소회로(PC1)들은 제1 표시영역(DA1)에서 행과 열을 이루도록 배열되되, 이웃한 제1 부화소회로(PC1)들 사이에는 제2 이격영역(IVA2)이 배치될 수 있다. 제2 부화소회로(PC2)들은 제2 표시영역(DA2)에서 행과 열을 이루도록 배열되되, 이웃한 제2 부화소회로(PC2)들 사이에는 제1 이격영역(IVA1)이 배치될 수 있다.
평면상에서, 제2 표시영역(DA2)에 배치되는 복수의 제1 이격영역(IVA1)들의 형상은 제1 표시영역(DA1)에 배치되는 복수의 제2 이격영역(IVA2)들의 형상과 실질적으로 동일할 수 있다. 동일 면적 당 제2 표시영역(DA2)에서 복수의 제1 이격영역(IVA1)들이 차지하는 비율은 제1 표시영역(DA1)에서 복수의 제2 이격영역(IVA2)들이 차지하는 비율과 동일할 수 있다. 즉, 제1 표시영역(DA1)과 제2 표시영역(DA2)은, 제2 표시영역(DA2)은 컴포넌트(20, 도 2)가 배치되어야하는 차이점이 있음에도 불구하고, 복수의 부화소회로영역들과 복수의 이격영역들이 동일하게 배치될 수 있다.
전술한 구조를 포함하는 본 발명의 일 실시예에 따른 표시 패널은 제1 표시영역(DA1) 및 제2 표시영역(DA2) 간의 휘도를 균일하게 개선할 수 있는 효과가 있다. 종래에는 카메라 등의 컴포넌트가 배치되어야 하는 제2 표시영역은 빛이 투과될 수 있는 투과영역이 확보되어야하기 때문에, 제2 표시영역에 배치되는 발광다이오드가 연결되는 부화소회로가 제2 표시영역 외의 다른 영역에 배치되어야하는 문제점이 있었다. 이에 반해, 본 발명의 일 실시예에 따른 표시 패널은 제1 및 제2 표시영역(DA1, DA2)에 각각 배치되는 제1 및 제2 발광다이오드(ED1, ED2)에 전기적으로 연결된 제1 및 제2 부화소회로(PC1, PC2)가 제1 및 제2 이격영역(IVA1, IVA2)을 개재한 채 실질적으로 동일한 배열을 가지므로 제1 표시영역(DA1)과 제2 표시영역(DA2)과의 휘도를 균일하게 하여 화질 편차를 개선할 수 있다.
제2 부화소회로(PC2)에 전기적으로 연결된 제2 발광다이오드(ED2)는 제2 표시영역(DA2)에 배치될 수 있고, 제1 부화소회로(PC1)에 전기적으로 연결된 제1 발광다이오드(ED1)는 제1 표시영역(DA1)에 배치될 수 있다. 일 실시예로, 제1 및 제2 발광다이오드(ED1, ED2)는 유기발광다이오드를 포함할 수 있다.
일 실시예로, 도 8b는 제1 부화소회로영역(PCA1)들에 각각 배치된 제1 내지 제3 유기발광다이오드(OLED1, OLED2, OLED3) 및 제2 부화소회로영역(PCA2)들에 각각 배치된 제1 내지 제3 유기발광다이오드(OLED1', OLED2', OLED3')를 도시한다. 예컨대, 제1 유기발광다이오드(OLED1, OLED1')은 적색 부화소(R)에 배치되어 적색 빛을 방출할 수 있고, 제2 유기발광다이오드(OLED2, OLED2')는 녹색 부화소(G)에 배치되어 녹색 빛을 방출할 수 있고, 제3 유기발광다이오드(OLED3, OLED3')는 청색 부화소(B)에 배치되어 청색 빛을 방출할 수 있다.
일부 실시예에 따르면, 제2 부화소회로(PC2)에 전기적으로 연결된 제2 발광다이오드(ED2)는 제2 부화소회로영역(PCA2)에 배치될 수 있고, 제1 부화소회로(PC1)에 전기적으로 연결된 제1 발광다이오드(ED1)는 제1 부화소회로영역(PCA1)에 배치될 수 있다. 바꾸어 말하면, 제1 발광다이오드(ED1)에 해당하는 제1 내지 제3 유기발광다이오드(OLED1, OLED2, OLED3)는 해당하는 제1 부화소회로영역(PCA1) 내에만 배치될 수 있고, 제2 발광다이오드(ED2)에 해당하는 제1 내지 제3 유기발광다이오드(OLED1', OLED2', OLED3')는 해당하는 제2 부화소회로영역(PCA2) 내에만 배치될 수 있다. 따라서, 동일 면적당 제1 및 제2 이격영역(IVA1, IVA2)의 비율을 증가시킬 수 있다.
또한, 서로 인접한 두 개의 부화소회로영역들 각각에 배치되는 부화소회로는 제1 방향(예, x방향) 및/또는 제1 방향과 수직인 제2 방향(예, y방향)을 따라 연장된 신호선에 의해 전기적으로 연결될 수 있다. 신호선들은 데이터선 또는 스캔선을 포함할 수 있으며, 복수의 부화소회로들은 데이터선 및 스캔선에 전기적으로 연결될 수 있다. 예컨대, 신호선들은 제1 스캔라인(SWL), 제2 스캔라인(SIL), 발광제어라인(EL), 초기화전압라인(VIL), 전극전압라인(HL), 데이터라인(DL) 및 구동전압라인(PL)을 포함할 수 있다. 제1 스캔라인(SWL), 제2 스캔라인(SIL), 발광제어라인(EL), 초기화전압라인(VIL) 및 전극전압라인(HL)은 각각 제1 방향(x방향)을 따라 연장될 수 있다. 데이터라인(DL) 및 구동전압라인(PL)은 제1 방향과 수직인 제2 방향(y방향)을 따라 연장될 수 있다.
제1 및 제2 표시영역(DA1, DA2)에서 신호선들은 서로 인접한 두 개의 부화소회로영역을 지나되, 이격영역을 가로지르도록 연장될 수 있다. 예컨대, 제1 부화소회로(PC1)들과 전기적으로 연결된 신호선들은 제1방향 및/또는 제2방향을 따라 제1 이격영역(IVA1)을 가로지르도록 연장되며, 제2 부화소회로(PC2)들과 전기적으로 연결된 신호선들은 제1방향 및/또는 제2방향을 따라 제2 이격영역(IVA2)을 가로지르도록 연장될 수 있다.
제2 표시영역(DA2)은 제1 이격영역(IVA1)이 투과영역(TA)을 포함할 수 있다. 즉, 제2 표시영역(DA2)의 투과영역(TA)은 제1 이격영역(IVA1)에서 제1 이격영역(IVA1)을 가로지르도록 연장된 신호선들이 배치되는 영역을 제외한 나머지 영역이다. 제1 이격영역(IVA1)은 부화소회로(PC) 및 제1 내지 제3 유기발광다이오드들(OLED1, OLED2, OLED3)이 배치되지 않는 영역이나, 신호선들이 금속층으로 형성되는 경우, 신호선들이 배치되는 제1 이격영역(IVA1)은 빛이 투과될 수 없다. 이에 따라, 신호선들이 배치되지 않는 제1 이격영역(IVA1)의 영역은 투과영역(TA)이 되어 빛이나 음향과 같은 파장이 투과될 수 있다. 이러한 투과영역(TA)의 투과율은 약 20% 이상일 수 있다.
도 9는 도 8b에 도시된 제2 표시영역의 일부를 나타낸 단면도이다. 도 9는 일 실시예로서, 발광다이오드가 유기발광다이오드(OLED)를 포함하는 것을 도시한다.
도 9를 참조하면, 기판(100) 상에 제2 부화소회로(PC2)가 배치되고, 제2 부화소회로(PC2) 상에 유기발광다이오드(OLED)가 배치될 수 있다.
기판(100)은 앞서 설명한 바와 같이 글래스재나 고분자 수지를 포함할 수 있다. 버퍼층(111)은 기판(100) 상에 위치하여, 기판(100)의 하부로부터 이물, 습기 또는 외기의 침투를 감소 또는 차단할 수 있고, 기판(100) 상에 평탄면을 제공할 수 있다. 버퍼층(111)은 산화물 또는 질화물과 같은 무기물, 또는 유기물, 또는 유무기 복합물을 포함할 수 있으며, 무기물과 유기물의 단층 또는 다층 구조로 이루어질 수 있다.
반도체층(1130)은 버퍼층(111) 상에 배치될 수 있다. 반도체층(1130)은 앞서 도 5를 참조하여 설명한 바와 같이 각 트랜지스터의 소스영역(또는 소스전극), 드레인영역(또는 드레인전극), 및 소스영역과 드레인영역 사이의 채널영역을 포함할 수 있다. 일 실시예로, 도 9는 구동 트랜지스터(T1)의 양측의 구동 소스전극(S1) 및 구동 드레인전극(D1), 및 구동 채널영역(C1)을 도시하며, 발광제어 트랜지스터(T6)의 발광제어 소스전극(S6) 및 발광제어 드레인전극(D6), 및 발광제어 채널영역(C6)을 도시한다. 반도체층(1130)은 폴리 실리콘을 포함하거나, 비정질 실리콘을 포함하거나, 산화물 반도체를 포함하거나, 유기반도체를 포함할 수 있다.
제1절연층(112)은 반도체층(1130) 상에 배치될 수 있다. 제1절연층(112)은 게이트절연층으로서, 제1절연층(112) 상의 게이트전극, 예컨대 구동 게이트전극(G1) 및 발광제어 게이트전극(G6)을 그 아래의 반도체층(1130)과 전기적으로 절연시킬 수 있다. 제1절연층(112)은 실리콘산화물, 실리콘질화물, 실리콘산질화물 등을 포함할 수 있다.
구동 트랜지스터(T1)의 구동 게이트전극(G1)과 발광제어 트랜지스터(T6)의 발광제어 게이트전극(G6)은 제2 절연층(113) 및 제3 절연층(115)으로 커버되어 접속메탈(1175)과 구동 게이트전극(G1) 및 발광제어 게이트전극(G6)을 전기적으로 절연시킬 수 있다. 제2 절연층(113) 및 제3 절연층은 실리콘산화물, 실리콘 질화물, 실리콘산질화물 등을 포함할 수 있다.
데이터라인(DL) 및 접속메탈(1175)은 제3 절연층(115) 상에 배치될 수 있으며, 접속메탈(1175)은 접속메탈(1175)과 제1전극(210) 사이에 개재된 제4 절연층(117)의 콘택홀(1163)을 통해 전기적으로 연결될 수 있다. 데이터라인(DL) 및 도 9에 도시되지 않은 구동전압라인(PL, 도 8b)은 접속메탈(1175)과 동일한 물질로 동일 층에 형성될 수 있다. 데이터라인(DL)은 이격영역(IVA)에 배치되는 데이터라인 제1 부분(DL1) 및 제2 부화소회로영역(PCA2)에 배치되는 데이터라인 제2 부분(DL2)을 포함할 수 있다. 도 9를 참조하면, 데이터라인(DL) 제1 부분(DL1) 및 데이터라인 제2 부분(DL2)은 모두 접속메탈(1175)과 동일한 물질로 형성되어 금속성 물질을 포함할 수 있다.
제4 절연층(117)은 실리콘산화물이나 실리콘질화물과 같은 무기절연물 및/또는 유기절연물을 포함할 수 있다. 유기절연물은 BCB(Benzocyclobutene), 폴리이미드(polyimide), HMDSO(Hexamethyldisiloxane), Polymethylmethacrylate(PMMA)나, Polystylene(PS)과 같은 일반 범용고분자, 페놀계 그룹을 갖는 고분자 유도체, 아크릴계 고분자, 이미드계 고분자, 아릴에테르계 고분자, 아마이드계 고분자, 불소계고분자, p-자일렌계 고분자, 비닐알콜계 고분자 및 이들의 블렌드 등을 포함할 수 있다.
제1전극(210)은 반사 전극일 수 있다. 일부 실시예에서, 제1전극(210)은 Ag, Mg, Al, Pt, Pd, Au, Ni, Nd, Ir, Cr 및 이들의 화합물 등으로 형성된 반사층과, 전술한 반사층 상에 형성된 투명 또는 반투명 전극층을 포함한 다층 구조일 수 있다. 투명 또는 반투명 전극층은 인듐틴산화물(ITO; indium tin oxide), 인듐징크산화물(IZO; indium zinc oxide), 징크산화물(ZnO; zinc oxide), 인듐산화물(In2O3; indium oxide), 인듐갈륨산화물(IGO; indium gallium oxide) 및 알루미늄징크산화물(AZO; aluminum zinc oxide)를 포함하는 그룹에서 선택된 적어도 하나 이상을 구비할 수 있다. 일부 실시예에서, 제1전극(210)은 ITO/Ag/ITO로 적층된 구조로 구비될 수 있다.
뱅크층(119)은 제1전극(210)의 중앙부가 노출되도록 하는 개구부(119OP)를 가짐으로써 유기발광다이오드(OLED)의 발광영역을 정의하는 역할을 할 수 있다. 일부 실시예에서, 개구부(119OP)의 크기 및 폭은 발광영역, 즉 부화소의 크기 및 폭에 해당할 수 있다.
뱅크층(119)은 제1전극(210)의 가장자리와 제1전극(210) 상부의 제2전극(230)의 사이의 거리를 증가시킴으로써 제1전극(210)의 가장자리에서 아크 등이 발생하는 것을 방지하는 역할을 할 수 있다. 뱅크층(119)은 투명한 물질 (예, 투명한 유기 절연물)을 포함할 수 있다. 뱅크층(119)은 폴리이미드, 예컨대 감광성 폴리이미드(Photo-sensitive PI)를 포함할 수 있다. 또는, 뱅크층(119)은 폴리아마이드(Polyamide), 아크릴 수지, 벤조사이클로부텐, HMDSO(hexamethyldisiloxane) 및 페놀 수지 등과 같은 유기 절연 물질을 포함할 수 있다.
발광층(220)은 적색, 녹색, 또는 청색의 빛을 방출하는 형광 또는 인광 물질을 포함하는 유기물을 포함할 수 있다. 도시되지는 않았으나, 발광층(220)의 아래 및/또는 위에는 기능층이 배치될 수 있다. 기능층은 홀 수송층, 홀 주입층, 전자 주입층, 및/또는 전자 수송층을 포함할 수 있다.
제2전극(230)은 투광성 전극일 수 있다. 제2전극(230)은 Li, Ca, LiF/Ca, LiF/Al, Al, Ag, Mg 및 이들의 화합물을 포함하는 일함수가 작은 금속 박막으로 형성될 수 있다. 또한, 금속 박막 위에 ITO, IZO, ZnO 또는 In2O3 등의 TCO(transparent conductive oxide)막이 더 배치될 수 있다. 제2전극(230)은 표시영역(DA)을 전체적으로 커버하도록 형성될 수 있다.
도 8b 및 도 9를 참조하면, 기판(100)과 뱅크층(119) 사이에는 트랜지스터들의 반도체층(들), 트랜지스터들의 전극들, 및 스토리지 커패시터의 전극, 및 도전성 라인들이 배치될 수 있다. 반도체층(들), 전극들, 도전성 라인들, 및 제1전극(210) 중 선택된 적어도 두 개 이상은 서로 중첩할 수 있으며, 중첩하는 부분은 빛이 투과할 수 없는 구역에 해당한다. 반면, 도 8b 및 도 9에 도시된 바와 같이, 기판(100)에 수직한 방향에서 기판(100)을 바라보았을 때, 반도체층(들), 전극들, 도전성 라인들, 및 제1전극(210)이 비중첩하는 구역(이하, 투과영역이라 함, TA)은 빛이 투과할 수 있는 구역에 해당할 수 있다.
투과영역(TA)은 뱅크층(119)과 기판(100)과 뱅크층(119) 사이의 절연층들만의 적층 구조를 포함할 수 있다. 예컨대, 투과영역(TA)에서, 버퍼층(111), 제1 내지 제4절연층(112, 113, 115, 117), 및 뱅크층(119)이 적층될 수 있다. 바꾸어 말하면, 투과영역(TA)에는 빛을 반사시키거나 차단하는 물질을 포함하는 층들, 예컨대 반도체층, 전극, 도전성 라인들, 및 제1전극(210)이 존재하지 않는다.
유기발광다이오드(OLED)는 봉지층(300)으로 커버될 수 있다. 봉지층(300)은 제1 및 제2 무기봉지층(310, 330) 및 이들 사이의 유기봉지층(320)을 포함할 수 있다.
제1 및 제2 무기봉지층(310, 330)은 각각 하나 이상의 무기 절연물을 포함할 수 있다. 무기 절연물은 알루미늄 옥사이드, 티타늄옥사이드, 탄탈륨옥사이드, 하프늄옥사이드, 징크옥사이드, 실리콘옥사이드, 실리콘나이트라이드, 및/또는 실리콘옥시나이트라이드를 포함할 수 있다. 제1 및 제2 무기봉지층(310, 330)은 화학기상증착법을 통해 형성될 수 있다.
유기봉지층(320)은 폴리머(polymer)계열의 물질을 포함할 수 있다. 폴리머 계열의 소재로는 아크릴계 수지, 에폭시계 수지, 폴리이미드 및 폴리에틸렌 등을 포함할 수 있다. 예컨대, 유기봉지층(320)은 아크릴계 수지, 예컨대 폴리메틸메타크릴레이트, 폴리아크릴산 등을 포함할 수 있다. 유기봉지층(320)은 모노머를 경화하거나, 폴리머를 도포하여 형성할 수 있다.
봉지층(300) 상에는 입력감지층(400)이 배치될 수 있다. 입력감지층(400)은 외부의 입력, 예컨대 손가락 또는 스타일러스펜과 같은 물체의 터치 이벤트에 따른 좌표정보를 획득할 수 있다. 이를 위해, 입력감지층(400)은 터치 전극 및 터치전극과 연결된 트레이스 선들을 포함할 수 있으며, 이들을 절연시키기 위한 절연층도 포함할 수 있다.
입력감지층(400)상에는 광학기능층으로서 반사방지층(600)이 배치될 수 있다. 반사방지층(600)은 블랙매트릭스(610), 컬러필터(620) 및 오버코트층(630)을 포함할 수 있다.
컬러필터(620)는 유기발광다이오드(OLED)의 발광영역 상에 배치될 수 있다. 컬러필터(620)는 유기발광다이오드(OLED)에서 방출되는 빛의 색상에 따라 적색, 녹색, 또는 청색의 안료 또는 염료를 가질 수 있다. 컬러필터(620)는 표시 패널(10)의 부화소들 각각에서 방출되는 빛의 색상을 고려하여 배열될 수 있다.
블랙매트릭스(610)는 발광영역 주변의 비발광영역에 위치하며, 발광영역을 둘러쌀 수 있다. 블랙매트릭스(610)는 블랙의 색상을 갖는 안료 또는 염료를 포함하는 절연물(예, 유기절연물)을 포함할 수 있다.
이러한 블랙매트릭스(610) 및 컬러필터(620) 상에는 이들을 덮어 상면을 평탄화하게 하는 오버코트층(630)이 배치될 수 있다. 오버코트층(630)은 수지와 같은 유기물을 포함할 수 있으며, 전술한 유기물은 투명할 수 있다.
도 9와 같이 반사방지층(600)이 블랙매트릭스(610)과 컬러필터(620)들을 포함하는 경우, 투과영역(TA)에 대응하는 위치에는 광투광성 물질이 배치될 수 있다. 반사방지층(600)은 투과영역(TA)에 대응하는 오버코트층(630)을 포함할 수 있다. 오버코트층(630)은 투광성의 유기 절연물을 포함할 수 있다.
도 10은 본 발명의 다른 실시예에 따른 표시 패널을 개략적으로 나타낸 평면도이다. 도 10을 참조하면, 제1 및 제2 이격영역(IVA1, IVA2)의 형상 및 제1 및 제2 부화소회로영역(PCA1, PCA2)과 제1 및 제2 이격영역(IVA1, IVA2)의 배치에 대한 특징을 제외하고 다른 특징은 도 8a 및 도 8b에서 설명한 바와 같다. 도 10의 구성요소 중 동일한 부호는 앞서 도 8a 및 도 8b를 참조하여 설명한 바로 대신하고, 이하에서는 차이를 위주로 설명한다.
제1 부화소회로영역(PCA1)은 제1 부화소회로(PC1)이 배치된 영역이며, 제2 부화소회로영역(PCA2)은 제2 부화소회로(PC2)이 배치된 영역이다.
제2 이격영역(IVA2)은 제1 부화소회로영역(PCA1)을 적어도 부분적으로 둘러싸는 영역으로, 제1 부화소회로영역(PCA1)와 달리 트랜지스터, 커패시터, 및/또는 다이오드와 같은 전자요소들이 배치되지 않은 영역이다. 제1 이격영역(IVA1)은 제2 부화소회로영역(PCA2)를 적어도 부분적으로 둘러싸는 영역으로, 제2 부화소회로영역(PCA2)와 달리 트랜지스터, 커패시터, 및/또는 다이오드와 같은 전자요소들이 배치되지 않은 영역이다. 일 실시예로, 도 10은 제1 제2 이격영역(IVA2)들은 각각 평면상에서 제1 부화소회로영역(PCA1)들의 모든 측면을 전체적으로 둘러싸는 형태이고, 제1 이격영역(IVA1)들은 각각 평면상에서 제2 부화소회로영역(PCA2)들의 모든 측면을 둘러싸는 형태인 것을 도시한다.
도 10에 도시된 바와 같이, 제1 부화소회로영역(PCA1)는 제1 표시영역(DA1)에서 행과 열을 이루도록 배열되되, 이웃한 제1 부화소회로영역(PCA1)들 사이에는 제2 이격영역(IVA2)이 배치될 수 있다. 제2 부화소회로영역(PCA2)는 제2 표시영역(DA2)에서 행과 열을 이루도록 배열되되, 이웃한 제2 부화소회로영역(PCA2)들 사이에는 제1 이격영역(IVA1)이 배치될 수 있다.
또한, 평면상에서 제2 표시영역(DA2)에 배치되는 복수의 제1 이격영역(IVA1)들의 형상은 제1 표시영역(DA1)에 배치되는 복수의 제2 이격영역(IVA2)들의 형상과 실질적으로 동일할 수 있다. 동일 면적 당 제2 표시영역(DA2)에서 복수의 제1 이격영역(IVA1)들이 차지하는 비율은 제1 표시영역(DA1)에서 복수의 제2 이격영역(IVA2)들이 차지하는 비율과 동일할 수 있다.
전술한 구조를 포함하는 본 발명의 다른 실시예에 따른 표시 패널은 제2 (300)표시영역(DA2)의 제1 이격영역(IVA1)이 제2 부화소회로영역(PCA2)의 모든 측면을 둘러싸도록 형성함으로써 제2 표시영역(DA2)의 부화소 단위 영역마다 균일하게 투과율을 확보할 수 있는 효과가 있다. 또한, 부화소회로영역(PCA) 및 이격영역(IVA)의 형상 및 배치를 제1 표시영역(DA1)과 제2 표시영역(DA2)에서 동일하게 형성할 수 있어, 제1 표시영역(DA1)과 제2 표시영역(DA2)과의 휘도를 균일하게 하여 화질 편차를 개선할 수 있다.
도 11은 본 발명의 또 다른 실시예에 따른 표시 패널을 개략적으로 나타낸 평면도이고, 도 12는 본 발명의 또 다른 실시예에 따른 표시 패널의 부화소회로 및 전술한 부화소회로에 연결된 발광다이오드를 나타낸 단면도이다. 도 11 및 도 12를 참조하면, 신호선을 제외하고 다른 특징은 도 8a, 도 8b 및 도 9를 참조하여 설명한 바와 같다. 도 11 및 도 12의 구성요소 중 동일한 부호는 앞서 도 8b 및 도 9를 참조하여 설명한 바로 대신하고, 이하에서는 차이를 위주로 설명한다.
서로 인접한 두 개의 부화소회로영역들 각각에 배치되는 부화소회로는 제1 방향(예, x방향) 또는 제1 방향과 수직인 제2 방향(예, y방향)을 따라 연장된 신호선에 의해 전기적으로 연결될 수 있다. 구체적으로, 서로 인접한 두 개의 제2 부화소회로영역(PCA2)들 각각에 배치되는 제2 부화소회로(PC2)는 연장된 신호선에 의해 전기적으로 연결될 수 있고, 서로 인접한 두 개의 제1 부화소회로영역(PCA1)들 각각에 배치되는 제1 부화소회로(PC1)는 연장된 신호선에 의해 전기적으로 연결도리 수 있다. 신호선들은 데이터선 또는 스캔선을 포함할 수 있으며, 제1 및 제2 부화소회로(PC1, PC2)들은 데이터선 및 스캔선에 전기적으로 연결될 수 있다.
신호선들은 서로 인접한 두 개의 부화소회로영역들 각각을 전기적으로 연결해주기 위해서, 이격영역을 가로지르도록 연장될 수 있다. 제2 표시영역(DA2)에서 제2 부화소회로영역(PCA2)에 배치되는 제2 부화소회로(PC2)들을 전기적으로 연결해주기 위한 신호선들은 제1 이격영역(IVA1)에 배치될 수 있고, 제1 표시영역(DA1)에서 제1 부화소회로영역(PCA1)에 배치되는 제1 부화소회로(PC1)들을 전기적으로 연결해주기 위한 신호선들은 제2 이격영역(IVA2)에 배치될 수 있다.
다만, 도 11 및 도 12를 참조하면, 본 발명의 또 다른 실시예에 따른 표시 패널은 데이터라인(DL)이 서로 다른층에 배치되어 컨택홀을 통해 전기적으로 연결될 수 있다. 구체적으로, 데이터라인(DL)은 제1 및 제2 이격영역(IVA1, IVA2)에 배치되는 데이터라인 제1 부분(DL1) 및 제1 및 제2 부화소회로영역(PCA1, PCA2)에 배치되는 데이터라인 제2 부분(DL2)을 포함할 수 있다. 또한, 제3 절연층(115)과 유기발광다이오드(OLED) 사이에 배치될 수 있는 절연층은 제4 절연층(117) 및 제5 절연층(116)으로 나뉠 수 있다. 이때, 데이터라인 제2 부분(DL2)은 제3 절연층(115)상에 배치되어 제5 절연층(116)이 커버할 수 있으며, 데이터라인 제1 부분(DL1)은 제5 절연층(116)상에 배치되어 제4 절연층(117)이 커버할 수 있다. 데이터라인 제1 부분(DL1) 및 데이터라인 제2 부분(DL2)은 서로 다른층에 배치되므로, 데이터라인 제1 부분(DL1) 및 데이터라인 제2 부분(DL2)은 데이터라인 제1 부분(DL1)과 데이터라인 제2 부분(DL2) 사이에 개재된 제5 절연층(116)의 컨택홀을 통해 전기적으로 연결될 수 있다.
제1 및 제2 부화소회로영역(PCA1, PCA2)에 배치되는 데이터라인 제2 부분(DL2)은 접속메탈(1175)과 동일한 물질로 동일 층에 형성되어 금속성 물질을 포함할 수 있다. 제1 및 제2 이격영역(IVA1, IVA2)에 배치되는 데이터라인 제1 부분(DL1)은 투명 도전성 물질을 포함할 수 있다. 데이터라인 제1 부분(DL1)은 투명 전극층으로서 인듐틴산화물(ITO; indium tin oxide), 인듐징크산화물(IZO; indium zinc oxide), 징크산화물(ZnO; zinc oxide), 인듐산화물(In2O3; indium oxide), 인듐갈륨산화물(IGO; indium gallium oxide) 및 알루미늄징크산화물(AZO; aluminum zinc oxide)를 포함하는 그룹에서 선택된 적어도 하나 이상을 구비할 수 있다.
즉, 제1 및 제2 부화소회로영역(PCA1, PCA2)에 배치되는 데이터라인 제2 부분(DL2)은 기존과 마찬가지로 금속성 물질을 포함하나, 제1 및 제2 이격영역(IVA1, IVA2)에 배치되는 데이터라인 제1 부분(DL1)이 투명 도전성 물질을 포함함으로써, 제1 및 제2 이격영역(IVA1, IVA2)에 배치되는 데이터라인의 영역까지도 빛이 투과할 수 있게 된다. 도 11을 참조하면, 데이터라인(DL) 중 제1 및 제2 이격영역(IVA1, IVA2)에 투명 도전성 물질을 배치하는 특징은 데이터라인(DL) 뿐만 아니라 제1 및 제2 이격영역(IVA1, IVA2)을 가로지르도록 연장되는 모든 신호선에 적용될 수 있다. 이에 따라, 제2 표시영역(DA2)의 제1 이격영역(IVA1)에 배치되는 신호선들이 광투광성을 가지게되므로, 제1 이격영역(IVA1)의 투과영역(TA)은 신호선이 배치되는 영역까지 포함할 수 있다.
전술한 구조를 포함하는 본 발명의 또 다른 실시예에 따른 표시 패널은 제2 표시영역(DA2)의 제1 이격영역(IVA1)에 배치되는 신호선들을 투명 도전성 물질로 배치함으로써, 제2 표시영역(DA2)의 투과율을 더욱 높게 확보할 수 있는 효과가 있다. 즉, 제2 표시영역(DA2)의 제1 이격영역(IVA1)에서 신호선이 금속물질로 형성되는 경우, 신호선이 배치되는 영역을 제외한 제1 이격영역(IVA1)만을 투과영역(TA)로 볼 수 있었으나, 제1 이격영역(IVA1)에 배치되는 신호선들이 광투광성을 가지게되면 신호선이 배치되는 영역도 투과영역(TA)으로 볼 수 있어, 투과영역(TA)의 면적을 넓힐 수 있다. 뿐만 아니라, 이러한 부화소회로영역(PCA) 및 이격영역(IVA)의 형상 및 배치는 제1 표시영역(DA1) 및 제2 표시영역(DA2)에 동일하게 적용할 수 있으므로, 제1 표시영역(DA1)과 제2 표시영역(DA2)과의 휘도를 균일하게하는 효과도 동시에 가질 수 있다.
본 발명은 도면에 도시된 실시예를 참고로 설명되었으나 이는 예시적인 것에 불과하며, 당해 기술분야에서 통상의 지식을 가진 자라면 이로부터 다양한 변형 및 균등한 다른 실시예가 가능하다는 점을 이해할 것이다. 따라서 본 발명의 진정한 기술적 보호 범위는 첨부된 특허청구범위의 기술적 사상에 의하여 정해져야 할 것이다.
1: 전자 기기
10: 표시 패널
100: 기판
DA1, DA2: 제1 및 제2 표시영역
PCA1, PCA2: 제1 및 제2 부화소회로영역
IVA1, IVA2: 제1 및 제2 이격영역
TA: 투과영역
PC1, PC2: 제1 및 제2 부화소회로
ED1, ED2: 제1 및 제2 발광다이오드
OLED1, OLED2, OLED3 : 제1 내지 제3 유기발광다이오드
PA: 주변영역
DL, DL1, DL2: 데이터라인, 데이터라인의 제1 부분 및 제2 부분

Claims (22)

  1. 제1 표시영역 및 상기 제1 표시영역 내측의 제2 표시영역을 포함하는 기판;
    상기 제1 표시영역 및 상기 제2 표시영역에 배치되는 복수의 발광다이오드들;
    상기 복수의 발광 다이오드들과 각각 전기적으로 연결되는 복수의 부화소회로들을 포함하고,
    상기 제2 표시영역은,
    복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들; 및
    상기 복수의 부화소회로영역들 각각을 적어도 부분적으로 둘러싸는 복수의 투과영역들을 포함하고,
    상기 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들은 제1 이격영역을 사이에 두고 제1 방향을 따라 서로 이격되되, 상기 제1 이격영역은 상기 복수의 투과영역들 중 어느 하나의 투과영역을 포함하는, 표시 패널.
  2. 제1 항에 있어서,
    상기 인접한 두 개의 부화소회로영역들 중 하나는 제1 색의 빛을 방출하는 제1 발광다이오드에 전기적으로 연결되고,
    상기 인접한 두 개의 부화소회로영역들 중 다른 하나는 제1 색과 다른 제2색의 빛을 방출하는 제2 발광다이오드에 전기적으로 연결되는, 표시 패널.
  3. 제2 항에 있어서,
    상기 제1 및 제2 발광 다이오드들은 상기 인접한 두 개의 부화소회로영역들 각각에 위치하는 부화소회로와 중첩하는, 표시 패널.
  4. 제1 항에 있어서,
    상기 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들 각각에 위치하는 부화소회로들은 상기 제1 방향을 따라 연장된 신호선에 전기적으로 연결되되,
    상기 신호선은 상기 이격영역을 가로지르도록 연장된, 표시 패널.
  5. 제4 항에 있어서,
    상기 부화소회로들은 데이터선 및 스캔선에 전기적으로 연결되며,
    상기 신호선은 상기 데이터선 또는 스캔선을 포함하는, 표시 패널.
  6. 제4 항에 있어서,
    상기 이격영역을 가로지르는 상기 신호선의 제1 부분은 투명 도전성 물질을 포함하는, 표시 패널.
  7. 제6 항에 있어서,
    상기 신호선은,
    상기 인접한 두 개의 부화소회로영역 중 적어도 하나의 부화소회로영역에 배치되고 금속성 물질을 포함하는 제2 부분을 더 포함하고,
    상기 신호선의 상기 제1 부분과 상기 제2 부분은 상기 제1 부분과 상기 제2 부분 사이에 개재된 적어도 하나의 절연층의 컨택홀을 통해 전기적으로 연결되는, 표시 패널.
  8. 제1 항에 있어서,
    상기 제1 표시영역은,
    복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들을 포함하되, 상기 복수의 부화소회로영역들 중 인접한 부화소회로영역들은 제2 이격영역을 사이에 두고 서로 이격되어 있는, 표시 패널.
  9. 제8 항에 있어서,
    평면 상에서 상기 제1 이격영역의 형상 및 상기 제2 이격영역의 형상은 서로 동일한, 표시 패널.
  10. 제8 항에 있어서,
    동일 면적 당, 상기 제2 표시영역에서 상기 제1 이격영역이 차지하는 비율은 상기 제1 표시영역에서 상기 제2 이격영역이 차지하는 비율과 동일한, 표시 패널.
  11. 제1 항에 있어서,
    상기 투과영역의 상부에 위치하며 상기 투과영역에 중첩하고, 투광성의 유기 절연물을 포함하는, 표시 패널.
  12. 제1 항에 있어서,
    동일 면적당, 상기 제1 표시영역에 배치된 발광다이오드들의 개수와 상기 제2 표시영역에 배치된 발광다이오드들의 개수는 동일한, 표시 패널.
  13. 제1 표시영역 및 제2 표시영역에 배치된 복수의 발광다이오드들을 포함하는 표시 패널; 및
    상기 제2 표시영역과 중첩하게 배치되는 컴포넌트;를 포함하며,
    상기 표시 패널은,
    제1 표시영역 및 상기 제1 표시영역 내측의 제2 표시영역을 포함하는 기판;
    상기 제1 표시영역 및 상기 제2 표시영역에 배치되는 복수의 발광다이오드들;
    상기 복수의 발광 다이오드들과 각각 전기적으로 연결되는 복수의 부화소회로들을 포함하고,
    상기 제2 표시영역은,
    복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들; 및
    상기 복수의 부화소회로영역들 각각을 적어도 부분적으로 둘러싸는 복수의 투과영역들을 포함하고,
    상기 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들은 제1 이격영역을 사이에 두고 제1 방향을 따라 서로 이격되되, 상기 제1 이격영역은 상기 복수의 투과영역들 중 어느 하나의 투과영역을 포함하는, 전자 기기.
  14. 제13 항에 있어서,
    상기 컴포넌트는 센서 또는 카메라를 포함하는, 전자 기기.
  15. 제13 항에 있어서,
    상기 인접한 두 개의 부화소회로영역들 중 하나는 제1 색의 빛을 방출하는 제1 발광다이오드에 전기적으로 연결되고,
    상기 인접한 두 개의 부화소회로영역들 중 다른 하나는 제1 색과 다른 제2색의 빛을 방출하는 제2 발광다이오드에 전기적으로 연결되는, 전자 기기.
  16. 제15 항에 있어서,
    상기 제1 및 제2 발광 다이오드들은 상기 인접한 두 개의 부화소회로영역들 각각에 위치하는 부화소회로와 중첩하는, 전자 기기.
  17. 제13 항에 있어서,
    상기 제2 표시영역에서 서로 인접한 두 개의 부화소회로영역들 각각에 포함된 부화소회로는 상기 제1 방향을 따라 연장된 신호선에 전기적으로 연결되되,
    상기 신호선은 상기 이격영역을 가로지르도록 연장된, 전자 기기.
  18. 제17 항에 있어서,
    상기 이격영역을 가로지르는 상기 신호선의 제1 부분은 투명 도전성 물질을 포함하는, 전자 기기.
  19. 제18 항에 있어서,
    상기 신호선은,
    상기 인접한 두 개의 부화소회로영역 중 적어도 하나의 부화소회로영역에 배치되고 금속성 물질을 포함하는 제2 부분을 더 포함하고,
    상기 신호선의 상기 제1 부분과 상기 제2 부분은 상기 제1 부분과 상기 제2 부분 사이에 개재된 적어도 하나의 절연층의 컨택홀을 통해 전기적으로 연결되는, 전자 기기.
  20. 제13 항에 있어서,
    상기 제1 표시영역은,
    복수의 부화소회로들이 각각 배치되는 복수의 부화소회로영역들을 포함하되, 상기 복수의 부화소회로영역들 중 인접한 부화소회로영역들은 제2 이격영역을 사이에 두고 서로 이격되어 있는, 전자 기기.
  21. 제20 항에 있어서,
    평면 상에서 상기 제1 이격영역의 형상 및 상기 제2 이격영역의 형상은 서로 동일한, 전자 기기.
  22. 제20 항에 있어서,
    동일 면적 당, 상기 제2 표시영역에서 상기 제1 이격영역이 차지하는 비율은 상기 제1 표시영역에서 상기 제2 이격영역이 차지하는 비율과 동일한, 전자 기기.
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