KR20180062577A - 드라이브 ic 및 그를 이용한 표시장치 - Google Patents
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Abstract
본 실시예에 의하면, 복수의 게이트제어신호를 전달받아 복수의 게이트구동신호를 출력하되, 복수의 게이트구동신호의 수가 복수의 게이트제어신호보다 많도록 출력하는 레벨쉬프터, 및 복수의 데이터제어신호를 전달받아 데이터신호를 출력하는 소스 드라이브 IC를 포함하는 드라이브 IC 및 그를 이용한 표시장치를 제공하는 것이다.
본 실시예들에 의하면, 두께를 보다 얇게 구현할 수 있고 제조비용이 저렴한 표시장치를 제공할 수 있다.
본 실시예들에 의하면, 두께를 보다 얇게 구현할 수 있고 제조비용이 저렴한 표시장치를 제공할 수 있다.
Description
본 실시예들은 드라이브 IC 및 그를 이용한 표시장치에 관한 것이다.
정보화 사회가 발전함에 따라 화상을 표시하기 위한 표시장치에 대한 요구가 다양한 형태로 증가하고 있으며, 근래에는 액정표시장치(LCD: Liquid Crystal Display Device), 플라즈마 표시장치(PDP: Plasma Display Panel), 유기발광표시장치(OLED: Organic Light Emitting Display Device) 등과 같은 매트릭스 타입의 여러 가지 표시장치가 활용되고 있다.
최근에는 심미감을 갖도록 하기 위해 표시장치를 박형화하고 있다. 따라서, PCB의 크기를 줄여 표시장치를 박형화할 필요가 있다. 또한, PCB를 줄이게 되면,
또한, 표시장치들은 PCB를 사용하여 각 소자들에 신호를 전달하는데, PCB면적이 작으면 제조비용을 절감할 수 있어 PCB의 크기를 줄일 필요가 있다.
또한, 매트릭스 타입의 표시장치는 게이트라인 별로 게이트신호가 전달되는데, 게이트 신호와, 게이트신호를 생성하기 위한 신호들은 펄스 형태로 전달되는데, 노이즈로 나타날 수 있다. 따라서, 노이즈 발생을 억제하도록 할 필요가 있다.
본 실시예들의 목적은, 얇고 가벼운 표시장치를 제공하는 것이다.
본 실시예들의 또 다른 목적은, 노이즈에 영향이 적은 드라이브 IC 및 그를 이용한 표시장치를 제공하는 것이다.
일측면에서, 본 실시예들은, 복수의 게이트제어신호를 전달받아 복수의 게이트구동신호를 출력하되, 상기 복수의 게이트구동신호의 수가 상기 복수의 게이트제어신호보다 많도록 출력하는 레벨쉬프터; 및 복수의 데이터제어신호를 전달받아 데이터신호를 출력하는 소스 드라이브 IC를 포함하는 드라이브 IC 및 그를 이용한 표시장치를 제공할 수 있다.
다른 일측면에서, 본 실시예들은, 복수의 게이트라인과 복수의 데이터라인이 교차하는 영역에 화소가 형성되는 표시패널, 표시패널의 구동을 제어하는 복수의 게이트제어신호를 출력하는 제어부, 복수의 게이트제어신호를 전달받아 복수의 게이트라인 중 홀수번째 게이트라인에 대응하는 제1게이트구동신호를 출력하는 제1드라이브 IC를 포함하는 제1군의 드라이브 IC, 복수의 게이트제어신호를 전달받아 복수의 게이트라인 중 짝수번째 게이트라인에 대응하는 제2게이트구동신호를 출력하는 제2드라이브 IC를 포함하는 제2군의 드라이브 IC, 제어부와 제1군의 드라이브 IC를 연결하는 제1회로부, 제어부와 제2군의 드라이브 IC를 연결하는 제2회로부를 포함하되, 제1드라이브 IC와 제2드라이브 IC는 각각 레벨쉬프터와 소스 드라이브 IC를 포함하는 표시장치를 제공하는 것이다.
본 실시예들에 의하면, 두께를 보다 얇게 구현할 수 있고 제조비용이 저렴한 표시장치를 제공할 수 있다.
또한, 본 실시예들에 의하면, 노이즈의 영향을 줄일 수 있는 드라이브 IC 및 그를 이용한 표시장치를 제공할 수 있다.
도 1은 본 실시예에 따른 표시장치의 일 실시예를 나타내는 구조도이다.
도 2는 본 실시예에 따른 표시장치의 다른 일 실시예를 나타내는 구조도이다.
도 3a는 도 2에 도시된 표시장치에 채용된 제1드라이브 IC의 일 실시예를 나타내는 도면이다.
도 3b는 도 2에 도시된 표시장치에 채용된 제2드라이브 IC의 일 실시예를 나타내는 도면이다.
도 3c는 도 2에 도시된 표시장치에 채용된 제3드라이브 IC의 일 실시예를 나타내는 도면이다.
도 4a는 도 3a에 도시되어 있는 제1레벨쉬프터의 일 실시예를 나타내는 구조도이다.
도 4b는 도 3b에 도시되어 있는 제2레벨쉬프터의 일 실시예를 나타내는 구조도이다.
도 5a는 도 4a에 도시되어 있는 레벨쉬프터가 제1모드로 동작하도록 결정하는 방법을 나타내는 개념도이다.
도 5b는 도 4b에 도시되어 있는 레벨쉬프터가 제2모드로 동작하도록 결정하는 방법을 나타내는 개념도이다.
도 6은 도 2에 도시되어 있는 제1PCB의 일 실시예를 나타내는 개념도이다.
도 7은 도 2에 도시되어 있는 제1드라이브 IC의 다른 일 실시예를 나타내는 개념도이다.
도 8은 도 2에 도시되어 있는 제1PCB의 다른 일 실시예를 나타내는 개념도이다.
도 2는 본 실시예에 따른 표시장치의 다른 일 실시예를 나타내는 구조도이다.
도 3a는 도 2에 도시된 표시장치에 채용된 제1드라이브 IC의 일 실시예를 나타내는 도면이다.
도 3b는 도 2에 도시된 표시장치에 채용된 제2드라이브 IC의 일 실시예를 나타내는 도면이다.
도 3c는 도 2에 도시된 표시장치에 채용된 제3드라이브 IC의 일 실시예를 나타내는 도면이다.
도 4a는 도 3a에 도시되어 있는 제1레벨쉬프터의 일 실시예를 나타내는 구조도이다.
도 4b는 도 3b에 도시되어 있는 제2레벨쉬프터의 일 실시예를 나타내는 구조도이다.
도 5a는 도 4a에 도시되어 있는 레벨쉬프터가 제1모드로 동작하도록 결정하는 방법을 나타내는 개념도이다.
도 5b는 도 4b에 도시되어 있는 레벨쉬프터가 제2모드로 동작하도록 결정하는 방법을 나타내는 개념도이다.
도 6은 도 2에 도시되어 있는 제1PCB의 일 실시예를 나타내는 개념도이다.
도 7은 도 2에 도시되어 있는 제1드라이브 IC의 다른 일 실시예를 나타내는 개념도이다.
도 8은 도 2에 도시되어 있는 제1PCB의 다른 일 실시예를 나타내는 개념도이다.
이하, 본 발명의 일부 실시예들을 예시적인 도면을 참조하여 상세하게 설명한다. 각 도면의 구성요소들에 참조부호를 부가함에 있어서, 동일한 구성요소들에 대해서는 비록 다른 도면상에 표시되더라도 가능한 한 동일한 부호를 가질 수 있다. 또한, 본 발명을 설명함에 있어, 관련된 공지 구성 또는 기능에 대한 구체적인 설명이 본 발명의 요지를 흐릴 수 있다고 판단되는 경우에는 그 상세한 설명은 생략할 수 있다.
또한, 본 발명의 구성 요소를 설명하는 데 있어서, 제 1, 제 2, A, B, (a), (b) 등의 용어를 사용할 수 있다. 이러한 용어는 그 구성 요소를 다른 구성 요소와 구별하기 위한 것일 뿐, 그 용어에 의해 해당 구성 요소의 본질, 차례, 순서 또는 개수 등이 한정되지 않는다. 어떤 구성 요소가 다른 구성요소에 "연결", "결합" 또는 "접속"된다고 기재된 경우, 그 구성 요소는 그 다른 구성요소에 직접적으로 연결되거나 또는 접속될 수 있지만, 각 구성 요소 사이에 다른 구성 요소가 "개재"되거나, 각 구성 요소가 다른 구성 요소를 통해 "연결", "결합" 또는 "접속"될 수도 있다고 이해되어야 할 것이다.
도 1은 본 실시예에 따른 표시장치의 일 실시예를 나타내는 구조도이다.
도 1을 참조하면, 표시장치(100)는 표시패널(110), 데이터드라이버(120), 게이트드라이버(130) 및 제어부(140)를 포함할 수 있다.
표시패널(110)은 복수의 게이트라인(G1,G2,…,Gn-1,Gn)과 복수의 데이터라인(D1,D2,…,Dm-1,Dm)이 교차된 영역에 각각 화소(111)가 형성될 수 있다. 복수의 화소(111)는 게이트라인(G1,G2,…,Gn-1,Gn)으로 순차적으로 전달되는 게이트신호에 대응하여 데이터라인(D1,D2,…,Dm-1,Dm)으로 전달되는 데이터신호에 대응하여 빛을 발광할 수 있다. 여기서, 표시패널(110)은 액정표시장치, 플라즈마표시장치, 유기발광표시장치일 수 있다. 하지만, 이에 한정되는 것은 아니다.
데이터드라이버(120)는 복수의 데이터라인(D1,D2,…,Dm-1,Dm)과 연결되고 데이터라인(120)에 데이터신호를 전달할 수 있다. 데이터드라이버(120)는 제어부(240)로부터 디지털 영상신호를 전달받고 디지털 영상신호를 데이터신호로 변환하여 복수의 데이터라인(D1,D2,…,Dm-1,Dm)에 전달할 수 있다. 데이터드라이버(120)는 제어부(140)로부터 복수의 데이터제어신호를 전달받을 수 있다. 데이터제어신호는 스타트펄스, 클럭신호, 수평동기신호, 수직동기신호일 수 있다. 하지만, 이에 한정되는 것은 아니다. 데이터드라이버(120)는 소스 드라이버 IC라고 칭할 수 있다.
게이트드라이버(130)는 복수의 게이트라인(G1,G2,…,Gn-1,Gn)과 연결되고 게이트라인(G1,G2,…,Gn-1,Gn)에 순차적으로 게이트신호를 전달할 수 있다. 하지만, 이에 한정되는 것은 아니다. 게이트드라이버(130)는 제어부(140)로부터 복수의 게이트제어신호를 전달받을 수 있다. 게이트 드라이버(130)는 복수의 게이트제어신호를 변경하여 복수의 게이트구동신호를 출력할 수 있다. 복수의 게이트구동신호의 수는 복수의 게이트제어신호의 수보다 더 많아 제어부(140)에서 게이트드라이버(130)로 게이트제어신호를 전달하는 배선수는 제어부(140)에서 복수의 게이트구동신호를 전달하는 것보다 더 줄일 수 있다.
또한, 게이트드라이버(130)는 레벨쉬프터(131)와 게이트회로(132)를 포함할 수 있다. 레벨쉬프터(131)는 제어부(140)로부터 전달받는 복수의 게이트제어신호를 변경하여 복수의 게이트구동신호를 출력할 수 있다.
레벨쉬프터(131)가 전달받는 복수의 게이트제어신호는, 이븐/오드(E/O) 클럭, 게이트스타트펄스(GST), 게이트시프트클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)를 포함할 수 있다. 그리고, 레벨쉬프터(131)는 복수의 게이트제어신호를 전달받아 복수의 게이트구동신호를 출력할 수 있다. 복수의 게이트구동신호는 제1내지 제10클럭, 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호를 포함할 수 있다. 하지만, 이에 한정되는 것은 아니다. 또한, 복수의 게이트구동신호의 수는 상기 복수의 게이트제어신호의 수보다 더 많을 수 있다. 이로써, 제어부(140)에서 게이트드라이버(130)로 신호를 전달하는 배선의 수를 줄일 수 있다. 배선의 수를 줄임으로 인해 배선이 차지하는 공간을 줄일 수 있어 경량화, 박형화에 유리할 수 있다.
게이트회로(132)는 게이트신호를 생성하고, 복수의 게이트라인(G1,G2,…,Gn-1,Gn)과 연결되어 게이트라인(G1,G2,…,Gn-1,Gn)에 게이트신호를 전달할 수 있다. 게이트회로(132)는 레벨쉬프터(131)로부터 복수의 게이트구동신호를 전달받아 게이트신호를 생성할 수 있다.
제어부(140)는 데이터드라이버(120)와 게이트드라이버(130)에 데이터제어신호와 게이트제어신호를 전달할 수 있다. 또한, 제어부(140)는 데이터드라이버(120)에 디지털 영상신호를 전달할 수 있다.
도 2는 본 실시예에 따른 표시장치의 다른 일 실시예를 나타내는 구조도이다.
도 2를 참조하면, 표시장치(200)는 표시패널(210), 복수의 드라이브 IC(221a,222a,223a,221b,222b,223b), 제어부(240) 및 복수의 드라이브 IC(221a,222a,223a,221b,222b,223b)와 제어부(240)를 연결하는 제1PCB(212a)및 제2PCB(212b)를 포함할 수 있다.
표시패널(210)은 게이트라인(GL)과 데이터라인(DL)이 교차하여 생성된 영역에 복수의 화소가 형성되며, 영상을 표시하는 액티브영역(210a)과 영상을 표시하지 않는 비액티브영역(211a,211b)을 포함할 수 있다. 비액티브영역 (211a,211b)에는 복수의 GIP(Gate In Panel) 회로(2111a,2111b)가 배치되어 있을 수 있다. 하지만, 이에 한정되는 것은 아니다. 여기서, 비액티브영역(211a,211b)은 액티브영역(210a)의 좌우에 형성되어 있는 것으로 도시되어 있지만 이에 한정되는 것은 아니며 표시패널(210)의 좌,우 중 어느 한 곳에 배치되어 있는 것도 가능하다.
복수의 GIP 회로(2111a,2111b)는 각각 게이트라인(GL)과 연결되어 게이트신호를 게이트라인(GL)에 전달할 수 있다. 복수의 GIP 회로(2111a,2111b) 중 표시패널(210)의 왼쪽에 배치되어 있는 GIP 회로(2111a,2111b)는 복수의 게이트라인(GL) 중 홀수번째 게이트라인(GL)과 각각 연결되고 표시패널(210)의 오른쪽에 배치되어 있는 GIP 회로(2111a)는 짝수번째 게이트라인(GL)과 각각 연결될 수 있다. 하지만, 이에 한정되는 것은 아니다. 또한, 복수의 GIP회로 (2111a,2111b)는 복수의 드라이브 IC(221a,222a,223a,221b,222b,223b) 중 좌우 양끝단에 배치되어 있는 드라이브 IC(221a,221b)로부터 복수의 게이트구동신호를 전달받아 게이트신호를 생성할 수 있다. 하지만, 이에 한정되는 것은 아니며 복수의 GIP 회로(2111a,2111b)가 비액티브 영역의 왼쪽에만 배치되어 있으면 복수의 드라이브 IC(221a,222a,223a,221b,222b,223b) 중 왼쪽 끝단에 배치되어 있는 드라이브 IC(221a)로부터 게이트구동신호를 전달받을 수 있다.
복수의 드라이브 IC(221a,222a,223a,221b,222b,223b)는 패널의 일단에 배치되고 복수의 데이터라인(DL)과 연결되어 데이터신호를 데이터라인(DL)에 전달할 수 있다. 복수의 드라이브 IC(221a,222a,223a,221b,222b,223b)는 6개가 도시되어 있지만, 이에 한정되는 것은 아니다. 또한, 표시패널(210)의 중앙을 중심으로 왼쪽에 배치되어 있는 복수의 드라이브 IC를 제1군의 드라이브 IC(221a,222a,223a) 라고 칭할 수 있고 오른쪽에 배치되어 있는 복수의 드라이브 IC를 제2군의 드라이브 IC(221b,222b,223b) 라고 칭할 수 있다.
제1군의 드라이브 IC(221a,222a,223a) 중 가장 왼쪽에 배치되어 있는 드라이브 IC는 제1드라이브 IC(221a)로 칭할 수 있고 제1드라이브 IC(221a)는 표시패널(210) 상의 왼쪽에 배치되어 있는 비액티브영역(211a,211b)에 형성되어 있는 GIP 회로(2111a,2111b)에 복수의 게이트구동신호를 전달할 수 있고, 제2군의 드라이브 IC(221b,222b,223b) 중 가장 오른쪽에 배치되어 있는 드라이브 IC는 제2드라이브 IC(221b)라고 칭할 수 있고 제2드라이브 IC(221b)는 표시패널(210) 상의 오른쪽에 배치되어 있는 비액티브영역(211a,211b)에 형성되어 있는 GIP 회로(2111a,2111b)에 복수의 게이트구동신호를 전달할 수 있다. 복수의 게이트제어신호는 제1내지 제10클럭(CLK 1~10), 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호를 포함할 수 있다. 또한, 복수의 게이트제어신호 중 이븐게이트하이전압(VGH_E)은 표시패널(210)의 왼쪽에 배치되어 있는 GIP회로에 전달될 수 있고, 오드 게이트하이전압(VGH_O)은 표시패널(210)의 오른쪽에 배치되어 있는 GIP 회로에 전달될 수 있다.
또한, 제1군의 드라이브 IC(221a,222a,223a)와 제2군의 드라이브 IC(221b,222b,223b)는 데이터제어신호를 전달받아 동작하며, 각각 복수의 데이터라인(DL)과 연결되어 데이터신호를 전달할 수 있다.
제어부(240)는 복수의 드라이브 IC(221a,222a,223a, 221b,222b,223b)에 데이터제어신호와 게이트제어신호를 전달할 수 있다. 또한, 제어부(240)는 복수의 드라이브 IC(221a,222a,223a, 221b,222b,223b)에 디지털 영상신호를 전달할 수 있다. 제어부(240)에서 전달하는 게이트제어신호는 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)일 수 있다. 하지만, 이에 한정되는 것은 아니다.
제어부(240)는 제1군의 드라이브 IC(221a,222a,223a)와 제2군의 드라이브 IC(221b,222b,223b)에 독립적으로 데이터제어신호와 게이트제어신호를 전달할 수 있다. 이를 위해 제어부(240)는 제1군의 드라이브 IC (221a,222a,223a)로 데이터제어신호와 게이트제어신호를 전달하는 제1연결부(241a)와 제2군의 드라이브 IC(221b,222b,223b)로 데이터제어신호와 게이트제어신호를 전달하는 제2연결부(241b)를 포함할 수 있다. 제1연결부(241a)와 제2연결부(241b)는 각각 데이터제어신호와 게이트제어신호를 전달하는 배선(미도시)이 형성되어 있다.
그리고, 제어부(240)에서 전달되는 데이터제어신호와 게이트제어신호를 제1군의 드라이브 IC(221a,222a,223a)와 제2군의 드라이브 IC(221b,222b,223b)로 전달하는 배선이 형성되어 있는 제1PCB(212a)와 제2PCB(212b)가 각각 제어부(240)와 제1군의 드라이브 IC(221a,222a,223a) 사이, 제어부(240)와 제2군의 드라이브 IC(221b,222b,223b) 사이에 배치될 수 있다. 보다 자세히 설명하면, 제어부(240)의 제1연결부(241a)가 제1PCB(212a)의 일단에 연결되고 제1군의 드라이브 IC(221a,222a,223a)가 제1PCB(212a) 타단에 연결된다. 또한, 제어부(240)의 제2연결부(241b)가 제2PCB(212b)의 일단에 연결되고 제2군의 드라이브 IC(221b,222b,223b)가 제2PCB(212b)의 타단에 연결된다. 그리고, 제1PCB(212a)와 제2PCB(212b)는 각각 배선이 형성될 수 있다. 제1PCB(212a)와 제2PCB(212b)에 형성된 배선은 복수의 게이트 제어신호를 전달하는 배선과 소스드라이브 IC에 전달되는 디지털 영상신호, 데이터제어신호일 수 있다.
제1PCB(212a)에 형성되어 있는 배선은 데이터제어신호가 제1군의 드라이브 IC들(221a,222a,223a)로 전달되도록 하고 게이트제어신호가 제1군의 드라이브 IC(221a,222a,223a) 중 가장 왼쪽에 있는 제1드라이브 IC(221a)로 전달되도록 할 수 있다. 제2PCB(212b)에 형성되어 있는 배선은 데이터제어신호가 제2군의 드라이브 IC(221b,222b,223b)로 전달되도록 하고 게이트제어신호가 제2군의 드라이브 IC(221b,222b,223b) 중 가장 오른쪽에 있는 제2드라이브 IC(221b)로 전달되도록 할 수 있다. 제1PCB(212a)와 제2PCB(212b)는 각각 제1회로부와 제2회로부라고 칭할 수 있다.
이 경우, 제어부(240)에서 복수의 게이트제어신호를 출력하여 제1드라이브 IC(221a) 및/또는 제2드라이브 IC(221b)로 전달되고, 제1드라이브 IC(221a) 및/또는 제2드라이브 IC(221b)는 전달된 복수의 게이트제어신호를 복수의 게이트구동신호로 출력할 수 있다. 복수의 게이트제어신호의 수는 복수의 게이트구동신호의 수보다 작기 때문에 제1PCB(212a) 및/또는 제2PCB(212b)에서 제1드라이브 IC(221a) 및/또는 제2드라이브 IC(221b)로 전달되는 복수의 게이트제어신호의 수가 제1드라이브 IC(221a) 및/또는 제2드라이브 IC(221b)에서 출력되는 복수의 게이트구동신호의 수보다 작다. 따라서, 제어부(240)에서 제1드라이브 IC(221a) 및/또는 제2드라이브 IC(221b)로 전달되는 게이트제어신호선이 전송되는 배선의 수를 작게 구현할 수 있어 제1PCB(212a)의 두께를 얇게 구현할 수 있다. 따라서, 제1PCB(212a)의 제조비용을 절감할 수 있다. 여기서, 제1PCB(212a)에 대해서만 설명하고 있지만, 이는 제2PCB(212b)에도 적용할 수 있다.
도 3a는 도 2에 도시된 표시장치에 채용된 제1드라이브 IC의 일 실시예를 나타내는 도면이고, 도 3b는 도 2에 도시된 표시장치에 채용된 제2드라이브 IC의 일 실시예를 나타내는 도면이고, 도 3c는 도 2에 도시된 표시장치에 채용된 제3드라이브 IC의 일 실시예를 나타내는 도면이다.
도 3a를 참조하면, 제1드라이브 IC(221a)는 FPCB(Flexible Printed Circuit Board)(2213a)에 소스 드라이브 IC(2211a) 와 레벨쉬프터(2212a)가 배치될 수 있다. 소스 드라이브 IC(2211a)는 FPCB(2213a)의 오른쪽에 배치되고 레벨쉬프터((2212a)는 FPCB(2213a)의 왼쪽에 배치될 수 있다. 즉, 소스 드라이브 IC(2211a) 와 레벨쉬프터(2212a)는 FPCB(2213a) 상에서 나란하게 배치될 수 있다. 소스 드라이브 IC(2211a) 와 레벨쉬프터(2212a)는 FPCB(2213a) 상에서 서로 다른 배선을 통해 복수의 게이트제어신호와 복수의 데이터제어신호를 전달받을 수 있다.
소스 드라이브 IC(2211a)는 복수의 데이터라인(DL)과 연결되며, 복수의 데이터라인(DL)에 데이터신호를 전달할 수 있다. 소스 드라이브 IC(2211a)는 제어부(240)로부터 데이터제어신호와 디지털 영상신호를 전달받아 데이터신호를 생성하고 복수의 데이터라인(DL)에 전달할 수 있다. 레벨쉬프터(2212a)는 제어부(240)로부터 복수의 게이트제어신호를 전달받을 수 있다. 레벨쉬프터(2212a)는 복수의 GIP회로(2111a)와 연결되며, GIP 회로(2111a)에 게이트구동신호를 전달할 수 있다. 복수의 게이트구동신호는 곧바로 복수의 GIP회로(2111a)로 전달되기 때문에 노이즈의 영향이 적을 수 있다.
도 3b를 참조하면, 제2드라이브 IC(221b)는 FPCB(Flexible Printed Circuit Board)(2213b)에 소스 드라이브 IC(2211b)와 레벨쉬프터(2212b)가 배치될 수 있다. 소스 드라이브 IC(2211b)는 FPCB(2213b)의 왼쪽에 배치되고 레벨쉬프터(2212b)는 FPCB의(2213b) 오른쪽에 배치될 수 있다.
소스 드라이브 IC(2211b)는 복수의 데이터라인(DL)과 연결되며, 복수의 데이터라인(DL)에 데이터신호를 전달할 수 있다. 소스 드라이브 IC(2211b)는 제어부(240)로부터 데이터제어신호와 디지털 영상신호를 전달받아 데이터신호를 생성하고 복수의 데이터라인(DL)에 전달할 수 있다. 레벨쉬프터(2212b)는 제어부(240)로부터 복수의 게이트제어신호를 전달받을 수 있다. 레벨쉬프터(2212b)는 복수의 GIP회로(2111b)와 연결되며, GIP 회로(2111b)에 게이트구동신호를 전달할 수 있다.
제1드라이브 IC(221a)의 소스 드라이브 IC(2211a)와 레벨쉬프터(2212a)가 FPCB(2213a)에 배치되어 있는 순서는 제2드라이브 IC(221b)의 소스 드라이브(2211b)와 레벨쉬프터(2212b)가 FPCB(2213b)에 배치되어 있는 순서와 반대일 수 있다.
도 3c를 참조하면, 제3드라이브 IC(222a)는 소스 드라이브 IC(2221a)가 FPCB(2223a)에 배치될 수 있다. 소스 드라이브 IC(2221a)는 제어부(240)로부터 데이터제어신호와 디지털 영상신호를 전달받아 데이터신호를 생성하고 복수의 데이터라인(DL)에 전달할 수 있다. 또한, 제4드라이브 IC(222b), 제5드라이브 IC(223a), 제6드라이브 IC(223b)는 제3드라이브 IC(222a)와 동일하게 형성될 수 있다.
또한, 제1드라이브 IC(221a), 제2드라이브 IC(221b), 제3드라이브 IC(222a)에 포함되는 각 FPCB(2213a, 2213b, 2223a)는 동일한 크기를 가질 수 있어 하나의 크기를 갖는 FPCB를 사용할 수 있다. 따라서, 드라이브 IC가 배치되는 위치에 대응하여 크기가 다른 FPCB를 제조할 필요가 없다. 여기서, 동일은 완전 동일만을 의미하는 것이 아니라 약간의 크기 차이가 있는 것을 포함할 수 있다.
도 4a는 도 3a에 도시되어 있는 제1레벨쉬프터의 일 실시예를 나타내는 구조도이고, 도 4b는 도 3b에 도시되어 있는 제2레벨쉬프터의 일 실시예를 나타내는 구조도이다.
도 4a를 참조하면, 제1레벨쉬프터(2211a)는 제어부(240)로부터 복수의 게이트제어신호를 전달받아 복수의 게이트구동신호를 전달할 수 있다. 복수의 게이트제어신호는 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)일 수 있다. 또한, 제1레벨쉬프터(2211a)는 복수의 입력핀을 포함하며, 왼쪽에서 오른쪽 방향으로 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)을 전달받을 수 있다. 그리고, 제1레벨쉬프터(2211a)는 전달받은 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)을 이용하여 제1내지 제10클럭(CLK 1~10), 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호(Reset)를 출력할 수 있다. 제1레벨쉬프터(2211a)는 왼쪽에서 오른쪽 방향으로 제1내지 제10클럭(CLK 1~10), 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호(Reset)를 출력할 수 있다.
도 4b를 참조하면, 제2레벨쉬프터(2211b)는 제어부(240)로부터 복수의 게이트제어신호를 전달받아 복수의 게이트구동신호를 전달할 수 있다. 복수의 게이트제어신호는 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)일 수 있다. 또한, 제2레벨쉬프터(2211b)는 오른쪽에서 왼쪽 방향으로 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)을 전달받을 수 있다. 그리고, 제2레벨쉬프터(2211b)는 전달받은 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)을 이용하여 제1내지 제10클럭(CLK 1~10), 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호(Reset)를 출력할 수 있다. 제2레벨쉬프터(2211b)는 오른쪽에서 왼쪽 방향으로 제1내지 제10클럭(CLK 1~10), 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호(Reset)를 출력할 수 있다.
도 5a는 도 4a에 도시되어 있는 제1레벨쉬프터가 제1모드로 동작하도록 결정하는 방법을 나타내는 개념도이고, 도 5b는 도 4b에 도시되어 있는 제2레벨쉬프터가 제2모드로 동작하도록 결정하는 방법을 나타내는 개념도이다.
도 5a 및 도 5b를 참조하면, 제1레벨쉬프터(2211a)는 1번핀(vcc)과 2번핀(CLK_option)에 전원전압(VCC)을 연결할 수 있다. 이렇게 연결되어 1번핀(vcc)과 2번핀(CLK_option)에 각각 전원전압(VCC)이 전달되게 되면 제1레벨쉬프터(2211a)는 하이(H)로 동작할 수 있다. 그리고, 제2레벨쉬프터(2211b)는 1번핀(vcc)에 전원전압(VCC)을 연결하고 2번핀(CLK_option)에 그라운드(GND)를 연결할 수 있다. 이렇게 1번핀(vcc)에 전원전압(VCC)가 전달되고 2번핀(CLK_option)에 그라운드(GND)가 전달되면 제2레벨쉬프터(2211b)는 로우(L)로 동작할 수 있다.
제1레벨쉬프터(2211a)는 하이(H)로 동작하면 표시패널의 왼쪽에 배치되고 제2레벨쉬프터(2211b)가 로우(L)로 동작하면 표시패널의 오른쪽에 배치될 수 있다. 따라서, 제1레벨쉬프터(2211a)와 제2레벨쉬프터는 1번핀(vcc)과 2번핀(CLK_option)에 전달되는 전압을 조절함으로써 표시패널(210)의 왼쪽 또는 오른쪽에 배치될 수 있다. 따라서, 왼쪽과 오른쪽에 배치되는 것을 고려하여 레벨쉬프터를 설계할 필요가 없다.
하기의 표 1은 레벨쉬프터가 하이(H)로 동작하는 경우와 로우(L)로 동작하는 경우 출력핀에서 출력되는 신호를 나타낸다.
| H | L | ||
| P 번호 | 출력신호 | P 번호 | |
| 1 | CLK1 | 1 | CLK10 |
| 2 | CLK2 | 2 | CLK9 |
| 3 | CLK3 | 3 | CLK8 |
| 4 | CLK4 | 4 | CLK7 |
| 5 | CLK5 | 5 | CLK6 |
| 6 | CLK6 | 6 | CLK5 |
| 7 | CLK7 | 7 | CLK4 |
| 8 | CLK8 | 8 | CLK3 |
| 9 | CLK9 | 9 | CLK2 |
| 10 | CLK10 | 10 | CLK1 |
상기 표 1을 보면, 레벨쉬프터가 하이(H)로 동작하는 경우와 로우(L)로 동작하는 경우에 핀에서 나오는 신호의 순서가 역순이 될 수 있다. 그리고, 레벨쉬프터가 표시패널의 좌, 우에 배치되는 것에 따라 출력되는 신호의 순서가 바뀌도록 함으로써 제어부에서 레벨쉬프터로 전달되는 신호의 배선이 꼬이지 않도록 할 수 있다.
도 6은 도 2에 도시되어 있는 제1PCB의 일 실시예를 나타내는 개념도이다.
도 6을 참조하면, 제1PCB(212a)는 입력패드(IN)에서 5개의 게이트제어신호를 입력받아 출력패드(OUT)으로 전달할 수 있다. 5개의 게이트제어신호는 5개의 배선을 통해 각각 전달될 수 있다. 이로써, 제1PCB(212a)에는 게이트제어신호를 전달하는 배선이 5개의 라인을 포함할 수 있다. 또한, 5개의 배선은 제1PCB(212a)의 일 구간에서 수평방향으로 배치될 수 있다. 제1PCB(212a) 두께는 5개의 배선의 폭에 의해 결정될 수 있다. 여기서, 수평방향은 제1PCB(212a)의 길이가 긴 방향일 수 있다. 또한, 일 구간은 입력패드(IN)와 출력패드(OUT)이 수직으로 나란하지 않도록 할 수 있는 거리를 의미할 수 있다. 여기서, 제1PCB(212a)에 대해서 도시하고 있지만, 도 2에 도시된 제2PCB(212b)에도 동일하게 적용될 수 있다.
도 7은 도 2에 도시되어 있는 제1드라이브 IC의 다른 일 실시예를 나타내는 개념도이다.
도 7을 참조하면, 제1드라이브 IC(721a)는 소스 드라이브 IC(7112)가 가운데 배치되고 소스 드라이브 IC(7112)의 양측에 각각 제어부에서 전달되는 신호들의 배선(7111a, 7111b)이 형성될 수 있다. 이 경우 제어부는 레벨쉬프터(미도시)를 포함하고 제어부에서 레벨쉬프터로 복수의 게이트제어신호를 전달하고 레벨쉬프터에서 복수의 게이트제어신호를 복수의 게이트구동신호로 변경하여 출력할 수 있다. 그리고, 복수의 게이트제어신호는, 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)를 포함하고 복수의 게이트구동신호는 제1내지 제10클럭, 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호(Reset)를 포함하기 때문에 소스 드라이브 IC(7112)의 양측에 배치되어 있는 배선(7111a, 7111b)의 라인의 수는 14개일 수 있다.
또한, 복수의 게이트구동신호는 제어부에 연결된 레벨쉬프터에서 출력되어 제1PCB(212a)와 제1드라이브 IC(721a)에 형성되어 있는 배선(7111a, 7111b)을 거쳐 GIP 회로에 전달되기 때문에 복수의 게이트구동신호가 전달되는 배선의 길이가 길게 될 수 있다. 이로 인해 복수의 게이트구동신호는 노이즈의 영향을 많이 받게 될 수 있다.
도 8은 도 2에 도시되어 있는 제1PCB의 다른 일 실시예를 나타내는 개념도이다.
도 8을 참조하면, 제1PCB(812a)는 입력패드(IN)에서 14개의 게이트구동신호를 입력받아 출력패드(OUT)으로 전달할 수 있다. 이로써, 제1PCB(812a)에는 게이트제어신호를 전달하는 배선이 14개의 라인을 포함할 수 있다. 따라서, 도 6에 도시되어 있는 것과 제1PCB(212a) 보다 배선이 포함하는 라인의 수가 9개가 더 많고 배선은 수평방향으로 진행되기 때문에 도 6에 도시되어 있는 제1 PCB(212a) 보다 폭이 더 두꺼워지게 될 수 있다. 제1PCB(812a)의 폭은 세로 방향의 길이를 의미할 수 있다.
이상에서의 설명 및 첨부된 도면은 본 발명의 기술 사상을 예시적으로 나타낸 것에 불과한 것으로서, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자라면 본 발명의 본질적인 특성에서 벗어나지 않는 범위에서 구성의 결합, 분리, 치환 및 변경 등의 다양한 수정 및 변형이 가능할 것이다. 따라서, 본 발명에 개시된 실시예들은 본 발명의 기술 사상을 한정하기 위한 것이 아니라 설명하기 위한 것이고, 이러한 실시예에 의하여 본 발명의 기술 사상의 범위가 한정되는 것은 아니다. 본 발명의 보호 범위는 아래의 청구범위에 의하여 해석되어야 하며, 그와 동등한 범위 내에 있는 모든 기술 사상은 본 발명의 권리범위에 포함되는 것으로 해석되어야 할 것이다.
200: 표시장치
210: 표시패널
210a: 액티브 영역
211a,211b: 비액티브 영역
212a, 212b: 제1PCB, 제2PCB
221a, 222a, 223a: 제1군의 드라이브 IC
221b, 222b, 223b: 제2군의 드라이브 IC
240: 제어부
241a, 241b: 제1연결부, 제2연결부
2111a,2111b: GIP 회로
GL: 게이트라인
DL: 데이터라인
210: 표시패널
210a: 액티브 영역
211a,211b: 비액티브 영역
212a, 212b: 제1PCB, 제2PCB
221a, 222a, 223a: 제1군의 드라이브 IC
221b, 222b, 223b: 제2군의 드라이브 IC
240: 제어부
241a, 241b: 제1연결부, 제2연결부
2111a,2111b: GIP 회로
GL: 게이트라인
DL: 데이터라인
Claims (12)
- 복수의 게이트제어신호를 전달받아 복수의 게이트구동신호를 출력하되, 상기 복수의 게이트구동신호의 수가 상기 복수의 게이트제어신호보다 많도록 출력하는 레벨쉬프터; 및
복수의 데이터제어신호를 전달받아 데이터신호를 출력하는 소스 드라이브 IC를 포함하는 드라이브 IC. - 제1항에 있어서,
상기 복수의 게이트제어신호는, 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)를 포함하고, 상기 복수의 게이트구동신호는 제1내지 제10클럭, 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호(Reset)를 포함하는 드라이브 IC. - 제1항에 있어서,
상기 레벨쉬프터와 상기 소스 드라이브 IC는 하나의 보드에 형성되고, 상기 레벨쉬프터와 상기 소스 드라이브 IC는 상기 보드 상에서 나란하게 배치되는 드라이브 IC. - 복수의 게이트라인과 복수의 데이터라인이 교차하는 영역에 화소가 형성되는 표시패널;
상기 복수의 게이트라인과 상기 복수의 데이터라인에 게이트신호와 데이터터신호를 전달하여 상기 표시패널을 구동하는 복수의 드라이브 IC; 및
복수의 게이트제어신호와 복수의 데이터제어신호를 출력하는 제어부를 포함하되,
상기 복수의 드라이브 IC는 제1드라이브 IC와 제2드라이브 IC를 포함하고, 상기 제1드라이브 IC와 상기 제2드라이브 IC는 제1항 내지 제3항 중 어느 하나의 항에 의한 드라이브 IC인 표시장치. - 제4항에 있어서,
상기 표시패널은 상기 게이트라인에 게이트신호를 구동하는 GIP회로를 더 포함하고, 상기 복수의 게이트구동신호는 상기 GIP회로에 공급되는 표시장치. - 제4항에 있어서,
상기 제1드라이브 IC는 상기 표시패널의 왼쪽 끝단에 배치되고 상기 제2드라이브 IC는 상기 표시패널의 오른쪽 끝단에 배치되고, 상기 제1드라이브 IC의 레벨쉬프터의 복수의 출력채널은 상기 제2드라이브 IC의 복수의 출력채널과 역순으로 배치되는 표시장치. - 제4항에 있어서,
상기 복수의 게이트제어신호를 전달받아 상기 복수의 게이트라인 중 홀수번째 게이트라인에 대응하는 제1게이트구동신호를 출력하는 제1드라이브 IC를 포함하는 제1군의 드라이브 IC;
상기 복수의 게이트제어신호를 전달받아 상기 복수의 게이트라인 중 짝수번째 게이트라인에 대응하는 제2게이트구동신호를 출력하는 제2드라이브 IC를 포함하는 제2군의 드라이브 IC;
상기 제어부와 상기 제1군의 드라이브 IC를 연결하는 제1회로부; 및
상기 제어부와 상기 제2군의 드라이브 IC를 연결하는 제2회로부;를 포함하며,
상기 제1회로부와 상기 제2회로부는 상기 복수의 게이트제어신호를 전달하는 배선이 일구간에서 수평방향으로 배치되는 표시장치. - 복수의 게이트라인과 복수의 데이터라인이 교차하는 영역에 화소가 형성되는 표시패널;
상기 표시패널의 구동을 제어하는 복수의 게이트제어신호를 출력하는 제어부;
상기 복수의 게이트제어신호를 전달받아 상기 복수의 게이트라인 중 홀수번째 게이트라인에 대응하는 제1게이트구동신호를 출력하는 제1드라이브 IC를 포함하는 제1군의 드라이브 IC;
상기 복수의 게이트제어신호를 전달받아 상기 복수의 게이트라인 중 짝수번째 게이트라인에 대응하는 제2게이트구동신호를 출력하는 제2드라이브 IC를 포함하는 제2군의 드라이브 IC;
상기 제어부와 상기 제1군의 드라이브 IC를 연결하는 제1회로부;
상기 제어부와 상기 제2군의 드라이브 IC를 연결하는 제2회로부;를 포함하되,
상기 제1드라이브 IC와 상기 제2드라이브 IC는 각각 레벨쉬프터와 소스 드라이브 IC를 포함하는 표시장치. - 제8항에 있어서,
상기 제1드라이브 IC는 상기 표시패널의 왼쪽 끝단에 배치되고 상기 제2드라이브 IC는 상기 표시패널의 오른쪽 끝단에 배치되고, 상기 제1드라이브 IC의 레벨쉬프터의 복수의 출력채널은 상기 제2드라이브 IC의 복수의 출력채널과 역순으로 배치되는 표시장치. - 제8항에 있어서,
상기 표시패널은 상기 게이트라인에 게이트신호를 전달하는 복수의 GIP회로를 더 포함하고, 상기 제1게이트구동신호는 상기 홀수번째 게이트라인에 연결된 GIP회로에 공급되고 상기 제2게이트구동신호는 짝수번째 게이트라인에 연결된 GIP 회로에 공급되는 표시장치. - 제8항에 있어서,
상기 복수의 게이트제어신호는 이븐/오드(E/O) 클럭, 게이트스타트 펄스(GST), 게이트 시프트 클럭(GCLK), 변조 타이밍 시프트 클럭(MCLK), 전원전압(VCC)를 포함하고, 상기 복수의 제1게이트구동신호 및 상기 복수의 제2게이트구동신호는 각각 제1내지 제10클럭(CLK 1~10), 이븐게이트하이전압(VGH_E), 오드 게이트하이전압(VGH_O), 스타트 펄스(VST), 리셋신호(Reset)를 포함하는 표시장치. - 제8항에 있어서,
상기 제1회로부와 상기 제2회로부는 상기 복수의 게이트제어신호를 전달하는 배선이 일구간에서 수평방향으로 배치되는 표시장치.
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|---|---|---|---|
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| KR1020160162346A KR102596604B1 (ko) | 2016-11-30 | 2016-11-30 | 드라이브 ic 및 그를 이용한 표시장치 |
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Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20200046645A (ko) * | 2018-10-25 | 2020-05-07 | 엘지디스플레이 주식회사 | 레벨 시프터 인터페이스와 이를 이용한 표시장치 |
| KR20200071442A (ko) * | 2018-12-11 | 2020-06-19 | 엘지디스플레이 주식회사 | 표시 장치 |
Citations (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR20070037012A (ko) * | 2005-09-30 | 2007-04-04 | 엘지.필립스 엘시디 주식회사 | 액정 표시 장치의 구동 장치 및 그 구동 방법 |
| KR20120063368A (ko) * | 2010-12-07 | 2012-06-15 | 엘지디스플레이 주식회사 | 입체 영상 표시장치 |
| KR20130067161A (ko) * | 2011-12-13 | 2013-06-21 | 엘지디스플레이 주식회사 | 표시장치 |
-
2016
- 2016-11-30 KR KR1020160162346A patent/KR102596604B1/ko active IP Right Grant
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| Publication number | Publication date |
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