KR20180025392A - 칩온필름 및 그를 구비한 표시장치 - Google Patents
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Abstract
본 발명은 배선 사이의 투습에 의한 배선의 마이그레이션으로 쇼트가 발생하는 것을 방지할 수 있는 칩온필름 및 이를 이용한 표시장치에 관한 것으로, 서로 대향하는 양측 단부에 일정 거리를 두고 각각 배치되는 제 1 본딩부 및 제 2 본딩부를 포함하는 베이스층; 상기 베이스층에 실장되며, 상기 제 1 및 제 2 본딩부 사이에 배치되는 IC: 상기 베이스층에서 상기 제 1 본딩부, 상기 IC, 및 상기 제 2 본딩부를 경유하도록 서로 나란하게 배치되는 복수의 신호라인들; 상기 베이스층의 상기 IC 외측에서 상기 제 1 본딩부, 및 상기 제 2 본딩부를 경유하도록 상기 복수의 신호라인들과 나란하게 배치되는, 적어도 하나의 전원전압 공급라인; 및 상기 베이스층에 형성되며, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인 중 서로 이웃하는 것들 사이의 적어도 일부 영역에 각각 배치되는 분리소자를 포함하는 칩온필름을 특징으로 한다.
Description
본 발명은 칩온필름(Chip-On-Film) 및 그를 구비한 표시장치에 관한 것으로, 특히 배선의 마이그레이션(migration)으로 인한 배선간 쇼트를 방지할 수 있는 칩온필름 및 그를 구비하는 표시장치에 관한 것이다.
휴대전화, 태블릿PC, 노트북 등을 포함한 다양한 종류의 전자제품에는 평판 표시장치(FPD: Flat Panel Display Device)가 이용되고 있다. 평판 표시장치에는, 액정표시장치(LCD: Liquid Crystal Display Device), 플라즈마 표시장치(PDP: Plasma Display Device), 발광표시장치(Light Emitting Display Device) 등이 있으며, 최근에는 전기영동 표시장치(EPD: Electrophoretic Display Device)도 널리 이용되고 있다.
이들 평판 표시장치는 일반적으로 영상을 표시하기 위한 표시패널과, 표시패널를 제어하기 위한 제어부를 구비하는 콘트롤 PCB(Printed Circuit Board, PCB) 및 소스 PCB와, 표시패널과 소스 PCB를 연결하는 칩온필름(Chip On Film,COF)를 포함한다.
이하, 도 1 내지 도 4를 참조하여, 종래의 표시장치에 대해 보다 구체적으로 설명하기로 한다.
도 1은 종래의 표시장치를 개략적으로 도시한 블록도이고, 도 2는 도 1의 표시장치의 1화소에 대한 등가 회로도이며, 도 3은 도 1에 도시된 칩온필름의 일부 영역의 배선배치를 개략적으로 도시한 평면도이고, 도 4는 도 3의 I-I'라인을 따라 취한 단면도이다. 도 1 내지 도 4는 종래의 유기발광 표시장치를 예로 들고 있으나, 이하에서는 편의상 표시장치로 표시하기 한다.
도 1을 참조하면, 종래의 표시장치는 콘트롤 PCB(20), 소스 PCB(22), 소스 PCB(22)와 콘트롤 PCB(20)에 연결된 케이블(21), 소스 PCB(22)와 액정표시패널(25)에 연결된 다수의 소스 COF(24)를 포함한다.
소스 COF(24)는 소스 PCB(22)의 패드들과 표시패널(25)의 데이터패드들에 전기적으로 접속된다. 소스 COF(24)에는 데이터 집적회로(Integrated Circuit 이하 "IC"라 함)(23)가 실장된다.
소스 PCB(22)에는 콘트롤 PCB(20)로부터의 디지털 비디오 데이터들과 타이밍 제어신호들을 전송하기 위한 신호배선들(SL)이 형성된다.
콘트롤 PCB(20)에는 제어회로와 데이터 전송회로 등이 실장된다. 이 콘트롤 PCB(20)는 데이터와 함께 데이터 IC(23)의 동작을 제어하기 위한 타이밍 제어신호들을 케이블(21)과 소스 PCB(22)를 통해 소스 COF(24)의 데이터 IC(23)에 공급한다.
최근, 표시장치의 고해상도 요구에 따라, 소스 COF(24)에는 좁은 면적에 각종 신호배선과 함께 전원배선이 고밀도로 배치되고 있다. 특히, 유기 발광표시장치의 경우, 도 2에 도시된 바와 같이, 비디오 데이터를 전송하기 위한 데이터 신호 전송라인(Vdata)뿐 아니라, 고전위 전원전압을 공급하는 고전위 공급라인(Vdd) 및 기저전위를 공급하는 기저전위 공급라인(Vss)도 형성된다.
도 2를 참조하면, 종래의 유기발광 표시장치는 게이트 라인들(GL)과 데이터 라인들(DL)이 교차하는 영역마다 화소가 형성되어 있으며, 각 화소에는 화소 회로가 형성되어 있다.
화소 회로는 스위칭 트랜지스터(ST), 구동 트랜지스터(DT), 캐패시터(C) 및 발광소자(OLED)를 구비한다.
스위칭 트랜지스터(ST)는 게이트 라인(GL)에 공급되는 스캔신호에 따라 스위칭되어 데이터 라인(DL)에 공급되는 데이터 전압(Vdata)을 구동 트랜지스터(DT)에 공급한다.
구동 트랜지스터(DT)는 스위칭 트랜지스터(ST)로부터 공급되는 데이터 전압(Vdata)에 따라 스위칭되어, 고전위 전원전압(Vdd)으로부터 발광소자(OLED)로 흐르는 전류(Ioled)를 제어한다.
캐패시터(C)는 구동 트랜지스터(DT)의 게이트 단자에 접속되어, 구동 트랜지스터(DT)의 게이트 단자에 공급되는 데이터 전압(Vdata)에 대응되는 전압을 저장하고, 저장된 전압으로 구동 트랜지스터(DT)를 턴온시킨다.
발광소자(OLED)는 구동 트랜지스터(DT)와 저전위 전원전압(Vss) 사이에 전기적으로 접속되어, 구동 트랜지스터(DT)로부터 공급되는 전류(Ioled)에 의해 발광한다. 이때, 발광소자(OLED)에 흐르는 전류(Ioled)는 구동 트랜지스터(DT)의 게이트-소스 사이의 전압, 즉, 구동 트랜지스터(DT)의 문턱전압 및 데이터 전압(Vdata)에 따라 결정된다.
상술한 바와 같이 종래의 유기발광 표시장치의 화소 회로는, 구동 트랜지스터(DT)의 게이트 단자에 공급되는 데이터 전압(Vdata)에 따라, 고전위 전원전압(Vdd)으로부터 발광소자(OLED)로 흐르는 전류(Ioled)의 크기를 제어하여, 발광소자(OLED)를 발광시키며, 이에 따라, 영상이 표시패널에 표시된다.
도 3 및 도 4를 참조하면 데이터 신호를 공급하는 데이터 신호 공급라인(Vdata)과, 고전위 전원전압(Vdd) 및 기저전위 전원전압(Vss)을 공급하는 전원 공급라인들(이하, Vdd, Vss로도 표시함)은 베이스층(BL)의 동일 평면상에서 매우 좁은 간격으로 배치되어 있다.
따라서, 종래의 표시장치에 적용된 칩온필름에서는 표시패널의 패드들 및 소스 PCB의 패드들과 연결을 위해 보호층이 제거되어 노출된 개구부를 통해 투습(습기침투)이 발생될 수 있다. 이러한 투습에 따라 서로 인접한 신호 공급라인, 전원 공급라인들은 마이그레이션(migration) 등에 의해 의도치 않게 서로 접촉할 수 있으며, 이 경우 쇼트에 의한 손상이 초래될 수 있는 문제점이 있었다.
따라서, 본 발명은 투습에 의한 마이그레이션으로 배선간 쇼트가 발생할 수 있는 상기 문제점들을 해결하기 위한 것으로, 칩온필름 상의 고집적 배선간의 쇼트를 방지할 수 있는 칩온필름 및 그를 이용한 표시장치를 제공하는 것을 목적으로 한다.
상술한 목적을 달성하기 위하여, 본 발명에 따르는 칩온필름은 서로 대향하는 양측 단부에 일정 거리를 두고 각각 배치되는 제 1 본딩부 및 제 2 본딩부를 포함하는 베이스층; 상기 베이스층에 실장되며, 상기 제 1 및 제 2 본딩부 사이에 배치되는 IC: 상기 베이스층에서 상기 제 1 본딩부, 상기 IC, 및 상기 제 2 본딩부를 경유하도록 서로 나란하게 배치되는 복수의 신호라인들; 상기 베이스층의 상기 IC 외측에서 상기 제 1 본딩부, 및 상기 제 2 본딩부를 경유하도록 상기 복수의 신호라인들과 나란하게 배치되는, 적어도 하나의 전원전압 공급라인; 및 상기 베이스층에 형성되며, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인 중 서로 이웃하는 것들 사이의 적어도 일부 영역에 각각 배치되는 분리소자를 포함한다.
상기 구성에서, 상기 분리소자는 상기 베이스층에 형성되는 오목부, 볼록부 중의 적어도 하나일 수 있다.
또한, 상기 베이스층은, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인을 노출시키는 개구영역을 갖는 상기 제 1 본딩부와 상기 제 2 본딩부 사이에서, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인을 커버하는 보호층을 갖는 비개구 영역을 더 포함할 수 있다.
또한, 상기 분리소자는 상기 제 1 본딩부와 상기 제 2 본딩부 중의 적어도 하나의 영역에 배치될 수 있다.
이와 달리, 상기 분리소자는 상기 제 1 본딩부와 상기 제 2 본딩부 외측의 개구영역에 배치될 수 있다.
또한, 상기 분리소자는 제 1 본딩부와 상기 제 2 본딩부 중의 적어도 하나의 영역과, 상기 제 1 본딩부와 상기 제 2 본딩부 외측의 개구영역에 배치될 수 있다.
상술한 목적을 달성하기 위하여, 본 발명에 따르는 칩온필름은 또한 서로 대향하는 양측 단부에 일정 거리를 두고 각각 배치되는 제 1 본딩부 및 제 2 본딩부를 포함하는 베이스층; 상기 베이스층에 실장되며, 상기 제 1 및 제 2 본딩부 사이에 배치되는 IC: 상기 베이스층에서 상기 IC를 경유하도록 서로 나란하게 배치되는 복수의 신호라인들; 상기 제 1 본딩부에 배치되며, 상기 복수의 신호라인들 일단부들로부터 각각 연장된 복수의 제 1 패드들; 상기 제 2 본딩부에 배치되며, 상기 복수의 신호라인들 타단부들로부터 각각 연장된 복수의 제 2 패드들; 상기 베이스층의 상기 IC 외측에서 상기 복수의 신호라인들과 나란하게 배치되는 적어도 하나의 전원전압 공급라인; 상기 제 1 본딩부에 배치되며, 상기 적어도 하나의 전원공급라인의 일단부로부터 연장되는 제 3 패드; 상기 제 2 본딩부에 배치되며, 상기 적어도 하나의 전원공급라인의 타단부로부터 연장되는 제 4 패드; 및 상기 베이스층에 형성되며, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인 중 서로 이웃하는 것들 사이의 적어도 일부 영역에 각각 배치되는 분리소자를 포함한다.
상기 구성에서, 상기 분리소자는 상기 베이스층에 형성되는 오목부, 볼록부 중의 적어도 하나일 수 있다.
상술한 목적을 달성하기 위하여, 본 발명에 따르는 표시장치는 표시영역과 비표시영역을 포함하며, 상기 표시영역에 복수의 화소들을 포함하는 표시패널; 상기 표시패널의 비표시부에 일측이 전기적으로 결합되어 상기 복수의 화소들에 적어도 하나의 전원전압과 복수의 데이터 신호들을 공급하기 위한 제 1 항 내지 제 8 항 중 어느 한 항 기재의 칩온필름; 상기 칩온필름의 타측에 전기적으로 결합되어, 상기 칩온필름에 상기 적어도 하나의 전원전압을 공급하기 위한 전원공급부와, 상기 복수의 데이터 신호들을 공급하기 위한 타이밍 콘트롤러가 실장된 소스 PCB를 포함한다.
본 발명에 따르는 칩온필름 및 그를 구비한 표시장치에 의하면, 서로 인접한 신호 공급라인들 및 전원전압 공급라인들 사이에 마이그레이션(migration)을 방지할 수 있는 분리소자가 배치되므로, 투습에 의해 이들이 이동되더라도 분리소자에 의해 서로 접촉되지는 않게 된다. 따라서, 칩온필름의 서로 인접한 신호 공급라인들 및 전원전압 공급라인들 사이의 의도치 않은 쇼트를 방지할 수 있는 효과를 얻을 수 있다.
도 1은 종래의 표시장치를 개략적으로 도시한 블록도,
도 2는 도 1의 표시장치의 1화소에 대한 등가 회로도,
도 3은 도 1에 도시된 칩온필름의 일부 영역의 배선배치를 개략적으로 도시한 평면도,
도 4는 도 3의 I-I'라인을 따라 취한 단면도,
도 5는 본 발명의 실시예에 따르는 유기발광 표시장치를 개략적으로 도시한 블록도,
도 6은 도 5의 유기발광 표시장치의 표시패널의 1화소영역을 개략적으로 도시한 등가 회로도,
도 7은 도 5에 도시된 유기발광 표시장치에 적용된 칩온필름을 개략적으로 도시한 평면도,
도 8은 도 7의 I-I'라인을 따라 취한 단면도,
도 9a는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 2 예를 도시한 평면도,
도 9b는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 3 예를 도시한 평면도,
도 9c는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 4 예를 도시한 평면도,
도 9d는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 5 예를 도시한 평면도,
도 9e는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 6 예를 도시한 평면도,
도 10a는 도 9a 내지 9e의 II-II'라인을 따라 취한 제 1 예의 단면도,
도 10b는 도 9a 내지 9e의 II-II'라인을 따라 취한 제 2 예의 단면도.
도 2는 도 1의 표시장치의 1화소에 대한 등가 회로도,
도 3은 도 1에 도시된 칩온필름의 일부 영역의 배선배치를 개략적으로 도시한 평면도,
도 4는 도 3의 I-I'라인을 따라 취한 단면도,
도 5는 본 발명의 실시예에 따르는 유기발광 표시장치를 개략적으로 도시한 블록도,
도 6은 도 5의 유기발광 표시장치의 표시패널의 1화소영역을 개략적으로 도시한 등가 회로도,
도 7은 도 5에 도시된 유기발광 표시장치에 적용된 칩온필름을 개략적으로 도시한 평면도,
도 8은 도 7의 I-I'라인을 따라 취한 단면도,
도 9a는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 2 예를 도시한 평면도,
도 9b는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 3 예를 도시한 평면도,
도 9c는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 4 예를 도시한 평면도,
도 9d는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 5 예를 도시한 평면도,
도 9e는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 6 예를 도시한 평면도,
도 10a는 도 9a 내지 9e의 II-II'라인을 따라 취한 제 1 예의 단면도,
도 10b는 도 9a 내지 9e의 II-II'라인을 따라 취한 제 2 예의 단면도.
이하, 첨부 도면을 참조하여 본 발명에 따른 바람직한 실시예들에 대해 상세히 설명하기로 한다. 명세서 전체에 걸쳐서 동일한 참조번호들은 실질적으로 동일한 구성요소들을 의미한다. 이하의 설명에서, 본 발명과 관련된 공지 기능 혹은 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우, 그 상세한 설명을 생략한다. 또한, 이하의 설명에서 사용되는 구성요소의 명칭은 명세서 작성의 용이함을 고려하여 선택된 것일 수 있는 것으로서, 실제 제품의 부품 명칭과는 상이할 수 있다.
이하, 도 5 및 도 6을 참조하여, 본 발명의 실시예에 따르는 유기발광 표시장치에 대해 구체적으로 설명하기로 한다. 본 발명의 실시예의 설명에서는 표시장치로서 유기발광 표시장치를 예로 들어 설명하고 있으나, 본 발명이 이에 한정되는 것은 아니며, 다른 평판 표시장치도 포함하는 것으로 이해되어야 한다.
도 5는 본 발명의 실시예에 따르는 유기발광 표시장치를 개략적으로 도시한 블록도이고, 도 6은 도 5의 유기발광 표시장치의 표시패널의 1화소영역을 개략적으로 도시한 등가 회로도이다.
도 5 및 도 6을 참조하면, 본 발명에 따르는 유기발광 표시장치는 표시패널(DP), 표시패널(DP)의 일측에 배치된 게이트 드라이브 IC(GIC), 표시패널(DP)의 다른 일측에 일단부가 부착되며, 소스 드라이브 IC(DIC)가 실장된 칩온필름들(Chip on film)(COF), 및 칩온필름들의 타단부에 부착되며 타이밍 컨트롤러(TC)와 전원 공급부(PS)가 실장된 소스 PCB(Printed Circuit Board)(SPCB)를 포함한다.
소스 드라이브 IC(DIC)는 타이밍 콘트롤러(TC)로부터 입력되는 디지털 비디오 데이터(RGB)를 변환하여 데이터전압을 발생한다. 소스 드라이브 IC(DIC)로부터 출력된 데이터 전압은 데이터라인들(DL)에 공급된다.
게이트 드라이브 IC(GIC)는 데이터전압에 동기되는 게이트펄스를 게이트라인들(GL)에 순차적으로 공급하여 데이터 전압이 기입되는 표시 패널(DP)의 화소들을 선택한다.
타이밍 콘트롤러(TC)는 호스트 시스템(도시생략)으로부터 입력되는 수직 동기신호, 수평 동기신호, 데이터 인에이블 신호, 메인 클럭등의 타이밍신호를 입력 받아 데이터 구동부(DD)와 게이트 구동부(GD)의 동작 타이밍을 동기시킨다. 소스 드라이브 IC(DIC)를 제어하기 위한 데이터 타이밍 제어신호는 소스 샘플링 클럭(Source Sampling Clock), 소스 출력 인에이블신호(Source Output Enable) 등을 포함한다. 게이트 드라이브 IC(GIC)를 제어하기 위한 게이트 타이밍 제어신호는 게이트 스타트 펄스(Gate Start Pulse), 게이트 쉬프트 클럭(Gate Shift Clock), 게이트 출력 인에이블신호(Gate Output Enable) 등을 포함한다.
호스트 시스템(도시생략)은 텔레비전 시스템, 셋톱박스, 네비게이션 시스템, DVD 플레이어, 블루레이 플레이어, 개인용 컴퓨터(PC), 홈 시어터 시스템(Home Theater System), 폰 시스템(Phone System) 중 어느 하나로 구현될 수 있다. 호스트 시스템은 스케일러(scaler)를 내장한 SoC(System on chip)을 포함하여 입력 영상의 디지털 비디오 데이터(RGB)를 표시 패널(DP)에 표시하기에 적합한 포맷으로 변환한다. 호스트 시스템은 디지털 비디오 데이터와 함께 타이밍 신호들을 타이밍 콘트롤러(TC)로 전송한다.
표시패널(DP)의 화소 어레이는 서로 교차하도록 배치된 복수의 게이트 라인들(GL) 및 복수의 데이터 라인들(DL)들과, 이들의 교차 영역마다 배치되는 화소들을 포함한다.
도 6을 참조하면, 각 화소는 유기발광 다이오드(OLED), 구동 TFT(DT), 스토리지 캐패시터(Cst), 제 1 스위칭 TFT(ST), 및 제 2 스위칭 TFT(ST2)를 구비할 수 있다.
화소를 구성하는 TFT들은 p 타입, 또는, n 타입으로 구현될 수 있다. 또한, 화소를 구성하는 TFT들의 반도체층은, 비정질 실리콘 또는, 폴리 실리콘 또는, 산화물을 포함할 수 있다. 유기발광 다이오드(OLED)는 애노드 전극, 캐소드 전극, 및 애노드 전극과 캐소드 전극(CAT) 사이에 개재된 유기 발광층(도시 생략)을 포함한다.
유기발광 다이오드(OLED)는 애노드전극과 캐소드전극 사이에 위치하는 유기 화합물층을 포함한다. 유기 화합물층은 발광층(Emission layer, EML)을 포함하고, 발광층을 사이에 두고 정공 주입층(Hole injection layer, HIL) 및 정공 수송층(Hole transport layer, HTL)과 전자 수송층(Electron transport layer, ETL) 및 전자주입층(Electron injection layer, EIL)이 배치될 수 있다.
유기발광 다이오드(OLED)의 애노드전극은 제 2 노드(N2)에 접속되고, 캐소드전극은 저전위 전원전압(Vss)의 입력단에 접속된다.
구동 TFT(DT)는 게이트-소스 간 전압(Vgs)에 따라 OLED에 흐르는 전류를 제어한다. 구동 TFT(DT)는 제 1 노드(N1)에 접속된 게이트전극, 고전위 전원전압(Vdd)의 입력단에 접속된 드레인전극, 및 제 2 노드(N2)에 접속된 소스전극을 구비한다.
스토리지 캐패시터(Cst)는 제 1 노드(N1)와 제 2 노드(N2) 사이에 접속된다.
제 1 스위칭 TFT(ST1)는 제 1 게이트라인(GL1)을 통해 공급되는 제1 게이트펄스(SCAN)에 응답하여 턴 온 됨으로써, 데이터전압 공급라인에 충전된 데이터전압(Vdata)을 제1 노드(N1)에 인가한다. 제 1 스위칭 TFT(ST1)는 제 1 게이트라인(GL1)에 접속된 게이트전극, 데이터전압 공급라인(DL)에 접속된 드레인전극, 및 제 1 노드(N1)에 접속된 소스전극을 구비한다.
제 2 스위칭 TFT(ST2)는 제 2 게이트라인(GL2)을 통해 공급되는 제2 게이트펄스(SEN)에 응답하여 턴 온 됨으로써, 기준전압 공급라인(RL)에 충전된 기준전압(Vref)을 제2 노드(N2)에 인가한다. 제 2 스위칭 TFT(ST2)의 게이트전극은 제 2 게이트라인(GL2)에 접속되고, 제2 스위칭 TFT(ST2)의 드레인전극은 제 2 노드(N2)에 접속되며, 제 2 스위칭 TFT(ST2)의 소스전극은 기준전압 공급라인(RL)에 접속된다.
구동 TFT(DT)는 스토리지 캐패시터에 충전된 전압의 크기에 따라 유기발광 다이오드(OLED)로 공급되는 전류량을 제어하여 유기발광 다이오드(OLED)의 발광량을 조절한다. 유기발광 다이오드(OLED)의 발광량은 구동 TFT(DT)로부터 공급되는 전류량에 비례한다.
각각의 화소는 전원 공급부(PS)로부터 고전위 전원전압(Vdd), 기준전위 전원전압(Vref), 및 저전위 전원전압(Vss)을 공급받는다.
다음으로 도 7 및 도 8을 참조하여, 본 발명의 실시예에 따르는 유기발광 표시장치에 적용되는 칩온필름(COF)에 대해 설명하기로 한다.
도 7은 도 5에 도시된 유기발광 표시장치에 적용된 칩온필름을 개략적으로 도시한 평면도이고, 도 8은 도 7의 I-I'라인을 따라 취한 단면도이다.
도 7 및 도 8을 참조하면, 본 발명의 실시예에 따른 칩온필름(COF)은 그 일측에서 소스 PCB(SPCB)의 패드들(도시생략)과 콘택하는 제 1 패드들(PAD1a~PAD1d)이 형성되는 제 1 패드영역(PA1)과, 타측에서 표시패널(DP)의 패드들(도시생략)과 콘택하는 제 2 패드들(PAD2a~PAD2d)이 형성되는 제 2 패드영역(PA2)과, 제 1 패드영역(PA1)과 제 2 패드영역(PA2) 사이에 실장되는 소스 IC(DIC)를 포함한다. 제 1 패드영역(PA1)과 제 2 패드영역(PA2)은 보호층(PL)이 제거되는 영역으로 제 1 패드들(PAD1a~PAD1d)과 제 2 패드들(PAD2a~PAD2d)이 노출되는 개구부를 형성한다. 제 1 패드영역(PA1)과 제 2 패드영역(PA2) 각각의 양측에는 보호층(PL)이 제거된 여유 영역으로서의 제 1 및 제 2 개구부들(OP1, OP2)이 각각 형성된다.
제 1 패드들(PAD1a~PAD1d)은 데이터 신호 입력패드(PAD1a), 고전위 전원전압 입력패드(PAD1b), 기준전위 전원전압 입력패드(PAD1c), 및 저전위 전원전압 입력패드(PAD1d)를 포함한다.
제 2 패드들(PAD1a~PAD1d)은 데이터 신호 출력패드(PAD2a), 고전위 전원전압 출력패드(PAD2b), 기준전위 전원전압 출력패드(PAD2c), 및 저전위 전원전압 출력패드(PAD2d)를 포함한다.
고전위 전원전압 입력패드(PAD1b), 기준전위 전원전압 입력패드(PAD1c), 및 저전위 전원전압 입력패드(PAD1d)은 배선들(Vss1, Vref1, Vdd1)을 통해 각각 고전위 전원전압 출력패드(PAD2b), 기준전위 전원전압 출력패드(PAD2c), 및 저전위 전원전압 출력패드(PAD2d)에 접속된다.
제 2 패드들(PAD1a~PAD1d)은 도 8에 도시된 바와 같이, 표시패널(DP)의 패드들(Dpad)과의 접속을 위해 상술한 바와 같이 보호층(PL)이 제거되어 있고, 제 1 패드들(PAD1a~PAD1d) 또한 소스 PCB(SPCB)의 패드들과의 접속을 위해 보호층(PL)이 제거되어 있다. 제 2 패드들(PAD1a~PAD1d)은 도전성 볼을 함유하는 비등방성 도전막(ACF) 등을 통해 표시패널(DP)의 패드들(Dpad)에 접속될 수 있다. 도 8에 도시하지는 않았지만, 제 1 패드들(PAD1a~PAD1d) 또한 도전성 볼을 함유하는 비등방성 도전막(ACF) 등을 통해 소스 PCB(SPCB)의 패드들에 접속될 수 있다.
제 1 패드들(PAD1a~PAD1d)이 소스 PCB(SPCB)의 패드들과 접속되는 제 1 패드영역(PA1)은 제 1 본딩영역(BA1)이 되고, 제 2 패드들(PAD1a~PAD1d)이 표시패널(DP)의 패드들(Dpad)에 접속되는 제 2 패드영역(PA2)은 제 2 본딩영역(BA2)으로 된다. 제 1 본딩영역(BA1)과 제 2 본딩영역(BA2)의 앞뒤에는 보호층(PL)이 제거된 여유영역으로서의 제 1 및 제 2 개구부들(M1, M2)이 존재한다. 제 1 본딩영역(BA1)의 내측 여유영역인과 제 2 본딩영역(BA2)의 내측 여유영역(OP2) 사이에는 신호라인들(Vdata1)과 전원공급라인들(Vss1, Vref1, Vdd1)을 커버하는 보호층(Pl)이 형성되어 비개구부(NOP)를 구성한다.
다음으로 도 9a 내지 도 9e, 도 10a 및 도 10b를 참조하여, 표시패널(DP)측 에 부착되는 본 발명의 실시예에 따르는 칩온필름(COF)에 대해 보다 구체적으로 설명하기로 한다.
도 9a는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 1 예를 도시한 평면도이고, 도 9b는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 2 예를 도시한 평면도이며, 도 9c는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 3 예를 도시한 평면도이고, 도 9d는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 4 예를 도시한 평면도이고, 도 9e는 도 7에 도시된 칩온필름의 일부 영역을 도시한 제 1 예를 도시한 평면도이다. 도 10a는 도 9a 내지 9e의 II-II'라인을 따라 취한 분리소자의 일례를 도시한 단면도이고, 도 10b는 도 9a 내지 9e의 II-II'라인을 따라 취한 분리소자의 다른 예를 도시한 단면도이다.
도 9a 내지 도 9e, 도 10a 및 도 10b에서는, 도 7에 도시된 제 2 패드들(PAD1a~PAD1d)은 데이터 신호 공급라인(PAD2a), 고전위 전원전압 공급라인(Vdd1), 기준전위 전원전압 공급라인(Vref1), 및 저전위 전원전압 공급라인(Vss1)으로부터 연장되어 보다 넓은 면적을 갖도록 확장된 부분이다.
도 9a, 도 10a 및 도 10b를 참조하면, 제 1 예에 따르는 칩온필름(COF)의 베이스층(BL) 상에는 일정 간격을 두고, 적색(R), 녹색(G), 청색(B) 및 백색(W)의 부화소들에 각각 데이터 신호를 공급하기 위한 데이터 신호 공급라인들(Vr, Vg, Vb, Vw)을 포함하는 데이터 신호 공급라인(Vdata1)이 배치된다. 데이터 신호 공급라인(Vdat1)의 일측(예를 들면, 좌측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 저전위 전원전압 공급라인(Vss1)과 기준전위 전원전압 공급라인(Vref1)이 배치되며, 데이터 신호 공급라인(Vdat1)의 타측(예를 들면, 우측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 고전위 전원전압 공급라인(Vdd1)이 배치된다.
또한, 데이터 신호 공급라인들(Vr, Vg, Vb, Vw) 사이, 고전위 전원전압 공급라인(Vdd1)과 데이터 신호 공급라인(Vw) 사이, 기준전위 전원전압 공급라인(Vref1)과 데이터 신호 공급라인(Vr) 사이, 기준전위 전원전압 공급라인(Vref1)과 저전위 전원전압 공급라인(Vss1) 사이의 적어도 하나의 사이에는, 도 10a에 도시된 바와 같이 서로 인접한 신호 공급라인들(Vr, Vg, Vb, Vw) 및 전원전압 공급라인들(Vdd1, Vref1, Vss1)의 마이그레이션(migration)에 의한 접촉을 방지하기 위한 분리소자(SE1)로서의 오목부가 형성되거나, 도 10b에 도시된 바와 같이 볼록부가 형성될 수 있다.
도 9a, 도 10a, 및 도 10b에 도시된 바와 같이, 제 1 예에 따르는 칩온필름(COF)의 분리소자(SE1)로서의 오목부와 볼록부는 표시패널(DP)을 향한 제 2 본딩부(BA2) 외측 영역인 제 1 개구부(OP1)에 형성될 수 있다.
도 9b, 도 10a 및 도 10b를 참조하면, 제 2 예에 따르는 칩온필름(COF)의 베이스층(BL) 상에는 일정 간격을 두고, 적색(R), 녹색(G), 청색(B) 및 백색(W)의 부화소들에 각각 데이터 신호를 공급하기 위한 데이터 신호 공급라인들(Vr, Vg, Vb, Vw)을 포함하는 데이터 신호 공급라인(Vdata1)이 배치된다. 데이터 신호 공급라인(Vdat1)의 일측(예를 들면, 좌측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 저전위 전원전압 공급라인(Vss1)과 기준전위 전원전압 공급라인(Vref1)이 배치되며, 데이터 신호 공급라인(Vdat1)의 타측(예를 들면, 우측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 고전위 전원전압 공급라인(Vdd1)이 배치된다.
또한, 데이터 신호 공급라인들(Vr, Vg, Vb, Vw) 사이, 고전위 전원전압 공급라인(Vdd1)과 데이터 신호 공급라인(Vw) 사이, 기준전위 전원전압 공급라인(Vref1)과 데이터 신호 공급라인(Vr) 사이, 기준전위 전원전압 공급라인(Vref1)과 저전위 전원전압 공급라인(Vss1) 사이의 적어도 하나의 사이에는, 도 10a에 도시된 바와 같이 서로 인접한 신호 공급라인들(Vr, Vg, Vb, Vw) 및 전원전압 공급라인들(Vdd1, Vref1, Vss1)의 마이그레이션(migration)에 의한 접촉을 방지하기 위한 분리소자(SE2)로서의 오목부가 형성되거나, 도 10b에 도시된 바와 같이 볼록부가 형성될 수 있다.
도 9b, 도 10a, 및 도 10b에 도시된 바와 같이, 제 2 예에 따르는 분리소자(SE2)로서의 오목부와 볼록부는 제 2 본딩부(BA2)로부터 표시패널(DP)을 향한 외측 영역인 제 1 개구부(OP1)까지 형성될 수 있다.
도 9c, 도 10a 및 도 10b를 참조하면, 제 3 예에 따르는 칩온필름(COF)의 베이스층(BL) 상에는 일정 간격을 두고, 적색(R), 녹색(G), 청색(B) 및 백색(W)의 부화소들에 각각 데이터 신호를 공급하기 위한 데이터 신호 공급라인들(Vr, Vg, Vb, Vw)을 포함하는 데이터 신호 공급라인(Vdata1)이 배치된다. 데이터 신호 공급라인(Vdat1)의 일측(예를 들면, 좌측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 저전위 전원전압 공급라인(Vss1)과 기준전위 전원전압 공급라인(Vref1)이 배치되며, 데이터 신호 공급라인(Vdat1)의 타측(예를 들면, 우측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 고전위 전원전압 공급라인(Vdd1)이 배치된다.
또한, 데이터 신호 공급라인들(Vr, Vg, Vb, Vw) 사이, 고전위 전원전압 공급라인(Vdd1)과 데이터 신호 공급라인(Vw) 사이, 기준전위 전원전압 공급라인(Vref1)과 데이터 신호 공급라인(Vr) 사이, 기준전위 전원전압 공급라인(Vref1)과 저전위 전원전압 공급라인(Vss1) 사이의 적어도 하나의 사이에는, 도 10a에 도시된 바와 같이 서로 인접한 신호 공급라인들(Vr, Vg, Vb, Vw) 및 전원전압 공급라인들(Vdd1, Vref1, Vss1)의 마이그레이션(migration)에 의한 접촉을 방지하기 위한 분리소자(SE3)로서의 오목부가 형성되거나, 도 10c에 도시된 바와 같이 볼록부가 형성될 수 있다.
도 9c, 도 10a, 및 도 10b에 도시된 바와 같이, 제 3 예에 따르는 분리소자(SE3)로서의 오목부와 볼록부는 표시패널(DP)의 반대방향을 향한 제 2 본딩부(BA2)의 외측 영역인 제 2 개구부(OP2)에 형성될 수 있다.
도 9d, 도 10a 및 도 10b를 참조하면, 제 4 예에 따르는 칩온필름(COF)의 베이스층(BL) 상에는 일정 간격을 두고, 적색(R), 녹색(G), 청색(B) 및 백색(W)의 부화소들에 각각 데이터 신호를 공급하기 위한 데이터 신호 공급라인들(Vr, Vg, Vb, Vw)을 포함하는 데이터 신호 공급라인(Vdata1)이 배치된다. 데이터 신호 공급라인(Vdat1)의 일측(예를 들면, 좌측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 저전위 전원전압 공급라인(Vss1)과 기준전위 전원전압 공급라인(Vref1)이 배치되며, 데이터 신호 공급라인(Vdat1)의 타측(예를 들면, 우측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 고전위 전원전압 공급라인(Vdd1)이 배치된다.
또한, 데이터 신호 공급라인들(Vr, Vg, Vb, Vw) 사이, 고전위 전원전압 공급라인(Vdd1)과 데이터 신호 공급라인(Vw) 사이, 기준전위 전원전압 공급라인(Vref1)과 데이터 신호 공급라인(Vr) 사이, 기준전위 전원전압 공급라인(Vref1)과 저전위 전원전압 공급라인(Vss1) 사이의 적어도 하나의 사이에는, 도 10a에 도시된 바와 같이 서로 인접한 신호 공급라인들(Vr, Vg, Vb, Vw) 및 전원전압 공급라인들(Vdd1, Vref1, Vss1)의 마이그레이션(migration)에 의한 접촉을 방지하기 위한 분리소자(SE4)로서의 오목부가 형성되거나, 도 10b에 도시된 바와 같이 볼록부가 형성될 수 있다.
도 9d, 도 10a, 및 도 10b에 도시된 바와 같이, 제 4 예에 따르는 분리소자(SE4)로서의 오목부와 볼록부는 제 2 본딩부(BA2)로부터 표시패널(DP)을 향한 제 2 본딩부의 외측영역인 제 1 개구부(OP1) 까지 형성될 수 있다.
도 9e, 도 10a 및 도 10b를 참조하면, 제 5 예에 따르는 칩온필름(COF)의 베이스층(BL) 상에는 일정 간격을 두고, 적색(R), 녹색(G), 청색(B) 및 백색(W)의 부화소들에 각각 데이터 신호를 공급하기 위한 데이터 신호 공급라인들(Vr, Vg, Vb, Vw)을 포함하는 데이터 신호 공급라인(Vdata1)이 배치된다. 데이터 신호 공급라인(Vdat1)의 일측(예를 들면, 좌측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 저전위 전원전압 공급라인(Vss1)과 기준전위 전원전압 공급라인(Vref1)이 배치되며, 데이터 신호 공급라인(Vdat1)의 타측(예를 들면, 우측)에는 데이터 신호 공급라인(Vdat1)과 일정 간격을 두고 고전위 전원전압 공급라인(Vdd1)이 배치된다.
또한, 데이터 신호 공급라인들(Vr, Vg, Vb, Vw) 사이, 고전위 전원전압 공급라인(Vdd1)과 데이터 신호 공급라인(Vw) 사이, 기준전위 전원전압 공급라인(Vref1)과 데이터 신호 공급라인(Vr) 사이, 기준전위 전원전압 공급라인(Vref1)과 저전위 전원전압 공급라인(Vss1) 사이의 적어도 하나의 사이에는, 도 10a에 도시된 바와 같이 서로 인접한 신호 공급라인들(Vr, Vg, Vb, Vw) 및 전원전압 공급라인들(Vdd1, Vref1, Vss1)의 마이그레이션(migration)에 의한 접촉을 방지하기 위한 분리소자(SE5)로서의 오목부가 형성되거나, 도 10b에 도시된 바와 같이 볼록부가 형성될 수 있다.
도 9e, 도 10a, 및 도 10b에 도시된 바와 같이, 제 5 예에 따르는 분리소자(SE5)로서의 오목부와 볼록부는 제 2 본딩부(BA2)로부터 표시패널(DP)을 향한 제 2 본딩부(BA2)의 외측 영역인 제 1 개구부(OP1)과, 표시패널(DP)의 반대방향을 향한 제 2 본딩부(BA2)의 외측 영역인 제 2 개구부(OP2)까지 형성될 수 있다.
상술한 본 발명의 제 1 내지 제 5 예에 따르는 칩온필름(COF)은 서로 인접한 신호 공급라인들(Vr, Vg, Vb, Vw) 및 전원전압 공급라인들(Vdd1, Vref1, Vss1)의 마이그레이션(migration)을 방지할 수 있는 분리소자(SE1, SE2, SE3, SE4, SE5)로서의 오목부 또는 볼록부를 구비하기 때문에, 투습에 의해 이들이 이동되더라도 분리소자에 의해 서로 접촉되지는 않게 된다. 따라서, 칩온필름(COF)의 서로 인접한 신호 공급라인들(Vr, Vg, Vb, Vw) 및 전원전압 공급라인들(Vdd1, Vref1, Vss1) 사이의 의도치 않은 쇼트를 방지할 수 있는 효과를 얻을 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 예를 들어, 상술한 본 발명의 실시예에 대한 설명에서는 표시패널(DP)과 접합하는 제 2 본딩부(BA2)에 형성되는 분리소자(SE1, SE2, SE3, SE4, SE5)로서의 오목부 또는 볼록부를 중심으로 설명하였지만, 소스 PCB(SPCB)에 접합되는 제 1 본딩부(BA1)에도 제 2 본딩부(BA2)와 마찬가지로 분리소자(SE1, SE2, SE3, SE4, SE5)로서의 오목부 또는 볼록부를 동일하게 형성할 수 있다.
또한, 본 발명의 실시예에서는 도 9a 내지 도 9e의 제 1 내지 도 5의 예와 도 10a 및 10b의 제 1 내지 제 2 예가 독립적으로 적용되는 것에 대해 설명하고 있지만 본 발명이 이에 한정되는 것은 아니며, 이들 구성을 상호 조합하는 것도 본 발명에 속하는 것으로 이해하여야 한다.
또한, 본 발명의 실시예에서는 칩온필름이 유기발광 표시장치에 적용되는 경우의 예를 들어 설명하였지만 본 발명이 이에 한정되는 것은 아니며, 칩온필름이 이용되는 다른 평판표시장치에도 적용될 수 있다.
따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의 해 정하여져야만 할 것이다.
COF: 칩온필름
DIC: 소스 드라이브 IC
DP: 표시패널 OP1, OP2: 개구부
BA1, BA2: 본딩영역 PA1, PA2: 패드영역
SPCB: 소스 PCB PS: 전원 공급부
Vdd: 고전위 전원전압 Vref: 기준전위 전원전압
Vss: 저전위 전원전압
DP: 표시패널 OP1, OP2: 개구부
BA1, BA2: 본딩영역 PA1, PA2: 패드영역
SPCB: 소스 PCB PS: 전원 공급부
Vdd: 고전위 전원전압 Vref: 기준전위 전원전압
Vss: 저전위 전원전압
Claims (9)
- 서로 대향하는 양측 단부에 일정 거리를 두고 각각 배치되는 제 1 본딩부 및 제 2 본딩부를 포함하는 베이스층;
상기 베이스층에 실장되며, 상기 제 1 및 제 2 본딩부 사이에 배치되는 IC:
상기 베이스층에서 상기 제 1 본딩부, 상기 IC, 및 상기 제 2 본딩부를 경유하도록 서로 나란하게 배치되는 복수의 신호라인들;
상기 베이스층의 상기 IC 외측에서 상기 제 1 본딩부, 및 상기 제 2 본딩부를 경유하도록 상기 복수의 신호라인들과 나란하게 배치되는, 적어도 하나의 전원전압 공급라인; 및
상기 베이스층에 형성되며, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인 중 서로 이웃하는 것들 사이의 적어도 일부 영역에 각각 배치되는 분리소자를 포함하는 칩온필름. - 제 1 항에 있어서,
상기 분리소자는 상기 베이스층에 형성되는 오목부, 볼록부 중의 적어도 하나인 칩온필름. - 제 1 항에 있어서,
상기 베이스층은, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인을 노출시키는 개구영역을 갖는 상기 제 1 본딩부와 상기 제 2 본딩부 사이에서, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인을 커버하는 보호층을 갖는 비개구 영역을 더 포함하는 칩온필름. - 제 3 항에 있어서,
상기 분리소자는 상기 제 1 본딩부와 상기 제 2 본딩부 중의 적어도 하나의 영역에 배치되는 칩온필름. - 제 3 항에 있어서,
상기 분리소자는 상기 제 1 본딩부와 상기 제 2 본딩부 외측의 개구영역에 배치되는 칩온필름. - 제 3 항에 있어서,
상기 분리소자는 상기 제 1 본딩부와 상기 제 2 본딩부 중의 적어도 하나의 영역과, 상기 제 1 본딩부와 상기 제 2 본딩부 외측의 개구영역에 배치되는 칩온필름. - 서로 대향하는 양측 단부에 일정 거리를 두고 각각 배치되는 제 1 본딩부 및 제 2 본딩부를 포함하는 베이스층;
상기 베이스층에 실장되며, 상기 제 1 및 제 2 본딩부 사이에 배치되는 IC:
상기 베이스층에서 상기 IC를 경유하도록 서로 나란하게 배치되는 복수의 신호라인들;
상기 제 1 본딩부에 배치되며, 상기 복수의 신호라인들 일단부들로부터 각각 연장된 복수의 제 1 패드들;
상기 제 2 본딩부에 배치되며, 상기 복수의 신호라인들 타단부들로부터 각각 연장된 복수의 제 2 패드들;
상기 베이스층의 상기 IC 외측에서 상기 복수의 신호라인들과 나란하게 배치되는 적어도 하나의 전원전압 공급라인;
상기 제 1 본딩부에 배치되며, 상기 적어도 하나의 전원공급라인의 일단부로부터 연장되는 제 3 패드;
상기 제 2 본딩부에 배치되며, 상기 적어도 하나의 전원공급라인의 타단부로부터 연장되는 제 4 패드; 및
상기 베이스층에 형성되며, 상기 복수의 신호라인들 및 상기 적어도 하나의 전원전압 라인 중 서로 이웃하는 것들 사이의 적어도 일부 영역에 각각 배치되는 분리소자를 포함하는 칩온필름. - 제 7 항에 있어서,
상기 분리소자는 상기 베이스층에 형성되는 오목부, 볼록부 중의 적어도 하나인 칩온필름. - 표시영역과 비표시영역을 포함하며, 상기 표시영역에 복수의 화소들을 포함하는 표시패널;
상기 표시패널의 비표시부에 일측이 전기적으로 결합되어 상기 복수의 화소들에 적어도 하나의 전원전압과 복수의 데이터 신호들을 공급하기 위한 제 1 항 내지 제 8 항 중 어느 한 항 기재의 칩온필름;
상기 칩온필름의 타측에 전기적으로 결합되어, 상기 칩온필름에 상기 적어도 하나의 전원전압을 공급하기 위한 전원공급부와, 상기 복수의 데이터 신호들을 공급하기 위한 타이밍 콘트롤러가 실장된 소스 PCB를 포함하는 표시장치.
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| KR1020160110660A KR102613421B1 (ko) | 2016-08-30 | 2016-08-30 | 칩온필름 및 그를 구비한 표시장치 |
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2016
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