KR20170062573A - 표시 장치 - Google Patents

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Abstract

본 발명은, 복수의 데이터 라인과 복수의 스캔 라인들에 연결된 화소들이 매트릭스 형태로 배치된 화소 어레이를 포함하는 표시 패널과, 상기 표시 패널의 구동을 제어하는 타이밍 컨트롤러와, 상기 표시 패널의 구동을 위한 전원을 공급하는 전원 공급부와, 상기 타이밍 컨트롤러와 상기 전원 공급부가 실장된 인쇄회로기판과, 일단이 상기 표시 패널에 연결되고 타단이 상기 인쇄회로기판에 연결되어 상기 표시 패널과 상기 인쇄회로기판을 전기적으로 연결하는 연성회로기판과, 상기 연성회로기판 상에 실장되어 상기 복수의 데이터 라인에 데이터 신호를 제공하는 데이터 구동부와, 상기 표시 패널의 기판 상에 직접 형성되어 상기 복수의 스캔 라인에 순차적으로 스캔 신호를 제공하는 시프트 레지스터 및 상기 표시 패널의 일측에 실장되어 상기 타이밍 컨트롤러로부터 제공된 클럭 신호와 상기 전원 공급부로부터 제공된 전원들을 이용하여 레벨 쉬프트된 신호들을 상기 시프트 레지스터로 제공하는 스캔 구동부를 포함하는 표시 장치에 관한 것이다.

Description

표시 장치{DISPLAY DEVICE}
본 발명의 실시예는 표시 장치에 관한 것이다.
표시 장치는, 스캔 라인들과 데이터 라인들이 교차되어 형성된 표시 패널과, 상기 스캔 라인들을 구동하기 위한 스캔 드라이버와, 상기 데이터 라인들을 구동하기 위한 데이터 드라이버와, 상기 스캔 드라이버 및 상기 데이터 드라이버의 구동 타이밍을 제어하는 타이밍 컨트롤러 등을 포함한다.
이러한 표시 장치에서 스캔 드라이버는, 스캔 드라이브 IC(Integrated Circuit)들을 COG(Chip On Glass) 방식으로 표시 패널에 실장될 수 있으며, GIP(Gate drive IC In Panel) 방식으로 화소 어레이와 동시에 표시 패널에 실장될 수 있다.
한편, COG(Chip On Glass) 방식의 스캔 드라이버를 포함하는 표시 장치와 GIP(Gate Drive IC In Panel) 방식의 스캔 드라이버를 포함하는 표시 장치 각각은 서로 상이한 구조의 표시 패널에 의해 상이한 구조의 인쇄회로기판이 적용될 수 있다. 스캔 드라이버의 실장 방식에 따라 구조가 상이한 인쇄회로기판이 적용되어야 하므로, 상기 인쇄회로기판의 제조 비용이 증가할 수 있다.
본 발명의 목적은 인쇄회로기판을 스캔 드라이버의 실장 방식에 관계없이 적용하면서 제조 비용을 줄일 수 있는 표시 장치를 제공하고자 한다.
본 발명의 일 실시예에 따른 표시 장치는, 복수의 데이터 라인과 복수의 스캔 라인들에 연결된 화소들이 매트릭스 형태로 배치된 화소 어레이를 포함하는 표시 패널과, 상기 표시 패널의 구동을 제어하는 타이밍 컨트롤러와, 상기 표시 패널의 구동을 위한 전원을 공급하는 전원 공급부와, 상기 타이밍 컨트롤러와 상기 전원 공급부가 실장된 인쇄회로기판과, 일단이 상기 표시 패널에 연결되고 타단이 상기 인쇄회로기판에 연결되어 상기 표시 패널과 상기 인쇄회로기판을 전기적으로 연결하는 연성회로기판과, 상기 연성회로기판 상에 실장되어 상기 복수의 데이터 라인에 데이터 신호를 제공하는 데이터 구동부와, 상기 표시 패널의 기판 상에 직접 형성되어 상기 복수의 스캔 라인에 순차적으로 스캔 신호를 제공하는 시프트 레지스터 및 상기 표시 패널의 일측에 실장되어 상기 타이밍 컨트롤러로부터 제공된 클럭 신호와 상기 전원 공급부로부터 제공된 전원들을 이용하여 레벨 쉬프트된 신호들을 상기 시프트 레지스터로 제공하는 스캔 구동부를 포함한다.
본 발명의 일 실시예에 있어서, 상기 스캔 구동부는 상기 표시 패널의 기판 상에 실장된 레벨 시프터를 포함한다.
본 발명의 일 실시예에 있어서, 상기 시프트 레지스터는 상기 화소 어레이의 주변 영역에 배치된다.
본 발명의 일 실시예에 있어서, 상기 스캔 구동부는 상기 표시 패널의 기판 상에서 상기 시프트 레지스터와 서로 이격되어 배치된다.
본 발명의 일 실시예에 있어서, 상기 인쇄회로기판은 상기 연성회로기판과 상기 타이밍 컨트롤러를 전기적으로 연결하는 제1 도전 배선과, 상기 연성회로기판과 상기 전원 공급부를 전기적으로 연결하는 제2 도전 배선을 포함한다.
본 발명의 일 실시예에 있어서, 상기 시프트 레지스터는 상기 화소 어레이와 함께 상기 표시 패널의 기판 상에 배치되는 복수의 트랜지스터들을 포함한다.
본 발명의 일 실시예에 있어서, 상기 연성회로기판은 칩 온 필름(chip on film)을 포함한다.
본 발명의 일 실시예에 있어서, 상기 표시 패널의 일측에 위치하며 상기 연성회로기판과 상기 스캔 구동부를 전기적으로 연결하는 연결 배선을 더 포함한다.
본 발명의 일 실시예에 있어서, 상기 연결 배선은 상기 표시 패널의 기판 상에 직접 배치되는 LOG 배선들을 포함한다.
본 발명의 실시 예에 따르면, 스캔 구동부와 시프트 레지스터를 표시 패널의 동일 기판 상에 직접 배치함으로써, 인쇄회로기판에 실장되는 부품 수를 최소화하여 인쇄회로기판의 크기를 줄일 수 있다. 또한, 인쇄회로기판의 크기가 줄어들어 인쇄회로기판의 제조 비용이 절감될 수 있다.
또한, 스캔 구동부와 시프트 레지스터를 표시 패널의 동일 기판 상에 배치함으로써, 스캔 구동부의 실장 방식에 관계없이 인쇄회로기판을 적용할 수 있다.
이와 더불어, 시프트 레지스터가 스캔 구동부로부터 신호들을 직접 제공받아, 신호 왜곡을 최소화할 수 있다.
도 1은 본 발명의 실시 예에 따른 표시 장치를 개략적으로 나타내는 블록도이다.
도 2는 도 1의 일 화소를 확대한 평면도이다.
도 3은 도 1의 시프트 레지스터를 개략적으로 나타낸 회로도이다.
도 4는 인쇄회로기판과, 표시 패널의 접속 관계를 설명하기 위한 평면도이다.
도 5는 도 3의 Q 부분을 확대한 평면도이다.
본 발명의 이점 및 특징, 그리고 그것들을 달성하는 방법은 첨부되는 도면과 함께 상세하게 후술되어 있는 실시 예들을 참조하면 명확해질 것이다.
그러나 본 발명은 이하에서 개시되는 실시 예들에 한정되는 것이 아니라 서로 다른 다양한 형태로 구현될 수 있으며, 단지 본 실시 예들은 본 발명의 개시가 완전하도록 하고, 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자에게 고안의 범주를 완전하게 알려주기 위해 제공되는 것이며, 본 발명은 청구항의 범주에 의해 정의될 뿐이다. 명세서 전체에 걸쳐 동일 참조 부호는 동일 구성 요소를 지칭한다.
이하, 첨부한 도면들을 참조하여 본 발명의 바람직한 실시 예를 보다 상세하게 설명하고자 한다. 이하의 설명에서 사용되는 구성 요소 명칭은 명세서 작성의 용이함을 고려하여 선택된 것일 수 있는 것으로, 실제 제품의 부품 명칭과는 상이할 수 있다.
도 1은 본 발명의 실시 예에 따른 표시 장치를 개략적으로 나타내는 블록도이고, 도 2는 도 1의 일 화소를 확대한 평면도이다.
본 발명의 실시 예에 따른 표시 장치는 액정표시장치(Liquid Crystal Display), 전계 방출 표시장치(Field Emission Display), 플라즈마 디스플레이 패널(Plasma Display panel), 유기발광 표시장치(Organic Light Emitting Display Device) 등의 표시 장치로 구현될 수 있다. 본 발명은 아래의 실시 예에서 표시 장치가 액정표시장치로 구현되는 것을 중심으로 예시하였지만, 이에 한정되지 않는다.
도 1 및 도 2를 참고하면, 본 발명의 실시 예에 따른 표시 장치는 표시 패널(10)과, 시프트 레지스터(20)와, 데이터 구동부(30)와, 감마전압 공급부(40)와, 타이밍 컨트롤러(50)와, 전원 공급부(60)와, 스캔 구동부(70) 등을 포함한다.
상기 표시 패널(10)은 상부 기판, 하부 기판, 및 그들 사이에 형성된 액정층을 포함한다. 상기 표시 패널(10)의 하부 기판에는 화소 어레이(PA)가 형성된다. 상기 화소 어레이(PA)는 데이터 라인들(D1 ~ Dm, m은 2 이상의 양의 정수)과 스캔 라인들(S1 ~ Sn, n은 2 이상의 양의 정수)의 교차 구조에 의해 형성된 영역들에 매트릭스 형태로 배열된 화소(P)들을 이용하여 화상을 표시한다.
본 발명의 일 실시 예에 있어서, 상기 화소(P)는 상기 스캔 라인들(S1 ~ Sn) 중 대응하는 스캔 라인(S1)과, 상기 데이터 라인들(D1 ~ Dm) 중 대응하는 데이터 라인(D2)에 연결된다. 상기 화소(P)는 박막트랜지스터(TFT)와, 액정 커패시터(Clc), 스토리지 커패시터(Cst), 및 화소 전극을 포함한다. 상기 박막트랜지스터(TFT)의 게이트 전극은 상기 스캔 라인(S1)에 연결되고, 상기 박막트랜지스터(TFT)의 소스 전극은 상기 데이터 라인(D2)에 연결되며, 상기 박막트랜지스터(TFT)의 드레인 전극은 상기 액정 커패시터(Clc) 및 공통 전압에 연결된 상기 스토리지 커패시터(Cst)에 연결된다.
상기 박막트랜지스터(TFT)는 상기 스캔 라인(S1)의 스캔 신호에 의해 턴-온(turn-on) 되어 상기 데이터 라인(D2)의 데이터 전압을 상기 화소(P)의 화소 전극에 공급한다. 상기 스토리지 커패시터(Cst)는 상기 화소 전극에 공급된 데이터 전압을 소정의 기간 동안 유지한다. 상기 화소(P)는 상기 데이터 전압이 공급되는 화소 전극과 상기 공통 전압이 인가되는 공통 전극 사이에서 생성된 전계에 의해 상기 액정층의 액정을 구동시켜 광의 투과 량을 조절함으로써 계조를 표현한다.
상기 표시 패널(10)의 상부 기판 상에는 블랙 매트릭스와 컬러필터들이 형성될 수 있으나, 이에 한정되는 것은 아니다. 상기 블랙 매트릭스와 컬러필터들은 상기 표시 패널(10)의 하부 기판 상에 형성될 수도 있다. 상기 공통 전극은 TN(Twisted Nematic) 모드와 VA(Vertical Alignment) 모드와 같은 수직 전계 구동 방식의 경우에 상부 기판 상에 형성되며, IPS(In-Plane Switching) 모드와 FFS(Fringe Field Switching) 모드와 같은 수평 전계 구동 방식의 경우에 화소 전극과 함께 하부 기판 상에 형성된다. 본 발명의 실시 예에 따른 표시 패널(10)은 TN 모드, VA 모드, IPS 모드, FFS 모드뿐 아니라 어떠한 액정모드로도 구현될 수 있다.
상기 표시 패널(10)의 상부 기판과 하부 기판의 외부면에는 각각 편광판이 부착되고, 내부면에는 각각 액정의 프리틸트각(pre-tilt angle)을 설정하기 위한 배향막이 형성된다.
상기 표시 패널(10)의 아래에는 상기 표시 패널(10)에 광을 균일하게 조사하기 위한 백라이트 유닛(미도시)이 배치될 수 있다. 상기 백라이트 유닛은 직하형(direct type) 또는 에지형(edge type)으로 구현될 수 있다.
상기 감마전압 공급부(40)는 상기 전원 공급부(60)로부터 적어도 하나의 전원 전압을 공급받는다. 상기 감마전압 공급부(40)는 분압회로를 이용하여 상기 전원 전압과 소정의 전압을 분압하여 복수의 감마기준전압들을 생성한다. 상기 소정의 전압은 공통전압 또는 그라운드 전압일 수 있다. 상기 감마전압 공급부(40)는 복수의 감마기준전압들을 상기 데이터 구동부(30)로 출력한다.
상기 데이터 구동부(30)는 적어도 하나의 소스 드라이브 IC(integrated circuit)를 포함한다.
상기 소스 드라이브 IC는 상기 타이밍 컨트롤러(50)로부터 디지털 비디오 데이터와 데이터 타이밍 제어신호를 입력받는다. 상기 소스 드라이브 IC는 상기 감마전압 공급부(40)로부터 복수의 감마기준전압들을 제공받는다.
상기 소스 드라이브 IC는 분압 회로를 이용하여 복수의 감마기준전압들을 분압하여 감마보상전압들을 생성할 수 있다. 이 경우, 상기 소스 드라이브 IC는 디지털 비디오 데이터에 따라 상기 감마보상전압들 중 어느 하나를 선택하고, 선택된 감마보상전압을 데이터 전압으로 출력할 수 있다. 특히, 상기 소스 드라이브 IC는 상기 타이밍 컨트롤러(50)의 데이터 타이밍 제어신호에 응답하여 상기 스캔 신호들 각각에 동기화하여 상기 데이터 전압을 상기 표시 패널(10)의 데이터 라인(D1 ~ Dm)으로 출력한다. 그 결과, 상기 스캔 신호에 의해 선택된 화소(P)들 각각에 데이터 전압이 공급된다.
상기 소스 드라이브 IC는 COF (chip on film), TCP(tape carrier packages) 등과 같은 연성회로기판 상에 실장될 수 있다.
상기 타이밍 컨트롤러(50)는 LVDS(Low Voltage Differential Signaling) 인터페이스, TMDS(Transition Minimized Differential Signaling) 인터페이스 등의 인터페이스를 통해 호스트 시스템(1)으로부터 디지털 비디오 데이터를 입력받는다. 또한, 상기 타이밍 컨트롤러(50)는 상기 호스트 시스템(1)으로부터 수직동기신호(vertical sync signal), 수평동기신호(horizontal sync signal), 데이터 인에이블신호(data enable signal), 도트 클럭 신호(dot clock signal) 등을 포함하는 타이밍 신호들을 입력받는다.
여기서, 상기 호스트 시스템(1)은 텔레비전 시스템, 셋톱박스, 네비게이션 시스템, DVD 플레이어, 블루레이 플레이어, 개인용 컴퓨터(PC), 홈 시어터 시스템, 폰 시스템 중 어느 하나로 구현될 수 있다. 상기 호스트 시스템(1)은 입력 영상의 디지털 비디오 데이터를 상기 표시 패널(10)에 적합한 포맷으로 변환한다.
상기 타이밍 컨트롤러(50)는 상기 타이밍 신호들에 응답하여 상기 데이터 구동부(30)의 동작 타이밍을 제어하기 위한 데이터 타이밍 제어신호와 상기 시프트 레지스터(20)의 동작 타이밍을 제어하기 위한 스캔 타이밍 제어신호를 발생한다. 상기 타이밍 컨트롤러(50)는 상기 스캔 타이밍 제어신호를 상기 스캔 구동부(70)로 출력한다. 상기 타이밍 컨트롤러(50)는 상기 디지털 비디오 데이터와 상기 데이터 타이밍 제어신호를 상기 데이터 구동부(30)로 출력한다.
상기 전원 공급부(60)는 상기 표시장치에 내장된 배터리 또는 외부의 전원공급원으로부터 소정의 전압을 공급받는다. 상기 전원 공급부(60)는 소정의 전압을 이용하여 상기 시프트 레지스터(20), 상기 데이터 구동부(30), 상기 스캔 구동부 및 상기 타이밍 컨트롤러(50)에 구동 전압들과 직류 전압들을 공급한다. 구체적으로, 상기 전원 공급부(60)는 상기 데이터 구동부(30)의 디지털 구동전압인 데이터 구동전압을 상기 데이터 구동부(30)로 공급하고, 상기 타이밍 컨트롤러(50)의 디지털 구동전압인 타이밍 구동전압을 상기 타이밍 컨트롤러(50)로 공급한다. 또한, 상기 전원 공급부(60)는 상기 표시 패널(10)의 공통 라인들에 공통 전압을 공급한다.
상기 스캔 구동부(70)는 상기 타이밍 컨트롤러(50)로부터 스캔 타이밍 제어신호 및 전원전압 공급 제어신호를 입력받고, 상기 전원 공급부(60)로부터 직류 전압을 입력받는다. 여기서, 상기 스캔 타이밍 제어신호는 스캔 스타트 펄스와, 클럭신호들을 포함할 수 있다.
상기 스캔 구동부(70)는 상기 스캔 타이밍 제어신호의 전압 레벨을 상기 화소(P)의 박막트랜지스터(TFT) 구동에 적합한 스윙 폭으로 변환하는 레벨 시프터를 포함한다. 상기 레벨 시프터는 상기 스캔 타이밍 제어신호의 TTL(Transistor-Transistor-Logic) 로직 레벨 전압을 게이트 하이 전압과 게이트 로우 전압으로 레벨 시프팅한다.
여기서, 상기 TTL 로직 레벨 전압은 예를 들어 0V와 3.3V 사이에서 스윙하는 전압이다. 상기 게이트 하이 전압과 상기 게이트 로우 전압은 상기 시프트 레지스터(20)와 상기 표시 패널(10)의 박막트랜지스터(TFT)들의 동작 전압으로 설정될 수 있다. 예를 들어, 상기 게이트 하이 전압은 대략 15V 이상의 전압이고, 상기 게이트 로우 전압은 0V 이하의 전압으로 설정될 수 있다.
상기 시프트 레지스터(20)는 GIP(Gate Drive IC In Panel) 방식으로 상기 표시 패널(10)의 일측에서 상기 화소 어레이(PA)와 함께 상기 표시패널(10)의 하부 기판 상에 직접 형성된다. 이하, 도 3을 참고하여 상기 시프트 레지스터(20)에 대해 설명한다.
도 3은 도 1의 시프트 레지스터를 개략적으로 나타낸 회로도이다.
도 1 및 도 3을 참고하면, 상기 시프트 레지스터(20)는 종속적으로 접속된 다수의 스테이지들(STn-2 ~ STn+2)을 포함한다. 상기 시프트 레지스터(20)는 상기 스캔 구동부(70)로부터 제공된 레벨 시프트된 신호들에 기초하여 상기 스캔 라인들(S1 ~ Sn)로 스캔 신호(OUTN-2 ~ OUTN+2)를 순차적으로 공급한다. 상기 다수의 스테이지들(STn-2 ~ STn+2) 각각은 화소 어레이(도 1의 PA)에 형성된 박막트랜지스터(TFT)와 동일한 공정을 형성된 복수의 트랜지스터(미도시)들을 포함할 수 있다.
여기서, 상기 레벨 시프트된 신호들은 상기 게이트 하이 전압과 상기 게이트 로우 전압 사이에서 스윙하는 신호(VST, CLK1 ~ CLK4, VDD, VDDH, VDDL)들을 포함한다. 상기 VDD는 고전위 전압으로서 게이트 하이 전압으로 설정될 수 있다. 상기 VDDH 및 상기 VDDL은 상기 시프트 레지스터(20)의 스테이지들(STn-2 ~ STn+2)의 스트레스를 보상하기 위한 전압 또는 게이트 로우 전압으로 설정될 수 있다.
제n 스테이지(STn)의 스타트 단자에는 스타트 펄스(VST), 또는 제n-2 스테이지(STn-2)의 출력이 스타트 펄스(VST)로서 입력된다. 상기 제n 스테이지(STn)의 리셋 단자에는 제n+2 스테이지(STn+2)의 출력(VNEXT)이 입력된다. 상기 제n 스테이지(STn)의 출력 단자는 상기 스캔라인들(S1 ~ Sn) 중 대응되는 스캔 라인에 연결된다.
이하, 도 4 및 도 5를 참조하며, 본 발명의 실시 예에 따른 표시장치에서 스캔 구동부와, 연성회로 기판, 및 인쇄회로기판의 연결 관계에 대해 설명한다.
도 4는 인쇄회로기판과, 표시 패널의 접속 관계를 설명하기 위한 평면도이고, 도 5는 도 3의 Q 부분을 확대한 평면도이다.
도 4 및 도 5를 참고하면, 본 발명의 실시 예에 따른 표시 장치는 표시 패널(10)과, 시프트 레지스터(20)와, 데이터 구동부(30)와, 스캔 구동부(70)와, 인쇄회로기판(100)을 포함한다. 또한, 본 발명의 실시 예에 따른 표시 장치는 상기 인쇄회로기판(100) 상에 실장된 타이밍 컨트롤러(50)와 전원 공급부(60)를 더 포함한다.
상기 표시 패널(10)은 상부 기판과, 하부 기판, 및 그들 사이에 형성된 액정층을 포함한다. 상기 표시 패널(10)의 하부 기판에는 화소 어레이(PA)가 형성된다. 또한, 상기 표시 패널(10)의 하부 기판에는 상기 스캔 구동부(70)와 전기적으로 연결되는 제1 LOG 배선(75a) 및 제2 LOG 배선(75b)이 배치된다.
상기 시프트 레지스터(20)는 상기 표시 패널(10)의 일측에서 상기 화소 어레이(PA)의 주변 영역에 위치한다. 상기 시프트 레지스터(20)는 상기 화소 어레이(PA)와 함께 상기 표시 패널(10)의 기판 상에 직접 실장된다.
상기 데이터 구동부(30)는 소스 드라이브 IC를 포함하고, 상기 소스 드라이브 IC는 COF(Chip On Film), TCP(Tape Carrier Packages) 등과 같은 연성회로기판(80)에 실장될 수 있다. 이하에서, 상기 연성회로기판(80)은 COF로 설명하지만, 이에 한정되는 것은 아니다.
상기 연성인쇄회로기판(80)의 일측은 ACF(Anisotropic Conductive Film)를 통해 상기 인쇄회로기판(100)에 접합되고, 그 타측은 상기 ACF를 통해 상기 표시 패널(10)의 일측에 접합된다.
상기 연성인쇄회로기판(80)은 복수의 입력 단자와 복수의 출력 단자를 포함한다. 설명의 편의를 위해, 상기 복수의 입력 단자 중 제1 입력 단자(85a)와 제2 입력 단자(85b)만을 도면 상에 도시하였다. 또한, 상기 복수의 출력 단자 중 제1 출력 단자(95a)와 제2 출력 단자(95b)만을 도면 상에 도시하였다.
여기서, 상기 제1 입력 단자(85a)는 상기 타이밍 컨트롤러(50)와 전기적으로 연결되고, 상기 제2 입력 단자(85b)는 상기 전원 공급부(60)와 전기적으로 연결된다. 상기 제1 입력 단자(85a)는 제1 패드 라인(PL1)을 통해 상기 제1 출력 단자(95a)와 전기적으로 연결되고, 상기 제2 입력 단자(85b)는 제2 패드 라인(PL2)을 통해 상기 제2 출력 단자(95b)와 전기적으로 연결된다. 상기 제1 출력 단자(95a)는 상기 제1 LOG 배선(75a)을 통해 상기 스캔 구동부(70)와 전기적으로 연결되고, 상기 제2 출력 단자(95b)는 상기 제2 LOG 배선(75b)을 통해 상기 스캔 구동부(70)와 전기적으로 연결된다.
상기 스캔 구동부(70)는 상기 표시 패널(10)의 일측에서 상기 시프트 레지스터(20)와 중첩되지 않도록 상기 화소 어레이(PA)를 둘러싸는 주변 영역에 위치한다. 상기 스캔 구동부(70)는 상기 표시 패널(10)의 일측 상에서 COG(Chip On Glass) 방식으로 실장된 스캔 드라이브 IC를 포함할 수 있다.
상기 스캔 드라이브 IC는 상기 타이밍 컨트롤러(50)로부터 제공되는 스캔 타이밍 제어신호를 상기 표시 패널(10)의 구동에 적합한 스윙 폭으로 변환하는 레벨 시프터를 포함할 수 있다.
상기 인쇄회로기판(100)에는 상기 연성회로기판(80)의 제1 입력 단자(85a)와 전기적으로 연결되는 제1 도전 배선(55)과, 상기 연성회로기판(80)의 제2 입력 단자(85b)와 전기적으로 연결되는 제2 도전 배선(65)이 배치된다.
상기 제1 도전 배선(55)의 일측은 상기 타이밍 컨트롤러(50)에 접속되고 그 타측은 상기 제1 입력 단자(85a)에 접속된다. 상기 제2 도전 배선(65)의 일측은 상기 전원 공급부(60)에 접속되고 그 타측은 상기 제2 입력 단자(85b)에 접속된다.
상기 타이밍 컨트롤러(50)는 상기 인쇄회로기판(100) 상에 실장되어 상기 데이터 구동부(30)의 동작 타이밍을 제어하기 위한 데이터 타이밍 제어신호와, 상기 시프트 레지스터(20)의 동작 타이밍을 제어하기 위한 스캔 타이밍 제어신호를 생성한다. 상기 타이밍 컨트롤러(50)에서 출력된 제어신호들은 상기 제1 도전 배선(55), 상기 연성회로기판(80), 상기 제1 LOG 배선(75a)을 거쳐 최종적으로 상기 스캔 구동부(70)로 제공된다.
상기 전원 공급부(60)는 상기 인쇄회로기판(100) 상에 실장되어 공통전압, 게이트 하이 전압, 게이트 로우 전압, 감마기준전압 등 상기 표시 패널(10)의 구동에 필요한 직류 전원을 출력한다. 상기 전원 공급부(60)에서 출력된 직류 전원은 상기 제2 도전 배선(65), 상기 연성회로기판(80), 상기 LOG 배선(75b)을 거쳐 최종적으로 상기 스캔 구동부(70)로 제공된다.
상기 스캔 구동부(70)는 상기 전원 공급부(60)로부터 제공된 직류 전원을 이용하여 상기 타이밍 컨트롤러(50)로부터 제공된 제어신호의 전압 레벨을 상기 표시 패널(10)의 구동에 적합한 스윙 폭으로 레벨 시프팅한다.
상기 스캔 구동부(70)에서 레벨 시프트된 신호들이 상기 표시 패널(10)의 기판 상에서 상기 시프트 레지스터(20)로 직접 제공되므로, 상기 인쇄회로기판(100)과, 상기 연성회로기판(80), 및 상기 표시 패널(10) 등을 거쳐 신호 전달이 이루어지는 경우에 비해 신호 왜곡이 줄어들 수 있다.
또한, 상기 표시 패널(10)의 기판 상에 배치된 상기 스캔 구동부(70)로부터 레벨 시프트된 신호들이 상기 시프트 레지스터(20)로 직접 제공됨에 따라, 인쇄회로기판을 통해 레벨 시프트된 신호들을 제공받는 경우에 비해 상기 표시 패널(10) 내의 LOG 배선들의 수가 줄어들 수 있다. 따라서, 상기 표시 패널(10)의 네로우 베젤을 구현할 수 있다.
이와 같이, 상기 스캔 구동부(70)가 상기 시프트 레지스터(20)와 함께 상기 표시 패널(10)의 일측에 실장됨에 따라, 상기 인쇄회로기판(100) 상에는 상기 타이밍 컨트롤러(50)와, 상기 전원 공급부(60) 등이 실장된다. 상기 인쇄회로기판(100) 상에 상기 타이밍 컨트롤러(50)와 상기 전원 공급부(60) 만이 실장되므로, 상기 인쇄회로기판(100) 상에 실장되는 부품 수가 줄어들어 상기 인쇄회로기판(100)의 크기가 줄어들 수 있다. 상기 인쇄회로기판(100)의 크기가 줄어들면, 상기 인쇄회로기판(100)의 제조 비용이 절감될 수 있다.
또한, 상기 인쇄회로기판(100) 상에 상기 타이밍 컨트롤러(50)와 상기 전원 공급부(60) 만이 실장되므로, 제품의 사양에 따라 구조가 변경되는 표시 패널(10)에 모두 적용이 가능해진다. 일 예로, 상기 인쇄회로기판(100)은 스캔 드라이브 IC가 COG(Chip On Glass) 방식으로 상기 표시 패널(10)의 일측에 실장되는 경우와 GIP(Gate Drive IC In Panel) 방식으로 화소 어레이(도 1의 PA)와 동시에 상기 표시 패널(10)의 일측에 실장하는 경우에 모두 적용 가능하다.
본 발명이 속하는 기술분야의 상의 지식을 가진 자는 본 발명이 그 기술적 사상이나 필수적인 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술된 실시예들은 모든 면에서 예시적인 것이며 한정적이 아닌 것으로 이해해야만 한다. 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허 청구범위에 의하여 나타내어지며, 특히 청구범위의 의미 및 범위 그리고 균등 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
1: 호스트 시스템 10: 표시 패널
20: 시프트 레지스터 30: 데이터 구동부
40: 감마전압 공급부 50: 타이밍 컨트롤러
55: 제1 도전 배선 60: 전원 공급부
65: 제2 도전 배선 70: 스캔 구동부
75a: 제1 LOG 배선 75b: 제2 LOG 배선
80: 연성회로기판 85a: 제1 입력 단자
85b: 제2 입력 단자 95a: 제1 출력 단자
95b: 제2 출력 단자 100: 인쇄회로기판

Claims (9)

  1. 복수의 데이터 라인과 복수의 스캔 라인들에 연결된 화소들이 매트릭스 형태로 배치된 화소 어레이를 포함하는 표시 패널;
    상기 표시 패널의 구동을 제어하는 타이밍 컨트롤러;
    상기 표시 패널의 구동을 위한 전원을 공급하는 전원 공급부;
    상기 타이밍 컨트롤러와 상기 전원 공급부가 실장된 인쇄회로기판;
    일단이 상기 표시 패널에 연결되고 타단이 상기 인쇄회로기판에 연결되어 상기 표시 패널과 상기 인쇄회로기판을 전기적으로 연결하는 연성회로기판;
    상기 연성회로기판 상에 실장되어 상기 복수의 데이터 라인에 데이터 신호를 제공하는 데이터 구동부;
    상기 표시 패널의 기판 상에 직접 형성되어 상기 복수의 스캔 라인에 순차적으로 스캔 신호를 제공하는 시프트 레지스터; 및
    상기 표시 패널의 일측에 실장되어 상기 타이밍 컨트롤러로부터 제공된 클럭 신호와 상기 전원 공급부로부터 제공된 전원들을 이용하여 레벨 쉬프트된 신호들을 상기 시프트 레지스터로 제공하는 스캔 구동부를 포함하는 표시 장치.
  2. 제1 항에 있어서,
    상기 스캔 구동부는 상기 표시 패널의 기판 상에 실장된 레벨 시프터를 포함하는 표시 장치.
  3. 제1 항에 있어서,
    상기 시프트 레지스터는 상기 화소 어레이의 주변 영역에 배치되는 표시 장치.
  4. 제1 항에 있어서,
    상기 스캔 구동부는 상기 표시 패널의 기판 상에서 상기 시프트 레지스터와 서로 이격되어 배치되는 표시 장치.
  5. 제1 항에 있어서,
    상기 인쇄회로기판은, 상기 연성회로기판과 상기 타이밍 컨트롤러를 전기적으로 연결하는 제1 도전 배선과, 상기 연성회로기판과 상기 전원 공급부를 전기적으로 연결하는 제2 도전 배선을 포함하는 표시 장치.
  6. 제1 항에 있어서,
    상기 시프트 레지스터는 상기 화소 어레이와 함께 상기 표시 패널의 기판 상에 배치되는 복수의 트랜지스터들을 포함하는 표시 장치.
  7. 제1 항에 있어서,
    상기 연성회로 기판은 칩 온 필름(Chip On Film)을 포함하는 표시 장치.
  8. 제1 항에 있어서,
    상기 표시 패널의 일측에 위치하며 상기 연성회로 기판과 상기 스캔 구동부를 전기적으로 연결하는 연결 배선을 더 포함하는 표시 장치.
  9. 제8 항에 있어서,
    상기 연결 배선은 상기 표시 패널의 기판 상에 직접 배치되는 LOG 배선들을 포함하는 표시 장치.
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