KR20150080361A - 감마기준전압 발생회로 및 이를 포함하는 표시장치 - Google Patents

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Abstract

본 발명은 감마기준전압 발생회로를 개시한다.
본 발명에 의한 감마기준전압 발생회로는 제1 DAC가 생성하는 제1 기준전압을 입력받고, 제1 감마기준전압을 출력하는 제1 전압추종기, 제2 DAC가 생성하는 제2 기준전압을 입력받고, 제n 감마기준전압을 출력하는 제n 전압추종기, 상기 제1 감마기준전압 및 제n 감마기준전압을 분압하는 저항스트링, 및 상기 저항스트링에 의해서 분압되는 전압을 입력받아서 제2 내지 제(n-1) 감마기준전압을 출력하는 제2 내지 제(n-1) 전압추종기;를 포함한다.

Description

감마기준전압 발생회로 및 이를 포함하는 표시장치{Curcuit for Generating Gamma Voltage and Display Panel having the Same}
본 발명은 감마기준전압 발생회로 및 이를 포함하는 표시장치에 관한 것이다.
음극선관(Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 각종 평판 표시장치들(Flat PanelDisplay, FPD)이 개발되고 있다. 평판 표시장치로는 액정 표시장치(Liquid Crystal Display, 이하 "LCD"), 전계 방출 표시장치(Field Emission Display : FED), 플라즈마 디스플레이 패널(Plasma Display Panel, PDP) 및 유기발광다이오드 표시장치(Organic Light Emitting Diode Display, 이하 "OLED") 등이 있으며, 이들 대부분이 상용화되어 시판되고 있다.
이들 중 LCD는 표시패널에 인가되는 구동전압의 세기에 따라 표시패널에 구비된 액정층의 광투과율을 조절함으로써 계조를 표시한다. 그리고, OLED는 표시패널에 인가되는 구동전압의 세기에 따라 유기발광다이오드에 흐르는 전류량을 조절함으로써 계조를 표시한다.
일반적으로 계조란 인간의 시각이 느끼는 빛의 양을 단계적으로 나눈 것을 의미한다. 인간의 시각은 베버의 법칙(Weber's law)에 따라 빛의 밝기에 대해 비선형적으로 반응한다. 이 때문에 채널마다 k bit와 같이 한정된 정보표현량 내에서 선형적으로 빛의 밝기를 기록하면 사람의 눈으로 보기에는 양이 변할 때 부드럽게 느껴지지 않고 단절되어 보이는 현상이 발생한다. 따라서, 주어진 정보표현량의 한계 안에서 최적의 화질을 보여주기 위해선 비선형적으로 부호화해야 할 필요가 있다. 이를 위해, 표시패널의 구동 특성과 인간의 시각인지 특성 간의 차이를 매칭하는 작업이 수행되게 되는데, 이를 감마 보정이라 한다. 통상적으로, 감마 보정방법은 표시패널의 특성에 따라 다수의 감마기준전압 값들을 설정하고, 설정된 감마기준전압 값들을 분압하여 입력 디지털 비디오 데이터 각각의 감마값을 보상한다.
감마기준전압들은 다수의 DAC에서 생성한 기준전압들에 일대일로 연결되는 전압추종기를 이용하거나, 저항스트링을 이용하여 분압한 전압값들에 전압추종기를 연결하여 생성된다. 전압추종기들은 기준전압들을 안정화하여 최종적인 감마기준전압들을 출력한다. 버퍼로 구현되는 전압추종기들은 칩 간의 슬루율(slew late)의 차이로 인해서 감마기준전압을 변경하는 순간에 과전류가 유도된다.
예컨대 제1 전압추종기의 슬루율이 제2 전압추종기의 슬루율 보다 작을 경우에 제1 감마기준전압(gamma1) 및 제2 감마기준전압(gamma2)을 변경하는 과정에서 전압의 변화율은 도 1에서와 같이 나타난다. 즉, 전압변경구간(Tt)에서 제1 감마기준전압(gamma1)은 제2 감마기준전압(gamma2) 보다 전압값이 천천히 변하기 때문에 제1 감마기준전압(gamma1)과 제2 감마기준전압(gamma2) 사이의 저항 노드에 전압 차이가 급격히 변하게 된다. 따라서 출력 저항의 노드에 순간적으로 과전류가 발생한다.
본 발명은 감마기준전압의 출력 노드에서 과전류가 발생하는 것을 개선할 수 있는 감마기준전압 발생회로 및 이를 포함하는 표시장치를 제공하기 위한 것이다.
본 발명에 의한 감마기준전압 발생회로는 제1 DAC가 생성하는 제1 기준전압을 입력받고, 제1 감마기준전압을 출력하는 제1 전압추종기, 제2 DAC가 생성하는 제2 기준전압을 입력받고, 제n 감마기준전압을 출력하는 제n 전압추종기, 상기 제1 감마기준전압 및 제n 감마기준전압을 분압하는 저항스트링, 및 상기 저항스트링에 의해서 분압되는 전압을 입력받아서 제2 내지 제(n-1) 감마기준전압을 출력하는 제2 내지 제(n-1) 전압추종기;를 포함한다.
본 발명은 슬루율이 높은 전압추종기가 슬루율이 낮은 전압추종기의 출력전압을 추종하여 입력전압으로 제공받기 때문에, 전압추종기 간의 슬루율의 차이로 인해서 출력 노드에 과전류가 유도되는 현상을 개선할 수 있다.
도 1은 감마전압변경구간에서의 과전류가 유도되는 현상을 설명하는 도면.
도 2는 본 발명에 의한 표시장치를 나타내는 도면.
도 3은 제1 실시 예에 의한 감마기준전압 발생회로를 나타내는 도면.
도 4는 도 3의 등가회로도.
도 5는 전압변경구간에서 감마기준전압의 전압변화를 나타내는 도면.
도 6은 제2 실시 예에 의한 감마기준전압 발생회로를 나타내는 도면.
도 7은 제3 실시 예에 의한 감마기준전압 발생회로를 나타내는 도면.
도 8은 제4 실시 예에 의한 감마기준전압 발생회로를 나타내는 도면.
이하 첨부된 도면을 참조하여 본 발명에 따른 바람직한 실시 예들을 상세히 설명한다. 명세서 전체에 걸쳐서 동일한 참조번호들은 실질적으로 동일한 구성요소들을 의미한다. 이하의 설명에서, 본 발명과 관련된 공지 기능 혹은 구성에 대한 구체적인 설명이 본 발명의 요지를 불필요하게 흐릴 수 있다고 판단되는 경우, 그 상세한 설명을 생략한다.
본 발명의 감마기준전압 발생회로는 유기발광다이오드 표시장치에 적용된 실시 예를 중심으로 설명되지만, 이에 한정되지 않고 액정표시장치에 적용될 수도 있음은 자명하다.
도 2는 본 발명에 의한 유기발광다이오드 표시장치를 나타내는 도면이다.
도 2를 참조하면, 본 발명에 의한 유기발광다이오드 표시장치는 화소들(P)이 매트릭스 형태로 배열되는 표시패널(10), 데이터 구동부(14), 게이트 구동부(13), 타이밍 콘트롤러(12) 및 감마기준전압 발생회로(15)를 구비한다.
표시패널(10)은 복수 개의 화소(P)를 포함하고, 각각의 화소(P)들이 표시하는 계조를 기반으로 영상을 표시하기 위한 것이다. 화소(P)들은 제1 내지 제m 수평라인들 각각에 복수 개가 일정한 간격으로 배열됨으로써 표시패널(10) 내에서 매트릭스 형태로 배치된다.
각각의 화소(P)들은 서로 직교하는 데이터라인(DL)과 게이트라인(GL)가 교차되는 영역에 배치된다. 화소(P)들 각각은 유기발광다이오드(OLED), 구동트랜지스터(DT), 스위칭 트랜지스터(Tsw) 및 스토리지 커패시터(Cst)를 포함한다. 구동트랜지스터(DT), 스위칭 트랜지스터(Tsw)는 산화물 반도체층을 포함한 산화물 박막트랜지스터(Thin Film Transitor;TFT)로 구현될 수 있다. 산화물 TFT는 전자 이동도, 공정 편차 등을 모두 고려할 때 표시패널(10)의 대면적화에 유리하다. 다만, 본 발명은 이에 한정되지 않고 TFT의 반도체층을 아몰포스 실리콘 또는, 폴리 실리콘 등으로 형성할 수도 있다.
유기발광다이오드(OLED)는 구동트랜지스터(DT)로부터 공급되는 구동 전류에 의해 발광한다. 유기발광다이오드(OLED)의 애노드전극과 캐소드전극 사이에는 다층의 유기 화합물층이 형성된다. 유기 화합물층은 정공주입층(Hole Injection layer, HIL), 정공수송층(Hole transport layer, HTL), 발광층(Emission layer, EML), 전자수송층(Electron transport layer, ETL) 및 전자주입층(Electron Injection layer, EIL)을 포함한다. 유기발광다이오드(OLED)의 애노드전극은 구동트랜지스터(DT)의 소스전극에 연결되고, 캐소드전극은 저전위구동전압(VSS)에 연결된다.
구동트랜지스터(DT)는 자신의 게이트-소스 간의 전압으로 유기발광다이오드(OLED)에 인가되는 구동전류를 제어한다. 이를 위해서 구동트랜지스터(DT)의 게이트전극은 데이터전압(Vdata)의 입력단에 연결되고, 드레인전극은 구동전압(VDD)의 입력단에 연결되며, 소스전극은 저전압구동전압(VSS)과 연결된다.
스위칭 트랜지스터(Tsw)는 데이터라인(DL) 및 게이트라인(GL)에 연결되고, 게이트라인(GL)으로부터 제공받는 게이트 신호에 응답하여, 데이터신호를 구동트랜지스터 및 스토리지 커패시터(Cst)에 제공한다.
타이밍 콘트롤러(12)는 데이터 구동부(14) 및 게이트 구동부(13)의 구동 타이밍을 제어하기 위한 것이다. 이를 위해서 타이밍 콘트롤러(12)는 외부로부터 입력되는 디지털 비디오 데이터(RGB)를 표시패널(10)의 해상도에 맞게 재정렬하여 데이터 구동부(14)에 공급한다. 그리고 타이밍 콘트롤러(12)는 수직 동기신호(Vsync), 수평 동기신호(Hsync), 도트클럭신호(DCLK) 및 데이터 인에이블신호(DE) 등의 타이밍 신호들에 기초하여 데이터 구동부(14)의 동작 타이밍을 제어하기 위한 데이터 제어신호(DDC)와, 게이트 구동부(13)의 동작 타이밍을 제어하기 위한 게이트 제어신호(GDC)를 발생한다. 특히, 타이밍 콘트롤러(12)는 감마기준전압 발생회로(15)의 제1 및 제2 스위치의 동작타이밍을 제어하기 위한 스위치 제어신호(S_ON,S_OFF)를 감마기준전압 발생회로(15)에 제공한다.
데이터 구동부(14)는 데이터라인(DL)를 구동하기 위한 것이다. 이를 위해서 데이터 구동부(14)는 데이터 제어신호(DDC)를 기반으로 타이밍 콘트롤러(12)로부터 입력되는 디지털 비디오 데이터(RGB)를 아날로그 데이터전압으로 변환하여 데이터라인(DL)들에 공급한다. 그리고 데이터 구동부(14)는 감마기준전압 발생회로(15)로부터 감마기준전압을 제공받아서 비디오 디지털 데이터(RGB)를 아날로그 신호로 변환한다.
게이트 구동부(13)는 게이트라인(GL)를 구동하기 위한 것으로, 타이밍 콘트롤러(12)로부터 제공받는 게이트 제어신호(GDC)를 이용하여 게이트신호를 생성한다. 게이트 제어신호(GDC)는 스캔이 시작되는 시작 스캔라인을 지시하는 게이트 스타트 펄스(Gate Start Pulse;GSP), 게이트 스타트 펄스(GSP)를 순차적으로 쉬프트시키기 위한 게이트 쉬프트 클럭(Gate Shift Clock;GSC) 및 게이트 구동부의 출력을 지시하는 게이트 출력 인에이블(Gate Output Enable;GOE)를 포함한다.
감마기준전압 발생회로(15)는 전압분압을 통해서 제1 내지 제n 감마기준전압(gamma1~gamman)을 출력한다. 특히, 감마기준전압 발생회로(15)는 제1 내지 제n 감마기준전압(gamma1~gamman)들을 변경하는 과정에서 과전류가 유도되는 것을 방지한다.
이하, 감마기준전압 발생회로(15)의 실시 예들을 살펴보면 다음과 같다.
도 3은 제1 실시 예에 의한 감마기준전압 발생회로를 나타내는 도면이고, 도 4는 데이터 구동부(14)의 저항스트링(140)에 인가되는 제1 내지 제9 감마기준전압(gamma1~gamma9)을 나타내는 등가회로도이다.
도 3 및 도 4를 참조하면, 제1 실시 예에 의한 감마기준전압 발생회로는 제1 및 제2 디지털-아날로그 컨버터(Digital-Analog Converter; 이하, DAC)(DAC1), 제1 및 제2 전류버퍼(111,112), 감마버퍼부(130) 및 저항스트링(120)을 포함한다.
제1 DAC(DAC1)는 내부 저항스트링(미도시)를 포함하고, 저전위전압(GND)과 고전위전압(VDD)을 분압하여 제1 기준전압(Vref1)을 출력한다. 마찬가지로 제2 DAC(DAC2)는 제2 DAC(DAC2)는 제2 기준전압(Vref2)을 출력한다.
제1 전류버퍼(111)는 제1 DAC(DAC1)의 출력전류를 강화하고, 제2 전류버퍼(112)는 제2 DAC(DAC2)의 출력전류를 강화한다.
감마버퍼부(130)는 제1 내지 제9 전압추종기(GMA1~GMA9)를 포함한다. 제1 전압추종기(GMA1~GMA9)는 제1 DAC(DAC1)의 출력단에 연결되어서, 제1 기준전압(Vref1)을 입력받아서 제1 감마기준전압(gamma1)을 출력한다. 이때, 제1 감마기준전압(gamma1)은 최상위 계조를 표현하기 위한 감마기준전압일 수 있다. 제9 전압추종기(GMA9)는 제2 DAC(DAC2)의 출력단에 연결되어서, 제2 기준전압(Vref2)을 입력받아서 제9 감마기준전압(gamma9)을 출력한다. 이때, 제9 감마기준전압(gamma9)은 최하위 계조를 표현하기 위한 감마기준전압일 수 있다.
저항스트링(120)은 제1 및 제9 전압추종기(GMA1~GMA9) 사이에 형성되어서, 제1 감마기준전압(gamma1) 및 제9 감마기준전압(gamma9)을 분압한다. 그리고, 제2 내지 제8 전압추종기(GMA2~GMA8)는 제1 내지 제8 저항(R1~R8) 사이의 각 노드에 일대일로 연결된다.
이때, 제1 감마기준전압(gamma1)은 제1 전압추종기(GMA1)가 낮은 슬루율을 갖기 때문에, 도 5에서와 같이, 전압변경구간(T1)에서 전압의 변화율이 완만한 경사를 갖는다. 제2 감마기준전압(gamma2)은 높은 슬루율을 갖는 제2 전압추종기(GMA2)의 출력전압이지만, 입력전압이 제1 전압추종기(GMA1)의 출력전압이기 때문에, 전압변경구간(Tt)에서 제1 감마기준전압(gamma1)의 변화율보다 완만한 경사를 갖는다.
즉, 제2 감마기준전압(gamma2)은 전압변경구간(Tt)에서 제1 감마기준전압(gamma1)의 전위를 역전시키지 않고, 제1 감마기준전압(gamma1)의 변화에 대응하여 변화한다. 따라서, 데이터 구동부(14)의 제9 저항(R11)의 양단인 제1 노드(n1) 및 제2 노드(n2)는 제1 감마기준전압(gamma1) 및 제2 감마기준전압(gamma2)이 변경될 때에도 전위차가 안정적으로 유지되기 때문에 과전류가 유도되는 현상이 억제된다.
이와 마찬가지로, 제8 감마기준전압(gamma8)은 제9 감마기준전압(gamma9)을 추종하는 제8 전압추종기(GMA8)의 출력전압이기 때문에 전압변경구간에서 완만한 변화율을 갖는다. 결국, 제1 실시 예에 의한 제1 내지 제9 감마기준전압(gamma1~gamma9)들은 전압추종기(GMA1~GMA9)들 간의 슬루율의 차이로 인해서 제9 내지 제16 저항(R11~R18)들에 과전류가 유도되는 현상을 개선할 수 있다.
도 6은 제2 실시 예에 의한 감마기준전압 발생회로를 나타내는 도면이다. 제2 실시 예에서 전술한 실시 예와 기능적으로 동일한 구성요소에 대해서는 동일한 도면부호를 사용하고 자세한 설명을 생략하기로 한다.
제2 실시 예에 의한 감마기준전압 발생회로는 제1 및 제2 DAC(DAC1,DAC2), 제1 및 제2 전류버퍼(111,112), 감마버퍼부(230), 저항스트링(220), 제1 및 제2 스위치(SW1,SW2)를 포함한다.
제1 스위치(SW1)는 저항스트링(220)의 제1 저항(R1)에 연결되며, 제1 저항(R1)을 제1 전압추종기(GMA1)의 출력단 또는 제1 DAC(DAC1)의 출력단과 연결한다.
제1 스위치(SW1)는 타이밍 콘트롤러(12)의 스위치 신호(S_ON,S_OFF)를 제공받아서 제1 저항(R1)이 연결되는 지점을 결정한다. 제1 스위치(SW1)는 제1 DAC(DAC1)의 출력전압변경구간(Tt)에서 스위치-온 신호(S_ON)를 제공받아서, 제1 저항(R1)을 제1 전압추종기(GMA1)의 출력단과 연결한다. 그리고 제1 스위치(SW1)는 제1 DAC(DAC1)의 출력전압유지구간(Th)에서 스위치-오프 신호(S_OFF)를 제공받아서, 제1 저항(R1)을 제1 DAC(DAC1)의 출력단과 연결한다.
제2 스위치(SW2)는 저항스트링(220)의 제8 저항(R8)에 연결되며, 제8 저항(R8)을 제9 전압추종기(GMA9)의 출력단 또는 제2 DAC(DAC2)의 출력단과 연결한다.
제2 스위치(SW2)는 타이밍 콘트롤러(12)의 스위치 신호(S_ON,S_OFF)를 제공받아서 제1 저항(R1)이 연결되는 지점을 결정한다. 제2 스위치(SW2)는 제2 DAC(DAC2)의 출력전압변경구간(Tt)에서 스위치-온 신호(S_ON)를 제공받아서, 제8 저항(R8)을 제9 전압추종기(GMA9)의 출력단과 연결한다. 그리고 제2 스위치(SW2)는 제2 DAC(DAC2)의 출력전압유지구간(Th)에서 스위치-오프 신호(S_OFF)를 제공받아서, 제2 저항(R2)을 제2 DAC(DAC2)의 출력단과 연결한다.
즉, 출력전압변경구간(Tt)에서, 제2 전압추종기(GMA2)는 제1 전압추종기(GMA1)의 출력전압을 추종하고, 제8 전압추종기(GMA8)는 제9 전압추종기(GMA9)의 출력전압을 추종한다. 따라서, 제2 실시 예에 의한 감마기준전압 발생회로는 출력전압변경구간(Tt)에서 전압추종기들 간의 슬루율의 차이로 인해서 과전류가 유도되는 현상을 억제한다.
이때, 제1 전압추종기(GMA1)의 출력전압은 리플(riffle)을 포함할 수 있다. 제1 전압추종기(GMA1)의 출력전압에 리플이 포함될 경우에 제2 전압추종기(GMA2)가 제1 전압추종기(GMA1)의 출력전압을 추종하면, 제2 내지 제8 감마기준전압(gamma2~gamma8)은 모두 리플의 영향을 받는다. 따라서, 출력전압유지구간(Th)에서, 제2 전압추종기(GMA2)는 제1 DAC(DAC1)의 출력전압을 추종하고, 제8 전압추종기(GMA8)는 제2 DAC(DAC2)의 출력전압을 추종한다.
도 7은 제3 실시 예에 의한 감마기준전압 발생회로를 나타내는 도면이다. 제3 실시 예에서 제1 및 제2 실시 예와 기능적으로 동일한 구성요소는 동일한 도면부호를 사용하고 자세한 설명을 생략하기로 한다.
제3 실시 예에 의한 감마기준전압 발생회로는 제1 내지 제9 DAC(DAC1~DAC9), 제1 전류버퍼(111) 및 감마버퍼부(330)를 포함한다.
제1 DAC(DAC1)는 저전위전압(GND)와 고전위전압(VDD)를 분압하여 제1 기준전압(Vref)을 출력한다. 제2 내지 제9 DAC(DAC2~DAC9)는 저전위전압(GND)와 제1 기준전압(Vref1)을 분압하여 각각 제2 내지 제9 기준전압(Vref2~Vref9)를 출력한다.
제1 전압추종기(GMA1)는 제1 DAC(DAC1)로부터 제1 기준전압(Vref1)을 입력받아서 제1 감마기준전압(gamma1)을 출력한다. 마찬가지로, 제2 내지 제9 전압추종기(GMA2~gamma9)는 각각 제2 내지 제9 감마기준전압(gamma2~gamma9)을 출력한다.
제2 DAC(DAC2)는 제1 감마기준전압(gamma1)을 고전위바이어스로 제공받기 때문에, 제1 전압추종기(GMA1) 및 제2 전압추종기(GMA2) 간의 슬루율의 차이로 인해서 과전류가 유도되는 현상을 개선한다. 마찬가지로 제3 내지 제9 DAC(DAC3~DAC9) 역시 제1 감마기준전압(gamma1)을 고전위바이어스로 제공받기 때문에 출력 노드에서 과전류가 유도되는 현상을 개선할 수 있다.
도 8은 제4 실시 예에 의한 감마기준전압 발생회로를 나타내는 도면이다. 제4 실시 예에서 전술한 실시 예와 기능적으로 동일한 구성요소에 대해서는 동일한 도면부호를 사용하고 자세한 설명을 생략하기로 한다.
제4 실시 예에 의한 감마기준전압 발생회로는 제1 내지 제9 DAC(DAC1~DAC9), 제1 전류버퍼(111), 감마버퍼부(330), 제1 내지 제8 스위치(SW1~SW8)를 포함한다.
제1 스위치(SW1)는 제2 DAC(DAC2)의 고전위바이어스 입력단(c)에 형성되어서, 고전위전압(VDD) 또는 제1 감마기준전압(gamma1)을 선택적으로 제공받도록 스위칭된다.
이와 유사하게, 제2 내지 제8 스위치(SW2~SW8)는 각각 제2 내지 제9 DAC(DAC2~DAC9)의 고전위바이어스 입력단(c)에 형성되어서, 고전위전압(VDD) 또는 제1 감마기준전압(gamma1)을 선택적으로 제공받도록 스위칭된다.
제1 내지 제8 스위치(SW1~SW8)는 타이밍 콘트롤러(12)의 스위치 신호(S_ON,S_OFF)를 제공받아서 고전위바이어스 입력단(c)이 연결되는 전압원을 결정한다. 제1 내지 제8 스위치(SW1~SW8) 출력전압변경구간(Tt)에서 스위치-온 신호(S_ON)를 제공받아서, b단자와 연결되어 제1 감마기준전압(gamma1)을 제공받는다. 그리고 제1 내지 제8 스위치(SW)는 출력전압유지구간(Th)에서 스위치-오프 신호(S_OFF)를 제공받아서, a단자와 연결되어서 고전위전압(VDD)을 제공받는다.
즉, 출력전압변경구간(Tt)에서, 제2 내지 제9 DAC(DAC2~DAC9)는 제1 전압추종기(GMA)의 출력전압을 추종한다. 따라서, 출력전압변경구간(Tt)에서 전압추종기들 간의 슬루율의 차이로 인해서 과전류가 유도되는 현상을 억제한다.
그리고, 출력전압유지구간(Th)에서, 제2 내지 제9 DAC(DAC2~DAC9)는 고전위전압(VDD)을 제공받기 때문에, 제2 내지 제9 감마기준전압(gamma2~gamma9)들이 제1 감마기준전압(gamma1)에 포함된 리플의 영향을 받지 않도록 한다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여져야만 할 것이다.
10 : 표시패널 12 : 타이밍 콘트롤러
13 : 게이트 구동부 14 : 데이터 구동부
15 : 감마기준전압 발생회로 111,112 : 전류버퍼

Claims (9)

  1. 제1 디지털-아날로그 컨버터가 생성하는 제1 기준전압을 입력받아서, 제1 감마기준전압을 출력하는 제1 전압추종기;
    제2 디지털-아날로그 컨버터가 생성하는 제2 기준전압을 입력받아서, 제n 감마기준전압을 출력하는 제n 전압추종기(n은 3이상의 자연수);
    상기 제1 감마기준전압 및 제n 감마기준전압을 분압하는 저항스트링; 및
    상기 저항스트링에 의해서 분압되는 전압을 입력받아서 제2 내지 제(n-1) 감마기준전압을 출력하는 제2 내지 제(n-1) 전압추종기;를 포함하는 감마기준전압 발생회로.
  2. 제 1 항에 있어서,
    상기 저항스트링의 제1 저항에 연결되며, 상기 제1 저항을 상기 제1 전압추종기의 출력단 또는 상기 제1 디지털-아날로그 컨버터의 출력단과 연결하는 제1 스위치; 및
    상기 저항스트링의 제m 저항(m은 n-1)에 연결되며, 상기 제m 저항을 상기 제n 전압추종기의 출력단 또는 상기 제2 디지털-아날로그 컨버터의 출력단과 연결하는 제2 스위치;를 더 포함하는 것을 특징으로 하는 감마기준전압 발생회로.
  3. 제 2 항에 있어서,
    상기 제1 스위치는 상기 제1 디지털-아날로그 컨버터의 출력전압 변경구간에서 상기 제1 전압추종기의 출력단과 연결되고, 상기 제1 디지털-아날로그 컨버터의 출력전압 유지구간에서 상기 제1 디지털-아날로그 컨버터의 출력단과 연결되며,
    상기 제2 스위치는 상기 제2 디지털-아날로그 컨버터의 출력전압 변경구간에서 상기 제n 전압추종기의 출력단과 연결되고, 상기 제2 디지털-아날로그 컨버터의 출력전압 유지구간에서 상기 제2 디지털-아날로그 컨버터의 출력단과 연결되는 것을 특징으로 하는 감마기준전압 발생회로.
  4. 제 1 항에 있어서,
    상기 제1 디지털-아날로그 컨버터의 출력단에 연결되는 제1 전류버퍼; 및
    상기 제2 디지털-아날로그 컨버터의 출력단에 연결되는 제2 전류버퍼;를 더 포함하는 것을 특징으로 하는 감마기준전압 발생회로.
  5. 제1 기준전압을 생성하는 제1 디지털-아날로그 컨버터;
    상기 제1 기준전압을 입력받아서 제1 감마기준전압을 출력하는 제1 전압추종기;
    저전위전압 및 상기 제1 감마기준전압을 분압하여 제2 내지 제n 기준전압을 생성하는 제2 내지 제n 디지털-아날로그 컨버터(n은 3 이상의 자연수); 및
    상기 제2 내지 제n 기준전압을 입력받아서 제2 내지 제n 감마기준전압을 출력하는 제2 내지 제n 전압추종기;를 포함하는 감마기준전압 발생회로.
  6. 제 5 항에 있어서,
    상기 제2 내지 제n 디지털-아날로그 컨버터에 각 하나씩 형성되는 제1 내지 제(n-1) 스위치를 더 포함하고,
    상기 제1 내지 제(n-1) 스위치는 상기 고전위전압 또는 상기 제1 전압추종기의 출력전압을 선택적으로 제공받도록 스위칭되는 것을 특징으로 하는 감마기준전압 발생회로.
  7. 제 6 항에 있어서,
    상기 제1 내지 제(n-1) 스위치는 상기 제1 디지털-아날로그 컨버터의 출력전압 변경구간에서 상기 제1 전압추종기의 출력단과 연결되며, 상기 제1 디지털-아날로그 컨버터의 출력전압 유지구간에서 상기 제1 디지털-아날로그 컨버터의 출력단과 연결되는 것을 특징으로 하는 감마기준전압 발생회로.
  8. 표시패널;
    상기 표시패널에 데이터 전압을 공급하는 데이터 구동부;
    상기 데이터 구동회로에 감마기준전압을 공급하기 위해서, 제1 디지털-아날로그 컨버터가 생성하는 제1 기준전압을 입력받고, 제1 감마기준전압을 출력하는 제1 전압추종기; 제2 디지털-아날로그 컨버터가 생성하는 제2 기준전압을 입력받고, 제n 감마기준전압을 출력하는 제n 전압추종기(n은 3이상의 자연수); 상기 제1 감마기준전압 및 제n 감마기준전압을 분압하는 저항스트링; 상기 저항스트링에 의해서 분압되는 전압을 입력받아서 제2 내지 제(n-1) 감마기준전압을 출력하는 제2 내지 제(n-1) 전압추종기; 상기 저항스트링의 제1 저항에 연결되며, 상기 제1 저항을 상기 제1 전압추종기의 출력단 또는 상기 제1 디지털-아날로그 컨버터의 출력단과 연결하는 제1 스위치; 및 상기 저항스트링의 제m 저항(m은 n-1)에 연결되며, 상기 제m 저항을 상기 제n 전압추종기의 출력단 또는 상기 제2 디지털-아날로그 컨버터의 출력단과 연결하는 제2 스위치;를 포함하는 감마기준전압 발생회로; 및
    상기 제1 및 제2 디지털-아날로그 컨버터의 출력전압 변경구간에서, 상기 제1 스위치가 상기 제1 전압추종기의 출력단과 연결되고, 상기 제2 스위치는 상기 제n 전압추종기의 출력단과 연결되도록 스위치-온 신호를 상기 감마기준전압 발생회로로 제공하고, 상기 제1 및 제2 디지털-아날로그 컨버터의 출력전압 유지구간에서, 상기 제1 스위치가 상기 제1 디지털-아날로그 컨버터의 출력단과 연결되고, 상기 제2 스위치는 상기 제2 디지털-아날로그 컨버터의 출력단과 연결되도록 스위치-오프 신호를 상기 감마기준전압 발생회로로 제공하는 타이밍 콘트롤러;를 포함하는 표시장치.
  9. 표시패널;
    상기 표시패널에 데이터 전압을 공급하는 데이터 구동부;
    상기 데이터 구동부에 감마기준전압을 공급하기 위해서, 제1 기준전압을 생성하는 제1 디지털-아날로그 컨버터; 상기 제1 기준전압을 입력받아서 제1 감마기준전압을 출력하는 제1 전압추종기; 저전위전압 및 상기 제1 감마기준전압을 분압하여 제2 내지 제n 기준전압을 생성하는 제2 내지 제n 디지털-아날로그 컨버터(n은 3이상의 자연수); 상기 제2 내지 제n 기준전압을 입력받아서 제2 내지 제n 감마기준전압을 출력하는 제2 내지 제n 전압추종기; 상기 제2 내지 제n 디지털-아날로그 컨버터에 각 하나씩 형성되는 제1 내지 제(n-1) 스위치;를 포함하는 감마기준전압 발생회로; 및
    상기 제1 디지털-아날로그 컨버터의 출력전압 변경구간에서, 상기 제1 내지 제(n-1) 스위치가 상기 제1 전압추종기의 출력단과 연결되도록 스위치-온 신호를 상기 감마기준전압 발생회로에 제공하고, 상기 제1 디지털-아날로그 컨버터의 출력전압 유지구간에서, 상기 제1 내지 제(n-1) 스위치가 상기 제1 디지털-아날로그 컨버터의 출력단과 연결되도록 스위치-오프 신호를 상기 감마기준전압 발생회로에 제공하는 타이밍 콘트롤러;를 포함하는 표시장치.
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