KR20150042064A - Method for manufacturing single-layer pcb - Google Patents

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KR20150042064A
KR20150042064A KR20130120802A KR20130120802A KR20150042064A KR 20150042064 A KR20150042064 A KR 20150042064A KR 20130120802 A KR20130120802 A KR 20130120802A KR 20130120802 A KR20130120802 A KR 20130120802A KR 20150042064 A KR20150042064 A KR 20150042064A
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circuit board
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circuit pattern
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노종문
박종태
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삼성전기주식회사
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Abstract

According to the present invention, the present invention provides a method for manufacturing a single layer PCB which includes the steps of: providing a carrier; stacking a first insulation layer on the upper and lower sides of the carrier and forming a first hole on the stacked first insulation layer; forming a first via and a circuit pattern by stacking a first plating layer on the first insulation layer and the first hole; stacking a second insulation layer on the circuit pattern and the first insulation layer and forming a second hole on the upper side of the circuit pattern; forming a second via by stacking a second plating layer on the second hole; and removing the carrier.

Description

단층 인쇄회로기판 제조방법{METHOD FOR MANUFACTURING SINGLE-LAYER PCB}METHOD FOR MANUFACTURING SINGLE-LAYER PCB [0001]

본 발명은 단층 인쇄회로기판 제조방법에 관한 것이다.
The present invention relates to a method of manufacturing a single-layer printed circuit board.

일반적으로, 인쇄회로기판은 가공방법에 따라 단층 인쇄회로기판, 양면 인쇄회로기판, 다층 인쇄회로기판 등으로 분류할 수 있으며, 재질에 따라 페놀재질의 인쇄회로기판과 글래스(Grass) 또는 에폭시 재질의 인쇄회로기판으로 분류할 수 있다.In general, a printed circuit board can be classified into a single-layer printed circuit board, a double-sided printed circuit board, a multilayer printed circuit board, and the like depending on a processing method. Depending on the material, a printed circuit board made of phenol, It can be classified as printed circuit board.

종래 기술에 따른 단층 인쇄회로기판은 기본적으로 노광, 현상, 에칭, 세정 등의 다수의 공정을 포함하여 제조되고 있어 공정이 복잡하고 금속의 노광, 에칭, 현상, 세정으로 패턴을 형성하기 때문에 도금되는 금속의 대부분이 에칭되어 원자재 낭비 등의 문제점이 있다. 또한, 종래 기술에 따른 단층 인쇄회로기판은 코어층으로 에폭시 재질을 사용하고 있어 박형의 인쇄회로기판을 제조하기 어렵다는 문제점이 있었다.The single-layer printed circuit board according to the related art is basically manufactured by including a plurality of processes such as exposure, development, etching, and cleaning, and is complicated in process and forms a pattern by exposure, etching, development, Most of the metal is etched and there is a problem such as waste of raw materials. In addition, since the single layer printed circuit board according to the related art uses an epoxy material as the core layer, it is difficult to manufacture a thin printed circuit board.

관련한 기술로는 대한민국 특허공개공보 제2011-0072666호(2011.06.29 공개, 단층 인쇄회로기판 및 그의 제조방법)가 있다.
A related art is Korean Patent Laid-Open Publication No. 2011-0072666 (published on Jun. 29, 2011, a single-layer printed circuit board and a manufacturing method thereof).

본 발명의 실시예에 따라, 단층 인쇄회로기판을 제조하기 위하여 캐리어 더미층을 이용하여 박판의 단층 인쇄회로기판 제조의 어려움을 해소하고, 회로패턴의 상부 및 하부에 비아가 형성된 인쇄회로기판을 제조할 수 있는 단층 인쇄회로기판 제조방법이 제공된다.
According to an embodiment of the present invention, a carrier dummy layer is used to manufacture a single-layer printed circuit board, thereby solving the difficulty of manufacturing a single-layer printed circuit board of a thin plate and manufacturing a printed circuit board having vias formed on the top and bottom of the circuit pattern A method for manufacturing a single-layer printed circuit board is provided.

본 발명의 일 실시예에 따르면, 캐리어를 제공하는 단계, 상기 캐리어의 상하부에 제1 절연층을 적층하고, 적층된 제1 절연층에 각각 제1 홀을 형성하는 단계, 상기 제1 홀 및 상기 제1 절연층에 제1 도금층을 적층하여 제1 비아 및 회로패턴을 형성하는 단계, 상기 제1 절연층 및 상기 회로패턴에 제2 절연층을 적층하며, 상기 회로패턴의 상부에 제2 홀을 형성하는 단계, 상기 제2 홀에 제2 도금층을 적층하여 제2 비아를 형성하는 단계, 및 상기 캐리어를 제거하는 단계를 포함하는 것을 특징으로 하는 단층 인쇄회로기판의 제조방법이 제공된다.According to an embodiment of the present invention, there is provided a method of manufacturing a semiconductor device, comprising: providing a carrier; stacking a first insulating layer on the upper and lower portions of the carrier; forming a first hole in each of the stacked first insulating layers; A method for manufacturing a semiconductor device, comprising the steps of: laminating a first plating layer on a first insulating layer to form a first via and a circuit pattern; laminating a second insulating layer on the first insulating layer and the circuit pattern; Forming a second via layer by laminating a second plating layer on the second hole, and removing the carrier. The method of manufacturing a single-layer printed circuit board includes the steps of:

상기 캐리어는 상하부에 적층된 동박층을 포함할 수 있다. The carrier may include a copper foil layer stacked on top and bottom.

상기 캐리어를 제거하는 단계는, 상기 캐리어 중 상기 동박층을 제외한 부분을 분리하여 제거하는 단계, 에칭에 의하여 상기 동박층을 제거하는 단계를 포함할 수 있다.The removing the carrier may include removing the portion of the carrier excluding the copper foil layer, and removing the copper foil layer by etching.

상기 회로패턴을 형성하는 단계는, 상기 제1 도금층의 일부에 드라이 필름을 적층하며, 드라이 필름이 적층되지 않은 상기 제1 도금층의 나머지 부분을 에칭하여 회로패턴을 형성할 수 있다.The step of forming the circuit pattern may include forming a circuit pattern by laminating a dry film on a part of the first plating layer and etching the remaining part of the first plating layer on which the dry film is not laminated.

또한, 본 발명은 상기 회로패턴을 형성하는 단계 이후에, 상기 드라이필름을 제거하는 단계를 더 포함할 수 있다.
Further, the present invention may further include a step of removing the dry film after the step of forming the circuit pattern.

본 발명의 실시예들에 따르면, 단층 인쇄회로기판 제조방법을 통하여 단층 인쇄회로기판을 제조하기 위하여 캐리어 더미층을 이용하여 박판의 단층 인쇄회로기판 제조의 어려움을 해소하고, 회로패턴의 상부 및 하부에 비아가 형성된 단층 인쇄회로기판을 제조할 수 있다.
According to embodiments of the present invention, a carrier dummy layer is used to manufacture a single-layer printed circuit board through a single-layer printed circuit board manufacturing method, thereby solving the difficulty of manufacturing a single-layer printed circuit board of a thin plate, A single-layer printed circuit board on which vias are formed can be manufactured.

도 1 내지 도 11은 본 발명의 일 실시예에 따른 단층 인쇄회로기판 제조방법을 나타낸 공정을 순차적으로 나타낸 도면.
도 12는 본 발명의 일 실시예에 따른 단층 인쇄회로기판 제조방법에 의하여 제조된 단층 인쇄회로기판을 나타낸 도면.
FIGS. 1 to 11 sequentially illustrate a process for manufacturing a single-layer printed circuit board according to an embodiment of the present invention. FIG.
12 illustrates a single-layer printed circuit board fabricated by a method of manufacturing a single-layer printed circuit board in accordance with an embodiment of the present invention.

본 발명은 다양한 변환을 가할 수 있고 여러 가지 실시예를 가질 수 있는 바, 특정 실시예들을 도면에 예시하고 상세한 설명에 상세하게 설명하고자 한다. 그러나, 이는 본 발명을 특정한 실시 형태에 대해 한정하려는 것이 아니며, 본 발명의 사상 및 기술 범위에 포함되는 모든 변환, 균등물 내지 대체물을 포함하는 것으로 이해되어야 한다. 본 발명을 설명함에 있어서 관련된 공지 기술에 대한 구체적인 설명이 본 발명의 요지를 흐릴 수 있다고 판단되는 경우 그 상세한 설명을 생략한다.BRIEF DESCRIPTION OF THE DRAWINGS The present invention is capable of various modifications and various embodiments, and specific embodiments are illustrated in the drawings and described in detail in the detailed description. It is to be understood, however, that the invention is not to be limited to the specific embodiments, but includes all modifications, equivalents, and alternatives falling within the spirit and scope of the invention. DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENTS Hereinafter, the present invention will be described in detail with reference to the accompanying drawings.

제1, 제2 등의 용어는 다양한 구성요소들을 설명하는데 사용될 수 있지만, 상기 구성요소들은 상기 용어들에 의해 한정되어서는 안 된다. 상기 용어들은 하나의 구성요소를 다른 구성요소로부터 구별하는 목적으로만 사용된다.The terms first, second, etc. may be used to describe various components, but the components should not be limited by the terms. The terms are used only for the purpose of distinguishing one component from another.

본 출원에서 사용한 용어는 단지 특정한 실시예를 설명하기 위해 사용된 것으로, 본 발명을 한정하려는 의도가 아니다. 단수의 표현은 문맥상 명백하게 다르게 뜻하지 않는 한, 복수의 표현을 포함한다. 본 출원에서, "포함하다" 또는 "가지다" 등의 용어는 명세서상에 기재된 특징, 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것이 존재함을 지정하려는 것이지, 하나 또는 그 이상의 다른 특징들이나 숫자, 단계, 동작, 구성요소, 부품 또는 이들을 조합한 것들의 존재 또는 부가 가능성을 미리 배제하지 않는 것으로 이해되어야 한다.The terminology used in this application is used only to describe a specific embodiment and is not intended to limit the invention. The singular expressions include plural expressions unless the context clearly dictates otherwise. In the present application, the terms "comprises" or "having" and the like are used to specify that there is a feature, a number, a step, an operation, an element, a component or a combination thereof described in the specification, But do not preclude the presence or addition of one or more other features, integers, steps, operations, elements, components, or combinations thereof.

이하, 본 발명에 따른 단층 인쇄회로기판 제조방법의 실시예를 첨부도면을 참조하여 상세히 설명하기로 하며, 첨부 도면을 참조하여 설명함에 있어, 동일하거나 대응하는 구성 요소는 동일한 도면번호를 부여하고 이에 대한 중복되는 설명은 생략하기로 한다.
DETAILED DESCRIPTION OF THE PREFERRED EMBODIMENT Hereinafter, embodiments of a method for manufacturing a single-layer printed circuit board according to the present invention will be described in detail with reference to the accompanying drawings, wherein like reference numerals designate like or corresponding components, A duplicate description will be omitted.

도 1 내지 도 11은 본 발명의 일 실시예에 따른 단층 인쇄회로기판 제조방법을 나타낸 공정을 순차적으로 나타낸 도면이고, 도 12는 본 발명의 일 실시예에 따른 단층 인쇄회로기판 제조방법에 의하여 제조된 단층 인쇄회로기판을 나타낸 도면이다.1 to 11 are views sequentially showing a method of manufacturing a single-layer printed circuit board according to an embodiment of the present invention. FIG. 12 is a cross-sectional view illustrating a method of manufacturing a single-layer printed circuit board according to an embodiment of the present invention. Lt; RTI ID = 0.0 > a < / RTI >

도 1에 도시된 바와 같이, 본 발명에 따른 단층 인쇄회로기판 제조방법에 있어서, 일정한 두께 이하의 제품 제작시 캐리어(100)를 사용할 수 있다. 캐리어(100)의 상하부에 얇은 박판을 위치시켜 일정 두께까지 제품을 제작한 다음, 캐리어(100)에서 제품을 분리시켜 후공정을 통하여 단층 인쇄회로기판(1000)을 완성할 수 있게 된다.As shown in FIG. 1, in the method of manufacturing a single-layer printed circuit board according to the present invention, the carrier 100 may be used when manufacturing a product having a certain thickness or less. It is possible to complete the single printed circuit board 1000 through a post-process by separating the product from the carrier 100 after the product is manufactured up to a certain thickness by placing a thin foil on the upper and lower portions of the carrier 100.

매우 얇은 박판을 설비에 직접 투입하는 경우 기판 파손에 의하여 제품 제작이 거의 불가능하므로, 얇은 박판일수록 본 발명을 적용하는 것이 바람직할 수 있다.When a very thin sheet is directly introduced into a facility, it is almost impossible to manufacture a product due to substrate breakage. Therefore, it may be preferable to apply the present invention to a thin sheet.

도 2에 도시된 바와 같이, 캐리어(100) 상부에 제1 절연층(200)을 적층하고, 제1 절연층(200)을 노광, 현상하여 제1 비아가 형성될 제1 홀(210)을 만든다. 이때 제1 절연층(200)은 고분자 수지로 구성될 수 있다.2, the first insulating layer 200 is laminated on the carrier 100, and the first insulating layer 200 is exposed and developed to form a first hole 210 in which the first via is to be formed I make it. At this time, the first insulating layer 200 may be formed of a polymer resin.

제1 절연층(200)에 제1 홀(210)을 형성한 다음, 도 3에 도시된 바와 같이, 제1 절연층(200) 및 제1 홀(210)에 도금을 위한 시드(seed) 라인을 형성한다. 제1 절연층(200) 및 제1 홀(210)의 표면을 전처리를 통하여 조도를 형성한 다음 증착이나 화학 도금을 거쳐 시드 라인을 형성할 수 있다. A first hole 210 is formed in the first insulating layer 200 and then a seed line for plating is formed in the first insulating layer 200 and the first hole 210, . The surface of the first insulating layer 200 and the first hole 210 may be subjected to pretreatment to form roughness, followed by deposition or chemical plating to form a seed line.

도 4에 도시된 바와 같이, 시드 라인을 형성한 다음 시드 라인 상에 도금을 통하여 제1 비아 및 일정 두께의 제1 도금층(300)을 형성한다.As shown in FIG. 4, a seed line is formed and then a first via layer and a first plating layer 300 of a predetermined thickness are formed on the seed line through plating.

도 5에 도시된 바와 같이, 제1 도금층(300)의 상부에는 드라이 필름(400)이 적층된다. 이때, 드라이 필름(400)은 제1 도금층(300) 중 회로패턴에 해당하는 부분의 상부에만 적층될 수 있다. 도 6에 도시된 바와 같이, 드라이 필름(400)이 적층된 다음, 에칭을 통하여 제1 도금층(300)의 나머지 부분을 제거하게 된다. 남겨진 제1 도금층(300)은 회로패턴이 될 수 있다.As shown in FIG. 5, a dry film 400 is stacked on the first plating layer 300. At this time, the dry film 400 may be stacked only on the upper part of the first plating layer 300 corresponding to the circuit pattern. As shown in FIG. 6, after the dry film 400 is laminated, the remaining portion of the first plating layer 300 is removed through etching. The remaining first plating layer 300 may be a circuit pattern.

도 7에 도시된 바와 같이, 본 발명에 따른 단층 인쇄회로기판 제조방법은 회로패턴을 형성한 다음 드라이 필름(400)을 제거하고, 제1 절연층(200) 및 회로패턴의 상부에 제2 절연층(500)을 적층할 수 있다. 또한 적층된 제2 절연층(500)에 제2 비아(600)가 형성될 제2 홀(510)을 형성한다. 제2 절연층(500) 또한 고분자 수지로 구성될 수 있고, 이때 제2 홀(510)은 노광, 현상을 통하여 형성될 수 있다.7, a method of manufacturing a single-layer printed circuit board according to the present invention includes forming a circuit pattern, removing the dry film 400, and forming a first insulation layer 200 and a second insulation Layer 500 may be stacked. A second hole 510 in which the second via 600 is to be formed is formed in the second insulating layer 500. The second insulating layer 500 may also be formed of a polymer resin, and the second hole 510 may be formed through exposure and development.

도 8에는, 노광 및 현상을 통하여 형성된 제2 홀(510)에 제2 비아(600)를 형성하는 것이 개시되어 있다. 즉, 회로패턴 상부의 개구부인 제2 홀(510)에는 일정량 도금을 하여 도전층인 제2 도금층(600)을 형성하거나 또는 페이스트(paste) 결합을 통하여 도전층인 제2 도금층(600)을 형성할 수 있다. 이때, 전처리를 통하여 조도를 형성함으로써 보다 강한 결합력을 형성할 수도 있다. 8, a second via hole 600 is formed in a second hole 510 formed through exposure and development. That is, a second plating layer 600, which is a conductive layer, is formed by plating a predetermined amount on the second hole 510, which is an opening above the circuit pattern, or a second plating layer 600, which is a conductive layer, is formed through paste bonding can do. At this time, by forming the roughness through the preprocessing, a stronger bonding force can be formed.

도 9는 캐리어(100)의 일부를 제거하는 공정을 나타낸 도면이다. 즉, 캐리어(100) 중 동박층(102)을 제외한 부분(101)을 분리하여 제거하는 것을 포함한다. 도 10은 캐어어 중 동박층(102)을 제외한 부분(101)을 분리하여 상부기판 및 하부기판의 단층 기판으로 제작될 수 있다.9 is a view showing a process of removing a part of the carrier 100. Fig. That is, it includes separating and removing the portion 101 of the carrier 100 excluding the copper foil layer 102. 10 may be manufactured as a single layer substrate of an upper substrate and a lower substrate by separating the portion 101 excluding the copper foil layer 102 in the carrier.

그리고 도 11에 도시된 바와 같이, 상부기판 및 하부기판의 부착된 동박층(102)은 에칭을 통하여 제거할 수 있다. 이때, 에칭에 의하여 동박층(102)과 함께 제2 비아(600)의 일부도 제거될 수 있다.As shown in FIG. 11, the attached copper foil layer 102 of the upper substrate and the lower substrate may be removed by etching. At this time, a portion of the second via 600 together with the copper foil layer 102 may be removed by etching.

도 12는 상술한 공정을 거쳐 완성된 단층 인쇄회로기판(1000)을 나타낸 것으로서, 제1 비아의 일부가 에칭에 의하여 제거된 부분과 상기 동박층(102)의 두께의 합은 제2 비아(600)의 일부가 에칭에 의하여 제거된 부분과 유사하게 형성될 수 있다.12 shows a single-layer printed circuit board 1000 that has been completed through the above-described processes. The sum of the thickness of the portion of the first via removed by etching and the thickness of the copper foil layer 102 is larger than that of the second via 600 ) May be formed similar to a portion removed by etching.

에칭을 제품 전체로 진행하기 때문에 동박층(102)이 에칭으로 제거시 제2 비아(600)도 함께 에칭으로 제거되고, 더 나아가 동박층(102)이 모두 제거된 다음 제1 비아도 에칭으로 제거될 수 있고, 이때, 제2 비아(600)도 더욱 에칭으로 제거될 수 있다.Etching proceeds to the entire product, so that when the copper foil layer 102 is removed by etching, the second vias 600 are also removed by etching, and furthermore, the copper foil 102 is removed and then the first via is removed by etching And at this time, the second via 600 can be further removed by etching.

본 발명에 따른 단층 인쇄회로기판 제조방법을 이용하여 단층 인쇄회로기판 제조시, 도 12에 도시된 바와 같이 한 개의 회로패턴 및 회로패턴의 상부 및 하부에 형성된 2개의 비아를 얻을 수 있다. 또한 설비의 제품 제작 한계를 극복하여 박판의 강성저하를 해결할 수 있는 단층 인쇄회로기판을 제조할 수 있게 된다.
When manufacturing a single-layer printed circuit board using the method of manufacturing a single-layer printed circuit board according to the present invention, two vias formed at the top and bottom of one circuit pattern and circuit pattern as shown in FIG. 12 can be obtained. In addition, it is possible to manufacture a single-layer printed circuit board which can overcome the manufacturing limit of the equipment and can solve the decrease in rigidity of the thin plate.

이상, 본 발명의 일 실시예에 대하여 설명하였으나, 해당 기술 분야에서 통상의 지식을 가진 자라면 특허청구범위에 기재된 본 발명의 사상으로부터 벗어나지 않는 범위 내에서, 구성 요소의 부가, 변경, 삭제 또는 추가 등에 의해 본 발명을 다양하게 수정 및 변경시킬 수 있을 것이며, 이 또한 본 발명의 권리범위 내에 포함된다고 할 것이다.
It will be apparent to those skilled in the art that various modifications and variations can be made in the present invention without departing from the spirit of the invention as set forth in the appended claims. The present invention can be variously modified and changed by those skilled in the art, and it is also within the scope of the present invention.

100: 캐리어
101: 동박층을 제외한 부분
102: 동박층
200: 제1 절연층
210: 제1 홀
300: 제1 도금층
400: 드라이 필름
500: 제2 절연층
510: 제2 홀
600: 제2 도금층, 제2 비아
1000: 단층 인쇄회로기판
100: Carrier
101: part excluding the copper foil layer
102: copper foil layer
200: first insulating layer
210: first hole
300: First plating layer
400: dry film
500: second insulating layer
510: second hole
600: second plating layer, second via
1000: Single layer printed circuit board

Claims (5)

캐리어를 제공하는 단계;
상기 캐리어의 상하부에 제1 절연층을 적층하고, 적층된 제1 절연층에 각각 제1 홀을 형성하는 단계;
상기 제1 홀 및 상기 제1 절연층에 제1 도금층을 적층하여 제1 비아 및 회로패턴을 형성하는 단계;
상기 제1 절연층 및 상기 회로패턴에 제2 절연층을 적층하며, 상기 회로패턴의 상부에 제2 홀을 형성하는 단계;
상기 제2 홀에 제2 도금층을 적층하여 제2 비아를 형성하는 단계; 및
상기 캐리어를 제거하는 단계를 포함하는 것을 특징으로 하는 단층 인쇄회로기판의 제조방법.
Providing a carrier;
Stacking a first insulating layer on upper and lower portions of the carrier and forming first holes in the first insulating layers;
Depositing a first plating layer on the first hole and the first insulating layer to form a first via and a circuit pattern;
Depositing a second insulating layer on the first insulating layer and the circuit pattern, and forming a second hole on the circuit pattern;
Depositing a second plating layer on the second hole to form a second via; And
And removing the carrier. ≪ RTI ID = 0.0 > 11. < / RTI >
제1항에 있어서,
상기 캐리어는
상하부에 적층된 동박층을 포함하는 것을 특징으로 하는 단층 인쇄회로기판 제조방법.
The method according to claim 1,
The carrier
And a copper foil layer laminated on the upper and lower sides.
제2항에 있어서,
상기 캐리어를 제거하는 단계는,
상기 캐리어 중 상기 동박층을 제외한 부분을 분리하여 제거하는 단계;
에칭에 의하여 상기 동박층을 제거하는 단계를 포함하는 것을 특징으로 하는 단층 인쇄회로기판 제조방법.
3. The method of claim 2,
Wherein removing the carrier comprises:
Separating and removing a portion of the carrier excluding the copper foil layer;
And removing the copper foil layer by etching.
제3항에 있어서,
상기 회로패턴을 형성하는 단계는,
상기 제1 도금층의 일부에 드라이 필름을 적층하며, 드라이 필름이 적층되지 않은 상기 제1 도금층의 나머지 부분을 에칭하여 회로패턴을 형성하는 것을 특징으로 하는 단층 인쇄회로기판 제조방법.
The method of claim 3,
Wherein forming the circuit pattern comprises:
Wherein a dry film is laminated on a part of the first plating layer and a remaining part of the first plating layer on which the dry film is not laminated is etched to form a circuit pattern.
제4항에 있어서,
상기 회로패턴을 형성하는 단계 이후에, 상기 드라이필름을 제거하는 단계를 더 포함하는 것을 특징으로 하는 단층 인쇄회로기판 제조방법.
5. The method of claim 4,
Further comprising the step of removing the dry film after the step of forming the circuit pattern.
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