KR20120077345A - 액정표시장치 - Google Patents

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KR20120077345A
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김재겸
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엘지디스플레이 주식회사
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Abstract

본 발명의 실시예는, 액정패널; 액정패널에 형성된 공통전압라인들이 영역별로 구분되어 그룹화된 공통전압라인그룹들; 및 액정패널에 형성되고 공통전압라인그룹들에 각기 배속되어 동일한 공통전압을 공급하되 공통전압라인그룹들에 공급되는 공통전압에 대해 개별적인 보상을 수행하도록 구성된 보상회로들을 포함하는 액정표시장치를 제공한다.

Description

액정표시장치{Liquid Crystal Display Device}
본 발명의 실시예는 액정표시장치에 관한 것이다.
정보화 기술이 발달함에 따라 사용자와 정보간의 연결 매체인 표시장치의 시장이 커지고 있다. 이에 따라, 액정 표시장치(Liquid Crystal Display: LCD), 유기전계 발광소자(Organic Light Emitting Diodes: OLED) 및 플라즈마 디스플레이 패널(Plasma Display Panel: PDP) 등과 같은 평판 표시장치(Flat Panel Display: FPD)의 사용이 증가하고 있다. 그 중 고해상도를 구현할 수 있고 소형화뿐만 아니라 대형화가 가능한 액정 표시장치가 널리 사용되고 있다.
액정표시장치는 트랜지스터, 스토리지 커패시터 및 화소전극 등이 형성된 트랜지스터기판과 컬러필터 및 블랙매트릭스 등이 형성된 컬러필터기판 사이에 위치하는 액정층을 포함한다. 액정표시장치는 화소전극과 트랜지스터기판 또는 컬러필터기판에 형성된 공통전극에 형성되는 전계로 액정층의 배열 방향을 조절하여 백라이트유닛으로부터 입사된 광을 출사하는 방식으로 영상을 표시한다.
액정표시장치는 데이터구동부로부터 공급된 데이터전압과 기준 전위 역할을 하는 공통전압 간의 차이가 액정을 구동하는 전압으로 작용한다. 공통전압은 액정패널에 형성된 배선저항 및 커패시터 등의 영향으로 액정패널의 위치에 따라 공급되는 전압이 달라진다. 즉, 공통전압은 액정패널 전체에 걸쳐 가장 큰 영향을 미치는 전압 중 하나이다.
따라서, 종래에는 공통전압을 생성하는 공통전압생성부에 하나의 보상회로를 내장하고 패널의 마지막 라인에 위치하는 공통전압배선으로부터 공통전압을 되먹임 받고 이를 이용하여 패널 전체에 공급되는 공통전압을 보상하는 형태의 보상 구조가 제안되었다.
그런데, 종래 보상 구조는 마지막 라인에 위치하는 공통전압만 되먹임 받기 때문에 그 외의 라인에 대한 최적 수준의 보상이 어려웠다. 이로 인하여, 종래 보상 구조는 화질 측면에서 공통전압 편차에 의해 발생되는 수평 크로스토크를 전 영역에서 제거할 수 없었음은 물론 잔상 측면에서도 패널 영역별로 수준의 차이가 발생하는 문제가 있었다.
상술한 배경기술의 문제점을 해결하기 위한 본 발명의 실시예는, 액정패널의 전 영역에 걸쳐 수평 크로스토크를 제거하고 액정패널의 영역별 잔상 수준 차이를 제거하여 표시품질을 향상시킬 수 있는 액정표시장치를 제공하는 것이다.
상술한 과제 해결 수단으로 본 발명의 실시예는, 액정패널; 액정패널에 형성된 공통전압라인들이 영역별로 구분되어 그룹화된 공통전압라인그룹들; 및 액정패널에 형성되고 공통전압라인그룹들에 각기 배속되어 동일한 공통전압을 공급하되 공통전압라인그룹들에 공급되는 공통전압에 대해 개별적인 보상을 수행하도록 구성된 보상회로들을 포함하는 액정표시장치를 제공한다.
보상회로들 각각은, 공통전압라인그룹들에 포함된 공통전압라인들 중 어느 하나로부터 공통전압을 되먹임 받도록 배선될 수 있다.
보상회로들 각각은, 트랜지스터들과 수동소자를 포함하는 반전 증폭기로 구성되어 액정패널의 베젤영역에 형성될 수 있다.
보상회로들 각각은, 반전 증폭기의 증폭비 차에 따라 공통전압라인그룹들에 공급되는 공통전압에 대해 개별적인 보상을 수행할 수 있다.
반전 증폭기는, 반전 증폭기의 증폭비를 조절하는 저항기들의 면적 및 길이를 공통전압라인그룹들에 배속된 보상회로들 별로 달리함으로써 그 증폭비가 달리질 수 있다.
보상회로들 각각은, 액정패널에 형성된 게이트구동부에 의해 마련된 더미영역에 형성될 수 있다.
액정패널은, IPS 및 FFS의 액정모드를 포함할 수 있다.
본 발명의 실시예는, 액정패널의 전 영역에 걸쳐 수평 크로스토크를 제거하고 액정패널의 영역별 잔상 수준 차이를 제거하여 표시품질을 향상시킬 수 있는 액정표시장치를 제공하는 효과가 있다.
도 1은 본 발명의 일 실시예에 따른 액정표시장치의 블록도.
도 2는 본 발명의 실시예에 따른 액정패널을 설명하기 위한 도면.
도 3은 도 2에 도시된 공통전압라인그룹들과 보상회로들의 상세 구성 및 배치 예시도.
도 4는 저항기들의 저항비 조절에 대해 설명하기 위한 도면.
도 5는 본 발명의 변형된 실시예에 따른 액정패널을 설명하기 위한 도면.
이하, 본 발명의 실시를 위한 구체적인 내용을 첨부된 도면을 참조하여 설명한다.
도 1은 본 발명의 일 실시예에 따른 액정표시장치의 블록도 이다.
도 1에 도시된 바와 같이, 본 발명의 일 실시예에 따른 액정표시장치에는 타이밍제어부(TCN), 액정패널(PNL), 게이트구동부(SDRV), 데이터구동부(DDRV), 백라이트유닛(BLU) 및 전원부(PWR)가 포함된다.
타이밍제어부(TCN)는 외부로부터 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK), 데이터신호(DATA)를 공급받는다. 타이밍제어부(TCN)는 수직 동기신호(Vsync), 수평 동기신호(Hsync), 데이터 인에이블 신호(Data Enable, DE), 클럭신호(CLK) 등의 타이밍신호를 이용하여 데이터구동부(DDRV)와 게이트구동부(SDRV)의 동작 타이밍을 제어한다. 또한, 타이밍제어부(TCN)는 전원부제어신호(PSC)를 이용하여 프로그래머블 전원부(PWR)로부터 출력되는 공통전압의 레벨을 액정패널(PNL)의 위치별로 가변한다. 타이밍제어부(TCN)는 1 수평기간의 데이터 인에이블 신호(DE)를 카운트하여 프레임기간을 판단할 수 있으므로 외부로부터 공급되는 수직 동기신호(Vsync)와 수평 동기신호(Hsync)는 생략될 수 있다. 타이밍제어부(TCN)에서 생성되는 제어신호들에는 게이트구동부(SDRV)의 동작 타이밍을 제어하기 위한 게이트 타이밍 제어신호(GDC)와 데이터구동부(DDRV)의 동작 타이밍을 제어하기 위한 데이터 타이밍 제어신호(DDC)가 포함될 수 있다. 게이트 타이밍 제어신호(GDC)에는 게이트 스타트 펄스(Gate Start Pulse, GSP), 게이트 시프트 클럭(Gate Shift Clock, GSC), 게이트 출력 인에이블신호(Gate Output Enable, GOE) 등이 포함된다. 게이트 스타트 펄스(GSP)는 첫 번째 게이트신호가 발생하는 게이트 드라이브 IC(Integrated Circuit)에 공급된다. 게이트 시프트 클럭(GSC)은 게이트 드라이브 IC들에 공통으로 입력되는 클럭신호로써 게이트 스타트 펄스(GSP)를 시프트시키기 위한 클럭신호이다. 게이트 출력 인에이블신호(GOE)는 게이트 드라이브 IC들의 출력을 제어한다. 데이터 타이밍 제어신호(DDC)에는 소스 스타트 펄스(Source, Start Pulse, SSP), 소스 샘플링 클럭(Source Sampling Clock, SSC), 소스 출력 인에이블신호(Source Output Enable, SOE) 등이 포함된다. 소스 스타트 펄스(SSP)는 데이터구동부(DDRV)의 데이터 샘플링 시작 시점을 제어한다. 소스 샘플링 클럭(SSC)은 라이징 또는 폴링 에지에 기준하여 데이터구동부(DDRV) 내에서 데이터의 샘플링 동작을 제어하는 클럭신호이다. 소스 출력 인에이블신호(SOE)는 데이터구동부(DDRV)의 출력을 제어한다. 한편, 데이터구동부(DDRV)에 공급되는 소스 스타트 펄스(SSP)는 데이터전송 방식에 따라 생략될 수도 있다.
액정패널(PNL)은 박막트랜지스터기판(이하 TFT기판으로 약칭)과 컬러필터기판 사이에 위치하는 액정층을 포함하며 매트릭스형태로 배치된 서브 픽셀들(SP)을 포함한다. TFT기판에는 데이터라인들(DL), 게이트라인들(GL), TFT들, 스토리지 커패시터들 등이 형성되고, 컬러필터기판에는 블랙매트릭스들, 컬러필터들 등이 형성된다. 하나의 서브 픽셀(SP)은 상호 교차하는 데이터라인(D1)과 게이트라인(G1)에 의해 정의된다. 하나의 서브 픽셀(SP)에는 게이트라인(G1)을 통해 공급된 게이트신호에 의해 구동하는 TFT, 데이터라인(D1)을 통해 공급된 데이터신호를 데이터전압으로 저장하는 스토리지 커패시터(Cst), 스토리지 커패시터(Cst)에 저장된 데이터전압에 의해 구동하는 액정셀(Clc)이 포함된다. 액정셀(Clc)은 화소전극(1)에 공급된 데이터전압과 공통 전극(2)에 공급된 공통전압에 의해 구동된다. 공통 전극(2)은 TN(Twisted Nematic) 모드와 VA(Vertical Alignment) 모드와 같은 수직전계 구동방식에서 컬러필터 기판 상에 형성되며, IPS(In Plane Switching) 모드와 FFS(Fringe Field Switching) 모드와 같은 수평전계 구동방식에서 화소전극(1)과 함께 TFT기판 상에 형성된다. 공통 전극(2)은 공통전압라인(Vcom)으로부터 공통전압을 공급받는다. 액정패널(PNL)의 TFT기판과 컬러필터기판에는 편광판이 부착되고 액정의 프리틸트각(pre-tilt angle)을 설정하기 위한 배향막이 형성된다. 액정패널(PNL)의 액정모드는 전술한 TN 모드, VA 모드, IPS 모드, FFS 모드뿐 아니라 어떠한 액정모드로도 구현될 수 있다.
게이트구동부(SDRV)는 타이밍제어부(TCN)로부터 공급된 게이트 타이밍 제어신호(GDC)에 응답하여 액정패널(PNL)에 포함된 서브 픽셀들(SP)의 TFT들이 동작 가능한 게이트 구동전압의 스윙폭으로 신호의 레벨을 시프트시키면서 게이트신호를 순차적으로 생성한다. 게이트구동부(SDRV)에는 게이트라인들(GL)을 통해 생성된 게이트신호를 액정패널(PNL)에 포함된 서브 픽셀들(SP)에 공급한다. 게이트구동부(SDRV)는 IC(Integrated Circuit) 형태로 액정패널(PNL) 상에 실장되거나 GIP(Gate In Panel) 형태로 액정패널(PNL) 상에 형성될 수 있다. 여기서, GIP는 액정패널(PNL) 상에 박막 트랜지스터를 형성하는 공정과 동일한 방법으로 게이트구동부(SDRV)를 형성하는 기술이다.
데이터구동부(DDRV)는 타이밍제어부(TCN)로부터 공급된 데이터 타이밍 제어신호(DDC)에 응답하여 타이밍제어부(TCN)로부터 공급되는 데이터신호(DATA)를 샘플링하고 래치하여 병렬 데이터 체계의 데이터로 변환한다. 데이터구동부(DDRV)는 병렬 데이터 체계의 데이터로 변환할 때, 데이터신호(DATA)를 감마 기준전압으로 변환한다. 데이터구동부(DDRV)는 데이터라인들(DL)을 통해 변환된 데이터신호(DATA)를 액정패널(PNL)에 포함된 서브 픽셀들(SP)에 공급한다. 데이터구동부(DDRV)는 IC 형태로 액정패널(PNL) 상에 실장되거나 GIP(Gate In Panel) 형태로 액정패널(PNL) 상에 형성될 수 있다.
백라이트유닛(BLU)은 액정패널(PNL)에 광을 제공한다. 백라이트유닛(BLU)은 광을 출사하는 광원, 광을 액정패널(PNL)에 안내하는 도광판, 광을 집광 및 확산하는 광학시트 등을 포함한다.
전원부(PWR)는 외부로부터 공급된 입력전원(Vin)을 직류전원으로 변환하여 감마전압(GMA0~GMA7)과 공통전압(Vcom) 등을 출력한다. 감마전압(GMA0~GMA7)은 데이터구동부(DDRV)에 공급되고 공통전압(Vcom)은 공통전압라인에 공급된다. 이 밖에 전원부(PWR)는 게이트구동부(SDRV) 및 데이터구동부(DDRV)를 구동하는 구동전압을 출력할 수도 있다.
위의 설명에서는 전원부(PWR)가 감마전압(GMA0~GMA7)과 더불어 공통전압(Vcom)을 생성하는 것을 일례로 설명하였으나, 감마전압(GMA0~GMA7)과 공통전압(Vcom)은 각기 다른 장치에 의해 생성될 수도 있다.
이하, 본 발명의 실시예에 따른 액정표시장치에 대해 더욱 자세히 설명한다.
도 2는 본 발명의 실시예에 따른 액정패널을 설명하기 위한 도면이고, 도 3은 도 2에 도시된 공통전압라인그룹들과 보상회로들의 상세 구성 및 배치 예시도이며, 도 4는 저항기들의 저항비 조절에 대해 설명하기 위한 도면이고, 도 5는 본 발명의 변형된 실시예에 따른 액정패널을 설명하기 위한 도면이다.
도 1 및 도 2에 도시된 바와 같이, 액정패널(PNL)에는 공통전압라인들이 영역별로 구분되어 그룹화된 공통전압라인그룹들(Vcom1 ~ Vcomn)이 형성된다. 또한, 액정패널(PNL)에는 공통전압라인그룹들(Vcom1 ~ Vcomn)에 각기 배속되어 동일한 공통전압(Vcom)을 공급하되 공통전압라인그룹들(Vcom1 ~ Vcomn)에 공급되는 공통전압(Vcom)에 대해 개별적인 보상을 수행하도록 구성된 보상회로들(Comp1 ~ Compn)이 형성된다.
공통전압라인그룹들(Vcom1 ~ Vcomn)은 액정패널(PNL)에 영상이 표시되는 표시영역(AA)에 형성되는 반면 보상회로들(Comp1 ~ Compn)은 액정패널(PNL)에 영상이 미표시되는 베젤영역인 비표시영역(NA)에 형성된다. 공통전압라인그룹들(Vcom1 ~ Vcomn)의 경우 적어도 2개의 공통전압라인이 그룹화될 수 있고, 보상회로들(Comp1 ~ Compn)의 경우 각 그룹에 적어도 1개씩 배속될 수 있다.
실시예에 따른 액정표시장치는 그룹화된 공통전압라인그룹들(Vcom1 ~ Vcomn)에 각기 배속되도록 액정패널(PNL) 상에 형성된 보상회로들(Comp1 ~ Compn)이 해당 영역에 공급되는 공통전압(Vcom)을 개별적으로 보상한다.
공통전압(Vcom)을 공급하는 전원부(PWR)는 액정패널(PNL)과 연결되는 외부 회로기판에 형성된다. 모든 보상회로들(Comp1 ~ Compn)은 전원부(PWR)에 연결된 메인 공통전압라인(VCOM)을 통해 공통전압(Vcom)을 동일하게 공급받는다. 여기서, 메인 공통전압라인(VCOM)은 LOG(Line on Glass) 방식으로 형성되고 데이터구동부(DDRV)의 내부 1라인(패스라인)을 통해 액정패널(PNL)로 전달될 수 있으나 이에 한정되지 않는다.
도 3을 참조하면, 4개로 그룹화된 공통전압라인그룹들(Vcom1 ~ Vcom4)과 4개의 보상회로들(Comp1 ~ Comp4)의 구성 및 배치 구조가 도시된다.
제1공통전압라인그룹(Vcom1)에는 제1보상회로(Comp1)가 제2공통전압라인그룹(Vcom2)에는 제2보상회로(Comp2)가 제3공통전압라인그룹(Vcom3)에는 제3보상회로(Comp3)가 제4공통전압라인그룹(Vcom4)에는 제4보상회로(Comp4)가 배속된다.
도 3에는 간략히 도시하였으나, 각각의 보상회로들(Comp1 ~ Comp4)은 액정패널(PNL)에 형성될 수 있도록 트랜지스터들과 수동소자를 포함하는 반전 증폭기로 구성된다. 트랜지스터들과 수동소자로 구성된 반전 증폭기는 이들에 포함된 소자들의 특성, 설계자 및 설계 목적 등에 따라 다양하므로 이의 회로 구성에 대한 도시는 생략한다.
각각의 보상회로들(Comp1 ~ Comp4)은 트랜지스터들과 수동소자를 포함하는 반전 증폭기로 구성되므로 이는 액정패널(PNL)에 GIP 형태로 형성된 게이트구동부(SDRV)의 더미영역에 형성될 수 있게 된다. 참고로, 게이트구동부(SDRV)를 액정패널(PNL)에 GIP 형태로 형성할 경우 게이트구동부(SSDRV)가 차지하는 영역에는 각종 트랜지스터들이 형성되는 영역과 더불어 더미영역이 존재하게 된다. 여기서, 보상회로들(Comp1 ~ Comp4)은 GIP 형태로 형성된 게이트구동부(SSDRV)에 의해 마련된 더미영역에 형성된다. 통상 게이트구동부(SSDRV)에 의해 마련된 더미영역에는 대략 80여 개의 트랜지스터가 실장될 수 있으므로, 각각의 보상회로들(Comp1 ~ Comp4)은 액정패널(PNL)의 좌상, 좌하, 우상 및 우하를 포함하는 4개의 더미영역에 걸쳐 실장될 수 있다. 그러나 이는 일례일 뿐, 보상회로들(Comp1 ~ Comp4)은 액정패널(PNL)에 존재하는 모든 비표시영역(NA)에 형성될 수 있다.
각각의 보상회로들(Comp1 ~ Comp4)은 공통전압라인그룹들(Vcom1 ~ Vcom4)에 공급되는 공통전압을 보상하기 위해 공통전압라인그룹들(Vcom1 ~ Vcom4)에 포함된 공통전압라인들 중 어느 하나로부터 공통전압을 되먹임 받는 피드백라인(FB1 ~ FB4)이 배선된다.
각각의 보상회로들(Comp1 ~ Comp4)은 피드백라인(FB1 ~ FB4)을 통해 되먹임된 공통전압을 기반으로 공통전압라인그룹들(Vcom1 ~ Vcom4)에 공급할 공통전압을 보상하게 된다.
각각의 보상회로들(Comp1 ~ Comp4)은 반전 증폭기의 증폭비 차에 따라 공통전압라인그룹들(Vcom1 ~ Vcom4)에 공급되는 공통전압에 대해 개별적인 보상을 수행하게 된다. 각각의 보상회로들(Comp1 ~ Comp4)은 반전 증폭기의 증폭비를 조절하는 저항기들(R1 ~ R8)의 면적 및 길이를 도 4의 (a) 및 (b)와 같은 형태로 형성하여 저항비를 달리하면 공통전압라인그룹들(Vcom1 ~ Vcom4)에 배속된 보상회로들(Comp1 ~ Comp4) 별로 증폭비가 달리질 수 있다.
즉, 제1보상회로(Comp1)에 포함된 저항기들(R1, R2), 제2보상회로(Comp2)에 포함된 저항기들(R3, R4), 제3보상회로(Comp3)에 포함된 저항기들(R5, R6) 및 제4보상회로(Comp4)에 포함된 저항기들(R7, R8) 간의 저항비를 달리하면 이들을 통해 되먹임되는 공통전압의 레벨이 달라진다. 이때, 각각의 보상회로들(Comp1 ~ Comp4)에 포함된 저항기들(R1 ~ R8)의 저항비는 액정패널(PNL)에 공급된 공통전압의 전압 강하(Drop) 특성값등(달리 설명하면, 측정을 통해 마련된 측정값)을 기반으로 설정될 수 있다.
한편, 위의 설명에서는 보상회로들(Comp1 ~ Comp4)이 액정패널(PNL)의 일측에 형성된 것을 일례로 하였다. 그러나, 도 5와 같이 보상회로들(Comp1 ~ Compn)은 액정패널(PNL)의 일측과 타측에 각각 구분되어 형성될 수도 있다. 이 경우, 공통전압라인그룹들(Vcom1 ~ Vcomn) 각기 다른 방향에서 교번하여 배치된 보상회로들(Comp1 ~ Compn)에 의해 보상된 공통전압을 공급받을 수 있게 된다.
실시예와 같은 구조로 공통전압라인그룹들(Vcom1 ~ Vcomn)에 대한 개별적인 보상을 할 수 있는 보상회로들(Comp1 ~ Compn)을 액정패널(PNL)에 형성하게 되면, 수평 크로스토크를 액정패널의 전 영역에서 제거할 수 있고 액정패널의 영역별 잔상 수준 차이를 제거할 수 있게 된다.
실시예와 같은 구조는 전원부(PWR) 내에 보상회로를 형성하는 것이 아니므로 부품에 대한 비용 절감이 가능하다. 또한, 실시예와 같은 구조는 공통전압 보상을 위해 전원부(PWR)가 형성된 외부기판과 연결되는 별도의 신호라인이 불요하므로 신호라인의 감소와 더불어 신호의 왜곡을 방지할 수 있다.
이상 본 발명의 실시예는 액정패널의 전 영역에 걸쳐 수평 크로스토크를 제거하고 액정패널의 영역별 잔상 수준 차이를 제거하여 표시품질을 향상시킬 수 있는 액정표시장치를 제공하는 효과가 있다.
이상 첨부된 도면을 참조하여 본 발명의 실시예를 설명하였지만, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술 분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 한다. 아울러, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어진다. 또한, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
TCN: 타이밍제어부 PNL: 액정패널
SDRV: 게이트구동부 DDRV: 데이터구동부
BLU: 백라이트유닛 PWR: 전원부
Vcom1 ~ Vcomn: 공통전압라인그룹들 Comp1 ~ Compn: 보상회로들

Claims (7)

  1. 액정패널;
    상기 액정패널에 형성된 공통전압라인들이 영역별로 구분되어 그룹화된 공통전압라인그룹들; 및
    상기 액정패널에 형성되고 상기 공통전압라인그룹들에 각기 배속되어 동일한 공통전압을 공급하되 상기 공통전압라인그룹들에 공급되는 상기 공통전압에 대해 개별적인 보상을 수행하도록 구성된 보상회로들을 포함하는 액정표시장치.
  2. 제1항에 있어서,
    상기 보상회로들 각각은,
    상기 공통전압라인그룹들에 포함된 공통전압라인들 중 어느 하나로부터 공통전압을 되먹임 받도록 배선된 것을 특징으로 하는 액정표시장치.
  3. 제1항에 있어서,
    상기 보상회로들 각각은,
    트랜지스터들과 수동소자를 포함하는 반전 증폭기로 구성되어 상기 액정패널의 베젤영역에 형성된 것을 특징으로 하는 액정표시장치.
  4. 제3항에 있어서,
    상기 보상회로들 각각은,
    상기 반전 증폭기의 증폭비 차에 따라 상기 공통전압라인그룹들에 공급되는 상기 공통전압에 대해 개별적인 보상을 수행하는 것을 특징으로 하는 액정표시장치.
  5. 제4항에 있어서,
    상기 반전 증폭기는,
    상기 반전 증폭기의 증폭비를 조절하는 저항기들의 면적 및 길이를 상기 공통전압라인그룹들에 배속된 상기 보상회로들 별로 달리함으로써 그 증폭비가 달라지는 것을 특징으로 하는 액정표시장치.
  6. 제1항에 있어서,
    상기 보상회로들 각각은,
    상기 액정패널에 형성된 게이트구동부의 더미영역에 형성된 것을 특징으로 하는 액정표시장치.
  7. 제1항에 있어서,
    상기 액정패널은,
    IPS 및 FFS의 액정모드를 포함하는 액정표시장치.
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* Cited by examiner, † Cited by third party
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KR20140013523A (ko) * 2012-07-24 2014-02-05 엘지디스플레이 주식회사 공통전압 보상회로를 포함하는 액정표시장치
KR20170061779A (ko) * 2015-11-26 2017-06-07 엘지디스플레이 주식회사 표시장치
US11296180B2 (en) 2020-07-15 2022-04-05 Samsung Display Co., Ltd. Display apparatus having a transmitting area

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