KR20110014660A - 공유 제어 채널상에서 송신되는 시간-도메인 시퀀스들의 검출 - Google Patents

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Abstract

제어 세그먼트에서 시그널링 메시지를 송신하고 수신하기 위한 기술들이 개시된다. 제어 세그먼트는 다수의 OFDM 심볼들에서 CDM으로 송신될 수 있다. 수신기에서, 수신된 시퀀스는 제어 세그먼트에 대하여 획득된다. 시간-도메인 시그널링 시퀀스는 제어 세그먼트에서 송신된 것으로 가정되는 시그널링 메시지에 기초하여 생성된다. 상관 시퀀스는 시그널링 시퀀스에 기초하여 생성된다. 일 설계에서, 시그널링 시퀀스는 다수의 서브-시퀀스들로 분할되며, 제어 세그먼트가 송신된 각각의 심볼 기간에 대하여 하나의 서브-시퀀스로 분할된다. 각각의 서브-시퀀스는 채널 탭 딜레이에 의하여 결정되는 양만큼 순환 시프트(cyclically shift)된다. 상관 시퀀스는 그 후 순환 시프트된 서브-시퀀스들의 전부를 연접시킴으로써(concatenate) 형성된다. 상관 시퀀스는 또한 다른 방식들로 생성될 수도 있다. 수신된 시퀀스는 시그널링 메시지가 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상관 시퀀스와 상관된다.

Description

공유 제어 채널상에서 송신되는 시간-도메인 시퀀스들의 검출{DETECTION OF TIME-DOMAIN SEQUENCES SENT ON A SHARED CONTROL CHANNEL}
본 발명은 일반적으로 통신과 관련되며, 특히, 공유 제어 채널을 수신하기 위한 기술들과 관련된다.
무선 통신 시스템들은 음성, 비디오, 패킷 데이터, 메시징, 브로드캐스트 등과 같은 다양한 통신 서비스들을 제공하도록 광범위하게 전개된다. 이러한 무선 시스템들은 이용가능한 시스템 리소스들을 공유함으로써 다수의 사용자들을 지원할 수 있는 다중-액세스 시스템들일 수 있다. 그러한 다중-액세스 시스템들은 코드 분할 다중 액세스(CDMA: Code Division Multiple Access) 시스템들, 시분할 다중 액세스(TDMA: Time Division Multiple Access) 시스템들, 주파수 분할 다중 액세스(FDMA: Frequency Division Multiple Access) 시스템들, 및 직교 주파수 분할 다중 액세스(OFDM: Orthogonal Frequency Division Multiple Access) 시스템들, 및 단일-캐리어 FDMA 시스템들을 포함한다.
통상적으로, 통신 시스템은 순방향 링크 및 역방향 링크상에 데이터 전송을 지원하기 위하여 다양한 제어 채널들을 이용한다. 순방향 링크(또는 다운링크)는 기지국들로부터 단말들로의 통신 링크를 지칭하고, 역방향 링크(또는 업링크)는 단말들로부터 기지국들로의 통신 링크를 지칭한다. 예를 들어, 단말들은 하나의 링크 또는 두개 링크들 모두상에서의 데이터 전송을 요청하고, 채널 조건들을 리포팅하고, 더 강한 기지국들로의 핸드오프를 요청하며, 그 외에 다른 동작들을 또한 수행하기 위하여 역방향 링크상에서 시그널링을 송신할 수 있다. 이로움에도 불구하고, 단말들에 의하여 송신되는 시그널링은 시스템의 오버헤드를 나타낸다.
따라서, 본 기술분야의 당업자들에게는 통신 시스템에서 시그널링을 효율적으로 송신하고 수신할 필요성이 존재한다.
제어 세그먼트에서 시그널링 메시지를 송신하고 수신하기 위한 기술들이 본 명세서에 개시된다. 제어 세그먼트는 다수의 심볼 기간들에서 제1 멀티플렉싱 방식, 예를 들어, 코드 분할 멀티플렉싱(CDM)으로 송신될 수 있다. 제어 세그먼트는 전송 심볼들 내에서 송신될 수 있으며, 전송 심볼들은 제2 멀티플렉싱 방식, 예를 들어, 직교 주파수 분할 멀티플렉싱(OFDM) 또는 단일-캐리어 주파수 분할 멀티플렉싱(SC-FDM)에 기초하여 생성될 수 있다.
수신기, 예를 들어, 기지국에서, 수신된 시퀀스는 제어 세그먼트 확장(spanning) 다수의 심볼 기간들에 대하여 획득될 수 있다. 시간-도메인 시그널링 시퀀스는 제어 세그먼트에서 송신된 것으로 가정되는 시그널링 메시지에 기초하여 생성될 수 있다. 상관 시퀀스는 그 후 다수의 방식들 중 하나의 방식으로 시그널링 시퀀스에 기초하여 생성될 수 있다. 수신된 시퀀스는 시그널링 메시지가 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상관 시퀀스와 상관될 수 있다.
상관 시퀀스를 생성하기 위한 한 설계에서, 시그널링 시퀀스는 다수의 서브-시퀀스들로 분할되며, 제어 세그먼트가 송신된 각각의 심볼 기간에 대하여 하나의 서브-시퀀스로 분할된다. 각각의 서브-시퀀스는 채널 탭 딜레이에 의하여 결정되는 양만큼 순환 시프트(cyclically shift)된다. 상관 시퀀스는 그 후 순환 시프트된 서브-시퀀스들의 전부를 연접시킴으로써(concatenate) 형성된다. 채널 탭 딜레이가 전송 심볼들(예를 들어, OFDM 심볼들)에 대한 순환 전치 길이를 초과한다면, 순환 전치 길이를 초과하는 채널 탭 딜레이의 부분에 대응하는 각각의 순환 시프트된 서브-시퀀스의 일부가 제로 아웃(zero out)될 수 있다.
상관 시퀀스를 생성하기 위한 다른 설계에서, 시그널링 시퀀스는 다수의 서브-시퀀스들로 분할된다. 제1 시퀀스는 그 후 다수의 서브-시퀀스들 각각에 순환 전치를 첨부함으로써 획득된다. 제2 시퀀스는 채널 탭 딜레이에 의하여 결정되는 적절한 개수의 0들을 제1 시퀀스에 첨부함으로써 획득된다. 제2 시퀀스는 다수의 제2 서브-시퀀스들로 분할되고, 순환 전치는 각각의 제2 서브-시퀀스로부터 제거된다. 상관 시퀀스는 그 후 순환 전치가 제거된 제2 서브-시퀀스들 전부를 연접시킴으로써 생성된다.
본 발명의 다양한 양상들 및 피쳐들이 하기에 추가로 상세히 설명된다.
도 1은 무선 통신 시스템을 도시한다.
도 2는 기지국 및 단말의 블록도를 도시한다.
도 3은 수퍼프레임 구조를 도시한다.
도 4a 및 4b는 CDMA 제어 세그먼트에서 시그널링 시퀀스를 송신하기 위한 프로세싱을 도시한다.
도 5는 CDMA 제어 세그먼트에 대한 변조 및 복조를 도시한다.
도 6은 수신된 시퀀스와 가정된 시그널링 시퀀스 사이에 상관을 도시한다.
도 7 및 8은 초과 지연 확산(spread)을 갖는 가정된 시그널링 시퀀스와 수신된 시퀀스 사이에 상관에 대한 2개의 설계들을 도시한다.
도 9는 단말에서 프로세싱 유닛들의 블록도를 도시한다.
도 10은 기지국에서 프로세싱 유닛들의 블록도를 도시한다.
도 11 및 12는 시그널링 메시지를 수신하기 위한 프로세스를 도시한다.
도 13 및 14는 시그널링 메시지를 수신하기 위한 장치를 도시한다.
도 1은 다수의 기지국들(110) 및 다수의 단말들(120)을 갖는 무선 통신 시스템(100)을 도시한다. 기지국은 단말들과 통신하는 스테이션이다. 기지국은 또한 액세스 포인트, Node B, 이벌브드(evolved) Node B 등으로 불릴 수 있으며, 이들의 기능의 일부 또는 전부를 포함할 수도 있다. 각각의 기지국(110)은 특정 지리적 영역(102)에 대한 통신 커버리지를 제공한다. "셀"이라는 용어는 이러한 용어가 사용되는 문맥에 따라 기지국 및/또는 기지국의 커버리지 영역을 지칭할 수 있다. 시스템 능력을 향상시키기 위하여, 기지국 커버리지 영역은 다수의 더 작은 영역들, 예를 들어, 3개의 더 작은 영역들(104a, 104b, 및 104c)로 분할될 수 있다. 각각의 더 작은 영역은 개별적인 기지국 트랜시버(BTS: base transceiver station)에 의하여 서빙될 수 있다. "섹터"라는 용어는 이러한 용어가 사용되는 문맥에 따라 BTS 및/또는 BTS의 커버리지 영역을 지칭할 수 있다. 섹터화된 셀에 대하여, 상기 셀의 모든 섹터들에 대한 BTS들은 통상적으로 셀에 대한 기지국 내에 공동-위치된다.
단말들(120)은 통상적으로 시스템 전반을 통해 분산되며, 각각의 단말은 정적이거나 이동성일 수 있다. 단말은 또한 액세스 단말, 이동국, 가용자 장비, 가입자 유닛, 스테이션 등으로 불릴 수 있으며, 이들의 기능의 일부 또는 전부를 포함할 수 있다. 단말은 셀룰러 전화, 개인용 디지털 단말(PDA), 무선 디바이스, 무선 모뎀, 핸드헬드(handheld) 디바이스, 랩탑 컴퓨터 등일 수 있다. 단말은 임의의 주어진 순간에 순방향 링크 및/또는 역방향 링크상에서 0개 또는 1개 또는 다수의 기지국들과 통신할 수 있다.
중앙집중형(centralized) 아키텍쳐에 대하여, 시스템 제어기(130)는 기지국들(110)에 연결되고, 이러한 기지국들에 대한 조정 및 제어를 제공한다. 시스템 제어기(130)는 단일 네트워크 엔티티 또는 네트워크 엔티티들의 콜렉션일 수 있다. 분산형 아키텍쳐에 대하여, 기지국들은 필요에 따라 서로와 통신할 수 있다.
본 명세서에 개시되는 기술들은 CDMA, TDMA, FDMA, OFDMA 및 SC-FDMA 시스템들과 같은 다양한 무선 통신 시스템들에 대하여 사용될 수 있다. CDMA 시스템은 코드 분할 멀티플렉싱(CDM)을 이용하며, 코드 도메인에서 이러한 전송들을 직교화시키기(orthogonalize) 위하여 상이한 직교 코드들을 가지는 전송들을 송신한다. TDMA 시스템은 시분할 멀티플렉싱(TDM)을 이용하며, 시간 도메인에서 이러한 전송들을 직교화시키기 위하여 상이한 시간 슬롯들에서 전송들을 송신한다. FDMA 시스템은 주파수 분할 멀티플렉싱(FDM)을 이용하며, 주파수 도메인에서 이러한 전송들을 직교화시키기 위하여 상이한 서브캐리어들상에서 전송들을 송신한다. OFDMA는 OFDM을 이용하며, SC-FDMA 시스템은 SC-FDM을 이용한다. OFDM 및 SC-FDM은 톤들, 빈들 등으로서 또한 지칭되는 다수의 직교 서브캐리어들로 시스템 대역폭을 분할한다. 각각의 서브캐리어는 데이터와 변조될 수 있다. 일반적으로, 변조 심볼들은 OFDM을 이용하여 주파수 도메인에서 송신되고, SC-FDM을 이용하여 시간 도메인에서 송신된다. 기술들은 또한 멀티플렉싱 방식들의 조합을 이용하는 무선 통신 시스템들에 대하여 사용될 수 있다.
명료성을 위하여, 데이터 채널들에 대하여 OFDM을 이용하고 공유된 제어 채널에 대하여 CDM을 이용하는 시스템에 대한 기술들의 특정 양상들이 하기에 개시된다. 기술들은 역방향 링크 뿐 아니라 순방향 링크상에서 송신되는 시그널링에 대하여 사용될 수 있다. 명료성을 위하여, 단말들에 의하여 역방향 링크상에서 기지국들로 송신되는 시그널링에 대한 기술들의 특정 양상들이 하기에 설명된다.
도 2는 기지국(110) 및 단말(120)의 일 설계의 블록도를 도시하며, 이는 도 1의 기지국들 및 단말들 중 하나일 수 있다. 간략성을 위하여, 역방향 링크상에 전송을 위한 프로세싱 유닛들만이 도 2에 도시된다.
단말(120)에서, 전송(TX) 데이터 및 파일럿 프로세서(220)는 역방향 링크상에서 송신하기 위하여 트래픽 데이터를 수신하고, 데이터에 대하여 선택되는 코딩 및 변조 파라미터들에 기초하여 데이터를 프로세싱하며, 데이터 심볼들을 제공한다. 본 명세서에서 사용될 때, 데이터 심볼은 데이터에 대한 심볼이고, 파일럿 심볼은 파일럿에 대한 심볼이고, 시그널링 심볼은 시그널링 또는 제어 신호에 대한 심볼이고, 제로 심볼은 0의 신호 값을 갖는 심볼이며, 심볼은 통상적으로 복소 값이다. 데이터, 파일럿 및/또는 시그널링 심볼들은 PSK, QAM 등과 같은 변조 방식들로부터의 변조 심볼들일 수 있다. 파일럿은 전송기 및 수신기 모두에 의하여 선험적으로(a priori) 공지되는 데이터이다. 프로세서(220)는 또한 파일럿을 프로세싱하고, 파일럿 심볼들을 제공한다. TX 시그널링 프로세서(230)는 시그널링을 위하여 선택되는 코딩 및 변조 파라미터들에 기초하여 시그널링 정보를 수신하여 프로세싱하고, 시그널링 심볼들을 제공한다. 변조기(MOD)(232)는 (예를 들어, OFDM, SC-FDM, CDM 등에 대한) 데이터, 파일럿, 및 시그널링 심볼들에 변조를 수행하고, 출력 칩들을 제공한다. 전송기(TMTR)(234)는 출력 칩들을 프로세싱(예를 들어, 아날로그로 변환, 증폭, 필터링, 및 업컨버팅)하고, 안테나(236)를 통해 전송되는 역방향 링크 신호를 생성한다.
기지국(110)에서, 안테나(252)는 단말(120)로부터 역방향 링크 신호를 수신하고, 수신기(RCVR)(254)로 수신된 신호를 제공한다. 수신기(254)는 수신된 신호를 프로세싱(예를 들어, 필터링, 증폭, 다운컨버팅, 및 디지털화)하고, 수신된 샘플들을 제공한다. 복조기(DEMOD)(256)는 수신된 심볼들을 획득하기 위하여 (예를 들어, OFDM, SC-FDM, CDM 등에 대하여) 수신된 샘플들에 복조를 수행한다. 복조기(256)는 채널 프로세서(258)에 수신된 파일럿 심볼들을 제공하고, 수신(RX) 데이터 프로세서(260)에 수신된 데이터 심볼들을 제공하며, RX 시그널링 프로세서(270)에 수신된 시그널링 심볼들을 제공한다. 채널 프로세서(258)는 수신된 파일럿 심볼들에 기초하여 단말(120)로부터 기지국(110)으로의 무선 채널의 응답을 추정하고, 프로세서(260 및/또는 270)에 채널 추정들(예를 들어, 채널 임펄스 응답 추정들, 채널 이득 추정들, 잡음 및 간섭 추정들 등)을 제공한다. RX 데이터 프로세서(260)는 TX 데이터 프로세서(220)에 의한 프로세싱에 상보적인 방식으로 수신된 데이터 심볼들을 프로세싱하고, 단말(120)에 대하여 디코딩된 데이터를 제공한다. RX 시그널링 프로세서(270)는 RX 시그널링 프로세서(230)에 의한 프로세싱에 상보적인 방식으로 수신된 시그널링 심볼들을 프로세싱하고, 단말(120)에 대하여 디코딩된 시그널링을 제공한다.
제어기들(240 및 280)은 각각 단말(120) 및 기지국(110)에서 동작을 지시한다. 메모리들(242 및 282)은 각각 단말(120) 및 기지국(110)에 대한 프로그램 코드들 및 데이터를 저장한다.
도 3은 수퍼프레임 구조(300)의 일 설계를 도시하며, 이는 시스템(100)의 역방향 링크에 대하여 사용될 수 있다. 전송 타임라인은 수퍼프레임들의 유닛들로 분할될 수 있다. 각각의 수퍼프레임은 특정 시간 기간에 걸쳐질(span) 수 있으며, 이는 고정되거나 구성가능할 수 있다. 각각의 수퍼프레임은 M개의 물리적 계층(PHY) 프레임들, 또는 간단히 프레임들을 포함할 수 있다. 각각의 프레임은 T개의 심볼 기간들에 걸쳐질 수 있으며, 여기서 M 및 T는 임의의 적절한 정수 값들일 수 있다.
도 3은 또한 서브캐리어 구조를 도시한다. 시스템 대역폭은 1 내지 K의 인덱스들이 할당될 수 있는 다수의(K) 직교 서브캐리어들로 분할될 수 있다. 스펙트럼 형태의 시스템에서, K개의 전체 서브캐리어들의 단 하나의 서브세트가 전송을 위해 사용될 수 있으며, 나머지 서브캐리어들은 시스템이 스펙트럼 마스크 요건들을 충족시키도록 허용하기 위하여 가드(guard) 서브캐리어들로서의 역할을 할 수 있다. 간략성을 위하여, 하기의 설명은 모든 K개의 전체 서브캐리어들이 사용가능한 것으로 가정한다. K개의 전체 서브캐리어들은 다수의(S) 서브대역들로 분할될 수 있으며, 각각의 서브대역은 L개의 서브캐리어들을 포함할 수 있고, 여기서 S 및 L은 임의의 적절한 정수 값들일 수 있는데, 예를 들어, K = S · L이다.
도 3은 또한 역방향 링크상에 시그널링의 전송을 지원하는 CDMA 제어 세그먼트의 일 설계를 도시한다. CDMA 제어 세그먼트는 시간 및 주파수 리소스들의 블록을 점유할 수 있으며, 예를 들어, CQICH(Channel Quality Indicator Channel), REQCH(request channel), BFCH(beamforming feedback channel), SFCH(subband feedback channel), PICH(pilot channel), ACH(access channel) 등과 같은 다양한 시그널링/제어 채널들을 지원할 수 있다. 도 3에 도시되는 설계에서, CDMA 제어 세그먼트는 하나의 서브대역에서 L개의 서브캐리어들을 커버하며, 모든 6-번째 PHY 프레임에서 송신된다. CDMA 제어 세그먼트는 (도 3에 도시되는 바와 같이)CDMA 프레임으로부터 CDMA 프레임으로 시스템 대역폭에 걸쳐 홉핑(hop)할 수 있거나, 또는 (도 3에 미도시되는) L개의 서브캐리어들의 고정 세트상에서 송신될 수 있다. CDMA 프레임은 CDMA 제어 세그먼트가 송신되는 프레임이다. 일반적으로, CDMA 제어 세그먼트는 임의의 레이트로 그리고 임의의 디멘젼의 시간 주파수 블록에서 송신될 수 있다. 다수의 단말들은 CDMA 제어 세그먼트를 공유하고, 송신할 시그널링이 존재할 때마다 이러한 제어 세그먼트에서 시그널링을 송신할 수 있다. 이것은 특히 시그널링이 산발적으로 송신될 때, 시그널링을 송신하기 위해 각각의 단말로 전용 시간 주파수 리소스들을 할당하는 것보다 더욱 효율적일 수 있다.
CDMA 제어 세그먼트에서 송신될 시그널링은 다양한 방식들로 프로세싱될 수 있다. 일 설계에서, 주어진 시그널링 채널상에서 송신될 B-비트 시그널링 메시지 M은 다음과 같이 프로세싱될 수 있다. 시그널링 메시지 M은 코딩된 메시지 W에 이러한 메시지를 맵핑함으로써 인코딩될 수 있으며, 이는 길이 2B의 왈쉬 시퀀스일 수 있다. 2B개의 상이한 메시지 값들은 길이 2B의 2B개의 상이한 왈쉬 시퀀스에 맵핑될 수 있다. 코딩된 메시지 W는 채널화된 메시지 V를 획득하기 위하여 채널화(chennelization) 시퀀스 FC를 사용하여 반복되고, 채널화될 수 있다. 채널화 시퀀스 FC로는 선형 피드백 시프트 레지스터(LFSR: linear feedback shift register)로부터 의사-랜덤 이진 시퀀스에 기초하여 생성될 수 있다. LFSR은 시그널링 채널 타입, 메시지가 송신되는 PHY 프레임에 대한 인덱스, 타겟 기지국에 대한 식별자 등과 같은 다양한 인자들에 좌우될 수 있는 시드(seed) 값으로 초기화될 수 있다.
채널화된 메시지 V는 복합 시퀀스를 획득하기 위하여 (존재한다면) 다른 채널화된 메시지들과 합산될 수 있으며, 이는 시그널링 시퀀스를 획득하기 위하여 스크램블링 시퀀스 FS를 사용하여 추가로 스크램블링될 수 있다. 스크램블링 시퀀스 FS는 타겟 기지국 및 단말 모두에 대하여 특정적일 수 있다. 이것은 그 후 단말이 타겟 기지국으로 시그널링 메시지 M을 송신하고, 타겟 기지국이 단말을 식별하도록 허용할 수 있다. 메시지 M만이 송신된다면, 이러한 메시지에 대한 시그널링 시퀀스 Z는 다음과 같이 표현될 수 있다:
Figure pct00001
식 (1)
여기서, 식 (1)의 곱셈은 샘플 단위로(on a sample-by-sample basis) 수행된다.
일 설계에서, 10-비트 시그널링 메시지 M이 길이 1024의 왈쉬 시퀀스 W에 맵핑되고, 이는 4096 샘플들을 획득하기 위하여 4번 반복된다. 반복된 왈쉬 시퀀스는 그 후 4096-샘플 채널화 시퀀스 FC를 사용하여 채널화되고, 추가로 4096-샘플 스크램블링 시퀀스 FS를 사용하여 스크램블링되어, 4096개의 샘플들을 포함하는 시그널링 시퀀스 Z를 획득한다.
일반적으로, 시간-도메인 시그널링 세그먼트 Z는 다양한 방식으로 시그널링 메시지 M에 대하여 생성될 수 있다. 시그널링 메시지는 임의의 코딩 방식으로 인코딩될 수 있으며, 왈쉬 시퀀스로의 맵핑은 하나의 예시적 코딩 방식이다. 시그널링 메시지는 또한 채널화되고, 스크램블링되고/스크램블링되며, 임의의 방식으로 프로세싱될 수 있다. 시그널링 메시지 M 및 시그널링 시퀀스 Z는 또한 임의의 길이를 가질 수 있다. 명료성을 위하여, 하기의 설명의 대부분은 시그널링 시퀀스 Z가 4096개의 샘플들을 포함하고, T = 8 심볼 기간들에서 L = 512개의 서브캐리어들을 커버하는 CDMA 제어 세그먼트에서 송신되는 것으로 가정한다.
도 4A는 CDMA 제어 세그먼트에서 시간-도메인 시그널링 시퀀스 Z를 송신하기 위한 프로세싱을 도시한다. 시그널링 시퀀스 Z는 4096개의 샘플들(Z1 내지 Z4096)을 포함하고, 8개의 서브-시퀀스들(Z1 내지 Z8)로 분할될 수 있으며, 각각의 서브-시퀀스 Zm은 512개의 연속 샘플들을 포함하고, 여기서 m = 1, ..., 8이다. 각각의 서브-시퀀스 Zm은 512개의 심볼들을 포함하는 대응 주파수-도메인 서브-시퀀스 Am을 획득하기 위하여 512-포인트 고속 푸리에 변환(FFT: fast Fourier transform)을 사용하여로 주파수 도메인으로 변환될 수 있다. 4096개의심볼들(a1 내지 a4096)을 포함하는 주파수-도메인 시퀀스 A는 8개의 서브-시퀀스들(A1 내지 A8)을 연접시킴으로써 획득될 수 있다.
도 4b는 주파수-도메인 시퀀스 A의 심볼들의 CDMA 제어 세그먼트로의 예시적인 맵핑을 도시한다. 서브-시퀀스 A1의 512개의 심볼들(a1 내지 a512)는 심볼 기간 n에서 CDMA 제어 세그먼트에 대하여 사용되는 512개의 서브캐리어들로 맵핑될 수 있고, 서브-시퀀스 A2의 512개의 심볼들(a513 내지 a1024)은 심볼 기간 n + 7에서 CDMA 제어 세그먼트에 대하여 사용되는 512개의 서브캐리어들로 맵핑될 수 있고, 나머지도 동일한 방식으로 맵핑되며, 서브-시퀀스 A8의 512개의 심볼들(a3585 내지 a4096)은 심볼 기간 n + 7에서 CDMA 제어 세그먼트에 대하여 사용되는 512개의 서브캐리어들로 맵핑될 수 있다. 도 4b에서 s1(n) 내지 sK(n + 7)로서 표시되는 데이터 심볼들, 파일럿 심볼들, 및/또는 0 심볼들은 각각의 심볼 기간들 n 내지 n + 7에서 나머지 K - 512개의 서브캐리어들로 맵핑될 수 있다. 심볼 기간 n에서의 K개의 전체 심볼들은 S1으로서 표시되고, 심볼 기간 n + 7에서의 K개의 전체 심볼들은 S2로서 표시되고, 나머지도 동일한 방식으로 표시되며, 심볼 기간 n + 1에서의 K개의 전체 심볼들은 S8로서 표시된다.
도 5는 CDMA 제어 세그먼트가 송신되는 심볼 기간들에 대한 변조 및 복조를 도시한다. 명료성을 위하여, 다음의 설명은 OFDM이 이러한 심볼 기간들에 대하여 사용되는 것으로 가정한다.
단말에서, 각각의 심볼 기간에서 K개의 전체 심볼들 Sm은 K개의 시간-도메인 칩들을 포함하는 유용한 부분 Um을 획득하기 위하여 K-포인트 고속 푸리에 역변환(IFFT: inverse fast Fourier transform)을 사용하여 시간 도메인으로 변환될 수 있으며, 여기서 m = 1, ..., 8이다. 유용한 부분 Um에서의 마지막 Ncp개의 칩들은 카피되고, N = K + Ncp개의 칩들을 포함하는 OFDM 심볼 Xm을 형성하기 위하여 유용한 부분의 프론트에 첨부될 수 있다. 반복된 부분은 종종 순환 전치(CP: cyclic prefix) 또는 가드 간격(guard interval)로서 지칭되고, Ncp는 순환 전치 길이이다. 순환 전치는 지연 확산을 갖는 무선 채널에서 주파수 선택적 페이딩(fading)에 의하여 야기되는 심볼간 간섭(ISI: inter-symbol interferenc)을 방지하는데 사용된다. 각각의 OFDM 심볼 Xm은 하나의 OFDM 심볼 기간(또는 간단히 하나의 심볼 기간)에서 전송될 수 있으며, 이러한 기간은 N = K + Ncp개의 칩 기간들과 동일할 수 있다. 일 설계에서, K = 2048, Ncp = 128, 그리고 N = 2176이다. 다른 값들이 또한 K, Ncp, 및 N에 대하여 사용될 수 있다.
기지국에서, N개의 샘플들을 포함하는 수신된 OFDM 심볼 Rm은 각각의 심볼 기간에서 획득될 수 있다. 각각의 OFDM 심볼의 시작은 본 기술분야에 공지된 다양한 기술들에 기초하여, 예를 들어, 단말과 기지국 사이에서 무선 채널에 대한 채널 임펄스 응답 추정에 기초하여 추정될 수 있다. 각각의 수신된 OFDM 심볼 Rm의 순환 전치는 K개의 샘플들을 포함하는 수신된 유용한 부분
Figure pct00002
을 획득하기 위하여 제거될 수 있다. K-포인트 FFT는 K개의 전체 서브캐리어들에 대하여 K개의 수신된 심볼들을 획득하기 위하여 각각의 수신된 유용한 부분
Figure pct00003
에 대하여 수행될 수 있다. 이러한 K개의 수신된 심볼들은 CDMA 제어 세그먼트에 대하여 유용한 512개의 서브캐리어들상에 512개의 수신된 심볼들을 포함하는 서브-시퀀스
Figure pct00004
을 포함한다. 512-포인트 IFFT는 512개의 샘플들을 포함하는 수신된 서브-시퀀스 Ym을 획득하기 위하여 각각의 수신된 심볼 서브-시퀀스 에 대하여 수행될 수 있다. 수신된 시퀀스 Y는 8개의 서브-시퀀스들 Y1 내지 Y8을 연접시킴으로써 획득될 수 있다.
기지국은 존재한다면 시그널링 메시지가 CDMA 제어 세그먼트에서 송신된 것을 결정하기 위하여 수신된 시퀀스 Y를 프로세싱할 수 있다. 기지국은 시그널링 시퀀스가 송신되었는지 여부를 결정하기 위하여 각각의 가능한 시그널링 시퀀스와 수신된 시퀀스 Y를 상관시킬 수 있다. 가능한 시그널링 시퀀스들 중 하나인 가정된 시그널링 시퀀스 C와 수신된 시퀀스 Y의 상관이 하기에 설명된다.
단말과 기지국 사이에 무선 채널의 임펄스 응답은 예를 들어, 수신된 파일럿 심볼들에 기초하여 추정될 수 있다. 채널 임펄스 응답 추정은 Ntap개의 채널 탭들을 포함할 수 있으며, 여기서 일반적으로 Ntap ≥ 1이다. 각각의 채널 탭은 특정 복합 이득 Hi 및 특정 딜레이 Di와 연관될 수 있으며, 여기서 i = 1, ..., Ntap이다. 채널 탭 딜레이 di는 칩 기간의 유닛들에서 주어질 수 있다. 수신된 시퀀스 Y는 각각의 Ntap개의 채널 탭들에 대하여 가정된 시그널링 시퀀스 C와 상관될 수 있다. 모든 Ntap 개의 채널 탭들에 대한 상관 결과들은 혼합되고, 시그널링 시퀀스 C가 CDMA 제어 세그먼트에서 송신되었는지 여부를 결정하는데 사용될 수 있다.
도 6은 순환 전치 길이 이하이거나 di ≤ Ncp인 지연 di를 갖는 하나의 채널 탭에 대한 가정된 시그널링 시퀀스 C와 수신된 시퀀스 Y 사이에 상관을 도시한다. 4096-샘플 가정 시그널링 시퀀스 C는 시그널링 시퀀스 Z에 대하여 상기 설명되는 바와 같이, 8개의 서브-시퀀스들(C1 내지 C8)로 분할될 수 있다. 각각의 서브-시퀀스 Cm은 서브-시퀀스 Cm의 마지막 Ni개 샘플들을 취하고, 이러한 Ni개의 샘플들을 서브-시퀀스 Cm의 프론트으로 이동시킴으로써 di개의 칩 기간들에 의하여 순환 또는 순회(circularly) 시프트될 수 있다. Ni는 탭 딜레이 di, 유용한 부분 (K)의 출력 칩들의 개수, 및 서브-시퀀스 (L) 당 샘플들의 개수, 또는 Ni = L · di/K 에 의하여 결정되며, 여기서 di는 칩 기간의 단위로 주어진다. 예를 들어, L = 512 샘플들의 서브-시퀀스가 K = 2048개의 칩들의 유용한 부분에서 송신된다면, Ni = 5l2 · di /2048 = di /4이다. 상관 시퀀스 C(di)는 8개의 순환 시프트된 서브-시퀀스들을 연접시킴으로써 형성될 수 있다.
상관 시퀀스 C(di)는 다음과 같이 수신된 시퀀스 Y와 상관될 수 있다:
Figure pct00006
식(2)
여기서 cl(di)는 상관 시퀀스 C(di)의 l번째 샘플이고,
yl은 수신된 시퀀스 Y의 l번째 샘플이며,
Q(di)는 채널 탭 딜레이 di에 대한 상관 결과이다.
식 (2)에 도시되는 바와 같이, 상관은 상관 시퀀스 C(di)의 각각의 샘플을 수신된 시퀀스 Y의 대응 샘플과 곱하고, 이러한 시퀀스들의 길이에 걸쳐 곱(product)들을 누적하고, 상관 결과 Q(di)를 획득하기 위하여 누적된 결과의 제곱 크기를 계산함으로써 수행될 수 있다. 시퀀스 C(di) 및 Y는 식 (2)에서 도시되는 바와 같이, 샘플 레이트로 샘플링될 수 있다. 대안적으로, 시퀀스 C(di) 및 Y는 시간 레졸루션(time resolution)을 향상시키기 위하여 샘플 레이트의 수배로 오버샘플링될 수 있으며, 상관은 서브-샘플 시간 레졸루션에서 샘플들에 걸쳐 수행될 수 있다.
가정된 시그널링 시퀀스 C의 8개의 서브-시퀀스들(C1 내지 C8)은 상이한 채널 탭 딜레이들(d1 내지 dNtap)에 대응하는 상이한 양만큼 순환 시프트될 수 있다. 각각의 채널 탭 딜레이 di에 대하여, 상관은 상기 채널 탭 딜레이에 대한 상관 결과 Q(di)를 획득하기 위하여 식 (2)에서 보여지는 바와 같이 수행될 수 있다. 모든 Ntap개의 채널 탭 딜레이들에 대한 상관 결과들은 하기에 개시되는 바와 같이, 가정된 시그널링 시퀀스 C에 대한 최종 상관 결과를 획득하기 위하여 결합될 수 있다.
도 6은 채널 탭 딜레이 di가 순환 전치 길이 Ncp 이하인 경우에 대하여 8개의 서브-시퀀스들(C1 내지 C8)의 순환 시프팅을 도시한다. 이러한 경우에, 채널 탭의 에너지의 대부분은 각각의 OFDM 심볼의 순환 전치에 의하여 포착된다. 그러나, 채널 탭 딜레이 di가 초과 딜레이 확산으로서 공통으로 지칭되는 순환 전치 길이 Ncp를 초과할 때, 채널 탭 에너지의 일부는 순환 전치에 의하여 포착되지 않는다. 초과 딜레이 확산은 다양한 방식들로 처리될 수 있다.
초과 딜레이 확산과의 상관을 수행하기 위한 일 설계에서, 8개의 서브-시퀀스들(C1 내지 C8)은 각각 도 6에 도시되는 바와 같이 채널 탭 딜레이 di만큼 순환 시프트된다. 순환 시프트된 서브-시퀀스들은 대응하는 수신된 서브-시퀀스들(Y1 내지 Y8)과 상관된다. 이러한 설계에서, 초과 딜레이에 대응하는 수신된 시퀀스 Y의 샘플들은 상관에서 잡음으로서 작용한다.
도 7은 초과 딜레이 확산을 갖는 가정된 시그널링 시퀀스 C와 수신된 시퀀스 Y 사이에 상관에 대한 다른 설계를 도시한다. 4096-샘플 가정 시그널링 시퀀스 C는 8개의 서브-시퀀스들(C1 내지 C8)로 분할될 수 있다. 각각의 서브-시퀀스 Cm는 di개의 칩 기간들(또는 Ni개의 샘플들)만큼 순환 시프트될 수 있으며, 여기서 di > 초과 딜레이 확산을 갖는 Ncp이다. 각각의 순환 시프트된 서브-시퀀스에 대하여, 제1 di - Ncp 칩 기간들은 순환 전치 길이를 넘어서는 추가 딜레이에 대응하며, 제1 di - Ncp 칩 기간들에 대한 리딩(leading) 0들을 포함하는 절단된(trancated) 서브-시퀀스를 획득하기 위하여 0으로 설정될 수 있다. 각각의 절단된 서브-시퀀스의 제로 아웃된 부분은 채널 탭 이전에 수신되는 부분에 대응하고, 따라서, 주로 잡음 및 유용하지 않은 신호를 포함하다. 상관 시퀀스 C'(di)는 리딩 0들을 갖는 8개의 절단된 서브-시퀀스들을 연접시킴으로써 획득될 수 있다. 상관 시퀀스 C'(di)는 식 (2)에 도시되는 수신된 시퀀스 Y와 상관될 수 있다.
도 8은 초과 딜레이 확산을 갖는 가정된 시그널링 시퀀스 C와 수신된 시퀀스 Y 사이에 상관에 대한 또 다른 설계를 도시한다. 4096-샘플 가정 시그널링 시퀀스 C는 8개의 서브-시퀀스들(C1 내지 C8)로 분할될 수 있다. 순환 전치는 그 후 서브-시퀀스 Cm의 마지막 Ncp개의 칩 기간들에서 Ns개의 샘플들을 카피하고, 서브-시퀀스의 시작에 이러한 Ns개의 샘플들을 첨부함으로써 각각의 서브-시퀀스 Cm에 첨부될 수 있으며, 여기서 Ns = L · Ncp / L이다. 예를 들어, 서브-시퀀스가 L = 512개의 샘플들을 포함하고, 유용한 부분이 K = 2048개의 칩들을 포함한다면, Ns = 512 · Ncp /2048 = Ncp /4이다. 시퀀스 CCP는 순환 전치들과 8개의 서브-시퀀스들을 연접시킴으로써 형성될 수 있다. 시퀀스 Cz(di)는 시퀀스 CCP의 시작에 di개의 칩 기간들에 대해 Ni개의 0들을 첨부하고, 시퀀스 CCP의 마지막 Ni개의 샘플들을 폐기함으로써 형성될 수 있다. 시퀀스 Cz(di)는 그 후 길이 L + Ncp의 8개의 서브-시퀀스들로 분할될 수 있다. 각각의 서브-시퀀스의 제1 Ncp개의 칩 기간들의 제1 Ns개의 샘플들은 순환 전치에 대응하며, 서브-시퀀스
Figure pct00007
를 획득하기 위하여 제거될 수 있다. 상관 시퀀스 C"(di)는 8개의 서브-시퀀스들(
Figure pct00008
내지
Figure pct00009
)을 연접시킴으로써 획득될 수 있다. 상관 시퀀스 C"(di)는 식 (2)에 도시되는 바와 같이 수신된 시퀀스 Y와 상관될 수 있다.
명료성을 위하여, 상관 시퀀스들의 생성은 시그널링 시퀀스 Z가 16개의 샘플들을 포함하고 T = 2 심볼 기간들에서 L = 8개의 서브캐리어들을 커버하는 CDMA 제어 세그먼트에서 송신되는 간단한 실시예에 대하여 하기에 설명된다. 간략성을 위하여, 순환 전치 길이 및 채널 탭 딜레이는 (칩 기간들 대신에) 샘플 기간들의 단위로 주어진다. 시그널링 시퀀스 Z는 다음과 같이 주어질 수 있다:
Figure pct00010
이러한 실시예에서, 순환 전치 길이는 NCP = 2개의 샘플 기간들이고, 채널 탭 딜레이는 di = 3개의 샘플 기간들이며, 이는 초과 딜레이 확산을 갖는 경우이다.
도 7에 도시되는 설계에 대하여, di = 3을 갖는 순환-시프트된 시퀀스 C(di)는 다음과 같이 주어질 수 있다:
Figure pct00011
상관 시퀀스 C'(di)는 다음과 같이 각각의 서브 시퀀스에서 제1 di - Ncp = 1 샘플을 제로 아웃함으로써 획득된다:
Figure pct00012
도 8에 도시되는 설계에 대하여, 시퀀스 CCP는 다음과 같이 각각의 서브-시퀀스에 길이 Ncp = 2의 순환 전치를 첨부함으로써 획득된다:
Figure pct00013
di = 2를 갖는 시퀀스 CZ(di)는 다음과 같이 시퀀스 CCP의 시작에 3개의 0들을 첨부하고 시퀀스 CCP의 마지막 3개 샘플들을 폐기함으로써 획득된다:
Figure pct00014
상관 시퀀스 C'(di)는 다음과 같이 시퀀스 CZ(di)의 각각의 서브-시퀀스의 제1 Ncp = 2개의 샘플들을 제거함으로써 획득된다:
Figure pct00015
상관 시퀀스 C'(di)가 di ≤ Ncp에 대하여 상관 시퀀스 C'(di)와 동일한 것을 볼 수 있다. 상기 설명된 실시예에 대하여, di = 1이라면, 상관 시퀀스들은 다음과 같이 표현될 수 있다:
Figure pct00016
상관 시퀀스들을 생성하기 위한 다수의 설계들이 상기 개시되었다. 상관 시퀀스들은 또한 다른 방식들로 생성될 수 있다. 예를 들어, 도 7의 시퀀스 C(di)는 심지어 초과 딜레이 확산에 대한 제로 아웃 없이 상관 시퀀스로서 직접 사용될 수 있다.
상관 결과는 식 (2)에 도시되는 바와 같이 각각의 채널 탭 딜레이에 대하여 획득될 수 있다. 일 설계에서, 모든 Ntap개의 채널 탭 딜레이들에 대한 상관 결과들은 다음과 같이 결합될 수 있다:
Figure pct00017
식(3)
여기서 Q는 최종 상관 결과이며,
<C, Y>는 가정된 시그널링 시퀀스 C와 수신된 시퀀스 Y 사이에 상관을 나타낸다.
다른 설계에서, Q(di)는 임계치에 비교되고, 그것이 임계치를 초과하는 경우 누적되거나 그렇지 않은 경우 폐기된다. 또 다른 설계에서, 최종 결과 Q는 모든 Ntap개의 채널 탭들에 대하여 가장 큰 Q(di)와 동일하다. 최종 결과 Q는 또한 다른 방식들로 획득될 수 있다. 최종 결과 Q는 가정된 시그널링 시퀀스 C가 수신되었는지 여부를 결정하기 위하여 다음과 같이 임계치 Qth와 비교될 수 있다:
Q > Qth라면, 시그널링 시퀀스 C가 수신된 것으로 선언하고,
Q ≤ Qth라면, 시그널링 시퀀스 C가 수신되지 않은 것으로 선언한다.
Qth는 시그널링 검출을 위해 사용되는 임계치이다.
임계치 Qth는 거짓(false) 알람의 타겟 확률(Pfa), 유실된(missed) 검출의 타겟 확률(Pmd), 에러의 타겟 확률(Perr), 등을 달성하도록 선택될 수 있다. 거짓 알람은 아무 것 송신되지 않을 때의 시그널링 메시지의 검출을 지칭한다. 유실된 검출(또는 말소(erasure))은 송신된 시그널링 메시지를 검출하는데 실패하는 것을 지칭한다. 메시지 에러는 다른 시그널링 메시지가 송신될 때 하나의 시그널링 메시지의 검출을 지칭한다. 거짓 알람의 확률은 예를 들어, 액세스 채널상에서 송신된 액세스 프로브들과 같은 송신될 수 있는 특정 메시지들에 대하여 적용가능할 수 있다. 에러 확률은 예를 들어, CQI 채널상에서 송신되는 CQI 메시지들과 같은 상이한 값들로 송신될 수 있는 메시지들에 대하여 적용될 수 있다. 유실된 검출의 확률은 메시지들의 2개 타입 모두에 대하여 적용가능할 수 있다.
임계치 Qth는 시퀀스 C가 시퀀스 Y와 시간 정렬되지 않을 때 Q ≥ Qth 의 확률이 P 퍼센트 미만이도록 선택될 수 있으며, 여기서 Pfa ≤ P 및/또는 Perr ≤ P이다. 수신된 시퀀스는 다음과 같이 표현될 수 있다:
Figure pct00018
식 (4)
여기서 hi는 i번째 채널 탭이고,
Z(di)는 i번째 채널 탭에 대하여 di만큼 딜레이된 시그널링 시퀀스 Z이며,
N은 시그널링 시퀀스 Z에 의하여 관찰된 전체 잡음이다.
가정된 시그널링 시퀀스 C와 수신된 시퀀스 Y 사이의 상관은 다음과 같이 표현될 수 있다:
Figure pct00019
식 (5)
가정된 시그널링 시퀀스 C는 가능한 시그널링 시퀀스들 중 하나이며, 전송된 시그널링 시퀀스 Z와 동일하거나 동일하지 않을 수 있다. 항 <C, Z(di)>는 시퀀스 C가 시퀀스 Z와 동일하지 않고/않거나 수신된 시퀀스의 Z(di)와 시간 정렬되지 않는다면 통상적으로 작다. 항 <C, N>는 상관 잡음을 나타내며,
Figure pct00020
로서 근사화될 수 있고, 여기서 σ2는 탭당 잡음 분산(per-tap variance of the noise)이다. 탭당 잡음 분산 σ2는 채널 임펄스 응답 추정에서 채널 탭들의 에너지에 기초하여 추정될 수 있다. 식 (5)로부터, 잡음 에너지는 2R 자유도로 카이-제곱(Chi-squared)되고, 여기서 R은 기지국에서 수신된 안테나들의 개수이다. 임계치 Qth는 잡음 에너지가 시간의 P 퍼센트에 대한 Qth를 초과하지 않도록 선택될 수 있다. P는 다음과 같이 주어질 수 있다:
Figure pct00021
식 (6)
여기서 X는 원하는 거짓 알람 확률이고, Nhyp는 테스트되는 가정들의 개수이다. Nhyp는 테스트될 가능한 시그널링 시퀀스들의 개수 및 각각의 그러한 시그널링 시퀀스가 테스트되는 횟수와 동일할 수 있다.
임계치 Qth는 또한 유실된 검출의 타겟 확률을 달성하도록 선택될 수 있다. 가정된 시그널링 시퀀스 C가 시퀀스 Z와 동일하고, 수신된 시퀀스 Y에서 Z(di)와 시간-정렬될 때, 식 (5)의 상관은 다음과 같이 표현될 수 있다:
Figure pct00022
식 (7)
식 (7)은 d1의 딜레이를 갖는 하나의 채널 탭에 대하여 수행되는 것으로 가정한다. 항 h1 · <C, Z(d1)>는 상관에 의하여 포착되는 신호 부분을 나타낸다. 합산 항은 상관에 의하여 포착되지 않는 신호 부분을 포함하며, 작고 무시할 정도여야 한다. 유실된 검출의 확률은
Figure pct00023
이 상관 시퀀스 C가 수신된 신호 Y에서 Z(di)와 시간 정렬되더라도 임계치 Qth 미만인 확률이다. 동등하게, 유실된 검출의 확률은
Figure pct00024
가
Figure pct00025
미만일 확률로서 주어질 수 있으며, 여기서
Figure pct00026
는 잡음 에너지의 카이-제곱 분산에 기초하여 결정될 수 있다.
도 9는 도 2의 단말(120)에서 TX 데이터 및 파일럿 프로세서(220), TX 시그널링 프로세서(230), 및 변조기(232)의 설계의 블록도를 도시한다. 프로세서(220)는 TX 데이터 프로세서(920) 및 파일럿 프로세서(922)를 포함한다. 프로세서(920)는 역방향 링크상에서 송신하기 위하여 데이터를 수신하고, 데이터를 프로세싱(예를 들어, 포맷팅, 인코딩, 인터리빙, 및 심볼 맵핑)하며, 변조기(232)에 데이터 심볼들을 제공한다. 프로세서(922)는 파일럿을 프로세싱하고, 변조기(232)에 파일럿 심볼들을 제공한다.
TX 시그널링 프로세서(230) 내에서, 인코더(932)는 CDMA 제어 세그먼트에서 송신하기 위하여 시그널링 메시지들을 수신하고, 코딩된 메시지를 획득하기 위하여 각각의 메시지를 인코딩한다. 채널라이저 및 스크램블러(934)는 채널화 시퀀스와 코딩된 메시지를 곱하고, 추가로 스크램블링 시퀀스를 사용하여 채널화된 메시지를 스크램블링하여 예를 들어, 식 (1)에 도시되는 바와 같이 시간-도메인 시그널링 시퀀스를 획득한다. 일반적으로, 각각의 메시지는 시그널링 시퀀스를 획득하기 위하여 임의의 방식으로 프로세싱될 수 있다. 도 9에 미도시되나, 다수의 시그널링 시퀀스들이 합산되거나, 결합되고, 동시에 송신될 수 있다. 멀티플라이어(936)는 채널라이저 및 스크램블러(934)의 출력을 이득과 곱하고, 출력 시퀀스를 제공한다. FFT/DFT 유닛(938)은 멀티플라이어(936)로부터의 시퀀스에 대하여 FFT/DFT를 수행하고, 예를 들어, 도 4a에 도시되는 바와 같이 대응 주파수-도메인 시퀀스 A를 제공한다.
도 9에 도시되는 설계에서, 변조기(232)는 OFDM 변조를 수행한다. 변조기(232) 내에서, 심볼-대-서브캐리어 맵퍼(940)는 프로세서(920)로부터 데이터 심볼들을, 프로세서(922)로부터 파일럿 심볼들을, 그리고 프로세서(230)로부터 시그널링 심볼들을 수신한다. 맵퍼(940)는 데이터 심볼들, 파일럿 심볼들, 시그널링 심볼들, 및 제로 심볼들을 각각의 심볼 기간에 적절한 서브캐리어들에 맵핑하고, 각각의 심볼 기간에 K개의 전체 서브캐리어들에 대한 K개의 출력 심볼들을 제공한다. IFFT/IDFT 유닛(942)은 각각의 심볼 기간에서 K개의 출력 심볼들에 대하여 K-포인트 IFFT/IDFT를 수행하고, 상기 심볼 기간에 대하여 유용한 부분을 제공한다. 순환 전치 삽입 유닛(944)은 각각의 유용한 부분에 순환 전치를 첨부하고, 대응 OFDM 심볼을 제공한다. 변조기(232)는 또한 예를 들어, SC-FDM, CDM 등과 같은 다른 멀티플렉싱 방식(들)에 대한 변조를 수행할 수 있다.
도 10은 도 2의 기지국(110)에서의 RX 시그널링 프로세서(270) 및 복조기(256)의 설계의 블록도를 도시한다. 복조기(256) 내에서, 순환 전치 제거 유닛(1012)은 수신기(254)로부터 샘플들을 수신하고, 각각의 수신된 OFDM 심볼에서 순환 전치를 제거하고, 대응하는 유용한 부분을 제공한다. FFT/DFT 유닛(1014)은 각각의 유용한 부분의 K개의 샘플들에 대하여 K-포인트 FFT/DFT를 수행하고, K개의 수신된 심볼들을 제공한다. 심볼-대-서브캐리어 디맵퍼(1016)는 각각의 심볼 기간에서 K개의 전체 서브캐리어들에 대하여 K개의 수신된 심볼들을 획득하고, 채널 프로세서(258)에 수신된 파일럿 심볼들을 제공하고, RX 데이터 프로세서(260)에 수신된 데이터 심볼들을 제공하며, RX 시그널링 프로세서(270)에 수신된 시그널링 심볼들을 제공한다. 채널 추정기(258)는 수신된 파일럿 심볼들에 기초하여 채널 임펄스 응답 추정을 유도하고, 프로세서들(260 및 270)에 채널 탭들을 제공할 수 있다. RX 데이터 프로세서(260)는 수신된 데이터 심볼들을 프로세성(예를 들어, 심볼 디맵핑, 디인터리빙, 및 디코딩)하고, 디코딩된 데이터를 제공한다.
RX 시그널링 프로세서(270) 내에서, IFFT/IDFT 유닛(1022)은 각각의 심볼 기간에서 L개의 수신된 시그널링 심볼들
Figure pct00027
에 대하여 IFFT/IDFT를 수행하고, 예를 들어, 도 5에 도시되는 바와 같이 L개의 샘플들을 포함하는 대응 서브-시퀀스 Ym을 제공한다. 각각의 가정된 시그널링 메시지에 대하여, 상관 시퀀스 생성기(1024)는 예를 들어, 도 6, 7 및 8에 도시되는 바와 같이, Ntap개의 채널 탭 딜레이들 각각에 대하여 상관 시퀀스를 생성한다. 각각의 가정된 시그널링 메시지에 대하여, 상관기(1026)는 예를 들어, 식 (2)에 도시되는 바와 같이 각각의 채널 탭 딜레이에 대한 상관 시퀀스와 수신된 시퀀스 사이에 상관을 수행하고, 식 (3)에 도시되는 바와 같이 모든 Ntap개의 채널 탭 딜레이들에 대한 상관 결과들을 결합하며, 가정된 시그널링 메시지에 대한 최종 상관 결과 Q를 제공한다. 검출기(1028)는 상이한 가정된 시그널링 메시지들에 대한 최종 상관 결과들을 수신하고, 이러한 시그널링 메시지들 중 임의의 것이 수신되었는지 여부를 결정한다. 검출기(1028)는 각각의 가정된 시그널링 메시지에 대한 최종 상관 결과 Q를 임계치 Qth를 비교하고, 시그널링 메시지가 비교 결과에 기초하여 송신되었는지 여부를 결정할 수 있다. 검출기(1028)는 또한 잡음 및 간섭 추정치들 및/또는 다른 정보에 기초하여 임계치를 결정할 수 있다. 유닛(1030)은 각각의 검출된 시그널링 시퀀스의 디스크램블링, 역채널화, 및 디코딩을 수행하고, 대응하는 디코딩된 메시지를 제공한다.
도 11은 시그널링 메시지를 수신하기 위한 프로세스(1100)의 일 설계를 도시한다. 수신된 시퀀스는 다수의 심볼 기간들에 걸치는 제어 세그먼트에 대하여 획득될 수 있다(블록(1110)). 수신된 시퀀스는 시그널링 메시지에 대하여 다수의 OFDM 심볼들에서 송신되는 시간-도메인 시그널링 시퀀스를 포함할 수 있다. 상관은 시그널링 메시지가 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 수신된 시퀀스에 대하여 수행될 수 있다(블록(1120)).
도 12는 도 11의 블록들(1110 및 1120)의 일 설계를 도시한다. 블록(1110)에 대하여, 제어 세그먼트가 송신된 다수의 심볼 기간들에서 다수의 전송 심볼들(예를 들어, OFDM 심볼들)이 수신될 수 있다(블록(1212)). 제어 세그먼트는 제1 멀티플렉싱 방식(예를 들어, CDM)으로 송신될 수 있으며, 전송 심볼들은 제2 멀티플렉싱 방식(예를 들어, OFDM)에 기초하여 생성될 수 있다. 순환 전치는 수신된 유용한 부분을 획득하기 위하여 각각의 수신된 전송 심볼로부터 제거될 수 있으며, 이는 K개의 전체 서브캐리어들에 대하여 수신된 심볼들을 획득하기 위하여 변환될 수 있다. 각각의 심볼 기간에서 제어 세그먼트에 대하여 사용되는 서브캐리어들의 세트로부터 수신된 심볼들의 세트가 획득될 수 있다(블록(1214)). 심볼 기간에 대하여 수신된 서브-시퀀스를 획득하기 위하여 각각의 심볼 기간 동안 수신된 심볼들의 세트가 변환될 수 있다(블록(1216)). 수신된 시퀀스는 다수의 심볼 기간들에 대하여 획득되는 다수의 수신된 서브-시퀀스들에 기초하여 (예를 들어, 연접시킴으로써) 형성될 수 있다(블록(1218)).
블록(1120)에 대하여, 시그널링 시퀀스는 예를 들어, 시그널링 메시지를 코딩된 메시지(예를 들어, 왈쉬 시퀀스)에 맵핑하고, 시그널링 시퀀스를 획득하기 위하여 코딩된 메시지를 프로세싱(예를 들어, 채널화 및 스크램블링)함으로써 검출될 시그널링 메시지에 기초하여 생성될 수 있다(블록(1222)). 상관 시퀀스는 다수의 방식들 중 하나의 방식으로 시그널링 시퀀스에 기초하여 생성될 수 있다(블록(1224)). 수신된 시퀀스는 그 후 시그널링 메시지가 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상관 시퀀스와 상관될 수 있다(블록(1226)).
블록(1224)에서 상관 시퀀스를 생성하기 위한 일 설계에서, 시그널링 시퀀스는 다수의 서브-시퀀스들로 분할되는데, 하나의 서브-시퀀스는 제어 세그먼트가 송신된 다수의 심볼 기간들 각각에 대한 것이다. 각각의 서브시퀀스는 예를 들어, 채널 탭 딜레이에 의하여 결정되는 양만큼 순환 시프트된다. 상관 시퀀스는 그 후 다수의 순환 시프트된 서브-시퀀스들에 기초하여 (예를 들어, 연접시킴으로써) 형성된다. 채널 탭 딜레이가 순환 전치 길이를 초과한다면, 순환 전치 길이를 초과하는 채널 탭 딜레이의 부분에 대응하는 각각의 순환 시프트된 서브-시퀀스의 부분은 도 7에 도시되는 바와 같이 제로 아웃될 수 있다.
블록(1224)에서 상관 시퀀스를 생성하기 위한 다른 설계에서, 시그널링 시퀀스는 다수의 서브-시퀀스들로 분할되는데, 제어 세그먼트가 송신된 각각의 심볼 기간에 대하여 하나의 서브-시퀀스로 분할된다. 제1 시퀀스는 다수의 서브-시퀀스들 각각에 순환 전치를 첨부함으로써 획득된다. 제2 시퀀스는 제1 시퀀스에 적어도 하나의 0으르 첨부함으로써 획득되며, 0들의 개수는 채널 탭 딜레이에 좌우된다. 제2 시퀀스는 다수의 제2 서브-시퀀스들로 분할되는데, 하나의 제2 서브-시퀀스는 각각의 심볼 기간에 대한 것이다. 순환 전치는 각각의 제2 서브-시퀀스로부터 제거된다. 상관 시퀀스는 그 후 도 8에 도시되는 바와 같이, 순환 전치가 제거된 다수의 제2 서브-시퀀스들에 기초하여 (예를 들어, 연접시킴으로써) 생성된다.
블록(1226)에 대하여, 상관 결과는 수신된 시퀀스와 상관 시퀀스 사이에 상관에 대하여 획득될 수 있다. 상관은 적어도 하나의 채널 탭 각각에 대하여 수행될 수 있으며, 최종 상관 결과는 모든 채널 탭들에 대한 상관 결과들에 기초하여 획득될 수 있다. 최종 상관 결과는 추정된 잡음 에너지에 기초하여 결정될 수 있는 임계치와 비교될 수 있다. 제어 세그먼트에서 시그널링 메시지가 송신되었는지 여부는 최종 상관 결과와 임계치 사이의 비교에 기초하여 결정될 수 있다.
상관은 제어 세그먼트에서 송신되었을 수 있는 상이한 가능한 시그널링 메시지들에 대하여 수행될 수 있다. 각각의 가능한 시그널링 메시지에 대한 프로세싱은 도 11 및 12에 대하여 상기 설명된 바와 같이 진행될 수 있다.
도 13은 시그널링 메시지를 수신하기 위한 장치(1300)의 일 설계를 도시한다. 장치(1300)는 다수의 심볼 기간들에 걸치는 제어 세그먼트에 대한 수신된 시퀀스를 획득하기 위한 수단(모듈(1310)), 및 시그널링 메시지가 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 수신된 시퀀스에 대하여 상관을 수행하기 위한 수단(모듈(1320))을 포함한다. 모듈들(1310 및 1320)은 프로세서들, 전자 디바이스들, 하드웨어 디바이스들, 전자 컴포넌트들, 논리 회로들, 메모리들, 등 또는 이들의 조합물을 포함할 수 있다.
도 14는 도 13의 모듈들(1310 및 1320)의 일 설계를 도시한다. 모듈(1310)은 제어 세그먼트에 대한 다수의 심볼 기간들에서 다수의 전송 심볼들(예를 들어, OFDM 심볼들)을 수신하기 위한 수단(모듈(1412)), 각각의 심볼 기간에서 제어 세그먼트에 대하여 사용되는 서브캐리어들의 세트로부터 수신된 심볼들의 세트를 획득하기 위한 수단(모듈(1414)), 심볼 기간 동안 수신된 서브-시퀀스를 획득하기 위하여 각각의 심볼 기간에서 수신된 심볼들의 세트를 변환하기 위한 수단(모듈(1416)), 및 다수의 심볼 기간들에 대하여 획득되는 다수의 수신된 서브-시퀀스들에 기초하여 수신된 시퀀스를 형성하기 위한 수단(모듈(1418))을 포함한다. 모듈(1320)은 검출될 시그널링 메시지에 기초하여 시그널링 시퀀스를 생성하기 위한 수단(모듈(1422)), 시그널링 시퀀스에 기초하여 상관 시퀀스를 생성하기 위한 수단(모듈(1424)), 및 시그널링 메시지가 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상관 시퀀스와 수신된 시퀀스를 상관시키기 위한 수단(모듈(1426))을 포함한다. 모듈들(1412 내지 1426)은 프로세서들, 전자 디바이스들, 하드웨어 디바이스들, 전자 컴포넌트들, 논리 회로들, 메모리들, 등 또는 이들의 임의의 조합물을 포함할 수 있다.
본 명에서에 개시되는 기술들은 다양한 수단에 의하여 구현될 수 있다. 예를 들어, 이러한 기술들은 하드웨어, 펌웨어, 소프트웨어, 또는 이들의 조합으로 구현될 수 있다. 하드웨어 구현에 대하여, 엔티티(예를 들어, 단말 또는 기지국)에서 프로세싱 유닛들은 본 명세서에서 설명하는 기능들을 수행하도록 설계된 하나 이상의 주문형 집적 회로(ASIC), 디지털 신호 프로세서(DSP), 디지털 신호 프로세싱 디바이스(DSPD)들, 프로그래밍가능 로직 디바이스(PLD)들, 필드 프로그래밍 가능 게이트 어레이(FPGA)들, 프로세서들, 제어기들, 마이크로-제어기들, 마이크로프로세서들, 전자 디바이스들, 다른 전자 유닛들, 컴퓨터, 또는 이들의 조합 내에 구현될 수 있다.
펌웨어 및/또는 소프트웨어에서 구현에서, 기술들은 본 명세서에서 설명한 기능들을 수행하는 모듈들(예를 들어, 프로시저들, 함수들 등)을 이용하여 구현될 수 있다. 펌웨어 및/또는 소프트웨어 코드들은 메모리(예를 들어, 도 2의 메모리(242 또는 282)에 저장될 수 있으며 프로세서(예를 들어, 프로세서(240 또는 280)에 의해 실행될 수 있다. 메모리 유닛은 프로세서 내에 또는 프로세서 외부에 구현될 수 있다.
본 발명의 상기 설명은 당업자들이 본 발명을 제작 또는 사용할 수 있도록 제공된다. 이들 실시예들에 대한 다양한 변형들이 본 기술분야의 당업자들에게 쉽게 명백해질 것이며, 본 명세서에 정의된 일반 원리들은 발명의 진의 또는 범위를 벗어나지 않고 다른 양상들에 적용될 수 있다. 따라서, 본 발명은 본원에 나타낸 양상들로 한정되는 것이 아니라 본원에 개시된 원리 및 신규한 특징들에 부합하는 가장 넓은 범위에 따르도록 의도된다.

Claims (29)

  1. 다수의 심볼 기간들에 걸치는(spanning) 제어 세그먼트에 대하여 수신된 시퀀스를 획득하고, 시그널링 메시지가 상기 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 수신된 시퀀스에 대하여 상관(correlation)을 수행하도록 구성되는 프로세서; 및
    상기 프로세서에 연결되는 메모리
    를 포함하는, 장치.
  2. 제1항에 있어서,
    상기 프로세서는 상기 시그널링 메시지에 기초하여 시그널링 시퀀스를 생성하고, 상기 시그널링 시퀀스에 기초하여 상관 시퀀스를 생성하며, 상기 시그널링 메시지가 상기 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 상관 시퀀스와 상기 수신된 시퀀스를 상관시키도록 구성되는, 장치.
  3. 제2항에 있어서,
    상기 프로세서는 상기 시그널링 시퀀스를 다수의 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 서브-시퀀스 ― 로 분할하고, 상기 다수의 서브-시퀀스들 각각을 순환 시프트(cyclically shift)시키며, 다수의 순환 시프트된 서브-시퀀스들에 기초하여 상기 상관 시퀀스를 형성하도록 구성되는, 장치.
  4. 제3항에 있어서,
    상기 프로세서는 채널 탭 딜레이(channel tap delay)에 의하여 결정되는 양만큼 상기 다수의 서브-시퀀스들 각각을 순환 시프트시키도록 구성되는, 장치.
  5. 제4항에 있어서,
    상기 프로세서는 각각의 순환 시프트된 서브-시퀀스의 일부를 제로 아웃(zero out)시키도록 구성되고, 상기 제로 아웃된 부분은 순환 전치 길이를 초과하는 상기 채널 탭 딜레이의 일부에 대응하는, 장치.
  6. 제2항에 있어서,
    상기 프로세서는 상기 시그널링 시퀀스를 다수의 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 서브-시퀀스 ― 로 분할하고, 상기 다수의 서브-시퀀스들 각각에 순환 전치를 첨부함으로써 제1 시퀀스를 획득하고, 적어도 하나의 0을 상기 제1 시퀀스에 첨부함으로써 제2 시퀀스를 획득하며, 상기 제2 시퀀스에 기초하여 상기 상관 시퀀스를 생성하도록 구성되는, 장치.
  7. 제6항에 있어서,
    상기 제1 시퀀스에 첨부되는 0들의 개수는 채널 탭 딜레이에 의하여 결정되는, 장치.
  8. 제6항에 있어서,
    상기 프로세서는 상기 제2 시퀀스를 다수의 제2 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 제2 서브-시퀀스 ― 로 분할하고, 상기 다수의 제2 서브-시퀀스들 각각으로부터 순환 전치를 제거하며, 상기 순환 전치가 제거된 다수의 제2 서브-시퀀스들에 기초하여 상기 상관 시퀀스를 생성하도록 구성되는, 장치.
  9. 제2항에 있어서,
    상기 프로세서는 상기 수신된 시퀀스와 상기 상관 시퀀스 사이에 상관에 대한 상관 결과를 획득하고, 상기 상관 결과를 임계치에 비교하며, 상기 시그널링 메시지가 상기 상관 결과와 상기 임계치 사이의 비교에 기초하여 상기 제어 세그먼트에서 송신되었는지 여부를 결정하도록 구성되는, 장치.
  10. 제9항에 있어서,
    상기 프로세서는 추정된 잡음 에너지에 기초하여 상기 임계치를 결정하도록 구성되는, 장치.
  11. 제1항에 있어서,
    상기 프로세서는 적어도 하나의 채널 탭 각각에 대하여 수신된 시퀀스에 대하여 상관을 수행하고, 상기 적어도 하나의 채널 탭에 대한 적어도 하나의 상관 결과에 기초하여 최종 상관 결과를 획득하며, 상기 최종 상관 결과에 기초하여 상기 시그널링 메시지가 상기 제어 세그먼트에서 송신되었는지 여부를 결정하도록 구성되는, 장치.
  12. 제1항에 있어서,
    상기 제어 세그먼트는 제2 멀티플렉싱 방식에 기초하여 생성되는 다수의 전송 심볼들에서 제1 멀티플렉싱 방식으로 송신되는, 장치.
  13. 제1항에 있어서,
    상기 제어 세그먼트는 상기 다수의 심볼 기간들에서 송신되는 다수의 직교 주파수 분할 멀티플렉싱(OFDM: orthogonal frequency division multiplexing) 시스템들에서 코드 분할 멀티플렉싱(CDM: code division multiplexing)을 사용하여 송신되는, 장치.
  14. 제1항에 있어서,
    상기 프로세서는 상기 다수의 심볼 기간들에서 다수의 직교 주파수 분할 멀티플렉싱(OFDM) 심볼들을 수신하고, 상기 다수의 OFDM 심볼들 각각으로부터 순환 전치를 제거하며, 상기 순환 전치가 제거된 상기 다수의 OFDM 심볼에 기초하여 상기 수신된 시퀀스를 획득하도록 구성되는, 장치.
  15. 제1항에 있어서,
    상기 프로세서는 상기 다수의 심볼 기간들 각각에서, 상기 제어 세그먼트에 대하여 사용되는 서브캐리어들의 세트로부터 수신된 심볼들의 세트를 획득하고, 상기 심볼 기간에 대한 서브-시퀀스를 획득하기 위하여 각각의 심볼 기간에서 상기 수신된 심볼들의 세트를 변환하며, 상기 다수의 심볼 기간들에 대하여 획득되는 다수의 서브-시퀀스들에 기초하여 상기 수신된 시퀀스를 형성하도록 구성되는, 장치.
  16. 제1항에 있어서,
    상기 프로세서는 상기 시그널링 메시지를 코딩된 메시지로 맵핑하고, 시그널링 시퀀스를 획득하기 위하여 상기 코딩된 메시지를 프로세싱하며, 상기 시그널링 시퀀스에 기초하여 상기 수신되는 시퀀스에 대하여 상관을 수행하도록 구성되는, 장치.
  17. 제16항에 있어서,
    상기 프로세서는 상기 시그널링 메시지에 기초하여 다수의 왈쉬(Walsh) 시퀀스들로부터 왈쉬 시퀀스를 선택하고, 상기 선택된 왈쉬 시퀀스를 상기 코딩된 메시지로서 제공하도록 구성되는, 장치.
  18. 다수의 직교 주파수 분할 멀티플렉싱(OFDM) 심볼들에서 송신되는 시간-도메인 시퀀스를 포함하는 수신된 시퀀스를 획득하고, 상기 시간-도메인 시퀀스에 의하여 송신되는 시그널링 메시지를 검출하기 위하여 상기 수신된 시퀀스에 대한 상관을 수행하도록 구성되는 프로세서; 및
    상기 프로세서에 연결되는 메모리
    를 포함하는, 장치.
  19. 다수의 심볼 기간들에 걸치는 제어 세그먼트에 대하여 수신된 시퀀스를 획득하는 단계; 및
    시그널링 메시지가 상기 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 수신된 시퀀스에 대하여 상관을 수행하는 단계
    를 포함하는, 방법.
  20. 제19항에 있어서,
    상기 시그널링 메시지에 기초하여 시그널링 시퀀스를 생성하는 단계;
    상기 시그널링 시퀀스를 다수의 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 서브-시퀀스 ― 로 분할하는 단계;
    상기 다수의 서브-시퀀스들 각각을 순환 시프팅하는 단계; 및
    다수의 순환 시프팅된 서브-시퀀스들에 기초하여 상관 시퀀스를 형성하는 단계
    를 더 포함하며, 상기 상관을 수행하는 단계는 상기 시그널링 메시지가 상기 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 상관 시퀀스와 상기 수신된 시퀀스를 상관시키는 단계를 포함하는, 방법.
  21. 제20항에 있어서,
    상기 순환 시프팅하는 단계는 채널 탭 딜레이에 의하여 결정되는 양만큼 상기 다수의 서브-시퀀스들 각각을 순환 시프팅하는 단계를 포함하는, 방법.
  22. 제21항에 있어서,
    각각의 순환 시프팅된 서브-시퀀스의 일부를 제로 아웃하는 단계를 더 포함하며, 상기 제로 아웃된 부분은 순환 전치 길이를 초과하는 상기 채널 탭 딜레이의 일부에 대응하는, 방법.
  23. 제19항에 있어서,
    상기 시그널링 메시지에 기초하여 시그널링 시퀀스를 생성하는 단계;
    상기 시그널링 시퀀스를 다수의 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 서브-시퀀스 ― 로 분할하는 단계;
    상기 다수의 서브-시퀀스들 각각에 순환 전치를 첨부함으로써 제1 시퀀스를 획득하는 단계;
    상기 제1 시퀀스에 적어도 하나의 0을 첨부함으로써 제2 시퀀스를 획득하는 단계;
    상기 제2 시퀀스를 다수의 제2 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 제2 서브-시퀀스 ― 로 분할하는 단계;
    상기 다수의 제2 서브-시퀀스들 각각에 대하여 순환 전치를 제거하는 단계; 및
    상기 순환 전치가 제거된 다수의 제2 서브-시퀀스들에 기초하여 상관 시퀀스를 생성하는 단계
    를 더 포함하며, 상기 상관을 수행하는 단계는 상기 시그널링 메시지가 상기 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 상관 시퀀스와 상기 수신된 시퀀스를 상관시키는 단계를 포함하는, 방법.
  24. 다수의 심볼 기간들에 걸치는 제어 세그먼트에 대하여 수신된 시퀀스를 획득하기 위한 수단; 및
    시그널링 메시지가 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 수신된 시퀀스에 대하여 상관을 수행하기 위한 수단
    을 포함하는, 장치.
  25. 제24항에 있어서,
    상기 시그널링 메시지에 기초하여 시그널링 시퀀스를 생성하기 위한 수단;
    상기 시그널링 시퀀스를 다수의 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 서브-시퀀스 ― 로 분할하기 위한 수단;
    상기 다수의 서브-시퀀스들 각각을 순환 시프팅하기 위한 수단; 및
    다수의 순환 시프팅된 서브-시퀀스들에 기초하여 상관 시퀀스를 형성하기 위한 수단
    을 더 포함하며, 상기 상관을 수행하기 위한 수단은 상기 시그널링 메시지가 상기 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 상관 시퀀스와 상기 수신된 시퀀스를 상관시키기 위한 수단을 포함하는, 장치.
  26. 제25항에 있어서,
    상기 순환 시프팅하기 위한 수단은 채널 탭 딜레이에 의하여 결정되는 양만큼 상기 다수의 서브-시퀀스들 각각을 순환 시프팅하기 위한 수단을 포함하는, 장치.
  27. 제26항에 있어서,
    각각의 순환 시프팅된 서브-시퀀스의 일부를 제로 아웃하기 위한 수단을 더 포함하며, 상기 제로 아웃된 부분은 순환 전치 길이를 초과하는 상기 채널 탭 딜레이의 일부에 대응하는, 장치.
  28. 제24항에 있어서,
    상기 시그널링 메시지에 기초하여 시그널링 시퀀스를 생성하기 위한 수단;
    상기 시그널링 시퀀스를 다수의 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 서브-시퀀스 ― 로 분할하기 위한 수단;
    상기 다수의 서브-시퀀스들 각각에 순환 전치를 첨부함으로써 제1 시퀀스를 획득하기 위한 수단;
    상기 제1 시퀀스에 적어도 하나의 0을 첨부함으로써 제2 시퀀스를 획득하기 위한 수단;
    상기 제2 시퀀스를 다수의 제2 서브-시퀀스들 ― 상기 다수의 심볼 기간들 각각에 대하여 하나의 제2 서브-시퀀스 ― 로 분할하기 위한 수단;
    상기 다수의 제2 서브-시퀀스들 각각에 대하여 순환 전치를 제거하기 위한 수단; 및
    상기 순환 전치가 제거된 다수의 제2 서브-시퀀스들에 기초하여 상관 시퀀스를 생성하기 위한 수단
    를 더 포함하며, 상기 상관을 수행하기 위한 수단은 상기 시그널링 메시지가 상기 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 상관 시퀀스와 상기 수신된 시퀀스를 상관시키기 위한 수단을 포함하는, 장치.
  29. 저장된 명령들을 포함하는 컴퓨터-판독가능 매체로서,
    상기 명령들은,
    다수의 심볼 기간들에 걸치는 제어 세그먼트에 대하여 수신된 시퀀스를 획득하기 위한 제1 명령; 및
    시그널링 메시지가 제어 세그먼트에서 송신되었는지 여부를 결정하기 위하여 상기 수신된 시퀀스에 대하여 상관을 수행하기 위한 제2 명령
    을 포함하는, 컴퓨터-판독가능 매체.
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