KR20110004170A - Organic light emitting device - Google Patents

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KR20110004170A
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Abstract

PURPOSE: An organic electroluminescent element and a method for manufacturing the same are provided to reduce the driving voltage of the element by forming an auxiliary electrode to be in connection with a second electrode in order to reduce the resistance of the second electrode. CONSTITUTION: A thin film transistor(T) comprises a gate electrode(115), a semiconductor layer(125), a source electrode(130a), and a drain electrode(130b). A planarized film(150) is located on the surface the thin film transistor. A first electrode(160) is located on the planarized film. An organic film(180) is located on the first electrode. A second electrode(185) is located on the organic film. A first auxiliary electrode(140) is located between the substrate and the first electrode.

Description

유기전계발광소자 및 그 제조방법{Organic Light Emitting Device}Organic light emitting device and its manufacturing method {Organic Light Emitting Device}

본 발명은 유기전계발광소자 및 그 제조방법에 관한 것으로, 보조전극을 형성하여 제 2 전극의 저항을 낮출 수 있는 유기전계발광소자 및 그 제조방법에 관한 것이다.The present invention relates to an organic light emitting display device and a method for manufacturing the same, and to an organic light emitting display device and a method for manufacturing the same, which can lower the resistance of a second electrode by forming an auxiliary electrode.

최근, 음극선관(CRT : Cathode Ray Tube)의 단점인 무게와 부피를 줄일 수 있는 각종 평판표시장치들이 개발되고 있다. 이러한, 평판표시장치의 예로는, 액정표시장치(LCD : Liquid Crystal Display), 전계방출표시장치(FED : Field Emission Display), 플라즈마표시장치(PDP : Plasma Display Panel) 및 유기전계발광소자(OLED : Organic Light Emitting Device) 등이 있다.Recently, various flat panel display devices that can reduce weight and volume, which are disadvantages of cathode ray tubes (CRTs), have been developed. Examples of such flat panel displays include liquid crystal displays (LCDs), field emission displays (FEDs), plasma displays (PDPs) and organic light emitting diodes (OLEDs). Organic Light Emitting Device).

이 중에서 유기전계발광(Organic Light Emitting Device)는 유기화합물을 전기적으로 여기시켜 발광하게 하는 자발광형 표시장치이다. 유기전계발광소자는 LCD에서 사용되는 백라이트가 필요하지 않아 경량박형이 가능할 뿐만 아니라 공정을 단순화시킬 수 있다. 또한, 저온 제작이 가능하고, 응답속도가 1ms 이하로서 고속 의 응답속도를 가지며, 낮은 소비 전력, 넓은 시야각 및 높은 콘트라스트(Contrast) 등의 특성을 나타낸다.Among them, an organic light emitting device is a self-luminous display device that electrically excites an organic compound to emit light. The organic light emitting diode does not require a backlight used in the LCD, so it is not only lightweight but also simplifies the process. In addition, low temperature production is possible, response speed is 1ms or less, high speed response speed, low power consumption, wide viewing angle, and high contrast (Contrast) characteristics.

유기전계발광소자는 애노드인 제 1 전극과 캐소드인 제 2 전극 사이에 유기물로 이루어진 발광층을 포함하고 있어 제 1 전극으로부터 공급받는 정공과 제 2 전극으로부터 받은 전자가 발광층 내에서 결합하여 정공-전자쌍인 여기자(exciton)를 형성하고 다시 여기자가 바닥상태로 돌아오면서 발생하는 에너지에 의해 발광하게 된다.The organic light emitting device includes a light emitting layer made of an organic material between the first electrode as the anode and the second electrode as the cathode, so that holes supplied from the first electrode and electrons received from the second electrode are combined in the light emitting layer to form a hole-electron pair. Excitons are formed and are then emitted by the energy generated by the excitons returning to the ground state.

유기전계발광소자는 빛이 출사되는 방향에 따라 배면발광형과 전면발광형으로 나눌 수 있다. 배면발광형은 기판의 하부 방향 즉, 발광층에서 제 1 전극 방향으로 빛이 출사되는 것이고, 전면발광형은 기판의 상부 방향 즉, 발광층에서 제 2 전극 방향으로 빛이 출사되는 것을 말한다.The organic light emitting display device can be classified into a bottom emission type and a front emission type according to the direction in which light is emitted. In the bottom emission type, light is emitted from the lower direction of the substrate, that is, the light emitting layer toward the first electrode, and the top emission type is light emitted from the upper direction of the substrate, that is, the light emitting layer toward the second electrode.

그러나, 전면발광형 유기전계발광소자는 제 2 전극에서 빛이 투과될 수 있도록 금속으로 이루어진 제 2 전극을 매우 얇게 형성하는데 이로 인해 제 2 전극의 저항이 높은 문제점이 있다.However, the top emission type organic light emitting diode has a very thin second electrode made of a metal so that light can be transmitted from the second electrode, which causes a high resistance of the second electrode.

본 발명은 보조전극을 형성하여 제 2 전극의 저항을 낮춤으로써, 소자의 구동전압을 낮추고 대형화에 용이하게 적용할 수 있는 유기전계발광소자 및 그 제조방법을 제공한다.The present invention provides an organic light emitting display device and a method of manufacturing the same, which can be easily applied to reduce the driving voltage and increase the size of the device by forming an auxiliary electrode to lower the resistance of the second electrode.

본 발명의 일 실시 예에 따른 유기전계발광소자는 기판, 상기 기판 상에 위치하며, 게이트 전극, 반도체층, 소오스 전극 및 드레인 전극을 포함하는 박막 트랜지스터, 상기 박막 트랜지스터 상에 위치하는 평탄화막, 상기 평탄화막 상에 위치하며, 상기 박막 트랜지스터와 연결되는 제 1 전극, 상기 제 1 전극 상에 위치하는 유기막층, 상기 유기막층 상에 위치하는 제 2 전극 및 상기 기판과 상기 제 1 전극 사이에 위치하며, 상기 제 2 전극과 연결된 제 1 보조전극을 포함할 수 있다.An organic light emitting display device according to an embodiment of the present invention is a substrate, a thin film transistor positioned on the substrate, including a gate electrode, a semiconductor layer, a source electrode and a drain electrode, a planarization film positioned on the thin film transistor, A first electrode connected to the thin film transistor, an organic layer positioned on the first electrode, a second electrode positioned on the organic layer, and between the substrate and the first electrode; The first auxiliary electrode may be connected to the second electrode.

상기 제 1 보조전극과 상기 제 2 전극 사이에 콘택 스페이서 및 제 2 보조전극을 더 포함할 수 있다.The display device may further include a contact spacer and a second auxiliary electrode between the first auxiliary electrode and the second electrode.

상기 제 2 보조전극은 상기 제 1 전극과 동일 평면 상에 위치하며, 상기 콘택 스페이서는 상기 제 2 보조전극과 상기 제 1 보조전극 사이에 위치할 수 있다.The second auxiliary electrode may be positioned on the same plane as the first electrode, and the contact spacer may be located between the second auxiliary electrode and the first auxiliary electrode.

상기 콘택 스페이서는 유기물, 금속, 도전볼 또는 이들의 다층막으로 이루어질 수 있다.The contact spacer may be formed of an organic material, a metal, a conductive ball, or a multilayer film thereof.

상기 제 1 보조전극은 상기 박막 트랜지스터 상에 위치할 수 있다.The first auxiliary electrode may be positioned on the thin film transistor.

상기 제 1 보조전극은 상기 제 1 전극과 상기 박막 트랜지스터와 연결되는 비어홀을 제외한 상기 기판 전면에 위치할 수 있다.The first auxiliary electrode may be located on the front surface of the substrate except for a via hole connected to the first electrode and the thin film transistor.

상기 제 1 보조전극은 상기 게이트 전극과 동일한 물질로 이루어질 수 있다.The first auxiliary electrode may be made of the same material as the gate electrode.

상기 제 1 보조전극은 상기 박막 트랜지스터와 상기 제 1 전극 사이에 위치할 수 있다.The first auxiliary electrode may be positioned between the thin film transistor and the first electrode.

상기 제 1 보조전극은 소오스 전극 및 드레인 전극과 동일한 물질로 이루어질 수 있다.The first auxiliary electrode may be made of the same material as the source electrode and the drain electrode.

상기 제 2 전극은 상기 제 1 보조전극의 일부를 노출시키는 비어홀을 통해 상기 제 1 보조전극과 연결될 수 있다.The second electrode may be connected to the first auxiliary electrode through a via hole exposing a portion of the first auxiliary electrode.

또한, 본 발명의 일 실시 예에 따른 유기전계발광소자의 제조방법은 기판 상에 게이트 전극, 반도체층, 소오스 전극 및 드레인 전극을 포함하는 박막 트랜지스터를 형성하는 단계, 상기 박막 트랜지스터 상에 제 1 보조전극을 형성하는 단계, 상기 제 1 보조전극 상에 복수의 비어홀을 포함하는 평탄화막을 형성하는 단계, 상기 평탄화막 상에 상기 박막 트랜지스터와 연결되는 제 1 전극을 형성하는 단계, 상기 제 1 전극 상에 유기막층을 형성하는 단계 및 상기 유기막층 상에 상기 제 1 보조전극과 연결되는 제 2 전극을 형성하는 단계를 포함할 수 있다.In addition, the method of manufacturing an organic light emitting display device according to an embodiment of the present invention comprises the steps of forming a thin film transistor including a gate electrode, a semiconductor layer, a source electrode and a drain electrode on a substrate, a first auxiliary on the thin film transistor Forming an electrode, forming a planarization film including a plurality of via holes on the first auxiliary electrode, forming a first electrode connected to the thin film transistor on the planarization film, on the first electrode The method may include forming an organic layer and forming a second electrode connected to the first auxiliary electrode on the organic layer.

상기 비어홀에 콘택 스페이서 및 제 2 보조전극을 형성하는 단계를 더 포함할 수 있다.The method may further include forming a contact spacer and a second auxiliary electrode in the via hole.

본 발명의 일 실시 예에 따른 유기전계발광소자 및 그 제조방법은 제 2 전극과 연결된 보조전극을 형성하여, 제 2 전극의 저항을 낮추고 이에 따라 구동전압을 낮출 수 있는 이점이 있다.An organic light emitting display device and a method of manufacturing the same according to an embodiment of the present invention have an advantage of forming an auxiliary electrode connected to a second electrode, thereby lowering the resistance of the second electrode and thereby lowering a driving voltage.

또한, 두께가 얇은 제 2 전극의 영역별로 저항이 불균일하던 것을 보조전극을 통해 해결함으로써, 휘도 불균형 현상도 방지할 수 있는 이점이 있다.In addition, there is an advantage in that the luminance unevenness may also be prevented by solving the nonuniform resistance for each region of the second thin electrode through the auxiliary electrode.

따라서, 본 발명의 실시 예들에 따른 유기전계발광소자 및 그 제조방법은 대향화에 적용이 용이한 유기전계발광소자 및 그 제조방법을 제공할 수 있다.Therefore, the organic light emitting display device and its manufacturing method according to the embodiments of the present invention can provide an organic light emitting display device and a method of manufacturing the same is easy to apply to the counter.

이하, 첨부한 도면을 참조하여 본 발명의 일 실시 예들을 상세히 설명하면 다음과 같다.Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings.

도 1은 본 발명의 제 1 실시 예에 따른 유기전계발광소자의 단면도이고, 도 2는 도 1의 평면도이다.1 is a cross-sectional view of an organic light emitting display device according to a first embodiment of the present invention, and FIG. 2 is a plan view of FIG.

도 1을 참조하면, 본 발명의 제 1 실시 예에 따른 유기전계발광소자(100)는 기판(110), 상기 기판(110) 상에 위치하며, 게이트 전극(115), 반도체층(125), 소오스 전극(130a) 및 드레인 전극(130b)을 포함하는 박막 트랜지스터(T), 상기 박막 트랜지스터(T) 상에 위치하는 평탄화막(150), 상기 평탄화막(150) 상에 위치하며, 상기 박막 트랜지스터(T)와 연결되는 제 1 전극(160), 상기 제 1 전극(160) 상에 위치하며, 적어도 발광층을 포함하는 유기막층(180), 상기 유기막층(180) 상에 위 치하는 제 2 전극(185) 및 상기 기판(110)과 상기 제 1 전극(160) 사이에 위치하며, 상기 제 2 전극(185)과 연결된 제 1 보조전극(140)을 포함할 수 있다.Referring to FIG. 1, an organic light emitting display device 100 according to a first embodiment of the present invention is positioned on a substrate 110, the substrate 110, a gate electrode 115, a semiconductor layer 125, A thin film transistor T including a source electrode 130a and a drain electrode 130b, a planarization film 150 positioned on the thin film transistor T, and a planarization film 150 positioned on the planarization film 150. A first electrode 160 connected to (T), an organic layer 180 disposed on the first electrode 160 and including at least an emission layer, and a second electrode positioned on the organic layer 180 185 and a first auxiliary electrode 140 positioned between the substrate 110 and the first electrode 160 and connected to the second electrode 185.

기판(110) 상에 박막 트랜지스터(T)가 위치한다. 보다 자세하게는 기판(110) 상에 게이트 전극(115)이 위치하고, 게이트 전극(115) 상에 게이트 전극(115)을 절연시키는 게이트 절연막(120)이 위치한다.The thin film transistor T is positioned on the substrate 110. In more detail, the gate electrode 115 is positioned on the substrate 110, and the gate insulating layer 120 that insulates the gate electrode 115 is positioned on the gate electrode 115.

게이트 절연막(120) 상에 게이트 전극(115)과 대응되는 영역에 반도체층(125)이 위치하고, 반도체층(125)과 전기적으로 연결되는 소오스 전극(130a) 및 드레인 전극(130b)이 반도체층(125)의 양측부에 위치하여 박막 트랜지스터(T)를 구성한다.The semiconductor layer 125 is positioned on a region of the gate insulating layer 120 that corresponds to the gate electrode 115, and the source electrode 130a and the drain electrode 130b electrically connected to the semiconductor layer 125 are formed of the semiconductor layer ( The thin film transistor T is disposed at both sides of the 125.

박막 트랜지스터(T) 상에는 박막 트랜지스터(T)를 보호하는 패시베이션막(135)이 위치한다. 그리고, 박막 트랜지스터(T)에 의한 단차를 평탄화시키는 패평탄화막(150)이 패시베이션막(135) 상에 위치한다. The passivation film 135 that protects the thin film transistor T is disposed on the thin film transistor T. In addition, a planarization film 150 is formed on the passivation film 135 to planarize the step by the thin film transistor T.

평탄화막(150) 상에 제 1 전극(160)이 위치한다. 제 1 전극(160)은 각 화소별로 패턴된 구조로 이루어지고, 제 1 전극(160)은 패시베이션막(135) 및 평탄화막(150)에 형성된 제 1 비어홀(151)을 통해 박막 트랜지스터(T)의 소오스 전극(130a) 및 드레인 전극(130b) 중 어느 하나에 연결된다.The first electrode 160 is positioned on the planarization layer 150. The first electrode 160 has a patterned structure for each pixel, and the first electrode 160 is a thin film transistor T through the first via hole 151 formed in the passivation layer 135 and the planarization layer 150. Is connected to any one of the source electrode 130a and the drain electrode 130b.

그리고, 제 1 전극(160)과 기판(110) 사이에 제 1 보조전극(140)이 위치한다. 제 1 보조전극(140)은 상기 제 1 비어홀(151)을 제외한 기판(110) 전면에 위치할 수 있다.The first auxiliary electrode 140 is positioned between the first electrode 160 and the substrate 110. The first auxiliary electrode 140 may be positioned on the entire surface of the substrate 110 except for the first via hole 151.

또한, 제 1 전극(160)과 동일 평면 상에는 제 1 전극(160)과 이격되게 제 2 보조전극(165)이 위치한다. 그리고, 평탄화막(150)은 제 1 보조전극(140)을 노출시키는 제 2 비어홀(152)이 위치하며, 제 2 비어홀(152)에는 콘택 스페이서(155)가 위치하여 제 1 보조전극(140)과 제 2 보조전극(165)을 연결한다.In addition, the second auxiliary electrode 165 is positioned on the same plane as the first electrode 160 to be spaced apart from the first electrode 160. The planarization layer 150 includes a second via hole 152 that exposes the first auxiliary electrode 140, and a contact spacer 155 is positioned in the second via hole 152 so that the first auxiliary electrode 140 is positioned. And the second auxiliary electrode 165 are connected.

제 1 전극(160) 상에 화소를 정의하는 뱅크층(170)이 위치한다. 뱅크층(170)에는 제 1 전극(160)의 일부 영역을 노출시키는 제 1 개구부(171) 및 제 2 보조전극(165)을 노출시키는 제 2 개구부(172)가 위치한다.The bank layer 170 defining the pixel is positioned on the first electrode 160. The bank layer 170 includes a first opening 171 exposing a portion of the first electrode 160 and a second opening 172 exposing the second auxiliary electrode 165.

제 1 개구부(171)에 의해 노출된 제 1 전극(160) 상에 유기막층(180)이 위치하고, 유기막층(180)을 포함하는 기판(110) 전면에 제 2 전극(185)이 위치한다. 제 2 전극(185)은 제 2 개구부(172)를 통해 제 2 보조전극(165)과 연결되고, 제 2 보조전극(165)과 연결된 콘택 스페이서(155)를 통해 제 1 보조전극(140)에 연결된다.The organic layer 180 is positioned on the first electrode 160 exposed by the first opening 171, and the second electrode 185 is positioned on the entire surface of the substrate 110 including the organic layer 180. The second electrode 185 is connected to the second auxiliary electrode 165 through the second opening 172 and to the first auxiliary electrode 140 through the contact spacer 155 connected to the second auxiliary electrode 165. Connected.

따라서, 도 2에 도시된 바와 같이, 각 발광영역(A)을 포함하는 셀들을 포함하는 기판(110) 전면 상에 제 1 비어홀(151)을 제외하고 제 1 보조전극(140)이 위치하고, 이러한 제 1 보조전극(140)과 제 2 전극(185)이 연결되어 저항을 낮추는 역할을 하게 된다. Therefore, as shown in FIG. 2, except for the first via hole 151, the first auxiliary electrode 140 is positioned on the entire surface of the substrate 110 including the cells including the light emitting regions A. The first auxiliary electrode 140 and the second electrode 185 are connected to serve to lower the resistance.

그러므로, 종래 저항이 높은 제 2 전극에 면적이 넓은 제 1 보조전극을 형성함으로써, 제 2 전극의 저항을 낮추고 소자의 구동전압을 낮춰 대형화에 용이한 유기전계발광소자를 제공할 수 있다.Therefore, by forming the first auxiliary electrode having a large area in the second electrode having a high resistance, it is possible to provide an organic light emitting device that is easy to increase in size by lowering the resistance of the second electrode and lowering the driving voltage of the device.

이하, 본 발명의 제 1 실시 예에 따른 유기전계발광소자의 제조방법에 대해 설명하면 다음과 같다. Hereinafter, a method of manufacturing the organic light emitting display device according to the first embodiment of the present invention will be described.

도 3a 내지 도 3b는 본 발명의 제 1 실시 예에 따른 유기전계발광소자의 제 조방법을 공정별로 나타낸 도면이다.3A to 3B are views illustrating a method of manufacturing an organic light emitting display device according to a first embodiment of the present invention, by process.

먼저, 도 3a를 참조하면, 유리, 플라스틱 또는 도전성 물질로 이루어진 기판(210)을 준비하고, 기판(210) 상에 제 1 도전층을 적층한다. 제 1 도전층은 알루미늄(Al), 알루미늄 합금(Al alloy), 몰리브덴(Mo), 몰리브덴 합금(Mo alloy), 텅스텐(W), 텅스텐 실리사이드(WSi2)로 이루어진 군에서 선택되는 하나로 형성하는 것이 바람직하다. 그런 다음, 제 1 도전층을 패터닝하여, 게이트 전극(215)을 형성한다. First, referring to FIG. 3A, a substrate 210 made of glass, plastic, or a conductive material is prepared, and a first conductive layer is stacked on the substrate 210. The first conductive layer may be formed of one selected from the group consisting of aluminum (Al), aluminum alloy (Al alloy), molybdenum (Mo), molybdenum alloy (Mo alloy), tungsten (W), and tungsten silicide (WSi 2 ). desirable. Then, the first conductive layer is patterned to form the gate electrode 215.

이어서, 상기 기판(210) 상에 게이트 절연막(220)을 적층한다. 상기 게이트 절연막(220)은 실리콘 산화막, 실리콘 질화막 또는 이들의 이중층으로 형성할 수 있다. Subsequently, a gate insulating layer 220 is stacked on the substrate 210. The gate insulating film 220 may be formed of a silicon oxide film, a silicon nitride film, or a double layer thereof.

다음에, 상기 게이트 절연막(220) 상에 비정질 실리콘층을 적층하거나 비정질 실리콘층을 적층하고 이를 결정화한 다결정 실리콘층을 형성한다. 그런 다음 이를 패터닝하여 게이트 전극(215)과 일정 영역이 대응되도록 반도체층(225)을 형성한다. 여기서, 도시하지는 않았지만, 반도체층(225) 상에는 오믹 콘택층이 위치할 수도 있다.Next, an amorphous silicon layer or an amorphous silicon layer is laminated on the gate insulating layer 220 to form a polycrystalline silicon layer obtained by crystallizing it. Next, the semiconductor layer 225 is formed by patterning the semiconductor layer 225 so that the gate electrode 215 corresponds to a predetermined region. Although not shown, an ohmic contact layer may be disposed on the semiconductor layer 225.

이어서, 상기 반도체층(225)을 포함한 기판(210) 상에 제 2 도전층을 적층한다. 여기서, 제 2 도전층은 배선 저항을 낮추기 위해 저저항 물질로 형성되어 있으며, 몰리 텅스텐(MoW), 티타늄(Ti), 알루미늄(Al) 또는 알루미늄 합금(Al alloy)으로 이루어진 다중막으로 형성된다. 상기 다중막으로는 몰리 텅스텐/알루미늄/몰리 텅스텐(MoW/Al/MoW)의 적층구조가 사용될 수 있다. 다음, 상기 제 2 도전층을 패터닝하여 상기 반도체층(225)의 일정 영역에 소오스 전극(230a) 및 드레인 전극(230b)을 형성한다.Subsequently, a second conductive layer is laminated on the substrate 210 including the semiconductor layer 225. Here, the second conductive layer is formed of a low resistance material in order to lower the wiring resistance, and is formed of a multilayer film made of molybdenum tungsten (MoW), titanium (Ti), aluminum (Al), or aluminum alloy (Al alloy). As the multilayer, a laminated structure of molybdenum tungsten / aluminum molybdenum tungsten (MoW / Al / MoW) may be used. Next, the second conductive layer is patterned to form a source electrode 230a and a drain electrode 230b in a predetermined region of the semiconductor layer 225.

이어서, 상기 소오스 전극(230a) 및 드레인 전극(230b)을 포함한 기판(210) 상에 패시베이션막(235)을 적층한다. 패시베이션막(235)은 실리콘 산화막, 실리콘 질화막 또는 이들의 이중층으로 형성할 수 있다. Subsequently, a passivation film 235 is stacked on the substrate 210 including the source electrode 230a and the drain electrode 230b. The passivation film 235 may be formed of a silicon oxide film, a silicon nitride film, or a double layer thereof.

다음, 상기 패시베이션막(235) 상에 제 3 도전층을 적층한다. 제 3 도전층은 저항을 낮추기 위해 저저항 물질로 형성할 수 있으며, 몰리브덴(Mo), 티타늄(Ti), 알루미늄(Al), 은(Ag) 또는 이들의 합금으로 이루어질 수 있고, 이들의 단일층 또는 다중층으로 이루어질 수 있다.Next, a third conductive layer is laminated on the passivation film 235. The third conductive layer may be formed of a low resistance material to lower the resistance, and may be formed of molybdenum (Mo), titanium (Ti), aluminum (Al), silver (Ag), or an alloy thereof, and a single layer thereof. Or it may be made of multiple layers.

이어, 상기 제 3 도전층을 추후 제 1 비어홀이 형성될 영역을 패터닝하여 제거하여 제 1 보조전극(240)을 형성한다. 이때, 제 1 보조전극(240)의 두께는 200Å 내지 3㎛일 수 있다. Subsequently, the third conductive layer is patterned and removed to form a first via hole, thereby forming a first auxiliary electrode 240. In this case, the thickness of the first auxiliary electrode 240 may be 200 μm to 3 μm.

다음, 도 3b를 참조하면, 상기 제 1 보조전극(240)을 포함하는 기판(210) 상에 평탄화막(250)을 형성한다. 평탄화막(250)은 벤조사이클로부텐(benzocyclobutene, BCB)계 수지, 아크릴계 수지 또는 폴리이미드 수지 등의 유기물로 형성될 수 있다.Next, referring to FIG. 3B, the planarization film 250 is formed on the substrate 210 including the first auxiliary electrode 240. The planarization layer 250 may be formed of an organic material such as benzocyclobutene (BCB) resin, acrylic resin, or polyimide resin.

그런 다음, 패시베이션막(235) 및 평탄화막(250)을 식각하여 박막 트랜지스터(T)의 소오스 전극(230a) 또는 드레인 전극(230b) 중 어느 하나를 노출시키는 제 1 비어홀(251)을 형성하고, 이와 동시에 평탄화막(250)을 식각하여 제 1 보조전 극(240)을 노출시키는 제 2 비어홀(252)을 형성한다. Then, the passivation film 235 and the planarization film 250 are etched to form a first via hole 251 exposing any one of the source electrode 230a or the drain electrode 230b of the thin film transistor T. At the same time, the planarization layer 250 is etched to form a second via hole 252 exposing the first auxiliary electrode 240.

이어, 상기 제 2 비어홀(252)에 전도성 유기물, 금속 및 도전볼 중 어느 하나 이상을 형성하여 콘택 스페이서(255)를 형성한다. 콘택 스페이서(255)는 추후 제 2 보조전극과 제 1 보조전극을 연결하는 역할을 하는 것으로, 도전성이 있는 물질이라면 어느 것에도 한정되지 않는다. 따라서, 제 2 비어홀(252)에 콘택 스페이서(255)가 꽉 채워진 형상으로 형성될 수 있다.Subsequently, at least one of a conductive organic material, a metal, and a conductive ball is formed in the second via hole 252 to form a contact spacer 255. The contact spacer 255 serves to connect the second auxiliary electrode and the first auxiliary electrode later, and is not limited to any conductive material. Accordingly, the contact spacer 255 may be formed in the second via hole 252 to be filled in a tight shape.

이어서, 평탄화막(250), 제 1 비어홀(251) 및 콘택 스페이서(255) 상에 제 4 도전층을 적층한다. 제 4 도전층은 ITO(Indium Tin Oxide), IZO(Indium Zinc Oxide), ICO(Indium Cerium Oxide) 또는 ZnO(Zinc Oxide)와 같은 일함수가 높은 물질로 형성할 수 있다. 제 4 도전층을 패터닝하여 제 1 전극(260)을 형성하고, 이와 동시에, 콘택 스페이서(255) 상부에 제 2 보조전극(265)을 형성한다. 제 2 보조전극(265)은 추후 형성될 제 2 전극과 콘택 스페이서(255)를 연결시켜주는 역할을 한다.Subsequently, a fourth conductive layer is stacked on the planarization film 250, the first via hole 251, and the contact spacer 255. The fourth conductive layer may be formed of a material having a high work function such as indium tin oxide (ITO), indium zinc oxide (IZO), indium cerium oxide (ICO), or zinc oxide (ZnO). The fourth conductive layer is patterned to form the first electrode 260, and at the same time, the second auxiliary electrode 265 is formed on the contact spacer 255. The second auxiliary electrode 265 connects the second electrode to be formed later and the contact spacer 255.

이때, 제 1 전극(260)은 상기 제 1 비어홀(251)을 매우며, 소오스 전극(230a) 또는 드레인 전극(230b) 중 어느 하나와 전기적으로 연결된다.In this case, the first electrode 260 fills the first via hole 251 and is electrically connected to either the source electrode 230a or the drain electrode 230b.

이어서, 도 3c를 참조하면, 상기 제 1 전극(260) 상에 뱅크층(270)을 형성한다. 뱅크층(270)은 폴리이미드(polyimide), 벤조사이클로부틴계 수지(benzocyclobutene series resin), 아크릴레이트(acrylate) 등의 유기물 또는 실리콘 산화물을 액상 형태로 코팅한 다음 경화시키는 SOG(spin on glass)와 같은 무기물로 형성될 수 있다.Subsequently, referring to FIG. 3C, a bank layer 270 is formed on the first electrode 260. The bank layer 270 may be coated with SOG (spin on glass), which is then coated with an organic material or silicon oxide such as polyimide, benzocyclobutene series resin, acrylate, and the like in a liquid form. It may be formed of the same inorganic material.

그런 다음, 뱅크층(270)을 식각하여 제 1 전극(260)의 일부를 노출시키는 제 1 개구부(271) 및 제 2 보조전극(265)을 노출시키는 제 2 개구부(272)를 형성한다.Next, the bank layer 270 is etched to form a first opening 271 exposing a part of the first electrode 260 and a second opening 272 exposing the second auxiliary electrode 265.

이어, 상기 제 1 개구부(271) 상에 파인메탈마스크(Fine Metal Mask : FMM)를 이용하여, 발광층을 포함하는 유기막층(280)을 형성한다. 이 때, 제 2 개구부(272)에는 유기막층(280)이 형성되지 않는다. 이와는 달리, 기판(210) 전면에 유기막층(280)을 증착한 후 레이저로 패터닝하여 형성할 수도 있다.Subsequently, the organic layer 280 including the emission layer is formed on the first opening 271 using a fine metal mask (FMM). In this case, the organic layer 280 is not formed in the second opening 272. Alternatively, the organic layer 280 may be deposited on the entire surface of the substrate 210 and then patterned with a laser.

다음, 상기 유기막층(280)이 형성된 기판(210) 상에 제 5 도전층을 적층하여 제 2 전극(285)을 형성한다. 상기 제 2 전극(285)은 배선 저항 및 일함수가 낮은 마그네슘(Mg), 은(Ag), 알루미늄(Al), 칼슘(Ca) 또는 이들의 합금으로 이루어질 수 있다. 그리고, 전면 발광을 위해, 제 2 전극(285)은 빛을 투과할 수 있을정도로 매우 얇게 형성될 수 있다.Next, the second electrode 285 is formed by stacking a fifth conductive layer on the substrate 210 on which the organic layer 280 is formed. The second electrode 285 may be formed of magnesium (Mg), silver (Ag), aluminum (Al), calcium (Ca), or an alloy thereof having low wiring resistance and work function. For the top emission, the second electrode 285 may be formed so thin that it can transmit light.

이 때, 제 2 전극(285)은 제 2 개구부(272)에서 제 2 보조전극(265)과 연결되게 된다. 따라서, 제 2 전극(285)은 제 2 보조전극(265)과 연결된 콘택 스페이서(255)를 통해 제 1 보조전극(265)과 연결될 수 있다.In this case, the second electrode 285 is connected to the second auxiliary electrode 265 at the second opening 272. Accordingly, the second electrode 285 may be connected to the first auxiliary electrode 265 through the contact spacer 255 connected to the second auxiliary electrode 265.

상기와 같이, 본 발명의 제 1 실시 예에 따른 유기전계발광소자를 제조할 수 있다. As described above, the organic light emitting display device according to the first embodiment of the present invention can be manufactured.

본 발명의 제 1 실시 예에 따른 유기전계발광소자는 두께가 매우 얇은 제 2 전극과 제 1 보조전극을 연결하여, 제 2 전극의 저항을 낮춰 구동전압을 낮출 수 있는 이점이 있다.The organic light emitting display device according to the first embodiment of the present invention has the advantage of connecting the second electrode having a very thin thickness and the first auxiliary electrode, thereby lowering the driving voltage by lowering the resistance of the second electrode.

따라서, 대형화에 적용이 용이한 유기전계발광소자를 제공할 수 있는 이점이 있다.Therefore, there is an advantage in that it is possible to provide an organic light emitting device that is easy to apply to large size.

도 4는 본 발명의 제 2 실시 예에 따른 유기전계발광소자를 나타낸 단면도이고, 도 5는 도 4의 평면도이다.4 is a cross-sectional view illustrating an organic light emitting display device according to a second embodiment of the present invention, and FIG. 5 is a plan view of FIG. 4.

도 4를 참조하면, 기판(310) 상에 박막 트랜지스터(T)가 위치한다. 보다 자세하게는 기판(310) 상에 게이트 전극(315)이 위치하고, 게이트 전극(315)과 이격된 제 1 보조전극(318)이 위치한다. Referring to FIG. 4, the thin film transistor T is positioned on the substrate 310. In more detail, the gate electrode 315 is positioned on the substrate 310, and the first auxiliary electrode 318 spaced apart from the gate electrode 315 is positioned.

게이트 전극(315) 및 제 1 보조전극(318) 상에 게이트 전극(315) 및 제 1 보조전극(318)을 절연시키는 게이트 절연막(320)이 위치한다.A gate insulating layer 320 that insulates the gate electrode 315 and the first auxiliary electrode 318 is disposed on the gate electrode 315 and the first auxiliary electrode 318.

게이트 절연막(320) 상에 게이트 전극(315)과 대응되는 영역에 반도체층(325)이 위치하고, 반도체층(325)과 전기적으로 연결되는 소오스 전극(330a) 및 드레인 전극(330b)이 반도체층(325)의 양측부에 위치하여 박막 트랜지스터(T)를 구성한다.The semiconductor layer 325 is positioned on a region of the gate insulating layer 320 corresponding to the gate electrode 315, and the source electrode 330a and the drain electrode 330b electrically connected to the semiconductor layer 325 are formed of the semiconductor layer ( The thin film transistor T is disposed at both sides of the 325.

박막 트랜지스터(T) 상에는 박막 트랜지스터(T)를 보호하는 패시베이션막(340)이 위치한다. 그리고, 박막 트랜지스터(T)에 의한 단차를 평탄화시키는 평탄화막(350)이 패시베이션막(340) 상에 위치한다. The passivation film 340 is disposed on the thin film transistor T to protect the thin film transistor T. In addition, a planarization film 350 is formed on the passivation film 340 to planarize the step by the thin film transistor T.

평탄화막(350) 상에 제 1 전극(360)이 위치한다. 제 1 전극(360)은 각 화소별로 패턴된 구조로 이루어지고, 제 1 전극(360)은 패시베이션막(340) 및 평탄화막(350)에 형성된 제 1 비어홀(351)을 통해 박막 트랜지스터(T)의 소오스 전극(330a) 및 드레인 전극(330b) 중 어느 하나에 연결된다.The first electrode 360 is positioned on the planarization film 350. The first electrode 360 has a patterned structure for each pixel, and the first electrode 360 is a thin film transistor T through the first via hole 351 formed in the passivation film 340 and the planarization film 350. It is connected to any one of the source electrode 330a and the drain electrode 330b.

그리고, 게이트 절연막(320), 패시베이션막(340) 및 평탄화막(350)에는 제 1 보조전극(318)을 노출시키는 제 2 비어홀(352)이 위치한다.The second via hole 352 exposing the first auxiliary electrode 318 is disposed in the gate insulating layer 320, the passivation layer 340, and the planarization layer 350.

제 1 전극(360) 상에 유기막층(370)이 위치하고, 유기막층(370)을 포함하는 기판(310) 전면에 제 2 전극(380)이 위치한다. 제 2 전극(380)은 제 2 비어홀(352)을 통해 제 1 보조전극(318)과 연결된다.The organic layer 370 is positioned on the first electrode 360, and the second electrode 380 is positioned on the entire surface of the substrate 310 including the organic layer 370. The second electrode 380 is connected to the first auxiliary electrode 318 through the second via hole 352.

따라서, 도 5에 도시된 바와 같이, 각 발광영역(A)을 포함하는 셀들을 포함하는 기판(310) 전면 상에 즉, 게이트 전극(315) 및 게이트 전극(315)과 연결된 게이트 라인(316)을 제외한 영역에 제 1 보조전극(318)이 위치할 수 있다.Accordingly, as shown in FIG. 5, the gate line 316 connected to the gate electrode 315 and the gate electrode 315 on the entire surface of the substrate 310 including the cells including the light emitting regions A. Referring to FIG. The first auxiliary electrode 318 may be located in an area except for the above.

그러므로, 종래 저항이 높은 제 2 전극에 면적이 넓은 제 1 보조전극을 형성함으로써, 제 2 전극의 저항을 낮추고 소자의 구동전압을 낮춰 대형화에 용이한 유기전계발광소자를 제공할 수 있다.Therefore, by forming the first auxiliary electrode having a large area in the second electrode having a high resistance, it is possible to provide an organic light emitting device that is easy to increase in size by lowering the resistance of the second electrode and lowering the driving voltage of the device.

본 발명의 제 2 실시 예에 따른 유기전계발광소자에서는 단면도의 자른 형태에 따라 뱅크층이 나타나지 않지만, 전술한 제 1 실시 예와 동일하게 뱅크층이 제 1 전극(360)의 일부를 노출하도록 형성되어 있음을 밝혀둔다.In the organic light emitting display device according to the second embodiment of the present invention, the bank layer does not appear according to the cross-sectional view, but the bank layer is formed so as to expose a part of the first electrode 360 as in the first embodiment. Make it clear.

이하, 본 발명의 제 2 실시 예에 따른 유기전계발광소자의 제조방법에 대해 설명하면 다음과 같다. Hereinafter, a method of manufacturing the organic light emitting display device according to the second embodiment of the present invention will be described.

도 6a 내지 도 6b는 본 발명의 제 2 실시 예에 따른 유기전계발광소자의 제조방법을 공정별로 나타낸 도면이다.6A through 6B are views illustrating a method of manufacturing an organic light emitting display device, according to a second embodiment of the present invention.

먼저, 도 6a를 참조하면, 유리, 플라스틱 또는 도전성 물질로 이루어진 기판(410)을 준비하고, 기판(410) 상에 제 1 도전층을 적층한다. 제 1 도전층은 알루 미늄(Al), 알루미늄 합금(Al alloy), 몰리브덴(Mo), 몰리브덴 합금(Mo alloy), 텅스텐(W), 텅스텐 실리사이드(WSi2)로 이루어진 군에서 선택되는 하나로 형성하는 것이 바람직하다. 그런 다음, 제 1 도전층을 패터닝하여, 게이트 전극(415) 및 제 1 보조전극(418)을 형성한다. 이때, 제 1 보조전극(418)의 두께는 200Å 내지 3㎛일 수 있다. First, referring to FIG. 6A, a substrate 410 made of glass, plastic, or a conductive material is prepared, and a first conductive layer is stacked on the substrate 410. The first conductive layer is formed of one selected from the group consisting of aluminum (Al), aluminum alloy (Al alloy), molybdenum (Mo), molybdenum alloy (Mo alloy), tungsten (W), and tungsten silicide (WSi 2 ). It is preferable. Then, the first conductive layer is patterned to form the gate electrode 415 and the first auxiliary electrode 418. In this case, the thickness of the first auxiliary electrode 418 may be 200 μm to 3 μm.

이어서, 상기 기판(410) 상에 게이트 절연막(420)을 적층한다. 상기 게이트 절연막(420)은 실리콘 산화막, 실리콘 질화막 또는 이들의 이중층으로 형성할 수 있다. Subsequently, a gate insulating film 420 is stacked on the substrate 410. The gate insulating film 420 may be formed of a silicon oxide film, a silicon nitride film, or a double layer thereof.

다음에, 상기 게이트 절연막(420) 상에 비정질 실리콘층을 적층하거나 비정질 실리콘층을 적층하고 이를 결정화한 다결정 실리콘층을 형성한다. 그런 다음 이를 패터닝하여 게이트 전극(415)과 일정 영역이 대응되도록 반도체층(425)을 형성한다. 여기서, 도시하지는 않았지만, 반도체층(425) 상에는 오믹 콘택층이 위치할 수도 있다.Next, an amorphous silicon layer or an amorphous silicon layer is laminated on the gate insulating layer 420, and a polycrystalline silicon layer obtained by crystallizing the same is formed. Next, the semiconductor layer 425 is formed to pattern the gate electrode 415 and a predetermined region by patterning it. Although not shown, an ohmic contact layer may be disposed on the semiconductor layer 425.

이어서, 상기 반도체층(425)을 포함한 기판(410) 상에 제 2 도전층을 적층한다. 여기서, 제 2 도전층은 배선 저항을 낮추기 위해 저저항 물질로 형성되어 있으며, 몰리 텅스텐(MoW), 티타늄(Ti), 알루미늄(Al) 또는 알루미늄 합금(Al alloy)으로 이루어진 다중막으로 형성된다. 상기 다중막으로는 몰리 텅스텐/알루미늄/몰리 텅스텐(MoW/Al/MoW)의 적층구조가 사용될 수 있다. 다음, 상기 제 2 도전층을 패터닝하여 상기 반도체층(425)의 일정 영역에 소오스 전극(430a) 및 드레인 전 극(430b)을 형성한다.Subsequently, a second conductive layer is laminated on the substrate 410 including the semiconductor layer 425. Here, the second conductive layer is formed of a low resistance material in order to lower the wiring resistance, and is formed of a multilayer film made of molybdenum tungsten (MoW), titanium (Ti), aluminum (Al), or aluminum alloy (Al alloy). As the multilayer, a laminated structure of molybdenum tungsten / aluminum molybdenum tungsten (MoW / Al / MoW) may be used. Next, the second conductive layer is patterned to form a source electrode 430a and a drain electrode 430b in a predetermined region of the semiconductor layer 425.

이어서, 상기 소오스 전극(430a) 및 드레인 전극(430b)을 포함한 기판(410) 상에 패시베이션막(440)을 적층한다. 패시베이션막(440)은 실리콘 산화막, 실리콘 질화막 또는 이들의 이중층으로 형성할 수 있다. Subsequently, a passivation film 440 is stacked on the substrate 410 including the source electrode 430a and the drain electrode 430b. The passivation film 440 may be formed of a silicon oxide film, a silicon nitride film, or a double layer thereof.

다음, 도 6b를 참조하면, 기판(410) 상에 평탄화막(450)을 형성한다. 평탄화막(450)은 벤조사이클로부텐(benzocyclobutene, BCB)계 수지, 아크릴계 수지 또는 폴리이미드 수지 등의 유기물로 형성될 수 있다.Next, referring to FIG. 6B, the planarization film 450 is formed on the substrate 410. The planarization layer 450 may be formed of an organic material such as benzocyclobutene (BCB) -based resin, acrylic resin, or polyimide resin.

이어, 평탄화막(450) 상에 제 3 도전층을 적층한다. 제 3 도전층은 ITO(Indium Tin Oxide), IZO(Indium Zinc Oxide), ICO(Indium Cerium Oxide) 또는 ZnO(Zinc Oxide)와 같은 일함수가 높은 물질로 형성할 수 있다. 제 3 도전층을 패터닝하여 제 1 전극(460)을 형성한다.Next, a third conductive layer is laminated on the planarization film 450. The third conductive layer may be formed of a material having a high work function such as indium tin oxide (ITO), indium zinc oxide (IZO), indium cerium oxide (ICO), or zinc oxide (ZnO). The third conductive layer is patterned to form the first electrode 460.

제 1 전극(460)의 패터닝 공정과 동시에, 패시베이션막(440) 및 평탄화막(450)을 식각하여 박막 트랜지스터(T)의 소오스 전극(430a) 또는 드레인 전극(430b) 중 어느 하나를 노출시키는 제 1 비어홀(451)을 형성하고, 이와 동시에 게이트 절연막(420), 패시베이션막(440) 및 평탄화막(450)을 식각하여 제 1 보조전극(418)을 노출시키는 제 2 비어홀(452)을 형성한다. The passivation layer 440 and the planarization layer 450 are etched at the same time as the patterning process of the first electrode 460 to expose either the source electrode 430a or the drain electrode 430b of the thin film transistor T. The first via hole 451 is formed, and at the same time, the gate insulating film 420, the passivation film 440, and the planarization film 450 are etched to form a second via hole 452 exposing the first auxiliary electrode 418. .

반면, 도시되지 않은 뱅크층이 있는 영역에서는 제 1 전극(460)을 패터닝하고, 제 1 전극(460) 상에 뱅크층을 형성한 후, 제 1 전극(460)을 노출시키는 개구부 형성 공정 시, 뱅크층, 평탄화막(350) 및 패시베이션막(440)을 식각하여 제 1 보조전극(418)을 노출시키는 제 2 비어홀(452)이 형성될 수 있다. On the other hand, in the region where the bank layer is not shown, in the opening forming process of patterning the first electrode 460, forming the bank layer on the first electrode 460, and exposing the first electrode 460, A second via hole 452 may be formed to expose the first auxiliary electrode 418 by etching the bank layer, the planarization film 350, and the passivation film 440.

이어서, 도 6c를 참조하면, 상기 제 1 전극(460) 상에 파인메탈마스크(FMM)를 이용하여, 발광층을 포함하는 유기막층(470)을 형성한다. 이와는 달리, 기판(410) 전면에 유기막층(470)을 형성한 후 레이저로 패터닝할 수도 있다.6C, an organic layer 470 including a light emitting layer is formed on the first electrode 460 by using a fine metal mask (FMM). Alternatively, the organic layer 470 may be formed over the entire surface of the substrate 410, and then patterned with a laser.

다음, 상기 유기막층(470)이 형성된 기판(410) 상에 제 4 도전층을 적층하여 제 2 전극(480)을 형성한다. 상기 제 2 전극(480)은 배선 저항 및 일함수가 낮은 마그네슘(Mg), 은(Ag), 알루미늄(Al), 칼슘(Ca) 또는 이들의 합금으로 이루어질 수 있다. 그리고, 전면 발광을 위해, 제 2 전극(480)은 빛을 투과할 수 있을 정도로 매우 얇게 형성될 수 있다.Next, the second electrode 480 is formed by stacking a fourth conductive layer on the substrate 410 on which the organic layer 470 is formed. The second electrode 480 may be made of magnesium (Mg), silver (Ag), aluminum (Al), calcium (Ca), or an alloy thereof having low wiring resistance and work function. For the top emission, the second electrode 480 may be formed so thin as to transmit light.

이 때, 제 2 전극(480)은 제 2 비어홀(452)을 통해 제 1 보조전극(418)과 연결되게 된다. 상기와 같이, 본 발명의 제 2 실시 예에 따른 유기전계발광소자(400)를 제조할 수 있다. In this case, the second electrode 480 is connected to the first auxiliary electrode 418 through the second via hole 452. As described above, the organic light emitting diode 400 according to the second embodiment of the present invention may be manufactured.

본 발명의 제 2 실시 예에 따른 유기전계발광소자는 전술한 제 1 실시 예와는 달리, 제 2 전극을 직접 제 1 보조전극과 연결함으로써, 제 2 전극의 저항을 낮춰 구동전압을 낮출 수 있는 이점이 있다.Unlike the first embodiment described above, the organic light emitting diode according to the second embodiment of the present invention can directly reduce the driving voltage by lowering the resistance of the second electrode by directly connecting the second electrode with the first auxiliary electrode. There is an advantage.

따라서, 대형화에 적용이 용이한 유기전계발광소자를 제공할 수 있는 이점이 있다.Therefore, there is an advantage in that it is possible to provide an organic light emitting device that is easy to apply to large size.

도 7은 본 발명의 제 3 실시 예에 따른 유기전계발광소자를 나타낸 단면도이다.7 is a cross-sectional view of an organic light emitting display device according to a third embodiment of the present invention.

도 7을 참조하면, 제 3 실시 예에 따른 유기전계발광소자(500)는 전술한 제 1 실시 예의 유기전계발광소자의 박막 트랜지스터(T), 패시베이션막(535) 및 제 1 보조전극(540)까지의 구조가 동일하므로 그 설명을 생략한다.Referring to FIG. 7, the organic light emitting diode 500 according to the third embodiment includes the thin film transistor T, the passivation layer 535, and the first auxiliary electrode 540 of the organic light emitting diode according to the first embodiment. Since the structure up to now is the same, description thereof is omitted.

박막 트랜지스터(T)에 의한 단차를 평탄화시키는 평탄화막(550)이 패시베이션막(535) 상에 위치한다.A planarization film 550 is formed on the passivation film 535 to planarize the step by the thin film transistor T.

평탄화막(550) 상에 제 1 전극(560)이 위치한다. 제 1 전극(560)은 각 화소별로 패턴된 구조로 이루어지고, 제 1 전극(560)은 패시베이션막(535) 및 평탄화막(550)에 형성된 제 1 비어홀(551)을 통해 박막 트랜지스터(T)의 소오스 전극(530a) 및 드레인 전극(530b) 중 어느 하나에 연결된다.The first electrode 560 is positioned on the planarization layer 550. The first electrode 560 has a patterned structure for each pixel, and the first electrode 560 is a thin film transistor T through the first via hole 551 formed in the passivation film 535 and the planarization film 550. Is connected to any one of the source electrode 530a and the drain electrode 530b.

그리고, 평탄화막(550)에는 제 1 보조전극(540)을 노출시키는 제 2 비어홀(552)이 위치한다.The second via hole 552 exposing the first auxiliary electrode 540 is disposed in the planarization layer 550.

제 1 전극(560) 상에 유기막층(570)이 위치하고, 유기막층(570)을 포함하는 기판(510) 전면에 제 2 전극(580)이 위치한다. 제 2 전극(580)은 제 2 비어홀(552)을 통해 제 1 보조전극(540)과 연결된다.The organic layer 570 is positioned on the first electrode 560, and the second electrode 580 is positioned on the entire surface of the substrate 510 including the organic layer 570. The second electrode 580 is connected to the first auxiliary electrode 540 through the second via hole 552.

본 발명의 제 3 실시 예에 따른 유기전계발광소자는 전술한 제 2 실시 예와 마찬가지로, 제 2 전극이 제 1 보조전극과 직접 연결되는 구조일 수 있다.The organic light emitting display device according to the third embodiment of the present invention may have a structure in which the second electrode is directly connected to the first auxiliary electrode as in the above-described second embodiment.

도 8은 본 발명의 제 4 실시 예에 따른 유기전계발광소자를 나타낸 단면도이다.8 is a cross-sectional view illustrating an organic light emitting display device according to a fourth embodiment of the present invention.

도 8을 참조하면, 제 4 실시 예에 따른 유기전계발광소자(600)는 전술한 제 2 실시 예의 유기전계발광소자와는 달리, 소오스 전극(630a) 및 드레인 전극(630b)과 동일한 물질로 제 1 보조전극(635)을 형성하는 구조이다. Referring to FIG. 8, the organic light emitting diode 600 according to the fourth embodiment is made of the same material as the source electrode 630a and the drain electrode 630b, unlike the organic light emitting diode according to the second embodiment. One auxiliary electrode 635 is formed.

그리고, 제 1 보조전극(635)을 포함하는 기판(610) 상에 패시베이션막(640) 이 위치하고, 그 상부에 평탄화막(650)이 위치한다. The passivation film 640 is positioned on the substrate 610 including the first auxiliary electrode 635, and the planarization film 650 is positioned thereon.

평탄화막(650) 상에 제 1 전극(660)이 위치한다. 제 1 전극(660)은 각 화소별로 패턴된 구조로 이루어지고, 제 1 전극(660)은 패시베이션막(640) 및 평탄화막(650)에 형성된 제 1 비어홀(651)을 통해 박막 트랜지스터(T)의 소오스 전극(530a) 및 드레인 전극(530b) 중 어느 하나에 연결된다. 그리고, 패시베이션막(640) 및 평탄화막(650)에는 제 1 보조전극(635)을 노출시키는 제 2 비어홀(652)이 위치한다.The first electrode 660 is positioned on the planarization layer 650. The first electrode 660 has a patterned structure for each pixel, and the first electrode 660 is formed through the first via hole 651 formed in the passivation layer 640 and the planarization layer 650. Is connected to any one of the source electrode 530a and the drain electrode 530b. In addition, a second via hole 652 exposing the first auxiliary electrode 635 is disposed in the passivation layer 640 and the planarization layer 650.

제 1 전극(660) 상에 유기막층(670)이 위치하고, 유기막층(670)을 포함하는 기판(610) 전면에 제 2 전극(680)이 위치한다. 여기서, 제 2 전극(680)은 제 2 비어홀(652)을 통해 제 1 보조전극(635)과 연결된다.The organic layer 670 is positioned on the first electrode 660, and the second electrode 680 is positioned on the entire surface of the substrate 610 including the organic layer 670. Here, the second electrode 680 is connected to the first auxiliary electrode 635 through the second via hole 652.

본 발명의 제 4 실시 예에 따른 유기전계발광소자는 전술한 제 3 실시 예와 마찬가지로, 제 2 전극이 제 1 보조전극과 직접 연결되는 구조일 수 있다.The organic light emitting display device according to the fourth embodiment of the present invention may have a structure in which the second electrode is directly connected to the first auxiliary electrode as in the above-described third embodiment.

상기와 같이, 본 발명의 일 실시 예에 따른 유기전계발광소자 및 그 제조방법은 종래 유기전계발광소자의 제 2 전극의 저항이 높은 것을 방지하기 위해, 보조전극과 제 2 전극을 연결하여, 제 2 전극의 저항을 낮추고 이에 따라 구동전압을 낮출 수 있는 이점이 있다.As described above, the organic light emitting display device and the method of manufacturing the same according to an embodiment of the present invention, in order to prevent the resistance of the second electrode of the conventional organic light emitting device is high, by connecting the auxiliary electrode and the second electrode, There is an advantage in that the resistance of the two electrodes can be lowered and thus the driving voltage can be lowered.

또한, 두께가 얇은 제 2 전극의 영역별로 저항이 불균일하던 것을 보조전극을 통해 해결함으로써, 휘도 불균형 현상도 방지할 수 있는 이점이 있다.In addition, there is an advantage in that the luminance unevenness may also be prevented by solving the nonuniform resistance for each region of the second thin electrode through the auxiliary electrode.

따라서, 본 발명의 실시 예들에 따른 유기전계발광소자 및 그 제조방법은 대향화에 적용이 용이한 유기전계발광소자 및 그 제조방법을 제공할 수 있다. Therefore, the organic light emitting display device and its manufacturing method according to the embodiments of the present invention can provide an organic light emitting display device and a method of manufacturing the same is easy to apply to the counter.

이상 첨부된 도면을 참조하여 본 발명의 실시 예를 설명하였지만, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술 분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다. 그러므로 이상에서 기술한 실시 예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 한다. 아울러, 본 발명의 범위는 상기 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어진다. 또한, 특허청구범위의 의미 및 범위 그리고 그 등가 개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.While the present invention has been described in connection with what is presently considered to be practical exemplary embodiments thereof, it is to be understood that the invention is not limited to the disclosed embodiments, but, on the contrary, It will be understood that the invention may be practiced. Therefore, the embodiments described above are to be understood as illustrative and not restrictive in all aspects. In addition, the scope of the present invention is shown by the claims below, rather than the above detailed description. Also, it is to be construed that all changes or modifications derived from the meaning and scope of the claims and their equivalent concepts are included in the scope of the present invention.

도 1은 본 발명의 제 1 실시 예에 따른 유기전계발광소자를 나타낸 단면도.1 is a cross-sectional view showing an organic light emitting display device according to a first embodiment of the present invention.

도 2는 도 1의 평면도.2 is a plan view of FIG.

도 3a 내지 도 3c는 본 발명의 제 1 실시 예에 따른 유기전계발광소자의 제조방법을 나타낸 공정별 단면도.3A to 3C are cross-sectional views of processes illustrating a method of manufacturing an organic light emitting display device according to a first embodiment of the present invention.

도 4는 본 발명의 제 2 실시 예에 따른 유기전계발광소자를 나타낸 단면도.4 is a cross-sectional view of an organic light emitting display device according to a second exemplary embodiment of the present invention.

도 5는 도 4의 평면도.5 is a plan view of FIG. 4.

도 6a 내지 도 6c는 본 발명의 제 2 실시 예에 따른 유기전계발광소자의 제조방법을 나타낸 공정별 단면도.6A through 6C are cross-sectional views illustrating a method of manufacturing an organic light emitting display device according to a second exemplary embodiment of the present invention.

도 7은 본 발명의 제 3 실시 예에 따른 유기전계발광소자를 나타낸 단면도.7 is a cross-sectional view of an organic light emitting display device according to a third exemplary embodiment of the present invention.

도 8은 본 발명의 제 4 실시 예에 따른 유기전계발광소자를 나타낸 단면도.8 is a cross-sectional view of an organic light emitting display device according to a fourth embodiment of the present invention.

Claims (12)

기판;Board; 상기 기판 상에 위치하며, 게이트 전극, 반도체층, 소오스 전극 및 드레인 전극을 포함하는 박막 트랜지스터;A thin film transistor on the substrate, the thin film transistor including a gate electrode, a semiconductor layer, a source electrode, and a drain electrode; 상기 박막 트랜지스터 상에 위치하는 평탄화막;A planarization layer on the thin film transistor; 상기 평탄화막 상에 위치하며, 상기 박막 트랜지스터와 연결되는 제 1 전극;A first electrode on the planarization layer and connected to the thin film transistor; 상기 제 1 전극 상에 위치하는 유기막층;An organic layer disposed on the first electrode; 상기 유기막층 상에 위치하는 제 2 전극; 및A second electrode on the organic layer; And 상기 기판과 상기 제 1 전극 사이에 위치하며, 상기 제 2 전극과 연결된 제 1 보조전극을 포함하는 유기전계발광소자.An organic light emitting device comprising a first auxiliary electrode positioned between the substrate and the first electrode and connected to the second electrode. 제 1항에 있어서,The method of claim 1, 상기 제 1 보조전극과 상기 제 2 전극 사이에 콘택 스페이서 및 제 2 보조전극을 더 포함하는 유기전계발광소자.The organic light emitting device of claim 1, further comprising a contact spacer and a second auxiliary electrode between the first auxiliary electrode and the second electrode. 제 2항에 있어서,3. The method of claim 2, 상기 제 2 보조전극은 상기 제 1 전극과 동일 평면 상에 위치하며, 상기 콘 택 스페이서는 상기 제 2 보조전극과 상기 제 1 보조전극 사이에 위치하는 유기전계발광소자.The second auxiliary electrode is positioned on the same plane as the first electrode, and the contact spacer is positioned between the second auxiliary electrode and the first auxiliary electrode. 제 2항에 있어서,3. The method of claim 2, 상기 콘택 스페이서는 유기물, 금속, 도전볼 또는 이들의 다층막으로 이루어진 유기전계발광소자.The contact spacer is an organic light emitting device consisting of an organic material, a metal, a conductive ball or a multilayer film thereof. 제 2항에 있어서,3. The method of claim 2, 상기 제 1 보조전극은 상기 박막 트랜지스터 상에 위치하는 유기전계발광소자. The first auxiliary electrode is an organic light emitting diode disposed on the thin film transistor. 제 5항에 있어서,The method of claim 5, 상기 제 1 보조전극은 상기 제 1 전극과 상기 박막 트랜지스터와 연결되는 비어홀을 제외한 상기 기판 전면에 위치하는 유기전계발광소자.The first auxiliary electrode is disposed on the front surface of the substrate except for a via hole connected to the first electrode and the thin film transistor. 제 1항에 있어서,The method of claim 1, 상기 제 1 보조전극은 상기 게이트 전극과 동일한 물질로 이루어진 유기전계발광소자.The first auxiliary electrode is made of the same material as the gate electrode. 제 1항에 있어서,The method of claim 1, 상기 제 1 보조전극은 상기 박막 트랜지스터와 상기 제 1 전극 사이에 위치하는 유기전계발광소자.The first auxiliary electrode is disposed between the thin film transistor and the first electrode. 제 1항에 있어서,The method of claim 1, 상기 제 1 보조전극은 소오스 전극 및 드레인 전극과 동일한 물질로 이루어진 유기전계발광소자.The first auxiliary electrode is made of the same material as the source electrode and drain electrode. 제 7항, 제8항 및 제 9항 중 어느 한 항에 있어서,The method according to any one of claims 7, 8 and 9, 상기 제 2 전극은 상기 제 1 보조전극의 일부를 노출시키는 비어홀을 통해 상기 제 1 보조전극과 연결되는 유기전계발광소자.The second electrode is connected to the first auxiliary electrode through a via hole for exposing a portion of the first auxiliary electrode. 기판 상에 게이트 전극, 반도체층, 소오스 전극 및 드레인 전극을 포함하는 박막 트랜지스터를 형성하는 단계;Forming a thin film transistor including a gate electrode, a semiconductor layer, a source electrode, and a drain electrode on the substrate; 상기 박막 트랜지스터 상에 제 1 보조전극을 형성하는 단계;Forming a first auxiliary electrode on the thin film transistor; 상기 제 1 보조전극 상에 복수의 비어홀을 포함하는 평탄화막을 형성하는 단계;Forming a planarization film including a plurality of via holes on the first auxiliary electrode; 상기 평탄화막 상에 상기 박막 트랜지스터와 연결되는 제 1 전극을 형성하는 단계;Forming a first electrode connected to the thin film transistor on the planarization layer; 상기 제 1 전극 상에 유기막층을 형성하는 단계; 및Forming an organic layer on the first electrode; And 상기 유기막층 상에 상기 제 1 보조전극과 연결되는 제 2 전극을 형성하는 단계를 포함하는 유기전계발광소자의 제조방법.And forming a second electrode connected to the first auxiliary electrode on the organic film layer. 제 11항에 있어서,The method of claim 11, 상기 비어홀에 콘택 스페이서 및 제 2 보조전극을 형성하는 단계를 더 포함하는 유기전계발광소자의 제조방법.A method of manufacturing an organic light emitting display device, the method comprising: forming a contact spacer and a second auxiliary electrode in the via hole.
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