KR20090113320A - Ｄｔｘ 동작 동안 전력 제어를 위한 방법 및 장치 - Google Patents

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KR20090113320A
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Abstract

본 발명은 불연속한 전송(DTX) 동작 동안 전력 제어를 실행하기 위한 기술에 관한 것이다. UE는 전송 버스트 동안 업링크를 통해 전송하며 업링크 전송에 기초하여 노드B에 의해 생성된 TPC 명령들을 수신한다. UE는 전송 버스트의 종단에서 전송 버스트 동안 적용되지 않은 두 개의 TPC 명령들을 수신한다. UE는 이러한 두 TPC 명령들을 저장하고 다음 전송 버스트에서 적용시킨다. 일 설계에서, UE는 다음 전송 버스트의 하나의 슬롯에서 각각의 저장된 TPC 명령을 적용한다. 다른 설계에서, UE는 저장된 TPC 명령들을 결합시키고, 다음 전송 버스트의 처음 두 개의 슬롯들에서 결합된 값을 적용한다. 또 다른 설계에서, UE는 저장된 TPC 명령 중 하나를 선택하고 다음 전송 버스트의 처음 두 개의 슬롯들에서 선택된 TPC 명령을 적용한다.

Description

ＤＴＸ 동작 동안 전력 제어를 위한 방법 및 장치{METHOD AND APPARATUS FOR POWER CONTROL DURING DTX OPERATION}
본 출원은 2007년 1월 31일 출원된 "POWER CONTROL AND DTX-DRX"라는 명칭의 미국 가출원 제 60/887,551호를 우선권으로 청구하며, 상기 출원은 본 출원의 양수인에게 양도되었으며, 본 명세서에 참조된다.
본 출원은 일반적으로 통신에 관한 것이며, 특히 무선 통신 시스템에서 전력 제어를 수행하기 위한 기술에 관한 것이다.
무선 통신 시스템들은 음성, 비디오, 패킷 데이터, 메시징, 브로드캐스트 등과 같은 다양한 통신 서비스들을 제공하도록 광범위하게 전개되었다. 이러한 시스템들은 이용가능한 시스템 리소스들을 공유함으로써 다수의 사용자들을 지원할 수 있는 다중 액세스 시스템들일 수도 있다. 이러한 다중 액세스 시스템들의 예들은 코드 분할 다중 액세스(CDMA) 시스템들, 시분할 다중 액세스(TDMA) 시스템들, 주파수 분할 다중 액세스(FDMA) 시스템들, 직교 FDMA(OFDMA) 시스템들, 및 단일 캐리어 FDMA(SC-FDMA) 시스템들을 포함한다.
무선 통신 시스템에서, 다수의 사용자 설비(UE)들은 업링크를 통해 노드 B로 전송할 수도 있다. 시스템 용량을 개선하기 위해, 다른 UE들에 대한 간섭의 양을 감소시키면서, UE에 대해 요구되는 성능이 달성될 수 있도록 각각의 UE에 대한 전송 전력이 제어될 수도 있다. 업링크 전력 제어의 경우, 노드B는 노드B에서 UE의 수신 신호 품질을 주기적으로 추정할 수도 있고, 요구되는 수신 신호 품질을 달성하기 위해, UE에게 자신의 전송 전력을 상향 또는 하향 조절하도록 지시하는 전송 전력 제어(TPC) 명령들을 전송할 수도 있다. UE는 TPC 명령들에 따라 자신의 전송 전력을 조절할 수도 있다. 그러나 UE는 불연속 전송(DTX) 모드에서 동작할 수도 있으며, 연속적인 대신에 버스트들로 전송할 수도 있다. DTX 동작 동안 효율적으로 전력 제어를 수행하는 것이 바람직하다.
DTX 동작 동안 전력 제어를 수행하기 위한 기술들이 본 명세서에 기술된다. UE는 업링크를 통해 전송 버스트 동안 전송할 수도 있고, 업링크 전송에 기초하여 노드B에 의해 생성된 TPC 명령들을 수신할 수도 있다. TPC 명령이 UE에서 수신되는 시점부터 TPC 명령이 UE에 의해 적용될 수 있는 시점까지 통상적으로 지연이 존재한다. 후술되는 바와 같이, 지연량은 가변적일 수도 있고, TPC 명령들을 전송하기 위해 사용되는 물리 채널에 대해 UE에 할당된 시간 오프셋에 기초할 수도 있다. UE는 전송 버스트의 종단(end)에서 전송 버스트 동안 직접 적용되지 않는 하나 또는 두 개의 TPC 명령들을 수신할 수도 있다. UE는 적용되지 않은 TCP 명령(들)을 저장할 수도 있고, 그 후 저장된 TPC 명령(들)을 다음 전송 버스트에 대해 적용할 수도 있다.
UE는 두 개의 저장된 TPC 명령들을 다양한 방식으로 적용할 수도 있다. 일 설계에서, UE는 두 개의 저장된 TPC 명령들을 다음 전송 버스트의 처음 두 개의 슬롯에 적용시킬 수도 있다. UE는 저장된 TPC 명령들 중 하나에 기초하여 다음 전송 버스트의 첫 번째 슬롯에 대해 자신의 전송 전력을 조절할 수도 있고, 다른 저장된 TPC 명령에 기초하여 다음 전송 버스트의 두 번째 슬롯에 대해 자신의 전송 전력을 조절할 수도 있다. 다른 설계에서, UE는 두 개의 저장된 TPC 명령들을 결합시켜서 결합된 값을 획득할 수도 있고, 결합된 값에 기초하여 다음 전송 버스트의 처음 두 개의 슬롯들에 대해 자신의 전송 전력을 조절할 수도 있다. 또 다른 설계에서, UE는 미리 결정된 범위 내로 결합된 값을 제한 또는 한정할 수도 있고, 한정된 값에 기초하여 다음 전송 버스트의 처음 두 개의 슬롯에 대해 자신의 전송 전력을 조절할 수도 있다. 또 다른 설계에서, UE는 저장된 TPC 명령들(예를 들어, 최종 TPC 명령 또는 더욱 신뢰가능한 TPC 명령) 중 하나를 선택할 수도 있고, 선택된 TPC 명령에 기초하여 다음 전송 버스트의 처음 두 개의 슬롯에 대해 자신의 전송 전력을 조절할 수도 있다. UE는 또한 다른 방식으로 저장된 TPC 명령들에 기초하여 다음 전송 버스트에 대해 자신의 전송 전력을 조절할 수도 있다.
설명된 다양한 특징들 및 특성들은 이하에서 더욱 상세하게 설명된다.
도1은 무선 통신 시스템을 도시한다.
도2는 물리 채널들의 일부의 타이밍도이다.
도3은 노드B에 의한 TPC 명령들의 전송을 도시한다.
도4는 UE에 의한 TPC 명령들의 수신을 도시한다.
도5는 UE에 대해 조기(early) TPC 명령들을 이용한 업링크 전력 제어를 도시한다.
도6은 UE에 대해 늦은 TPC 명령들을 이용한 업링크 전력 제어를 도시한다.
도7은 조기 TPC 명령들을 이용한 DTX 동작 동안 UE에 대한 업링크 전력 제어를 도시한다.
도8A 및 8B는 늦은 TPC 명령들을 이용한 DTX 동작 동안 UE에 대한 업링크 전력 제어의 두 설계를 도시한다.
도9는 업링크 전력 제어를 위해 UE에 의해 실행된 프로세스를 도시한다.
도10은 업링크 전력 제어를 위해 노드B에 의해 실행된 프로세스를 도시한다.
도11은 UE 및 노드B의 블록도를 도시한다.
설명된 기술들은 CDMA, TDMA, FDMA, OFDMA, SC-FDMA 및 다른 시스템들과 같은 다양한 무선 통신 시스템들에 대해 사용될 수도 있다. "시스템" 및 "네트워크"라는 용어들은 종종 상호 교환적으로 사용된다. CDMA 시스템은 범용 지상 무선 액세스(UTRA), cdma 2000 등과 같은 무선 기술을 구현할 수도 있다. UTRA는 광대역 CDMA(W-CDMA) 및 다른 CDMA 변형들을 포함한다. cdma2000은 IS-2000, IS-95 및 IS-856 표준들을 포함한다. TDMA 시스템은 글로벌 모바일 시스템(GSM)과 같은 무선 기술을 구현할 수도 있다. OFDMA 시스템은 E-UTRA(Evolved UTRA), UMB(Ultra Mobile Broadband), IEEE 802.20, IEEE 802.16(WiMAX), 802.11(WiFi), Flash-OFDM® 등과 같은 무선 기술을 구현할 수도 있다. UTRA 및 E-UTRA는 범용 모바일 통신 시스템(UMTS)의 일부이다. 3GPP LTE(Long Term Evolution)는 E-UTRA를 이용하는 UMTS의 후속 배포판이다. UTRA, E-UTRA, UMTS, LTE 및 GSM은 "3세대 파트너쉽 프로젝트(3GPP)"로 명명된 조직의 문서에 개시된다. cdma 2000 및 UMB는 "3세대 파트너쉽 프로젝트2"(3GPP2)로 명명된 조직의 문서에 개시된다. 이러한 다양한 무선 기술들 및 표준들이 기술 분야에 알려져 있다. 간략화를 위해, 기술들의 소정 특징들이 UMTS에 대해 이하에 기술되며, 3GPP라는 용어가 이하의 설명에서 대부분 사용된다.
도1은 UMTS에서 범용 지상 무선 액세스 네트워크(UTRAN)로 지칭될 수도 있는 무선 통신 시스템(100)을 도시한다. 시스템(100)은 다수의 노드B들(110)을 포함한다. 노드B는 UE들과 통신하는 고정국일 수도 있으며, 진화된 노드B(evolved Node B), 기지국, 액세스 포인트 등으로 지칭될 수도 있다. 각각의 노드B(110)는 특정 지리적 영역에 대해 통신 커버리지를 제공하며 커버리지 영역 내에 위치된 UE들에 대한 통신을 지원한다. 시스템 제어기(130)는 노드B들(110)에 연결되어 이러한 노드B들에 대한 조정 및 제어를 제공할 수도 있다. 시스템 제어기(130)는 단일 네트워크 엔티티이거나 네트워크 엔티티들의 집합일 수도 있다.
UE들(120)은 시스템 전체에 분포되어 있을 수도 있으며, 각각의 UE는 고정형 또는 이동형일 수도 있다. UE는 이동국, 단말, 액세스 단말, 가입자 유닛, 국 등으로 지칭될 수도 있다. UE는 셀룰러 폰, 개인용 디지털 보조기(PDA), 무선 통신 장치, 휴대용 장치, 무선 모뎀, 랩탑 컴퓨터 등일 수도 있다. UE는 다운링크 및 업링크 상의 전송을 통해 노드B와 통신할 수도 있다. 다운링크(또는 순방향 링크) 는 노드B들로부터 UE들로의 통신 링크를 지칭하며, 업링크(또는 역방향 링크)는 UE들로부터 노드B들로의 통신 링크를 지칭한다.
UMTS는 다운링크 및 업링크를 통해 데이터 및 시그널링/제어 정보를 전송하기 위해 다양한 물리 채널들을 이용한다. 물리 채널들은 상이한 채널화 코드들을 이용하여 채널화되며 코드 도메인에서 서로 직교한다.
도2는 UMTS에서 사용되는 물리 채널들의 일부의 타이밍도를 도시한다. 전송을 위한 타임라인은 무선 프레임들로 분할된다. 각각의 무선 프레임은 10밀리초(ms)의 지속 기간을 가지며, 12 비트 시스템 프레임 번호(SFN)로 식별된다. 각각의 무선 프레임은, 슬롯 0 내지 슬롯 14로 라벨링된 15개의 슬롯들로 분할된다. 각각의 슬롯은 Tslot = 0.667ms의 지속 기간을 가지며, 3.84Mcps에서 2560개의 칩들을 포함한다. 각각의 무선 프레임은 또한 5개의 서브 프레임들(도2에 미도시)로 분할된다. 각각의 서브프레임은 2ms의 지속기간을 가지며 3개의 슬롯들을 포함한다.
1차 공통 제어 물리 채널(P-CCPCH)은 다운링크 상에서 노드B에 의해 전송된다. P-CCPCH는 다운링크 물리 채널들에 대한 타이밍 기준으로서 직접적으로 사용되며, 업링크 물리 채널들에 대한 타이밍 기준으로서 간접적으로 사용된다. 단편화된 전용 물리 채널(F-DPCH)은 다운링크를 통해 전송되고 다수의 UE들에 대한 TPC 명령들을 전달할 수도 있다. F-DPCH는 P-CCPCH의 프레임 경계로부터
Figure 112009053464195-PCT00001
개의 칩들만큼 지연되는데, 여기서
Figure 112009053464195-PCT00002
이며, n은 0 내지 149의 범위 일 수 있다. 업링크 전용 물리 제어 채널(UL-DPCCH)은 업링크를 통해 전송되며, UE로부터 파일럿 및 제어 정보를 전달할 수도 있다. UL-DPCCH는 F-DPCH의 프레임 경계로부터
Figure 112009053464195-PCT00003
개의 칩들만큼 지연된다.
3GPP 릴리스 5 및 그 이후 릴리스는 고속 다운링크 패킷 액세스(HSDPA)를 지원한다. 3GPP 릴리스 6 및 그 이후 릴리스는 고속 업링크 패킷 액세스(HSUPA)를 지원한다. HSDPA 및 HSUPA는 각각 다운링크 및 업링크를 통한 고속 패킷 데이터 전송을 가능하게 하는 절차들 및 채널들의 세트들이다. 표1은 3GPP 릴리스 6에서 HSDPA 및 HSUPA에 대해 사용된 일부 물리 채널들의 리스트이다.
Figure 112009053464195-PCT00004
3GPP 릴리스 7은 연속한 패킷 접속(CPC)을 지원하는데, 이는 UE가 DTX 및/또는 불연속 수신(DRX)으로 동작하게 하여, 배터리 전력을 보존하게 한다. DTX의 경우, UE가 노드B로 업링크 전송을 전달할 수 있게 하는 소정의 이네이블된 업링크 서브프레임들이 UE에 할당될 수도 있다. 이네이블된 업링크 서브프레임들은 업링 크 DPCCH 버스트 패턴에 의해 정의될 수도 있다. DRX의 경우, 노드B가 UE로 다운링크 전송을 전달할 수 있게 하는 소정의 이네이블된 다운링크 서브프레임들이 UE에 할당될 수도 있다. 이네이블된 다운링크 서브프레임들은 HS-SCCH 수신 패턴에 의해 정의될 수도 있다. UE는 이네이블된 업링크 서브프레임들에서 시그널링 및/또는 데이터를 전송할 수도 있으며, 이네이블된 다운링크 서브프레임들에서 시그널링 및/또는 데이터를 수신할 수도 있다. UE는 배터리 전력을 보존하기 위해 이네이블된 서브프레임들 사이에서 아이들 시간 동안 전력 다운될 수도 있다. CPC는 2007년 3월자 "Continuous Connectivity for Packet Data Users"라는 명칭의 3GPP TR 25.903에 기재되어 있는데, 이는 공용 가능하다.
도3은 노드B에 의해 F-DPCH를 통한 TPC 명령들의 전송을 도시한다. 노드B는 각각의 슬롯에서 F-DPCH를 통해 10개까지의 UE들에 대해 10개까지의 TPC 명령을 전송할 수도 있다. 이러한 UE들은 F-DPCH 상에서 시간상으로 멀티플렉싱될 수도 있으며, 각각의 UE는 F-DPCH에 대해 상이한 시간 오프셋을 가질 수도 있다. 도3에 도시된 바와 같이, 노드B는 각각의 슬롯의 첫 번째 위치에서 UE 0에 대한 TPC 명령들을 전송하고, 각각의 슬롯의 두 번째 위치에서 UE 1에 대한 TPC 명령들을 전송하며, 이러한 방식으로, 각각의 슬롯의 최종 위치에서 UE 9에 대한 TPC 명령들을 전송할 수도 있다. 노드B는 할당된 시간 오프셋으로 각각의 슬롯에서 F-DPCH를 통해 주어진 UE로 새로운 TPC 명령을 전송할 수도 있다.
도4는 UE에 의한, F-DPCH를 통한 TPC 명령들의 수신을 도시한다. UE는 각각의 슬롯에서 F-DPCH를 통해 TPC 명령들을 수신할 수도 있다. UE에 대한 TPC 명령 은 슬롯의 시작에서 NOFF1 비트들로 시작하는 NTPC 비트들을 이용하여 전송된다. 10개의 슬롯 포맷0 내지 9가 F-DPCH에 대해 지원되며, 도3에 도시된 10개의 상이한 시간 오프셋들에 대응한다. NOFF1은 슬롯 포맷0 내지 9에 대해 0 내지 2304개의 칩들과 동일하다. 각각의 슬롯에서, UE는 F-DPCH 상에서 처음 NOFF1 비트들을 무시하고, 자신의 TPC 명령을 수신하기 위해 다음 NTPC 비트들을 프로세싱하고, 최종 NOFF2 비트들을 무시할 수도 있다. UE 관점에서 보면, TPC 명령은 F-DPCH 슬롯에서 임의의 시간 오프셋을 가질 수도 있다.
도5는 조기 TPC 명령들을 이용하는, UE에 대한 업링크 전력 제어의 예를 도시한다. 노드B는 UE에 할당된 시간 오프셋으로 각각의 슬롯에서 F-DPCH를 통해 UE로 TPC 명령을 전송할 수도 있다. 따라서, TPC 명령은 할당된 시간 오프셋에 따라 슬롯 내에 어디든지 위치할 수도 있다. 도5에 도시된 예에서, 할당된 시간 오프셋은 F-DPCH 상의 슬롯의 시작 부근이다. UE는
Figure 112009053464195-PCT00005
의 전파 지연 이후 F-DPCH를 수신할 수도 있다.
UL-DPCCH는 F-DPCH의 슬롯 경계로부터 1024개의 칩들만큼 지연된다. 수신된 TPC 명령과 UL-DPCCH 상의 슬롯의 시작 사이의 시간량은 UE에 할당된 F-DPCH 시간 오프셋에 의존한다. 도5에 도시된 바와 같이, 만일 F-DPCH을 통해 슬롯 i에서 수신된 TPC 명령과 UL-DPCCH 상의 슬롯 i의 시작 사이에 적어도 512개의 칩들이 존재한다면, 현재 타이밍 관계가 유지된다. 이러한 경우, UE는 F-DPCH을 통해 슬롯 i 에서 수신된 TCP 명령을 UL-DPCCH 상의 동일한 슬롯 i에 적용시킬 수도 있다. 특히, UE는 수신된 TPC 명령에 기초하여 슬롯 i에서 UL-DPCCH의 전송 전력을 조절함으로써 수신된 TPC 명령에 응답할 수도 있다. 더욱이, UE는 수신된 TPC 명령에 기초하여 다운링크의 신호대 잡음 및 간섭비(SIR)를 추정할 수도 있다. 이어, 도5에 도시된 바와 같이, UE는 다운링크 SIR 추정치를 기초로 노드B에 대한 TPC 명령을 생성하여 이러한 TPC 명령을 슬롯 i에서 UL-DPCCH를 통해 전송할 수도 있다.
노드B는 전파 지연 이후 UE로부터 UL-DPCCH를 수신할 수도 있다. 노드B는 슬롯 i에서 UL-DPCCH를 통해 수신된 파일럿에 기초하여 UE에 대한 업링크의 SIR을 추정할 수도 있다. 이어 노드B는 업링크 SIR 추정치를 기초로 UE에 대한 TPC 명령을 생성하여 이러한 TPC 명령을 슬롯 i+1에서 할당된 시간 오프셋으로 F-DPCH를 통해 전송할 수도 있다. 노드B는 또한 이러한 수신된 TPC 명령에 기초하여 슬롯 i+2에서 F-DPCH의 전송 전력을 조절함으로써 슬롯 i에서 UL-DPCCH를 통해 수신된 TPC 명령에 응답할 수도 있다.
도5의 예에서, 업링크 전력 제어 루프는 하나의 슬롯에서 완결된다. 슬롯 i의 F-DPCH를 통해, 노드B에 의해 전송된 TPC 명령은 슬롯 i의 UL-DPCCH를 통해 전송된 파일럿으로 UE에 의해 적용된다. 이러한 파일럿은 슬롯 i+1에서 F-DPCH를 통해 노드B에 의해 전송된 TPC 명령을 생성하기 위해 사용된다.
도6은 늦은 TPC 명령들을 이용한 UE에 대한 업링크 전력 제어의 예를 도시한다. 이러한 예에서, UE에 대해 할당된 시간 오프셋은 F-DPCH 상의 슬롯의 종단 부근이다. UE는 할당된 시간 오프셋으로, 슬롯 i에서 F-DPCH를 통해 TPC 명령을 수 신한다. 도6에 도시된 바와 같이, 이러한 예에서, 슬롯 i에서 F-DPCH를 통해 수신된 TPC 명령은 UL-DPCCH 상의 슬롯 i의 시작 이전의 적어도 512개의 칩들은 아니다. 이러한 경우, UE는 슬롯 i에서 F-DPCH를 통해 수신된 TPC 명령을 UL-DPCCH 상의 다음 슬롯 i+1에 적용시킬 수도 있다. 특히, UE는 수신된 TPC 명령에 기초하여 슬롯 i+1에서 UL-DPCCH의 전송 전력을 조정함으로써 수신된 TPC 명령에 응답할 수도 있다. 도6에 도시된 바와 같이, UE는 또한 수신된 TPC 명령에 기초하여 다운링크 SIR을 추정하고, 다운링크 SIR 추정치를 기초로 TPC 명령을 생성하고, 슬롯 i+1에서 UL-DPCCH를 통해 이러한 TPC 명령을 전송할 수도 있다.
노드B는 UE로부터 UL-DPCCH를 수신하고, 슬롯 i+1에서 UL-DPCCH를 통해 수신된 파일럿에 기초하여 UE에 대한 업링크 SIR을 추정하고, 업링크 SIR 추정에 기초하여 TPC 명령을 생성하고, 슬롯 i+2에서 할당된 시간 오프셋으로 F-DPCH를 통해 이러한 TPC 명령을 전송할 수도 있다. 노드B는 또한 이러한 수신된 TPC 명령에 기초하여 슬롯 i+3에서 F-DPCH의 전송 전력을 조절함으로써 슬롯 i+1에서 UL-DPCCH를 통해 수신된 TPC 명령에 응답할 수도 있다.
도6에 도시된 예에서, 업링크 전력 제어 루프는 두 개의 슬롯들에서 완료된다. 슬롯 i에서 F-DPCH를 통해 노드B에 의해 전송된 TPC 명령은 UE에 의해 슬롯 i+1에서 UL-DPCCH를 통해 전송된 파일럿에 적용된다. 이러한 파일럿은 슬롯 i+2에서 F-DPCH를 통해 노드B에 의해 전송된 TPC 명령을 생성하기 위해 사용된다.
도5 및 6은 각각 조기 TPC 명령 및 늦은 TPC 명령을 이용한 업링크 전력 제어의 예를 도시한다. 도6에 도시된 바와 같이, 음영 영역(610) 내의 임의의 위치 에서 수신된 TPC 명령은 슬롯 i+1에서 UL-DPCCH에 적용될 수도 있다. 만일 F-DPCH의 슬롯 i+1에 속하는, 음영 영역(610)의 일부인 영역(612) 내에 TPC 명령이 위치되면, TPC 명령은 UL-DPCCH의 동일한 슬롯 i+1에 적용된다. 만일 F-DPCH의 슬롯 i에 속하는 음영 영역(610)의 일부인 영역(614) 내에 TPC 명령이 위치되면, TPC 명령은 UL-DPCCH의 다음 슬롯 i+1에서 적용된다. 조기 TPC 명령들은 영역(612) 내에서 수신된 TPC 명령들이며, 동일한 슬롯에서 UL-DPCCH에 적용될 수 있다. 늦은 TPC 명령들은 영역(614) 내에서 수신된 명령들이며, 다음 슬롯에서 UL-DPCCH에 적용될 수 있다.
도7은 조기 TPC 명령들을 이용하여 DTX 동작 동안 UE에 대한 업링크 전력 제어의 예를 도시한다. 이러한 예에서, UE는 6개의 슬롯 i 내지 i+5 동안에는 UL-DPCCH를 통해 전송하고, 다음 6개의 슬롯 i+6 내지 i+11 동안에는 업링크를 통해 전송하지 않으며, 다음 6개의 슬롯 i+12 내지 i+17 동안에는 UL-DPCCH를 통해 전송하는 식으로 전송한다. 일반적으로, UE가 UL-DPCCH를 통해 전송하는 이네이블된 업링크 슬롯들의 수(도7에 도시된 예에서는 6)는 설정 가능할 수도 있다. 이네이블된 업링크 슬롯들(도7에 도시된 예에서는 12개의 슬롯들)의 연속한 버스트들 사이의 시간 간격 또한 설정 가능할 수도 있다.
도7에 도시된 예에서, 도5에 도시된 바와 같이 UE에 대한 TCP 명령들이 각각의 슬롯의 시작 부근에서 F-DPCH를 통해 전송되며, UL-DPCCH 상의 동일한 슬롯의 시작 이전의 적어도 512개의 칩들이다. 따라서, UE는 슬롯 i+1에서 F-DPCH를 통해 수신된 TPC 명령을 동일한 슬롯 i+1에서 UL-DPCCH를 통한 업링크 전송에 적용시킬 수도 있다. 슬롯 i+5에서 UL-DPCCH를 통해 전송된 파일럿은 슬롯 i+6에서 F-DPCH를 통해 전송된 TPC 명령을 생성하기 위해 사용된다. 그러나 UE는 슬롯 i+6에서 업링크를 통해 전송하지 않기 때문에, UE는 슬롯 i+6에서 F-DPCH를 통해 수신된 TPC 명령을 저장할 수도 있다. 전송 재개 시, UE는 이러한 저장된 TPC 명령을 슬롯 i+12에서 UL-DPCCH를 통한 업링크 전송에 적용시킬 수도 있다.
도7에 도시된 예에서, 각각의 전송 버스트의 종단에, 전송 버스트에 직접적으로 적용되지 않는 하나의 TPC 명령이 존재한다. 이러한 TPC 명령은 저장되어 다음 전송 버스트의 첫 번째 슬롯에 적용될 수도 있다.
도6에 도시된 바와 같이, 슬롯 i에서 F-DPCH를 통해 수신된 TPC 명령이 슬롯 i+1에서 UL-DPCCH에 적용될 때, 추가 지연은 전송 버스트의 종단에 전송 버스트에 직접적으로 적용되지 않는 두 개의 TPC 명령을 유발할 수도 있다. 다음 전송 버스트에 대해 이러한 TPC 명령들 모두를 이용하는 것이 바람직할 수도 있다.
도8A는 늦은 TPC 명령들을 이용한, DTX 동작 동안 UE에 대한 업링크 전력 제어의 설계를 도시한다. 이러한 예에서, UE에 대한 TPC 명령들은 각각의 슬롯의 종단 부근에서 F-DPCH를 통해 전송된다. 따라서, 도6에 도시된 바와 같이, UE는 슬롯 i+1에서 F-DPCH를 통해 수신된 TPC 명령을 다음 슬롯 i+2에서 UL-DPCCH를 통한 업링크 전송에 적용시킬 수도 있다.
도8A의 제1 전송 버스트의 시작시, 슬롯 i에서 UL-DPCCH를 통해 전송된 파일럿이 슬롯 i+1에서 F-DPCH를 통해 전송된 TPC 명령을 생성하기 위해 사용된다. 이러한 TPC 명령은 슬롯 i+2에서 UL-DPCCH를 통해 송신된 업링크 전송에 적용된다. 슬롯 i+2 내지 i+4에서 F-DPCH를 통해 전송된 TPC 명령들은 각각 슬롯 i+3 내지 i+5에서 UL-DPCCH를 통해 송신된 업링크 전송들에 유사하게 적용된다. UE가 슬롯 i+6 및 i+7에서 업링크를 통해 전송하지 않기 때문에, UE는 슬롯 i+5 및 i+6에서 F-DPCH를 통해 수신된 두 개의 TPC 명령들을 저장할 수도 있다.
도8A에 도시된 설계에서, 전송 재개 시, UE는 처음 두 개의 슬롯들에 저장된 TPC 명령들을 연속적으로 적용한다. 특히, UE는 슬롯 i+5에서 F-DPCH를 통해 수신된 TPC 명령을 슬롯 i+12에서 UL-DPCCH를 통해 송신된 업링크 전송에 적용한다. UE는 슬롯 i+6에서 F-DPCH를 통해 수신된 TPC 명령을 슬롯 i+13에서 UL-DPCCH를 통해 송신된 업링크 전송에 적용한다.
다른 설계에서, UE는 슬롯 i+6에서 F-DPCH를 통해 수신된 TPC 명령을 슬롯 i+12에서 UL-DPCCH를 통해 송신된 업링크 전송에 적용한다. UE는 슬롯 i+5에서 F-DPCH를 통해 수신된 TPC 명령을 슬롯 i+13에서 UL-DPCCH를 통해 송신된 업링크 전송에 적용한다. 이러한 순서는 도8A에 도시된 순서와 반대가 된다.
또 다른 설계에서, UE는 슬롯 i+5 또는 i+6에서 F-DPCH를 통해 수신된 UP TPC 명령(존재한다면)을 슬롯 i+12에서 UL-DPCCH를 통해 송신된 업링크 전송에 적용한다. UE는 슬롯 i+13에서 UL-DPCCH를 통해 송신된 업링크 전송에 다른 TPC 명령을 적용한다. 이러한 설계는 UE로 하여금 다음 전송 버스트에서 자신의 전송 전력을 조기에 증가시키게 하며, 이는 성능을 향상시킬 수도 있다.
UE는 또한 다른 방식으로 두 개의 저장된 TPC 명령들을 다음 전송 버스트의 처음 두 개의 슬롯들에 적용할 수도 있다.
도8B는 늦은 TPC 명령들을 이용하여 DTX 동작 동안 UE에 대한 업링크 전력 제어를 적용하는 다른 설계를 도시한다. 이러한 예에서, 도8A에 도시된 바와 같이, UE에 대한 TPC 명령들은 각각의 슬롯의 종단 부근에서 F-DPCH를 통해 전송되며, UE는 슬롯 i+5 및 i+6에서 F-DPCH를 통해 수신된 최종 두 개의 TPC 명령들을 저장한다. 이러한 설계에서, UE는 두 개의 저장된 TPC 명령들을 다음 전송 버스트의 처음 두 개의 슬롯들 각각에 적용한다. 이는 다양한 방식으로 달성될 수도 있다.
일 설계에서, UE는 두 개의 저장된 TPC 명령들의 값을 누적하여 결합된 값을 얻는다. UE는 통상적으로 UP TPC 명령의 경우 미리 결정된 양(Δ) 만큼 자신의 전송 전력을 증가시키고, DOWN TPC 명령의 경우 미리 결정된 양(Δ) 만큼 자신의 전송 전력을 감소시킬 수도 있다. UE는 아래와 같이 두 개의 저장된 TPC 명령들에 대해 결합된 값(
Figure 112009053464195-PCT00006
)을 결정할 수도 있다:
Figure 112009053464195-PCT00007
UE는 다음 전송 버스트의 처음 두 개의 슬롯 i+12 및 i+13 각각에서 결합된 값(
Figure 112009053464195-PCT00008
)만큼 자신의 전송 전력을 조절할 수도 있다.
다른 설계에서, 식(1)에 도시된 바와 같이, UE는 우선 두 개의 저장된 TPC 명령들의 값을 누적시킨다. 이어 UE는 결합된 값을 아래와 같이 제한 또는 한정한 다:
Figure 112009053464195-PCT00009
식(2)
UE는 다음 전송 버스트의 처음 두 개의 슬롯 i+12 및 i+13 각각에서 한정된 값(
Figure 112009053464195-PCT00010
)만큼 자신의 전송 전력을 조절할 수도 있다.
또 다른 설계에서, 두 개의 저장된 TPC 명령들 중 하나의 TPC 명령이 폐기(drop)될 때, UE는 다른 하나의 TPC 명령을 사용한다. 저장된 TPC 명령은 다양한 기준에 기초하여, 예를 들어, TPC 명령에 대해 수신된 값이 검출 임계치 미만인 경우 폐기될 수도 있다. UE는 다음 전송 버스트의 처음 두 개의 슬롯들 i+12 및 i+13 각각에서 폐기되지 않은 저장된 TPC 명령에 기초하여 자신의 전송 전력을 조절할 수도 있다.
또 다른 설계에서, UE는 두 개의 저장된 TPC 명령들 중 하나를 사용한다. 일 방식에서, UE는 최종 저장된 TPC 명령(예를 들어, 슬롯 i+6에서 수신됨)을 사용할 수도 있고, 보다 앞서 저장된 TPC 명령(예를 들어, 슬롯 i+5에서 수신됨)을 폐기할 수도 있다. 다른 방식에서, UE는 더욱 신뢰가능한(예를 들어, 더 높은 수신 값을 갖는) 저장된 TPC 명령을 사용할 수도 있고, 다른 저장된 TPC 명령을 폐기할 수도 있다. UE는 또한 다른 기준에 기초하여 하나의 저장된 TPC 명령을 선택할 수도 있다. 어떤 경우든, UE는 다음 전송 버스트의 처음 두 개의 슬롯 i+12 및 i+13 각각에서 선택된 TPC 명령에 기초하여 자신의 전송 전력을 조절할 수도 있다.
또 다른 설계에서, 예를 들어, 만일 저장된 두 TPC 명령 모두 신뢰할 수 없는 것으로 간주되면, UE는 저장된 두 TPC 명령 모두를 폐기할 수도 있다. UE는 다음 전송 버스트의 처음 두 개의 슬롯 i+12 및 i+13 각각에 대해 슬롯 i+5에서 사용된 전송 전력을 적용할 수도 있다. 따라서, UE는 전송 갭(gap) 이전과 동일한 전력 레벨로 전송을 재개할 수도 있다.
하나 이상의 명령들이 노드B에서 유효한 업링크 SIR 측정에 기초하여 생성되기 때문에, 설명된 기술들은 유효한 하나 이상의 TPC 명령들의 사용을 허용한다. 용량을 낭비할 수도 있는, 전송 버스트에서의 최종 두 개의 TPC 명령들의 폐기 대신, 기술들은 전송이 재개될 때 이러한 두 개의 TPC 명령들을 효율적으로 사용한다.
도9는 업링크 전력 제어를 위해 UE에 의해 실행되는 프로세스(900)의 설계를 도시한다. UE는 제1 전송 버스트 동안 다수의 TPC 명령들을 수신(블록 912)할 수도 있다. UE는 다수의 TPC 명령들 중 적어도 하나에 기초하여 제1 전송 버스트 동안 송신되는 전송의 전송 전력을 조절(블록 914)할 수도 있다. UE는 다수의 TPC 명령들 중 적어도 두 개의 최종 TPC 명령에 기초하여 제2 전송 버스트 동안 송신되는 전송의 전송 전력을 조절(블록 916)할 수도 있다. 제2 전송 버스트는 DTX 기간에 의해 제1 전송 버스트와 분리될 수도 있다. 블록(916)의 경우, UE는 제1 전송 버스트 동안 수신된 적어도 두 개의 최종 TPC 명령들에 기초하여 제2 전송의 앞 부분에 대한 전송 전력을 조절할 수도 있으며, 제2 전송 버스트 동안 수신된 TPC 명령에 기초하여 제2 전송 버스트의 나머지 부분에 대한 전송 전력을 조절할 수도 있 다.
블록(916)의 일 설계에서, UE는 제1 전송 버스트 동안 수신된 최종 두 개의 TPC 명령 중 하나(예를 들어, 두 번째 최종 명령 또는 UP TPC 명령)에 기초하여 제2 전송 버스트의 처음 두 개의 슬롯 중 하나(예를 들어, 첫 번째 슬롯)에 대한 전송 전력을 조절할 수도 있다. UE는 제1 전송 버스트 동안 수신된 최종 두 개의 TPC 명령 중 다른 하나(예를 들어, 최종 TPC 명령)에 기초하여 제2 전송 버스트의 처음 두 개의 슬롯들 중 다른 하나(예를 들어, 두 번째 슬롯)에 대한 전송 전력을 조절할 수도 있다.
블록(916)의 다른 설계에서, UE는 제1 전송 버스트 동안 수신된 최종 두 개의 TPC 명령들에 기초하여 결합된 값을 얻을 수도 있으며, 결합된 값에 기초하여 제2 전송 버스트의 처음 두 개의 슬롯들에 대한 전송 전력을 조절할 수도 있다. 또 다른 설계에서, UE는 미리 결정된 범위 내로 결합된 값을 제한함으로써 한정된 값을 얻을 수도 있으며, 한정된 값에 기초하여 제2 전송 버스트의 처음 두 개의 슬롯들에 대한 전송 전력을 조절할 수도 있다.
또 다른 설계에서, UE는 제1 전송 버스트 동안 수신된 최종 두 개의 TPC 명령 중 하나를 선택할 수도 있으며, 선택된 TPC 명령에 기초하여 제2 전송 버스트의 적어도 하나의 슬롯에 대한 전송 전력을 조절할 수도 있다. 또 다른 설계에서, UE는 제1 전송 버스트 동안 수신된 최종 두 개의 TPC 명령 중 가장 신뢰가능한 TPC 명령을 선택할 수도 있으며, 선택된 TPC 명령에 기초하여 제2 전송 버스트의 적어도 하나의 슬롯에 대한 전송 전력을 조절할 수도 있다. 또 다른 설계에서, UE는 제1 전송 버스트 동안 수신된 최종 TPC 명령을 선택할 수도 있으며, 최종 TPC 명령에 기초하여 제2 전송 버스트의 처음 두 개의 슬롯에 대한 전송 전력을 조절할 수도 있다. UE는 또한 제1 전송 버스트 동안 수신된 적어도 두 개의 최종 TPC 명령에 기초하여 다른 방식으로 제2 전송 버스트에 대한 전송 전력을 조절할 수도 있다.
UE는 F-DPCH를 통해 제1 및 제2 전송 버스트 동안 다수의 TPC 명령을 수신할 수도 있고, UL-DPCCH를 통해 전송을 송신할 수도 있다. UE는 또한 다른 다운링크 채널들을 통해 TPC 명령들을 수신할 수도 있고 다른 업링크 채널들을 통해 전송을 송신할 수도 있다. UE는 다수의 가능한 시간 오프셋들 중 하나로 다수의 슬롯에서 다수의 TPC 명령을 수신할 수도 있다. UE는 최종 두 개의 TPC 명령이 시간 오프셋들의 제1 범위 내에서(예를 들어, 도6의 영역(614) 내에서) 수신된다면, 최종 두 개의 TPC 명령에 기초하여 제2 전송 버스트 동안 전송 전력을 조절할 수도 있으며, 최종 TPC 명령이 시간 오프셋들의 제2 범위 내에서(예를 들어, 도6의 영역(612) 내에서) 수신된다면, 최종 TPC 명령에 기초하여 제2 전송 버스트 동안 전송 전력을 조절할 수도 있다.
노드B는 UE로 송신된 다운링크 전송의 전송 전력을 조절하기 위해 다운링크 전력 제어를 위한 프로세스(900)를 실행할 수도 있다.
도10은 업링크 전력 제어를 위해 노드B에 의해 실행되는 프로세스(1000)의 설계를 도시한다. 노드B는 제1 전송 버스트 동안 다수의 TPC 명령들을 전송(블록 1012)할 수도 있다. 노드B는 다수의 TPC 명령 중 적어도 하나에 기초하여 조절된 전송 전력으로 제1 전송 버스트 동안 송신된 전송을 수신(블록 1014)할 수도 있다. 노드B는 다수의 TPC 명령 중 적어도 두 개의 최종 TPC 명령에 기초하여 조절된 전송 전력으로 제2 전송 버스트 동안 송신된 전송을 수신(블록 1016)할 수도 있다. 제2 전송 버스트는 DTX 기간에 의해 제1 전송 버스트와 분리될 수도 있다. 노드B는 제1 전송 버스트 동안 수신된 전송에 기초하여 SIR을 추정할 수도 있으며, 추정된 SIR에 기초하여 다수의 TPC 명령들을 생성할 수도 있다.
도11은 도1의 UE들 중 하나일 수도 있는 UE(120)의 설계를 도시한 블록도이다. 업링크의 경우, 인코더(1112)는 업링크를 통해 UE(120)에 의해 전송될 데이터 및 시그널링을 수신할 수도 있다. 인코더(1112)는 데이터 및 시그널링을 프로세싱(예를 들어, 포맷팅, 인코딩, 및 인터리빙)할 수도 있다. 변조기(Mod)(1114)는 인코딩된 데이터 및 시그널링을 추가로 프로세싱(예를 들어, 변조, 채널화 및 스크램블링)하여 출력 칩들을 제공할 수도 있다. 송신기(TMTR)(1122)는 출력 칩들을 조절(예를 들어, 아날로그로 변환, 필터링, 증폭, 및 주파수 상향변환)할 수도 있고 안테나(1124)를 통해 노드B(110)로 전송될 수도 있는 업링크 신호를 생성할 수도 있다.
다운링크의 경우, 안테나(1124)는 노드B(110) 및 다른 노드B들에 의해 전송된 다운링크 신호들을 수신할 수도 있다. 수신기(RCVR)(1126)는 안테나(1124)로부터 수신된 신호를 조절(예를 들어, 필터링, 증폭, 주파수 하향변환 및 디지털화)하고 샘플들을 제공할 수도 있다. 복조기(Demod)(1116)는 샘플들을 프로세싱(예를 들어, 디스크램블링, 채널화 및 복조)하고, 심볼 추정치들을 제공할 수도 있다. 디코더(1118)는 심볼 추정치들을 추가로 프로세싱(예를 들어, 디인터리빙 및 디코딩)하고 디코딩된 데이터 및 시그널링을 제공할 수도 있다. 다운링크 시그널링은 TPC 명령들 등을 포함할 수도 있다. 인코더(1112), 변조기(1114), 복조기(1116), 및 디코더(1118)는 모뎀 프로세서(1110)에 의해 구현될 수도 있다. 이러한 유닛들은 시스템에 의해 사용된 무선 기술(예를 들어, W-CDMA, GSM 등)에 따라 프로세싱을 실행할 수도 있다.
제어기/프로세서(1130)는 UE(120)의 다양한 유닛들의 동작을 지시한다. 제어기/프로세서(1130)는 도9의 프로세스(900) 및/또는 설명된 기술들에 대한 다른 프로세스들을 구현할 수도 있다. 메모리(1132)는 UE(120)에 대한 프로그램 코드 및 데이터를 저장할 수도 있다.
도11은 또한 도1의 노드B들 중 하나일 수도 있는 노드B(110)의 블록도를 도시한다. 노드B(110) 내에서, 송신기/수신기(1138)는 UE(120) 및 다른 UE들과의 무선 통신을 지원할 수도 있다. 프로세서/제어기(1140)는 UE들과의 통신을 위한 다양한 기능을 실행할 수도 있고 도10의 프로세스 및/또는 설명된 기술들에 대한 다른 프로세스들을 실행할 수도 있다. 메모리(1142)는 노드B(110)에 대한 프로그램 코드들 및 데이터를 저장할 수도 있다.
기술 분야의 당업자는 정보 및 신호들이 소정의 다양한 상이한 기술들을 이용하여 표현될 수도 있음을 이해할 것이다. 예를 들어, 전술한 설명을 통해 참조될 수도 있는 데이터, 명령들, 지시어들, 정보, 신호들, 비트들, 심볼들 및 칩들은 전압들, 전류들, 전자기파들, 자기장들 또는 입자들, 광학계들 또는 입자들 또는 소정의 이들의 결합으로 표현될 수도 있다.
당업자는 다양하게 개시된 로직 블럭들, 모듈들, 회로들, 및 개시된 특징들과 관련한 알고리즘 단계들이 전자적인 하드웨어, 컴퓨터 소프트웨어 또는 이 둘의 결합으로 구현될 수 있음을 이해할 것이다. 하드웨어 및 소프트웨어의 이러한 상호 호환성을 명확하게 설명하기 위해, 다양하게 설명된 컴포넌트들, 블록들, 모듈들, 회로들 및 단계들이 이들의 기능과 관련하여 전술되었다. 이러한 기능이 하드웨어 또는 소프트웨어로서 구현될 지의 여부는 전체 시스템에 부가된 특정 애플리케이션 및 설계 제한에 의존한다. 당업자는 개시된 기능을 각각의 특정 애플리케이션을 위해 다양한 방식으로 구현할 수도 있지만, 이러한 구현 결정은 본 발명의 사상을 벗어나는 것으로 해석되지 않는다.
다양하게 개시된 로직 블럭들, 모듈들, 및 개시된 특징과 관련된 회로들은 범용 프로세서, 디지털 신호 프로세서(DSP), 주문형 집적 회로(ASIC), 필드 프로그램 가능한 게이트 어레이(FPGA) 또는 다른 프로그램 가능한 논리 회로, 이산 게이트 또는 트랜지스터 로직, 이산 하드웨어 컴포넌트, 또는 개시된 기능을 구현하기 위해 설계된 이들의 결합을 포함할 수도 있다. 범용 프로세서는 마이크로프로세서일 수 있지만, 대안적으로, 프로세서는 소정의 통상적인 프로세서, 제어기, 마이크로 제어기 또는 상태 머신일 수 있다. 프로세서는 또한 계산 장치들의 결합, 예를 들어, DSP 및 마이크로프로세서의 결합, 다수의 마이크로프로세서, DSP 코어와 결합한 하나 이상의 마이크로프로세서 또는 소정의 다른 이러한 구성으로 구현될 수도 있다.
개시된 특징들과 관련하여 설명된 방법 또는 알고리즘의 단계들은 하드웨어, 프로세서에 의해 실행된 소프트웨어 모듈 또는 이 둘의 결합으로 직접 실시될 수도 있다. 소프트웨어 모듈은 RAM 메모리, 플래시 메모리, ROM 메모리, EPROM 메모리, EEPROM 메모리, 레지스터들, 하드디스크, 이동형 디스크, CD-ROM, 또는 기술 분야에 알려진 소정의 다른 형태의 저장 매체에 상주할 수도 있다. 예로든 저장 매체는 프로세서가 저장 매체와 정보를 기록 및 판독할 수 있도록 프로세서에 결합될 수도 있다. 대안적으로, 저장 매체는 프로세서에 통합될 수도 있다. 프로세서 및 저장 매체는 ASIC에 상주할 수도 있다. ASIC는 사용자 단말에 상주할 수도 있다. 대안적으로, 프로세서 및 저장 매체는 사용자 단말에서 개별 컴포넌트로서 상주할 수도 있다.
하나 이상의 실시예에서, 개시된 기능들은 하드웨어, 소프트웨어, 펌웨어, 또는 이들의 결합으로 구현될 수도 있다. 소프트웨어에서 구현될 경우, 기능들은 컴퓨터 판독 가능 매체에 저장되거나 하나 이상의 명령들 또는 코드를 통해 전달될 수도 있다. 컴퓨터 판독 가능 매체는 일 장소에서 다른 장소로 컴퓨터 프로그램의 전달을 용이하게 하는 컴퓨터 저장 매체 및 매체들 모두를 포함한다. 저장 매체는 범용 또는 특수 목적 컴퓨터에 의해 액세스될 수 있는 소정의 이용가능한 매체일 수도 있다. 예로써, 제한되지 않지만, 이러한 컴퓨터 판독 가능 매체는 RAM, ROM, EEPROM, CD-ROM 또는 다른 광학 디스크 저장소, 마그네틱 디스크 저장소 또는 다른 마그네틱 저장소 장치들, 또는 명령 또는 데이터 구조의 형태로 원하는 프로그램 코드를 전달 또는 저장하기 위해 사용될 수 있고, 범용 또는 특수 목적 컴퓨터, 또 는 범용 또는 특수 목적 프로세서에 의해 액세스될 수 있는 소정의 다른 매체를 포함할 수 있다. 또한 소정의 접속부는 컴퓨터 판독 가능 매체로 부르는 것이 적절하다. 예를 들어, 만일 소프트웨어가 웹사이트, 서버, 또는 동축 케이블을 이용하는 다른 원격 소스, 광섬유 케이블, 꼬임 쌍선, 디지털 가입자 회선(DSL), 또는 적외선, 무선, 및 마이크로파와 같은 무선 기술로부터 전송되면, 동축 케이블, 광섬유 케이블, 꼬임 쌍선, DSL 또는 적외선, 무선, 및 마이크로파와 같은 무선 기술은 매체의 정의에 포함된다. 디스크(disk 및 disc)는 컴팩트 디스크(CD), 레이저 디스크, 광디스크, DVD, 플로피디스크 및 블루레이 디스크를 포함하는데, 여기서 디스크(disk)들은 통상적으로 데이터를 자기적으로 재생하는 반면, 디스크(disc)들은 레이저를 이용하여 광학적으로 데이터를 재생한다. 전술한 결합은 컴퓨터 판독 가능 매체의 범위에 또한 포함된다.
앞서 설명된 실시예는 당업자가 본 발명을 실시할 수 있도록 제공된다. 이러한 실시예에 대한 다양한 변경이 기술 분야의 당업자에게 명백하며, 정의된 일반 원칙은 본 발명의 사상을 벗어나지 않고 다른 실시예에 적용가능하다. 따라서, 본 발명은 설명된 실시예에 한정되지 않으며 설명된 원칙과 새로운 특징에 부합하는 광의의 사상과 조화된다.

Claims (32)

  1. 제1 전송 버스트 동안 다수의 전송 전력 제어(TPC) 명령들을 수신하고, 상기 다수의 TPC 명령들 중 적어도 하나에 기초하여 상기 제1 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하고, 상기 다수의 TPC 명령들 중 적어도 두 개의 최종 TPC 명령들에 기초하여 제2 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하도록 구성되는 적어도 하나의 프로세서; 및
    상기 적어도 하나의 프로세서에 연결되는 메모리를 포함하며, 상기 제2 전송 버스트는 불연속한 전송(DTX) 기간에 의해 상기 제1 전송 버스트와 분리되는,
    무선 통신용 장치.
  2. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 적어도 두 개의 최종 TPC 명령들에 기초하여 상기 제2 전송 버스트의 앞 부분(early portion) 동안 송신되는 전송의 전송 전력을 조절하고, 상기 제2 전송 버스트 동안 수신되는 TPC 명령들에 기초하여 상기 제2 전송 버스트의 나머지 부분 동안 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  3. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들 중 하나에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들 중 하나에서 송신되는 전송의 전송 전력을 조절하고, 상기 제1 전송 버스트 동안 수신되는 상기 최종 두 개의 TPC 명령들 중 다른 하나에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들 중 다른 하나에서 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  4. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 최종 TPC 명령에서 두 번째 최종(second to last) TPC 명령에 기초하여 상기 제2 전송 버스트의 첫 번째 슬롯에서 송신되는 전송의 전송 전력을 조절하고, 상기 제1 전송 버스트 동안 수신되는 최종 TPC 명령에 기초하여 상기 제2 전송 버스트의 두 번째 슬롯에서 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  5. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들 중, 존재한다면, UP TPC 명령에 기초하여 상기 제2 전송 버스트의 제1 슬롯에서 송신되는 전송의 전송 전력을 조절하고, 상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들 중 다른 하나에 기초하여 상기 제2 전송 버스트의 두 번째 슬롯에서 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  6. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들에 기초하여 결합된 값을 획득하고, 상기 결합된 값에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들에서 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  7. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령에 기초하여 결합된 값을 획득하고, 한정된 값(capped value)을 획득하기 위해 미리 결정된 범위 내로 상기 결합된 값을 제한하고, 상기 한정된 값에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들에서 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  8. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 적어도 두 개의 최종 TPC 명령들 중 하나를 선택하고, 상기 선택된 TPC 명령에 기초하여 상기 제2 전송 버스트의 적어도 하나의 슬롯에서 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  9. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 적어도 두 개의 최종 TPC 명령들 중 가장 신뢰가능한 TPC 명령을 선택하고, 상기 선택된 TPC 명령에 기초하여 상기 제2 전송 버스트의 적어도 하나의 슬롯에서 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  10. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 상기 제1 전송 버스트 동안 수신되는 최종 TPC 명령을 선택하고, 상기 최종 TPC 명령에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들에서 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  11. 제1항에 있어서,
    상기 적어도 하나의 프로세서는, 다수의 가능한 시간 오프셋들 중 하나로 다수의 슬롯에서 상기 다수의 TPC 명령들을 수신하도록 구성되는, 무선 통신용 장치.
  12. 제11항에 있어서,
    상기 적어도 하나의 프로세서는, 시간 오프셋들의 제1 범위 내에서 수신된다면, 두 개의 최종 TPC 명령들에 기초하여 상기 제2 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하고, 시간 오프셋들의 제2 범위 내에서 수신된다면, 최종 TPC 명령에 기초하여 상기 제2 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하도록 구성되는, 무선 통신용 장치.
  13. 제1항에 있어서,
    상기 적어도 하나의 프로세서는 단편화된 전용 물리 채널(F-DPCH)을 통해 상기 다수의 TPC 명령들을 수신하고, 상기 제1 및 제2 전송 버스트들 동안 업링크 전용 물리 제어 채널(UL-DPCCH)을 통해 전송을 송신하도록 구성되는, 무선 통신용 장치.
  14. 제1 전송 버스트 동안 다수의 전송 전력 제어(TPC) 명령들을 수신하는 단계;
    상기 다수의 TPC 명령들 중 적어도 하나에 기초하여 상기 제1 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하는 단계; 및
    상기 다수의 TPC 명령들 중 적어도 두 개의 최종 TPC 명령들에 기초하여 제2 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하는 단계를 포함하며,
    상기 제2 전송 버스트는 불연속한 전송(DTX) 기간에 의해 상기 제1 전송 버스트와 분리되는,
    무선 통신용 방법.
  15. 제14항에 있어서, 상기 제2 전송 동안 송신되는 전송의 전송 전력을 조절하는 단계는,
    상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들 중 하나에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들 중 하나에서 송신되는 전송의 전송 전력을 조절하는 단계;
    상기 제1 전송 버스트 동안 수신되는 상기 최종 두 개의 TPC 명령들 중 다른 하나에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들 중 다른 하나에서 송신되는 전송의 전송 전력을 조절하는 단계를 포함하는, 무선 통신용 방법.
  16. 제14항에 있어서, 상기 제2 전송 동안 송신되는 전송의 전송 전력을 조절하는 단계는,
    상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들에 기초하여 결합된 값을 획득하는 단계; 및
    상기 결합된 값에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들에서 송신되는 전송의 전송 전력을 조절하는 단계를 포함하는, 무선 통신용 방법.
  17. 제14항에 있어서, 상기 제2 전송 동안 송신되는 전송의 전송 전력을 조절하는 단계는,
    상기 제1 전송 버스트 동안 수신되는 적어도 두 개의 최종 TPC 명령들 중 하나를 선택하는 단계; 및
    상기 선택된 TPC 명령에 기초하여 상기 제2 전송 버스트의 적어도 하나의 슬롯에서 송신되는 전송의 전송 전력을 조절하는 단계를 포함하는,
    무선 통신용 방법.
  18. 제14항에 있어서,
    상기 다수의 TPC 명령들을 수신하는 단계는, 단편화된 전용 물리 채널(F-DPCH)을 통해 상기 다수의 TPC 명령들을 수신하는 단계를 포함하며,
    상기 방법은, 상기 제1 및 제2 전송 버스트들 동안 업링크 전용 물리 제어 채널(UL-DPCCH)을 통해 전송을 송신하는 단계를 더 포함하는, 무선 통신용 방법.
  19. 제1 전송 버스트 동안 다수의 전송 전력 제어(TPC) 명령들을 수신하기 위한 수단;
    상기 다수의 TPC 명령들 중 적어도 하나에 기초하여 상기 제1 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하기 위한 수단; 및
    상기 다수의 TPC 명령들 중 적어도 두 개의 최종 TPC 명령들에 기초하여 제2 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하기 위한 수단을 포함하며,
    상기 제2 전송 버스트는 불연속한 전송(DTX) 기간에 의해 상기 제1 전송 버스트와 분리되는,
    무선 통신용 장치.
  20. 제19항에 있어서, 상기 제2 전송 동안 송신되는 전송의 전송 전력을 조절하기 위한 수단은,
    상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들 중 하나에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들 중 하나에서 송신되는 전송의 전송 전력을 조절하기 위한 수단; 및
    상기 제1 전송 버스트 동안 수신되는 상기 최종 두 개의 TPC 명령들 중 다른 하나에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들 중 다른 하나에서 송신되는 전송의 전송 전력을 조절하기 위한 수단을 포함하는, 무선 통신용 장치.
  21. 제19항에 있어서, 상기 제2 전송 동안 송신되는 전송의 전송 전력을 조절하기 위한 수단은,
    상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령에 기초하여 결합된 값을 획득하기 위한 수단; 및
    상기 결합된 값에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들에서 송신되는 전송의 전송 전력을 조절하기 위한 수단을 포함하는, 무선 통신용 장치.
  22. 제19항에 있어서, 상기 제2 전송 동안 송신되는 전송의 전송 전력을 조절하기 위한 수단은,
    상기 제1 전송 버스트 동안 수신되는 적어도 두 개의 최종 TPC 명령들 중 하나를 선택하기 위한 수단; 및
    상기 선택된 TPC 명령에 기초하여 상기 제2 전송 버스트의 적어도 하나의 슬 롯에서 송신되는 전송의 전송 전력을 조절하기 위한 수단을 포함하는, 무선 통신용 장치.
  23. 제19항에 있어서,
    상기 다수의 TPC 명령들을 수신하기 위한 수단은, 단편화된 전용 물리 채널(F-DPCH)을 통해 상기 다수의 TPC 명령들을 수신하기 위한 수단을 포함하며,
    상기 장치는, 상기 제1 및 제2 전송 버스트들 동안 업링크 전용 물리 제어 채널(UL-DPCCH)을 통해 전송을 송신하기 위한 수단을 더 포함하는, 무선 통신용 장치.
  24. 컴퓨터 프로그램 제품으로서,
    적어도 하나의 컴퓨터로 하여금 제1 전송 버스트 동안 다수의 전송 전력 제어(TPC) 명령들을 수신하게 하는 코드;
    상기 적어도 하나의 컴퓨터로 하여금 상기 다수의 TPC 명령들 중 적어도 하나에 기초하여 상기 제1 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하게 하는 코드; 및
    상기 적어도 하나의 컴퓨터로 하여금 상기 다수의 TPC 명령들 중 적어도 두 개의 최종 TPC 명령들에 기초하여 제2 전송 버스트 동안 송신되는 전송의 전송 전력을 조절하게 하는 코드를 포함하는, 컴퓨터 판독 가능 매체를 포함하며,
    상기 제2 전송 버스트는 불연속한 전송(DTX) 기간에 의해 상기 제1 전송 버 스트와 분리되는, 컴퓨터 프로그램 제품.
  25. 제24항에 있어서, 상기 컴퓨터 판독 가능 매체는,
    상기 적어도 하나의 컴퓨터로 하여금 상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들 중 하나에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들 중 하나에서 송신되는 전송의 전송 전력을 조절하게 하는 코드; 및
    상기 적어도 하나의 컴퓨터로 하여금 상기 제1 전송 버스트 동안 수신되는 상기 최종 두 개의 TPC 명령들 중 다른 하나에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들 중 다른 하나에서 송신되는 전송의 전송 전력을 조절하게 하는 코드를 더 포함하는, 컴퓨터 프로그램 제품.
  26. 제24항에 있어서, 상기 컴퓨터 판독 가능 매체는,
    상기 적어도 하나의 컴퓨터로 하여금 상기 제1 전송 버스트 동안 수신되는 최종 두 개의 TPC 명령들에 기초하여 결합된 값을 획득하게 하는 코드; 및
    상기 적어도 하나의 컴퓨터로 하여금 상기 결합된 값에 기초하여 상기 제2 전송 버스트의 처음 두 개의 슬롯들에서 송신되는 전송의 전송 전력을 조절하게 하는 코드를 포함하는, 컴퓨터 프로그램 제품.
  27. 제24항에 있어서, 상기 컴퓨터 판독 가능 매체는,
    상기 적어도 하나의 컴퓨터로 하여금 상기 제1 전송 버스트 동안 수신되는 적어도 두 개의 최종 TPC 명령들 중 하나를 선택하게 하는 코드; 및
    상기 적어도 하나의 컴퓨터로 하여금 상기 선택된 TPC 명령에 기초하여 상기 제2 전송 버스트의 적어도 하나의 슬롯에서 송신되는 전송의 전송 전력을 조절하게 하는 코드를 포함하는, 컴퓨터 프로그램 제품.
  28. 제24항에 있어서, 상기 컴퓨터 판독 가능 매체는,
    상기 적어도 하나의 컴퓨터로 하여금 단편화된 전용 물리 채널(F-DPCH)을 통해 상기 다수의 TPC 명령들을 수신하게 하는 코드; 및
    상기 적어도 하나의 컴퓨터로 하여금 상기 제1 및 제2 전송 버스트들 동안 업링크 전용 물리 제어 채널(UL-DPCCH)을 통해 전송을 송신하게 하는 코드를 더 포함하는, 컴퓨터 프로그램 제품.
  29. 제1 전송 버스트 동안 다수의 전송 전력 제어(TPC) 명령들을 전송하고, 상기 다수의 TPC 명령들 중 적어도 하나에 기초하여 조절된 전송 전력으로 상기 제1 전송 버스트 동안 송신되는 전송을 수신하고, 상기 다수의 TPC 명령들 중 적어도 두 개의 최종 TPC 명령들에 기초하여 조절된 전송 전력으로 제2 전송 버스트 동안 송신되는 전송을 수신하도록 구성되는 적어도 하나의 프로세서; 및
    상기 적어도 하나의 프로세서에 연결되는 메모리를 포함하며, 상기 제2 전송 버스트는 불연속한 전송(DTX) 기간에 의해 상기 제1 전송 버스트와 분리되는, 무선 통신용 장치.
  30. 제29항에 있어서,
    상기 적어도 하나의 프로세서는 상기 제1 전송 버스트 동안 수신되는 상기 전송에 기초하여 신호대 잡음 및 간섭비(SIR)를 추정하고, 상기 추정된 SIR에 기초하여 상기 다수의 TPC 명령들을 생성하도록 구성되는, 무선 통신용 장치.
  31. 제1 전송 버스트 동안 다수의 전송 전력 제어(TPC) 명령들을 전송하는 단계;
    상기 다수의 TPC 명령들 중 적어도 하나에 기초하여 조절된 전송 전력으로 상기 제1 전송 버스트 동안 송신되는 전송을 수신하는 단계; 및
    상기 다수의 TPC 명령들 중 적어도 두 개의 최종 TPC 명령들에 기초하여 조절된 전송 전력으로 제2 전송 버스트 동안 송신되는 전송을 수신하는 단계를 포함하며, 상기 제2 전송 버스트는 불연속한 전송(DTX) 기간에 의해 상기 제1 전송 버스트와 분리되는, 무선 통신용 방법.
  32. 제31항에 있어서,
    상기 제1 전송 버스트 동안 수신되는 상기 전송에 기초하여 신호대 잡음 및 간섭비(SIR)를 추정하는 단계; 및
    상기 추정된 SIR에 기초하여 상기 다수의 TPC 명령들을 생성하는 단계를 더 포함하는, 무선 통신용 방법.
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