KR20090100208A - 플라즈마 디스플레이 장치 - Google Patents

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KR20090100208A
KR20090100208A KR1020080109845A KR20080109845A KR20090100208A KR 20090100208 A KR20090100208 A KR 20090100208A KR 1020080109845 A KR1020080109845 A KR 1020080109845A KR 20080109845 A KR20080109845 A KR 20080109845A KR 20090100208 A KR20090100208 A KR 20090100208A
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scan
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마사시 야마자끼
다까시 후지사끼
요시까즈 가나자와
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가부시키가이샤 히타치세이사쿠쇼
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Abstract

본 발명은, 구동 회로를 구성하는 소자수를 삭감하고, 또한 전력의 손실을 저감할 수 있는 플라즈마 디스플레이 장치를 제공한다. Y 전극에 소정의 전위를 인가하는 스캔 드라이버의 고전위측 단자 및 저전위측 단자 간에 접속되는 용량 C1과, 저전위측 단자에 접속되는 제2 전위 라인 LN2를 전위 Vs에 클램프하는 스위치 SWY5 및 그라운드 전위에 클램프하는 스위치 SWY6과, 스위치 SWY6을 통한 제2 전위 라인 LN2와 그라운드 전위와의 접속을 차단 가능한 스위치 SWY7을 구비하고, 제2 전위 라인 LN2가 마이너스 전위인 경우에는, 스위치 SWY7을 오프하여 그라운드 전위와의 접속을 차단하여, 전류가 스위치 SWY6의 기생 다이오드를 통하여 흐르는 것을 방지할 수 있게 한다.
Figure P1020080109845
주사 전극, 플라즈마 디스플레이 장치, 스캔 펄스, 공급 단자, 용량 소자, 스위치

Description

플라즈마 디스플레이 장치{PLASMA DISPLAY DEVICE}
본 발명은, 플라즈마 디스플레이 장치에 관한 것이다.
플라즈마 디스플레이 패널의 구동에서, 1개의 필드는, 복수의 서브필드로 구성되고, 어느 서브필드에서 셀을 점등시킬지를 선택함으로써 계조 표현이 실현된다. 또한, 각 서브필드는, 전극 상의 벽전하 상태를 초기화하는 리세트 기간, 표시 데이터에 기초하여 벽전하 상태를 조정하여 점등시키고자 하는 셀의 선택을 행하는 어드레스 기간, 및 표시 데이터에 대응한 셀을 점등시키는(표시 데이터에 따라서 선택된 셀을 방전 발광시키는) 서스테인 기간으로 구성된다.
도 6은, 종래의 플라즈마 디스플레이 장치에서, Y 전극(주사 전극)을 구동하는 Y 구동 회로를 도시하는 회로도이다. Y 구동 회로는, 복수의 Y 전극에 소정의 전압을 인가한다.
Y 구동 회로는, 스위치 SW11∼SW19, 저항 R11, R12, 다이오드 D11∼D13, 및 용량 C11을 갖는다. 스위치 SW11, SW12 및 다이오드 D1, D2는, 스캔 드라이버의 일부로서, 1개의 Y 전극 Y를 구동하는 서브 드라이버 SD를 구성하고 있다. 서브 드라이버 SD의 고전위측 단자 VDH는 전위 Vsc에 접속 가능하고, 서브 드라이버 SD 의 저전위측 단자 VDL은 전위 Vs, Vw, (-Vy) 및 그라운드 전위에 접속 가능하게 구성된다.
Y 구동 회로는, 리세트 기간에서, 스위치 SW17을 온으로 하는(도통 상태로 하는) 것에 의해 도달 전위 Vw의 제1 리세트 펄스(기입 펄스)를 Y 전극에 인가하고, 스위치 SW12, SW14를 온으로 함으로써 도달 전위 (-Vy)의 제2 리세트 펄스(소거 펄스)를 Y 전극에 인가한다. 어드레스 기간에서는, 스캔 펄스를 인가하지 않은 Y 전극(비선택의 Y 전극)에는, 스위치 SW11을 온으로 하고, 스위치 SW12를 오프로 하여 전위 Vsc를 공급하고, 스캔 펄스를 인가하는 Y 전극(선택된 Y 전극)에는, 스위치 SW11을 오프로 하고, 스위치 SW12를 온으로 하여 전위 (-Vy)의 스캔 펄스를 인가한다. 또한, 서스테인 기간에서는, 스위치 SW12를 온으로 한 상태에서 스위치 SW18 및 SW19를 교대로 온으로 하여 전위 Vs 및 그라운드 전위를 교대로 공급함으로써, Y 전극에 서스테인 펄스를 인가한다.
도 6에 도시한 종래의 Y 구동 회로에서는, 어드레스 기간 중 및 리세트 기간에서의 제2 리세트 펄스의 인가시에는, 스위치 SW13 또는 스위치 SW14를 온으로 함으로써 서브 드라이버 SD의 저전위측 단자 VDL이 마이너스 전위로 된다. 따라서, 서브 드라이버 SD의 저전위측 단자 VDL이 마이너스 전위로 되었을 때에, 스위치 SW19의 기생 다이오드를 통하여 전류가 흐르는 것을 방지하기 위하여, 스위치 SW15, SW16으로 이루어지는 쌍방향 스위치(20)를 필요로 한다. 한편, 쌍방향 스위치(20)를 설치함으로써, 서스테인 기간에서의 서스테인 펄스의 인가시에 전력의 손실(전력 손실)이 발생하고 있었다. 또한, 도 6에 도시한 종래의 Y 구동 회로에서 는, Y 전극에 전위 Vsc, Vs, Vw, (-Vy)를 공급하기 위한 각 전위에 관련된 전원 회로를 필요로 한다. 일본 특허 공개 2007-309999호 공보 참조.
본 발명은, 구동 회로를 구성하는 소자수를 삭감하고, 또한 전력의 손실을 저감할 수 있는 플라즈마 디스플레이 장치를 제공하는 것을 목적으로 한다.
본 발명의 플라즈마 디스플레이 장치는, 주사 전극에 소정의 전위를 인가하는 스캔 드라이버와, 상기 스캔 드라이버의 고전위측 단자 및 저전위측 단자 간에 접속되는 용량 소자와, 상기 스캔 드라이버의 저전위측 단자의 전위를 제1 전위에 클램프하는 제1 스위치와, 상기 스캔 드라이버의 저전위측 단자의 전위를 상기 제1 전위보다 낮은 제2 전위에 클램프하는 제2 스위치와, 상기 제2 스위치 및 상기 제2 전위의 공급 단자 간 혹은 상기 제1 스위치 및 상기 제2 스위치 간에 접속되는 제3 스위치를 구비하고, 상기 제1 스위치 및 상기 제2 스위치의 접속점 혹은 상기 제1 스위치 및 상기 제3 스위치의 접속점과, 상기 스캔 드라이버의 저전위측 단자가 접속되는 것을 특징으로 한다.
스캔 드라이버의 저전위측 단자의 전위가 제2 전위보다 낮은 경우에는, 제3 스위치를 오프함으로써, 2개의 스위치로 이루어지는 쌍방향 스위치를 설치하지 않아도, 제3 스위치만으로 제2 전위의 공급 단자와의 접속을 차단하여, 스캔 드라이버의 저전위측 단자에 대하여 제2 스위치의 기생 다이오드를 통해 전류가 흐르는 것을 방지할 수 있다. 또한, 스위치의 수가 삭감되므로, 전력의 손실도 저감할 수 있다.
이하, 본 발명의 실시 형태를 도면에 기초하여 설명한다.
도 1은, 본 발명의 일 실시 형태에 따른 플라즈마 디스플레이 장치의 구성예를 도시하는 도면이다.
제어 회로(1)는, 화상 데이터 DATA, 클럭 신호 CLOCK, 수평 동기 신호 HSYNC 및 수직 동기 신호 VSYNC를 입력하고, X 구동 회로(2), Y 구동 회로(3) 및 어드레스 구동 회로(4)를 제어한다.
X 구동 회로(2)는, 유지 방전을 반복하는 회로로 이루어지고, 복수의 X 전극(유지 전극) X1, X2, …에 소정의 전압을 공급한다. 이하, X 전극 X1, X2, …의 각각을 또는 그들의 총칭을, X 전극 Xi라고 하고, i는 첨자를 의미한다.
Y 구동 회로(3)는, 선순차적으로 주사하여 표시할 행을 선택하는 회로 및 유지 방전을 반복하는 회로로 이루어지고, 복수의 Y 전극(주사 전극) Y1, Y2, …에 소정의 전압을 공급한다. 구체적으로는, Y 구동 회로(3)는, 어드레스 기간에서 Y 전극 Y1, Y2, …에 스캔 펄스가 순서대로 인가되고, 서스테인 기간(유지 방전 기간)에서 Y 전극 Y1, Y2, …에 서스테인 펄스(유지 방전 펄스)가 동시에 인가되도록 동작한다. 이하, Y 전극 Y1, Y2, …의 각각을 또는 그들의 총칭을, Y 전극 Yi라고 하고, i는 첨자를 의미한다.
어드레스 구동 회로(4)는, 표시할 열을 선택하는 회로로 이루어지고, 복수의 어드레스 전극 A1, A2, …에 소정의 전압을 공급한다. 이하, 어드레스 전극 A1, A2, …의 각각을 또는 그들의 총칭을, 어드레스 전극 Aj라고 하고, j는 첨자를 의미한다.
플라즈마 디스플레이 패널(5)에서는, Y 전극 Yi 및 X 전극 Xi가 수평 방향으로 병렬로 연장되는 행을 형성하고, 어드레스 전극 Aj가 수직 방향으로 연장되는 열을 형성한다. Y 전극 Yi 및 X 전극 Xi는, 수직 방향으로 교대로 배치된다. 즉, Y 전극 Yi 및 X 전극 Xi는 서로 평행하게 배치되고, 어드레스 전극 Aj는 Y 전극 Yi 및 X 전극 Xi에 대략 수직의 방향으로 배치된다. Y 전극 Yi 및 어드레스 전극 Aj는, i행 j열의 2차원 행렬을 형성한다.
셀 Cij는, Y 전극 Yi 및 어드레스 전극 Aj의 교점 및 그것에 대응하여 인접하는 X 전극 Xi에 의해 형성된다. 또한, Y 전극 Yi 및 어드레스 전극 Aj의 교점 및 그것에 대응하여 인접하는 X 전극 Xi에 의해 셀이 형성됨과 함께, Y 전극 Yi 및 어드레스 전극 Aj의 교점 및 그것에 대응하여 인접하는 X 전극 X(i+1)에 의해 셀이 형성되는 경우도 있다.
이 셀 Cij가, 예를 들면 적색, 녹색, 청색의 서브 픽셀에 대응하고, 이들 3색의 서브 픽셀에 의해 1화소가 구성된다. 플라즈마 디스플레이 패널(5)은 2차원 배열된 복수의 화소의 점등에 의해 화상을 표시한다. Y 구동 회로(3)는 선순차적으로 주사하여 표시할 행을 선택하는 회로와 어드레스 구동 회로(4)에 의해 어느 곳의 셀을 점등시킬지를 결정하고, X 구동 회로(2)와 Y 구동 회로(3)의 유지 방전을 반복하는 회로에 의해 반복 방전을 행함으로써 표시 동작이 행해지며, 플라즈마 디스플레이 패널(5)은 2차원 화상을 표시할 수 있다.
도 2는, 본 실시 형태에서의 X 구동 회로(2) 및 Y 구동 회로(3)의 구성예를 도시하는 회로도이다. 용량성 부하(10)는, 1개의 X 전극 X와 1개의 Y 전극 Y 사이에 형성되어 있는 셀의 합계의 용량이다. 부하(10)에는, X 전극 X 및 Y 전극 Y가 형성되어 있다. X 구동 회로(2)는, 부하(10)의 X 전극 X에 소정의 전압을 인가한다. Y 구동 회로(3)는, 부하(10)의 Y 전극 Y에 소정의 전압을 인가한다.
이하, MOS 전계 효과 트랜지스터를 간단히 트랜지스터라고 한다. n채널 트랜지스터는, 기생 다이오드를 갖고, 소스가 기생 다이오드의 애노드에 접속되고, 드레인이 기생 다이오드의 캐소드에 접속된다. 또한, 이하에서는, 임의의 전위 P를 공급하는 전원 회로나 공급 단자에 접속되는 것을 전위 P에 접속된다고 기재한다.
X 구동 회로에 대하여 설명한다. X 구동 회로는, 스위치 SWX1∼SWX3 및 저항 R1을 갖는다. 스위치 SWX1∼SWX3은, n채널 트랜지스터에 의해 구성된다. 스위치 SWX1은, X 전극 X 및 전위 Vs 간에 접속되고, 스위치 SWX2는, X 전극 X 및 그라운드 전위(기준 전위) 간에 접속된다. 스위치 SWX3 및 저항 R1은, X 전극 X 및 그라운드 전위 간에 직렬 접속된다.
Y 구동 회로에 대하여 설명한다. Y 구동 회로는, 스위치 SWY1∼SWY8, 저항 R2, R3, 다이오드 D1∼D3, 및 용량(컨덴서) C1을 갖는다. 스위치 SWY1∼SWY8은, n채널 트랜지스터에 의해 구성된다.
스위치 SWY1, SWY2 및 다이오드 D1, D2는, 스캔 드라이버의 일부로서, 1개의 Y 전극 Y를 구동하는 서브 드라이버 SD를 구성하고 있다. 스캔 드라이버는, 구동하는 Y 전극의 개수분의 서브 드라이버를 갖고, 어드레스 기간 Ta에서의 Y 전극 Y의 스캔 펄스를 출력하기 위한 스위칭 동작을 행한다.
스위치 SWY1은, Y 전극 Y 및 서브 드라이버 SD의 고전위측 단자 VDH 간에 접속되고, 스위치 SWY2는, Y 전극 Y 및 서브 드라이버 SD의 저전위측 단자 VDL 간에 접속된다. 다이오드 D1은, 애노드가 Y 전극 Y에 접속되고, 캐소드가 서브 드라이버 SD의 고전위측 단자 VDH에 접속된다. 다이오드 D2는, 애노드가 서브 드라이버 SD의 저전위측 단자 VDL에 접속되고, 캐소드가 Y 전극 Y에 접속된다.
또한, 스캔 드라이버가 갖는 모든 서브 드라이버 SD의 고전위측 단자 VDH는, 제1 전위 라인 LN1에 공통 접속된다. 마찬가지로, 스캔 드라이버가 갖는 모든 서브 드라이버 SD의 저전위측 단자 VDL은, 제2 전위 라인 LN2에 공통 접속된다. 제1 전위 라인 LN1은, 전위 Vsc를 공급하기 위한 Vsc 전원에 접속된다. 본 실시 형태에서는, 전위 Vsc는 스캔 펄스의 전위의 절대값에 대응하는 전위이다.
스위치 SWY3은, 제1 전위 라인 LN1 및 그라운드 전위 간에 접속된다. 스위치 SWY3은, 어드레스 기간 Ta에서의 Y 전극 Y의 스캔 펄스를 생성할 수 있다.
스위치 SWY4 및 저항 R2는, 다이오드(제너 다이오드) D3의 애노드 및 그라운드 전위 간에 직렬 접속된다. 다이오드 D3은, 캐소드가 제1 전위 라인 LN1에 접속된다. 스위치 SWY4, 저항 R2 및 다이오드 D3으로 구성되는 회로에 의해, 리세트 기간 Tr에서의 Y 전극 Y의 도달 전위 (-Vsc)인 제2 리세트 펄스(소거 펄스)를 생성할 수 있다.
스위치 SWY5는, 전위 Vs 및 제2 전위 라인 LN2 간에 접속된다. 스위치 SWY5는, 제2 전위 라인 LN2를 서스테인 펄스의 전위 Vs로 하기 위한 고전위 클램프용 스위치이다.
스위치 SWY6 및 스위치 SWY7은, 제2 전위 라인 LN2 및 그라운드 전위 간에 직렬 접속된다. 스위치 SWY6은, 제2 전위 라인 LN2를 그라운드 전위로 하기 위한 저전위 클램프용 스위치이다. 스위치 SWY7은, 제2 전위 라인 LN2가 마이너스 전위로 되었을 때에, 스위치 SWY6의 기생 다이오드를 통하여 제2 전위 라인 LN2에 전류가 흐르는 것을 방지하기 위한 스위치이다.
도 2에 도시하는 예에서는, 스위치 SWY6의 드레인이 제2 전위 라인 LN2에 접속되고, 스위치 SWY6의 소스와 스위치 SWY7의 소스가 접속되고, 스위치 SWY7의 드레인이 그라운드 전위에 접속된다. 또한, 본 발명은 이것에 한정되는 것이 아니며, 스위치 SWY7의 소스가 제2 전위 라인 LN2에 접속되고, 스위치 SWY7의 드레인과 스위치 SWY6의 드레인이 접속되고, 스위치 SWY6의 소스가 그라운드 전위에 접속되도록 해도 된다. 즉, 스위치 SW6 및 스위치 SWY7의 소스끼리 또는 드레인끼리를 접속한 직렬 접속 구성이, 제2 전위 라인 LN2 및 그라운드 전위 간에 접속되면 된다.
스위치 SWY8 및 저항 R3은, 전위 Vs 및 제2 전위 라인 LN2 간에 직렬 접속된다. 스위치 SWY8 및 저항 R3으로 구성되는 회로에 의해, 리세트 기간 Tr에서의 Y 전극 Y의 도달 전위 (Vsc+Vs)인 제1 리세트 펄스(기입 펄스)를 생성할 수 있다. 용량 C1은, 제1 전위 라인 LN1 및 제2 전위 라인 LN2 간에 접속된다.
도 3은, 화상의 1필드 FD의 구성예를 도시하는 도면이다. 화상은, 예를 들면 60필드/초로 형성된다. 1 필드 FD는, 제1 서브필드 SF1, 제2 서브필드 SF2, …, 제n 서브필드 SFn에 의해 형성된다. 이 n은, 예를 들면 10이며, 계조 비트수에 상당한다. 서브필드 SF1, SF2 등의 각각을 또는 그들의 총칭을, 이하, 서브필드 SF라고 한다.
각 서브필드 SF는, 리세트 기간 Tr, 어드레스 기간 Ta 및 서스테인 기간 Ts를 갖는다. 리세트 기간 Tr에서는, 셀 Cij의 초기화를 행한다. 어드레스 기간 Ta에서는, 어드레스 전극 Aj 및 Y 전극 Yi 간의 어드레스 방전에 의해 각 셀 Cij의 발광 또는 비발광을 선택할 수 있다. 구체적으로는, Y 전극 Y1, Y2, Y3, Y4, …, Yn으로 순차적으로 스캔 펄스를 인가하고, 그 스캔 펄스에 대응하여 어드레스 전극 Aj에 어드레스 펄스를 인가함으로써, 원하는 셀 Cij의 발광을 선택할 수 있다. 서스테인 기간 Ts에서는, 발광이 선택된 셀 Cij의 X 전극 Xi 및 Y 전극 Yi 간에서 서스테인 방전을 행하여, 발광을 행한다. 각 서브필드 SF에서는, X 전극 Xi 및 Y 전극 Yi 간의 서스테인 펄스에 의한 발광 횟수(서스테인 기간 Ts의 길이)가 서로 다르다. 이에 의해, 계조값을 결정할 수 있다.
도 4는, 도 2에 도시한 구동 회로의 1서브필드에서의 동작예를 나타내는 파형도로서, X 전극, Y 전극 및 어드레스 전극의 전압의 파형예를 나타낸다. 1개의 서브필드는, 리세트 기간 Tr과 어드레스 기간 Ta와 서스테인 기간 Ts로 구분된다.
리세트 기간 Tr에서는, 셀 Cij의 초기화를 행한다. 리세트 기간에서는, Y 전극에 정극성의 둔파를 일제히 인가하여 리세트 방전(기입)을 행함으로써 벽전하 를 형성하고, 계속해서 부극성의 둔파를 일제히 인가하여 리세트 방전(소거)을 행함으로써 셀 Cij의 벽전하량을 조정한다. 또한, 정극성의 둔파란, 플러스의 경사를 갖는 파형이며, 인가 전압이 시간 경과와 함께 플러스 방향으로 연속적으로 변화하는 것이다. 또한, 부극성의 둔파란, 마이너스의 경사를 갖는 파형이며, 인가 전압이 시간 경과와 함께 마이너스 방향으로 연속적으로 변화하는 것이다.
구체적으로는, 리세트 기간 Tr에서, 시각 t1의 전에서는, 도 2에 도시한 구동 회로의 각 스위치 중, 스위치 SWX1, SWY2, SWY6, SWY7은 온(도통 상태)이고, 그 밖의 스위치는 오프(비도통 상태)이다. 이 때, X 전극 X의 전위는 전위 Vs이고, Y 전극 Y의 전위는 그라운드 전위이다. 또한, 용량 C1에는, 전위차 Vsc에 따른 전하가 충전된다.
시각 t1에서는, 스위치 SWX1을 오프로 하고, 스위치 SWX3을 온으로 한다. 이에 의해, X 전극 X의 전위가 서서히 전위 Vs로부터 그라운드 전위로 저하한다. 또한, 스위치 SWY1을 온으로 하고, 스위치 SWY2를 오프로 한다. 이에 의해, Y 전극 Y에 전위 Vsc가 인가된다.
다음으로, 시각 t2에서는, 스위치 SWY6 및 SWY7을 오프로 하고, 스위치 SWY8을 온으로 한다. 이에 의해, 제2 전위 라인 LN2의 전위가 서서히 그라운드 전위로부터 전위 Vs로 상승해 가고, 그에 따라서 시각 t2∼t3에 나타내는 바와 같이 제1 전위 라인 LN1의 전위가 서서히 전위 Vsc로부터 전위 (Vsc+Vs)로 상승한다. 이와 같이 하여, Y 전극 Y에 정극성의 둔파인 도달 전위 (Vsc+Vs)의 제1 리세트 펄스(기입 펄스)가 인가된다.
시각 t3에서는, 스위치 SWY1을 오프로 하고, 스위치 SWY2를 온으로 하며, 계속되는 시각 t4에서는, 스위치 SWY8을 오프로 하고, 스위치 SWY6 및 SWY7을 온으로 한다. 이에 의해, Y 전극 Y의 전위가, 전위 (Vsc+Vs)로부터 전위 Vs로 변화하고, 계속해서 그라운드 전위로 변화한다.
다음으로, 시각 t5에서는, 스위치 SWX3을 오프로 하고, 스위치 SWX1을 온으로 한다. 이에 의해, X 전극 X에 전위 Vs가 인가된다. 또한, 스위치 SWY7을 오프로 하고, 스위치 SWY4를 온으로 한다. 이에 의해, 제1 전위 라인 LN1의 전위가 서서히 전위 Vsc로부터 그라운드 전위로 저하해 가고, 그에 따라서 시각 t5∼t6에 나타내는 바와 같이 제2 전위 라인 LN2의 전위가 서서히 그라운드 전위로부터 전위 (-Vsc)로 저하한다. 이와 같이 하여, Y 전극 Y에 부극성의 둔파인 도달 전위 (-Vsc)의 제2 리세트 펄스(소거 펄스)가 인가된다. 또한, 제2 전위 라인 LN2의 전위가 그라운드 전위로부터 전위 (-Vsc)로 저하하는, 즉 마이너스 전위로 되지만, 스위치 SWY7은 오프이므로 스위치 SWY6의 기생 다이오드를 통하여 전류가 흐르는 일은 없다.
시각 t6에서는, 스위치 SWY2 및 SWY4를 오프로 하고, 스위치 SWY1 및 SWY3을 온으로 한다. 이에 의해, Y 전극 Y의 전위가 그라운드 전위로 된다. 또한, 시각 t6에서, 스위치 SWY4를 오프하도록 하고 있지만, 스위치 SWY4를 오프하는 타이밍은 시각 t6 이후에서 어드레스 기간 Ta의 개시 이전이면 임의적이다.
계속해서, 어드레스 기간 Ta에서는, 표시 데이터에 기초하는 어드레스 지정에 의해 표시 라인의 각 셀 Cij의 발광(점등) 또는 비발광(비점등)을 선택하는 스 캔 동작을 행한다. 어드레스 기간 Ta에서는, 표시 라인의 Y 전극 Y에 순차적으로 스캔 펄스를 인가하고, 그 스캔 펄스에 대응하여 어드레스 전극에 어드레스 펄스를 인가한다. 이에 의해, 어드레스 전극 및 Y 전극 Y 간에 방전이 생기고, 이 방전에 의해 X 전극 X 및 Y 전극 Y에 벽전하가 형성되며, 셀 Cij의 발광 또는 비발광을 선택한다.
구체적으로는, Y 전극 Y에 스캔 펄스를 인가할 때에는, 시각 t7∼t8에 나타내는 바와 같이, 스위치 SWY1을 오프로 하고, 스위치 SWY2를 온으로 한다. 이에 의해, Y 전극 Y에 전위 (-Vsc)의 스캔 펄스가 인가된다. 이 스캔 펄스에 대응하여 어드레스 전극의 어드레스 펄스 (Va)가 생성되면, 그 Y 전극 Yi 및 X 전극 Xi와 어드레스 전극 Aj에 의해 형성되는 셀 Cij의 발광이 선택된다. 한편, 스캔 펄스에 대응하여 어드레스 전극 A의 어드레스 펄스가 생성되지 않으면, 그 Y 전극 Yi 및 X 전극 Xi와 어드레스 전극 Aj에 의해 형성되는 셀 Cij의 발광이 선택되지 않고, 비발광이 선택된다.
이 어드레스 기간 Ta에서, 제2 전위 라인 LN2의 전위는 전위 (-Vsc)로서 마이너스 전위로 되지만, 스위치 SWY7은 오프이므로 스위치 SWY6의 기생 다이오드를 통하여 전류가 흐르는 일은 없다.
계속해서, 서스테인 기간 Ts에서는, X 전극 X 및 Y 전극 Y에 교대로 서스테인 펄스(전위 Vs)가 인가되고, 어드레스 기간 Ta에서 선택된 셀의 X 전극 X 및 Y 전극 Y 간에서 서스테인 방전을 행하여, 발광을 행한다.
구체적으로는, 시각 t9에서는, 스위치 SWY1 및 SWY3을 오프로 하고, 스위치 SWY2 및 SWY7을 온으로 한다. 이 상태에서, 시각 t9 이후에 나타내는 바와 같이, 스위치 SWX1 및 SWY6을 오프로 하고, 스위치 SWX2 및 스위치 SWY5를 온으로 하는 제1 동작과, 스위치 SWX2 및 SWY5를 오프로 하고, 스위치 SWX1 및 스위치 SWY6을 온으로 하는 제2 동작을 교대로 행한다. 이에 의해, X 전극 X 및 Y 전극 Y에 전위 Vs의 서스테인 펄스가 교대로 인가된다.
본 실시 형태에 따르면, 스캔 드라이버가 갖는 서브 드라이버 SD의 저전위측 단자 VDL에 접속되는 제2 전위 라인 LN2의 전위가 마이너스 전위로 되는 경우에는, 스위치 SWY7을 오프하여 제2 전위 라인 LN2와 그라운드 전위의 접속을 차단한다. 이에 의해, 제2 전위 라인 LN2와 그라운드 전위를 전기적으로 분리하여, 제2 전위 라인 LN2에 스위치 SWY6의 기생 다이오드를 통하여 전류가 흐르는 것을 방지할 수 있다. 또한, 리세트 기간 Tr에서 Y 전극에 부극성의 둔파를 인가하지 않는 등 어드레스 기간 Ta 이외에는 제2 전위 라인 LN2의 전위가 마이너스 전위로 되지 않는 경우에는, 적어도 어드레스 기간 Ta에서 스위치 SWY7을 오프로 하면 된다.
또한, 서브 드라이버 SD의 고전위측 단자 VDH(제1 전위 라인 LN1) 및 저전위측 단자 VDL(제2 전위 라인 LN2) 간에 용량 소자 C1을 접속하고, 전위 라인 LN1, LN2의 전위를 적절하게 제어함으로써, Y 전극 Y에 인가되는 각 펄스를 생성한다. 이에 의해, 플라즈마 디스플레이 장치의 구동에서, Y 전극에 각 펄스의 전위를 공급하기 위한 전원 회로의 수를 삭감할 수 있다.
도 5는, 본 실시 형태에서의 Y 구동 회로의 다른 구성예를 도시하는 회로도이다. 이 도 5에서, 도 2에 나타낸 구성 요소와 동일한 기능을 갖는 구성 요소에 는 동일한 부호를 붙이고, 중복 설명은 생략한다.
도 5에 도시하는 Y 구동 회로는, 전위 Vs뿐만 아니라, 전위 Vs와 전위 Vu 중으로부터 어느 하나의 전위를 선택하여 공급할 수 있도록 한 것이다. 전위 Vu는, 전위 Vs보다도 약간 높은 전위(예를 들면, 그라운드 전위를 기준으로 하여 전위 Vs가 180V일 때, 전위 Vu가 210V 정도임)로서, 플라즈마 디스플레이 패널의 방전을 안정시키기 위하여, 보다 강한 방전을 발생시키는 경우 등에 사용된다.
스위치 SWY9는, 전위 Vs 및 노드 NV 간에 접속되고, 스위치 SWY10은, 전위 Vu 및 노드 NV 간에 접속된다. 또한, 스위치 SWY5는, 노드 NV 및 제2 전위 라인 LN2 간에 접속되고, 스위치 SWY8 및 저항 R3은, 노드 NV 및 제2 전위 라인 LN2 간에 직렬 접속된다. 이와 같이 구성하여, 스위치 SWY9 또는 스위치 SWY10을 선택적으로 온함으로써, 전위 Vs 또는 전위 Vu 중 어느 하나가 공급된다. 예를 들면, 리세트 기간 Tr에서의 Y 전극 Y의 제1 리세트 펄스로서 도달 전위가 (Vsc+Vs) 또는 (Vsc+Vu)의 펄스를 선택하여 공급할 수 있다. 또한, 마찬가지로 예를 들면, 서스테인 기간 Ts에서의 서스테인 펄스로서 전위가 Vs 또는 Vu인 펄스를 선택하여 공급할 수 있다.
또한, 전술한 실시 형태에서는, 전위 라인 LN1, LN2의 전위를 적절하게 제어함으로써, 용량 소자 C1에 관련된 전위를 변화시켜, 리세트 기간 Tr에서의 Y 전극 Y의 제1 리세트 펄스(기입 펄스) 및 제2 리세트 펄스(소거 펄스)나, 어드레스 기간 Ta에서의 Y 전극 Y의 스캔 펄스를 생성하도록 하고 있지만, 도 6에 도시한 바와 같은 전위 Vw나 (-Vy)의 전원을 이용하여 각 펄스를 생성하도록 해도 된다.
또한, 상기 실시 형태는, 모두 본 발명을 실시함에 있어서의 구체화의 극히 일례를 나타낸 것에 지나지 않으며, 이들에 의해 본 발명의 기술적 범위가 한정적으로 해석되어서는 안되는 것이다. 즉, 본 발명은 그 기술 사상 또는 그 주요한 특징으로부터 일탈하지 않고, 다양한 형태로 실시할 수 있다.
도 1은, 본 발명의 실시 형태에 따른 플라즈마 디스플레이 장치의 구성예를 도시하는 도면.
도 2는, 본 실시 형태에서의 X 구동 회로 및 Y 구동 회로의 구성예를 도시하는 회로도.
도 3은, 화상의 1필드의 구성예를 도시하는 도면.
도 4는, 도 2에 도시한 구동 회로의 1서브필드에서의 동작예를 나타내는 파형도.
도 5는, 본 실시 형태에서의 Y 구동 회로의 다른 구성예를 도시하는 회로도.
도 6은, 종래 기술에 의한 Y 구동 회로의 구성예를 도시하는 회로도.
<도면의 주요 부분에 대한 부호의 설명>
1: 제어 회로
2: X 구동 회로
3: Y 구동 회로
4: 어드레스 구동 회로

Claims (12)

  1. 주사 전극에 소정의 전위를 인가하는 스캔 드라이버와,
    상기 스캔 드라이버의 고전위측 단자 및 저전위측 단자 간에 접속되는 용량 소자와,
    상기 스캔 드라이버의 저전위측 단자의 전위를 제1 전위에 클램프하는 제1 스위치와,
    상기 스캔 드라이버의 저전위측 단자의 전위를 상기 제1 전위보다 낮은 제2 전위에 클램프하는 제2 스위치와,
    상기 제2 스위치 및 상기 제2 전위의 공급 단자 간에 접속되는 제3 스위치
    를 포함하고,
    상기 제1 스위치 및 상기 제2 스위치의 접속점과, 상기 스캔 드라이버의 저전위측 단자가 접속되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  2. 제1항에 있어서,
    상기 스캔 드라이버의 저전위측 단자의 전위가 상기 제2 전위보다 낮은 기간에서는, 상기 제3 스위치를 오프시키는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 제1항에 있어서,
    상기 주사 전극에 스캔 펄스가 인가되는 어드레스 기간에서는, 상기 제3 스위치를 오프시키는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  4. 제1항에 있어서,
    상기 제2 전위는 그라운드 전위인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  5. 제1항에 있어서,
    상기 제1 전위는, 서로 다른 복수의 전위로부터 선택 가능한 것을 특징으로 하는 플라즈마 디스플레이 장치.
  6. 제5항에 있어서,
    상기 제1 스위치와 제3 전위의 공급 단자 간에 접속되는 제4 스위치와,
    상기 제1 스위치와 제4 전위의 공급 단자 간에 접속되는 제5 스위치
    를 포함하고,
    상기 제3 전위 또는 상기 제4 전위를 상기 제1 전위로 하여 상기 제1 스위치에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  7. 주사 전극에 소정의 전위를 인가하는 스캔 드라이버와,
    상기 스캔 드라이버의 고전위측 단자 및 저전위측 단자 간에 접속되는 용량 소자와,
    상기 스캔 드라이버의 저전위측 단자의 전위를 제1 전위에 클램프하는 제1 스위치와,
    상기 스캔 드라이버의 저전위측 단자의 전위를 상기 제1 전위보다 낮은 제2 전위에 클램프하는 제2 스위치와,
    상기 제1 스위치 및 상기 제2 스위치 간에 접속되는 제3 스위치
    를 포함하고,
    상기 제1 스위치 및 상기 제3 스위치의 접속점과, 상기 스캔 드라이버의 저전위측 단자가 접속되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  8. 제7항에 있어서,
    상기 스캔 드라이버의 저전위측 단자의 전위가 상기 제2 전위보다 낮은 기간에서는, 상기 제3 스위치를 오프시키는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  9. 제7항에 있어서,
    상기 주사 전극에 스캔 펄스가 인가되는 어드레스 기간에서는, 상기 제3 스위치를 오프시키는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  10. 제7항에 있어서,
    상기 제2 전위는 그라운드 전위인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  11. 제7항에 있어서,
    상기 제1 전위는, 서로 다른 복수의 전위로부터 선택 가능한 것을 특징으로 하는 플라즈마 디스플레이 장치.
  12. 제11항에 있어서,
    상기 제1 스위치와 제3 전위의 공급 단자 간에 접속되는 제4 스위치와,
    상기 제1 스위치와 제4 전위의 공급 단자 간에 접속되는 제5 스위치
    를 포함하고,
    상기 제3 전위 또는 상기 제4 전위를 상기 제1 전위로 하여 상기 제1 스위치에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
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