KR20080048765A - 멀티-프로그램 다중화/역다중화 장치 및 방법 - Google Patents

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Abstract

디지털 방송에서 MPEG 지터를 방지하는 멀티-프로그램 다중화/역 다중화 장치 및 그 방법 및 그를 적용한 멀티-프로그램 수신기가 개시되어 있다. 본 발명은 복수개 채널의 디코더로부터 각각 트랜스포트 스트림 패킷을 추출하는 과정, 추출된 각 트랜스포트 스트림 패킷의 기준 클럭값과 그 값에 래치된 시스템 클럭값을 비교하여 시스템 클럭 제어값을 생성하는 과정, 생성된 클럭 제어값을 상기 각 채널의 로칼 패킷에 삽입하는 과정, 복수개 채널의 로칼 패킷을 다중화하여 멀티-프로그램 패킷을 생성하는 과정을 포함한다.

Description

멀티-프로그램 다중화/역다중화 장치 및 방법{Method and apparatus for multiplexing/de-multiplexing multi-program}
도 1은 종래의 케이블 방송 시스템에서의 멀티-프로그램 다중화 방식을 도시한 타이밍도이다.
도 2는 본 발명에 따른 멀티-프로그램 다중화 장치의 블록도이다.
도 3은 로칼 패킷 발생부에서 생성되는 신호 포맷의 일실시예이다.
도 4는 도 2의 기준 클럭 복구부의 상세도이다.
도 5는 본 발명에 따른 멀티-프로그램 다중화 방법을 보이는 흐름도이다.
도 6은 본 발명에 따른 멀티-프로그램 역다중화 장치의 블록도이다.
도 7은 본 발명에 따른 멀티-프로그램 역다중화 방법을 보이는 흐름도이다.
본 발명은 디지털 방송 송수신 시스템에 관한 것이며, 특히 디지털 방송에서 MPEG 지터를 방지하는 멀티-프로그램 다중화/역 다중화 장치 및 그 방법 및 그를 적용한 멀티-프로그램 수신기에 관한 것이다.
통상적으로 디지털 방송은, 디지털 영상/음성 압축 및 디지털 전송 기술의 발전에 따라 아날로그 방송 신호 서비스보다 고화질의 방송 서비스를 제공할 수 있으며, 디지털 통신 미디어 및 디지털 저장 미디어등과의 상호 운용성을 높일 수 있다.
디지털 방송은 대부분 MPEG-2 방식을 기반으로 인코딩된 전송 스트림(Transport Stream)형태로 전송된다.
근래 들어 방송 채널의 수가 증가하고 있다. 따라서 복수개 채널을 통해 입력되는 방송 프로그램을 동시에 시청 또는 저장할 수 있는 시스템을 요구하고 있다. 이에 따라 PIP(Picture in Picture), 더블 윈도우 기능을 갖는 방송 수신기가 출시되고 있다.
통상적으로 케이블 방송 시스템은 복수개의 채널을 통해서 입력되는 프로그램을 다중화(multiplexing)하여 방송 수신기로 전송한다. 이때 멀티플렉싱된 전송 스트림의 PCR(Program Clock Reference) 지터는 최소화되어야한다. PCR은 시스템 디코더의 STC(System Time Clock)값을 인코더측에서 의도된 값으로 설정하기 위한 시간 정보이다.
도 1은 종래의 케이블 방송 시스템에서의 멀티-프로그램 다중화 방식을 도시한 타이밍도이다.
도 1을 참조하면, 복수개의 채널 디코더(도시안됨)는 각각의 채널 특성(트랜스포트 스트림 레이트)에 따라 각각 독립적으로 트랜스포트 스트림(TS1,.... TSn) 패킷을 출력한다. CMP 생성부(도시안됨)는 각 채널의 트랜스포트 스트림에 제어 정보를 부가하여 CMP(Cable MPEG Packet)로 생성된다. 그리고 다중화부(도시안됨)는 각 채널의 CMP를 하나의 패킷열(packet sequence)로 다중화한다.
그러나 멀티플렉싱된 하나의 패킷열(packet sequence)은 입력되는 트랜스포트 스트림 패킷의 순서 및 트랜스포트 스트림 패킷 기간(TS packet duration)에 의해 그 출력되는 시점이 결정된다. 이러한 멀티플렉싱 방식은 각 로칼 TS들간의 시간 간격을 정확히 보장할 수 없기 때문에 MPEG 지터가 발생한다. 따라서 종래 멀티-프로그램 멀티플렉싱 방식은 MPEG 지터에 의해 MPEG 시스템의 클럭(27MHz) 락킹(locking)에 오차가 발생되는 문제점이 있다.
본 발명이 이루고자하는 기술적 과제는 멀티-프로그램을 수신하는 수신기에서 채널별로 시스템 클럭 제어값을 멀티-프로그램 패킷에 삽입함으로써 MPEG 지터를 방지하는 멀티-프로그램 멀티플렉서/디멀티플렉서 장치 및 그 방법을 제공하는 데 있다.
본 발명이 이루고자하는 다른 기술적 과제는 MPEG 지터를 방지하는 멀티-프로그램 멀티플렉서/디멀티플렉서를 구비한 디지털 신호 수신기를 제공하는 데 있다.
상기의 기술적 과제를 해결하기 위하여, 본 발명은 멀티-프로그램 다중화 방법에 있어서,
복수개 채널의 디코더로부터 각각 트랜스포트 스트림 패킷을 추출하는 과정;
상기 추출된 각 트랜스포트 스트림 패킷의 기준 클럭값과 그 값에 래치된 시스템 클럭값을 비교하여 시스템 클럭 제어값을 생성하는 과정;
상기 생성된 클럭 제어값을 상기 각 채널의 로칼 패킷에 삽입하는 과정;
상기 과정의 복수개 채널의 로칼 패킷을 다중화하여 멀티-프로그램 패킷을 생성하는 과정을 포함하는 것을 특징으로 한다.
상기의 다른 기술적 과제를 해결하기 위하여, 본 발명은 멀티-프로그램 역-다중화 방법에 있어서,
채널별 시스템 클럭 제어값이 삽입된 멀티-프로그램 패킷을 수신하는 과정;
상기 수신된 멀티-프로그램 패킷으로부터 로칼 트랜스포트 ID와 시스템 클럭 제어값을 분리하는 과정;
상기 로칼 트랜스포트 ID에 따라 로칼 트랜스포트 스트림 패킷을 분리하고 각 로칼 트랜스포트 스트림 패킷에 해당하는 시스템 클럭 제어값과 링크하는 과정;
상기 선택된 로칼 트랜스포트 스트림 패킷에 해당하는 시스템 클럭 제어값을 참조하여 시스템 클럭을 제어하는 과정을 포함하는 것을 특징으로 한다.
상기의 또 다른 기술적 과제를 해결하기 위하여, 본 발명은 멀티-프로그램 다중화 장치에 있어서,
방송 신호로부터 원하는 채널의 방송 신호를 선택하고, 각 채널의 방송 신호중에서 트랜스포트 스트림 패킷을 추출하는 적어도 하나 이상의 채널 디코더부;
상기 채널 디코더부에서 추출된 각 채널의 트랜스포트 스트림 패킷의 동기 신호에 따라 로칼 타임 스탬프를 발생하는 로칼 타임 스탬프 발생부;
상기 채널 디코더부에서 추출된 각 트랜스포트 스트림 패킷의 기준 클럭값과 그 값에 래치된 시스템 클럭값을 비교하여 시스템 클럭 제어값을 생성하는 기준 클 럭 복구부;
상기 채널 디코더부에서 발생하는 트랜스포트 스트림 패킷, 로칼 타임 스탬프 발생부에서 발생하는 로칼 타임 스탬프, 기준 클럭 복구부에서 생성되는 시스템 클럭 제어값를 바탕으로 각 채널별로 로칼 패킷을 발생하는 로칼 패킷 발생부;
상기 로칼패킷 발생부에서 발생되는 각 채널의 로칼 패킷을 다중화하여 출력 주파수와 동기화된 패킷 시퀀스를 발생하는 다중화부를 포함하는 것을 특징으로 한다.
상기의 또 다른 기술적 과제를 해결하기 위하여, 본 발명은 멀티-프로그램 역다중화 장치에 있어서,
채널별로 시스템 클럭 제어값이 삽입된 멀티-프로그램 패킷으로부터 로칼 트랜스포트 ID와 시스템 클럭 제어값을 분리하는 패킷 역다중화부;
상기 패킷 역 다중화부에서 분리된 로칼 트랜스포트 ID에 따라 로칼 트랜스포트 스트림 패킷을 분리하는 TS 역다중화부;
상기 패킷 역 다중화부에서 분리된 각 채널의 시스템 클럭 제어값에 따라 각 채널에 대한 시스템 클럭들을 제어하는 클럭 제어부를 구비하는 것을 특징으로 한다.
이하 첨부된 도면을 참조로하여 본 발명의 바람직한 실시예를 설명하기로 한다.
본 발명의 멀티-프로그램 다중화/역다중화 장치는 하나의 수신기에 내장된 다. 따라서 수신기는 복수개 채널에서 수신되는 각 트랜스포트 스트림 패킷들에 클럭 제어값을 삽입하여 다중화하고, 그 다중화된 트랜스포트 스트림 패킷을 역 다중화한다. 그리고 수신기에서는 송신기에서 사용되는 27MHz의 발진 주파수에 동기된 27MHz의 시스템 타임 클럭 신호(시스템 클럭 신호라고 칭함)를 발생함으로써 수신 신호를 정상적으로 복원할 수 있다. 따라서 송신기는 27MHz의 시스템 타임 클럭 신호를 복원하는 PLL(Phase Locking Loop)회로의 기준으로 사용하기 위해 수신기로 PCR(Program Clock Reference)을 전송한다.
도 2는 본 발명에 따른 멀티-프로그램 다중화 장치의 블록도이다.
제1,제2,제n채널 디코더(211, 212, 213)는 복수개 안테나를 통해 수신되는 방송 신호로부터 원하는 채널의 방송 신호를 선택하고, 각 채널의 방송 신호중에서 MPEG 규격의 트랜스포트 스트림(TS) 패킷을 추출한다. 이때 트랜스포트 스트림(TS) 패킷은 헤더 영역과 페이로드 영역으로 구성된다. 헤더 영역은 4바이트의 헤더와 PCR(Program Clock Reference)을 갖는 부가 헤더로 구성되고, 페이로드 영역은 188바이트의 비디오/오디오 신호로 구성된다. 또한 헤더에는 트랜스포트 스트림(TS) 패킷의 시작 위치를 나타내는 동기 신호가 포함되어 있다.
로칼 타임 스탬프 발생부(220)는 제1,제2,제n채널 디코더(211, 212, 213)에서 추출된 각 채널의 트랜스포트 스트림(TS)의 동기 신호에 따라 각 채널의 트랜스포트 스트림 패킷 마다 로칼 타임 스탬프를 발생한다. 이때 로칼 타임 스탬프값은 바람직하게 4바이트를 사용한다.
기준 클럭 복구부(230)는 제1,제2,제n채널 디코더(211, 212, 213)에서 추출 된 트랜스포트 스트림(TS)으로부터 PCR(Program Clock Reference)을 추출하고, 그 PCR의 추출시점에서 래치된 STC(System Time Clock)값과 PCR값을 비교하여 PWM(Pulse Width Modulation)제어값을 발생한다. STC(System Time Clock)값은 수신된 오디오/비디오 신호의 립 싱크(lip synchronization)를 위한 시스템 클럭 정보이다. PWM 제어값은 각 채널에 대한 시스템 클럭의 특성을 나타낸다.
제1,제2,제n로칼 패킷 발생부(251, 252, 253)는 제1,제2,제n채널 디코더(211, 212, 213)에서 발생하는 188바이트의 트랜스포트 스트림, 로칼 타임 스탬프 발생부(220)에서 발생하는 각 채널의 로칼 타임 스탬프, 기준 클럭 복구부(230)에서 생성되는 PWM 제어값 및 제어부(240)에서 생성되는 부가 정보를 이용하여 각 채널별로 로칼 패킷을 발생한다. 이때 로칼 패킷은 일실시예로 케이블 방송 수신기에서 적용되는 CMP(Cable Card MPEG Packet)가 사용된다
패킷 다중화부(260)는 제1,제2,제n로칼패킷 발생부(251, 252, 253)에서 발생되는 n개 채널의 로칼 패킷을 다중화하여 출력 주파수와 동기화된 패킷 시퀀스를 발생한다
제어부(240)는 제1,제2,제n채널 디코더(211, 212, 213), 로칼 타임 스탬프 발생부(220), 기준 클럭 복구부(230), 제1,제2,제n로칼패킷 발생부(251, 252, 253), 패킷 다중화부(260)의 동작을 제어하고, 부가 정보를 생성한다.
도 3은 로칼 패킷 발생부(251,252,253)에서 생성되는 신호 포맷의 일실시예이다.
도 3의 로칼 패킷은 헤더(header)과 MPEG TS 패킷으로 구성된다. 헤더는 LTSID(Local TS ID)(8비트), Res(Reserved)(24비트), LTS(Local Time Stamp)(32비트), Res(Reserved)(16비트), PWMV(PWM Value)(8비트)로 구성되고, MPEG TS 패킷은 188바이트의 페이로드로 구성된다.
도 4는 도 2의 기준 클럭 복구부(230)의 상세도이다.
제1,제2,제n PCR추출부(410, 420, 430)는 복수채널로부터 출력되는 188바이트의 각 TS 패킷들로부터 PCR들을 추출한다.
제1,제2,제n STC 생성부(412, 422, 432)는 제1,제2,제nPCR추출부(410, 420, 430)에서 추출된 PCR값의 출력 시점에서 STC(System Time Clock)값을 래치(latch)한다.
제1,제2,제n PWM 제어값 생성부(416, 426, 436)는 제1,제2,제n PCR추출부(410, 420, 430)에서 추출된 PCR값들과 제1,제2,제n STC 생성부(412, 422, 432)에서 래치된 STC값들을 비교하여 오차를 추출하고, 그 오차값을 PWM 제어값으로 변환한다. 따라서 제1,제2,제n PWM 제어값 생성부(416, 426, 436)는 각 채널마다 클럭 제어값에 해당하는 1바이트의 PWM 제어값을 생성한다.
도 5는 본 발명에 따른 멀티-프로그램 다중화 방법을 보이는 흐름도이다.
먼저, 복수개 채널의 디코더로부터 각각 트랜스포트 스트림 패킷을 추출한다(510 과정).
이어서, 추출된 트랜스포트 스트림 패킷내에 PCR값이 존재하는 가를 체크한다(520 과정).
이어서, 추출된 트랜스포트 스트림 패킷내에 PCR값이 존재하면 추출된 각 트 랜스포트 스트림 패킷들로부터 PCR값을 추출한다(530 과정). 반면에 추출된 트랜스포트 스트림 패킷내에 PCR값이 존재하지 않으면 패킷 다중화 과정(560 과정)을 수행한다.
이어서, 추출된 그 PCR값의 추출 시점에서 STC값을 래치한다(530 과정).
이어서, 각 채널별로 추출된 PCR값과 래치된 STC값을 비교하여 오차값을 추출하고, 그 오차값에 해당하는 PWM 제어값을 계산한다(540 과정). 이때 PWM 제어값은 시스템 클럭의 제어값에 해당한다.
이어서, 생성된 PWM 제어값을 각 채널의 로칼 패킷에 삽입한다(550 과정).
따라서, 로칼 패킷은 도 3에 도시된 바와 같이 각 채널 디코더부에서 발생하는 트랜스포트 스트림 패킷, 로칼 타임 스탬프, PWM 제어값등으로 구성된다.
이어서, 복수개 채널의 로칼 패킷을 다중화하여 출력 주파수와 동기된 멀티-프로그램 패킷을 생성한다(560 과정).
도 6은 본 발명에 따른 멀티-프로그램 역다중화 장치의 블록도이다.
패킷 역 다중화부(610)는 입력되는 다중 패킷 시퀀스에서 헤더를 추출하여 LTSID에 따라 각각의 로칼 TS를 분리한다. 또한 패킷 역 다중화부(610)는 헤더로부터 각 로칼 채널에 대한 PWM 제어값을 추출한다.
제1,제2,제n TS 역 다중화부(621, 622, 623)는 패킷 역 다중화부(610)에서 추출된 각 채널의 트랜스포트 스트림을 오디오 데이터, 비디오 데이터, PSI(Program Specific Ingormation)등에 따라 ES(Elementary Stream)또는 섹션 스트림등으로 파싱(parsing)한다.
제1,제2,제n PWM 제어부(631, 632, 633)는 PWM 발생기(도시안됨)와 LPF(Low Pass Filter)(도시안됨)로 구성되며, 패킷 역 다중화부(610)에서 추출된 각 채널의 PWM 제어값에 따라 PWM 신호를 발생하고, 그 PWM 신호를 저역 필터링하여 아날로그 전압 신호를 발생한다.
제1,제2,제n 시스템 클럭부(651, 652, 653)는 제1,제2,제n PWM 제어부(631, 632, 633)에서 발생하는 아날로그 전압 신호에 의해 VCXO(Voltage Controlled Crystal Oscillator)를 구동하고, 그 구동되는 VCXO(Voltage Controlled Crystal Oscillator)의해 각 로칼 채널들에 대한 시스템 클럭을 발생한다. 따라서 시스템 클럭 신호는 각 로칼 채널에 대한 비디오/오디오 신호를 정상적으로 복원한다.
제1,제2,제n 버퍼부(641, 642, 643)는 제1,제2,제n TS 역 다중화부(621, 622, 623)에서 파싱된 ES(Elementary Stream)또는 섹션 스트림들을 저장한다.
도 7은 본 발명에 따른 멀티-프로그램 역다중화 방법을 보이는 흐름도이다.
먼저, 채널별로 PWM 제어값이 삽입된 멀티-프로그램 패킷을 수신한다(710 과정).
이어서, 수신된 멀티-프로그램 패킷으로부터 로칼 트랜스포트 ID와 PWM 제어값을 분리한다(720 과정).
이어서, 로칼 트랜스포트 ID에 따라 로칼 트랜스포트 스트림 패킷을 분리하고(730 과정) 각 로칼 트랜스포트 스트림 패킷에 해당하는 PWM 제어값과 링크한다(740 과정).
이이서, 재생으로 선택된 로칼 트랜스포트 스트림 패킷에 해당하는 PWM 제어 값을 이용하여 시스템 클럭을 제어한다(750 과정).
본 발명은 상술한 실시예에 한정되지 않으며, 본 발명의 사상내에서 당업자에 의한 변형이 가능함은 물론이다.
또한 본 발명은 컴퓨터로 읽을 수 있는 기록매체에 컴퓨터가 읽을 수 있는 코드로서 구현하는 것이 가능하다. 컴퓨터가 읽을 수 있는 기록매체는 컴퓨터 시스템에 의하여 읽혀질 수 있는 데이터가 저장되는 모든 종류의 기록장치를 포함한다. 컴퓨터가 읽을 수 있는 기록매체의 예로는 ROM, RAM, CD-ROM, 자기 테이프, 하드디스크, 플로피디스크, 플래쉬 메모리, 광 데이터 저장장치 등이 있으며, 또한 캐리어 웨이브(예를 들어 인터넷을 통한 전송)의 형태로 구현되는 것도 포함한다. 또한 컴퓨터가 읽을 수 있는 기록매체는 네트워크로 연결된 컴퓨터 시스템에 분산되어, 분산방식으로 컴퓨터가 읽을 수 있는 코드로서 저장되고 실행될 수 있다.
상술한 바와 같이 본 발명에 의하면, 복수개 채널로 멀티-프로그램을 수신하는 수신기에서 각 채널별로 PCR과 STC를 비교하여 그 오차에 해당하는 PWM 제어값을 멀티-프로그램 패킷에 삽입함으로써 멀티-프로그램 다중화 과정에서 불가피하게 발생하는 MPEG 지터로 인한 부작용을 방지할 수 있다.

Claims (11)

  1. 멀티-프로그램 다중화 방법에 있어서,
    복수개 채널의 디코더로부터 각각 트랜스포트 스트림 패킷을 추출하는 과정;
    상기 추출된 각 트랜스포트 스트림 패킷의 기준 클럭값과 그 값에 래치된 시스템 클럭값을 비교하여 시스템 클럭 제어값을 생성하는 과정;
    상기 생성된 클럭 제어값을 상기 각 채널의 로칼 패킷에 삽입하는 과정;
    상기 과정의 복수개 채널의 로칼 패킷을 다중화하여 멀티-프로그램 패킷을 생성하는 과정을 포함하는 멀티-프로그램 다중화 방법.
  2. 제1항에 있어서, 상기 시스템 클럭 제어값은 펄스폭변조 제어값임을 특징으로 하는 멀티-프로그램 다중화 방법.
  3. 제1항에 있어서, 상기 클럭 제어값 생성 과정은
    상기 추출된 각각의 트랜스포트 스트림 패킷으로부터 기준 클럭값을 추출하는 과정;
    상기 추출된 그 기준 클럭값의 추출 시점에서 시스템 클럭값을 래치하는 과정;
    상기 각 채널별로 상기 추출된 기준클럭값과 래치된 시스템 클럭값을 비교하여 오차값을 추출하는 과정;
    상기 추출된 오차값에 근거하여 각 채널에 대한 시스템 클럭 제어값을 생성하는 과정을 구비하는 것을 특징으로 하는 멀티-프로그램 다중화 방법.
  4. 제3항에 있어서, 상기 시스템 클럭 제어값은 시스템 클럭의 오차를 제어하는 PWM 제어값임을 특징으로 하는 멀티-프로그램 다중화 방법.
  5. 제1항에 있어서, 상기 로칼 패킷은 채널별 트랜스포트 스트림, 로칼 타임 스탬프, 시스템 클럭 제어값을 구비하는 것을 특징으로 하는 멀티-프로그램 다중화 방법.
  6. 멀티-프로그램 역-다중화 방법에 있어서,
    채널별 시스템 클럭 제어값이 삽입된 멀티-프로그램 패킷을 수신하는 과정;
    상기 수신된 멀티-프로그램 패킷으로부터 로칼 트랜스포트 ID와 시스템 클럭 제어값을 분리하는 과정;
    상기 로칼 트랜스포트 ID에 따라 로칼 트랜스포트 스트림 패킷을 분리하고 각 로칼 트랜스포트 스트림 패킷에 해당하는 시스템 클럭 제어값과 링크하는 과정;
    상기 선택된 로칼 트랜스포트 스트림 패킷에 해당하는 시스템 클럭 제어값을 참조하여 시스템 클럭을 제어하는 과정을 포함하는 멀티-프로그램 역 다중화 장치.
  7. 멀티-프로그램 다중화 장치에 있어서,
    방송 신호로부터 원하는 채널의 방송 신호를 선택하고, 각 채널의 방송 신호중에서 트랜스포트 스트림 패킷을 추출하는 적어도 하나 이상의 채널 디코더부;
    상기 채널 디코더부에서 추출된 각 채널의 트랜스포트 스트림 패킷의 동기 신호에 따라 로칼 타임 스탬프를 발생하는 로칼 타임 스탬프 발생부;
    상기 채널 디코더부에서 추출된 각 트랜스포트 스트림 패킷의 기준 클럭값과 그 값에 래치된 시스템 클럭값을 비교하여 시스템 클럭 제어값을 생성하는 기준 클럭 복구부;
    상기 채널 디코더부에서 발생하는 트랜스포트 스트림 패킷, 로칼 타임 스탬프 발생부에서 발생하는 로칼 타임 스탬프, 기준 클럭 복구부에서 생성되는 시스템 클럭 제어값를 바탕으로 각 채널별로 로칼 패킷을 발생하는 로칼 패킷 발생부;
    상기 로칼패킷 발생부에서 발생되는 각 채널의 로칼 패킷을 다중화하여 출력 주파수와 동기화된 패킷 시퀀스를 발생하는 다중화부를 포함하는 멀티-프로그램 다중화 장치.
  8. 제7항에 있어서, 상기 기준 클럭 복구부는
    상기 각 채널의 트랜스포트 스트림 패킷으로부터 기준 클럭값을 추출하는 기준 클럭 추출부;
    상기 기준 클럭값의 추출 시점에서 래치된 시스템 클럭값을 생성하는 시스템 클럭 생성부;
    상기 기준 클럭 추출부에서 추출된 기준클럭값과 상기 시스템 클럭 생성부에 서 생성된 시스템 클럭값을 비교하여 오차값을 추출하고, 그 오차값에 근거하여 각 채널에 대한 시스템 클럭 제어값을 생성하는 클럭 제어값 생성부를 구비하는 것을 특징으로 하는 멀티-프로그램 다중화 장치.
  9. 멀티-프로그램 역다중화 장치에 있어서,
    채널별로 시스템 클럭 제어값이 삽입된 멀티-프로그램 패킷으로부터 로칼 트랜스포트 ID와 시스템 클럭 제어값을 분리하는 패킷 역다중화부;
    상기 패킷 역 다중화부에서 분리된 로칼 트랜스포트 ID에 따라 로칼 트랜스포트 스트림 패킷을 분리하는 TS 역다중화부;
    상기 패킷 역 다중화부에서 분리된 각 채널의 시스템 클럭 제어값에 따라 각 채널에 대한 시스템 클럭들을 제어하는 클럭 제어부를 구비하는 것을 특징으로 하는 멀티-프로그램 역다중화 장치.
  10. 제9항에 있어서, 상기 클럭 제어부는
    상기 패킷 역 다중화부에서 분리된 각 채널의 시스템 클럭 제어값에 따라 PWM 신호를 발생하는 PWM 발생기;
    상기 PWM 발생기에서 발생하는 PWM신호를 저역 필터링하는 로우패스필터를 구비함을 특징으로 하는 멀티-프로그램 역다중화 장치.
  11. 멀티-프로그램 수신기기에 있어서,
    복수개 채널의 디코더로부터 각각 트랜스포트 스트림 패킷을 추출하고, 상기 추출된 각 트랜스포트 스트림 패킷의 기준 클럭값과 그 값에 래치된 시스템 클럭값을 비교하여 시스템 클럭 제어값을 생성하고, 상기 생성된 클럭 제어값을 상기 각 채널의 로칼 패킷에 삽입하고, 상기 복수개 채널의 로칼 패킷을 다중화하여 멀티-프로그램 패킷을 생성하는 다중화 수단; 및
    상기 다중화 수단으로부터 채널별 시스템 클럭 제어값이 삽입된 멀티-프로그램 패킷을 수신하고, 상기 수신된 멀티-프로그램 패킷으로부터 로칼 트랜스포트 ID와 시스템 클럭 제어값을 분리하고, 상기 로칼 트랜스포트 ID에 따라 로칼 트랜스포트 스트림 패킷을 분리하고 각 로칼 트랜스포트 스트림 패킷에 해당하는 시스템 클럭 제어값과 링크하고, 상기 선택된 로칼 트랜스포트 스트림 패킷에 해당하는 시스템 클럭 제어값을 참조하여 시스템 클럭을 제어하는 역 다중화 수단을 구비하는 것을 특징으로 하는 멀티-프로그램 수신기기.
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