KR20080004839A - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것으로, 영상 데이터의 전송 시점을 전송 라인의 길이에 따라 다르게 조절함으로써 영상 데이터의 전송을 안정시키고, 이에 따라 구현되는 영상의 화질의 악화를 방지하는 효과가 있다.
이러한, 본 발명의 플라즈마 디스플레이 장치는 어드레스 전극이 형성된 플라즈마 디스플레이 패널과, 입력되는 영상 신호에 따라 영상 데이터를 발생시켜 전송하는 타이밍 컨트롤러 및 어드레스 전극에 접속되고, 영상 데이터를 소정의 스위칭 동작을 통해 어드레스 전극으로 인가하는 복수의 데이터 구동부를 포함하고, 여기서 복수의 데이터 구동부는 제 1 데이터 구동부와 제 2 데이터 구동부를 포함하고, 제 1 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터의 전송 라인의 길이와 제 2 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이는 서로 다르고, 타이밍 컨트롤러는 제 1 데이터 구동부로 전송되는 영상 데이터의 전송 시점과 제 2 데이터 구동부로 전송되는 영상 데이터의 전송 시점을 서로 다르게 하는 것을 특징으로 한다.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}
도 1은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면.
도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면.
도 3은 본 발명의 플라즈마 디스플레이 패널에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면.
도 4는 본 발명의 플라즈마 디스플레이 패널의 동작의 일례를 설명하기 위한 도면.
도 5a 내지 도 5b는 상승 램프 신호 또는 제 2 하강 램프 신호의 또 다른 형태에 대해 설명하기 위한 도면.
도 6은 서스테인 신호의 또 다른 타입에 대해 설명하기 위한 도면.
도 7은 데이터 구동부와 타이밍 컨트롤러 간의 영상 데이터 송, 수신에 대하여 설명하기 위한 도면.
도 8a 내지 도 8b는 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 거리에 관계없이 영상 데이터의 전송 시점을 동일하게 하는 경우를 설명하기 위한 도면.
도 9는 본 발명에서와 같이 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 거리에 따라 영상 데이터의 전송 시점을 조절하는 경우를 설명하기 위한 도면.
도 10은 복수의 데이터 구동부 중 두 개 이상에서 영상 데이터의 전송 시점을 동일하게 하는 경우의 일례를 설명하기 위한 도면.
<도면의 주요 부분에 대한 부호의 설명>
100 : 전면 패널 110 : 후면 패널
120 : 플라즈마 디스플레이 패널 130 : 프레임
140 : 타이밍 컨트롤러 150 : 데이터 보드
160 : 연성 기판 170 : 데이터 구동부
본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.
플라즈마 디스플레이 장치는 전극이 형성된 플라즈마 디스플레이 패널과, 이러한 플라즈마 디스플레이 패널의 전극에 소정의 구동 신호를 인가하는 구동부를 포함하여 이루어진다.
일반적으로 플라즈마 디스플레이 패널에는 격벽으로 구획된 방전 셀(Cell) 내에 형광체 층이 형성되고, 아울러 복수의 전극(Electrode)이 형성된다.
그리고 구동부는 전극을 통해 방전 셀로 구동 신호를 인가한다.
그러면, 방전 셀 내에서는 공급되는 구동 신호에 의해 방전이 발생한다. 여기서, 방전 셀 내에서 구동 신호에 의해 방전이 될 때, 방전 셀 내에 충진 되어 있는 방전 가스가 진공자외선(Vacuum Ultraviolet rays)을 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체를 발광시켜 가시 광을 발생시킨다. 이러한 가시 광에 의해 플라즈마 디스플레이 패널의 화면상에 영상이 표시된다.
한편, 종래의 플라즈마 디스플레이 장치에서는 구동 신호의 전송 라인의 길이에 따라 구동 신호의 전송이 시간적으로 지연(Delay)된다.
아울러, 전송 라인의 길이가 달라지는 경우에 지연 시간이 연동하여 달라지고, 이에 따라 구동 신호의 전송이 불안정해지는 문제점이 발생한다.
이와 같이, 구동 신호의 전송이 불안정해지면 화면상에 구현되는 영상의 화질이 악화되는 문제점이 발생하다.
상술한 문제점을 해결하기 위해 본 발명은 구동 신호의 전송 라인의 길이에 따라 구동 신호의 전송 시점을 조절하여 구동 신호의 전송을 안정시키는 플라즈마 디스플레이 장치를 제공하는데 그 목적이 있다.
상술한 목적을 이루기 위한 본 발명의 플라즈마 디스플레이 장치는 어드레스 전극이 형성된 플라즈마 디스플레이 패널과, 입력되는 영상 신호에 따라 영상 데이터를 발생시켜 전송하는 타이밍 컨트롤러 및 어드레스 전극에 접속되고, 영상 데이터를 소정의 스위칭 동작을 통해 어드레스 전극으로 인가하는 복수의 데이터 구동 부를 포함하고, 여기서 복수의 데이터 구동부는 제 1 데이터 구동부와 제 2 데이터 구동부를 포함하고, 제 1 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터의 전송 라인의 길이와 제 2 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이는 서로 다르고, 타이밍 컨트롤러는 제 1 데이터 구동부로 전송되는 영상 데이터의 전송 시점과 제 2 데이터 구동부로 전송되는 영상 데이터의 전송 시점을 서로 다르게 하는 것을 특징으로 한다.
또한, 제 1 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터의 전송 라인의 길이는 제 2 데이터 구동부와 상기 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이보다 더 길고, 타이밍 컨트롤러는 제 1 데이터 구동부로 전송되는 영상 데이터의 전송 시점을 제 2 데이터 구동부로 전송되는 영상 데이터의 전송 시점 보다 더 앞서게 하는 것을 특징으로 한다.
또한, 타이밍 컨트롤러는 복수의 데이터 구동부 각각에 대하여 영상 데이터의 전송 시점을 각각 다르게 하는 것을 특징으로 한다.
또한, 타이밍 컨트롤러는 복수의 데이터 구동부 중 적어도 두 개 이상에 대하여 영상 데이터의 전송 시점을 서로 동일하게 하는 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치를 상세히 설명하기로 한다.
도 1은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면이다.
도 1을 살펴보면, 본 발명의 플라즈마 디스플레이 장치는 플라즈마 디스플레 이 패널(120), 타이밍 컨트롤러(140) 및 데이터 구동부(170a~170h)를 포함한다.
여기서, 플라즈마 디스플레이 패널(120)은 전면 패널(100)과 후면 패널(110)이 합착되어 이루어지는 것이 바람직하다.
아울러, 이러한 플라즈마 디스플레이 패널(120)의 배면에는 프레임(130)이 배치될 수 있다. 이러한 프레임(130)은 플라즈마 디스플레이 패널(120)을 지지하며 이와 함께 플라즈마 디스플레이 패널(120)에서 발생하는 열을 외부로 방출하는 역할을 수행할 수 있다. 또한, 이러한 프레임(130)은 타이밍 컨트롤러(140) 등이 배치될 수 있는 실질적인 공간을 제공할 수 있다.
타이밍 컨트롤러(140)는 프레임(130) 상에 배치되는 것이 바람직하고, 아울러 입력되는 영상 신호에 따라 영상 데이터를 발생시켜 전송한다.
데이터 구동부(170a~170h)는 플라즈마 디스플레이 패널(120)에 형성되는 어드레스 전극(미도시)에 접속되고, 타이밍 컨트롤러(140)가 발생시키는 영상 데이터를 소정의 스위칭 동작을 통해 플라즈마 디스플레이 패널(120)의 어드레스 전극(미도시)으로 인가한다.
이러한 데이터 구동부(170a~170h)는 연성을 갖는 연성 기판(160) 상에 배치되는 것이 바람직하다. 아울러 이러한 연성 기판(160)은 데이터 보드(150)에 고정되는 것이 바람직하다.
여기서, 데이터 보드(150)에는 타이밍 컨트롤러(140)가 발생시켜 전송한 영상 데이터를 수신하는 수신 회로가 탑재될 수 있다. 아울러 데이터 구동부(170a~170h)를 동작시키기 위한 다른 회로들도 탑재될 수 있다.
이러한 본 발명의 플라즈마 디스플레이 장치의 타이밍 컨트롤러(140) 및 데이터 구동부(170a~170h)에 대해서는 이후의 설명을 통해 보다 명확히 하도록 한다.
여기, 도 1에서는 데이터 구동부(170a~170h)만을 도시하였지만, 본 발명의 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(120)에 형성된 전극에 따라 또 다른 구동부를 포함하는 것이 바람직하다.
예를 들면, 플라즈마 디스플레이 패널(120)에는 스캔 전극(미도시), 서스테인 전극(미도시) 및 어드레스 전극(미도시)이 형성되고, 여기서 본 발명의 플라즈마 디스플레이 장치는 스캔 전극을 구동시키는 스캔 구동부(미도시)와, 서스테인 전극을 구동시키는 서스테인 구동부(미도시)를 더 포함할 수 있는 것이다.
여기서, 플라즈마 디스플레이 패널(120)에 대해 첨부된 도 2a 내지 도 2b를 결부하여 보다 상세히 살펴보면 다음과 같다.
도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면이다.
먼저, 도 2a를 살펴보면 본 발명의 플라즈마 디스플레이 패널은 전극(Electrode), 바람직하게는 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성되는 전면 기판(201)을 포함하는 전면 패널(200)과, 전술한 스캔 전극(202, Y) 및 서스테인 전극(203, Z)과 교차하는 전극, 바람직하게는 어드레스 전극(213, X)이 형성되는 후면 기판(211)을 포함하는 후면 패널(210)이 합착되어 이루어질 수 있다.
여기서, 전면 기판(201) 상에 형성되는 전극, 바람직하게는 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 방전 공간, 즉 방전 셀(Cell)에서 방전을 발생시키고 아울러 방전 셀의 방전을 유지할 수 있다.
이러한 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 형성된 전면 기판(201)의 상부에는 스캔 전극(202, Y)과 서스테인 전극(203, Z)을 덮도록 유전체 층, 바람직하게는 상부 유전체 층(204)이 형성될 수 있다.
이러한, 상부 유전체 층(204)은 스캔 전극(202, Y) 및 서스테인 전극(203, Z)의 방전 전류를 제한하며 스캔 전극(202, Y)과 서스테인 전극(203, Z) 간을 절연시킬 수 있다.
이러한, 상부 유전체 층(204) 상면에는 방전 조건을 용이하게 하기 위한 보호 층(205)이 형성된다. 이러한 보호 층(205)은 산화마그네슘(MgO) 등의 재료를 상부 유전체 층(204) 상부에 증착하는 방법 등을 통해 형성될 수 있다.
한편, 후면 기판(211) 상에 형성되는 전극, 바람직하게는 어드레스 전극(213, X)은 방전 셀에 데이터(Data) 신호를 인가하는 전극이다.
이러한 어드레스 전극(213, X)이 형성된 후면 기판(211)의 상부에는 어드레스 전극(213, X)을 덮도록 유전체 층, 바람직하게는 하부 유전체 층(215)이 형성될 수 있다.
이러한, 하부 유전체 층(215)은 어드레스 전극(213, X)을 절연시킬 수 있다.
이러한 하부 유전체 층(215)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(Stripe Type), 웰 타입(Well Type), 델타 타입(Delta Type), 벌집 타입 등의 격벽(212)이 형성된다. 이에 따라, 전면 기판(201)과 후면 기 판(211)의 사이에서 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 등의 방전 셀이 형성될 수 있다.
여기서, 격벽(212)에 의해 구획된 방전 셀 내에는 소정의 방전 가스가 채워지는 것이 바람직하다.
아울러, 격벽(212)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(214)이 형성될 수 있다. 예를 들면, 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성될 수 있다.
이상에서 설명한 본 발명의 플라즈마 디스플레이 패널에서는 스캔 전극(202, Y), 서스테인 전극(203, Z) 또는 어드레스 전극(213, X) 중 적어도 하나 이상의 전극으로 구동 신호가 공급되면, 격벽(212)에 의해 구획된 방전 셀 내에서 방전이 발생할 수 있다.
그러면, 방전 셀 내에 채워진 방전 가스에서 진공 자외선이 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체 층(214)에 가해진다. 그러면, 형광체 층(214)에서 소정의 가시광선이 발생되고, 이렇게 발생된 가시광선이 상부 유전체 층(204)이 형성된 전면 기판(201)을 통해 외부로 방출되고, 이에 따라 전면 기판(201)의 외부 면에 소정의 영상이 표시될 수 있다.
한편, 여기 도 2a의 설명에서는 스캔 전극(202, Y) 및 서스테인 전극(203, Z)이 각각 하나의 층(Layer)으로 이루어지는 경우만을 도시하고 설명하였지만, 이와는 다르게 스캔 전극(202, Y) 또는 서스테인 전극(203, Z) 중 하나 이상이 복수의 층으로 이루어지는 것도 가능하다. 이에 대해 도 2b를 참조하여 살펴보면 다음 과 같다.
도 2b를 살펴보면, 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 각각 두 개의 층(Layer)으로 이루어질 수 있다.
특히, 광 투과율 및 전기 전도도를 고려하면 방전 셀 내에서 발생한 광을 외부로 방출시키며 아울러 구동 효율을 확보하는 차원에서 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 불투명한 은(Ag) 재질의 버스 전극(202b, 203b)과 투명한 인듐 틴 옥사이드(Indium Tin Oxide : ITO) 재질의 투명 전극(202a, 203a)을 포함하는 것이 바람직하다.
이와 같이, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 투명 전극(202a, 203a)을 포함하도록 하는 이유는, 방전 셀 내에서 발생한 가시 광이 플라즈마 디스플레이 패널의 외부로 방출될 때 효과적으로 방출되도록 하기 위해서이다.
아울러, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 버스 전극(202b, 203b)을 포함하도록 하는 이유는, 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 투명 전극(202a, 203a)만을 포함하는 경우에는 투명 전극(202a, 203a)의 전기 전도도가 상대적으로 낮기 때문에 구동 효율이 감소할 수 있어서, 이러한 구동 효율의 감소를 야기할 수 있는 투명 전극(202a, 203a)의 낮은 전기 전도도를 보상하기 위해서이다.
이와 같이 스캔 전극(202, Y)과 서스테인 전극(203, Z)이 버스 전극(202b, 203b)을 포함하는 경우에, 버스 전극(202b, 203b)에 의한 외부 광의 반사를 방지하기 위해 투명 전극(202a, 203a)과 버스 전극(202b, 203b)의 사이에 블랙 층(Black Layer : 220, 221)이 더 구비되는 것이 바람직하다.
한편, 앞선 도 2b에서와 같은 구조에서 투명 전극(202a, 203a)이 생략되는 것도 가능하다. 다시 말해 ITO-Less 인 경우도 가능한 것이다.
예를 들면, 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 도 2b에서 투명 전극(202a, 203a)이 생략되고, 버스 전극(202b, 203b)만으로 이루어질 수 있다. 즉, 스캔 전극(202, Y)과 서스테인 전극(203, Z)은 버스 전극(202b, 203b)의 하나의 층(Layer)으로 이루어질 수 있다.
이상의 도 2a 내지 도 2b에서는 본 발명의 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명이 여기 도 2a 내지 도 2b와 같은 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 도 2a 내지 도 2b의 플라즈마 디스플레이 패널에는 상부 유전체 층(204) 및 하부 유전체 층(215)이 각각 하나의 층(Layer)인 경우만을 도시하고 있지만, 상부 유전체 층(204) 및 하부 유전체 층(215) 중 적어도 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.
아울러, 격벽(212)으로 인한 외부 광의 반사를 방지하기 위해 격벽(212)의 상부에 외부 광을 흡수할 수 있는 블랙 층(미도시)을 더 형성할 수도 있다.
이와 같이, 본 발명의 플라즈마 디스플레이 패널의 제조 장치가 적용될 수 있는 플라즈마 디스플레이 패널의 구조는 다양하게 변경될 수 있다.
이러한 플라즈마 디스플레이 패널의 동작의 일례에 대해 첨부된 도 3 내지 도 4를 결부하여 살펴보면 다음과 같다.
도 3은 본 발명의 플라즈마 디스플레이 패널에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면이다.
또한, 도 4는 본 발명의 플라즈마 디스플레이 패널의 동작의 일례를 설명하기 위한 도면이다.
먼저, 도 3을 살펴보면 본 발명의 플라즈마 디스플레이 패널에서 영상의 계조(Gray Level)를 구현하기 위한 프레임은 발광횟수가 다른 여러 서브필드로 나누어진다.
아울러, 도시하지는 않았지만 각 서브필드는 다시 모든 방전 셀을 초기화시키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어 질 수 있다.
예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 예컨대, 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.
한편, 서스테인 기간에 공급되는 서스테인 신호의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 즉, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제 1 서브필드의 계조 가중치를 20 으로 설정하고, 제 2 서브필드의 계조 가중치를 21 으로 설정하는 방법 으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가되도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 신호의 개수를 조절함으로써, 다양한 영상의 계조를 구현하게 된다.
본 발명의 플라즈마 디스플레이 패널은 영상을 구현하기 위해, 예컨대 1초의 영상을 표시하기 위해 복수의 프레임을 사용한다. 예를 들면, 1초의 영상을 표시하기 위해 60개의 프레임을 사용하는 것이다.
여기 도 3에서는 하나의 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제 1 서브필드부터 제 12 서브필드까지의 12개의 서브필드로 하나의 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 프레임을 구성할 수도 있는 것이다.
이러한, 프레임으로 영상의 계조를 구현하는 플라즈마 디스플레이 장치가 구현하는 영상의 화질은 프레임에 포함되는 서브필드의 개수에 따라 결정될 수 있다. 즉, 프레임에 포함되는 서브필드가 12개인 경우는 212 가지의 영상의 계조를 표현할 수 있고, 프레임에 포함되는 서브필드가 8개인 경우는 28 가지의 영상의 계조를 구현할 수 있게 되는 것이다.
또한, 여기 도 3에서는 하나의 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 프레임에서 서브필 드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있고, 또는 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.
다음, 도 4를 살펴보면 앞선 도 3과 같은 프레임에 포함된 복수의 서브필드 어느 하나의 서브필드(Subfield)에서의 본 발명의 플라즈마 디스플레이 장치의 동작의 일례가 나타나 있다.
먼저, 리셋 기간 이전의 프리(Pre) 리셋 기간에서 스캔 전극(Y)에 제 1 하강 램프(Ramp-Down) 신호가 인가될 수 있다.
아울러, 스캔 전극(Y)에 제 1 하강 램프 신호가 인가되는 동안 제 1 하강 램프 신호와 반대 극성 방향의 프리(Pre) 서스테인 신호가 서스테인 전극(Z)에 인가될 수 있다.
여기서, 스캔 전극(Y)에 인가되는 제 1 하강 램프 신호는 제 10 전압(V10)까지 점진적으로 하강하는 것이 바람직하다. 이러한 제 1 하강 램프 신호는 그라운드 레벨(GND)의 전압으로부터 점진적으로 하강하는 것이 더욱 바람직하다.
아울러, 프리 서스테인 신호는 프리 서스테인 전압(Vpz)을 실질적으로 일정하게 유지하는 것이 바람직하다. 여기서, 프리 서스테인 전압(Vpz)은 이후의 서스테인 기간에서 인가되는 서스테인 신호(SUS)의 전압, 즉 서스테인 전압(Vs)과 대략 동일한 전압인 것이 바람직하다.
이와 같이, 프리 리셋 기간에서 스캔 전극(Y)에 제 1 하강 램프 신호가 인가되고, 이와 함께 서스테인 전극(Z)에 프리 서스테인 신호가 인가되면 스캔 전극(Y) 상에 소정 극성의 벽 전하(Wall Charge)가 쌓이고, 서스테인 전극(Z) 상에는 스캔 전극(Y)과 반대 극성의 벽 전하들이 쌓인다. 예를 들면, 스캔 전극(Y) 상에는 양(+)의 벽 전하(Wall Charge)가 쌓이고, 서스테인 전극(Z) 상에는 음(-)의 벽 전하가 쌓이게 된다.
이에 따라, 이후의 리셋 기간에서 충분한 세기의 셋업 방전을 발생시킬 수 있게 되고, 결국 초기화를 충분히 안정적으로 수행할 수 있게 된다.
심지어는, 방전 셀 내에 벽 전하의 양이 부족한 경우에서도 충분한 세기의 셋업 방전을 발생시킬 수 있다.
아울러, 리셋 기간에서 스캔 전극(Y)으로 인가되는 상승 램프 신호(Ramp-Up)의 전압이 더 작아지더라도 충분한 세기의 셋업 방전을 발생시킬 수 있게 된다.
이상에서 설명한 프리 리셋 기간은 프레임(Frame)의 모든 서브필드에서 리셋 기간이전에 포함될 수 있다.
또는, 구동 시간을 확보하는 관점에서 프레임의 서브필드 중에서 계조 가중치가 가장 작은 하나의 서브필드에서 리셋 기간이전에 프리 리셋 기간이 포함되거나 또는 프레임의 서브필드 중 2개 또는 3개의 서브필드에서 리셋 기간이전에 프리 리셋 기간이 포함되는 것도 가능한 것이다.
또는, 이러한 프리 리셋 기간은 모든 서브필드에서 생략되는 것도 가능한 것이다.
프리 리셋 기간 이후, 초기화를 위한 리셋 기간의 셋업(Set-Up) 기간에서는 스캔 전극(Y)으로 제 1 하강 램프 신호와 반대 극성 방향의 상승 램프(Ramp-Up) 신호가 인가될 수 있다.
여기서, 상승 램프 신호는 제 20 전압(V20)부터 제 30 전압(V30)까지 제 1 기울기로 점진적으로 상승하는 제 1 상승 램프 신호와 제 30 전압(V30)부터 제 40 전압(V40)까지 제 2 기울기로 상승하는 제 2 상승 램프 신호를 포함할 수 있다.
이러한 셋업 기간에서는 상승 램프 신호에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓이게 된다.
여기서, 제 2 상승 램프 신호의 제 2 기울기는 제 1 기울기보다 더 완만한 것이 바람직하다. 이와 같이, 제 2 기울기를 제 1 기울기보다 더 완만하게 하게 되면, 셋업 방전이 발생하기 이전까지는 전압을 상대적으로 빠르게 상승시키고, 셋업 방전이 발생하는 동안에는 전압을 상대적으로 느리게 상승시키는 효과를 획득함으로써, 셋업 방전에 의해 발생하는 광의 양을 저감시킬 수 있다.
이에 따라, 콘트라스트(Contrast) 특성을 개선할 수 있다.
셋업 기간 이후의 셋다운(Set-Down) 기간에서는 상승 램프 신호 이후에 이러한 상승 램프 신호와 반대 극성 방향의 제 2 하강 램프(Ramp-Down) 신호가 스캔 전극(Y)에 인가될 수 있다.
여기서, 제 2 하강 램프 신호는 제 20 전압(V20)부터 제 50 전압(V50)까지 점진적으로 하강하는 것이 바람직하다.
이에 따라, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다.
한편, 여기 도 4와는 다르게 상승 램프 신호 또는 제 2 하강 램프 신호를 설정할 수도 있는데, 이에 대해 첨부된 도 5a 내지 도 5b를 결부하여 살펴보면 다음과 같다.
도 5a 내지 도 5b는 상승 램프 신호 또는 제 2 하강 램프 신호의 또 다른 형태에 대해 설명하기 위한 도면이다.
먼저, 도 5a를 살펴보면, 상승 램프 신호는 제 30 전압(V30)까지는 급격히 상승한 이후에 제 30 전압(V30)부터 제 40 전압(V40)까지 점진적으로 상승하는 형태이다.
이와 같이, 상승 램프 신호는 도 4에서와 같이 두 단계에 걸쳐 서로 다른 기울기로 점진적으로 상승하는 것도 가능하고, 여기 도 5a에서와 같이 하나의 단계에서 점진적으로 상승하는 것도 가능한 것과 같이, 다양한 형태로 변경되는 것이 가능한 것이다.
다음, 도 5b를 살펴보면 제 2 하강 램프 신호는 제 30 전압(V30)에서부터 전압이 점진적으로 하강하는 형태이다.
이와 같이, 제 2 하강 램프 신호는 전압이 하강하는 시점을 다르게 변경하는 것도 가능한 것과 같이, 다양한 형태로 변경되는 것이 가능한 것이다.
이상 도 5a 내지 도 5b에 대한 설명을 마무리하기로 한다.
한편, 리셋 기간 이후의 어드레스 기간에서는 제 2 하강 램프 신호의 제 50 전압(V50)보다는 높은 전압을 실질적으로 유지하는 스캔 바이어스 신호가 스캔 전극(Y)에 인가될 수 있다.
아울러, 스캔 바이어스 신호로부터 스캔 전압(ΔVy)만큼 하강하는 스캔 신호(Scan)가 모든 스캔 전극(Y1~Yn)에 인가될 수 있다.
예를 들면, 복수의 스캔 전극(Y) 중 첫 번째 스캔 전극(Y1)에 첫 번째 스캔 신호(Scan 1)가 인가되고, 이후에 두 번째 스캔 전극(Y2)에 두 번째 스캔 신호(Scan 2)가 인가되고, n 번째 스캔 전극(Yn)에는 n 번째 스캔 신호(Scan n)가 인가되는 것이다.
이와 같이, 스캔 신호(Scan)가 스캔 전극(Y)으로 인가될 때, 스캔 신호에 대응되게 어드레스 전극(X)에 데이터 전압의 크기(ΔVd)만큼 상승하는 데이터 신호가 인가될 수 있다.
여기서, 어드레스 전극(X)에 인가되는 데이터 신호의 발생과정의 일례에 대해 살펴보면 다음과 같다.
예를 들면, 앞선 도 1에서 부호 140의 타이밍 컨트롤러가 입력되는 영상 신호에 따라 영상 데이터를 발생시켜 전송한다. 그러면, 부호 170a~170h의 데이터 구동부가 이러한 영상 데이터를 소정의 스위칭 동작을 통해 어드레스 전극(X)으로 인가하는데, 이러한 부호 170a~170h의 데이터 구동부가 스위칭 동작을 통해 어드레스 전극(X)으로 인가하는 영상 데이터가 여기 도 4에서와 같은 데이터 신호인 것이다.
이러한 스캔 신호(Scan)와 데이터 신호(Data) 신호가 인가됨에 따라, 스캔 신호(Scan)의 전압과 데이터 신호의 데이터 전압(Vd) 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 신호의 전압(Vd)이 인가되는 방전 셀 내에는 어드레스 방전이 발생된다.
이러한, 어드레스 방전에 의해 선택된 방전 셀 내에는 이후의 서스테인 기간에서 서스테인 신호(SUS)가 인가될 때 서스테인 방전이 일어날 수 있게 하는 정도의 벽 전하가 형성된다.
여기서, 어드레스 기간에서 서스테인 전극(Z)의 간섭에 의해 어드레스 방전이 불안정해지는 것을 방지하기 위해 서스테인 전극(Z)에 서스테인 바이어스 신호가 인가되는 것이 바람직하다.
여기서, 서스테인 바이어스 신호는 서스테인 기간에서 인가되는 서스테인 신호의 전압보다는 작고 그라운드 레벨(GND)의 전압보다는 큰 서스테인 바이어스 전압(Vz)을 실질적으로 일정하게 유지하는 것이 바람직하다.
이후, 영상 표시를 위한 서스테인 기간에서는 스캔 전극(Y) 및/또는 서스테인 전극(Z)에 서스테인 신호(SUS)가 인가될 수 있다. 예를 들면, 스캔 전극(Y) 및 서스테인 전극(Z)에 번갈아가며 서스테인 신호(SUS)가 인가된다. 이러한 서스테인 신호(SUS)는 ΔVs 만큼의 전압의 크기를 갖는 것이 바람직하다.
이러한 서스테인 신호(SUS)가 인가되면, 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 신호(SUS)의 서스테인 전압(Vs)이 더해지면서 서스테인 신호(SUS)가 인가될 때 스캔 전극(Y)과 서스테인 전극(Z) 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다. 이에 따라, 플라즈마 디스플레이 패널 상에 소정의 영상이 구현되는 것이다.
이러한 도 4와는 다른 타입(Type)으로 서스테인 신호를 인가하는 것도 가능하다. 이에 대해 첨부된 도 6을 결부하여 살펴보면 다음과 같다.
도 6은 서스테인 신호의 또 다른 타입에 대해 설명하기 위한 도면이다.
도 6을 살펴보면, 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나의 전극, 예를 들면 스캔 전극에 양(+)의 서스테인 신호와 음(-)의 서스테인 신호가 번갈아가면서 인가된다.
이와 같이 어느 하나의 전극에 양의 서스테인 신호와 음의 서스테인 신호가 인가되는 동안 나머지 전극, 예컨대 서스테인 전극(Z)에는 바이어스 신호가 인가되는 것이 바람직하다.
여기서, 바이어스 신호는 그라운드 레벨(GND)의 전압을 실질적으로 일정하게 유지하는 것이 바람직하다.
이처럼, 서스테인 신호(SUS)의 형태는 다양하게 변경될 수 있다.
이와 같이 서스테인 기간에서 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나에만 서스테인 신호를 인가하고, 나머지 하나의 전극에는 바이어스 신호를 인가하게 되면, 구동부의 형태를 보다 단순화 할 수 있다.
예를 들어, 스캔 전극(Y)에도 서스테인 신호를 인가하고, 서스테인 전극(Z)에도 서스테인 신호를 인가하는 경우에는 스캔 전극(Y)에 서스테인 신호를 인가하기 위한 회로들이 배치되는 구동 보드(Board)와 서스테인 전극(Z)에 서스테인 신호를 인가하기 위한 회로들이 배치되는 구동 보드가 각각 필요하게 된다.
반면에, 본 발명에서와 같이 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나의 전극에만 서스테인 신호를 인가하는 경우에는 스캔 전극(Y) 또는 서스테인 전극(Z) 중 어느 하나의 전극에 서스테인 신호를 인가하기 위한 회로들이 배치되는 하나의 구동 보드만이 구비되면 된다.
이에 따라, 구동부의 전체 크기를 줄일 수 있고, 이에 따라 제조 단가를 저감시킬 수 있게 된다.
한편, 이상에서 설명한 바와 같이 어드레스 기간에서 어드레스 전극(X)으로 인가되는 데이터 신호는 도 1의 부호 170a~170h의 데이터 구동부가 부호 140의 타이밍 컨트롤러가 전송한 영상 데이터를 소정의 스위칭 동작을 통해 어드레스 전극(X)으로 인가하는 것인데, 이러한 데이터 신호를 어드레스 전극(X)으로 인가하기 위한 도 1의 부호 170a~170h의 데이터 구동부와 부호 140의 타이밍 컨트롤러 사이의 영상 데이터 송, 수신에 대해 보다 상세히 살펴보면 다음과 같다.
이하에서는, 앞선 도 1의 본 발명의 플라즈마 디스플레이 장치를 결부하여 설명하기로 한다.
도 7은 데이터 구동부와 타이밍 컨트롤러 간의 영상 데이터 송, 수신에 대하여 설명하기 위한 도면이다.
도 7을 살펴보면, 앞선 도 1의 부호 170a의 데이터 구동부로 전송되는 영상 데이터의 전송 시점과 부호 170b의 데이터 구동부로 전송되는 영상 데이터의 전송 시점은 서로 다르다. 즉, Δt1만큼 차이가 있다. 여기서, 170a의 데이터 구동부와 140의 타이밍 컨트롤러 사이의 영상 데이터의 전송 라인의 길이와 170b의 데이터 구동부와 140의 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이는 서로 다르다.
보다 자세하게는 170a의 데이터 구동부와 140의 타이밍 컨트롤러 사이의 영 상 데이터의 전송 라인의 길이와 170b의 데이터 구동부와 140의 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이는 서로 다른 경우에, 부호 140의 타이밍 컨트롤러가 170a의 데이터 구동부로 t0의 시점에서 영상 데이터를 전송하였다면, 170b의 데이터 구동부로는 t0+Δt1의 시점에서 영상 데이터를 전송함으로써 영상 데이터의 전송 시점 간의 차이가 Δt1이 되도록 하는 것이다.
아울러, 부호 170b의 데이터 구동부로 전송되는 영상 데이터의 전송 시점과 부호 170c의 데이터 구동부로 전송되는 영상 데이터의 전송 시점은 서로 다르다. 즉, Δt2만큼 차이가 있다.
여기서, 140의 타이밍 컨트롤러는 복수의 데이터 구동부(170a~170h)에 대하여 각각에 대하여 영상 데이터의 전송 시점을 각각 다르게 하는 것이 바람직하다.
즉, 170a부터 170h까지의 데이터 구동부로의 영상 데이터 전송 시점이 각각 서로 다른 것이다.
여기서, 다시 도 1을 살펴보면 부호 170a의 데이터 구동부와 부호 140의 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이가 부호 170b의 데이터 구동부와 부호 140의 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이보다 더 긴 것을 확인할 수 있다.
이와 같은 경우에는, 부호 170a의 데이터 구동부로 전송되는 영상 데이터의 전송 시점이 부호 170b의 데이터 구동부로 전송되는 영상 데이터의 전송 시점보다 더 앞서도록 하는 것이 바람직하다.
보다 자세하게는 부호 140의 타이밍 컨트롤러가 170a의 데이터 구동부로 영 상 데이터를 전송한 이후에 부호 170b의 데이터 구동부에 영상 데이터를 전송하는 것이다.
이와 같이, 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 거리에 따라 영상 데이터의 전송 시점을 조절하는 이유에 대해 첨부된 도 8a 내지 도 8b 및 도 9를 결부하여 살펴보면 다음과 같다.
도 8a 내지 도 8b는 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 거리에 관계없이 영상 데이터의 전송 시점을 동일하게 하는 경우를 설명하기 위한 도면이다.
또한, 도 9는 본 발명에서와 같이 데이터 구동부와 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 거리에 따라 영상 데이터의 전송 시점을 조절하는 경우를 설명하기 위한 도면이다.
먼저, 도 8a를 살펴보면 도 1의 경우에서의 부호 170a, 170b, 170c의 데이터 구동부와 140의 타이밍 컨트롤러와의 영상 데이터 전송 라인의 길이가 나타나 있다.
즉, 부호 170a의 데이터 구동부와 140의 타이밍 컨트롤러와의 영상 데이터 전송 라인의 길이가 가장 긴 L1이고, 부호 170b의 데이터 구동부와 140의 타이밍 컨트롤러와의 영상 데이터 전송 라인의 길이가 L1보다는 짧은 L2이고, 부호 170c의 데이터 구동부와 140의 타이밍 컨트롤러와의 영상 데이터 전송 라인의 길이가 가장 짧은 L3이다.
다음, 도 8b를 살펴보면 앞선 도 8a와 같은 경우에 영상 데이터의 전송 라인 의 길이에 관계없이 영상 데이터의 전송 시점을 동일하게 하는 경우에 각각의 데이터 구동부에서의 영상 데이터 검출의 일례가 나타나 있다. 여기 도 8b에서는 앞선 도 7과는 다르게 부호 170a, 170b, 170c의 배열 순서가 역순인 것을 확인해 주기 바란다.
여기서, 데이터 구동부는 클록(CLK) 신호를 이용하여 140의 타이밍 컨트롤러가 전송하는 영상 데이터를 읽어낸다. 예를 들면, 클록(CLK)의 상승 에지(Rising Edge)에서 영상 데이터의 레벨(Level)을 검출함으로써 영상 데이터를 읽어낼 수 있다.
여기서, 부호 170c의 데이터 구동부와 140의 타이밍 컨트롤러 사이의 전송 라인의 길이가 L3으로서 가장 짧기 때문에 전송 라인 상의 임피턴스(Impedance) 값도 가장 작다. 이에 따라 상대적으로 빠르게 영상 데이터가 전송될 수 있다.
반면에, 부호 170b의 데이터 구동부와 140의 타이밍 컨트롤러 사이의 전송 라인의 길이는 L3보다는 긴 L2이기 때문에 전송 라인 상의 임피턴스(Impedance) 값도 L3의 경우보다는 크다. 이에 따라 영상 데이터의 전송 시에 임피던스 값에 의해 전송 지연(Delay)이 발생한다. 예를 들면, L3의 경우보다 L2의 경우가 Δt만큼 전송이 지연되는 것이다.
이러한 이유로 인해 L1의 경우에는 L2 및 L3의 경우보다 영상 데이터의 전송 시점이 더욱 지연된다.
이에 따라, 클록(CLK) 신호의 첫 번째 상승 에지에서 부호 170c와 170b의 데이터 구동부는 하이(High) 레벨의 영상 데이터를 읽어낼 수 있지만, 부호 170a의 데이터 구동부는 170b와 170c의 데이터 구동부와는 다르게 로우(Low) 레벨의 영상 데이터를 읽어내는 것이다.
결국, 140의 타이밍 컨트롤러가 부호 170a, 170b, 170c의 데이터 구동부로 각각 동일한 영상 데이터를 전송하더라도, 170b와 170c의 데이터 구동부는 정상적으로 영상 데이터를 수신할 수 있지만, 부호 170a의 데이터 구동부는 정상적으로 영상 데이터를 수신할 수 없게 되는 것이다.
이러한 경우에는 구동 신호, 즉 영상 데이터의 전송이 불안정한 경우로서, 화면상에 구현되는 영상의 화질이 악화될 수 있다.
반면에, 다음 도 9를 살펴보면 (a)와 같이 부호 170a, 170b, 170c의 데이터 구동부로의 영상 데이터 전송 시점을 다르게, 바람직하게는 부호 170a의 데이터 구동부로의 영상 데이터 전송 시점을 가장 빠르게 하고, 부호 170b, 170c의 데이터 구동부로의 순서로 영상 데이터 전송 시점을 조절하게 되면, 앞선 도 8a에서와 같이 부호 170a, 170b, 170c의 데이터 구동부와 140의 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이가 서로 다르더라도 전송 라인의 임피던스 값에 의해 각각 다르게 발생하는 전송 지연을 충분히 보상할 수 있다. 여기 도 9에서는 앞선 도 8b의 경우와는 다르게 170a, 170b, 170c의 배열 순서가 역순인 것을 확인해 주기 바란다.
이에 따라, (b)에서와 같이 부호 170a, 170b, 170c의 데이터 구동부에 각각 수신되는 영상 데이터는 전송 지연의 정도가 실질적으로 동일하게 되고, 이에 따라 부호 170a, 170b, 170c의 데이터 구동부는 모두 동일하게 영상 데이터를 정상적으 로 읽어낼 수 있게 되는 것이다.
여기, (b)에 도시된 클록(CLK) 신호의 첫 번째 상승 에지에서의 부호 170a, 170b, 170c의 데이터 구동부에 전송된 영상 데이터가 모두 하이 레벨인 것을 주목해 주기 바란다.
이에 따라, 구동 신호, 즉 영상 데이터의 전송이 안정되고, 이에 따라 구현되는 영상의 화질 악화를 방지할 수 있다.
한편, 이상에서는 복수의 데이터 구동부에 대하여 영상 데이터의 전송 시점을 각각 다르게 하는 것으로 설명하였지만, 이와는 다르게 복수의 데이터 구동부 중 두 개 이상에서 영상 데이터의 전송 시점을 동일하게 하는 것도 가능하다. 이에 대해 첨부된 도 10을 결부하여 살펴보면 다음과 같다.
도 10은 복수의 데이터 구동부 중 두 개 이상에서 영상 데이터의 전송 시점을 동일하게 하는 경우의 일례를 설명하기 위한 도면이다.
도 10을 살펴보면, 각각 하나의 어드레스 전극(X)과 연결되는 10개의 데이터 구동부(1010a~1010j)를 가정하자. 이러한 10개의 데이터 구동부(1010a~1010j)에 타이밍 컨트롤러(1000)가 영상 데이터를 전송한다.
여기서, 타이밍 컨트롤러(1000)는 X1, X2, X3 어드레스 전극에 각각 연결되는 1010a, 1010b, 1010c의 데이터 구동부와 X8, X9, X10 어드레스 전극에 각각 연결되는 1010h, 1010i, 1010j의 데이터 구동부에는 모두 t1의 시점에서 영상 데이터를 전송할 수 있다.
즉, 영상 데이터의 전송 라인의 길이가 유사한 1010a, 1010b, 1010c, 1010h, 1010i, 1010j의 데이터 구동부에는 실질적으로 동일한 시점에서 영상 데이터를 전송하는 것이다.
반면에, 영상 데이터의 전송 라인의 길이가 상대적으로 짧으며 X4, X5, X6, X7 어드레스 전극에 각각 연결되는 1010d, 1010e, 1010f, 1010g의 데이터 구동부에는 t1+Δt의 시점에서 영상 데이터를 전송할 수 있다.
이와 같이, 타이밍 컨트롤러(1000)는 복수의 데이터 구동부(1010a~1010j) 중 적어도 두 개 이상에 대하여 영상 데이터의 전송 시점을 서로 동일하게 하는 것도 가능한 것이다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이상에서 상세히 설명한 바와 같이 본 발명의 플라즈마 디스플레이 장치는 영상 데이터의 전송 시점을 전송 라인의 길이에 따라 다르게 조절함으로써 영상 데이터의 전송을 안정시키고, 이에 따라 구현되는 영상의 화질의 악화를 방지하는 효 과가 있다.

Claims (4)

  1. 어드레스 전극이 형성된 플라즈마 디스플레이 패널;
    입력되는 영상 신호에 따라 영상 데이터를 발생시켜 전송하는 타이밍 컨트롤러; 및
    상기 어드레스 전극에 접속되고, 상기 영상 데이터를 소정의 스위칭 동작을 통해 상기 어드레스 전극으로 인가하는 복수의 데이터 구동부;
    를 포함하고,
    상기 복수의 데이터 구동부는 제 1 데이터 구동부와 제 2 데이터 구동부를 포함하고,
    상기 제 1 데이터 구동부와 상기 타이밍 컨트롤러 사이의 영상 데이터의 전송 라인의 길이와 상기 제 2 데이터 구동부와 상기 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이는 서로 다르고,
    상기 타이밍 컨트롤러는
    상기 제 1 데이터 구동부로 전송되는 영상 데이터의 전송 시점과 상기 제 2 데이터 구동부로 전송되는 영상 데이터의 전송 시점을 서로 다르게 하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  2. 제 1 항에 있어서,
    상기 제 1 데이터 구동부와 상기 타이밍 컨트롤러 사이의 영상 데이터의 전 송 라인의 길이는 상기 제 2 데이터 구동부와 상기 타이밍 컨트롤러 사이의 영상 데이터 전송 라인의 길이보다 더 길고,
    상기 타이밍 컨트롤러는
    상기 제 1 데이터 구동부로 전송되는 영상 데이터의 전송 시점을 상기 제 2 데이터 구동부로 전송되는 영상 데이터의 전송 시점 보다 더 앞서게 하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 제 1 항에 있어서,
    상기 타이밍 컨트롤러는
    상기 복수의 데이터 구동부 각각에 대하여 상기 영상 데이터의 전송 시점을 각각 다르게 하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  4. 제 1 항에 있어서,
    상기 타이밍 컨트롤러는
    상기 복수의 데이터 구동부 중 적어도 두 개 이상에 대하여 상기 영상 데이터의 전송 시점을 서로 동일하게 하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
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