KR20080008914A - 플라즈마 디스플레이 장치 - Google Patents

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Abstract

본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것으로, 입력되는 영상 신호의 주파수의 변경 시 제 1 기간 동안 구동부의 스위칭 소자를 오프시킴으로써, 스위칭 소자의 오동작 및 손상을 방지하는 효과가 있다.
이러한, 본 발명의 플라즈마 디스플레이 장치는 전극이 형성된 플라즈마 디스플레이 패널과, 전극에 구동 신호를 인가하는 구동부를 포함하고, 여기서 구동부는 스위칭(Switching) 동작을 수행하는 스위칭 소자를 포함하고, 입력되는 영상 신호의 주파수가 변경되는 경우에 제 1 기간 동안 스위칭 소자를 오프(Off)시키는 것이 바람직하다.

Description

플라즈마 디스플레이 장치{Plasma Display Apparatus}
도 1은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면.
도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면.
도 3은 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면.
도 4는 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면.
도 5a 내지 도 5b는 상승 램프 신호 또는 제 2 하강 램프 신호의 또 다른 형태에 대해 설명하기 위한 도면.
도 6은 서스테인 신호의 또 다른 타입에 대해 설명하기 위한 도면.
도 7a 내지 도 7b는 입력되는 영상 신호의 주파수가 변경되는 경우의 동작의 일례를 설명하기 위한 도면.
도 8은 입력되는 영상 신호의 변경 시 제 1 기간 동안 스위칭 소자를 오프시키는 이유에 대해 설명하기 위한 도면.
도 9a 내지 도 9d는 제 1 기간 또는 제 2 기간에서의 구동부의 동작의 일례를 보다 상세히 설명하기 위한 도면.
<도면의 주요 부분에 대한 부호의 설명>
100 : 플라즈마 디스플레이 패널 110 : 구동부
본 발명은 플라즈마 디스플레이 장치(Plasma Display Apparatus)에 관한 것이다.
플라즈마 디스플레이 장치는 전극이 형성된 플라즈마 디스플레이 패널과, 이러한 플라즈마 디스플레이 패널의 전극에 소정의 구동 신호를 인가하는 구동부를 포함하여 이루어진다.
일반적으로 플라즈마 디스플레이 패널에는 격벽으로 구획된 방전 셀(Cell) 내에 형광체 층이 형성되고, 아울러 복수의 전극(Electrode)이 형성된다.
그리고 구동부는 전극을 통해 방전 셀로 구동 신호를 인가한다.
그러면, 방전 셀 내에서는 공급되는 구동 신호에 의해 방전이 발생한다. 여기서, 방전 셀 내에서 구동 신호에 의해 방전이 될 때, 방전 셀 내에 충진 되어 있는 방전 가스가 진공자외선(Vacuum Ultraviolet rays)을 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체를 발광시켜 가시 광을 발생시킨다. 이러한 가시 광에 의해 플라즈마 디스플레이 패널의 화면상에 영상이 표시된다.
한편, 종래의 플라즈마 디스플레이 장치에서는 입력되는 영상 신호의 주파수의 변경 시 구동부의 스위칭(Switching) 소자가 손상을 입는 문제점이 있다.
상술한 문제점을 해결하기 위해 본 발명은 입력되는 영상 신호의 주파수의 변경 시 구동부의 동작을 개선하여 스위칭 소자의 손상을 방지하는 플라즈마 디스플레이 장치를 제공하는데 그 목적이 있다.
상술한 목적을 이루기 위한 본 발명의 플라즈마 디스플레이 장치는 전극이 형성된 플라즈마 디스플레이 패널과, 전극에 구동 신호를 인가하는 구동부를 포함하고, 여기서 구동부는 스위칭(Switching) 동작을 수행하는 스위칭 소자를 포함하고, 입력되는 영상 신호의 주파수가 변경되는 경우에 제 1 기간 동안 스위칭 소자를 오프(Off)시키는 것이 바람직하다.
또한, 구동부는 입력되는 영상 신호의 주파수가 증가하는 경우에 제 1 기간 동안 스위칭 소자를 오프시키는 것을 특징으로 한다.
또한, 제 1 기간은 주파수 변경 시 인가되는 첫 번째 수직 동기 신호(Vertical Synchronizing Signal)의 인가시점부터 시작되는 것을 특징으로 한다.
또한, 제 1 기간의 길이는 대략 40ns(나노초)이상 2㎲(마이크로초)이하인 것을 특징으로 한다.
또한, 구동부는 제 1 기간 이후에 제 2 기간 동안 상기 스위칭 소자로 특정 신호를 인가하는 것을 특징으로 한다.
또한, 특정 신호는 전극으로 그라운드 레벨(GND)의 전압을 인가하도록 하는 신호인 것을 특징으로 한다.
또한, 제 2 기간의 길이는 대략 100㎲(마이크로초)이상 300㎲(마이크로초)이하인 것을 특징으로 한다.
또한, 제 1 기간과 제 2 기간의 길이의 합은 하나의 수직 동기 신호의 폭과 실질적으로 동일한 것을 특징으로 한다.
이하, 첨부된 도면을 참조하여 본 발명의 플라즈마 디스플레이 장치를 상세히 설명하기로 한다.
도 1은 본 발명의 플라즈마 디스플레이 장치의 구성을 설명하기 위한 도면이다.
도 1을 살펴보면, 본 발명의 플라즈마 디스플레이 장치는 플라즈마 디스플레이 패널(100)과 구동부(110)를 포함한다.
구동부(110)는 스위칭(Switching) 동작을 수행하는 스위칭 소자를 포함하고, 입력되는 영상 신호의 주파수가 변경되는 경우에 제 1 기간 동안 스위칭 소자를 오프(Off)시킨다.
여기, 도 1에서는 구동부(110)가 하나의 보드(Board) 형태로 이루어지는 경우만 도시하고 있지만, 본 발명에서 구동부(110)는 플라즈마 디스플레이 패널(100)에 형성된 전극에 따라 복수개의 보드 형태로 나누어지는 것도 가능하다.
예를 들면, 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널(100)에 서로 나란한 제 1 전극과 제 2 전극 및 이러한 제 1 전극과 제 2 전극에 교차하는 제 3 전극이 형성되는 경우에, 구동부(110)는 제 1 전극을 구동시키는 제 1 구동부(미도시)와, 제 2 전극을 구동시키는 제 2 구동부와, 제 3 전극 을 구동시키는 제 3 구동부(미도시)로 나누어질 수 있는 것이다.
이러한 본 발명의 플라즈마 디스플레이 장치의 구동부(110)에 대해서는 이후의 설명을 통해 보다 명확히 하도록 한다.
여기서, 플라즈마 디스플레이 패널(100)의 구조의 일례를 첨부된 도 2a 내지 도 2b를 결부하여 상세히 살펴보면 다음과 같다.
도 2a 내지 도 2b는 본 발명의 플라즈마 디스플레이 장치에 포함되는 플라즈마 디스플레이 패널의 구조의 일례를 설명하기 위한 도면이다.
먼저, 도 2a를 살펴보면 본 발명의 플라즈마 디스플레이 패널은 전극(Electrode), 바람직하게는 서로 나란한 제 1 전극(202)과 제 2 전극(203)이 형성되는 전면 기판(201)을 포함하는 전면 패널(200)과, 전술한 제 1 전극(202) 및 제 2 전극(203)과 교차하는 전극, 바람직하게는 제 3 전극(213)이 형성되는 후면 기판(211)을 포함하는 후면 패널(210)이 합착되어 이루어질 수 있다.
여기서, 전면 기판(201) 상에 형성되는 전극, 바람직하게는 제 1 전극(202)과 제 2 전극(203)은 방전 공간, 즉 방전 셀(Cell)에서 방전을 발생시키고 아울러 방전 셀의 방전을 유지할 수 있다.
이러한 제 1 전극(202)과 제 2 전극(203)이 형성된 전면 기판(201)의 상부에는 제 1 전극(202)과 제 2 전극(203)을 덮도록 유전체 층, 바람직하게는 상부 유전체 층(204)이 형성될 수 있다.
이러한, 상부 유전체 층(204)은 제 1 전극(202) 및 제 2 전극(203)의 방전 전류를 제한하며 제 1 전극(202)과 제 2 전극(203)간을 절연시킬 수 있다.
이러한, 상부 유전체 층(204) 상면에는 방전 조건을 용이하게 하기 위한 보호 층(205)이 형성될 수 있다. 이러한 보호 층(205)은 산화마그네슘(MgO) 등의 재료를 상부 유전체 층(204) 상부에 증착하는 방법 등을 통해 형성될 수 있다.
한편, 후면 기판(211) 상에 형성되는 전극, 바람직하게는 제 3 전극(213)은 방전 셀에 데이터(Data) 신호를 인가하는 전극이다.
이러한 제 3 전극(213)이 형성된 후면 기판(211)의 상부에는 제 3 전극(213)을 덮도록 유전체 층, 바람직하게는 하부 유전체 층(215)이 형성될 수 있다.
이러한, 하부 유전체 층(215)은 제 3 전극(213)을 절연시킬 수 있다.
이러한 하부 유전체 층(215)의 상부에는 방전 공간 즉, 방전 셀을 구획하기 위한 스트라이프 타입(Stripe Type), 웰 타입(Well Type), 델타 타입(Delta Type), 벌집 타입 등의 격벽(212)이 형성된다. 이에 따라, 전면 기판(201)과 후면 기판(211)의 사이에서 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 등의 방전 셀이 형성될 수 있다.
여기서, 격벽(212)에 의해 구획된 방전 셀 내에는 소정의 방전 가스가 채워지는 것이 바람직하다.
아울러, 격벽(212)에 의해 구획된 방전 셀 내에는 어드레스 방전 시 화상표시를 위한 가시 광을 방출하는 형광체 층(214)이 형성될 수 있다. 예를 들면, 적색(Red : R), 녹색(Green : G), 청색(Blue : B) 형광체 층이 형성될 수 있다.
이상에서 설명한 본 발명의 플라즈마 디스플레이 패널에서는 제 1 전극(202), 제 2 전극(203) 또는 제 3 전극(213) 중 적어도 하나 이상의 전극으로 구 동 신호가 공급되면, 격벽(212)에 의해 구획된 방전 셀 내에서 방전이 발생할 수 있다.
그러면, 방전 셀 내에 채워진 방전 가스에서 진공 자외선이 발생하고, 이러한 진공 자외선이 방전 셀 내에 형성된 형광체 층(214)에 가해진다. 그러면, 형광체 층(214)에서 소정의 가시광선이 발생되고, 이렇게 발생된 가시광선이 상부 유전체 층(204)이 형성된 전면 기판(201)을 통해 외부로 방출되고, 이에 따라 전면 기판(201)의 외부 면에 소정의 영상이 표시될 수 있다.
한편, 여기 도 2a의 설명에서는 제 1 전극(202) 및 제 2 전극(203)이 각각 하나의 층(Layer)으로 이루어지는 경우만을 도시하고 설명하였지만, 이와는 다르게 제 1 전극(202) 또는 제 2 전극(203) 중 하나 이상이 복수의 층으로 이루어지는 것도 가능하다. 이에 대해 도 2b를 참조하여 살펴보면 다음과 같다.
도 2b를 살펴보면, 제 1 전극(202)과 제 2 전극(203)은 각각 두 개의 층(Layer)으로 이루어질 수 있다.
특히, 광 투과율 및 전기 전도도를 고려하면 방전 셀 내에서 발생한 광을 외부로 방출시키며 아울러 구동 효율을 확보하는 차원에서 제 1 전극(202)과 제 2 전극(203)은 불투명한 은(Ag) 재질의 버스 전극(202b, 203b)과 투명한 인듐 틴 옥사이드(Indium Tin Oxide : ITO) 재질의 투명 전극(202a, 203a)을 포함하는 것이 바람직하다.
이와 같이, 제 1 전극(202)과 제 2 전극(203)이 투명 전극(202a, 203a)을 포함하도록 하는 이유는, 방전 셀 내에서 발생한 가시 광이 플라즈마 디스플레이 패 널의 외부로 방출될 때 효과적으로 방출되도록 하기 위해서이다.
아울러, 제 1 전극(202)과 제 2 전극(203)이 버스 전극(202b, 203b)을 포함하도록 하는 이유는, 제 1 전극(202)과 제 2 전극(203)이 투명 전극(202a, 203a)만을 포함하는 경우에는 투명 전극(202a, 203a)의 전기 전도도가 상대적으로 낮기 때문에 구동 효율이 감소할 수 있어서, 이러한 구동 효율의 감소를 야기할 수 있는 투명 전극(202a, 203a)의 낮은 전기 전도도를 보상하기 위해서이다.
이와 같이 제 1 전극(202)과 제 2 전극(203)이 버스 전극(202b, 203b)을 포함하는 경우에, 버스 전극(202b, 203b)에 의한 외부 광의 반사를 방지하기 위해 투명 전극(202a, 203a)과 버스 전극(202b, 203b)의 사이에 블랙 층(Black Layer : 220, 221)이 더 구비되는 것이 바람직하다.
한편, 앞선 도 2b에서와 같은 구조에서 투명 전극(202a, 203a)이 생략되는 것도 가능하다. 다시 말해 ITO-Less 인 경우도 가능한 것이다.
예를 들면, 제 1 전극(202)과 제 2 전극(203)은 도 2b에서 투명 전극(202a, 203a)이 생략되고, 버스 전극(202b, 203b)만으로 이루어질 수 있다. 즉, 제 1 전극(202)과 제 2 전극(203)은 버스 전극(202b, 203b)의 하나의 층(Layer)으로 이루어질 수 있다.
이상의 도 2a 내지 도 2b에서는 본 발명의 플라즈마 디스플레이 패널의 일례만을 도시하고 설명한 것으로써, 본 발명이 여기 도 2a 내지 도 2b와 같은 구조의 플라즈마 디스플레이 패널에 한정되는 것은 아님을 밝혀둔다. 예를 들면, 여기 도 2a 내지 도 2b의 플라즈마 디스플레이 패널에는 상부 유전체 층(204) 및 하부 유전 체 층(215)이 각각 하나의 층(Layer)인 경우만을 도시하고 있지만, 상부 유전체 층(204) 및 하부 유전체 층(215) 중 적어도 하나 이상은 복수의 층으로 이루지는 것도 가능한 것이다.
아울러, 격벽(212)으로 인한 외부 광의 반사를 방지하기 위해 격벽(212)의 상부에 외부 광을 흡수할 수 있는 블랙 층(미도시)을 더 형성할 수도 있다.
이와 같이, 본 발명의 플라즈마 디스플레이 장치에 적용되는 플라즈마 디스플레이 패널의 구조는 다양하게 변경될 수 있다.
이러한 플라즈마 디스플레이 패널을 포함하는 본 발명의 플라즈마 디스플레이 장치의 동작의 일례에 대해 첨부된 도 3 내지 도 4를 결부하여 살펴보면 다음과 같다. 여기서는, 입력되는 영상 신호의 주파수가 실질적으로 일정하게 유지되는 경우에 대해 설명하는 것임을 미리 밝혀둔다.
도 3은 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조를 구현하기 위한 프레임(Frame)에 대해 설명하기 위한 도면이다.
또한, 도 4는 본 발명의 플라즈마 디스플레이 장치의 동작의 일례를 설명하기 위한 도면이다.
먼저, 도 3을 살펴보면 본 발명의 플라즈마 디스플레이 장치에서 영상의 계조(Gray Level)를 구현하기 위한 프레임은 발광횟수가 다른 여러 서브필드로 나누어진다.
아울러, 도시하지는 않았지만 각 서브필드는 다시 모든 방전 셀을 초기화시키기 위한 리셋 기간(Reset Period), 방전될 방전 셀을 선택하기 위한 어드레스 기 간(Address Period) 및 방전횟수에 따라 계조를 구현하는 서스테인 기간(Sustain Period)으로 나누어 질 수 있다.
예를 들어, 256 계조로 영상을 표시하고자 하는 경우에 1/60 초에 해당하는 프레임기간(16.67ms)은 예컨대, 도 3과 같이 8개의 서브필드들(SF1 내지 SF8)로 나누어지고, 8개의 서브 필드들(SF1 내지 SF8) 각각은 리셋 기간, 어드레스 기간 및 서스테인 기간으로 다시 나누어지게 된다.
한편, 서스테인 기간에 공급되는 서스테인 신호의 개수를 조절하여 해당 서브필드의 계조 가중치를 설정할 수 있다. 즉, 서스테인 기간을 이용하여 각각의 서브필드에 소정의 계조 가중치를 부여할 수 있다. 예를 들면, 제 1 서브필드의 계조 가중치를 20 으로 설정하고, 제 2 서브필드의 계조 가중치를 21 으로 설정하는 방법으로 각 서브필드의 계조 가중치가 2n(단, n = 0, 1, 2, 3, 4, 5, 6, 7)의 비율로 증가되도록 각 서브필드의 계조 가중치를 결정할 수 있다. 이와 같이 각 서브필드에서 계조 가중치에 따라 각 서브필드의 서스테인 기간에서 공급되는 서스테인 신호의 개수를 조절함으로써, 다양한 영상의 계조를 구현하게 된다.
이러한 본 발명의 플라즈마 디스플레이 장치는 1초의 영상을 표시하기 위해 복수의 프레임을 사용한다. 예를 들면, 1초의 영상을 표시하기 위해 60개의 프레임을 사용하는 것이다.
여기 도 3에서는 하나의 프레임이 8개의 서브필드로 이루어진 경우만으로 도시하고 설명하였지만, 이와는 다르게 하나의 프레임을 이루는 서브필드의 개수는 다양하게 변경될 수 있다. 예를 들면, 제 1 서브필드부터 제 12 서브필드까지의 12개의 서브필드로 하나의 프레임을 구성할 수도 있고, 10개의 서브필드로 하나의 프레임을 구성할 수도 있는 것이다.
이러한, 프레임으로 영상의 계조를 구현하는 플라즈마 디스플레이 장치가 구현하는 영상의 화질은 프레임에 포함되는 서브필드의 개수에 따라 결정될 수 있다. 즉, 프레임에 포함되는 서브필드가 12개인 경우는 212 가지의 영상의 계조를 표현할 수 있고, 프레임에 포함되는 서브필드가 8개인 경우는 28 가지의 영상의 계조를 구현할 수 있게 되는 것이다.
또한, 여기 도 3에서는 하나의 프레임에서 계조 가중치의 크기가 증가하는 순서에 따라 서브필드들이 배열되었지만, 이와는 다르게 하나의 프레임에서 서브필드들이 계조 가중치가 감소하는 순서에 따라 배열될 수도 있고, 또는 계조 가중치에 관계없이 서브필드들이 배열될 수도 있는 것이다.
다음, 도 4를 살펴보면 앞선 도 3과 같은 프레임에 포함된 복수의 서브필드 어느 하나의 서브필드(Subfield)에서의 본 발명의 플라즈마 디스플레이 장치의 동작의 일례가 나타나 있다.
앞선, 도 1의 부호 110의 구동부는 리셋 기간 이전의 프리(Pre) 리셋 기간에서 제 1 전극에 제 1 하강 램프(Ramp-Down) 신호를 인가할 수 있다.
아울러, 구동부(110)는 제 1 전극에 제 1 하강 램프 신호가 인가되는 동안 제 1 하강 램프 신호와 반대 극성 방향의 프리(Pre) 서스테인 신호를 제 2 전극에 인가할 수 있다.
여기서, 제 1 전극에 인가되는 제 1 하강 램프 신호는 제 10 전압(V10)까지 점진적으로 하강하는 것이 바람직하다. 이러한 제 1 하강 램프 신호는 그라운드 레벨(GND)의 전압으로부터 점진적으로 하강하는 것이 더욱 바람직하다.
아울러, 프리 서스테인 신호는 프리 서스테인 전압(Vpz)을 실질적으로 일정하게 유지하는 것이 바람직하다. 여기서, 프리 서스테인 전압(Vpz)은 이후의 서스테인 기간에서 인가되는 서스테인 신호(SUS)의 전압, 즉 서스테인 전압(Vs)과 대략 동일한 전압인 것이 바람직하다.
이와 같이, 프리 리셋 기간에서 제 1 전극에 제 1 하강 램프 신호가 인가되고, 이와 함께 제 2 전극에 프리 서스테인 신호가 인가되면 제 1 전극 상에 소정 극성의 벽 전하(Wall Charge)가 쌓이고, 제 2 전극 상에는 제 1 전극과 반대 극성의 벽 전하들이 쌓인다. 예를 들면, 제 1 전극 상에는 양(+)의 벽 전하(Wall Charge)가 쌓이고, 제 2 전극 상에는 음(-)의 벽 전하가 쌓이게 된다.
이에 따라, 이후의 리셋 기간에서 충분한 세기의 셋업 방전을 발생시킬 수 있게 되고, 결국 초기화를 충분히 안정적으로 수행할 수 있게 된다.
심지어는, 방전 셀 내에 벽 전하의 양이 부족한 경우에서도 충분한 세기의 셋업 방전을 발생시킬 수 있다.
아울러, 리셋 기간에서 제 1 전극으로 인가되는 상승 램프 신호(Ramp-Up)의 전압이 더 작아지더라도 충분한 세기의 셋업 방전을 발생시킬 수 있게 된다.
이상에서 설명한 프리 리셋 기간은 프레임(Frame)의 모든 서브필드에서 리셋 기간이전에 포함될 수 있다.
또는, 구동 시간을 확보하는 관점에서 프레임의 서브필드 중에서 계조 가중치가 가장 작은 하나의 서브필드에서 리셋 기간이전에 프리 리셋 기간이 포함되거나 또는 프레임의 서브필드 중 2개 또는 3개의 서브필드에서 리셋 기간이전에 프리 리셋 기간이 포함되는 것도 가능한 것이다.
또는, 이러한 프리 리셋 기간은 모든 서브필드에서 생략되는 것도 가능한 것이다.
프리 리셋 기간 이후, 초기화를 위한 리셋 기간의 셋업(Set-Up) 기간에서는 구동부(110)는 제 1 전극으로 제 1 하강 램프 신호와 반대 극성 방향의 상승 램프(Ramp-Up) 신호를 인가할 수 있다.
여기서, 상승 램프 신호는 제 20 전압(V20)부터 제 30 전압(V30)까지 제 1 기울기로 점진적으로 상승하는 제 1 상승 램프 신호와 제 30 전압(V30)부터 제 40 전압(V40)까지 제 2 기울기로 상승하는 제 2 상승 램프 신호를 포함할 수 있다.
이러한 셋업 기간에서는 상승 램프 신호에 의해 방전 셀 내에는 약한 암방전(Dark Discharge), 즉 셋업 방전이 일어난다. 이 셋업 방전에 의해 방전 셀 내에는 어느 정도의 벽 전하(Wall Charge)가 쌓이게 된다.
여기서, 제 2 상승 램프 신호의 제 2 기울기는 제 1 기울기보다 더 완만한 것이 바람직하다. 이와 같이, 제 2 기울기를 제 1 기울기보다 더 완만하게 하게 되면, 셋업 방전이 발생하기 이전까지는 전압을 상대적으로 빠르게 상승시키고, 셋업 방전이 발생하는 동안에는 전압을 상대적으로 느리게 상승시키는 효과를 획득함으 로써, 셋업 방전에 의해 발생하는 광의 양을 저감시킬 수 있다.
이에 따라, 콘트라스트(Contrast) 특성을 개선할 수 있다.
셋업 기간 이후의 셋다운(Set-Down) 기간에서는 구동부(110)는 상승 램프 신호 이후에 이러한 상승 램프 신호와 반대 극성 방향의 제 2 하강 램프(Ramp-Down) 신호를 제 1 전극에 인가할 수 있다.
여기서, 제 2 하강 램프 신호는 제 20 전압(V20)부터 제 50 전압(V50)까지 점진적으로 하강하는 것이 바람직하다.
이에 따라, 방전 셀 내에서 미약한 소거 방전(Erase Discharge), 즉 셋다운 방전이 발생한다. 이 셋다운 방전에 의해 방전 셀 내에는 어드레스 방전이 안정되게 일어날 수 있을 정도의 벽전하가 균일하게 잔류된다.
한편, 여기 도 4와는 다르게 상승 램프 신호 또는 제 2 하강 램프 신호를 설정할 수도 있는데, 이에 대해 첨부된 도 5a 내지 도 5b를 결부하여 살펴보면 다음과 같다.
도 5a 내지 도 5b는 상승 램프 신호 또는 제 2 하강 램프 신호의 또 다른 형태에 대해 설명하기 위한 도면이다.
먼저, 도 5a를 살펴보면, 상승 램프 신호는 제 30 전압(V30)까지는 급격히 상승한 이후에 제 30 전압(V30)부터 제 40 전압(V40)까지 점진적으로 상승하는 형태이다.
이와 같이, 상승 램프 신호는 도 4에서와 같이 두 단계에 걸쳐 서로 다른 기울기로 점진적으로 상승하는 것도 가능하고, 여기 도 5a에서와 같이 하나의 단계에 서 점진적으로 상승하는 것도 가능한 것과 같이, 다양한 형태로 변경되는 것이 가능한 것이다.
다음, 도 5b를 살펴보면 제 2 하강 램프 신호는 제 30 전압(V30)에서부터 전압이 점진적으로 하강하는 형태이다.
이와 같이, 제 2 하강 램프 신호는 전압이 하강하는 시점을 다르게 변경하는 것도 가능한 것과 같이, 다양한 형태로 변경되는 것이 가능한 것이다.
이상 도 5a 내지 도 5b에 대한 설명을 마무리하기로 한다.
한편, 리셋 기간 이후의 어드레스 기간에서는 구동부(110)는 제 2 하강 램프 신호의 제 50 전압(V50)보다는 높은 전압을 실질적으로 유지하는 스캔 바이어스 신호를 제 1 전극(Y)에 인가할 수 있다.
아울러, 스캔 바이어스 신호로부터 스캔 전압(ΔVy)만큼 하강하는 스캔 신호(Scan)를 모든 제 1 전극(Y1~Yn)에 인가할 수 있다.
예를 들면, 복수의 제 1 전극 중 첫 번째 제 1 전극(Y1)에 첫 번째 스캔 신호(Scan 1)를 인가하고, 이후에 두 번째 제 1 전극(Y2)에 두 번째 스캔 신호(Scan 2)를 인가하고, n 번째 제 1 전극(Yn)에는 n 번째 스캔 신호(Scan n)를 인가한다.
이와 같이, 스캔 신호(Scan)를 제 1 전극으로 인가할 때, 이에 대응되게 제 3 전극에 데이터 전압의 크기(ΔVd)만큼 상승하는 데이터 신호를 인가할 수 있다.
이러한 스캔 신호(Scan)와 데이터 신호(Data) 신호가 인가됨에 따라, 스캔 신호(Scan)의 전압과 데이터 신호의 데이터 전압(Vd) 간의 전압 차와 리셋 기간에 생성된 벽 전하들에 의한 벽 전압이 더해지면서 데이터 신호의 전압(Vd)이 인가되 는 방전 셀 내에는 어드레스 방전이 발생된다.
이러한, 어드레스 방전에 의해 선택된 방전 셀 내에는 이후의 서스테인 기간에서 서스테인 신호(SUS)가 인가될 때 서스테인 방전이 일어날 수 있게 하는 정도의 벽 전하가 형성된다.
여기서, 구동부(110)는 어드레스 기간에서 제 2 전극의 간섭에 의해 어드레스 방전이 불안정해지는 것을 방지하기 위해 제 2 전극에 서스테인 바이어스 신호를 인가하는 것이 바람직하다.
여기서, 서스테인 바이어스 신호는 서스테인 기간에서 인가되는 서스테인 신호의 전압보다는 작고 그라운드 레벨(GND)의 전압보다는 큰 서스테인 바이어스 전압(Vz)을 실질적으로 일정하게 유지하는 것이 바람직하다.
이후, 구동부(110)는 영상 표시를 위한 서스테인 기간에서는 제 1 전극 또는 제 2 전극 중 하나 이상에 서스테인 신호(SUS)를 인가할 수 있다. 예를 들면, 제 1 전극 및 제 2 전극에 번갈아가며 서스테인 신호(SUS)를 인가한다. 이러한 서스테인 신호(SUS)는 ΔVs 만큼의 전압의 크기를 갖는 것이 바람직하다.
이와 같이, 서스테인 신호(SUS)가 인가되면, 어드레스 방전에 의해 선택된 방전 셀은 방전 셀 내의 벽 전압과 서스테인 신호(SUS)의 서스테인 전압(Vs)이 더해지면서 제 1 전극과 제 2 전극 사이에 서스테인 방전 즉, 표시방전이 일어나게 된다. 이에 따라, 플라즈마 디스플레이 패널 상에 소정의 영상이 구현되는 것이다.
한편, 이상에서는 제 1 전극과 제 2 전극에 교대로 서스테인 신호를 인가하는 경우만을 설명하였다. 이와는 다르게 제 1 전극 또는 제 2 전극 중 어느 하나의 전극에만 서스테인 신호가 인가될 수도 있다. 이에 대해 첨부된 도 6을 결부하여 살펴보면 다음과 같다.
도 6은 서스테인 신호의 또 다른 타입에 대해 설명하기 위한 도면이다.
도 6을 살펴보면, 제 1 전극 또는 제 2 전극 중 어느 하나의 전극, 예를 들면 제 1 전극에 양의 서스테인 신호와 음의 서스테인 신호가 번갈아가면서 인가된다. 예를 들면, 제 1 전극에 제 1 양 서스테인 신호(+SUS1)가 인가되고, 이후 다시 제 1 전극에 제 1 음 서스테인 신호(-SUS1)가 인가되고, 이후 다시 제 1 전극에 제 2 양 서스테인 신호(+SUS2)가 인가되고, 이후 다시 제 1 전극에 제 2 음 서스테인 신호(-SUS2)가 인가될 수 있다.
이와 같이 어느 하나의 전극에 양의 서스테인 신호와 음의 서스테인 신호가 인가되는 동안 나머지 전극에는 바이어스 신호가 인가되는 것이 바람직하다.
여기서, 바이어스 신호는 그라운드 레벨(GND)의 전압을 실질적으로 일정하게 유지하는 것이 바람직하다.
이처럼, 서스테인 신호(SUS)의 형태는 다양하게 변경될 수 있다.
이와 같이 서스테인 기간에서 제 1 전극 또는 제 2 전극 중 어느 하나에만 서스테인 신호를 인가하고, 나머지 하나의 전극에는 바이어스 신호를 인가하게 되면, 구동부의 형태를 보다 단순화 할 수 있다.
예를 들어, 제 1 전극에도 서스테인 신호를 인가하고, 제 2 전극에도 서스테인 신호를 인가하는 경우에는 제 1 전극에 서스테인 신호를 인가하기 위한 회로들이 배치되는 구동 보드(Board)와 제 2 전극에 서스테인 신호를 인가하기 위한 회로 들이 배치되는 구동 보드가 각각 필요하게 된다.
반면에, 여기 도 6에서와 같이 제 1 전극 또는 제 2 전극 중 어느 하나의 전극에만 서스테인 신호를 인가하는 경우에는 제 1 전극 또는 제 2 전극 중 어느 하나의 전극에 서스테인 신호를 인가하기 위한 회로들이 배치되는 하나의 구동 보드만이 구비되면 된다.
이에 따라, 구동부의 전체 크기를 줄일 수 있고, 이에 따라 제조 단가를 저감시킬 수 있게 된다.
다음, 도 7a 내지 도 7b는 입력되는 영상 신호의 주파수가 변경되는 경우의 동작의 일례를 설명하기 위한 도면이다.
먼저, 도 7a를 살펴보면 입력되는 영상 신호의 주파수가 변경되는 경우에 제 1 기간(d1)이 포함된다. 여기서, 제 1 기간(d1)은 구동부의 스위칭 소자가 오프되는 기간이다.
즉, 본 발명의 플라즈마 디스플레이 장치의 구동부는 입력되는 영상의 주파수가 변경되는 경우에 제 1 기간(d1) 동안 포함하는 스위칭 소자를 오프(Off)시킨다. 이에 따라, 플라즈마 디스플레이 패널의 전극은 플로팅(Floating) 상태가 될 수 있다.
여기, 도 7a에서 구동 신호로 표시된 것은 앞선 도 3에서와 같은 프레임일 수 있다.
예를 들어, 입력되는 영상 신호의 주파수가 60㎐인 경우에 하나의 프레임의 길이는 대략 16.67ms이고, 주파수가 50㎐인 경우에는 하나의 프레임의 길이는 대략 20ms이다.
여기서, 입력되는 영상 신호의 주파수가 50㎐에서 60㎐로 변경되는 경우에 프레임의 길이가 20ms에서 16.67ms로 감소하게 된다. 즉, 수직 동기 신호(Vertical Synchronizing Signal)간의 시간 차이가 20ms에서 16.67ms로 감소하게 된다.
이와 같이, 입력되는 영상 신호의 주파수가 증가하는 경우, 즉 수직 동기 신호간의 시간 차이가 감소하는 경우에 제 1 기간(d1) 동안 구동부의 스위칭 소자를 오프시키는 것이 바람직하다.
여기서, 스위칭 소자를 오프시키는 방법의 일례는 이후의 도 9a 내지 도 9d에서 보다 상세히 설명하기로 한다.
이상에서 설명한 제 1 기간(d1)에 대해 도 7b에 보다 상세히 나타나 있다.
도 7b를 살펴보면, 제 1 기간(d1)은 주파수 변경 시 인가되는 첫 번째 수직 동기 신호(Vertical Synchronizing Signal)의 인가시점(t0)부터 시작되는 것이 바람직하다.
이와 같이, 주파수의 변경 시 제 1 기간(d1) 동안 스위칭 소자를 오프시키는 이유에 대해 첨부된 도 8을 결부하여 살펴보면 다음과 같다.
도 8은 입력되는 영상 신호의 변경 시 제 1 기간(d1) 동안 스위칭 소자를 오프시키는 이유에 대해 설명하기 위한 도면이다.
도 8을 살펴보면, 입력되는 영상 신호의 주파수가 증가하는 경우에, 예컨대 50㎐에서 60㎐로 변경되는 경우에 (a)와 같이 스위칭 소자를 오프시키는 제 1 기간(d1)이 포함되지 않는 경우에는 주파수가 변경되기 이전의 구동 신호가 그대로 출력됨으로써 수직 동기 신호와의 신호 충돌이 발생할 수 있다.
이는, 입력되는 영상 신호의 주파수가 증가됨으로써 수직 동기 신호 간의 차이는 감소하였지만, 반면에 구동 신호는 영상 신호의 주파수 변경에 대응하지 못하고 변경되기 이전의 주파수에 따라 생성됨으로써 발생하는 문제점이다.
이러한 경우에서는 구동부의 스위칭 소자에 주파수 변경된 수직 동기 신호에 따른 제어 신호와 주파수가 변경되기 이전의 구동 신호에 따른 제어 신호가 함께 인가될 수 있다.
이에 따라, 스위칭 소자들이 오동작을 일으킬 수 있고, 심지어는 스위칭 소자들이 타버리는 등의 손상을 입을 수 있다.
이러한 경우는, 방송국에서 50㎐의 영상 신호를 송출하다가 주파수를 변경하여 60㎐의 영상 신호를 송출하는 경우일 수 있다.
또는, 녹화된 영상을 시청하는 과정에서 빨리 감기(FF) 또는 빨리 되감기(FR) 등의 기능을 동작시키는 경우일 수 있다. 이때는 영상의 주파수가 순간적으로 증가할 수 있다.
이러한 (a)의 경우와는 다르게 (b)와 같이 입력되는 영상 신호의 주파수가 증가하는 경우에 스위칭 소자를 오프시키는 제 1 기간(d1)을 포함하게 되면 스위칭 소자에 두 가지 이상의 상이한 제어 신호가 인가되는 것을 방지할 수 있다. 즉, 입력되는 영상 신호의 주파수가 증가하는 경우에 스위칭 소자에 두 가지 이상의 상이한 제어 신호가 인가되지 못하도록 스위칭 소자를 오프 시키는 것이다.
이에 따라, 스위칭 소자의 동작을 안정시키고 아울러, 스위칭 소자의 손상을 방지할 수 있다. 따라서 구동부의 회로 신뢰성을 향상시킬 수 있다.
이러한 제 1 기간(d1)의 길이는 스위칭 소자에 두 가지 이상의 상이한 제어 신호가 인가되는 것을 충분히 방지하기 위해 대략 40ns(나노초)이상 2㎲(마이크로초)이하로 설정되는 것이 바람직하다.
즉, 스위칭 소자에 두 가지 이상의 상이한 제어 신호가 인가되는 것을 충분히 방지하기 위해 주파수 변경 시 인가되는 첫 번째 수직 동기 신호의 인가시점부터대략 40ns(나노초)이상 2㎲(마이크로초)이하의 기간 동안 구동부의 스위칭 소자를 오프 시키는 것이다.
한편, 이러한 제 1 기간(d1) 이후에 제 2 기간이 더 포함되는 것이 바람직하다. 여기서, 제 2 기간(d2)은 스위칭 소자로 특정 신호가 인가되는 기간인 것이 바람직하다.
아울러, 이러한 특정 신호는 플라즈마 디스플레이 패널의 전극으로 그라운드 레벨(GND)의 전압을 인가하도록 하는 신호인 것이 바람직하다.
이와 같이, 제 1 기간 이후의 제 2 기간에서 플라즈마 디스플레이 패널의 전극으로 그라운드 레벨의 전압을 인가하도록 하는 특정 신호를 스위칭 소자로 인가하는 이유는 제 1 기간 이후에서의 구동부의 동작을 안정시키기 위해서이다.
예를 들어, 제 1 기간에서 스위칭 소자를 오프 시키게 되면 스위칭 소자의 동작이 멈추게 된다. 여기서, 제 2 기간을 생략하고 그 다음 수직 동기 신호에 따라 구동 신호를 생성하기 위해 스위칭 소자에 제어 신호를 바로 인가하게 되면, 동작하지 않던 스위칭 소자가 갑자기 동작하게 됨으로써 스위칭 소자의 동작이 불안 정해질 수 있다.
반면에, 제 1 기간에서 스위칭 소자를 오프 시킨 이후에 제 2 기간에서 스위칭 소자에 특정 신호, 바람직하게는 플라즈마 디스플레이 패널의 전극으로 그라운드 레벨의 전압을 인가하도록 하는 신호를 인가하게 되면, 그 다음 수직 동기 신호에 따라 구동 신호를 생성하기 위해 스위칭 소자에 제어 신호를 바로 인가하기 이전에 스위칭 소자를 안정시킬 수 있다.
즉, 스위칭 소자를 동작시키기 이전에 제 2 기간(d2)에서 스위칭 소자에 특정 신호를 인가하여 스위칭 소자를 안정시키는 것이다.
이에 따라, 스위칭 소자의 오동작 및 스위칭 소자의 손상을 방지할 수 있다.
여기서, 스위칭 소자에 특정 신호를 인가하는 방법의 일례는 이후의 도 9a 내지 도 9d에서 보다 상세히 설명하기로 한다.
이러한, 제 2 기간(d2)은 스위칭 소자의 동작을 보다 안정시키기 위해 그 길이가 대략 100㎲(마이크로초)이상 300㎲(마이크로초)이하로 설정되는 것이 바람직하다.
한편, 하나의 수직 동기 신호의 폭을 고려할 때, 제 1 기간(d1)과 제 2 기간(d2)의 길이의 합은 하나의 수직 동기 신호의 폭(W1)과 실질적으로 동일한 것이 바람직하다.
즉, 하나의 수직 동기 신호의 인가기간 동안 제 1 기간(d1)과 제 2 기간(d2)을 포함시킴으로써 추가적인 구동 시간의 증가를 방지할 수 있다.
이러한, 제 1 기간(d1)과 제 2 기간(d2)에서의 구동부의 동작을 일례에 대해 살펴보면 다음과 같다.
도 9a 내지 도 9d는 제 1 기간 또는 제 2 기간에서의 구동부의 동작의 일례를 보다 상세히 설명하기 위한 도면이다.
여기, 도 9a 내지 도 9d에서는 서스테인 신호를 인가하기 위한 회로 구성의 경우를 예로 들어 설명하기로 한다.
먼저, 도 9a를 살펴보면 서스테인 신호를 인가하기 위한 회로 구성은 전압 저장부(900)와, 저장 전압 공급부(901)와, 전압 회수부(902)와, 공진부(903)와, 서스테인 전압 공급부(904)와, 기저 전압 공급부(905)를 포함하는 것이 바람직하다.
전압 저장부(900)는 전압 저장용 캐패시터부(C)를 포함하고, 이러한 에너지 저장용 캐패시터부(C)를 이용하여 전압을 저장한다.
저장 전압 공급부(901)는 저장 전압 공급 제어용 스위치부(S1)를 포함하고, 이러한 저장 전압 공급 제어용 스위치부(S1)를 이용하여 전압 저장부(900)에 저장된 전압이 플라즈마 디스플레이 패널의 제 1 전극(Y) 또는 제 2 전극(Z)으로 공급되도록 한다.
전압 회수부(902)는 전압 회수 제어용 스위치부(S2)를 포함하고, 이러한 전압 회수 제어용 스위치부(S2)를 이용하여 플라즈마 디스플레이 패널의 제 1 전극(Y) 또는 제 2 전극(Z)의 무효 에너지가 전압 저장부(900)로 회수되어 저장되도록 한다.
공진부(903)는 공진용 인덕터부(L)를 포함하고, 이러한 공진용 인덕터부(L)를 이용하여 전압 저장부(900)에 저장된 전압이 제 1 전극(Y) 또는 제 2 전극(Z)으 로 공급될 때 제 1 전극(Y) 또는 제 2 전극(Z)의 전압, 즉 제 1 전극(Y) 또는 제 2 전극(Z)의 무효 전압이 전압 저장부(900)로 회수될 때 공진, 즉 LC 공진을 발생시킨다.
서스테인 전압 공급부(904)는 서스테인 전압 공급 제어용 스위치부(S3)를 포함하고, 이러한 서스테인 전압 공급 제어용 스위치부(S3)를 이용하여 서스테인 전압원이 발생시키는 서스테인 전압(Vs)이 제 1 전극(Y) 또는 제 2 전극(Z)으로 공급되도록 한다.
기저 전압 공급부(905)는 기저 전압 공급 제어용 스위치부(S4)를 포함하고, 이러한 기저 전압 공급 제어용 스위치부(S4)를 이용하여 기저 전압원이 발생시키는 기저 전압(GND)이 제 1 전극(Y) 또는 제 2 전극(Z)으로 공급되도록 한다. 즉, 제 1 전극(Y) 또는 제 2 전극(Z)이 접지되도록 한다.
이러한 구성의 회로에서 입력되는 영상 신호의 주파수가 실질적으로 일정하게 유지되는 경우의 동작의 일례를 살펴보면 다음과 도 9b와 같다.
도 9b를 살펴보면 먼저, d10기간 이전에서는 기저 전압 공급부(905)의 기저 전압 공급 제어용 스위치부(S4)가 온(On) 된다. 그러면, 도 9b의 d10기간의 이전에서와 같이 제 1 전극(Y) 또는 제 2 전극(Z)의 전압이 기저 전압(GND)을 유지한다.
다음, d10기간에서는 전압 회수부(902)와, 서스테인 전압 공급부(904)와, 기저 전압 공급부(905)는 모두 오프된 상태에서 저장 전압 공급부(901)가 온 된다.
그러면, 전압 저장부(900), 제 1 노드(n1), 저장 전압 공급부(901), 제 2 노드(n2), 공진부(903), 제 3 노드(n3)를 경유하는 전류 패스(Path)가 형성된다. 이 에 따라, 전압 저장부(900)에 저장되어 있던 전압이 공진부(903)의 인덕터부(L)에 의한 LC 공진을 통해 제 1 전극(Y) 또는 제 2 전극(Z)으로 공급된다.
여기서, 전압 저장부(900)에 0.5배의 서스테인 전압, 즉 1/2Vs의 전압이 저장되어 있다고 가정하면 이러한 d10기간에서는 제 1 전극(Y) 또는 제 2 전극(Z)의 전압이 최대 서스테인 전압(Vs)까지 상승할 수 있다.
다음, d20기간에서는 서스테인 전압 공급부(904)의 서스테인 전압 공급 제어용 스위치부(S3)가 온 된다. 그러면 서스테인 전압원이 발생시킨 서스테인 전압(Vs)이 제 3 노드(n3)를 거쳐 제 1 전극(Y) 또는 제 2 전극(Z)으로 공급된다.
이에 따라, 제 1 전극(Y) 또는 제 2 전극(Z)이 서스테인 전압(Vs)을 실질적으로 일정하게 유지한다.
다음, d30기간에서는 서스테인 전압 공급부(904)의 서스테인 전압 공급 제어용 스위치부(S3)와 저장 전압 공급부(901)의 저장 전압 공급 제어용 스위치부(S1)가 모두 오프된 상태에서 전압 회수부(902)의 전압 회수 제어용 스위치부(S2)가 온 된다.
그러면, 제 1 전극(Y) 또는 제 2 전극(Z), 제 3 노드(n3), 공진부(903), 제 2 노드(n2), 전압 회수부(902), 제 1 노드(n1), 전압 저장부(900)를 경유하는 전류 패스가 형성되고, 이에 따라 제 1 전극(Y) 또는 제 2 전극(Z)의 전압이 공진부(903)에 의한 LC 공진을 통해 전압 저장부(900)로 회수되어 저장된다.
이에 따라, 제 1 전극(Y) 또는 제 2 전극(Z)의 전압이 서스테인 전압(Vs)으로부터 최저 기저 전압(GND)까지 하강할 수 있다.
이러한 방법에 의해 제 1 전극(Y) 또는 제 2 전극(Z)으로 서스테인 신호가 공급될 수 있다.
이러한 도 9b의 경우와는 다르게 입력되는 영상 신호의 주파수가 변경되는 경우에 제 1 기간에서의 동작의 일례가 도 9c에 나타나 있다.
도 9c를 살펴보면, 제 1 기간에서는 저장 전압 공급부(901)의 저장 전압 공급 제어용 스위치부(S1)의 게이트(Gate) 단자로 입력되는 구동 전압(Vcc)의 공급을 차단하는 방법 등을 통해 저장 전압 공급 제어용 스위치부(S1)를 d10, d20, d30 기간에서 계속 오프시킨다.
이러한 방식으로 전압 회수부(902)의 전압 회수 제어용 스위치부(S2), 서스테인 전압 공급부(904)의 서스테인 전압 공급 제어용 스위치부(S3) 및 기저 전압 공급부(905)의 기저 전압 공급 제어용 스위치부(S4)를 d10, d20, d30 기간에서 모두 오프 시킬 수 있다.
저장 전압 공급부(901)의 저장 전압 공급 제어용 스위치부(S1), 전압 회수부(902)의 전압 회수 제어용 스위치부(S2), 서스테인 전압 공급부(904)의 서스테인 전압 공급 제어용 스위치부(S3) 및 기저 전압 공급부(905)의 기저 전압 공급 제어용 스위치부(S4)가 모두 오프된다.
이에 따라, 플라즈마 디스플레이 패널의 전극, 예컨대 제 1 전극 또는 제 2 전극이 플로팅 상태가 될 수 있다.
이러한 방법으로 입력되는 영상 신호의 변경 시 스위칭 소자들에 두 가지 이상의 제어 신호가 인가되는 것을 방지할 수 있다.
다음, 제 2 기간에서의 동작의 일례를 살펴보면 다음과 도 9d와 같다.
도 9d를 살펴보면, 제 2 기간에서는 저장 전압 공급부(901)의 저장 전압 공급 제어용 스위치부(S1), 전압 회수부(902)의 전압 회수 제어용 스위치부(S2) 및 서스테인 전압 공급부(904)의 서스테인 전압 공급 제어용 스위치부(S3)는 오프시키고, 반면에 기저 전압 공급부(905)의 기저 전압 공급 제어용 스위치부(S4)는 온 시킬 수 있다.
그러면, 플라즈마 디스플레이 패널의 전극, 예컨대 제 1 전극 또는 제 2 전극에 그라운드 레벨(GND)의 전압이 인가될 수 있다.
이러한 방식으로 제 1 기간이후의 스위칭 소자의 구동을 안정시키는 것이다.
이와 같이, 상술한 본 발명의 기술적 구성은 본 발명이 속하는 기술분야의 당업자가 본 발명의 그 기술적 사상이나 필수적 특징을 변경하지 않고서 다른 구체적인 형태로 실시될 수 있다는 것을 이해할 수 있을 것이다.
그러므로 이상에서 기술한 실시예들은 모든 면에서 예시적인 것이며 한정적인 것이 아닌 것으로서 이해되어야 하고, 본 발명의 범위는 전술한 상세한 설명보다는 후술하는 특허청구범위에 의하여 나타내어지며, 특허청구범위의 의미 및 범위 그리고 그 등가개념으로부터 도출되는 모든 변경 또는 변형된 형태가 본 발명의 범위에 포함되는 것으로 해석되어야 한다.
이상에서 상세히 설명한 바와 같이, 본 발명의 플라즈마 디스플레이 장치는 입력되는 영상 신호의 주파수의 변경 시 제 1 기간 동안 구동부의 스위칭 소자를 오프시킴으로써, 스위칭 소자의 오동작 및 손상을 방지하는 효과가 있다.

Claims (8)

  1. 전극이 형성된 플라즈마 디스플레이 패널과,
    상기 전극에 구동 신호를 인가하는 구동부
    를 포함하고,
    상기 구동부는 스위칭(Switching) 동작을 수행하는 스위칭 소자를 포함하고, 입력되는 영상 신호의 주파수가 변경되는 경우에 제 1 기간 동안 상기 스위칭 소자를 오프(Off)시키는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  2. 제 1 항에 있어서,
    상기 구동부는
    입력되는 영상 신호의 주파수가 증가하는 경우에 상기 제 1 기간 동안 스위칭 소자를 오프시키는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  3. 제 1 항에 있어서,
    상기 제 1 기간은 주파수 변경 시 인가되는 첫 번째 수직 동기 신호(Vertical Synchronizing Signal)의 인가시점부터 시작되는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  4. 제 3 항에 있어서,
    상기 제 1 기간의 길이는 대략 40ns(나노초)이상 2㎲(마이크로초)이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  5. 제 1 항에 있어서,
    상기 구동부는
    상기 제 1 기간 이후에 제 2 기간 동안 상기 스위칭 소자로 특정 신호를 인가하는 것을 특징으로 하는 플라즈마 디스플레이 장치.
  6. 제 5 항에 있어서,
    상기 특정 신호는 전극으로 그라운드 레벨(GND)의 전압을 인가하도록 하는 신호인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  7. 제 5 항에 있어서,
    상기 제 2 기간의 길이는 대략 100㎲(마이크로초)이상 300㎲(마이크로초)이하인 것을 특징으로 하는 플라즈마 디스플레이 장치.
  8. 제 5 항에 있어서,
    상기 제 1 기간과 제 2 기간의 길이의 합은 하나의 수직 동기 신호의 폭과 실질적으로 동일한 것을 특징으로 하는 플라즈마 디스플레이 장치.
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