KR20060095721A - 데이터 구동부의 출력 전위가 단계적인 전자 방출 디스플레이 장치 - Google Patents

데이터 구동부의 출력 전위가 단계적인 전자 방출 디스플레이 장치 Download PDF

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KR20060095721A
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Abstract

본 발명에 따른 전자 방출 디스플레이 장치는 전자 방출원들, 데이터 전극 라인들, 주사 전극 라인들, 형광 셀들, 및 양극판을 포함한다. 주사 전극 라인들은 데이터 전극 라인들과 교차하도록 형성된다. 양극판은 전자 방출원들로부터의 전자들이 형광 셀들로 이동하도록 전위가 인가된다. 여기에서, 각각의 수평 구동 주기가 블랭킹 시간 및 수평 디스플레이 시간을 포함한다. 데이터 전극 라인들을 구동하는 데이터 구동부의 제1 출력 전위가 수평 디스플레이 시간 내에서 데이터 전극 라인들 각각의 계조에 비례한 시간 동안에 출력되되, 블랭킹 시간에서 데이터 구동부의 출력 전위가 상기 제1 출력 전위보다 높은 제2 출력 전위이다.

Description

데이터 구동부의 출력 전위가 단계적인 전자 방출 디스플레이 장치{Electron emission display apparatus wherein output electric potential of data driver is staged}
도 1은 통상적인 전자 방출 디스플레이 장치의 데이터 구동부의 출력 전위 및 이로 인한 데이터 구동 펄스의 파형을 보여주는 타이밍도이다.
도 2는 본 발명에 따른 전자 방출 디스플레이 장치의 구성을 보여주는 블록도이다.
도 3은 도 2의 전자 방출 디스플레이 패널을 보여주는 분리 사시도이다.
도 4는 도 2의 전원 공급부로부터 각 부에 공급되는 전위들을 보여주는 블록도이다.
도 5는 도 2의 전자 방출 디스플레이 장치의 데이터 구동부의 출력 전위 및 이로 인한 데이터 구동 펄스의 파형들을 보여주는 타이밍도이다.
도 6은 도 2의 전자 방출 디스플레이 장치의 데이터 구동부의 출력 전위 및 각 구동 신호의 파형들을 보여주는 타이밍도이다.
도 7은 도 2의 제어 소자의 내부 구성을 보여주는 블록도이다.
<도면의 주요 부분에 대한 부호의 설명>
11...전자 방출 디스플레이 패널, 12...프레임 메모리,
15...제어 소자, 17...주사 구동부,
18...데이터 구동부, 19...전원 공급부,
V17G...주사 기준 전위, 2...앞쪽 패널,
21...앞쪽 기판, 22...양극판,
FR11,...,FBnm...형광 셀들, 3...뒤쪽 패널,
31...뒤쪽 기판, CR1,...,CBm...캐소드 전극 라인들,
ER11,...,EBnm...전자 방출원들, 33...제1 절연층,
G1,...,Gn...게이트 전극 라인들, 35...제2 절연층,
36...포커싱 전극판, HR11,...,HBnm...관통구들,
41,...,43...스페이스 바아들.
본 발명은, 전자 방출 디스플레이 장치에 관한 것으로서, 보다 상세하게는, 전자 방출원들, 데이터 전극 라인들, 주사 전극 라인들, 형광 셀들, 및 양극판을 포함한 전자 방출 디스플레이 장치에 관한 것이다.
전자 방출 디스플레이 장치와 관련된 선행 기술로는 2003년 미국 특허출원 공개 번호 제122,118호(명칭 : FED driving method)를 들 수 있다.
상기와 같은 통상적인 전자 방출 디스플레이 장치는 기본적으로 전자 방출원들, 데이터 전극 라인들, 주사 전극 라인들, 형광 셀들, 및 양극판을 포함한다. 주사 전극 라인들은 데이터 전극 라인들과 교차하도록 형성된다. 양극판에는 전자 방출원들로부터의 전자들이 상기 형광 셀들로 이동하도록 전위가 인가된다.
수평 구동 주기는 블랭킹 시간 및 수평 디스플레이 시간을 포함한다. 각각의 수평 디스플레이 시간의 폭을 가진 주사 펄스는 주사 전극 라인들에 순차적으로 인가된다. 데이터 펄스들은 상기 주사 펄스에 상응하여 데이터 전극 라인들에 인가된다.
도 1은 통상적인 전자 방출 디스플레이 장치의 데이터 구동부의 출력 전위 및 이로 인한 데이터 구동 펄스의 파형을 보여준다. 도 1에서 참조 부호 VSG는 시스템 기준 전위를 가리킨다. 도 1을 참조하면, 각각의 수평 구동 주기(t1~t4, 또는 t4~t7)는 블랭킹 시간(t1~t2, 또는 t4~t5) 및 수평 디스플레이 시간(t2~t4, 또는 t5~t7)을 포함한다.
전원 공급부로부터 인가되는 데이터 구동부의 출력 전위(+VPP)는 항상 일정하다. 데이터 전극 라인들을 구동하는 데이터 구동부의 출력 전위(+VPP)는 수평 디스플레이 시간(t2~t4, 또는 t5~t7) 내에서 데이터 전극 라인들 각각의 계조에 비례한 시간(t2~t3, 또는 t5~t6) 동안에 출력된다. 이에 따라, 데이터 전극 라인들 각각에는 수평 디스플레이 시간(t2~t4, 또는 t5~t7) 내에서 데이터 전극 라인들 각각의 계조에 비례한 시간(t2~t3, 또는 t5~t6) 동안에 부극성의 구동 전위(-VC)가 인가 된다.
하지만, 각각의 수평 디스플레이 시간(t2~t4, 또는 t5~t7)의 초기 시간에서, 모든 데이터 전극 라인들에 상응하는 데이터 구동부의 출력 트랜지스터들이 일시에 스위칭하면서 큰 전류가 흐른다. 이에 따라, 전원 공급부로부터 데이터 구동부의 출력 전위 단자 사이의 라인에 상대적으로 큰 전압 강하(voltage drop)가 발생한다. 이에 따라, 스위칭 손실로 인하여 도 1에 도시된 바와 같이 상대적으로 낮은 계조의 디스플레이 셀들에 더욱 낮은 구동 전력이 인가되므로, 저계조의 표현 능력이 저하되는 문제점이 있다.
본 발명의 목적은, 데이터 구동부의 스위칭 손실로 인하여 저계조의 표현 능력이 저하됨을 방지할 수 있는 전자 방출 디스플레이 장치를 제공하는 것이다.
상기 목적을 이루기 위한 본 발명의 전자 방출 디스플레이 장치는 전자 방출원들, 데이터 전극 라인들, 주사 전극 라인들, 형광 셀들, 및 양극판을 포함한다. 상기 주사 전극 라인들은 상기 데이터 전극 라인들과 교차하도록 형성된다. 상기 양극판은 상기 전자 방출원들로부터의 전자들이 상기 형광 셀들로 이동하도록 전위가 인가된다. 여기에서, 각각의 수평 구동 주기가 블랭킹 시간 및 수평 디스플레이 시간을 포함한다. 상기 데이터 전극 라인들을 구동하는 데이터 구동부의 제1 출력 전위가 상기 수평 디스플레이 시간 내에서 상기 데이터 전극 라인들 각각의 계조에 비례한 시간 동안에 출력되되, 상기 블랭킹 시간에서 상기 데이터 구동부의 출력 전위가 상기 제1 출력 전위보다 높은 제2 출력 전위이다.
본 발명의 상기 전자 방출 디스플레이 장치에 의하면, 상기 블랭킹 시간에서 상기 데이터 구동부의 출력 전위가 상기 제1 출력 전위보다 높은 제2 출력 전위이므로, 상기 수평 디스플레이 시간의 초기 시간에서의 데이터 구동부의 스위칭 손실이 보상될 수 있다. 즉, 데이터 구동부의 스위칭 손실로 인하여 상대적으로 낮은 계조의 디스플레이 셀들에 더욱 낮은 구동 전력이 인가됨을 방지할 수 있다. 이에 따라, 데이터 구동부의 스위칭 손실로 인하여 저계조의 표현 능력이 저하됨을 방지할 수 있다.
이하, 본 발명에 따른 바람직한 실시예가 상세히 설명된다.
도 2는 본 발명에 따른 전자 방출 디스플레이 장치의 구성을 보여준다. 도 4는 도 1의 전원 공급부(19)로부터 각 부에 공급되는 전위들을 보여준다.
도 2 및 4를 참조하면, 본 발명에 따른 전자 방출 디스플레이 장치는 전자 방출 디스플레이 패널(11) 및 이 전자 방출 디스플레이 패널(11)의 구동 장치를 포함한다. 이 구동 장치는 전원 공급부(19), 주사 구동부(17), 데이터 구동부(18), 프레임 메모리(12), 및 제어 소자(15)를 포함한다.
전원 공급부(19)는, 프레임 메모리(12)에 시스템 기준 전위(VSG) 및 동작 전위(V12H)를 인가하고, 제어 소자(15)에 상기 시스템 기준 전위(VSG) 및 동작 전위(V15H)를 인가하며, 주사 구동부(17)에 상기 시스템 기준 전위(VSG) 및 동작 전위(V17H)를 인가하고, 데이터 구동부(18)에 동작 전위(V18H) 및 상기 시스템 기준 전위 (VSG)를 인가하며, 전자 방출 디스플레이 패널(11)의 양극판(도 2의 22)에 양극 전위(VA)를 인가하고, 전자 방출 디스플레이 패널(11)의 포커싱 전극판(36)에 포커싱 전위(VF)를 인가한다.
여기에서, 전원 공급부(19)는, 제어 소자(15)로부터의 제어 신호들에 따라 동작하여, 데이터 구동부(18)의 동작 전위(V18H) 즉, 데이터 전극 라인들로서의 캐소드 전극 라인들(CR1,...,CBm)에 인가될 출력 전위(V18H)를 주기적으로 변경시킨다. 보다 상세하게는, 각각의 수평 구동 주기는 블랭킹 시간 및 수평 디스플레이 시간을 포함한다. 여기에서, 데이터 전극 라인들로서의 캐소드 전극 라인들(CR1,...,CBm)을 구동하는 데이터 구동부(18)의 제1 출력 전위가 수평 디스플레이 시간 내에서 캐소드 전극 라인들(CR1,...,CBm) 각각의 계조에 비례한 시간 동안에 출력되되, 블랭킹 시간에서 데이터 구동부(18)의 출력 전위가 상기 제1 출력 전위보다 높다.
이에 따라, 수평 디스플레이 시간의 초기 시간에서의 데이터 구동부(18)의 스위칭 손실이 보상될 수 있다. 즉, 데이터 구동부(18)의 스위칭 손실로 인하여 상대적으로 낮은 계조의 디스플레이 셀들에 더욱 낮은 구동 전력이 인가됨을 방지할 수 있다. 이에 따라, 데이터 구동부(18)의 스위칭 손실로 인하여 저계조의 표현 능력이 저하됨을 방지할 수 있다. 이와 관련된 내용은 도 5 내지 7을 참조하여 상세히 설명될 것이다.
주사 구동부(17)는 전자 방출 디스플레이 패널(11)의 주사 전극 라인들로서의 게이트 전극 라인들(G1,...,Gn)을 구동한다. 데이터 구동부(18)는 전자 방출 디스플레이 패널(11)의 데이터 전극 라인들로서의 캐소드 전극 라인들(CR1,...,CBm)을 구동한다. 프레임 메모리(12)에는 디지털 영상 데이터가 일시적으로 저장된다.
제어 소자(15)는, 단일 집적 회로 소자 예를 들어, FPGA(Field-Programmable Gate Array)로 형성되고, 다음과 같은 다양한 기능을 수행한다. 첫째, 입력 영상 신호들(SIM)을 디지털 영상 데이터로 변환시키며, 디지털 영상 데이터를 프레임 메모리(12)에 일시적으로 저장하면서, 계조 디스플레이를 위한 펄스폭 변조 데이터 및 타이밍 제어 신호들을 발생시킨다. 둘째, 제어 소자(15)는 발생된 펄스폭 변조 데이터 및 타이밍 제어 신호들에 따라, 데이터 구동부(18)에 펄스폭 변조 데이터(SDD) 및 타이밍 제어 신호들(SDT)을 제공하고, 주사 구동부(17)에 타이밍 제어 신호들(SS)을 제공한다. 셋째, 제어 소자(15)는, 전원 공급부(19)에 제어 신호들을 제공한다. 상기한 바와 같이, 전원 공급부(19)는, 제어 소자(15)로부터의 제어 신호들에 따라 동작하여, 데이터 구동부(18)의 동작 전위(V18H) 즉, 데이터 전극 라인들로서의 캐소드 전극 라인들(CR1,...,CBm)에 인가될 출력 전위(V18H)를 주기적으로 변경시킨다.
한편, 도 3을 참조하면, 도 2의 전자 방출 디스플레이 패널(11)은 앞쪽 패널(2)과 뒤쪽 패널(3)이 스페이스 바아(space bar)들(41,...,43)에 의하여 지지된다. 여기에서, 도 3에 도시된 스페이스 바아들(41,...,43) 외에도 다수의 스페이스 바아들이 포커싱 전극판(36) 위에 존재한다.
뒤쪽 패널(3)은 뒤쪽 기판(31), 캐소드 전극 라인들(CR1,...,CBm), 전자 방출원들(ER11,...,EBnm), 제1 절연층(33), 게이트 전극 라인들(G1,...,Gn), 제2 절연층(35), 및 포커싱 전극판(36)을 포함한다.
데이터 신호들이 인가되는 캐소드 전극 라인들(CR1,...,CBm)은 전자 방출원들(ER11,...,EBnm)과 전기적으로 연결된다. 제1 절연층(33), 게이트 전극 라인들(G1,...,Gn), 제2 절연층(35), 및 포커싱 전극판(36)에는 전자 방출원들(ER11,...,EBnm)에 대응하는 관통구들(HR11,...,HBnm)이 형성된다. 따라서, 주사 신호들이 인가되는 게이트 전극 라인들(G1,...,Gn)에서, 캐소드 전극 라인들(CR1,...,CBm)과 교차되는 영역에 관통구들(HR11,...,HBnm)이 형성된다. 포커싱 전극판(36)에는 포커싱 전위(도 4의 VF)가 인가된다.
앞쪽 패널(2)은 앞쪽 투명 기판(21), 양극판(22), 및 형광 셀들(FR11,...,FBnm)을 포함한다. 형광 셀들(FR11,...,FBnm)은 포커싱 전극판(36)의 관통구들(HR11,...,HBnm)에 대응하여 형성된다. 양극판(22)에는 전자 방출원들(ER11,...,EBnm)로부터의 전자들이 형광 셀들로 이동하도록 1 내지 4 킬로볼트(KV)의 높은 정극성 전위(도 4의 VA)가 인가된다.
도 5는 도 2의 데이터 구동부(18)의 출력 전위(V18H) 및 이로 인한 데이터 구동 펄스(SCR1)의 파형들을 보여준다. 도 5에서 참조 부호 V18H는 데이터 구동부(18)의 출력 전위를, 그리고 SCR1은 제1 캐소드 전극 라인(도 3의 CR1)에 인가되는 구동 신호들을, 그리고 VSG는 시스템 기준 전위를 각각 가리킨다.
도 6은 도 2의 데이터 구동부(18)의 출력 전위(V18H) 및 각 구동 신호의 파형들을 보여준다. 도 6에서 참조 부호 SG1은 제1 게이트 전극 라인(도 3의 G1)에 인가되는 구동 신호를, SG2는 제2 게이트 전극 라인(도 3의 G2)에 인가되는 구동 신호를, SGn은 제n 게이트 전극 라인(도 3의 Gn)에 인가되는 구동 신호를, S36은 포커싱 전극판(도 3의 36)에 인가되는 구동 신호를, V18H는 데이터 구동부(18)의 출력 전위를, 그리고 SCR1..CBm은 캐소드 전극 라인들(CR1,...,CBm)에 인가되는 구동 신호들을 각각 가리킨다.
도 2 내지 6을 참조하여 도 2의 데이터 구동부(18)의 출력 전위(V18H) 및 각 구동 신호의 파형들을 설명하면 다음과 같다.
수직 구동 주기(TVDR)는 수직 디스플레이 주기(TDISP) 및 수직 동기 주기(TVSYN)를 포함한다.
수직 디스플레이 주기(TDISP)에 있어서, 설정 정극성 전위(+Vg1)와 설정 펄스 폭(THDR)을 가진 정극성 주사 펄스가 게이트 전극 라인들(G1,...,Gn)에 순차적으로 인가되고, 부극성 데이터 펄스들이 주사 펄스에 상응하여 캐소드 전극 라인들(CR1,...,CBm)에 인가된다.
캐소드 전극 라인들(CR1,...,CBm)에 인가되는 데이터 신호의 펄스폭(TDPW)은 계조에 따라 변한다. 예를 들어, 최고 계조 데이터를 가진 부극성의 데이터 펄스의 폭(TDPW)은 정극성의 주사 펄스(THDR)의 폭과 동일하다. 또한, 최저 계조 데이터인 경우, 부극성의 데이터 펄스의 폭(TDPW)이 영이므로, 0 볼트(V)의 접지 전위가 인가된다.
포커싱 전극판(36)에는 관통구들(HR11,...,HBnm)로부터의 전자들의 포커싱을 위한 정극성 전위(+Vg2)가 인가된다.
다음에, 수직 동기 주기(TVSYN)에서 모든 전극 라인들에 0 볼트(V)의 접지 전위가 인가된다.
각각의 수평 구동 주기(t1~t4, 또는 t4~t7)는 블랭킹 시간(t1~t2, 또는 t4~t5) 및 수평 디스플레이 시간(t2~t4, 또는 t5~t7)을 포함한다.
데이터 전극 라인들로서의 캐소드 전극 라인들(CR1,...,CBm)을 구동하는 데이터 구동부(18)의 제1 출력 전위(+V18HR)는 수평 디스플레이 시간(t2~t4, 또는 t5~t7) 내에서 캐소드 전극 라인들(CR1,...,CBm) 각각의 계조에 비례한 시간(t2~t3, 또는 t5~t6) 동안에 출력된다. 이에 따라, 캐소드 전극 라인들(CR1,...,CBm) 각각에는 수평 디스플레이 시간(t2~t4, 또는 t5~t7) 내에서 캐소드 전극 라인들(CR1,...,CBm) 각각의 계조에 비례한 시간(t2~t3, 또는 t5~t6) 동안에 부극성의 구동 전위(-VC)가 인가된다.
여기에서, 블랭킹 시간(t1~t2, 또는 t4~t5)에서 데이터 구동부(18)의 출력 전위(V18H)가 상기 제1 출력 전위(V18HR)보다 높은 제2 출력 전위(V18HI)이다. 이에 따라, 수평 디스플레이 시간(t2~t4, 또는 t5~t7)의 초기 시간에서의 데이터 구동부(18)의 스위칭 손실이 보상될 수 있다. 즉, 데이터 구동부(18)의 스위칭 손실로 인하여 상대적으로 낮은 계조의 디스플레이 셀들에 더욱 낮은 구동 전력이 인가됨을 방지할 수 있다. 이에 따라, 데이터 구동부(18)의 스위칭 손실로 인하여 저계조의 표현 능력이 저하됨을 방지할 수 있다.
도 2, 4, 및 7을 참조하면, 제어 소자(15)는 아날로그-디지털 변환부(151), 프레임 메모리 제어부(153), 감마 정정부(154), 신호 변환부(155), 제1 라인 메모리(156), 제2 라인 메모리(157), 및 구동 제어부(158)를 포함한다.
아날로그-디지털 변환부(151)는 입력 영상 신호들(SIM)을 디지털 영상 데이터(SD1) 및 타이밍 제어 신호들(ST)로 변환시킨다. 아날로그-디지털 변환부(151)로부터의 타이밍 제어 신호들(ST)은 전원 공급부(19), 프레임 메모리 제어부(153), 감 마 정정부(154), 및 신호 변환부(155)에 각각 인가된다.
상기한 바와 같이, 전원 공급부(19)는, 제어 소자(15)의 아날로그-디지털 변환부(151)로부터의 타이밍 제어 신호들(ST)에 따라 동작하여, 데이터 구동부(18)의 동작 전위(V18H) 즉, 데이터 전극 라인들로서의 캐소드 전극 라인들(CR1,...,CBm)에 인가될 출력 전위(V18H)를 주기적으로 변경시킨다.
프레임 메모리 제어부(153)는, 아날로그-디지털 변환부(151)로부터의 타이밍 제어 신호들(ST)에 따라 동작하여, 아날로그-디지털 변환부(151)로부터의 디지털 영상 데이터(SD2)를 프레임 메모리(92)에 일시적으로 저장한 후, 프레임 메모리(12)로부터의 디지털 영상 데이터(SD3)를 출력한다.
감마 정정부(154)는, 아날로그-디지털 변환부(151)로부터의 타이밍 제어 신호들(ST)에 따라 동작하여, 프레임 메모리 제어부(153)로부터의 디지털 영상 데이터(SD3)의 감마 특성을 정정한다. 참고로, 입력 영상 신호들(SIM)에는 음극선관의 역감마 디스플레이 특성을 보정하기 위하여 감마 특성이 포함되어 있다. 따라서, 선형 디스플레이 특성을 가진 전자 방출 디스플레이 패널(11)의 구동을 위해서는 입력 영상 신호들(SIM)에 역감마 특성을 포함시키는 정정이 필요하다.
신호 변환부(155)는, 아날로그-디지털 변환부(151)로부터의 타이밍 제어 신호들(ST)에 따라 동작하여, 감마 정정부(154)로부터의 디지털 영상 데이터(SD4)를 펄스폭 변조 데이터(S1D)로 변환시키고, 조정된 타이밍 제어 신호들(S1T)을 발생시킨다.
제1 및 제2 라인 메모리들(156, 157)은 신호 변환부(155)로부터의 펄스폭 변조 데이터(S1D)를 주사 라인 단위로 교대로 출력한다.
구동 제어부(158)는, 제1 및 제2 라인 메모리들(156, 157)로부터의 펄스폭 변조 데이터(S1D1, S1D2)를 입력받고 신호 변환부(155)로부터의 타이밍 제어 신호들(S1T)에 따라 동작하여, 데이터 구동부(18)에 펄스폭 변조 데이터(SDD) 및 타이밍 제어 신호들(SDT)을 제공하고, 주사 구동부(17)에 타이밍 제어 신호들(SS)을 제공한다.
이상 설명된 바와 같이, 본 발명에 따른 전자 방출 디스플레이 장치에 의하면, 블랭킹 시간에서 데이터 구동부의 출력 전위가 상승하므로, 수평 디스플레이 시간의 초기 시간에서의 데이터 구동부의 스위칭 손실이 보상될 수 있다. 즉, 데이터 구동부의 스위칭 손실로 인하여 상대적으로 낮은 계조의 디스플레이 셀들에 더욱 낮은 구동 전력이 인가됨을 방지할 수 있다. 이에 따라, 데이터 구동부의 스위칭 손실로 인하여 저계조의 표현 능력이 저하됨을 방지할 수 있다.
본 발명은, 상기 실시예에 한정되지 않고, 청구범위에서 정의된 발명의 사상 및 범위 내에서 당업자에 의하여 변형 및 개량될 수 있다.

Claims (6)

  1. 전자 방출원들, 데이터 전극 라인들, 상기 데이터 전극 라인들과 교차하도록 형성된 주사 전극 라인들, 형광 셀들, 및 상기 전자 방출원들로부터의 전자들이 상기 형광 셀들로 이동하도록 전위가 인가되는 양극판을 포함한 전자 방출 디스플레이 장치에 있어서,
    각각의 수평 구동 주기가 블랭킹 시간 및 수평 디스플레이 시간을 포함하고,
    상기 데이터 전극 라인들을 구동하는 데이터 구동부의 제1 출력 전위가 상기 수평 디스플레이 시간 내에서 상기 데이터 전극 라인들 각각의 계조에 비례한 시간 동안에 출력되되,
    상기 블랭킹 시간에서 상기 데이터 구동부의 출력 전위가 상기 제1 출력 전위보다 높은 제2 출력 전위인 전자 방출 디스플레이 장치.
  2. 제1항에 있어서,
    상기 각각의 수평 디스플레이 시간의 폭을 가진 주사 펄스가 상기 주사 전극 라인들에 순차적으로 인가되는 전자 방출 디스플레이 장치.
  3. 제1항에 있어서, 상기 데이터 전극 라인들이,
    전자 방출원들과 전기적으로 연결된 캐소드 전극 라인들인 전자 방출 디스플레이 장치.
  4. 제3항에 있어서, 상기 주사 전극 라인들이,
    상기 캐소드 전극 라인들과 교차되는 영역에 상기 전자 방출원들에 대응하는 관통구들이 형성된 게이트 전극 라인들인 전자 방출 디스플레이 장치.
  5. 제4항에 있어서, 상기 형광 셀들이,
    상기 게이트 전극 라인들의 관통구들에 대응하여 위치한 전자 방출 디스플레이 장치.
  6. 전자 방출원들과 전기적으로 연결된 캐소드 전극 라인들,
    상기 캐소드 전극 라인들과 교차되는 영역에 상기 전자 방출원들에 대응하는 관통구들이 형성된 게이트 전극 라인들,
    상기 게이트 전극 라인들의 관통구들에 대응하는 관통구들이 형성된 포커싱 전극판,
    상기 포커싱 전극판의 관통구들에 대응하여 형성된 형광 셀들, 및
    상기 전자 방출원들로부터의 전자들이 상기 형광 셀들로 이동하도록 정극성 전위가 인가되는 양극판을 포함한 전자 방출 디스플레이 장치에 있어서,
    각각의 수평 구동 주기가 블랭킹 시간 및 수평 디스플레이 시간을 포함하고,
    상기 데이터 전극 라인들을 구동하는 데이터 구동부의 제1 출력 전위가 상기 수평 디스플레이 시간 내에서 상기 데이터 전극 라인들 각각의 계조에 비례한 시간 동안에 출력되되,
    상기 블랭킹 시간에서 상기 데이터 구동부의 출력 전위가 상기 제1 출력 전위보다 높은 제2 출력 전위인 전자 방출 디스플레이 장치.
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