KR20060092377A - 비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법 - Google Patents

비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법 Download PDF

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Abstract

본 발명은 비동기 단말 모뎀의 초기 셀 탐색기에서 주파수 옵셋의 영향을 줄일 수 있는 비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법에 관한 것이다.
본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐색기에서의 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법은, 제1 안테나와 제2 안테나로부터의 연속된 슬롯 신호를 수신하는 단계와, 상기 제1 안테나와 제2 안테나 신호의 우수 번째(i번째) 슬롯과 제2 안테나 신호의 기수 번째(i-1 번째 또는 i+1 번째) 슬롯에 포함된 동기 채널 및 공통 파일럿 채널 신호를 모두 이용하여 연산처리하는 단계를 포함하여 구성되는 것을 특징으로 한다.
이와 같은 본 발명의 구성에 의하면 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 신호 검출 과정에 따른 시간의 낭비를 제거하고, 주파수 옵셋 문제를 추가적인 모듈 구성 없이도 해결할 수 있는 이점을 제공한다.
초기 셀 탐색기, 인코딩 식별자 검출, 주파수 옵셋, STTD

Description

비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법{Cell searcher of asynchronous terminal modem and Method for detecting downlink STTD encoding indicator}
도 1은 종래 기술에 따른 다이버서티 비적용의 경우에 있어서의 동기 채널의 구성을 설명하기 위한 도면
도 2는 종래 기술에 따른 다이버서티 적용의 경우에 있어서의 동기 채널의 구성을 설명하기 위한 도면
도 3은 다이버서티 적용 및 비적용의 경우에서의 공통 파일럿 채널의 변조패턴을 나타내는 도면
도 4는 본 발명의 비동기 단말 모뎀의 초기 셀 탐색기의 일 실시 예에 따른 주요 구성 블록을 도시한 도면
도 5는 본 발명의 비동기 단말 모뎀의 초기 셀 탐색기에서의 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법의 일 실시 예를 설명하기 위한 도면
<도면의 주요 부분에 대한 부호의 설명>
420: 확산코드 생성기 430: 8 확산코드 상관기
440: 제2 안테나 패턴 생성기 450: 승산기
460: 역확산기 470: 가간섭성 누산기
본 발명은 비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법에 관한 것이다.
비동기 단말 모뎀의 초기 셀 탐색기(Initial Cell Searcher)의 공간 시간 전송 다이버서티(Space Time Transmit Diversity: STTD) 인코딩 식별자 비트를 검출하기 위한 모듈 구성에 있어서는 비간섭성 검출 구조(Non-coherent Detection Scheme)와 가간섭성(Coherent) 검출 구조 등 두 가지 방식을 고려할 수 있다.
상기 비간섭성 검출 구조의 경우 비동기 단말 모뎀의 초기 셀 탐색기의 구조에 추가적인 모듈 구성이 필요 없다는 장점이 있다. 하지만, 이 방식은 다이버서티 케이스(Diversity Case)에서 제1 안테나 및 제2 안테나 전송 채널의 독립적인 채널 페이딩(Fading) 특성으로 인하여 오검출(False Detection) 확률이 높아지는 단점이 있다. 따라서, 현재 비동기 단말 모뎀의 초기 셀 탐색기의 설계에 있어서 기본적인 구조에 추가적인 모듈이 부가되더라도 공간 시간 전송 다이버서티 인코딩 식별자 비트에 대한 정확한 검출 확률을 높이기 위해서는 가간섭성 검출 구조가 고 려되고 있다.
한편, 비동기 기지국의 동기 채널(Synchronization Channel: SCH)의 전송 방식은 다이버서티의 적용 유무에 의해 두 가지 형식으로 나누어진다.
도 1은 종래 기술에 따른 다이버서티 비적용의 경우에 있어서의 동기 채널의 구성을 설명하기 위한 도면이고, 도 2는 종래 기술에 따른 다이버서티 적용의 경우에 있어서의 동기 채널의 구성을 설명하기 위한 도면이다.
도 1을 참조하면, 종래 기술에 따른 다이버서티 비적용의 경우에 있어서의 동기 채널은 주요 동기 채널(Primary SCH: P-SCH)과 부가 동기 채널(Secondary SCH: S-SCH)로 구성된다.
상기 주요 동기 채널(Primary SCH)의 각각의 슬롯(Slot#0 내지 Slot#14)에는 각각 2560 칩 중에 256 칩으로 구성되는 주요 동기 채널 STTD 인코딩 식별자 비트 acp가 포함된다. 상기 부가 동기 채널(Secondary SCH)의 각각의 슬롯(Slot#0 내지 Slot#14)에도 각각 2560 칩 중에 256 칩으로 구성되는 부가 동기 채널 STTD 인코딩 식별자 비트 acs 1,0 내지 acs 1,14가 포함된다.
도 1에서, a는 주요 공통 제어 물리 채널(primary common control physical channel: P-CCPCH)에 대한 STTD 인코딩 식별자 심벌을 나타내는 것으로, P-CCPCH이 STTD 인코딩되는 경우 a = +1이 되고, P-CCPCH이 STTD 인코딩되지 않는 경우 a = -1이 된다. Cp 는 주요 동기 코드(Primary synchronization code: PSC)를 나타내고, Cs i,k 는 부가 동기 코드(Secondary synchronization code: SSC)를 나타낸다.
도 2를 참조하면, 종래 기술에 따른 다이버서티 적용의 경우에 있어서의 동기 채널은, 제1 안테나(Antenna 1)와 제2 안테나(Antenna)에 대하여 해당 STTD 인코딩 식별자 비트 신호가 포함되게 되는데, 다이버서티가 적용되지 않는 경우에 있어서 해당 STTD 인코딩 식별자 비트 신호가 모든 슬롯에 포함되는 것과는 달리, 각 안테나별로 각각 기수(odd) 또는 우수(even) 슬롯에만 해당 STTD 인코딩 식별자 비트 신호가 삽입되는 구조로 구성된다.
상기와 같이, SCH 채널은 동기 코드(Synchronization Code) 정보 이외에, STTD 인코딩 식별자 비트(a)로 나타내어진 부호를 이용하여 STTD 적용 유무를 전송한다. 따라서 STTD 인코딩 식별자 비트에 대한 정확한 검출이 필요하지만 전송 채널을 통해 수신기로 들어온 신호는 전송 채널의 페이딩 특성 등으로 인하여 신호의 진폭과 위상에 많은 왜곡이 포함되게 된다. 때문에, 가간섭성 검출 구조에서는 공통 파일럿 채널(Common Pilot Channel: CPICH)의 신호를 이용하여 추정한 전송 채널 정보에 따라서 신호의 왜곡을 보상한 뒤 STTD 인코딩 식별자 비트 부호로 STTD 적용 유무를 결정한다.
단일 경로 채널(Single-path Channel)을 가정하여 다이버서티 비적용 경우에서의 초기 셀 탐색기 수신 신호를 나타내면 다음의 (수학식 1)과 같이 나타낼 수 있다.
(수학식 1)
Figure 112005008348800-PAT00001
상기 (수학식 1)에서는, 다이버서티 비적용 경우에 해당하므로 a = -1을 가지며, G는 CPICH 채널과 P-SCH채널간 전력비이며, Ccpich,k와 Cp,k는 각각 칩 단위의 CPICH 채널 신호와 P-SCH 채널 신호를 나타낸다. 또한, h1,k와 nk는 각각 제1 안테나 전송 채널의 성분과 부가적 백색 가우시안 잡음(Additive White Gaussian Noise: AWGN)으로 모델링된 잡음과 간섭 성분의 합을 나타낸다.
다음의 (수학식 2)는 다이버서티가 적용된 경우에서의 초기 탐색기 수신 신호를 나타낸다.
(수학식 2)
Figure 112005008348800-PAT00002
상기 (수학식 2)에서 h2,k와 n'k 는 각각 제2 안테나의 전송 채널의 성분과 다이버서티가 적용된 경우에서의 AWGN으로 모델링된 잡음과 간섭 성분의 합을 나타내며, ±부호와 h1,k 혹은 h2,k 채널 성분은, 다이버서티 적용 및 비적용의 경우에서의 공통 파일럿 채널의 변조패턴을 나타내는 도면인 도 3에 도시된 바와 같이, 제2 안테나에 대응되는 각각의 슬롯 번호(Slot Number)와 심벌(Symbol) 위치에 따라 선택된다. 상기 (수학식 2)에서 알 수 있듯이, 다이버서티 적용의 결과로 초기 탐색기 수신 신호는 다중 경로를 통해 수신되는 여러 신호들의 합으로 나타남을 알 수 있 다.
한편, 종래 기술에 따른 가간섭성 검출 구조에는 두 가지 방식이 있으며, 이하에서는, 종래 기술에 따른 각각의 가간섭성 검출 방법에 따라 해당 소프트 메트릭(Soft Metric)을 구하는 방식을 설명한다.
첫 번째 방식의 경우, 소프트 메트릭을 구하기 위하여 먼저, 동기 채널과 공통 파일럿 채널 신호에 대한 Si와 Pi 값을 다음의 (수학식 3)에 의하여 구한다.
(수학식 3)
Figure 112005008348800-PAT00003
상기 (수학식 3)에서 i는 슬롯 번호(slot number)이고, NSCH 는 1개의 슬롯당 동기 채널 심벌의 칩 개수로서 NSCH =256이며, NCPICH 는 채널 추정을 위해 누적되는 CPICH 심벌의 칩 개수로 확산 계수(Spread Factor: SF)를 256으로 설정하는 경우를 고려하면 256의 배수 값을 갖게 된다.
채널의 위상을 보상하기 위하여 동기 채널과 공통 파일럿 채널 신호에 대한 Si와 Pi 에 대하여 다음과 같은 관계를 이용한다.
(수학식 4)
Figure 112005008348800-PAT00004
상기 (수학식 4)를 이용하면 STTD 인코딩 식별자 비트는 다음의 (수학식 5) 과 같이 결정된다.
(수학식 5)
Figure 112005008348800-PAT00005
최종적으로, 구하고자 하는 소프트 메트릭은 상기 결과에 대해 NS 슬롯 구간 동안 누적하여 다음의 (수학식 6)과 같이 구하게 된다.
(수학식 6)
Figure 112005008348800-PAT00006
또한, 두 번째 방식은 연속된 2개의 슬롯 구간의 CPICH 신호를 이용하여 소프트 매트릭을 구하는 것으로 다음의 (수학식 7)로 표현되는 값을 먼저 구한다.
(수학식 7)
Figure 112005008348800-PAT00007
상기 (수학식 7)에 사용되는 동기 채널의 i번째 신호인 Si, 공통 파일럿 채널의 제1 및 제2 슬롯의 i번째 신호인 Pi,1, Pi,2는 각각 다음의 수학식과 같이 나타난다.
(수학식 8)
Figure 112005008348800-PAT00008
(수학식 9)
Figure 112005008348800-PAT00009
(수학식 10)
Figure 112005008348800-PAT00010
상기 수학식에서 NSCH = 256이며, 공통 파일럿 채널은 2개의 슬롯 구간에 해당하므로 NCPICH = 512를 사용한다.
최종적으로, 두 번째 방식에 따르는 경우 소프트 메트릭은 상기 결과를 동기채널의 칩 개수에 해당하는 NS 슬롯 구간 동안 누적시켜 구하게 되며, 다음의 (수학식 12)와 같이 표현된다.
(수학식 11)
Figure 112005008348800-PAT00011
그러나 상기와 같이 종래 기술에 따른 첫 번째 방식을 사용한 경우에, 기수 번째(Odd-numbered) 슬롯을 사용하여 누적시키게 되면 소프트 매트릭을 구하게 될 때 h1과 h2를 구하는 과정에서 상관 성분이 발생하게 되므로, 이를 방지하기 위하여 NS 슬롯 구간 중 우수 번째(Even-numbered) 슬롯만을 사용하게 된다. 이와 같이, NS 누적 슬롯 구간 동안 전체 슬롯의 절반만을 이용하게 되면 전체적인 검출 프로세스 시간이 길어지는 단점이 생긴다.
또한, 두 번째 방식을 따르는 경우는 상기 문제점은 생기지 않게 되지만, 주파수 옵셋의 영향이 압도적(Dominant)인 경우 전체적인 검출 성능이 급속히 저하되게 된다.
예를 들면, 3ppm의 오실레이터를 사용하였을 경우 2GHz 대역에서 발생하는 6kHz의 주파수 옵셋의 영향은 CPICH 신호의 256 칩 구간 동안 144도의 위상 변화를 가져온다. 따라서, 최소 두 심벌 구간의 가간섭성 합산을 이용하는 방식은 위상 변화의 영향을 받게 되고, 10ppm 까지의 오실레이터 사용을 고려한다면 상기 영향은 더욱더 커지게 되는 문제점이 생기게 된다.
본 발명은 비동기 단말 모뎀의 초기 셀 탐색기에서 검출 프로세스 시간 지연 문제를 해결하고 아울러 주파수 옵셋의 영향을 줄일 수 있는 비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법을 제공하는 것에 그 목적이 있다.
이와 같은 목적을 달성하기 위한 본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐색기는, 확산코드를 생성하여 출력하는 확산코드 생성기와, 입력 버퍼로부터의 칩 단위 출력 데이터와 상기 확산코드 생성기의 출력과의 상관 관계를 구하여 출력시키는 8 확산코드 상관기와, 제2 안테나 패턴을 생성하여 출력시키는 제2 안테나 패턴 생성기와, 상기 8 확산코드 상관기의 출력과 상기 제2 안테나 패턴 생성기의 출력을 승산 시켜 출력하는 승산기와, 상기 승산기의 출력을 역확산시켜 출력하는 역확산기 및 상기 역확산기의 출력을 일정 칩 구간 동안 가간섭성 합산하여 심벌 단위의 신호를 출력시키는 가간섭성 누산기를 포함하여 구성되는 것을 특징으로 한다.
상기 목적을 달성하기 위한 본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐색기에서의 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법은, 제1 안테나와 제2 안테나로부터의 연속된 슬롯 신호를 수신하는 단계와, 상기 제1 안테나와 제2 안테나 신호의 우수 번째(i번째) 슬롯과 기수 번째(i-1 번째 또는 i+1 번째) 슬롯에 포함된 동기 채널 및 공통 파일럿 채널 신호를 모두 이용하여 연산처리하는 단계를 포함하여 구성되는 것을 특징으로 한다.
상기 동기 채널 및 공통 파일럿 채널 신호를 모두 이용하여 연산처리하는 단계는, 제1 안테나 신호의 i번째 슬롯에 대해 동기 채널 신호를 역확산시켜 가간섭성 누산값을 구하고, 공통 파일럿 채널 신호에 대해 제2 안테나 패턴을 곱한 후 역확산시켜 일정 칩 구간에 대해 제1 가간섭성 누산값(Coherent Sum)을 구하는 단계 와, 제2 안테나 신호의 i+1번째 슬롯에 대해 동기 채널 신호를 역확산시켜 가간섭성 누산값을 구하고, 공통 파일럿 채널 신호에 대해 제2 안테나 패턴을 곱한 후 역확산시켜 일정 칩 구간에 대해 제2 가간섭성 누산값(Coherent Sum)을 구하는 단계와, 상기 제1 가간섭성 누산값과 상기 제2 가간섭성 누산값의 가산값을 구하는 단계와, 상기 가산값의 실수값을 취하는 단계를 포함하여 구성되는 것을 특징으로 한다.
상기 제1 및 제2 가간섭성 누산값을 구하는 일정 칩 구간은 최대 256 칩을 넘지 않는 것을 특징으로 한다.
상기 제1 및 제2 가간섭성 누산값을 구하는 일정 칩 구간은 연속된 두 슬롯의 처음 256 칩의 동기 채널과 공통 파일럿 채널 신호를 이용하는 것을 특징으로 한다.
상기와 같이 구성되는 본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법에 따르면, 우수 번째와 기수 번째 슬롯 모두의 동기 채널 및 공통 파일럿 채널 신호를 이용하게 됨으로써, 비동기 단말 모뎀의 초기 셀 탐색기에서 검출 프로세스 시간 지연이 발생하지 않고, 아울러 주파수 옵셋의 영향이 줄어드는 이점을 제공하게 된다.
이하, 첨부된 도면을 참조하여 본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법에 대하여 실시 예를 들어 상세히 설명한다.
도 4는 본 발명의 비동기 단말 모뎀의 초기 셀 탐색기의 일 실시 예에 따른 주요 구성 블록을 도시한 도면이고, 도 5는 본 발명의 비동기 단말 모뎀의 초기 셀 탐색기에서의 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법의 일 실시 예를 설명하기 위한 도면이다.
도 4를 참조하면, 본 발명의 일 실시 예에 따른 비동기 단말 모뎀의 초기 셀 탐색기는, 입력 버퍼(410)와, 확산코드 생성기(420)와, 8 확산코드 상관기(430)와, 제2 안테나 패턴 생성기(440)와, 승산기(450)와, 역확산기(460) 및 가간섭성 누산기(470)를 포함하여 구성된다.
상기 입력 버퍼(410)는 제1안테나 및 제2 안테나로부터의 신호를 입력받아 입력신호를 칩 단위로 출력한다.
상기 확산코드 생성기(420)는 요구되는 확산 계수에 따른 확산코드를 생성하여 출력한다.
상기 8 확산코드 상관기(430)는 상기 입력 버퍼(410)의 칩 단위 출력 데이터와 상기 확산코드 생성기(420)의 출력의 상관 관계를 구하여 출력한다.
상기 제2 안테나 패턴 생성기(440)는 제2 안테나 패턴을 생성하여 출력한다.
상기 승산기(450)는 상기 8 확산코드 상관기(430)의 출력과 상기 제2 안테나 패턴 생성기(440)의 출력을 승산 시켜 출력한다.
상기 역확산기(460)는 상기 승산기(450)의 출력을 역확산시켜 출력한다.
상기 가간섭성 누산기(470)는 상기 역확산기(460)의 출력을 일정 칩 구간 동안 가간섭성 합산(Coherent Sum)하여 심벌 단위의 신호를 출력한다.
상기와 같은 구성을 가지는 본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐 색기의 동작 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법을 설명을 설명한다.
도 5를 참조하면, 본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐색기에서 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자를 검출하기 위하여, 입력 버퍼(410)에서는 다이버서티가 적용된 제1안테나 및 제2 안테나로부터의 신호를 입력받아, 상기 입력받은 신호를 칩 단위로 출력한다(S510).
상기 칩 단위로 출력되는 신호 중에 제1 안테나 신호의 i번째 슬롯의 첫 번째 256 칩에 해당되는 동기 채널 신호에 대해서는 일반적인 방법에 따라서 동기 채널 신호를 역확산시켜 가간섭성 누산값을 구하여 출력하게 되나, 상기 칩 단위로 출력되는 신호 중에 제2 안테나 신호의 i번째 슬롯과 i+1번째 슬롯의 첫 번째 256 칩에 해당되는 공통 파일럿 채널 신호에 대해서는 다음의 단계가 수행된다.
상기 8 확산코드 상관기(430)는 상기 입력 버퍼(410)에서 칩 단위로 출력되는 신호 데이터와 확산코드 생성기(420)에서 출력되는 확산코드와의 상관 관계를 구하여 출력한다(S520).
승산기(450)는 상기 8 확산코드 상관기(430)에서 출력되는 제2 안테나 신호에 대하여 제2 안테나 패턴 생성기(440)에서 출력되는 제2 안테나 패턴을 승산 시켜 출력한다(S530). 도 3에 도시된 바와 같이, 제2 안테나 패턴은 우수 번째 슬롯(0, 2, 4 번째 등의 슬롯)과 기수 번째 슬롯(1, 3, 5번째 등의 슬롯) 구간 단위로 안테나 인코딩 패턴이 교차하여 있으므로 교대로 ±1의 값을 갖는다. 예를 들면, 도 3에서 0번 슬롯의 2A 구간에서는 제2 안테나 패턴이 0으로 되어 a = -1의 값으 로 되며, 1번 슬롯의 2B 구간에서는 제2 안테나 패턴이 1로 인코딩되어 a = +1의 값을 갖게 된다.
이와 같이 교차하여 인코딩된 제2 안테나 인코딩 패턴이 슬롯 순서에 따라서 해당 신호에 승산 되어 출력된다.
이어서, 역확산기(460)는 상기 승산기(450)의 출력을 역확산시켜 출력한다(S540).
칩 단위의 신호가 상기 과정에 따라서 역확산되어 출력되면, 가간섭성 누산기(470)는 상기 역확산기(460)의 출력을 i번째 슬롯과 i+1번째 슬롯의 일정 칩 구간 동안 가간섭성 합산(Coherent Sum)함으로써 제1 및 제2 가간섭성 누산값을 구하여 심벌 단위의 신호를 출력하게 된다.
상기 제1 및 제2 가간섭성 누산값을 구하는 일정 칩 구간은, 최대 256 칩을 넘지 않게 한다. 이는 256 칩이 넘게 되는 경우에는 주파수 옵셋의 영향을 받을 수 있기 때문이다. 또한, 상기 가간섭성 누산값을 구하는 일정 칩 구간은 사용되는 확산 계수와 일치시키는 것이 바람직하다. 본 발명의 일 실시 예에 따르는 상기 가간섭성 누산값을 구하는 일정 칩 구간은 i번째 슬롯과 i+1번째 슬롯의 첫 번째 256 칩으로 설정된다.
상기 과정에 따라서, 심벌 단위의 신호로 출력되는 동기 채널 신호(Si)와 공통 파일럿 채널 신호(Pi)는 다음의 (수학식 12)와 같이 각각 표현된다.
(수학식 12)
Figure 112005008348800-PAT00012
Figure 112005008348800-PAT00013
위의 식에서 동기 채널의 칩 수(Nsch)와 공통 파일럿 채널의 칩 수(Ncpich)와 Nsch=Ncpich=256을 사용하며 b는 제2 안테나 패턴으로, 도 3에 도시된 바와 같이 256 칩 구간 단위로 ±값을 갖는다.
따라서, 예를 들면, 0번 슬롯과 1번 슬롯에서 상기 (수학식 12)는 다음 (수학식 13)과 같은 값을 갖는다.
(수학식 13)
Figure 112005008348800-PAT00014
상기의 결과를 연속되는 2개의 슬롯 단위로 가산하면 다음과 같이 나타난다.
따라서 위의 관계식에서 2 Slot 단위로 합하면 다음 (수학식 14)와 같아진다.
(수학식 14)
Figure 112005008348800-PAT00015
위의 결과에서 실수부(Real) 값만을 취할 경우 전송 채널로 인한 잡음의 영향은 무시할 수 있게 된다(S560).
결론적으로, 전술한 종래 기술에 따른 2번째 방식과 결과와 동일한 결과를 얻을 수 있게 되며, 본 발명에 따라 구해지는 소프트 메트릭은 공통 파일럿 채널의 슬롯 수(Ns)를 2로 한 경우에는, 즉 Ns=2인 경우, 다음의 (수학식 15)와 같이 나타난다.
(수학식 15)
Figure 112005008348800-PAT00016
위에서 상술한 바와 같이, 본 발명에 따르는 경우, 연속되는 2개의 슬롯에 부가된 동기 채널 신호 및 공통 파일럿 신호를 모두 이용하게 됨으로써 종래 기술에 따른 슬롯의 절반만을 이용하는 방식보다 더 빠르게 필요한 신호를 검출할 수 있게 될 뿐만 아니라, 상기 (수학식 15)와 종래 기술에 따른 2개의 슬롯 신호를 이용하는 방식에 의한 결과인 (수학식 11)과 비교하면 알 수 있듯이 주파수 옵셋에 따른 영향이 제거된다.
이상에서 본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법을 상세히 설명하였다. 그러나 본 발명은 이에 한정되는 것이 아니라 본 발명의 기술적 사상의 기초를 벗어나지 않고 변경 및 수정을 가하여 실시하더라도 본 발명에 포함되는 것이며, 그러한 사실은 당업자에게 자명할 것이다.
본 발명에 따른 비동기 단말 모뎀의 초기 셀 탐색기 및 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법에 따르면, 파일럿 채널 슬롯 신호 누적에서 슬롯의 절반만을 이용하는 방식에서 발생하는 신호 검출 과정에 따른 시간의 낭비를 제거하고, 종래 기술에 따른 2개의 슬롯 신호를 이용하는 방식에서 고가의 진동자(Oscillator)를 사용하지 못하므로 발생하는 256 칩 구간 이상의 가간섭성 누산(Coherent Sum)으로 인한 주파수 옵셋 문제를 추가적인 모듈 구성 없이도 해결할 수 있는 이점을 제공한다.

Claims (5)

  1. 확산코드를 생성하여 출력하는 확산코드 생성기와;
    입력 버퍼로부터의 칩 단위 출력 데이터와 상기 확산코드 생성기의 출력과의 상관 관계를 구하여 출력시키는 8 확산코드 상관기와;
    제2 안테나 패턴을 생성하여 출력시키는 제2 안테나 패턴 생성기와;
    상기 8 확산코드 상관기의 출력과 상기 제2 안테나 패턴 생성기의 출력을 승산 시켜 출력하는 승산기와;
    상기 승산기의 출력을 역확산시켜 출력하는 역확산기 및 상기 역확산기의 출력을 일정 칩 구간 동안 가간섭성 합산하여 심벌 단위의 신호를 출력시키는 가간섭성 누산기; 를
    포함하여 구성되는 것을 특징으로 하는 비동기 단말 모뎀의 초기 셀 탐색기.
  2. 제1 안테나와 제2 안테나로부터의 연속된 슬롯 신호를 수신하는 단계와;
    상기 제1 안테나와 제2 안테나 신호의 우수 번째(i번째) 슬롯과 기수 번째(i-1 번째 또는 i+1 번째) 슬롯에 포함된 동기 채널 및 공통 파일럿 채널 신호를 모두 이용하여 연산처리하는 단계;
    를 포함하여 구성되는 것을 특징으로 하는 비동기 단말 모뎀의 초기 셀 탐색기에서의 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법.
  3. 제 2항에 있어서, 상기 동기 채널 및 공통 파일럿 채널 신호를 모두 이용하여 연산처리하는 단계는,
    제1 안테나 신호의 i번째 슬롯에 대해 동기 채널 신호를 역확산시켜 가간섭성 누산값을 구하고, 공통 파일럿 채널 신호에 대해 제2 안테나 패턴을 곱한 후 역확산시켜 일정 칩 구간에 대해 제1 가간섭성 누산값(Coherent Sum)을 구하는 단계와;
    제2 안테나 신호의 i+1번째 슬롯에 대해 동기 채널 신호를 역확산시켜 가간섭성 누산값을 구하고, 공통 파일럿 채널 신호에 대해 제2 안테나 패턴을 곱한 후 역확산시켜 일정 칩 구간에 대해 제2 가간섭성 누산값(Coherent Sum)을 구하는 단계와;
    상기 제1 가간섭성 누산값과 상기 제2 가간섭성 누산값의 가산값을 구하는 단계와;
    상기 가산값의 실수값을 취하는 단계;를
    포함하여 구성되는 것을 특징으로 하는 비동기 단말 모뎀의 초기 셀 탐색기에서의 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법.
  4. 제 3항에 있어서, 상기 제1 및 제2 가간섭성 누산값을 구하는 일정 칩 구간은, 최대 256 칩을 넘지 않는 것을 특징으로 하는 비동기 단말 모뎀의 초기 셀 탐색기에서의 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법.
  5. 제 3항에 있어서, 상기 제1 및 제2 가간섭성 누산값을 구하는 일정 칩 구간은, 연속된 두 슬롯의 처음 256 칩의 동기 채널과 공통 파일럿 채널 신호를 이용하는 것을 특징으로 하는 비동기 단말 모뎀의 초기 셀 탐색기에서의 다운 링크 공간 시간 전송 다이버서티 인코딩 식별자 검출 방법.
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