KR20060083047A - 플라즈마 디스플레이 패널의 구동장치 - Google Patents

플라즈마 디스플레이 패널의 구동장치 Download PDF

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KR20060083047A
KR20060083047A KR1020050003928A KR20050003928A KR20060083047A KR 20060083047 A KR20060083047 A KR 20060083047A KR 1020050003928 A KR1020050003928 A KR 1020050003928A KR 20050003928 A KR20050003928 A KR 20050003928A KR 20060083047 A KR20060083047 A KR 20060083047A
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sustain
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정성희
김희중
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엘지전자 주식회사
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Abstract

본 발명은 노이즈를 방지함과 아울러 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동장치에 관한 것이다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동장치는 플라즈마 디스플레이 패널의 스캔전극에 기저전압 및 서스테인전압을 공급하기 위한 서스테인전압 공급부와, 상기 패널과 상기 서스테인전압 공급부 사이에 접속되어 상기 스캔전극에 셋업전압을 공급하기 위한 셋업전압 공급부를 구비하며, 상기 셋업전압 공급부는 셋업전압원과, 상기 셋업전압원과 상기 서스테인전압 공급부 사이에 직렬로 접속된 제 1 스위치 및 제 1 다이오드와, 상기 제 1 스위치의 게이트단자에 접속된 제 1 가변저항을 구비한다.
이러한 구성에 의하여 본 발명은 정극성의 전압을 공급하는 전압원에 역전류 방지용 다이오드를 설치하여 스캔전극에 정극성의 전압이 공급될 때 노이즈의 발생을 방지함으로써 플라즈마 디스플레이 패널의 오방전을 방지할 수 있다.

Description

플라즈마 디스플레이 패널의 구동장치{APPARATUS FOR DRIVING PLASMA DISPLAY PANEL}
도 1은 플라즈마 디스플레이 패널에서 256 계조를 구현하기 위한 8 비트 디폴트 코드의 서브필드 패턴을 나타내는 도면이다.
도 2는 3 전극 교류 면방전형 플라즈마 디스플레이 패널의 전극배치를 개략적으로 나타내는 평면도이다.
도 3은 통상적인 플라즈마 디스플레이 패널의 구동파형을 나타내는 파형도이다.
도 4는 플라즈마 표시장치를 나타내는 도면이다.
도 5는 도 4에 도시된 스캔 구동부와 서스테인 구동부를 상세히 나타내는 회로도이다.
도 6은 서스테인기간에 스캔전극에 서스테인펄스가 충/방전 될 때 도 5에 도시된 스캔전압원에서의 전류 흐름을 나타내는 도면이다.
도 7은 서스테인기간에 도 5에 도시된 스캔전압 공급부의 게이트단자에 유기되는 전압을 나타내는 도면이다.
도 8은 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동장치를 나타내는 도면이다.
< 도면의 주요 부분에 대한 부호의 설명 >
1 : 방전셀 40 : 플라즈마 디스플레이 패널
41 : 타이밍 콘트롤러 42 : 데이터 구동부
43, 100 : 스캔 구동부 44, 120 : 서스테인 구동부
45 : 구동전압 발생부
51, 52, 110, 130 : 에너지 회수회로
55, 112 : 스캔 IC 102 : 서스테인전압 공급부
104 : 셋업전압 공급부 106 : 스캔 바이어스전압 공급부
108 : 스캔전압 공급부
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 노이즈를 방지함과 아울러 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel; 이하 "PDP"라 함)은 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 방전할 때 발생하는 자외선을 이 용하여 형광체를 여기 발광시킴으로써 화상을 표시하게 된다. PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 화질이 향상되고 있다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간(RP)과, 스캔라인을 선택하고 선택된 스캔라인에서 방전셀을 선택하기 위한 어드레스기간(AP)과, 방전횟수에 따라 계조를 구현하는 서스테인기간(SP)으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 1과 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 8 개의 서브 필드들(SF1 내지 SF8) 각각은 전술한 바와 같이, 리셋기간(RP), 어드레스기간(AP) 및 서스테인기간(SP)으로 나누어지게 된다. 각 서브필드의 리셋기간(RP)과 어드레스기간(AP)은 각 서브필드마다 동일한 반면에 서스테인 기간과 그에 할당되는 서스테인펄스의 수는 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 2는 종래의 3 전극 교류 면방전형 PDP의 전극배치를 개략적으로 나타낸 도면이다.
도 2를 참조하면, 종래의 3 전극 교류 면방전형 PDP는 상판에 형성된 스캔전극들(Y1 내지 Yn) 및 서스테인전극들(Z)과, 스캔전극들(Y1 내지 Yn) 및 서스테인전극들(Z)과 직교하도록 하판에 형성되는 어드레스전극들(X1 내지 Xm)을 구비한다.
스캔전극들(Y1 내지 Yn), 서스테인전극들(Z) 및 어드레스전극들(X1 내지 Xm) 의 교차부에는 적색, 녹색 및 청색 중 어느 하나를 표시하기 위한 방전셀들(1)이 매트릭스 형태로 배치된다.
스캔전극들(Y1 내지 Yn)과 서스테인전극들(Z)이 형성된 상판 상에는 도시하지 않는 유전체층과 MgO 보호층이 적층된다.
어드레스전극들(X1 내지 Xm)이 형성된 하판 상에는 인접한 방전셀들(1) 간에 광학적, 전기적 혼신을 방지하기 위한 격벽이 형성된다. 하판과 격벽 표면에는 자외선에 의해 여기되어 가시광을 방출하는 형광체가 형성된다.
이러한 PDP의 상판과 하판 사이의 방전공간에는 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 주입된다.
도 3은 도 2와 같은 PDP에 공급되는 구동파형을 나타낸 도면이다.
도 3을 참조하면, 서브필드(SF) 각각은 전화면의 방전셀들(1)을 초기화하기 위한 리셋기간(RP), 방전셀을 선택하기 위한 어드레스기간(AP) 및 선택된 방전셀들(1)의 방전을 유지시키기 위한 서스테인기간(SP)포함한다.
리셋기간(RP)에 있어서, 셋업기간(SU)에는 모든 스캔전극들(Y)에 상승 램프파형(PR)이 동시에 인가된다. 이 상승 램프파형(PR)에 의해 전화면의 셀들 내에는 미약한 방전(셋업방전)이 일어나게 되어 셀들 내에 벽전하가 생성된다. 셋다운기간(SD)에는 상승 램프파형(PR)이 인가된 후, 상승 램프파형(PR)의 피크전압보다 낮은 정극성(+)의 서스테인전압(Vs)에서 떨어지는 하강 램프파형(NR)이 스캔전극들(Y)에 동시에 인가된다. 하강 램프파형(NR)은 셀들 내에 미약한 소거방전을 일으킴으로써 셋업방전에 의해 생성된 벽전하 및 공간전하 중 불요전하를 소거시키게 되고 전화면의 셀들 내에 어드레스방전에 필요한 벽전하를 균일하게 잔류시키게 된다.
어드레스기간(AP)에는 부극성(-)의 스캔펄스(-SCNP)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 어드레스전극들(X)에 정극성(+)의 데이터펄스(DP)가 인가된다. 이 스캔펄스(-SCNP)와 데이터펄스(DP)의 전압차와 리셋기간(RP)에 생성된 벽전압이 더해지면서 데이터펄스(DP)가 인가되는 셀 내에는 어드레스방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 벽전하가 생성된다.
한편, 셋다운기간(SD)과 어드레스기간(AP) 동안에 서스테인전극들(Z)에는 정극성(+)의 서스테인전압(Vs)이 인가된다.
서스테인기간(SP)에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(SUSP)가 인가된다. 그러면, 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(SUSP)가 더해지면서 매 서스테인펄스(SUSP)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 면방전 형태로 서스테인방전이 일어나게 된다. 여기서, 서스테인펄스들(SUSP)은 서스테인전압(Vs)과 동일한 전압값을 갖는다.
도 4는 플라즈마 표시장치를 개략적으로 나타내는 도면이다.
도 4를 참조하면, 종래의 플라즈마 표시장치는 어드레스전극들(X1 내지 Xm)에 데이터를 공급하기 위한 데이터 구동부(42)와, 스캔전극들(Y1 내지 Yn)을 구동하기 위한 스캔 구동부(43)와, 서스테인전극들(Z)을 구동하기 위한 서스테인 구동부(44)와, 각 구동부(42, 43, 44)를 제어하기 위한 타이밍 콘트롤러(41)와, 각 구 동부(42, 43, 44)에 필요한 구동전압을 공급하기 위한 구동전압 발생부(45)를 구비한다.
데이터 구동부(42)에는 도시하지 않은 역감마보정회로, 오차확산회로 등에 의해 역감마보정 및 오차확산 된 후, 서브필드맵핑회로에 의해 각 서브필드에 맵핑된 데이터가 공급된다. 이 데이터 구동부(42)는 타이밍 콘트롤러(41)로부터의 타이밍제어신호(Cx)에 응답하여 데이터를 샘플링하고 래치한 다음, 그 데이터의 데이터전압(Va)을 어드레스전극들(X1 내지 Xm)에 공급하게 된다.
스캔 구동부(43)는 타이밍 콘트롤러(41)의 제어하에 스캔전극들(Y1 내지 Ym)에 리셋기간(RP) 동안 도 3과 같은 초기화파형들을 공급한 후, 어드레스기간(AP) 동안 스캔 바이어스전압(Vscb)을 스캔전극들(Y1 내지 Yn)에 공급함과 아울러, 스캔펄스(-SCNP)를 스캔전극들(Y1 내지 Yn)에 순차적으로 공급한다. 그리고, 스캔 구동부(43)는 타이밍 콘트롤러(41)의 제어하에 서스테인기간(SP) 동안 서스테인펄스(SUSP)를 스캔전극들(Y1 내지 Ym)에 공급한다.
서스테인 구동부(44)는 타이밍 콘트롤러(41)의 제어하에 셋다운기간(SD)과 어드레스기간(AP) 동안 서스테인전극들(Z)에 정극성(+)의 서스테인전압(Vs)을 공급한 후에 서스테인기간(SP) 동안 스캔 구동부(43)와 교대로 동작하여 서스테인펄스(SUSP)를 공급하게 된다.
타이밍 콘트롤러(41)는 수직/수평 동기신호와 클럭신호를 입력받아 각 구동부에 필요한 타이밍 제어신호(Cx, Cy, Cz)를 발생하고 그 타이밍 제어신호(Cx, Cy, Cz)를 해당 구동부(42, 43, 44)에 공급함으로써 각 구동부(42, 43, 44)를 제어한 다. 데이터 제어신호(Cx)에는 데이터를 샘플링하기 위한 샘플링클럭, 래치제어신호, 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치 제어신호가 포함된다. 스캔 제어신호(Cy)에는 스캔구동부(43) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치 제어신호가 포함된다. 그리고, 서스테인 제어신호(Cz)에는 서스테인구동부(44) 내의 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치 제어신호가 포함된다.
구동전압 발생부(45)는 상승램프파형의 셋업전압(Vsetup), 부극성(-)의 스캔전압(Vy), 직류 바이어스전압(Vscb), 정극성(+)의 서스테인전압(Vs), 데이터전압(Va) 등을 발생한다.
도 5는 스캔 구동부(43)와 서스테인 구동부(44)를 상세히 나타내는 회로도이다.
도 5를 참조하면, 스캔 구동부(43)는 제 1 에너지 회수회로(51), 제 1 내지 제 9 스위치(SW1 내지 SW9) 및 스캔 집적회로(Intergrated Circuit; 이하 "IC"라 함)(55)를 구비한다. 그리고, 서스테인 구동부(44)는 제 2 에너지 회수회로(52), 제 12 및 제 13 스위치(SW12, SW13)를 구비한다.
제 1 및 제 2 에너지 회수회로(51, 52)는 PDP(40)에서 방전에 기여하지 않은 무효전력의 에너지를 패널(Cp)의 스캔전극(Y) 및 서스테인전극(Z)으로부터 회수하고 그 회수된 에너지를 이용하여 패널(Cp)의 스캔전극(Y) 및 서스테인전극(Z)을 충전하게 된다.
스캔 IC(55)는 제 3 노드(N3)와 제 4 노드(N4) 사이에 푸쉬풀 형태로 접속되 는 제 10 및 제 11 스위치(SW10, SW11)를 구비한다. 제 10 및 제 11 스위치소자들(SW10, SW11) 사이의 출력단자는 패널(Cp)의 스캔전극(Y)에 접속된다.
제 10 스위치(SW10)는 제 4 노드(N4)와 패널(Cp)의 스캔전극(Y) 사이에 접속되어 자신의 바디 다이오드를 통해 패널(Cp)의 스캔전극(Y)으로부터의 전압을 제 4 노드(N4)에 공급한다.
제 11 스위치(SW11)는 제 3 노드(N3)와 패널(Cp)의 스캔전극(Y) 사이에 접속되어 자신의 바디 다이오드를 통해 제 3 노드(N3) 상의 전압을 패널(Cp)의 스캔전극(Y)에 공급한다.
제 1 스위치(SW1)는 서스테인전압원(Vs)과 제 1 노드(N1) 사이에 접속되어 제 1 스위칭 제어신호에 따라 제 1 노드(N1)에 서스테인전압(Vs)를 공급한다.
제 2 스위치(SW2)는 기저전압원(GND)과 제 1 노드(N1) 사이에 접속되어 제 2 스위칭 제어신호에 따라 제 1 노드(N1)에 기저전압(GND)을 공급한다.
제 3 스위치(SW3)는 제 1 노드(N1)과 제 2 노드(N2) 사이에 접속되어 제 3 스위칭 제어신호에 따라 제 1 노드(N1)와 제 2 노드(N2)를 전기적으로 접속시킨다.
제 4 스위치(SW4)는 셋업전압원(Vsetup)과 제 2 노드(N2) 사이에 접속되고, 그 자신의 게이트단자에는 제 1 가변저항(R1)이 접속된다. 이러한, 제 4 스위치(SW4)는 제 4 스위칭 제어신호가 공급될 때 제 1 가변저항(R1)의 저항값의 변화에 따라 소정의 기울기로 셋업전압(Vsetup)까지 상승하는 전압을 제 2 노드(N2)에 공급한다.
제 5 스위치(SW5)는 제 2 노드(N2)와 제 3 노드(N3) 사이에 접속되어 제 5 스위칭 제어신호에 따라 제 2 노드(N2)와 제 3 노드(N3)를 전기적으로 접속시킨다.
제 6 스위치(SW6)는 제 3 노드(N3)와 스캔전압원(Vy) 사이에 접속되고, 그 자신의 게이트단자에는 제 2 가변저항(R2)이 접속된다. 이러한, 제 6 스위치(SW6)는 제 6 스위칭 제어신호가 공급될 때 제 2 가변저항(R2)의 저항값의 변화에 따라 소정의 기울기로 부극성(-)의 스캔전압(Vy)까지 하강하는 전압을 제 3 노드(N3)에 공급한다.
제 7 스위치(SW7)는 제 3 노드(N3)와 스캔전압원(Vy) 사이에 접속되어 제 7 스위칭 제어신호에 따라 부극성(-)의 스캔전압(Vy)을 제 3 노드(N3)에 공급한다.
제 8 스위치(SW8)는 제 3 및 제 3 노드(N3, N3) 사이와 제 4 노드(N4) 사이에 접속되어 제 8 스위칭 제어신호에 따라 제 3 노드(N3)와 제 4 노드(N4)를 전기적으로 접속시킨다.
제 9 스위치(SW9)는 스캔전압원(Vscb)과 제 4 노드(N4) 사이에 접속되어 제 9 스위칭 제어신호에 따라 스캔전압원(Vscb)을 제 4 노드(N4)에 공급한다.
제 12 및 제 13 스위치(SW12, SW13)는 서스테인전압원(Vs)과 기저전압원(GND) 사이에 직렬로 접속되어 서스테인기간(SP) 동안 서스테인전압 및 기저전압을 서스테인전극들(Z)에 공급한다.
이러한, 스위치들(SW1 내지 SW13)은 바디 다이오드(Body diode)가 내장된 전계효과트랜지스터(Field Effect Transistor)로 구현된다.
그러나, 종래의 스캔 구동부(43)에서는 스캔전극(Y)에 셋업전압(Vsetup)이 공급될 때 도 6에 도시된 바와 같이 서스테인전압원(Vs)으로부터 공급되는 서스테 인전압(Vs)에 의해 셋업전압원(Vsetup)과 제 2 노드(N2) 사이에 접속된 제 4 스위치(SW4)의 소스단자(S)와 게이트단자(G) 간의 기생 커패시터(C)에 전류가 충전된다. 이로 인해, 제 2 노드(N2)에는 도 7에 도시된 바와 같이 노이즈(Noise)가 더해진 셋업전압(Vsetup)이 공급되게 된다. 이에 따라, 리셋기간(RP) 중 셋업기간(SU) 동안 스캔전극(Y)에는 서스테인전압(Vs)과 노이즈가 더해진 셋업전압(Vsetup)이 공급되므로 PDP에서는 오방전이 발생하는 문제가 있다.
따라서, 본 발명의 목적은 노이즈를 방지함과 아울러 오방전을 방지할 수 있도록 한 플라즈마 디스플레이 패널의 구동장치를 제공하는데 있다.
상기 목적을 달성하기 위하여, 본 발명에 따른 플라즈마 디스플레이 패널의 구동장치는 플라즈마 디스플레이 패널의 스캔전극에 기저전압 및 서스테인전압을 공급하기 위한 서스테인전압 공급부와, 상기 패널과 상기 서스테인전압 공급부 사이에 접속되어 상기 스캔전극에 셋업전압을 공급하기 위한 셋업전압 공급부를 구비하며, 상기 셋업전압 공급부는 셋업전압원과, 상기 셋업전압원과 상기 서스테인전압 공급부 사이에 직렬로 접속된 제 1 스위치 및 제 1 다이오드와, 상기 제 1 스위치의 게이트단자에 접속된 제 1 가변저항을 구비한다.
본 발명에 따른 플라즈마 디스플레이 패널의 구동장치는 상기 패널과 상기 셋업전압 공급부 사이에 접속되어 상기 패널의 스캔전극에 부극성의 스캔전압을 공급하기 위한 스캔전압 공급부와, 상기 패널과 상기 스캔전압 공급부 사이에 접속되어 상기 패널의 스캔전극에 스캔 바이어스전압을 공급하기 위한 스캔 바이어스전압 공급부와, 상기 스캔전압 공급부, 스캔 바이어스전압 공급부 및 패널 사이에 푸쉬풀 형태로 접속된 스캔 IC와, 상기 서스테인전압 공급부와 상기 셋업전압 공급부 사이에 접속된 제 2 스위치와, 상기 셋업전압 공급부와 상기 스캔전압 공급부 사이에 접속된 제 3 스위치를 더 구비한다.
상기 스캔전압 공급부는 스캔전압원과, 상기 스캔전압원과 상기 스캔 IC 사이에 접속된 제 4 스위치와, 상기 제 4 스위치와 상기 스캔 바이어스전압 공급부에 접속된 제 5 스위치와, 상기 제 5 스위치의 게이트단자에 접속된 제 2 가변저항을 구비한다.
상기 스캔 기준전압 공급부는 스캔 기준전압원과, 상기 스캔 기준전압원과 상기 스캔 IC 사이에 접속된 제 6 스위치와, 상기 제 6 스위치와 상기 스캔전압 공급부 사이에 접속된 제 7 스위치를 구비한다.
상기 스캔 IC는 상기 제 6 스위치와 상기 패널의 스캔전극 사이에 접속된 제 8 스위치와, 상기 제 4 스위치와 상기 패널의 스캔전극 사이에 접속된 제 9 스위치를 구비한다.
상기 제 8 스위치는 그 자신의 바디 다이오드를 통해 상기 제 6 스위치와 상기 제 7 스위치 사이의 제 1 노드에 공급되는 부극성의 전압을 상기 패널의 스캔전극에 공급하는 것을 특징으로 한다.
상기 제 9 스위치는 그 자신의 바디 다이오드를 통해 상기 제 4 스위치와 상기 제 7 스위치 사이의 제 2 노드에 공급되는 정극성의 전압을 상기 패널의 스캔전극에 공급하는 것을 특징으로 한다.
상기 서스테인전압 공급부는 서스테인전압원과, 상기 서스테인전압원과 상기 기저전압원 사이에 직렬로 접속된 제 10 스위치, 제 2 다이오드 및 제 11 스위치를 구비한다.
상기 목적 외에 다른 목적 및 이점들은 첨부한 도면들을 참조한 본 발명의 바람직한 실시 예에 대한 설명을 통하여 명백하게 드러나게 될 것이다.
이하, 도 8을 참조하여 본 발명의 바람직한 실시 예들에 대하여 설명하기로 한다.
도 8은 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동장치를 나타내는 도면이다.
도 8을 참조하면, 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동장치는 스캔 구동부(100) 및 서스테인 구동부(130)를 구비한다.
스캔 구동부(100)는 타이밍 콘트롤러(도시하지 않음)의 제어하에 리셋기간(RP) 동안 패널(Cp)의 스캔전극들(Y)에 도 3과 같은 초기화파형들을 공급한 후, 어드레스기간(AP) 동안 스캔 바이어스전압(Vscb)을 패널(Cp)의 스캔전극들(Y)에 공급함과 아울러, 스캔펄스(-SCNP)를 패널(Cp)의 스캔전극들(Y)에 순차적으로 공급한다. 또한, 스캔 구동부(100)는 타이밍 콘트롤러의 제어하에 서스테인기간(SP) 동안 서스테인전압레벨(Vs)의 서스테인펄스(SUSP)를 패널(Cp)의 스캔전극들(Y)에 공 급한다. 이러한, 스캔 구동부(100)는 에너지 회수회로(110), 제 1 서스테인전압 공급부(102), 셋업전압 공급부(104), 스캔전압 공급부(108), 스캔 바이어스전압 공급부(106), 스캔 집적회로(Intergrated Circuit; 이하 "IC"라 함)(112), 제 3 및 5 스위치(SW3, SW5)를 구비한다.
제 1 에너지 회수회로(110)는 PDP에서 방전에 기여하지 않은 무효전력의 에너지를 패널(Cp)의 스캔전극(Y)으로부터 회수하고 그 회수된 에너지를 이용하여 패널(Cp)의 스캔전극(Y)을 충전하게 된다.
제 1 서스테인전압 공급부(102)는 타이밍 콘트롤러로부터 공급되는 제어신호에 따라 리셋기간(RP) 중 일부기간 동안 패널(Cp)의 스캔전극들(Y)에 서스테인전압(Vs)을 공급함과 아울러 서스테인기간(SP) 동안 서스테인전압레벨(Vs)의 서스테인펄스를 패널(Cp)의 스캔전극들(Y)에 공급한다. 이를 위해, 제 1 서스테인전압 공급부(102)는 서스테인전압원(Vs)과 기저전압원(GND) 사이에 직렬로 접속된 제 1 및 제 2 스위치(SW1, SW2)를 구비한다. 이때, 제 1 스위치(SW1)와 제 2 스위치(SW1, SW2) 사이의 제 1 노드(N1)는 에너지 회수회로(110)와 접속된다.
제 1 스위치(SW1)는 타이밍 콘트롤러로부터 공급되는 제 1 스위칭 제어신호에 따라 서스테인전압원(Vs)과 제 1 노드(N1)를 전기적으로 접속시켜 제 1 노드(N1)에 서스테인전압(Vs)을 공급한다.
제 2 스위치(SW2)는 공급되는 제 2 스위칭 제어신호에 따라 기저전압원(GND)과 제 1 노드(N1)를 전기적으로 접속시켜 제 1 노드(N1)에 기저전압(GND)을 공급한다.
셋업전압 공급부(104)는 타이밍 콘트롤러로부터 공급되는 제어신호에 따라 리셋기간(RP) 중 셋업기간(SU)에 패널(Cp)의 스캔전극들(Y)에 셋업전압(Vsetup)을 공급한다. 이러한, 셋업전압 공급부(104)는 셋업전압원(Vsetup)과 제 2 노드(N2) 사이에 직렬로 접속된 제 4 스위치(SW4) 및 다이오드(D)를 구비한다.
제 4 스위치(SW4)는 셋업전압원(Vsetup)과 제 2 노드(N2) 사이에 접속되고, 그 자신의 게이트단자에는 제 1 가변저항(R1)이 접속된다. 이러한, 제 4 스위치(SW4)는 제 4 스위칭 제어신호가 공급될 때 제 1 가변저항(R1)의 저항값의 변화에 따라 소정의 기울기로 셋업전압(Vsetup)까지 상승하는 전압을 제 2 노드(N2)에 공급한다.
다이오드(D)는 제 4 스위치(SW4)와 제 2 노드(N2) 사이에 접속되어 제 2 노드(N2)로부터의 역전류를 방지한다. 이로 인해, 제 2 노드(N2)에 공급되는 셋업전압(Vsetup)에는 노이즈가 발생하지 않게 된다.
스캔전압 공급부(108)는 셋업전압 공급부(104)와 스캔 바이어스전압 공급부(106) 및 스캔 IC(112) 사이에 접속되어 타이밍 콘트롤러로부터 공급되는 제어신호에 따라 어드레스기간(AP) 동안 패널(Cp)의 스캔전극들(Y)에 부극성(-)의 스캔전압(Vy)을 공급한다. 이를 위해, 스캔전압 공급부(108)는 스캔전압원(-Vy)과, 스캔전압원(-Vy)과 제 3 노드(N3) 사이에 병렬로 접속된 제 6 및 제 7 스위치(SW6, SW7)를 구비한다.
제 6 스위치(SW6)는 스캔전압원(-Vy)과 제 3 노드(N3) 사이에 제 7 스위치(SW7)와 병렬로 접속되고 그 자신의 게이트단자에는 제 2 가변저항(R2)이 접속된 다. 이러한, 제 6 스위치(SW6)는 제 6 스위칭 제어신호가 공급될 때 제 2 가변저항(R2)의 저항값의 변화에 따라 소정의 기울기로 부극성(-)의 스캔전압(Vy)까지 하강하는 전압을 제 3 노드(N3)에 공급한다.
제 7 스위치(SW7)는 스캔전압원(-Vy)과 제 3 노드(N3) 사이에 제 6 스위치(SW6)와 병렬로 접속되어 제 7 스위칭 제어신호에 따라 부극성(-)의 스캔전압(Vy)을 제 3 노드(N3)에 공급한다.
스캔 바이어스전압 공급부(106)는 제 3 노드(N3)와 스캔 IC(112) 사이에 접속되어 타이밍 콘트롤러로부터 공급되는 제어신호에 따라 어드레스기간(AP) 동안 서스테인전극들(Z)에 정극성(+)의 스캔 바이어스전압(Vscb)을 공급한다. 이를 위해, 스캔 바이어스전압 공급부(106)는 스캔 바이어스전압원(Vscb)과 스캔 IC(112) 사이에 접속된 제 9 스위치(SW9)와 제 9 스위치(SW9)와 스캔 IC(112) 사이의 제 4 노드(N4)와 제 3 노드(N3) 사이에 접속된 제 8 스위치(SW8)를 구비한다.
제 8 스위치(SW8)는 제 8 스위칭 제어신호에 따라 제 3 노드(N3)와 제 4 노드(N4)를 전기적으로 접속시키고, 제 9 스위치(SW9)는 제 9 스위칭 제어신호에 따라 스캔 바이어스전압(Vscb)을 제 4 노드(N4)에 공급한다.
스캔 IC(112)는 제 3 노드(N3)와 제 4 노드(N4) 사이에 푸쉬풀 형태로 접속되는 제 10 및 제 11 스위치(SW10, SW11)를 구비한다. 이때, 제 10 및 제 11 스위치소자들(SW10, SW11) 사이의 출력단자는 패널(Cp)의 스캔전극(Y)에 접속된다.
제 10 스위치(SW10)는 제 4 노드(N4)와 패널(Cp)의 스캔전극(Y) 사이에 접속되어 자신의 바디 다이오드를 통해 제 4 노드(N4)에 공급된 전압을 스캔전극(Y)에 공급한다. 다시 말해, 제 10 스위치(SW10)는 제 4 노드(N4)에 부극성(-)의 전압이 공급될 때 그 자신의 내부 다이오드를 통해 스캔전극(Y)을 제 4 노드(N4)에 전기적으로 접속시킨다. 이에 따라, 스캔전극(Y)은 제 4 노드(N4)에 공급된 부극성(-)의 전압만큼 낮은 전압이 공급되게 된다.
제 11 스위치(SW11)는 제 3 노드(N3)와 패널(Cp)의 스캔전극(Y) 사이에 접속되어 자신의 바디 다이오드를 통해 제 3 노드(N3) 상의 전압을 패널(Cp)의 스캔전극(Y)에 공급한다. 이때, 제 3 노드(N3) 상에는 정극성(+)의 전압이 공급된다. 이에 따라, 제 3 노드(N3) 상에 공급된 정극성(+)의 전압은 제 11 스위치(SW11)의 바디 다이오드를 통해 스캔전극(Y)에 공급되게 된다.
제 3 스위치(SW3)는 제 1 노드(N1)와 제 2 노드(N2) 사이에 접속되어 제 3 스위칭 제어신호에 따라 제 1 노드(N1)와 제 2 노드(N2)를 전기적으로 접속시킨다.
제 5 스위치(SW5)는 제 2 노드(N2)와 제 3 노드(N3) 사이에 접속되어 제 5 스위칭 제어신호에 따라 제 2 노드(N2)와 제 3 노드(N3)를 전기적으로 접속시킨다.
서스테인 구동부(120)는 서스테인기간(SP) 동안 서스테인전극(Z)에 서스테인전압레벨(Vs)의 서스테인펄스를 공급한다. 이러한, 서스테인 구동부(120)는 제 2 에너지 회수회로(130)와, 제 12 및 제 13 스위치(SW12, SW13)를 구비한다.
제 2 에너지 회수회로(130)는 PDP에서 방전에 기여하지 않은 무효전력의 에너지를 서스테인전극(Z)으로부터 회수하고 그 회수된 에너지를 이용하여 서스테인전극(Z)을 충전하게 된다.
제 12 스위치(SW12)는 제 12 스위칭 제어신호에 따라 서스테인전극(Z)에 서 스테인전압(Vs)을 공급한다.
제 13 스위치(SW13)는 제 13 스위칭 제어신호에 따라 서스테인전극(Z)에 기저전압(GND)을 공급한다.
이상의 본 발명에 따른 플라즈마 디스플레이 패널의 구동장치에서는 셋업전압 공급부(104)에만 역전류를 방지하기 위한 다이오드(D)가 설치되었으나 역전류 방지용 다이오드는 서스테인전압 공급부(102) 및 스캔 바이어스전압 공급부(106)에도 설치될 수 있다. 이때, 서스테인전압 공급부(102)에 설치되는 역전류 방지용 다이오드는 제 1 스위치(SW1)와 제 1 노드(N1) 사이에 접속되고, 스캔 바이어스전압 공급부(106)에 설치되는 역전류 방지용 다이오드는 제 9 스위치(SW9)와 제 4 노드(N4) 사이에 접속된다.
이와 같이 본 발명의 실시 예에 따른 플라즈마 디스플레이 패널의 구동장치는 정극성(+)의 전압을 공급하는 전압원에 역전류 방지용 다이오드(D)를 설치하여 스캔전극(Y)에 정극성(+)의 전압이 공급될 때 노이즈의 발생을 방지함으로써 플라즈마 디스플레이 패널의 오방전을 방지할 수 있게 된다.
상술한 바와 같이, 본 발명에 따른 플라즈마 디스플레이 패널의 구동장치는 정극성의 전압을 공급하는 전압원에 역전류 방지용 다이오드를 설치하여 스캔전극에 정극성의 전압이 공급될 때 노이즈의 발생을 방지함으로써 플라즈마 디스플레이 패널의 오방전을 방지할 수 있다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (8)

  1. 플라즈마 디스플레이 패널의 스캔전극에 기저전압 및 서스테인전압을 공급하기 위한 서스테인전압 공급부와, 상기 패널과 상기 서스테인전압 공급부 사이에 접속되어 상기 스캔전극에 셋업전압을 공급하기 위한 셋업전압 공급부를 구비하며,
    상기 셋업전압 공급부는,
    셋업전압원과,
    상기 셋업전압원과 상기 서스테인전압 공급부 사이에 직렬로 접속된 제 1 스위치 및 제 1 다이오드와,
    상기 제 1 스위치의 게이트단자에 접속된 제 1 가변저항을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  2. 제 1 항에 있어서,
    상기 패널과 상기 셋업전압 공급부 사이에 접속되어 상기 패널의 스캔전극에 부극성의 스캔전압을 공급하기 위한 스캔전압 공급부와,
    상기 패널과 상기 스캔전압 공급부 사이에 접속되어 상기 패널의 스캔전극에 스캔 바이어스전압을 공급하기 위한 스캔 바이어스전압 공급부와,
    상기 스캔전압 공급부, 스캔 바이어스전압 공급부 및 패널 사이에 푸쉬풀 형태로 접속된 스캔 IC와,
    상기 서스테인전압 공급부와 상기 셋업전압 공급부 사이에 접속된 제 2 스위 치와,
    상기 셋업전압 공급부와 상기 스캔전압 공급부 사이에 접속된 제 3 스위치를 더 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  3. 제 2 항에 있어서,
    상기 스캔전압 공급부는,
    스캔전압원과,
    상기 스캔전압원과 상기 스캔 IC 사이에 접속된 제 4 스위치와,
    상기 제 4 스위치와 상기 스캔 바이어스전압 공급부에 접속된 제 5 스위치와,
    상기 제 5 스위치의 게이트단자에 접속된 제 2 가변저항을 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  4. 제 2 항에 있어서,
    상기 스캔 기준전압 공급부는,
    스캔 기준전압원과,
    상기 스캔 기준전압원과 상기 스캔 IC 사이에 접속된 제 6 스위치와,
    상기 제 6 스위치와 상기 스캔전압 공급부 사이에 접속된 제 7 스위치를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  5. 제 2 항에 있어서,
    상기 스캔 IC는,
    상기 제 6 스위치와 상기 패널의 스캔전극 사이에 접속된 제 8 스위치와,
    상기 제 4 스위치와 상기 패널의 스캔전극 사이에 접속된 제 9 스위치를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  6. 제 5 항에 있어서,
    상기 제 8 스위치는 그 자신의 바디 다이오드를 통해 상기 제 6 스위치와 상기 제 7 스위치 사이의 제 1 노드에 공급되는 부극성의 전압을 상기 패널의 스캔전극에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  7. 제 5 항에 있어서,
    상기 제 9 스위치는 그 자신의 바디 다이오드를 통해 상기 제 4 스위치와 상기 제 7 스위치 사이의 제 2 노드에 공급되는 정극성의 전압을 상기 패널의 스캔전극에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  8. 제 1 항에 있어서,
    상기 서스테인전압 공급부는,
    서스테인전압원과,
    상기 서스테인전압원과 상기 기저전압원 사이에 직렬로 접속된 제 10 스위 치, 제 2 다이오드 및 제 11 스위치를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
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