KR20050122690A - 게이트 구동부와 에미션 구동부를 구비하는 발광 표시장치 - Google Patents

게이트 구동부와 에미션 구동부를 구비하는 발광 표시장치 Download PDF

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Abstract

본 발명은 발광 표시장치에 관한 것으로, 제 1 선택신호에 따라 데이터 신호에 대응하는 신호를 저장하고, 제 2 선택신호에 따라 상기 저장된 신호에 대응하여 발광하는 복수의 화소를 포함하는 화소부; 상기 화소부의 한 측면과 연결되며 상기 화소부에 상기 제 1 선택신호를 전달하는 게이트 구동부; 상기 화소부의 다른 한 측면과 연결되며 상기 화소부에 제 2 선택신호를 전달하는 에미션 구동부를 포함하는 발광 표시장치를 제공한다.
따라서, 게이트 구동부와 에미션 구동부를 구분하여 설치하여 발광 표시장치의 좌우대칭이 이루어지도록 하여 불필요한 공간을 줄여 그 크기가 줄어들게 하며, 각 구동부의 크기를 줄일 수 있다.

Description

게이트 구동부와 에미션 구동부를 구비하는 발광 표시장치{LIGHT EITTING DISPLAY WITH GATE DRIVER AND EISSION DRIVER}
본 발명은 발광 표시장치에 관한 것으로, 더욱 상세히 설명하면, 주사신호 구동부를 게이트 구동부와 에미션 구동부로 구분하여 발광 표시장치의 화소부의 한쪽단에 게이트 구동부를 연결하고 반대편단에 에미션 구동부를 연결하여 화소부에 좌우 대칭이 되게 하여 불필요한 공간을 줄여 크기가 작아지도록 하는 발광 표시장치에 관한 것이다.
근래에 음극선관과 비교하여 무게와 부피가 작은 각종 평판 표시장치들이 개발되고 있으며 특히 발광효율, 휘도 및 시야각이 뛰어나며 응답속도가 빠른 발광 표시장치가 주목받고 있다. 발광 표시장치는 화소에 있는 발광소자의 종류에 따라 무기 발광표시장치와 유기 발광표시장치로 구별된다.
발광소자는 빛을 발산하는 박막인 발광층이 캐소드 전극과 애노드 전극 사이에 위치하는 구조를 갖고 발광층에 전자 및 정공을 주입하여 이들을 재결합시킴으로써 여기자가 생성되며 여기자가 낮은 에너지로 떨어지면서 발광하는 특성을 가지고 있다.
도 1은 종래 기술에 의한 발광 표시장치의 구조를 나타내는 구조도이다. 도 1을 참조하여 설명하면, 종래 기술에 의한 발광 표시장치는 복수의 화소에 의해 화상이 표시되는 화소부(100), 화소부(100)에 데이터 신호를 인가하는 데이터 구동부 (200) 및 화소부(100)의 화소를 선택하여 데이터 신호가 선택된 화소에 인가되도록 하는 주사 구동부(300)를 포함한다.
화소부(100)는 n×m 화소(110)가 배열되고 각 화소(110)에 발광소자(Light Eitting Device:LED)가 연결된다. 그리고, 행방향으로 형성되며 제 1 선택신호를 전달하는 n 개의 제 1 주사선(S1,S2,...Sn-1,Sn)과 열방향으로 형성되며 데이터신호를 전달하는 m 개의 데이터선(D1, D2,....Dm-1, Dm)과 화소전원을 전달하는 전원 공급선(Vdd)이 배열된다. 화소부(100)는 제 1 선택신호, 데이터신호 및 화소전원에 의해 발광소자(LED)가 발광하여 화상을 표시한다.
데이터 구동부(200)는 화소부(100)에 데이터 신호를 인가하는 수단으로, 데이터 구동부(200)가 화소부(100)의 데이터선(D1, D2,....Dm-1, Dm)과 연결되어 데이터 신호가 화소(110)에 인가된다.
주사 구동부(300)는 제 1 선택신호와 제 2 선택신호를 출력하는 수단으로, 주사 구동부(300)는 데이터 구동부(200)에서 입력되는 데이터 신호가 제 1 선택신호에 의해 선택된 화소(110)에 인가되도록 하는 제 1 선택신호를 화소부(100)에 전달하고, 발광소자(LED)를 발광시키는 제 2 선택신호를 화소부(100)에 전달한다.
상기와 같은 구성을 갖는 종래의 발광 표시장치는 화소부(100)의 한쪽에만 주사 구동부(300)가 위치하게 되어 전계발광 표시장치의 화소부(100)가 정 중앙에 오도록 하기 위해 주사 구동부(300)가 연결되어 있는 부분의 반대편 측면에 불필요한 공간이 형성되는 문제점이 발생하였다.
따라서, 본 발명은 상기 종래 기술의 문제점을 해결하기 위하여 창출된 것으로, 본 발명의 목적은 주사 구동부를 게이트 구동부(Gate Driver)와 에미션 구동부 (Eission Driver)로 분리하여 구조를 간단히 하고 그 크기를 작게 함으로써, 각 구동부가 차지하는 공간을 줄이도록 하며, 게이트 구동부와 에미션 구동부가 화소부의 양 측면에 각각 위치하도록 하여 불필요한 공간을 없애고 발광 표시장치가 좌우대칭이 되게 구성하여 고해상도의 화상을 표시하기에 적합한 별도의 게이트 구동부와 에미션 구동부를 구비하는 발광 표시장치를 제공하는 것이다.
상기 목적을 달성하기 위하여 본 발명에 따른 게이트 구동부와 에미션 구동부를 구비하는 발광 표시장치는, 제 1 선택신호에 따라 데이터 신호에 대응하는 신호를 저장하고, 제 2 선택신호에 따라 상기 저장된 신호에 대응하여 발광하는 복수의 화소를 포함하는 화소부; 상기 화소부의 한 측면과 연결되며 상기 화소부에 상기 제 1 선택신호를 전달하는 게이트 구동부; 상기 화소부의 다른 한 측면과 연결되며 상기 화소부에 제 2 선택신호를 전달하는 에미션 구동부를 포함한다.
바람직하게는, 상기 에미션 구동부는, 입력되는 제 1 펄스 신호를 순차적으로 시프트하여 복수의 출력선으로 출력하는 시프트 레지스터를 포함한다.
또한, 바람직하게는, 상기 에미션 구동부는, 입력되는 제 1 펄스 신호를 순차적으로 시프트하여 복수의 제 1 출력선으로 출력하는 제 1 시프트 레지스터; 입력되는 제 2 펄스 신호를 순차적으로 시프트하여 복수의 제 1 출력선으로 출력하는 제 2 시프트 레지스터; 및 상기 제 1 펄스신호와 상기 제 2 펄스신호를 입력받아 OR 연산을 하여 출력하는 제 1 연산수단을 복수 개 구비하는 제 1 연산부를 포함한다.
또한, 바람직하게는, 상기 게이트 구동부는, 입력되는 제 1 펄스 신호를 순차적으로 시프트하여 복수의 출력선으로 출력하는 제 3 시프트 레지스터; 및 상기 제 3 시프트 레지스터의 복수의 출력신호 중 2 개의 출력신호를 입력받아 NAND 연산을 수행하는 제 2 연산부를 복수 개 구비하는 제 2 연산부를 포함한다.
또한, 바람직하게는, 상기 화소는, 전류에 대응하여 빛을 발광하는 발광소자; 상기 제 1 선택신호에 의해 온 상태가 되어 상기 데이터 신호를 전달하는 제 1 스위칭소자; 상기 전달된 데이터 신호에 대응되는 전하를 충전하는 캐패시터; 상기 캐패시터에 충전된 전하에 대응되는 구동전류를 전달하는 제 1 트랜지스터; 및 상기 제 2 선택신호에 의해 온 상태가 되어 상기 구동전류를 상기 발광소자에 전달하는 제 3 스위칭 소자를 포함한다.
또한, 바람직하게는, 상기 제 1 스위칭 소자와 상기 제 2 스위칭 소자는 트랜지스터로 구성된다.
이하, 본 발명의 실시예를 첨부한 도면을 참조하여 설명하면 다음과 같다.
도 2는 본 발명의 실시예에 따른 게이트 구동부와 에미션 구동부를 구비하는 발광 표시장치의 구조를 나타내는 블럭도이다. 도 2를 참조하여 설명하면, 발광 표시장치는 화소부(100), 데이터 구동부(200), 게이트 구동부(305) 및 에미션 구동부(306)를 포함한다.
화소부(100)는 n×m 개의 발광소자, 행방향으로 배열된 n 개의 제 1 주사선 (G1,G2,...Gn-1,Gn)과 행방향으로 배열된 n 개의 제 2 주사선(E1,E2,...En-1,En) 및 열방향으로 배열된 m 개의 데이터선(D1, D2,....Dm-1, Dm)과 m 개의 전원 공급선(미도시)을 포함하며, 제 1 주사선(G1,G2,...Gn-1,Gn)에서 전달되는 제 1 선택신호와 데이터선(D1, D2,....Dm-1, Dm)에서 전달되는 데이터신호에 대응한 구동전류를 전달하고, 제 2 주사선(E1,E2,...En-1,En)에 의해 구동전류를 발광소자(LED)에 전달하여 화상을 표현한다.
데이터 구동부(200)는 데이터선(D1, D2,....Dm-1, Dm)과 연결되어 화소부 (100)에 데이터 신호를 전달하도록 한다.
게이트 구동부(305)는 화소부(100)의 한쪽 측면에 구성되며, 제 1 주사선 (G1,G2, ...Gn-1,Gn)과 연결되어 화소부(100)에 제 1 선택신호를 인가하여 화소부 (100)의 복수의 행을 순차적으로 선택하여 선택된 행에 데이터 신호가 인가되도록 한다.
에미션 구동부(306)는 화소부(100)의 다른 한쪽 측면에 구성되며, 제 2 주사선(E1, E2,...En-1,En)과 연결되어 화소부(100)의 발광소자(LED)에 제 2 선택신호를 전달하여 제 2 선택신호가 인가된 발광소자(LED)가 발광하도록 한다.
따라서, 제 1 선택신호와 제 2 선택신호가 게이트 구동부(305)와 에미션구동부(306)로 분리되어 출력됨으로써, 게이트 구동부(305)와 에미션 구동부(306)의 배선이 간단하게 되어 구조가 간단해지며 그 크기를 작게 구현할 수 있게 된다.
도 3은 도 2의 발광 표시장치에 채용된 화소의 실시예를 나타내는 회로도이다. 도 3을 참조하여 설명하면, 화소는 발광소자(LED) 및 화소 구동회로를 포함한다. 화소 구동회로는 구동트랜지스터(M1), 발광제어트랜지스터(M2), 스위칭 트랜지스터(M3) 및 스토리지 캐패시터(Cst)를 포함한다. 그리고, 구동 트랜지스터(M1), 발광제어 트랜지스터(M2) 및 스위칭 트랜지스터(M3)는 각각 게이트, 소스 및 드레인을 가지며 스토리지 캐패시터(Cst)는 제 1 전극과 제 2 전극을 가진다.
구동 트랜지스터(M1)는 소스가 전원 공급선(Vdd)에 연결되고 드레인이 발광제어 트랜지스터(M2)의 소스에 연결되며 게이트가 제 1 노드(A)와 연결된다. 제 1 노드(A)는 스위칭 트랜지스터(M3)의 드레인과 연결된다. 구동 트랜지스터(M1)는 데이터 신호에 대응되는 전류를 발광소자(LED)에 공급하는 기능을 수행한다.
발광제어 트랜지스터(M2)는 소스가 구동 트랜지스터(M1)의 드레인과 연결되고, 드레인은 발광소자(LED)의 애노드 전극에 연결되고, 게이트가 제 2 주사선 (E[l])에 연결되어 제 2 선택신호에 응답한다. 따라서, 제 2 선택신호에 따라 구동 트랜지스터(M1)에서 발광소자(LED)로 흐르는 전류의 흐름을 제어하여 발광소자 (LED)가 발광을 제어한다.
스위칭 트랜지스터(M3)는 소스가 데이터선(D[k])에 연결되고 드레인이 제 1 노드(A)와 연결되며 게이트는 제 1 주사선(G[l])과 연결된다. 그리고, 게이트에 인가되는 제 1 선택신호에 따라 데이터 신호를 제 1 노드(A)에 전달한다.
여기서 l은 1에서 n 사이의 정수이고, k 는 1에서 m 사이의 정수이다.
스토리지 캐패시터(Cst)는 제 1 전극이 전원공급선(Vdd)에 연결되고 제 2 전극이 제 1 노드(A)에 연결된다. 그리고, 데이터 신호에 따른 전하를 충전하며, 충전된 전하에 의해 한 프레임의 시간 동안 구동 트랜지스터(M1)의 게이트에 신호를 인가하게 되어 구동 트랜지스터(M1)의 동작을 한 프레임의 시간 동안 유지시킨다.
도 4는 도 3에 도시된 화소를 구동하기 위한 구동신호를 나타내는 파형도이다. 도 4 및 도 3을 참조하여 화소의 동작을 설명하면, l 번째 제 1 주사선(Gl)에서 제 1 선택신호(g[l])가 로우(Low)가 되고 제 2 선택신호(e[l])는 하이(high)인 상태인 T1 구간에서는 스위칭 트랜지스터(M3)가 온 상태가 되며, 스위칭 트랜지스터(M3)를 통해 화소(110)에 데이터 신호가 입력된다.
그리고, 데이터 신호에 의해 구동 트랜지스터(M1)가 구동하게 된다. 하지만, 발광제어 트랜지스터(M2)는 오프 상태를 유지하므로, 발광소자(LED)에 전류가 전달되지 않게 된다.
그 후에, l 번째 제 1 주사선(Gl)에서 제 1 선택신호(g[l])가 하이(High)에서 로우(Low)로 전환되고 제 2 선택신호(E[l])는 로우(low)인 상태인 T2 구간에서는 제 2 선택신호(e[l])에 의해 발광제어 트랜지스터(M2)가 온 상태가 되고, 구동트랜지스터(M1)는 게이트에 연결되어 있는 스토리지 캐패시터(Cst)에 의해 온 상태를 유지한다. 따라서, 발광제어 트랜지스터(M2)를 통해 전류가 발광소자(LED)의 애노드로 입력된다. 발광제어 트랜지스터(M2)가 온 상태를 유지하여 발광 소자(LED)에 전류가 흘러가게 하여 발광할 수 있도록 한다.
이때, 발광 제어 트랜지스터(M2)가 PMOS 형인 경우에는 제 2 선택신호 (ep[l])는 한 프레임의 시간 동안 로우 신호를 유지하며, 발광 제어 트랜지스터(M2)가 로우 신호를 유지하는 한 프레임 시간 동안 스토리지 캐패시터(Cst)에 의해 구동 트랜지스터(M1)의 게이트 전극에 신호가 인가되어 발광소자(LED)가 한 프레임 동안 발광하게 된다.
그리고, 발광 제어 트랜지스터(M2)를 NMOS 타입으로 구현할 수 있으며, NMOS 타입인 경우에는 제 2 선택신호는 한 프레임의 시간 동안 하이 신호를 유지 하며, 발광 제어 트랜지스터(M2)가 하이 신호를 유지하는 시간 동안 스토리지 캐패시터(Cst)에 의해 구동 트랜지스터(M1)의 게이트 전극에 신호가 인가되어 발광 소자(LED)가 한 프레임 동안 발광하게 된다.
또한, 스위칭 트랜지스터(MS) 역시 NMOS 형으로 구현하게 되면 제 1 선택신호가 하이 신호일 때 스위칭 트랜지스터(MS)가 온상태가 되도록 할 수 있다.
도 5는 도 2의 발광 표시장치의 게이트 구동부와 에미션 구동부의 제 1 실시예를 나타내는 블럭도이다. 도 5에는, 화소(110)를 중심으로 좌우에 게이트 구동부(305)와 에미션 구동부(306)가 표현되어 있다.
도 5를 참조하여 설명하면, 게이트 구동부(305)는 제 1 선택신호(g[0], g[1],g[2],g[3])를 순차적으로 출력하는 수단으로, 플리플롭이 종으로 연결되어 구성되며, 상위의 플리플롭(10)에서 나온 출력신호가 하위의 플리플롭(11)에 입력되고 하위의 플리플롭(11)에서 출력된 신호는 상위의 플리플롭(10)에서 출력된 신호를 시프트하여 출력한다.
좀 더 상세히 설명하면, 게이트 구동부(305)의 가장 상위에 있는 플리플롭에서 가장 하위에 있는 플리플롭을 제 1 플리플롭(10), 제 2 플리플롭(11), 제 3 플리플롭(12), 제 4 플리플롭(13)이라고 한다.
제 1 플리플롭(10)은 제 1 스타트 펄스(SP1) 신호를 입력받아 제 1 출력신호(sr0)를 출력하고, 제 1 출력신호(sr0)는 제 2 플리플롭(11)에 입력되어 제 2 플리 프롭(11)은 제 2 출력신호(sr1)을 출력한다. 제 1 출력신호(sr0)와 제 2 출력신호(sr1)는 제 1 NAND 게이트(20)에 입력되고 두 개의 NOT 게이트가 직렬로 연결되어 있는 제 1 버퍼(30)를 통과하여 제 1 선택 신호(g[0])로 출력되어 제 1 화소(111)에 입력된다.
그리고, 제 2 플리플롭(11)에서 출력된 제 2 출력신호(sr1)은 제 3 플리플롭(12)에 입력되어 제 3 플리플롭(12)에서 제 3 출력신호(sr2)를 출력하게 한다. 또한, 제 2 출력신호(sr1)과 제 3 출력신호(sr2)는 제 2 NAND 게이트(21)에 입력되고 두 개의 NOT 게이트가 직렬로 연결되어 있는 제 2 버퍼(31)를 통과 하여 제 1 선택 신호(g[1])로 출력되어 제 2 화소(112)에 입력된다.
또한, 제 3 플리플롭(12)에서 출력된 제 3 출력신호(sr2)는 제 4 플리플롭 (13)에 입력되어 제 4 플리플롭(13)에서 제 4 출력신호(sr3)를 출력하게 한다. 그리고, 제 3 출력신호(sr2)와 제 4 출력신호(sr3)는 제 3 NAND 게이트(22)에 입력되고 두 개의 NOT 게이트가 직렬로 연결되어 있는 제 3 버퍼(32)를 통과하여 제 1 선택신호(g[2])로 출력되어 제 3 화소(113)에 입력된다.
그리고, 제 4 출력신호(sr3)는 하위의 플리플롭(미도시)에 입력되고 하위의 플리플롭(미도시)에서 출력되는 제 5 출력신호(sr4)가 제 4 NAND 게이트(23)에 입력되고 두 개의 NOT 게이트가 직렬로 연결되어 있는 제 4 버퍼(33)를 통과하여 제 1 선택 신호(g[3])로 출력되어 제 4 화소(114)에 입력된다.
에미션 구동부(306)는 제 2 선택신호(e[0], e[1], e[2], e[3])를 순차적으로 출력하는 수단으로, 복수의 플리플롭이 종으로 배열되어 구성되며 상위의 플리플롭(40)에서 나온 출력신호가 하위의 플리플롭(41)에 입력되고 하위의 플리플롭 (41)은 상위의 플리플롭(40)에서 출력된 신호를 시프트하여 출력한다.
좀더 상세히 설명하면, 에미션 구동부(306)의 가장 상위에 있는 플리플롭에서 가장 하위에 있는 플리플롭을 제 5 플리플롭(20), 제 6 플리플롭(21), 제 7 플리플롭(22) 및 제 8 플리플롭(23)이라고 한다.
제 5 플리플롭(20)은 제 2 스타트 펄스(SP2) 신호를 입력받아 제 5 출력신호 (elsr0)를 출력하고, 제 5 출력신호(elsr0)는 제 6 플리플롭(21)에 입력되어 제 6 플리프롭(21)은 제 6 출력신호(elsr1)을 출력한다. 제 5 출력신호(elsr0)는 두 개의 인버터가 직렬로 연결되어 있는 제 5 버퍼(50)를 통과하여 제 2 선택신호(e[0])로 출력되어 제 1 화소(111)에 입력된다.
그리고, 제 6 플리플롭(21)에서 출력된 제 6 출력신호(elsr1)은 제 7 플리플롭(22)에 입력되어 제 7 플리플롭(22)에서 제 7 출력신호(elsr2)를 출력하게 한다. 또한, 제 6 출력신호(elsr1)는 두 개의 인버터가 직렬로 연결되어 있는 제 6 버퍼(51)를 통과하여 제 2 선택 신호(e[1])로 출력되어 제 2 화소(112)에 입력된다.
또한, 제 7 플리플롭(22)에서 출력된 제 7 출력신호(elsr2)는 제 8 플리플롭 (23)에 입력되어 제 8 플리플롭(23)에서 제 8 출력신호(elsr3)를 출력하게 한다. 그리고, 제 7 출력신호(elsr2)는 두 개의 NOT 게이트가 직렬로 연결되어 있는 제 7 버퍼(52)를 통과하여 제 3 에미션 신호(e[2])로 출력되어 제 3 화소(113)에 입력된다.
그리고, 제 8 출력신호(elsr3)는 두 개의 NOT 게이트가 직렬로 연결되어 있는 제 8 버퍼(53)를 통과하여 제 4 에미션 신호(e[3])로 출력되어 제 4 화소(114)에 입력된다.
도 6은 도 5의 게이트 구동부의 동작을 나타내는 파형도이다. 도 6을 참조하여 설명하면, 먼저 제 1 플리플롭(10)에 제 1 스타트 펄스(SP1) 신호가 입력되어 동작하게 되면, 제 1 플리플롭(10)은 제 1 스타트 펄스(SP1)가 시프트된 제 1 출력신호(sr0)를 출력한다. 제 2 플리플롭(11)은 제 1 출력신호(sr0)를 입력받아 제 1 출력신호(sr0)가 시프트된 제 2 출력신호(sr1)를 출력하고, 제 2 출력신호(sr1)는 제 3 플리플롭(12)에 입력되어 제 2 출력신호(sr1)가 시프트된 제 3 출력신호(sr2)를 출력한다. 또한, 제 3 출력신호(sr2)는 제 4 플리플롭(13)에 입력되어 제 3 출력신호(sr2)가 시프트된 제 4 출력신호(sr3)를 출력한다.
그리고, 제 1 출력신호(sr0)와 제 2 출력신호(sr1)는 NAND 연산이 수행되어 제 1 선택 신호(g[0])를 출력하고, 제 2 출력신호(sr1)와 제 3 출력신호(sr2)가 NAND 연산이 수행되어 제 1 선택 신호(g[1])를 출력하고, 제 3 출력신호(sr2)와 제 4 출력신호(sr3)가 NAND 연산이 수행되어 제 1 선택 신호(g[2])를 출력한다. 또한, 제 4 출력신호(sr3)와 제 5 출력신호(sr4)가 NAND 연산이 수행되어 제 1 선택 신호(g[3])를 출력한다.
도 7은 도 5의 에미션 구동부의 동작을 나타내는 파형도이다. 도 7을 참조하여 설명하면, 먼저 제 5 플리플롭(20)에 제 2 스타트 펄스(SP2) 신호가 입력되어 동작하게 되면, 제 5 플리플롭(20)은 제 2 스타트 펄스(SP2)가 시프트된 제 5 출력 신호(elsr0)를 출력한다. 제 5 출력신호(elsr1)는 제 2 선택 신호(e[0])가 된다.
그리고, 제 6 플리플롭(21)은 제 5 출력 신호(elsr0)를 입력받아 제 5 출력신호(elsr0)가 시프트된 제 6 출력신호(elsr1)를 출력하며, 제 6 출력신호(elsr1)는 제 2 선택 신호(e[1])가 된다.
또한, 제 6 출력신호(elsr1)는 제 7 플리플롭(22)에 입력되어 제 6 출력신호 (elsr1)가 시프트된 제 7 출력신호(elsr2)를 출력하며, 제 7 출력신호(elsr2)는 제 2 선택 신호(e[2])가 된다.
또한, 제 7 출력신호(elsr2)는 제 8 플리플롭(43)에 입력되어 제 7 출력신호 (elsr2)가 시프트된 제 8 출력신호(elsr3)를 출력한다. 제 8 출력신호(elsr3)는 제 2 선택 신호(e[3])가 된다.
도 8은 도 2의 발광 표시장치의 게이트 구동부와 에미션 구동부의 제 2 실시예를 나타내는 도이다. 도 8을 참조하여 설명하면,
게이트 구동부(305)는 제 1 선택신호(g[1],g[2],g[3],g[4])를 순차적으로 출력하는 수단으로, 플리플롭이 종으로 연결되어 구성되며, 상위의 플리플롭(10)에서 나온 출력신호가 하위의 플리플롭(11)에 입력되고 하위의 플리플롭(11)에서 출력된 신호는 상위의 플리플롭(10)에서 출력된 신호가 시프트된다.
화소(110)에 연결되어 있는 게이트 구동부(305)의 가장 상위에 있는 플리플롭에서 가장 하위에 있는 플리플롭을 제 1 플리플롭(10), 제 2 플리플롭(11), 제 3 플리플롭(12), 제 4 플리플롭(13), 제 5 플리플롭(14)라고 한다.
제 1 플리플롭 (10)의 출력신호는 제 2 플리플롭(11)에 입력되며, 제 2 플리플롭(11)의 출력신호는 제 3 플리플롭(12)에 입력된다. 또한, 제 3 플리플롭(12)의 출력신호는 제 4 플리플롭(13)의 입력되며, 제 4 플리플롭(13)의 출력신호는 제 5 플리플롭(14)에 입력되며, 제 1 플리플롭(10), 제 2 플리플롭(11), 제 3 플리플롭(12), 제 4 플리플롭(13) 및 제 5 플리플롭(14)의 출력신호는 입력신호가 시프트되어 출력된다.
제 1 플리플롭(10)에서 출력된 신호(sr0)가 Vss와 ENB의 신호와 함께 복수의 NAND 게이트들 중 가장 상위에 있는 제 1 NAND 게이트(40)에 입력되며, 제 1 NAND 게이트(40)에서 출력된 신호가 두 개의 NOT 게이트가 직렬로 연결되어 형성되는 복수의 버퍼들 중 가장 상위의 제 1 버퍼(50)를 통과하여 더미에 연결된다.
그리고, 제 2 플리플롭(11), 제 3 플리플롭(12), 제 4 플리플롭(13), 제 5 플리플롭(14) 각각 제 1 플리플롭(10)과 동일하게 제 2 내지 제 5 NAND 게이트들 (41 내지 44) 중 하나의 NAND 게이트에 연결되고 제 2 내지 제 5 버퍼들(51 내지 54) 중 하나의 버퍼를 통과하여 화소(110)에 입력된다.
이때, 제 2 플리플롭(11), 제 3 플리플롭(12), 제 4 플리플롭(13), 제 5 플리플롭(14)와 연결되어 있는 제 2 내지 제 5 버퍼들(41 내지 44)을 통과하여 출력된 신호들은 제 1 선택신호(g[1],g[2],g[3],g[4])로 사용된다.
에미션 구동부(306)는 제 2 선택신호(e[1], e[2], e[3], e[4])를 순차적으로 출력하는 수단으로, 복수의 플리플롭이 두 개의 열로 배열되어 구성된다.
에미션 구동부(306)의 왼쪽열의 가장 상위에 있는 플리플롭에서 가장 하위에 있는 플리플롭을 제 6 플리플롭(20), 제 7 플리플롭(21), 제 8 플리플롭(22), 제 9 플리플롭(23), 제 10 플리플롭(24)이라 하고, 오른쪽열의 가장 상위에 있는 플리플롭에서 가장 하위에 있는 플리플롭을 제 11 플리플롭(30), 제 12 플리플롭(31), 제 13 플리플롭(32), 제 14 플리플롭(33), 제 15 플리플롭(34)이라 한다. 에미션 구동부(306) 역시 게이트 구동부(305)와 마찬가지로 플리플롭의 출력신호는 입력신호가 시프트된 형태로 나타난다.
그리고, 제 6 플리플롭(20)과 제 11 플리플롭(30)에서 출력된 신호가 복수의 NOR 게이트들 중 가장 상위의 제 1 NOR 게이트(70)로 입력되며 제 1 NOR 게이트(70)에서 출력된 신호가 복수의 인버터들 중 가장 상위의 인버터(80)를 거쳐 더미에 연결된다.
또한, 제 7 프리프롭(21)과 제 12 플리플롭(31), 제 8 플리플롭(22)과 제 13 플리플롭(32), 제 9 플리플롭(23)과 제 14 플리플롭(33), 제 10 플리플롭(24)과 제 15 플리플롭(35)에서 출력되는 신호는 제 2 내지 제 5 NOR 게이트들(71 내지 74) 중 하나의 NOR 게이트를 통과하여 제 2 내지 제 5 인버터들(81 내지 84) 중 하나의 인버터를 통과한다.
제 2 내지 제 5 인버터들(81 내지 84)을 통과한 각 신호들은 화소(110)에 입력되어 제 2 선택신호(e1,e2,e3,e4)로 사용된다.
도 9를 참조하여 게이트 구동부(305)의 동작을 상세히 설명하면, 먼저 제 1 플리플롭(10)에 스타트 펄스(SP) 신호가 입력되어 동작하게 되면, 제 1 플리플롭 (10)에서 출력되는 신호와 Vss, ENB 신호가 NAND 게이트에 입력되어 g[0] 신호가 출력되며 g[0] 신호는 더미(Dummy)에 연결된다.
제 1 플리플롭(10)에서 출력되는 신호(sr0)는 제 2 플리플롭(20)에 입력되며, 제 2 플리플롭(11)의 출력신호(sr1)는 제 1 플리플롭(10)에서 출력되는 신호 (sr0)보다 시프트되어 출력된다.
그리고, 제 1 플리플롭(10)의 출력신호, 제 2 플리플롭(11)의 출력 및 ENB 신호가 제 1 NAND 게이트(40)에 입력되어 제 1 NAND 게이트(40)의 연산에 따라 출력되며, 두 개의 NOT 게이트(50)을 거쳐 제 1 선택신호(g[1])가 출력된다.
그리고, 제 2 플리플롭(11)에서 출력되는 신호(sr1)는 제 3 플리플롭(12)에 입력되어 제 3 플리플롭(12)이 동작하게 되고, 제 2 플리플롭(11)의 출력신호 (sr1), 제 3 플리플롭(12)의 출력(sr2) 및 ENB 신호가 제 2 NAND 게이트(41)에 입력되고 두 개의 NOT 게이트(51)을 거쳐 제 1 선택신호(g[2])가 출력된다.
마찬가지로, 제 4 플리플롭(13), 제 5 플리플롭(14)이 동작하여 차례로 제 1 선택신호(g[3], g[4])가 출력된다.
도 10을 참조하여 에미션 구동부(306)의 동작을 설명하면, 먼저 제 6 플리플롭(20)에 LSP 신호가 입력되고 제 11 플리플롭(30)에 SP 신호가 입력되면, 제 6 플리플롭(20)에서 출력되는 신호(elsr0)와 제 11 플리플롭(30)에서 출력되는 신호 (elsr0)는 LSP 신호와 SP 신호 보다 시프트되어 출력된다.
그리고, 제 6 플리플롭(20)에서 출력되는 신호(elsr0)와 제 11 플리플롭(30)에서 출력되는 신호(elsr0)는 제 1 NOR 게이트(70)에 입력되어 연산을 수행한 뒤에 제 1 NOT 게이트(80)에 입력되고 제 1 NOT 게이트(80)는 더미에 연결된다.
제 6 플리플롭(20)에서 출력되는 신호(elsr0)와 제 11 플리플롭(30)에서 출력되는 신호(elsr0)는 제 7 플리플롭(21)과 제 12 플리플롭(31)에 입력된다.
그리고, 제 7 플리플롭(21)에서 출력되는 신호(elsr1)와 제 12 플리플롭 (31)에서 출력되는 신호(elsr1)가 제 2 NOR 게이트(71)에 입력되며 제 2 NOR 게이트(71)에서 출력된 신호는 제 2 NOT 게이트(81)에 입력되고 출력되어 제 2 선택신호(e[1])신호를 출력한다.
그리고, 제 7 플리플롭(21)에서 출력되는 신호(elsr1)는 제 8 플리플롭(22)에 입력되어 제 8 플리플롭(22)이 동작하게 되고, 제 12 플리플롭(31)에서 출력되는 신호(elsr1)는 제 13 플리플롭(32)에 입력되어 제 13 플리플롭(32)이 동작하게 된다.
그리고, 제 8 플리플롭(22)에서 출력되는 신호(elsr1)와 제 13 플리플롭(32)에서 출력되는 신호(elsr2)가 제 3 NOR 게이트(72)에 입력되며 제 3 NOR 게이트 (72)에서 출력된 신호는 제 3 NOT 게이트(82)에 입력되고 출력되어 제 2 선택신호(e[2])를 출력한다.
마찬가지로, 제 9 플리플롭(23), 제 10 플리플롭(24), 제 14 플리플롭(33), 제 15 플리플롭(34)이 동작하여 차례로 제 2 선택신호(e[3], e[4]) 신호가 출력된다.
본 발명의 바람직한 실시예가 특정 용어들을 사용하여 기술되어 왔지만, 그러한 기술은 단지 설명을 하기 위한 것이며, 다음의 청구범위의 기술적 사상 및 범위로부터 이탈되지 않고 여러 가지 변경 및 변화가 가해질 수 있는 것으로 이해되어져야 한다.
특히, 본 발명은 상기 도 3에 도시된 화소에 한정되는 것이 아니라 하나의 화소에 화소를 선택하는 제 1 선택신호와 발광소자(LED)를 제어하는 제 2 선택신호가 입력되는 화소에 적용할 수 있다.
본 발명에 따른 게이트 구동부와 에미션 구동부를 구비하는 발광 표시장치는 주사 구동부를 제 1 선택신호로 출력하는 게이트 구동부와 제 2 선택신호를 출력하는 에미션 구동부로 분리하여 각각의 구동부는 하나의 구동부에서 제 1 선택신호와 제 2 선택신호를 출력하는 것보다 회로가 간단하게 구성되어 그 크기를 줄일 수 있게 된다.
그리고, 간단하게 구성된 게이트 구동부와 에미션 구동부를 화소부의 좌우측면에 설치하여 발광 표시장치의 좌우대칭이 이루어지도록 하여 불필요한 공간을 사용하게 되어 발광 표시장치의 크기를 줄일 수 있게 한다.
도 1은 종래 기술에 의한 발광 표시장치의 구조를 나타내는 구조도이다.
도 2는 본 발명의 실시예에 따른 게이트 구동부와 에미션 구동부를 구비하는 발광 표시장치의 구조를 나타내는 블럭도이다.
도 3은 도 2의 발광 표시장치에 채용된 화소의 실시예를 나타내는 회로도이다.
도 4는 도 3에 도시된 화소를 구동하기 위한 구동신호를 나타내는 파형도이다.
도 5는 도 2의 발광 표시장치의 게이트 구동부와 에미션 구동부의 제 1 실시예를 나타내는 블럭도이다.
도 6은 도 5의 게이트 구동부의 동작을 나타내는 파형도이다.
도 7은 도 5의 에미션 구동부의 동작을 나타내는 파형도이다.
도 8은 도 2의 발광 표시장치의 게이트 구동부와 에미션 구동부의 제 2 실시예를 나타내는 도이다.
도 9는 도 8의 게이트 구동부의 동작을 나타내는 파형도이다.
도 10은 도 8의 에미션 구동부의 동작을 나타내는 파형도이다.
***도면의 부호설명***
100: 화소부 110: 화소
200: 데이터 구동부 305: 게이트 구동부
306: 에미션 구동부 M1: 구동 트랜지스터
M2: 발광제어 트랜지스터 M3: 스위칭 트랜지스터
g: 게이트 신호 e: 제 2 선택신호
LED: 발광 소자

Claims (7)

  1. 제 1 선택신호에 따라 데이터 신호에 대응하는 신호를 저장하고, 제 2 선택신호에 따라 상기 저장된 신호에 대응하여 발광하는 복수의 화소를 포함하는 화소부;
    상기 화소부의 한 측면과 연결되며 상기 화소부에 상기 제 1 선택신호를 전달하는 게이트 구동부; 및
    상기 화소부의 다른 한 측면과 연결되며 상기 화소부에 제 2 선택신호를 전달하는 에미션 구동부를 포함하는 발광 표시장치.
  2. 제 1 항에 있어서,
    상기 화소부에 연결되어 상기 화소부에 데이터 신호를 전달하는 데이터 구동부를 포함하는 발광 표시장치.
  3. 제 1 항에 있어서,
    상기 에미션 구동부는,
    입력되는 제 1 펄스 신호를 순차적으로 시프트하여 복수의 출력선으로 출력하는 시프트 레지스터를 포함하는 발광 표시장치.
  4. 제 1 항에 있어서,
    상기 에미션 구동부는,
    입력되는 제 1 펄스 신호를 순차적으로 시프트하여 복수의 제 1 출력선으로 출력하는 제 1 시프트 레지스터;
    입력되는 제 2 펄스 신호를 순차적으로 시프트하여 복수의 제 1 출력선으로 출력하는 제 2 시프트 레지스터; 및
    상기 제 1 펄스신호와 상기 제 2 펄스신호를 입력받아 OR 연산을 하여 출력하는 제 1 연산수단을 복수 개 구비하는 제 1 연산부를 포함하는 발광 표시 장치.
  5. 제 1 항에 있어서,
    상기 게이트 구동부는,
    입력되는 제 1 펄스 신호를 순차적으로 시프트하여 복수의 출력선으로 출력하는 제 3 시프트 레지스터; 및
    상기 제 3 시프트 레지스터의 복수의 출력신호 중 2 개의 출력신호를 입력받아 NAND 연산을 수행하는 제 2 연산수단을 복수 개 구비하는 제 2 연산부를 포함하는 발광 표시장치.
  6. 제 1 항에 있어서,
    상기 화소는,
    전류에 대응하여 빛을 발광하는 발광소자;
    상기 제 1 선택신호에 의해 온 상태가 되어 상기 데이터 신호를 전달하는 제 1 스위칭소자;
    상기 전달된 데이터 신호에 대응되는 전하를 충전하는 캐패시터;
    상기 캐패시터에 충전된 전하에 대응되는 구동전류를 전달하는 제 1 트랜지스터; 및
    상기 제 2 선택신호에 의해 온 상태가 되어 상기 구동전류를 상기 발광소자에 전달하는 제 3 스위칭 소자를 포함하는 발광 표시장치.
  7. 제 6 항에 있어서,
    상기 제 1 스위칭 소자와 상기 제 2 스위칭 소자는 트랜지스터로 구성되는 발광 표시장치.
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