KR20050114060A - 플라즈마 디스플레이 패널의 구동 장치 및 그 구동 방법 - Google Patents

플라즈마 디스플레이 패널의 구동 장치 및 그 구동 방법 Download PDF

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Abstract

본 발명은 플라즈마 디스플레이 패널(plasma display panel; PDP)의 구동 장치 및 그 구동 방법에 관한 것이다. 본 발명의 플라즈마 디스플레이 구동 방법은, 리셋 기간 중 램프 하강 기간을 하강 속도가 빠른 제1 램프 하강 기간과 하강 속도가 느린 제2 램프 하강 기간으로 나누어 램프 하강 기간을 줄인다. 이 때, 제1 램프 하강 기간은 LC 공진을 이용하여 하강 속도를 빠르게 한다. 이와 같이 리셋 기간을 단축시켜서 남는 시간을 유지 방전 구간에 활용하면 휘도를 높일 수 있다.

Description

플라즈마 디스플레이 패널의 구동 장치 및 그 구동 방법{DRIVING APPARATUS AND METHOD OF PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널(plasma display panel; PDP)의 구동 장치 및 그 구동 방법에 관한 것으로, 특히 리셋 시간을 줄이는 플라즈마 디스플레이 패널의 구동 장치 및 그 구동 방법에 관한 것이다.
최근 액정 표시 장치(liquid crystal display; LCD), 전계 방출 표시 장치(field emission display; FED), PDP 등의 평면 표시 장치가 활발히 개발되고 있다. 이들 평면 표시 장치 중에서 PDP는 다른 평면 표시 장치에 비해 휘도 및 발광 효율이 높으며 시야각이 높다는 장점이 있다. 따라서, PDP가 40인치 이상의 대형 표시 장치에서 종래의 CRT(cathode ray tube)를 대체할 표시 장치로서 각광받고 있다.
PDP는 기체 방전에 의해 생성된 플라즈마를 이용하여 문자 또는 영상을 표시하는 평면 표시 장치로서, 그 크기에 따라 수십에서 수백만개 이상의 픽셀(pixel)이 매트릭스(matrix) 형태로 배열되어 있다. 이러한 PDP는 인가되는 구동 전압 파형의 형태와 방전 셀의 구조에 따라 직류형(DC형)과 교류형(AC형)으로 구분된다.
직류형 PDP는 전극이 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전 공간에 그대로 노출되어 있어서 전압이 인가되는 동안 전류가 방전 공간에 그대로 흐르게 되며, 이를 위해 전류제한을 위한 저항을 만들어 주어야 하는 단점이 있다. 반면 교류형 PDP에서는 전극을 유전체층이 덮고있어 자연스러운 캐패시턴스 성분의 형성으로 전류가 제한되며 방전시 이온의 충격으로부터 전극이 보호되므로 직류형에 비해 수명이 길다는 장점이 있다.
도 1은 AC형 플라즈마 디스플레이 패널의 일부 사시도이다.
도 1에 도시한 바와 같이, 제1 유리기판(1) 위에는 유전체층(2) 및 보호막(3)으로 덮인 주사전극(4)과 유지전극(5)이 쌍을 이루어 평행하게 설치된다. 제2 유리기판(6) 위에는 절연체층(7)으로 덮인 복수의 어드레스전극(8)이 설치된다. 어드레스전극(8)들 사이에 있는 절연체층(7) 위에는 어드레스 전극(8)과 평행하게 격벽(9)이 형성되어 있다. 제1 유리기판(1)과 제2 유리기판(6)은 주사전극(4)과 어드레스전극(8) 및 유지전극(5)과 어드레스전극(8)이 직교하도록 방전공간(11)을 사이에 두고 대향하여 배치되어 있다. 어드레스전극(8)과, 쌍을 이루는 주사전극(4)과 유지전극(5)과의 교차부에 있는 방전공간(11)이 방전셀(12)을 형성한다.
도 2는 플라즈마 디스플레이 패널의 전극 배열도를 나타낸다.
도 2에 나타낸 바와 같이, 플라즈마 디스플레이 패널의 전극은 m × n의 매트릭스 형태로 배열되며, 구체적으로 열 방향으로는 어드레스 전극(A1-Am)이 배열되어 있고 행 방향으로는 n행의 주사 전극(Y1-Yn) 및 유지 전극(X1-Xn)이 지그재그로 배열되어 있다. 이하에서는 주사전극을 "Y 전극", 유지전극을 "X 전극"이라 칭한다. 도 2에 도시된 방전셀(12)은 도 1에 도시된 방전셀(12)에 대응한다.
일반적으로 AC형 플라즈마 디스플레이 패널의 구동 방법은 시간적인 동작 변화로 표현하면 리셋 기간, 어드레싱 기간 및 유지방전 기간으로 이루어진다.
도 3은 종래기술에 따른 X, Y 전극의 파형을 나타낸 도이다.
도 3에 나타낸 바와 같이, 각 서브필드는 리셋 기간, 어드레스 기간 및 유지기간으로 이루어진다. 리셋 기간의 상승기간에서는 주사 전극(Y1-Yn)에 Vset 전압까지 완만하게 상승하는 전압을 인가하여 모든 셀에 미약한 방전을 발생시킨다. 다음으로 리셋 기간의 하강기간에서는 유지 전극(X1-Xn)을 일정한 전압(Ve)으로 바이어스 시킨 상태에서 음의 레벨인 Vnf 전압까지 완만하게 하강하는 전압을 인가하여 벽전하를 소거시킨다. 이를 통해 각 셀의 벽전하 상태를 초기화시킨다. 어드레스 기간에서는 주사 전극(Y1-Yn)을 일정한 전압(Vsch)을 바이어스 시킨 상태에서 각 주사 전극의 라인에 순차적으로 펄스 전압(Vscl)을 인가한다. 이때, 어드레스 전극(A1-An)에 선택하고자 하는 방전셀을 선택하기 위해 어드레스 전압(Va)을 인가한다. 유지방전 기간에서는 유지 방전 전압(Vs)을 주사 전극(Y1-Yn)과 유지 전극(X1-Xn)에 교대로 인가함으로써 어드레스싱된 셀에 실제로 화상을 표시하기 위한 방전을 발생시킨다.
즉, 리셋 기간에는 모든 셀의 초기화가 이루어지고, 어드레스 기간에는 유지방전 기간에 방전시킬 셀을 선택하고, 유지방전 기간에는 상기 선택된 셀의 유지방전으로 발광이 일어나게 된다. 따라서, 발광이 일어나지 않는 리셋 기간은 짧고, 발광이 일어나는 유지방전 기간이 길어야 밝은 화상을 표시할 수 있다. 또한, 상기 리셋 기간에는 잘못된 방전으로 인한 발광이 일어나지 않아야 깨끗한 화상을 표시할 수 있다.
본 발명이 이루고자 하는 기술적 과제는 잘못된 발광 없이 리셋 기간의 시간을 줄이고, 남는 시간을 유지방전 기간에 할당하여 휘도를 높일 수 있는 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법을 제공하기 위한 것이다.
이러한 기술적 과제를 달성하기 위한, 본 발명의 특징에 따른 플라즈마 디스플레이 패널의 구동장치는, 제1 전극 및 제2 전극과, 상기 제1 전극과 상기 제2 전극 사이에 형성되는 패널 커패시터에 전압을 인가하는 플라즈마 디스플레이 패널의 구동 장치로서,
상기 패널 커패시터의 제1 전극에 제1 단자가 전기적으로 연결되는 인덕터; 상기 인덕터의 제2 단자와 제1 전압을 공급하는 제1 전원 사이에 전기적으로 연결되는 제1 스위치(S2); 상기 인덕터의 제1 단자와 제2 전압(Vs)을 공급하는 제2 전원 사이에 전기적으로 연결되는 제2 스위치(S3)를 포함하며,
리셋 기간에서, 상기 제2 스위치를 턴온하여 상기 제2 전압을 상기 제1 전극에 공급한 후, 상기 제2 스위치를 턴오프하고 상기 제1 스위치를 턴온하여 상기 제1 전극을 제3 전압까지 하강시킨다.
상기 패널 커패시터의 제1 전극과 제4 전압(Vnf)을 공급하는 제3 전원 사이에 전기적으로 연결되어 전압을 점진적으로 하강시키는 제3 스위치를 더 포함하며,
상기 제1 스위치를 턴오프하고 상기 제3 스위치를 턴온하여 상기 제1 전극을 상기 제3 전압에서 제4 전압으로 점진적으로 하강시킨다.
본 발명의 다른 특징에 따른 플라즈마 디스플레이 패널의 구동 방법은,
리셋 기간에서, 제1 전극에 제1 전압에서 제2 전압까지 하강하는 전압을 인가하는 단계; 상기 제1 전극에 제2 전압에서 제3 전압까지 완만하게 하강하는 전압을 인가하는 단계를 포함하며,
상기 단계(a)에서 상기 제1 전압에서 제2 전압까지의 하강하는 전압을 LC 공진에 의해 인가한다.
아래에서는 첨부한 도면을 참고로 하여 본 발명의 실시예에 대하여 본 발명이 속하는 기술 분야에서 통상의 지식을 가진 자가 용이하게 실시할 수 있도록 상세히 설명한다. 그러나 본 발명은 여러 가지 상이한 형태로 구현될 수 있으며 여기에서 설명하는 실시예에 한정되지 않는다.
도면에서 본 발명을 명확하게 설명하기 위해서 설명과 관계없는 부분은 생략하였다. 명세서 전체를 통하여 유사한 부분에 대해서는 동일한 도면 부호를 붙였다.
이제 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동 장치 및 구동 방법에 대하여 도면을 참고로 하여 상세하게 설명한다.
도 3에 도시된 리셋 기간을 살펴보면, 램프 상승이나 램프 하강 기간이 차지하는 시간이 길다. 하지만, 램프 상승이나 램프 하강의 전기간에서 미약한 방전이 일어나는 것이 아니라 초기 상승이나 초기 하강의 일부 범위에서는 방전이 거의 일어나지 않는다.
본 발명은 이러한 점에 착안한 것으로, 초기 램프 하강에서 하강의 기울기를 일부 기간동안 빠르게 하여 리셋 기간의 시간을 줄이는 방법을 제공한다.
도 4는 본 발명의 실시예에 따른 구동 파형은 리셋 기간, 어드레스 기간 및 유지방전 기간으로 이루어진다. 그리고, 플라즈마 디스플레이 패널에는 각 기간에서 Y 전극(Y1-Yn) 및 X 전극(X1-Xn)에 구동 전압을 인가하는 주사/유지 구동 회로(도시하지 않음)와 어드레스 전극(A1-Am)에 구동 전압을 인가하는 어드레스 구동 회로(도시하지 않음)가 연결된다. 이러한 구동 회로와 플라즈마 디스플레이 패널이 연결되어 하나의 플라즈마 표시 장치를 이룬다.
도 4에 나타낸 바와 같이, 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도는 도 3과 같은 종래의 구동 파형도와 유사하나 램프 하강 기간이 서로 다른 기울기의 제1 램프 하강 기간(M3)과 제2 램프 하강 기간(M4)으로 나뉘어져 있다. 특히, 제1 램프 하강 기간(M3)의 기울기는 제2 램프 하강 기간(M4)의 기울기보다 크다.
리셋 기간 중, 램프 상승 기간(M2)에서는 어드레스 전극 및 X 전극을 0V로 유지하고, Y 전극에는 X 전극에 대해 방전개시 전압 이하인 전압 Vs로부터 방전개시 전압을 넘는 전압인 Vset을 향하여 완만하게 상승하는 램프전압을 인가한다. 이 램프전압이 상승하는 동안 모든 방전 셀에서는 Y 전극으로부터 어드레스 전극 및 X 전극으로 각각 1회째의 미약한 리셋 방전이 일어난다. 그 결과, Y 전극에 (-) 벽전하가 축적되고, 동시에 어드레스전극 및 X 전극에는 (+) 벽전하가 축적된다.
제1 램프 하강 기간(M3)에서는 X 전극에 Ve 전압을 바이어스한 상태에서 Y 전극에 Vs/2의 전압으로 하강시킨다. 본 실시예에서는 Vs/2의 전압이라고 명시했지만, 각 전극들 사이에서 강한 방전이 일어나지 않는다면 다른 전압(예를 들어, Vs/2 보다 높거나 낮은 전압)으로 하강시켜도 된다.
본 발명의 실시예에 따르면, 상기 제1 램프 하강 기간은 전력회수 회로의 LC 공진을 이용한다. 이에 대한 구체적인 설명은 아래에서 한다.
제2 램프 하강 기간(M4)에서는 X 전극을 정전압 Ve로 유지한 상태에서, Y 전극에는 X 전극에 대해 전압 Vs/2로부터 방전개시 전압을 넘는 Vnf(V)를 향해 완만하게 하강하는 램프전압을 인가한다. 이 램프전압이 하강하는 동안 다시 모든 방전셀에서는 2회째의 미약한 리셋 방전이 일어난다. 그 결과, Y 전극의 (-) 벽전하가 감소하고 X 전극은 극성이 반전되어 미약한 (-) 전하가 축적된다. 또한, 어드레스전극의 (+) 벽전하는 어드레스 동작에 적당한 값으로 조정된다.
그리고, 본 발명의 실시예에서는 리셋 기간에서 램프 형태의 전압이 Y 전극에 인가되는 것으로 하여 설명하였지만, 램프 형태 이외의 약방전을 일으키면서 벽 전하를 제어할 수 있는 다른 형태의 전압을 Y 전극에 인가할 수도 있다. 이러한 형태의 전압은 시간 변화에 따라 점진적으로 전압 레벨이 변화하는 전압이다.
도 5는 도 4에 나타난 파형을 인가하기 위한 구동 회로의 개략적인 회로도이며, 도 6a 내지 도 6d는 본 발명에 따른 구동 회로에서 램프 상승 및 램프 하강 모드의 전류 경로를 나타내는 도면이다.
도 5에 도시되어 있는 회로는 개략적으로 도시한 Y 전극 구동 회로로서, 여기서는 패널 커패시터(Cp)의 제1 단자는 Y 전극이고, 제2 단자는 X 전극을 나타낸다. 단, 여기서는 X 전극 및 A 전극의 구동 회로는 생략하였다.
상기 Y 전극 구동 회로(100)는 크게 전력회수 회로(120), 유지방전 회로(140), 램프 회로(160)로 나뉜다.
전력회수 회로(120)는, 인덕터(L)와, 일단이 접지에 연결된 전력회수 커패시터(Cer)와, 상기 전력회수 커패시터(Cer)의 타단과 상기 인덕터(L)의 일단 사이에 병렬로 연결된 스위치(S1, S2)를 포함한다.
유지방전 회로(140)는 상기 전력회수 회로(120)에 포함된 인덕터(L)의 타단과 각각 일단이 연결되는 스위치(S3, S4)와, 상기 스위치(S3, S4)의 타단은 각각 전압(Vs)과 접지에 연결된다.
램프 회로(160)는 상기 인덕터(L)의 타단과 패널 커패시터(Cp)의 Y 전극 사이에 직렬로 연결된 스위치(S5, S6)와, 상기 인덕터(L)의 타단과 스위치(S5)의 접점과 전압(Vset - Vs) 사이에 연결된 커패시터(Cset)와, 상기 커패시터(Cset)와 상기 전압(Vset - Vs)의 접점과 상기 직렬로 연결된 스위치들(S5, S6)의 접점 사이에 연결된 램프 상승 스위치(Yrr), 스위치(S6)와 상기 Y전극의 접점과 전압(Vnf) 사이에 연결된 램프 하강 스위치(Yfr)를 포함한다. 여기서 스위치(S4 내지 S6)가 바디 다이오드를 포함한 MOSFET 스위치이고, 전압(Vnf)이 음의 전압인 경우, 스위치(S4, S5)의 바디 다이오드에 흐르는 전류를 차단하기 위하여 스위치(S6)가 필요하게 된다.
단, 본 회로는 스위치(S1 내지 S6)로 표현하였지만, 일반적으로는 MOSFET를 이용한다. 본 발명에서 상기 스위치는 MOSFET이나 스위치에 한정하지 않는다. 램프 스위치(Yrr, Yfr)는 램프 동작을 하는 회로를 간략히 표시한 것이다. 상기 스위치(S1 내지 S6) 및 램프 스위치(Yrr, Yfr)는 도면에 도시하지 않은 제어부에 의해 제어된다.
전력회수 회로(120) 및 유지방전 회로(140)는 유지방전 기간에서 Y전극에 Vs와 0의 전압을 교대로 인가할 때, 소모되는 전력의 일부를 전력 회수용 캐패시터(Cer)에 저장했다가 방출하여 전체적으로 전력 소모를 줄인다. 즉, 램프 스위치(Yrr, Yfr)가 열려 있고, 스위치(S5, S6)가 닫혀 있는 상태에서 스위치(S1 내지 S4)가 S1 - S3 - S2 - S4의 순서로 하나씩 닫힌 후에 열리면, Y전극에는 Vs와 0의 전압이 교대로 인가된다. 여기서 S2 스위치가 닫힐 때는, 전력 회수용 캐패시터(Cer)에 전류가 흘러가서 전하가 충전되며, S1 스위치가 닫힐 때, 상기 충전된 전하로 인하여 Y전극에 전압이 인가된다.
램프 회로(160)는 리셋 기간에서 셋업 전압(Vset)과 셋다운 전압(Vnf)을 일정한 순서로 Y 전극에 인가한다. 스위치(S5)를 오픈한 상태에서 램프 상승 스위치(Yrr)와 스위치(S6)를 턴온하면, Y 전극에 셋업 전압(Vset)이 서서히 인가된다. 또한, 스위치(S6)를 턴오프하고, 램프 하강 스위치(Yfr)를 턴온하면, Y 전극에 셋다운 전압(Vnf)이 서서히 인가된다.
본 발명에 따른 실시예에서는 상기 램프 하강을 제1 램프 하강과 제2 램프 하강 기간으로 나누고, 상기 Y 전극 구동 회로(100)의 동작 변화를 도 6a 내지 도 6d를 참조하여 4개의 모드로 나누어 설명한다.
① 모드 1(M1)
도 4의 모드 1 기간(M1)에서는 스위치(S1, S2, S4) 및 램프 스위치(Yrr, Yfr)는 오프 상태이고, 스위치(S3, S5, S6)는 온 상태이다. 그러면, 도 6a에 도시된 바와 같이 스위치(S3), 스위치(S5), 스위치(S6), 패널 커패시터(Cp)로 전류 경로가 형성된다. 따라서, Y전극에는 Vs의 전압이 인가된다.
② 모드 2(M2) - (램프 상승)
도 4의 모드 2 기간(M2)에서는 스위치(S4)를 온시킨 상태에서, 스위치(S5)를 턴오프하고, 램프 스위치(Yrr)를 턴온한다. 여기서, 커패시터(Cset)에는 Vset - Vs의 전압이 미리 충전되어 있다. 그러면, 도 6b에 도시된 바와 같이 스위치(S4), 램프 스위치(Yrr), 스위치(S6), 패널 커패시터(Cp)로 전류 경로가 형성되어, Y 전극(패널 커패시터의 제1 전극)의 전압이 Vs 전압에서 Vset 전압으로 서서히 올라간다.
③ 모드 3(M3) - (제1 램프 하강)
도 4의 모드 3 기간(M3)에서는 램프 스위치(Yrr)가 턴오프되고, 스위치(S3, S4)가 턴온되어 Y 전극에는 Vs의 전압이 인가된다. 그 후, 다시 스위치(S3)가 턴오프되고, 스위치(S2)가 턴온된다. 그러면, 도 6c에 도시된 바와 같이 패널 커패시터(Cp), 스위치(S6), 스위치(S5), 코일(L), 스위치(S2), 전력 회수용 커패시터(Cer)로 전류 경로가 형성되어, 전력 회수용 커패시터(Cer), 인덕터(L) 및 패널 커패시터(Cp) 사이에서 공진이 발생한다. 이 공진에 의해 전력 회수용 커패시터(Cer)에 전하가 충전되고, Y 전극의 전압은 Vs/2 정도까지 급격히 떨어지게 된다. 이 때, 스위치(S2)의 스위칭 타이밍을 조절하여 Y 전극에 인가되는 전압을 Vs/2보다 높거나 낮게 조절할 수 있다.
④ 모드 4(M4) - (제2 램프 하강)
도 4의 모드 4 기간(M4)에서는 스위치(S6)가 턴오프되고, 램프 스위치(Yfr) 턴온된다. 그러면, 도 6d에 도시된 바와 같이 패널 커패시터(Cp)에서 램프 스위치(Yfr)로 전류 경로가 형성된다. 따라서, Y전극에 인가되는 전압은 Vs/2에서 램프 스위치(Yfr)에 의해 Vnf로 서서히 떨어진다.
이러한 동작으로 인하여 전체 램프 하강 기간의 길이가 종래 기술의 램프 하강 기간에 비하여 Z 만큼 줄어들게 된다. 예를 들어 하나의 프레임에 서브필드가 8개인 경우, Z × 8 길이 만큼의 길이가 확보된다. 이렇게 확보된 시간을 유지방전에 사용할 수 있다.
상기 본 발명에 따른 실시예에서는 기존의 회로를 변경하지 않고도, 간단하게 스위치(S1 내지 S6) 및 램프 스위치(Yrr, Yfr)를 제어함으로써 리셋 기간에 걸리는 시간을 줄일 수 있다.
이상에서 본 발명의 바람직한 실시예에 대하여 상세하게 설명하였지만 본 발명의 권리범위는 이에 한정되는 것은 아니고 다음의 청구범위에서 정의하고 있는 본 발명의 기본 개념을 이용한 당업자의 여러 변형 및 개량 형태 또한 본 발명의 권리범위에 속하는 것이다.
이상에서 살펴본 바와 같이, 본 발명에 따르면 간단하게 스위치의 조작만으로 잘못된 방전 없이 리셋 기간의 시간을 줄이고, 남는 시간을 유지방전 기간에 할당하여 휘도를 높일 수 있다.
도 1은 플라즈마 디스플레이 패널의 일부 사시도이다.
도 2는 플라즈마 디스플레이 패널의 전극 배열도를 나타낸다.
도 3은 종래 플라즈마 디스플레이 패널의 구동 파형도이다.
도 4는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동 파형도이다.
도 5는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널 구동 회로의 개략적인 회로도이다.
도 6a 내지 도 6d는 본 발명의 실시예에 따른 리셋 기간의 각 모드에서의 전류 경로를 나타낸 도면이다.

Claims (10)

  1. 제1 전극 및 제2 전극과, 상기 제1 전극과 상기 제2 전극 사이에 형성되는 패널 커패시터에 전압을 인가하는 플라즈마 디스플레이 패널의 구동 장치에 있어서,
    상기 패널 커패시터의 제1 전극에 제1 단자가 전기적으로 연결되는 인덕터;
    상기 인덕터의 제2 단자와 제1 전압을 공급하는 제1 전원 사이에 전기적으로 연결되는 제1 스위치;
    상기 인덕터의 제1 단자와 제2 전압을 공급하는 제2 전원 사이에 전기적으로 연결되는 제2 스위치를 포함하며,
    리셋 기간에서,
    상기 제2 스위치를 턴온하여 상기 제2 전압을 상기 제1 전극에 공급한 후, 상기 제2 스위치를 턴오프하고 상기 제1 스위치를 턴온하여 상기 제1 전극을 제3 전압까지 하강시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  2. 제1항에 있어서,
    상기 패널 커패시터의 제1 전극과 제4 전압을 공급하는 제3 전원 사이에 전기적으로 연결되어 전압을 점진적으로 하강시키는 제3 스위치를 더 포함하며,
    상기 제1 스위치를 턴오프하고 상기 제3 스위치를 턴온하여 상기 제1 전극을 상기 제3 전압에서 제4 전압으로 점진적으로 하강시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  3. 제1항 또는 제2항에 있어서,
    상기 인덕터의 제1 단자와 상기 패널 커패시터의 제1 전극 사이에 전기적으로 연결되는 제4 스위치;
    상기 제4 스위치와 상기 인덕터의 접점과 제5 전압을 공급하는 제4 전원 사이에 전기적으로 연결되는 커패시터; 및
    상기 패널 커패시터의 제1 전극과 상기 제4 전원 사이에 전기적으로 연결되어 전압을 점진적으로 상승시키는 제5 스위치를 더 포함하며,
    상기 제4 스위치를 턴오프 한 상태에서 상기 제5 스위치를 턴온하여 상기 제1 전극을 제6 전압에서 제7 전압까지 점진적으로 상승시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  4. 제1항 또는 제2항에 있어서,
    상기 제2 전압은 상기 제1 전압의 1/2인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  5. 제1항 또는 제2항에 있어서,
    상기 제4 전압은 음의 값인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  6. 제1항 또는 제2항에 있어서,
    상기 제1 스위치 및 제2 스위치는 각각 바디 다이오드를 가지는 트랜지스터인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 장치.
  7. 제1 전극 및 제2 전극과, 상기 제1 전극과 상기 제2 전극 사이에 형성되는 패널 커패시터에 전압을 인가하는 플라즈마 디스플레이 패널의 구동 방법에 있어서,
    리셋 기간에서,
    (a) 상기 제1 전극에 제1 전압에서 제2 전압까지 하강하는 전압을 인가하는 단계;
    (b) 상기 제1 전극에 제2 전압에서 제3 전압까지 완만하게 하강하는 전압을 인가하는 단계를 포함하며,
    상기 단계(a)에서 상기 제1 전압에서 제2 전압까지의 하강하는 전압을 LC 공진에 의해 인가하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  8. 제7항에 있어서,
    상기 단계(a) 전에,
    제1 전극에 제4 전압에서 제5 전압까지 완만하게 상승하는 전압을 인가하는 단계를 더 포함하는 플라즈마 디스플레이 패널의 구동 방법.
  9. 제7항 또는 제8항에 있어서,
    상기 제2 전압은 상기 제1 전압의 1/2인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
  10. 제7항 또는 제8항에 있어서,
    상기 제3 전압은 음의 값인 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동 방법.
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