KR20040082779A - 플라즈마 디스플레이 패널의 구동방법 및 장치 - Google Patents

플라즈마 디스플레이 패널의 구동방법 및 장치 Download PDF

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Abstract

본 발명은 오방전을 방지하도록 한 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
이 플라즈마 디스플레이 패널의 구동방법 및 장치는 상승 기울기의 제1 램프파형, 상승 기울기의 제2 램프파형 및 하강 기울기의 제3 램프파형을 발생하고, 상기 제1, 제2 및 제3 램프파형을 이용하여 플라즈마 디스플레이 패널을 초기화시킨다.

Description

플라즈마 디스플레이 패널의 구동방법 및 장치{METHOD AND APPARATUS FOR DRIVING PLASMA DISPLAY PANEL}
본 발명은 플라즈마 디스플레이 패널에 관한 것으로, 특히 오방전을 방지하도록 한 플라즈마 디스플레이 패널의 구동방법 및 장치에 관한 것이다.
플라즈마 디스플레이 패널(Plasma Display Panel : 이하 "PDP"라 한다)은 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 방전할 때 발생하는 자외선을 이용하여 형광체를 여기 발광시킴으로써 화상을 표시하게 된다. 이러한 PDP는 박막화와 대형화가 용이할 뿐만 아니라 최근의 기술 개발에 힘입어 화질이 향상되고 있다.
도 1을 참조하면, 종래의 3전극 교류 면방전형 PDP의 방전셀은 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과, 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)과 직교하는 어드레스전극(X1 내지 Xm)을 구비한다.
스캔전극(Y1 내지 Yn), 서스테인전극(Z) 및 어드레스전극(X1 내지 Xm)의 교차부에는 적색, 녹색 및 청색 중 어느 하나를 표시하기 위한 셀(1)이 형성된다. 스캔전극(Y1 내지 Yn) 및 서스테인전극(Z)은 도시하지 않은 상부기판 상에 형성된다. 상부기판에는 도시하지 않는 유전체층과 MgO 보호층이 적층된다. 어드레스전극(X1 내지 Xm)은 도시하지 않은 하부기판 상에 형성된다. 하부기판 상에는 수평으로 인접한 셀들 간에 광학적, 전기적 혼신을 방지하기 위한 격벽이 형성된다. 하부기판과 격벽 표면에는 진공자외선에 의해 여기되어 가시광을 방출하는 형광체가 형성된다. 상부기판과 하부기판 사이의 방전공간에는 He+Xe, Ne+Xe, He+Xe+Ne 등의 불활성 혼합가스가 주입된다.
PDP는 화상의 계조를 구현하기 위하여, 한 프레임을 발광횟수가 다른 여러 서브필드로 나누어 시분할 구동하게 된다. 각 서브필드는 전화면을 초기화시키기 위한 리셋기간과, 주사라인을 선택하고 선택된 주사라인에서 셀을 선택하기 위한 어드레스기간과, 방전횟수에 따라 계조를 구현하는 서스테인기간으로 나뉘어진다. 예를 들어, 256 계조로 화상을 표시하고자 하는 경우에 도 2와 같이 1/60 초에 해당하는 프레임 기간(16.67ms)은 8개의 서브필드들(SF1 내지 SF8)로 나누어지게 된다. 8개의 서브 필드들(SF1 내지 SF8) 각각은 전술한 바와 같이, 초기화기간, 어드레스기간 및 서스테인기간으로 나누어지게 된다. 각 서브필드의 초기화기간과 어드레스 기간은 각 서브필드마다 동일한 반면에 서스테인 기간과 그에 할당되는 서스테인펄스의 수는 각 서브필드에서 2n(n=0,1,2,3,4,5,6,7)의 비율로 증가된다.
도 3은 두 개의 서브필드에 공급되는 PDP의 구동파형을 나타낸다.
도 3을 참조하면, PDP는 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간으로 나누어 구동된다.
리셋기간에 있어서, 셋업기간(SU)에는 모든 스캔전극들(Y)에 서스테인전압(Vs)까지 상승한 후 셋업전압(Vsetup)까지 점진적으로 상승하는 상승 램프파형(Ramp-up)이 동시에 인가된다. 이와 동시에, 서스테인전극(Z)과 어드레스전극(X)에는 0[V]가 인가된다. 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에서 스캔전극(Y)과 어드레스전극(X) 사이와 스캔전극(Y)과 서스테인전극(Z) 사이에는 빛이 거의 발생되지 않는 다크 방전(Dark discharge)이 일어난다. 이 셋업방전에 의해 어드레스전극(X)과 서스테인전극(Z) 상에는 정극성(+)의 벽전하가 쌓이게 되며, 스캔전극(Y) 상에는 부극성(-)의 벽전하가 쌓이게 된다. 여기서, 스캔전극(Y) 상에 쌓여진 부극성(-)의 벽전하양은 어드레스전극(X)과 서스테인전극(Z) 상에 쌓여진 정극성(+)의 벽전하의 총양과 동일하다.
셋다운기간(SD)에는 상승 램프파형(Ramp-up)이 공급된 후, 상승 램프파형(Ramp-up)의 피크전압보다 낮은 정극성 전압에서 떨어지기 시작하여 기저전압(GND) 또는 부극성의 특정 전압레벨까지 떨어지는 하강 램프파형(Ramp-down)이 스캔전극들(Y)에 동시에 인가된다. 이와 동시에, 서스테인전극(Z)에는 정극성의 서스테인전압(Vs)이 인가되고, 어드레스전극(X)에는 0[V]가 인가된다. 이렇게 하강 램프파형(Ramp-down)이 인가될 때, 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 다크 방전이 일어난다. 또한, 스캔전극(Y)과 어드레스전극(Z) 사이에서는 하강 램프파형(Ramp-down)이 떨어지는 구간에서 방전이 일어나지 않고 하강 램프파형(Ramp-down)의 하한점에서 다크 방전이 일어난다. 이러한 셋다운기간(SD)에 일어나는 방전에 의해 셋업기간(SU)에 발생된 어드레스방전에 불필요한과도한 벽전하를 소거시키게 된다. 셋업기간(SU)과 셋다운기간(SD)에서의 벽전하 변화를 살펴보면, 어드레스전극(X) 상의 벽전하 변화는 거의 없으며, 스캔전극(Y)의 부극성(-) 벽전하가 감소한다. 반면에, 서스테인전극(Z)의 벽전하는 셋업기간(SU)에서의 극성이 정극성이었으나, 스캔전극(Y)의 부극성(-) 벽전하의 감소분만큼 자신에게 부극성 벽전하가 쌓이면서 셋다운기간(SD)에서 그 극성이 부극성으로 반전된다.
어드레스기간에는 부극성 스캔펄스(scn)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 스캔펄스(scn)에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 스캔펄스(scn)와 데이터펄스(data)의 전압차와 초기화기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 서스테인전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다.
서스테인전극(Z)에는 셋다운기간과 어드레스기간 동안에 스캔전극(Y)과의 전압차를 줄여 스캔전극(Y)과의 오방전이 일어나지 않도록 정극성 직류전압(Zdc)이 공급된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전 즉, 표시방전이 일어나게 된다.
서스테인방전이 완료된 후에는 펄스폭과 전압레벨이 작은 램프파형(ramp-ers)이 서스테인전극(Z)에 공급되어 전화면의 셀들 내에 잔류하는 벽전하를 소거시키게 된다.
그런데 종래의 PDP는 리셋기간의 초기에 스캔전극(Y) 상의 전압이 서스테인전압(Vs)까지 급격히 상승하기 때문에 셀(1) 내에서 오방전이 발생할 수 있다. 예를 들면, 이전 서브필드에서 방전횟수가 많은 셀들은 방전횟수가 작은 셀들에 비하여 상대적으로 많은 양의 벽전하가 잔류하게 된다. 이러한 셀들에 서스테인 전압까지 급격히 상승하는 전압이 인가되면 리셋기간이나 어드레스기간에 오방전이 일어날 수 있다. 따라서, 스캔전극(Y) 상의 전압이 급격히 서스테인전압까지 상승하면 셀(1) 내의 벽전하 양과 셀들 사이의 유전율 편차에 따라 셀(1) 내에서 오방전이 일어날 수 있다.
따라서, 본 발명의 목적은 오방전을 방지하도록 한 PDP의 구동방법 및 장치를 제공함에 있다.
도 1은 종래의 3전극 교류 면방전형 플라즈마 디스플레이 패널의 전극배치를 개략적으로 나타내는 평면도이다.
도 2는 256 계조를 구현하기 위한 8 비트 디폴트 코드의 프레임 구성을 나타내는 도면이다.
도 3은 종래의 PDP를 구동하기 위한 구동 파형을 나타내는 파형도이다.
도 4는 본 발명의 실시예에 따른 플라즈마 디스플레이 패널의 구동장치를 개략적으로 나타내는 블록도이다.
도 5는 도 4에 도시된 구동장치로부터 발생되는 구동 신호를 나타내는 파형도이다.
도 6은 도 4에 도시된 스캔 구동부를 상세히 나타내는 회로도이다.
도 7은 도 6에 도시된 스위치소자의 제어신호를 나타내는 파형도이다.
< 도면의 주요 부분에 대한 부호의 설명 >
41 : 타이밍 콘트롤러 42 : 데이터 구동부
43 : 스캔 구동부 44 : 서스테인 구동부
45 : 구동전압 발생부
상기 목적을 달성하기 위하여, 본 발명의 실시예에 따른 PDP의 구동방법은 상승 기울기의 제1 램프파형을 발생하는 단계와; 상승 기울기의 제2 램프파형을 발생하는 단계와; 하강 기울기의 제3 램프파형을 발생하는 단계와; 제1 램프파형,제2 램프파형 및 제3 램프파형을 이용하여 PDP를 초기화시키는 단계를 포함한다.
상기 PDP에는 제1 램프파형, 제2 램프파형 및 제3 램프파형의 순으로 램프파형들이 연속으로 공급되는 것을 특징으로 한다.
상기 제1 램프파형은 상기 제2 램프파형의 시작전압 이하의 전압까지 상승하는 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 구동방법은 제1 램프파형과 제2 램프파형 사이에 직류전압을 PDP에 공급하는 단계를 더 포함한다.
상기 제1 램프파형과 상기 제2 램프파형은 기울기가 동일한 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 구동장치는 상승 기울기의 제1 램프파형, 상승 기울기의 제2 램프파형 및 하강 기울기의 제3 램프파형을 PDP에 연속으로 공급하기 위한 구동회로를 구비한다.
상기 구동회로는 램프파형들을 스캔전극에 공급하는 것을 특징으로 한다.
상기 구동회로는 제1 램프파형을 제2 램프파형의 시작전압 이하의 전압까지 상승시키는 것을 특징으로 한다.
상기 구동회로는 제1 램프파형과 제2 램프파형 사이에 직류전압을 스캔전극에 공급하는 것을 특징으로 한다.
상기 구동회로는 제1 램프파형과 제2 램프파형을 동일한 기울기로 발생하는 것을 특징으로 한다.
상기 구동회로는 셋업전압을 발생하는 전압원과; 제어신호에 응답하여 셋업전압을 절환하기 위한 스위치소자와; 제어신호를 발생하는 스위치 제어회로를 구비한다.
상기 스위치소자의 온타임에 따라서 제1 램프파형과 제2 램프파형이 발생되는 것을 특징으로 한다.
본 발명의 실시예에 따른 PDP의 구동장치는 어드레스기간 동안 어드레스전극에 데이터를 공급하기 위한 데이터 구동회로와; 데이터에 동기되는 스캔펄스를 스캔전극에 공급하기 위한 스캔 구동회로와; 서스테인기간 동안 스캔전극과 서스테인전극에 교대로 서스테인펄스를 공급하기 위한 서스테인 구동회로를 구비한다.
이하, 도 4 내지 도 11을 참조하여 본 발명의 바람직한 실시예들에 대하여 설명하기로 한다.
도 4를 참조하면, 본 발명의 실시예에 따른 PDP의 구동장치는 PDP의 어드레스전극들(X1 내지 Xm)에 접속된 데이터 구동부(42)와, PDP의 스캔전극들(Y1 내지 Yn)에 접속된 스캔 구동부(43)와, PDP의 서스테인전극들(Z)에 접속된 서스테인 구동부(44)와, 각 구동부(42,43,44)에 필용한 구동전압을 공급하기 위한 구동전압 발생부(45)와 각 구동부(42,43,44)를 제어하기 위한 타이밍 콘트롤러(41)를 구비한다.
데이터 구동부(42)에는 도시하지 않은 역감마보정회로, 오차확산회로 등에 의해 역감마보정 및 오차확산 된 후, 서브필드맵핑회로에 의해 각 서브필드에 맵핑된 데이터가 공급된다. 이 데이터 구동부(42)는 타이밍 콘트롤러(41)로부터 공급되는 타이밍제어신호(CTRX)에 응답하여 데이터를 샘플링한 다음, 그 데이터를 1 수평기간마다 1 수평 라인분씩 어드레스전극들(X1 내지 Xm)에 공급하게 된다. 여기서, 데이터 구동부(42)에 공급되는 타이밍제어신호(CTRX)에는 데이터를 샘플링하기 위한 샘플링클럭(SMPCLK)과 에너지 회수회로와 구동 스위치소자의 온/오프타임을 제어하기 위한 스위치제어신호가 포함된다.
스캔 구동부(43)는 타이밍 콘트롤러(41)의 제어 하에 리셋기간 동안 프리 램프파형을 스캔전극들(Y1 내지 Yn)에 공급한 후에 상승 램프파형과 하강 램프 파형을 스캔전극들(Y1 내지 Yn)에 연속으로 공급한다. 또한, 스캔 구동부(43)는 타이밍 콘트롤러(41)의 제어 하에 어드레스기간 동안 스캔전극들(Y1 내지 Yn)에 스캔펄스를 스캔전극들(Y1 내지 Ym)에 순차적으로 공급하며, 어드레스 방전에 의해 선택된 셀에 대하여 서스테인방전을 일으키기 위한 서스테인펄스를 스캔전극들(Y1 내지 Ym)에 동시에 공급하게 된다. 스캔 구동부(43)에 인가되는 타이밍제어신호(CTRY)에는 스캔 구동부(43) 내의 스위치소자의 온/오프 타임을 제어하기 위한 스위치 제어신호가 포함된다.
서스테인 구동부(44)는 타이밍 콘트롤러(41)의 제어 하에 리셋기간의 일부와 어드레스기간 동안 정극성의 바이어스전압을 서스테인전극들(Z)에 공급한 후, 서스테인기간 동안 스캔 구동부(43)와 교대로 동작하여 서스테인펄스를 서스테인전극들(Z)에 공급하게 된다. 서스테인 구동부(44)에 인가되는 타이밍제어신호(CTRZ)에는 서스테인 구동부(44) 내의 스위치소자의 온/오프 타임을 제어하기 위한 스위치 제어신호가 포함된다.
구동전압 발생부(45)는 도시하지 않은 메인 보드로부터의 시스템 전원을 펄스폭 변조 방식 등으로 출력전압의 전압레벨을 변환하는 직류-직류 변환기(DC-DC Converter)로 구현된다. 이 구동전압 발생부(45)로부터 출력되는 구동전압은 정극성의 서스테인전압(Vs), 서스테인전압(Vs) 보다 낮은 정극성의 스캔 바이어스전압(Vscb), 서스테인전압(Vs) 보다 낮은 데이터전압(Vd), 서스테인전압(Vs) 보다 높은 정극성의 셋업전압(Vsetup) 그리고 부극성의 스캔전압(-Vy)이다. 서스테인전압(Vs)은 스캔 구동부(43)와 서스테인 구동부(44)에 공급된다. 스캔 바이어스전압(Vscb), 셋업전압(Vsetup) 및 스캔전압(-Vy)은 스캔 구동부(43)에 공급된다. 데이터전압(Vd)은 데이터 구동부(42)에 공급된다.
타이밍 콘트롤러(41)는 수직/수평 동기신호와 메인 클럭신호를 입력받고, 그 동기신호와 메인클럭을 이용하여 각 구동부(42,43,44)에 필요한 타이밍 제어신호(CTRX,CTRY,CTRZ)를 발생한다.
도 5는 도 4에 도시된 구동부로부터 발생되는 구동신호의 파형을 나타낸다.
도 5를 참조하면, 본 발명의 실시예에 따른 PDP의 구동방법은 한 프레임기간을 다수의 서브필드로 나누어 시분할 구동한다. 각 서브필드는 전화면을 초기화시키기 위한 초기화기간, 셀을 선택하기 위한 어드레스 기간 및 선택된 셀의 방전을 유지시키기 위한 서스테인기간을 포함한다.
리셋기간 동안, 모든 스캔전극들(Y)에 기저전압(GND) 또는 0[V]로부터 서스테인전압(Vs) 이하의 전압까지 상승하는 프리 램프파형(Pre-ramp)이 스캔전극들(Y)에 동시에 인가된다. 프리 램프파형(Pre-ramp)은 스캔전극(Y) 상의 전압이 서스테인전압(Vs)까지 급격히 상승할 때 스캔전극(Y)과 어드레스전극(X) 사이나스캔전극(Y)과 서스테인전극(Y) 사이에 방전이 크게 일어나는 것을 예방하는 역할을 한다. 이 프리 램프파형(Pre-ramp)에 이어서, 서스테인전압(Vs)부터 셋업전압(Vsetup)까지 상승하는 상승 램프파형(Ramp-up)이 스캔전극들(Y)에 공급된다. 프리 램프파형(Pre ramp)과 상승 램프파형(Ramp-up)에 의해 전화면의 셀들 내에는 스캔전극(Y)과 어드레스전극(X) 사이와 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 다크 방전이 일어나게 된다. 그 결과, 전화면의 셀들 내에서 어드레스전극들(X)과 서스테인전극들(Z) 상에는 정극성(+)의 벽전하가 균일하게 쌓이게 되며, 스캔전극들(Y) 상에는 부극성(-)의 벽전하가 균일하게 쌓이게 된다. 상승 램프파형(Ramp-up)에 이어서, 스캔전극들(Y)의 전압은 서스테인전압(Vs)까지 떨어진 다음, 서스테인전압(Vs)부터 스캔전압(-Vy)까지 하강하는 하강 램프파형(Ramp-down)이 스캔전극들(Y)에 동시에 인가된다. 이와 동시에, 서스테인전극(Z)에는 바이어스전압(Vzb)으로서 정극성의 서스테인전압(Vs)이 인가되고, 어드레스전극(X)에는 0[V]가 인가된다. 이렇게 하강 램프파형(Ramp-down)이 인가될 때, 스캔전극(Y)과 서스테인전극(Z) 사이에 빛이 거의 발생되지 않는 다크 방전이 일어난다. 하강 램프파형(Ramp-down)은 상승 램프파형(Ramp-up)에 의한 셋업 방전시 발생된 과도한 벽전하를 소거시켜 전화면의 셀들 내에 어드레스방전에 필요한 벽전하양을 균일하게 잔류시킨다.
한편, 하강 램프파형(Ramp-down)은 서스테인전극(Z)과 어드레스전극(X)에 인가되는 전압에 따라 부극성의 스캔전압(-Vy)까지 하강하기 않고 기저전압(GND)이나 0[V]까지 하강할 수 있다.
어드레스기간에는 부극성 스캔펄스(scn)가 스캔전극들(Y)에 순차적으로 인가됨과 동시에 스캔펄스(scn)에 동기되어 어드레스전극들(X)에 정극성의 데이터펄스(data)가 인가된다. 스캔펄스(scn)와 데이터펄스(data)의 전압차와 초기화기간에 생성된 벽전압이 더해지면서 데이터펄스(data)가 인가되는 셀 내에는 어드레스 방전이 발생된다. 어드레스방전에 의해 선택된 셀들 내에는 서스테인전압(Vs)이 인가될 때 방전이 일어날 수 있게 하는 정도의 벽전하가 형성된다.
서스테인전극(Z)에는 셋다운기간과 어드레스기간 동안에 스캔전극(Y)과의 전압차를 줄여 스캔전극(Y)과의 오방전이 일어나지 않도록 정극성 직류전압(Zdc)이 공급된다.
서스테인기간에는 스캔전극들(Y)과 서스테인전극들(Z)에 교번적으로 서스테인펄스(sus)가 인가된다. 여기서 스캔전극(Y)이나 서스테인전극(Z)에 첫 번째 인가되는 서스테인펄스(WSUS)는 서스테인방전이 안정되게 개시될 수 있도록 그 이 후의 서스테인펄스(SUS)에 비하여 펄스폭이 더 넓다. 어드레스방전에 의해 선택된 셀은 셀 내의 벽전압과 서스테인펄스(sus)가 더해지면서 매 서스테인펄스(sus)가 인가될 때 마다 스캔전극(Y)과 서스테인전극(Z) 사이에 서스테인방전 즉, 표시방전이 일어나게 된다.
서스테인방전이 완료된 후에는 도시하지 않은 소거 램프파형(ramp-ers)이 스캔전극(Y)이나 서스테인전극(Z)에 공급되어 서스테인방전에 의해 잔류하는 벽전하를 소거시킨다.
도 6은 스캔 구동부(43)를 상세히 나타낸다. 도 7은 리셋기간 동안 스캔 구동부(43)에 공급되는 스위치 제어신호를 나타내는 파형도이다.
도 6 및 도 7을 참조하면, 스캔 구동부(43)는 에너지 회수회로(61)와, 에너지 회수회로(61)와 제3 노드(n3) 사이에 접속된 제5 스위치(Q5)와, 제3 노드(n3)와 셋업전압원(Vsetup) 사이에 접속된 제7 스위치(Q7)와, 제3 노드(n3)와 스캔전압원(-Vy) 사이에 접속된 제6 및 제8 스위치(Q6,Q8)와, 제3 노드(n3)와 스캔 바이어스전압원(Vscb) 사이에 접속된 제10 스위치(Q10)와, 제4 노드(n4)와 스캔전극(Y) 사이에 접속된 제11 스위치(Q11)와, 제3 노드(n3)와 스캔전극(Y) 사이에 접속된 제12 스위치(Q12)를 구비한다.
에너지 회수회로(61)는 스캔전극(Y)으로부터 회수되는 에너지를 충전하기 위한 캐패시터(C)와, 캐패시터(C)에 병렬 접속된 제3 및 제4 스위치(Q3,Q4)와, 제1 노드(n1)와 제2 노드(n2) 사이에 접속된 인덕터(L)와, 서스테인전압원(Vs)과 제2 노드(n2) 사이에 접속된 제1 스위치(Q1)와, 제2 노드(n2)와 기저전압원(GND) 사이에 접속된 제2 스위치(Q2)로 구성된다.
이 에너지 회수회로(41)의 동작을 설명하면 다음과 같다. 캐패시터(C)에는 Vs/2 전압이 충전되어 있다고 가정한다. 제3 스위치(Q3)가 턴-온되면, 캐패시터(C)에 충전된 전압은 인덕터(L)를 경유하여 스캔전극(Y)에 공급된다. 인덕터(L)는 PDP 셀의 정전용량(C)과 함께 직렬 LC 공진회로를 구성하게 된다. LC 직렬 공진파형의 공진점에서 제1 스위치(Q1)가 턴-온된다. 제1 스위치(Q1)의 턴-온에 의하여 스캔전극(Y) 상의 전압은 서스테인 전압레벨로 유지된다. PDP의 셀 내에서 방전이 일어난 후에 제1 스위치(Q1)는 턴-오프되고 제4 스위치(Q4)가 턴-온된다. 이 때, 방전에 기여하지 않은 무효전력 즉, 에너지는 PDP의 스캔전극(Y)으로부터 인덕터(L)를 경유하여 캐패시터(C)에 충전된다. 이어서, 제4 스위치(Q4)가 턴-오프되고 제2 스위치(Q2)가 턴-온되면 스캔전극(Y) 상의 전압은 기저전압(GND)이나 0[V]를 유지한다.
이렇게 에너지 회수회로(41)는 PDP로부터 에너지를 회수한 다음, 회수된 에너지를 이용하여 스캔전극(Y)에 서스테인전압(Vs)을 공급함으로써 과도한 소비전력을 줄이게 된다.
스캔전극(Y) 상의 전압이 기저전압(GND)이나 0[V]를 유지하는 리셋기간의 초기에 제2 스위치(Q2)는 턴-온된다. 이어서, 제2 스위치(Q2)가 턴-오프되는 반면에 제7 스위치(Q7)는 턴-온된다. 이 때, 스캔전극(Y)에 프리 램프파형(Pre-ramp)이 공급되어 스캔전극(Y) 상의 전압은 기저전압(GND)이나 0[V]로부터 서스테인전압(Vs) 이하의 전압까지 상승하게 된다. 프리 램프파형(Pre-ramp)의 상한 전압은 제2 스위치(Q2)의 온타임에 의해 결정된다. 이어서, 제2 스위치(Q2)가 턴-오프되는 반면에 제1 스위치(Q1)가 턴-온되고 소정 시간이 지난 다음, 제1 스위치(Q1)가 턴-오프되고 제7 스위치(Q7)가 다시 턴-온된다. 그러면 스캔전극(Q1) 상의 전압은 서스테인전압(Vs)을 소정 시간 유지한 후에 상승 램프파형(Ramp-up)에 의해 셋업전압(Vsetup)까지 상승한다. 프리 램프파형(Pre-ramp)과 상승 램프파형(Ramp-up)의 기울기는 제7 스위치(Q7)의 게이트단자에 접속된 가변저항(R1)의 저항값과 도시하지 않은 캐패시터의 캐패시턴스의 조합에 의한 RC 시정수에 의해 결정된다. 이어서, 제7 스위치(Q7)가 턴-오프되고 제1 스위치(Q1)가 다시 턴-온된 후에 제1 스위치(Q1)가 턴-오프되고 제6 스위치(Q6)가 턴-온된다. 그러면 스캔전극(Y) 상의 전압은 셋업전압(Vsetup)에서 서스테인전압(Vs)까지 떨어진 후에 하강 램프파형(Ramp-dn)에 의해 부극성의 스캔전압(-Vy)까지 떨어진다. 하강 램프파형(Ramp-dn)의 기울기는 제6 스위치(Q6)의 게이트단자에 접속된 가변저항(R2)의 저항값과 도시하지 않은 캐패시터의 캐패시턴스의 조합에 의한 RC 시정수에 의해 결정된다.
제6 스위치(Q6)는 어드레스기간 동안 타이밍 콘트롤러(41)로부터의 제어신호(sc)에 응답하여 절환됨으로써 스캔전압(-Vy)을 스캔전극(Y)에 공급한다.
제10 스위치(Q10)는 어드레스기간 동안 타이밍 콘트롤러(41)로부터의 제어신호(Scb)에 응답하여 절환됨으로써 스캔바이어스전압(Vscb)을 스캔전극(Y)에 공급한다.
제9 스위치(Q9)는 타이밍 콘트롤러(41)로부터의 제어신호(Dic_updn)에 응답하여 절환됨으로써 제3 노드(n3)와 제4 노드(n4) 사이의 전류패스를 절환한다.
제11 및 제12 스위치(Q11,12)는 스캔전극(Y)을 사이에 두고 푸쉬풀 형태로 접속되어 타이밍 콘트롤러(41)의 제어 하에 절환됨으로써 제4 노드(n4)와 제3 노드(n3) 상의 전압을 스캔전극(Y)에 공급한다.
결과적으로, 스캔 구동부(43)는 셋업회로를 그대로 이용하여 프리 램프파형(Pre-ramp)을 발생함으로써 별도의 전압원이나 스위치소자를 추가하지 않고 프리 램프파형(Pre-ramp)을 스캔전극(Y)에 공급할 수 있다.
상술한 바와 같이, 본 발명에 따른 PDP의 구동방법 및 장치는 스캔전극에 서스테인전압이 공급되기 전에 서스테인전압까지 점진적으로 상승하는 프리 램프파형(Pre-ramp)을 상기 스캔전극에 공급함으로써 스캔전극(Y) 상의 전압이 급격히 서스테인전압까지 상승하는 것을 예방하게 된다. 그 결과, 본 발명에 따른 PDP의 구동방법 및 장치는 스캔전극 상의 전압이 급격히 상승하는 것으로 인하여 발생되는 리셋기간이나 어드레스기간에서의 오방전을 방지할 수 있게된다.
이상 설명한 내용을 통해 당업자라면 본 발명의 기술사상을 일탈하지 아니하는 범위에서 다양한 변경 및 수정이 가능함을 알 수 있을 것이다. 따라서, 본 발명의 기술적 범위는 명세서의 상세한 설명에 기재된 내용으로 한정되는 것이 아니라 특허 청구의 범위에 의해 정하여 져야만 할 것이다.

Claims (13)

  1. 상승 기울기의 제1 램프파형을 발생하는 단계와;
    상승 기울기의 제2 램프파형을 발생하는 단계와;
    하강 기울기의 제3 램프파형을 발생하는 단계와;
    상기 제1 램프파형, 상기 제2 램프파형 및 상기 제3 램프파형을 이용하여 플라즈마 디스플레이 패널을 초기화시키는 단계를 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  2. 제 1 항에 있어서,
    상기 플라즈마 디스플레이 패널에는 상기 제1 램프파형, 상기 제2 램프파형 및 상기 제3 램프파형의 순으로 상기 램프파형들이 연속으로 공급되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  3. 제 1 항에 있어서,
    상기 제1 램프파형은 상기 제2 램프파형의 시작전압 이하의 전압까지 상승하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  4. 제 3 항에 있어서,
    상기 제1 램프파형과 상기 제2 램프파형 사이에 직류전압을 상기 플라즈마디스플레이 패널에 공급하는 단계를 더 포함하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  5. 제 1 항에 있어서,
    상기 제1 램프파형과 상기 제2 램프파형은 기울기가 동일한 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동방법.
  6. 스캔전극, 서스테인전극 및 어드레스전극을 가지는 플라즈마 디스플레이 패널을 리셋기간, 어드레스기간 및 서스테인기간을 각각 포함하는 다수의 서브필드로 나누어 구동하는 장치에 있어서,
    상승 기울기의 제1 램프파형, 상승 기울기의 제2 램프파형 및 하강 기울기의 제3 램프파형을 상기 플라즈마 디스플레이 패널에 연속으로 공급하기 위한 구동회로를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  7. 제 6 항에 있어서,
    상기 구동회로는 상기 램프파형들을 상기 스캔전극에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  8. 제 6 항에 있어서,
    상기 구동회로는,
    상기 제1 램프파형을 상기 제2 램프파형의 시작전압 이하의 전압까지 상승시키는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  9. 제 6 항에 있어서,
    상기 구동회로는,
    상기 제1 램프파형과 상기 제2 램프파형 사이에 직류전압을 상기 스캔전극에 공급하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  10. 제 6 항에 있어서,
    상기 구동회로는,
    상기 제1 램프파형과 상기 제2 램프파형을 동일한 기울기로 발생하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  11. 제 6 항에 있어서,
    상기 구동회로는,
    셋업전압을 발생하는 전압원과;
    제어신호에 응답하여 상기 셋업전압을 절환하기 위한 스위치소자와;
    상기 제어신호를 발생하는 스위치 제어회로를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  12. 제 11 항에 있어서,
    상기 스위치소자의 온타임에 따라서 상기 제1 램프파형과 상기 제2 램프파형이 발생되는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
  13. 제 11 항에 있어서,
    상기 어드레스기간 동안 상기 어드레스전극에 데이터를 공급하기 위한 데이터 구동회로와;
    상기 데이터에 동기되는 스캔펄스를 상기 스캔전극에 공급하기 위한 스캔 구동회로와;
    상기 서스테인기간 동안 상기 스캔전극과 상기 서스테인전극에 교대로 서스테인펄스를 공급하기 위한 서스테인 구동회로를 구비하는 것을 특징으로 하는 플라즈마 디스플레이 패널의 구동장치.
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