KR20040043199A - 트랜스폰더 및 집적 회로 - Google Patents

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KR20040043199A KR10-2004-7004936A KR20047004936A KR20040043199A KR 20040043199 A KR20040043199 A KR 20040043199A KR 20047004936 A KR20047004936 A KR 20047004936A KR 20040043199 A KR20040043199 A KR 20040043199A
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Abstract

트랜스폰더(1) 및 집적 회로(4)는 활성화 및 비활성화 가능하게 되도록 구성된 적어도 2개의 신호 처리 스테이지(25, 26, 27, 28, 29, 30, 31)를 구비한 적어도 하나의 신호 채널(5, 6, 7)을 가지며, 역시 활성화 및 비활성화 가능하게 되도록 구성된 바이패스 브랜치(32, 33, 34)가 각각의 활성화 및 비활성화 가능 신호 처리 스테이지(25, 26, 27)에 제공되고, 마이크로컴퓨터(36) 및 이 마이크로컴퓨터(36)에 의해 제어가능한 제어 레지스터(37)가 제공되며, 이를 통해서 각각의 활성화 및 비활성화 가능 신호 처리 스테이지(25, 26, 27) 및 관련 바이패스 브랜치(32, 33, 34)가 서로 반대로(in counterphase) 활성화 및 비활성화될 수 있다.

Description

트랜스폰더 및 집적 회로{TRANSPONDER WITH A CHANGEABLE CIRCUIT CONFIGURATION}
알려진 실시예에서, 트랜스폰더 또는 트랜스폰더의 집적 회로는 고정된 회로 구성을 가지고 있으며, 따라서 마련되어 있는 신호 처리 스테이지는 트랜스폰더의 전력 공급 수단, 즉 비충전식 전지에 의해서 전체 전력을 영구적으로 공급받아야 하고, 결과적으로 알려진 실시예에서 모드 신호 처리 스테이지는 모든 가능한 동작 상태에서 전력을 영구적으로 공급받되, 여기서 일부 동작 상태에서는 불필요하게 높은 에너지 소비를 유발한다. 이는 트랜스폰더의 혹은 집적 회로의 전력 공급이비충전식 전지에 의해 이루어지는 경우, 불필요하게 높은 에너지 소비에 의해서, 비충전식 전지의 사용 기간에 악영향을 미치기 때문에, 즉 사용 기간을 단축시키기 때문에 특히 불리하다.
본 발명은 송신 수단 및 이 송신 수단의 출력단에 접속된 적어도 2개의 신호 처리 스테이지를 구비한 적어도 하나의 신호 채널을 가진 트랜스폰더에 관한 것이다.
본 발명은 또한 송신 수단 및 이 송신 수단의 출력단에 접속된 적어도 2개의 신호 처리 스테이지를 구비한 적어도 하나의 신호 채널을 가진 트랜스폰더용 집적 회로에 관한 것이다.
본 발명은 도면에 도시된 실시예를 참조로 더 설명될 것이지만, 본 발명이이 도면에 한정되는 것은 아니다.
도 1은 본 발명에 따른 트랜스폰더 중 현 상황에서 필수적인 부품을 블록도의 형태로 도시하는 도면,
도 2는 도 1의 트랜스폰더 중 현 상황에서 중요한 회로의 세부 사항을 도시하는 도면.
본 발명의 목적은 위의 문제점을 제거해서 개선된 트랜스폰더 및 개선된 집적 회로를 구현하는 것이다.
위의 목적을 달성하기 위해서, 본 발명에 따라서 개선된 특성이 본 발명에 따른 트랜스폰더에 제공되며, 이로써 본 발명에 따른 트랜스폰더는 다음과 같은 특징을 가질 수 있다.
송신 수단 및 이 송신 수단의 출력단에 접속된 적어도 2개의 신호 처리 스테이지를 구비한 적어도 하나의 신호 채널을 가진 트랜스폰더로서, 적어도 하나의 신호 처리 스테이지는 활성화 및 비활성화 가능하게 되도록 구성되되, 각각의 활성화 및 비활성화 가능 신호 처리 스테이지에는 관련 신호 처리 스테이지를 바이패스시키는 관련 바이패스 브랜치가 제공되며, 이 바이패스 브랜치도 활성화 및 비활성화 가능하게 되도록 구성되고, 적어도 하나의 활성화 및 비활성화 가능 신호 처리 스테이지 및 적어도 하나의 관련 활성화 및 비활성화 가능 바이패스 브랜치가 활성화 및 비활성화 가능하게 되도록 하는 제어 수단이 제공되며, 제어 수단, 적어도 하나의 활성화 및 비활성화 가능 신호 처리 스테이지 및 적어도 하나의 관련 활성화 및 비활성화 가능 바이패스 브랜치는 활성화 및 비활성화 가능 신호 처리 스테이지의비활성화 시에, 이 신호 처리 스테이지와 관련된 바이패스 브랜치의 활성화가 동시에 일어나고, 신호 처리 스테이지의 활성화 시에, 이 신호 처리 스테이지와 관련된 바이패스 브랜치의 비활성화가 동시에 일어나도록 구성된다.
위의 목적을 달성하기 위해서, 본 발명에 따라서 개선된 특성이 본 발명에 따른 트랜스폰더에 제공되며, 이로써 본 발명에 따른 집적 회로는 다음과 같은 특징을 가질 수 있다.
송신 수단 및 이 송신 수단의 출력단에 접속된 적어도 2개의 신호 처리 스테이지를 구비한 적어도 하나의 신호 채널을 가진 집적 회로로서, 적어도 하나의 신호 처리 스테이지는 활성화 및 비활성화 가능하게 되도록 구성되되, 각각의 활성화 및 비활성화 가능 신호 처리 스테이지에는 관련 신호 처리 스테이지를 바이패스시키는 관련 바이패스 브랜치가 제공되며, 이 바이패스 브랜치도 활성화 및 비활성화 가능하게 되도록 구성되고, 적어도 하나의 활성화 및 비활성화 가능 신호 처리 스테이지 및 적어도 하나의 관련 활성화 및 비활성화 가능 바이패스 브랜치가 활성화 및 비활성화 가능하게 되도록 하는 제어 수단이 제공되며, 제어 수단, 적어도 하나의 활성화 및 비활성화 가능 신호 처리 스테이지 및 적어도 하나의 관련 활성화 및 비활성화 가능 바이패스 브랜치는, 활성화 및 비활성화 가능 신호 처리 스테이지의 비활성화 시에 이 신호 처리 스테이지와 관련된 바이패스 브랜치의 활성화가 동시에 일어나고, 신호 처리 스테이지의 활성화 시에 이 신호 처리 스테이지와 관련된 바이패스 브랜치의 비활성화가 동시에 일어나도록 구성된다.
본 발명에 따른 특징을 제공함으로써, 모든 활성화 및 비활성화 가능 신호처리 스테이지 중에서 이들 신호 처리 스테이지만이 활성화되고, 따라서 본 발명에 따른 트랜스폰더 및 본 발명에 따른 집적 회로를 사용해서 구현할 수 있는 모든 동작 상태 중에서 현재 획득 중인 동작 상태에 대해 요구되는 에너지 소모품으로 제조될 가능성을 비교적 간단한 방식으로, 상세하게는 집적 기술을 사용해서 많은 추가 비용 없이 만들 수 있다. 따라서, 동작 조건에 불필요한 신호 처리 스테이지는 비활성화된 신호 처리 스테이지가 에너지를 소비하지 않도록 유지되거나 비활성화되어서 감소된 에너지 소비가 보장될 수 있고, 이는 최저 가능 에너지 요구라는 점에서 유익하다. 최저 가능 에너지 요구를 실현하기 위한 바램은 에너지가 비접촉식으로 송신되는 신호를 통해서 트랜스폰더에 공급되고, 정류 수단을 통해서 정류되는 이른바 수동 트랜스폰더의 경우와, 에너지가 비충전식 전지를 통해서 공급되는 이른바 능동 트랜스폰더의 경우 모두에 제공된다.
본 발명에 따른 트랜스폰더 또는 본 발명에 따른 집적 회로의 신호 처리 스테이지 및 바이패스 브랜치의 활성화 및 비활성화는 예컨대, 집적 회로 또는 트랜스폰더의 제조시에, 신호 처리 스테이지 및 바이패스 브랜치의 활성화 및 비활성화가 완료된 것을 바탕으로 구현될 수 있으며, 제조 후에 고정된 회로 구성이 제공된다. 그러나, 신호 처리 스테이지 및 바이패스 브랜치의 활성화 및 비활성화가 프로그래밍 가능 방식으로 수행될 수 있는 경우에, 이러한 프로그래밍 가능 활성화 및 비활성화를 수행할 수 있는 것이 바람직하다는 것도 입증되었으며, 여기서 예컨대, 본 발명에 따른 트랜스폰더와 통신하기 위해 제공되는 통신 스테이션은 트랜스폰더에 커맨드를 송신하고, 트랜스폰더에서 이 커맨드를 평가하고, 결론적으로 신호 처리 스테이지 및 바이패스 브랜치의 활성화 또는 비활성화가 이루어져서, 신호 구성의 변화를 일으킨다.
본 발명에 따른 트랜스폰더 또는 본 발명에 따른 집적 회로에서, 신호 처리 스테이지는 필터 스테이지, 디코딩 스테이지 또는 신호 생성 스테이지로 이루어질 수 있다. 그러나, 활성화 및 비활성화 가능 신호 처리 스테이지의 적어도 일부가 증폭기 스테이지로 이루어지는 경우 본 발명에 따른 특성이 특히 유익하다는 것이 입증되었다. 이에 대해, 예컨대 송신 수단에 광역 송신 코일을 구비해서 높은 수신 감도를 가진 트랜스폰더에서, 하나 이상의 증폭기 스테이지를 비활성화시키는 것이 유익하다고 할 수 있으며, 이는 이런 경우에 더 적은 수의 즉, 최소 하나의 증폭기 스테이지를 사용해서 구현할 수 있으며, 따라서 에너지를 공급할 증폭기 스테이지의 수가 적으므로 적은 에너지 소비로 구현 가능하기 때문이다. 또한 이에 대해서, 트랜스폰더가 통신 스테이션에 근접한 거리에서만 항상 동작하고, 결론적으로는 이 근접한 거리로 인해서 비교적 높은 입력 신호를 수신할 수 있도록 충분히 작은 동작 거리를 가진 본 발명에 따른 트랜스폰더에서, 트랜스폰더의 에너지 소비를 가능한 한 작게 유지하기 위해서 하나 이상의 증폭기 스테이지를 비활성화시키는 것이 바람직하다. 이에 대해서, 본 발명에 따른 트랜스폰더에서 수신되는 신호의 진폭의 함수에 따라서, 적어도 하나의 증폭기 스테이지가 비활성화될 수 있으며 예컨대, 수신된 신호가 높은 진폭을 가지는 경우에 다중 증폭이 불필요하기 때문에 높은 진폭의 신호가 수신되는 경우 적어도 하나의 증폭기 스테이지가 비활성화될 수 있다고 할 수 있다.
청구항 3 및 4에 개시된 특성 및 청구항 7 및 8에 개시된 특성이 본 발명에 따른 트랜스폰더 및 본 발명에 따른 집적 회로에 제공되면 특히 유익하다는 것이 입증되었다. 이러한 구성은 신호 처리 스테이지 및 바이패스 브랜치의 활성화 및 비활성화를 수행할 수 있는 가능한 방식을 가장 다양하게 한다는 점에서 특히 바람직하다는 것이 입증되었다. 본 발명에 따른 트랜스폰더 및 본 발명에 따른 집적 회로에 타이밍 수단을 제공하는 것은 이러한 추가 타이밍 수단이 예컨대, 며칠과 같은 미리 설정된 기간 동안, 트랜스폰더 또는 집적 회로를 사용하지 않았는지 검출해서, 실질적으로 극히 작은 에너지 소비만을 유발하는 대기 상태로 되도록 모든 신호 처리 스테이지를 비활성화시켜서 트랜스폰더 또는 집적 회로가 제어될 수 있다는 장점이 있다. 본 발명에 따른 트랜스폰더 또는 본 발명에 따른 집적 회로는 예컨대, 이를 위해 제공되는 별도의 웨이크 업 키를 작동시켜서 대기 상태 등으로부터 스위칭될 수 있다. 본 발명에 따른 트랜스폰더가 기본적으로 이른바 능동 트랜스폰더인 경우에, 예컨대 능동 트랜스폰더가 이른바 수동 트랜스폰더와 결합해서 능동 트랜스폰더를 웨이크 업하도록 웨이크 업 신호가 비접촉식으로 수동 트랜스폰더에 송신되는 것으로, 이러한 능동 트랜스폰더는 대기 상태에서 웨이크 업한다.
위에서 설명한 본 발명의 이러한 측면은 이하 설명되는 실시예로부터 자명할 것이며, 이는 실시예를 참조해서 설명될 것이다.
도 1은 트랜스폰더(1)를 도시하고 있다. 트랜스폰더(1)는 능동 트랜스폰더와 수동 트랜스폰더를 포함하는 결합형 트랜스폰더이다. 결합형 트랜스폰더(1) 중 능동 부분, 즉 능동 트랜스폰더만이 도 1에 도시되어 있다.
트랜스폰더(1)는 비충전식 전지(3)를 포함하는 전력 공급 수단(2)을 포함한다. 공급 전력(V)을 공급받아야 하는 능동 트랜스폰더(1)의 모든 회로 부품에 공급될 수 있는 공급 전력(V)은 전지(3)를 통해서 생성될 수 있으며, 전압 안정화 수단은 상세도에 도시되어 있지 않다.
트랜스폰더(1)는 집적 회로(4)도 포함한다.
트랜스폰더(1)는 3개의 신호 채널(5, 6, 7)을 구비하고 있다. 여기서는 제 1 신호 채널(5)의 회로 상세만이 개략적으로 도시된다. 2개의 다른 신호 채널(6, 7)은 제 1 신호 채널(5)과 같은 회로 구조를 가지고 있다.
3개의 신호 채널(5, 6, 7)은 각각 송신 수단(8, 9, 10)을 가지고 있다. 송신 수단(8, 9, 10) 각각은 전송 코일(11, 12, 13) 및 각각의 전송 코일(11, 12,13)에 병렬로 접속된 캐패시터(14, 15, 16)를 포함한다. 송신 수단(8, 9, 10) 각각은 집적 회로(4)의 2개의 단자들(17, 18 및 19, 20 및 21, 22)에 각각 접속된다.
3개의 신호 채널(5, 6, 7)의 다른 구조는 제 1 신호 채널(5)만을 참조해서 설명된다.
종종 리미터라고 불리는, 리미터 스테이지(23)는 2개의 단자(17, 18)에 접속된다. 신호 처리 회로(24')는 리미터 스테이지(23)의 출력단에 접속된다.
유사한 신호 처리 회로(24'', 24''')가 제 2 신호 채널(6) 및 제 3 신호 채널(7)에 각각 제공된다.
신호 처리 회로(24')는 7개의 직렬 접속된 신호 처리 스테이지를 포함한다. 이들 7개의 신호 처리 스테이지는 제 1 증폭기 스테이지(25), 제 2 증폭기 스테이지(26), 제 3 증폭기 스테이지(27), 복조기 스테이지(28), 제 4 증폭기 스테이지(29) 및 디코더 스테이지(31)를 구비한 제 5 증폭기 스테이지(30)이다. 5개의 증폭기 스테이지(25, 26, 27, 29, 30)는 각각 송신되어 오는 신호를 증폭하는 역할을 한다. 복조기 스테이지(28)는 제 1 송신 수단(8)을 통해서 수신되고 후속해서 증폭된 신호를 복조하는 역할을 한다. 디코더 스테이지(31)는 복조기 스테이지(28)로부터 송신되고 후속해서 증폭되는 신호를 디코딩하는 역할을 한다.
7개의 신호 처리 스테이지 중에서, 제 2, 제 3, 제 5 신호 처리 스테이지는, 즉 3개의 증폭기 스테이지(26, 27, 29)는 활성화 가능 또는 비활성화 가능하도록 구성되며, 이는 이하 더 상세하게 설명될 것이다. 각각의 증폭기 스테이지(26, 27, 29)와 관련된 바이패스 브랜치(32, 33, 34)가 각각의 활성화 및 비활성화 가능신호 처리 스테이지, 즉 3개의 증폭기 스테이지(26, 27, 29)에 제공된다. 이들 바이패스 브랜치(32, 33, 34) 각각은 관련 증폭기 스테이지(26, 27, 29)와 같이 활성화 가능 또는 비활성화 가능하도록 구성되며, 이는 이하 더 상세하게 설명될 것이다.
3개의 증폭기 스테이지(26, 27, 29)를 활성화 및 비활성화시키기 위해서, 그리고 관련 바이패스 브랜치(32, 33, 34)를 활성화 및 비활성화시키기 위해서, 제어 신호(CS2', CS3', CS4')가 각각 회로 지점(B', C', D')을 통해서 이들 회로 부품에 공급될 수 있으며, 이는 이하 더 상세하게 설명될 것이다.
이 경우, 전체 신호 처리 회로(24')는 추가적으로 활성화 및 비활성화 가능하게 되도록 구성된다. 전체 신호 처리 회로(24')를 활성화 및 비활성화 가능하게 하기 위해서, 제어 신호(CS1')가 회로 지점(A')에서 신호 처리 회로(24')에 공급될 수 있다.
복조기 스테이지(28) 및 디코더 스테이지(31)는 물론 제 1 증폭기 스테이지(25) 및 제 5 증폭기 스테이지(30)는 활성화 및 비활성화 가능하게 되도록 구성되지 않는다. 이들 스테이지의 활성화 및 비활성화 가능은 각각의 제어 신호(CS1', CS1'', CS1''')에 의해서 전체 신호 처리 회로(24', 24'', 24''')를 활성화 또는 비활성화시킴으로써만 가능하다.
트랜스폰더(1) 및 집적 회로(4)는, 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)를 활성화 및 비활성화 가능하게 하고, 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)를 활성화 및 비활성화 가능하게 하고, 전체 신호 처리 회로(24', 24'', 24''')를 활성화 및 비활성화 가능하게 하도록 구성되어 제공되는 제어 수단(35)을 더 포함한다. 이들 제어 수단(35)은 마이크로컴퓨터(36) 및 마이크로컴퓨터(36)에 의해 제어 가능한 제어 레지스터(37)를 포함하며, 이들은 제어 접속부(38)를 통해서 서로 접속되어 있다. 마이크로컴퓨터(36)는 다른 접속부(39)를 통해서 저장 수단(40)에 접속되며, 이 저장 수단(40)은 복수의 저장 유닛, 즉 RAM, ROM 및 EEPROM으로 이루어진다. 활성화 및 비활성화 가능 신호 처리 스테이지, 즉 증폭기 스테이지(26, 27, 29) 및 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)는 제어 레지스터(37)를 통해서 활성화 및 비활성화하도록 제어할 수 있다. 이를 위해서, 제어 레지스터(37)는 도 1에 U', U'', U''' 및 V', V'', V''' 및 X', X'', X''' 및 Y', Y'', Y''' 및 Z', Z'', Z'''로 표시된 복수의 제어 출력단을 가지고 있다. 이들 제어 출력단은 회로 지점(A', A'', A''' 및 B', B'', B''' 및 C', C'',C'''및 D', D'', D''' 및 E', E'', E''')에 접속된다. 3개의 회로 지점(E', E'', E''')은 다른 활성화 및 비활성화 가능 신호 처리 스테이지에 접속되지만, 이는 도시되어 있지는 않다.
제어 수단(35)은 또한 추가 타이밍 수단(41)을 포함하고 있으며, 이 타이밍 수단(41)은 타이밍 수단(41)에 신호를 전송하는 오실레이터(42)에 접속되고, 타이밍 수단(41)이 시간 정보를 마이크로컴퓨터(36)에 공급할 수 있도록 마이크로컴퓨터(36)에 접속된다. 마이크로컴퓨터(36)는 미리 설정된 기간의 만료를 등록하도록 구성된다. 또한, 마이크로컴퓨터(36)는 미리 설정된 기간의 만료를 등록한 후에 제어 레지스터(37)를 제어해서 제어 레지스터(37)가 모든 신호 처리 스테이지(25,26, 27, 28, 29, 30, 31)를 비활성화 상태로 스위칭하도록 구성되며, 이는 도 1의 트랜스폰더(1) 및 집적 회로(4)에서 간단한 방식으로 구현될 수 있고, 여기서 제어 레지스터(37)는 제어 출력단(U', U'', U''')을 통해서 3개의 신호 처리 회로 모두(24', 24'', 24''')를 비활성화 상태로 스위칭한다.
예컨대, 데이터 처리 수단 및 데이터 저장 수간과 같은 다른 신호 처리 수단이 트랜스폰더(1)의 신호 처리 회로(24', 24'', 24''')에 접속되어 있지만, 이러한 수단들이 제공되는 것을 일반적으로 알려져 있기 때문에 도 1에는 도시되지 않는다.
제 2 증폭기 스테이지(26) 및 제 2 증폭기 스테이지(26)와 관련된 바이패스 브랜치(32)가 각각 활성화 상태 및 비활성화 상태가 되도록 제어될 수 있는 방법이 도 2를 참조로 더 상세하게 설명될 것이다.
제 2 증폭기 스테이지(26)는 제 1 입력단(50), 제 2 입력단(51), 제 1 출력단(52), 제 2 출력단(53)을 구비하고 있다. 제 1 제어 가능 스위치(54)는 제 1 입력단(50)에 접속된다. 제 2 제어가능 스위치(55)는 제 2 입력단(51)에 접속되어 있다. 제 3 제어 가능 스위치(56)는 제 1 출력단(52)에 접속된다. 제 4 제어 가능 스위치(57)는 제 2 출력단(53)에 접속된다. 제 2 증폭기 스테이지(26)도 제 1 공급 전압 입력단(58) 및 제 2 공급 전압 입력단(59)을 구비하고 있다. 제 1 공급 전압 입력단(58)은 라인(60)을 통해서 공급 전압(V)에 접속될 수 있으며, 이 라인(60)에는 제 5 제어 가능 스위치(61)가 포함된다. 제 2 공급 전압 입력단(59)은 다른 라인(62)을 통해서 접지에 접속될 수 있고, 이 다른 라인(62)에는 제 6 제어 가능 스위치(63)가 포함된다.
제 2 증폭기 스테이지(26)와 관련된 바이패스 브랜치(32)는 2개의 바이패스 라인(64, 65)을 통해서 간단한 방식으로 구현되며, 제 1 바이패스 라인(64)에는 제 7 제어 가능 스위치(66)가 포함되고, 제 2 바이패스 라인(65)에는 제 8 제어 가능 스위치(67)가 포함된다.
도 2는 활성화 및 비활성화 가능 제 2 증폭기 스테이지(26)가 비활성화 상태로 스위칭되고, 제 2 증폭기 스테이지(26)와 관련된 바이패스 브랜치(32)가 활성화 상태로 스위칭된 상황을 도시하고 있으며, 이런 상황은 제 6 스위치(54, 55, 56, 57, 61, 63)가 비도전 상태이고, 2개의 스위치(66, 67)가 도전 상태라는 사실로 입증된다.
총 8개의 스위치는 회로 지점(B')으로, 특히 제어 수단(35)의 제어 레지스터(37)에 의해서 제어 출력단(V')으로부터 송신될 수 있는 제어 신호(CS2')를 통해서 제어된다. 이 때, 제어 신호(CS2')는 6개의 스위치(54, 55, 56, 57, 58, 59)에는 직접 송신되지만, 2개의 스위치(66, 67)에는 인버터 스테이지(68)를 거쳐서 송신된다. 이로써, 고 전위(H)로 이루어진 제어 신호(CS2')가 발생되면, 6개의 스위치(54, 55, 56, 57, 61, 63)는 닫히고, 2개의 다른 스위치(66, 67)는 열리게 된다. 제어 신호(CS2')가 중지되면, 즉 저 전위(L)가 회로 지점(B')에서 발생되면, 6개의 스위치(54, 55, 56, 57, 61, 63)는 비도전 상태로 스위칭될 것이고, 2개의 다른 스위치(66, 67)는 도전 상태로 스위칭될 것이며, 이는 도 2에 도시되어 있다.
제 3 증폭기 스테이지(27)와 제 4 증폭기 스테이지(29) 및 2개의 바이패스 브랜치(32, 34)는 동일한 방식으로 정확하게 제어될 수 있다. 신호 처리 회로(24', 24'', 24''')는 아날로그 방식으로 제어된다.
위의 설명에서 자명한 바와 같이, 제어 수단(35), 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29), 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)가 트랜스폰더(1) 및 집적 회로(4)에 구성되어서, 이들 신호 처리 스테이지(26, 27, 29) 중 하나가 비활성화되면, 동시에 신호 처리 스테이지(26, 27, 29)와 관련된 바이패스 브랜치(32, 33, 34)는 활성화되고, 이들 신호 처리 스테이지(26, 27, 29) 중 하나가 활성화되면, 동시에 신호 처리 스테이지(26, 27, 29)와 관련된 바이패스 브랜치(32, 33, 34)는 비활성화된다.
도 1에 따른 트랜스폰더(1)에서, 제어 수단(35)에 의해서 선택적인 구성 설비가 제공되어서, 트랜스폰더(1)가 언제라도 동작 상태가 존재하도록 최적으로 구성될 수 있다는 이점을 제공하며, 어떤 경우든 최적화, 즉 선택적인 구성 설비를 통한 최저 가능 에너지 소비를 달성할 수 있다. 활성화 및 비활성화 가능 증폭기 스테이지의 선택적인 활성화 및 비활성화를 통해서 트랜스폰더(1)에서의 최고 수신 감도와 최저 가능 에너지 소비 사이의 최적의 절충안을 만들 수 있다.
위에서 설명한 도 1에 따른 트랜스폰더(1)에서, 하나의 신호 채널 내의 모든 신호 처리 스테이지는 직렬로 접속된다. 이는, 신호 처리 스테이지가 병렬로 접속되고, 그 중 적어도 하나가 활성화 및 비활성화되는 구현도 본 발명에 따른 트랜스폰더에 가능하기 때문에 절대적인 것은 아니다.
도 1의 트랜스폰더(1) 중 능동 트랜스폰더에 대해서, 모든 신호 처리 채널(5, 6, 7)이 항상 능동 트랜스폰더에 사용되어야 하는 것이 아니라, 예컨대 하나의 신호 채널만을 사용하고, 다른 2개의 신호 채널은 관련 신호 처리 회로(24', 24'', 24''')의 비활성화에 의해 비활성화되는 동작 상태도 가능하다는 점에 주의해야 한다. 이 경우, 소비되는 에너지의 현저한 감소 및 그에 따른 비충전식 전지(3)의 더 긴 사용시간이 보장된다.
능동 트랜스폰더만이 도시된 도 1을 참조로 설명된 트랜스폰더(1)에서, 비충전식 전지(3)만이 전원으로 도시되어 있다. 트랜스폰더(1)는 추가적으로 전송되어 오는 신호로부터 전원이 획득되는 수동 트랜스폰더를 포함할 수 있으며, 이 신호는 정류기 수단에 의해 정류되고, 정류를 통해서 획득된 공급 전원은 기본적으로 수동 트랜스폰더용 전원 공급 수단을 구성하는 저장 캐패시터에 저장된다.

Claims (8)

  1. 적어도 하나의 신호 채널(5, 6, 7)을 가진 트랜스폰더(1)에 있어서,
    상기 신호 채널(5, 6, 7)은 송신 수단(8, 9, 10) 및 상기 송신 수단(8, 9, 10)의 출력단에 접속된 적어도 2개의 신호 처리 스테이지(25, 26, 27, 28, 29, 30, 31)를 구비하되,
    적어도 하나의 신호 처리 스테이지(26, 27, 29)는 활성화 및 비활성화 가능하게 되도록 구성되고, 각각의 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)에는 관련 신호 처리 스테이지(26, 27, 29)를 바이패스시키는 관련 바이패스 브랜치(32, 33, 34) - 상기 바이패스 브랜치(32, 33, 34)도 활성화 및 비활성화 가능하게 되도록 구성됨 - 가 제공되며,
    상기 적어도 하나의 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)와 적어도 하나의 관련 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)가 활성화 및 비활성화 가능하게 되도록 하는 제어 수단(35)이 제공되며,
    상기 제어 수단(35), 상기 적어도 하나의 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29) 및 상기 적어도 하나의 관련 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)는, 상기 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)가 비활성화되면, 동시에 상기 신호 처리 스테이지(26, 27, 29)와 관련된 상기 바이패스 브랜치(32, 33, 34)가 활성화되고, 상기 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)가 활성화되면, 동시에 상기 신호 처리 스테이지(26, 27, 29)와 관련된 상기 바이패스 브랜치(32, 33, 34)가 비활성화되도록 구성되는
    트랜스폰더(1).
  2. 제 1 항에 있어서,
    상기 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29) 중 적어도 일부는 증폭기 스테이지로 이루어지는
    트랜스폰더(1).
  3. 제 1 항에 있어서,
    상기 제어 수단(35)은 마이크로컴퓨터(36) 및 상기 마이크로컴퓨터(36)에 의해 제어 가능한 제어 레지스터(37)를 포함하며,
    상기 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29) 및 상기 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)는 상기 제어 레지스터(37)에 의해서 활성화 상태 및 비활성화 상태로 제어될 수 있는
    트랜스폰더(1).
  4. 제 3 항에 있어서,
    상기 제어 수단(35)은 상기 마이크로컴퓨터(36)에 접속된 타이밍 수단(41)을 더 구비하고,
    상기 마이크로컴퓨터(36)는 미리 설정된 기간의 만료를 등록하도록 구성되며, 상기 미리 설정된 기간의 만료를 등록한 후에 상기 제어 레지스터(37)를 제어해서 상기 제어 레지스터(37)가 모든 신호 처리 스테이지(25, 26, 27, 28, 29, 30, 31)를 비활성화 상태로 스위칭하게 하도록 구성되는
    트랜스폰더(1).
  5. 트랜스폰더(1)용 집적 회로(4)에 있어서,
    송신 수단(8, 9, 10) 및 상기 송신 수단(8, 9, 10)의 출력단에 접속된 적어도 2개의 신호 처리 스테이지(25, 26, 27, 28, 29, 30, 31)를 구비한 적어도 하나의 신호 채널(5, 6, 7)을 포함하되,
    적어도 하나의 신호 처리 스테이지(26, 27, 29)는 활성화 및 비활성화 가능하게 되도록 구성되고, 각각의 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)에는 관련 신호 처리 스테이지(26, 27, 29)를 바이패스시키는 관련 바이패스 브랜치(32, 33, 34) - 상기 바이패스 브랜치(32, 33, 34)도 활성화 및 비활성화 가능하게 되도록 구성됨 - 가 제공되며,
    상기 적어도 하나의 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)와 적어도 하나의 관련 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)가 활성화 및 비활성화 가능하게 되도록 하는 제어 수단(35)이 제공되며,
    상기 제어 수단(35), 상기 적어도 하나의 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29) 및 상기 적어도 하나의 관련 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)는, 상기 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)가 비활성화되면, 동시에 상기 신호 처리 스테이지(26, 27, 29)와 관련된 상기 바이패스 브랜치(32, 33, 34)가 활성화되고, 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29)가 활성화되면, 동시에 상기 신호 처리 스테이지(26, 27, 29)와 관련된 상기 바이패스 브랜치(32, 33, 34)가 비활성화되도록 구성되는
    집적 회로(4).
  6. 제 5 항에 있어서,
    상기 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29) 중 적어도 일부는 증폭기 스테이지로 이루어지는
    집적 회로(4).
  7. 제 5 항에 있어서,
    상기 제어 수단(35)은 마이크로컴퓨터(36) 및 상기 마이크로컴퓨터(36)에 의해 제어 가능한 제어 레지스터(37)를 포함하며,
    상기 활성화 및 비활성화 가능 신호 처리 스테이지(26, 27, 29) 및 상기 활성화 및 비활성화 가능 바이패스 브랜치(32, 33, 34)는 상기 제어 레지스터(37)에 의해서 활성화 상태 및 비활성화 상태로 제어될 수 있는
    집적 회로(4).
  8. 제 7 항에 있어서,
    상기 제어 수단(35)은 상기 마이크로컴퓨터(36)에 접속된 타이밍 수단(41)을 더 구비하고,
    상기 마이크로컴퓨터(36)는 미리 설정된 기간의 만료를 등록하도록 구성되며, 상기 미리 설정된 기간의 만료를 등록한 후에 상기 제어 레지스터(37)를 제어해서 상기 제어 레지스터(37)가 모든 신호 처리 스테이지(25, 26, 27, 28, 29, 30, 31)를 비활성화 상태로 스위칭하게 하도록 구성되는
    집적 회로(4).
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