KR20020078778A - 3지피피 비동기 시스템에서 세컨드 인터리빙을 위한변조장치 - Google Patents

3지피피 비동기 시스템에서 세컨드 인터리빙을 위한변조장치 Download PDF

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KR20020078778A
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Abstract

본 발명은 W-CDMA 비동기 시스템에서 2nd 인터리빙을 위한 변조 장치를 제공하여, 다채널 기지국 모뎀에서 다중-레이트(Multi-Rate) 서비스 및 여러 물리 채널을 동시에 지원할 수 있도록 한 3GPP 비동기 시스템에서 2nd 인터리빙을 위한 변조장치에 관한 것으로서, 이러한 본 발명은, 세컨드 인터리빙 및 물리 채널 매핑에 필요한 메모리를 제공하고, 상기 코덱과 후단의 변조부 사이의 인터페이스를 제공하는 세컨드 인터리브 메모리부와; 물리 채널 매핑 기능을 수행하며, W-CDMA의 기반 동작인 직접확산(DS) 기능을 수행하고, QPSK 변조를 수행하는 복수개의 변조기로 이루어진 변조부와; 3GPP에서 규정하는 공통 순방향 링크 물리 채널들의 변조를 수행하는 비-트랜스포트 채널 변조기와; 상기 변조부 및 비-트랜스포트 채널 변조기에서 생성된 신호를 정해진 섹터에 따라 그 출력신호를 만들어 상기 프론트 앤드 인터페이스부로 전달하는 섹터 컨트롤러로 변조장치를 구현한다.

Description

3지피피 비동기 시스템에서 세컨드 인터리빙을 위한 변조장치{Modulator for 2nd interleaving in 3GPP asynchronous system}
본 발명은 3GPP 비동기 W-CDMA(Wideband-Code Division Multiple Access) 시스템에서 2nd 인터리빙을 위한 변조장치(Demodulator)에 관한 것으로서, 특히 다채널 기지국 모뎀에서 다중-레이트(Multi-Rate) 서비스 및 여러 물리 채널을 동시에 지원할 수 있도록 한 3GPP 비동기 시스템에서 2nd 인터리빙을 위한 변조장치에 관한 것이다.
일반적으로 3GPP 비동기 W-CDMA의 시스템은, 무선접속 방식으로 W-CDMA 방식을사용하고, 네트웍 구조는 3GPP를 수용한다.
비동기 시스템의 기본 구성요소는 단말기(UE), 기지국(BTS 또는 Node B), 제어국 (RNC) 및 코아 네트웍(CN)으로 구성된다. 각 구성 장치간 인터페이스는 단말(UE)과 기지국(Node B)간은 Uu, 기지국과 제어국(RNC)간은 Iub, 제어국과 제어국간은 Iur, 제어국과 코아 네트웍(CN)간은 Iu인터페이스로 ,3GPP 규격으로 정의한다. 각종 인터페이스로 정합되는 액세스 네트웍의 구성은 트리구조이다. 가장 규모가 큰 UTRA(UMTS Terrestrial Radio Access)은 UE(단말기)와 UTRAN(기지국)으로 구성된다. UE는 소형 PC 등과 접속되어 인터넷, 영상, 이미지 등의 다양한 응용 서비스를 제공한다. UTRAN은 여러 RNS(Radio Network Subsystem)로 구성되어 핸드오버,마크로 다이버시티 및 셀 레벨의 이동을 비롯하여 무선 액세스에 필요한 모든 신호 제어 기능을 담당한다. RNS는 RNC(Radio Network Controller)와 Node B로 구성하고, Node B는 다시 여러 셀과 이를 제어하는 셀 제어부로 세분되며, 단말 모뎀과 통신하여 무선 전송 서비스를 제공한다. Node B의 기능은 채널 다중화 기능, 정보 부호화, PN 확산 및 기저대역 여파기능, 변조기 출력의 결합 기능, W-CDMA신호에 대한 초기 동기 획득 및 유지 기능 등의 모뎀 기능을 수행하며, 부차적으로 Node B의 초기화 및 시스템 클럭 생성 분배 기능, 시스템 정보 방송 기능 및 Node B의 운용 및 유지보수 기능을 가질 수 있다.
3GPP W-CDMA 물리계층(L1) 처리 절차는 도2와 같으며, 단계별로 3GPP 규격에 정의된 관련 동작을 수행한다.
도 2는 일반적인 기지국 모뎀의 전체적인 기능을 나타낸 것이며, 실제 모뎀은 변조(S1 ---> S13 순서) 및 복조(S13 --> S1 순서)의 처리를 수행하는 일련의 기능 및 동작 수행을 통칭한 말이다.
첨부한 도면 도 1은 일반적인 3GPP W-CDMA 비동기 시스템내의 모뎀 구성을 보인 도면이다.
여기서 참조부호 10은 제어 및 외부 인터페이스부로서, 전체 모뎀의 동작 제어, 관련 레지스터 및 기타 자원들을 관리하는 기능을 수행하며, 클럭 제공 기능과 다른 보드나 블록과의 인터페이스 즉, 상위 계층(L2/L3)과의 인터페이스도 지원한다.
참조부호 20은 코덱(CODEC)으로서, 상위 계층으로부터 전송되고 상기 제어및 외부 인터페이스부(10)를 통해 수신한 하나 혹은 여러 개의 트랜스포트 채널(3GPP의 경우 한 사용자가 여러 TrCH을 가질 수 있으며(이 경우 하나의 CCTrCH생성), 그런 사용자가 여러 명이 동시에 존재(사용자 각각이 한 CCTrCH을 가짐)) 및 제어 정보를 3GPP 규격에 따라 도 2의 단계 S1에서 단계 S12까지(Encoding)를 수행하거나, 그 반대로 도 2의 단계 S12에서 단계 S1까지(Decoding)를 수행하는 역할을 한다.
즉, 인코딩 동작은 도 2와 같이, CRC attachment(S1), transport block concatenation/code block segmentation(S2), channel coding(S3), rate matching(S4), 1st dtx insertion(S5), 1st interleaving(S6), radio frame segmentation(S7), transport channel Multiplexing(S8), 2nd dtx insertion(S9), physical channel segmentation(S10)으로 이루어진다. 그리고 TrCH 인코딩이 완료된 물리 채널을 두 번째 인터리빙(S11)하고, 2번째 인터리브 메모리에 매핑하는 단계(S12)를 수행하여 변조한다.
또한 인코딩 과정에 관련된 TFCI 코드를 생성하여 변조기(30)로 전송하는 기능을 한다. 이 모듈에서 인코딩 및 디코딩 되어지는 트랜스포트 채널은 데디케이티드 채널(DCH)과 공통 채널(BCH, FACH,PCH, DSCH)이 있으며, 채널의 종류에 따라 인코딩하여 CCTrCH로 다중화한 후 물리 채널로 변환한다.
물리 채널은 데디케이티드 물리 채널(DPDCH, DPCCH)과 공통 물리 채널(CPICH, P-CCPCH, S-CCPCH, SCH, PDSCH, AICH, AP-AICH, CD/CA-ICH, PICH, CSICH)이 있으며, 코덱은 변조기(30)로 물리 채널을 전송할 때 각 채널의 타이밍오프셋을 표시하여 지정된 시작에 따라 전송하게 한다. 트랜스포트 채널과 물리 채널의 매핑 및 인코딩 관계는 규격에 따른다.
다음으로 참조부호 30은 상기 변조기로서, 2번째 인터리브 메모리를 통해 전달된 관련 물리 채널들의 데이터 및 TFCI 신호, 그리고 복조기(40)에서 제공하는 TPC 및 전력 제어 정보를 기반으로 규격에 따른 확산 및 변조(도 2의 S13)를 통해 펄스 성형 필터의 입력으로 제공될 신호를 무선 프레임 단위로 생성하고, 후단의 프론트 앤드 인터페이스(Front End Interface : FEI)부(50)로 전달하는 역할을 수행한다.
또한, 참조부호 40은 복조기로서, 상기 변조기(30)의 역방향 동작(도2의 S13 --> S1)을 수행하는 기능 블록으로 상기 프론트 앤드 인터페이스부(50)로부터 받은 신호로부터 초기 동기를 획득하고, 역 확산하여 데이터를 복조하며, 또 복조된 데이터를 상위 계층으로 전달하는 역할을 수행한다.
다음으로 상기 프론트 앤드 인터페이스부(50)는, 기저대역 데이터를 아날로그 정합 장치에 전달하며, RF 및 아날로그 단으로부터 수신된 신호를 상기 복조기(40)로 전달하는 기능을 수행한다.
그러나 상기와 같은 일반적인 W-CDMA 비동기 시스템에서, 변조기의 기능은 제안되었으나, 그것의 구체적인 하드웨어 및 소프트웨어는 현재 개발 중에 있다.
따라서 본 발명은 W-CDMA 비동기 시스템에서 2nd 인터리빙을 위한 변조 장치를 제공하여, 다채널 기지국 모뎀에서 다중-레이트(Multi-Rate) 서비스 및 여러 물리 채널을 동시에 지원할 수 있도록 한 3GPP 비동기 시스템에서 2nd 인터리빙을 위한 변조장치를 제공하는 데 그 목적이 있다.
상기와 같은 목적을 달성하기 위한 본 발명은,
코덱 및 프론트 앤드 인터페이스부를 구비한 3GPP 비동기 시스템에서 2nd 인터리빙을 위한 변조장치에 있어서,
세컨드 인터리빙 및 물리 채널 매핑에 필요한 메모리를 제공하고, 상기 코덱과 후단의 변조부 사이의 인터페이스를 제공하는 세컨드 인터리브 메모리부와;
물리 채널 매핑 기능을 수행하며, W-CDMA의 기반 동작인 직접확산(DS) 기능을 수행하고, QPSK 변조를 수행하는 복수개의 변조기로 이루어진 변조부와;
3GPP에서 규정하는 공통 순방향 링크 물리 채널들의 변조를 수행하는 비-트랜스포트 채널 변조기와;
상기 변조부 및 비-트랜스포트 채널 변조기에서 생성된 신호를 정해진 섹터에 따라 그 출력신호를 만들어 상기 프론트 앤드 인터페이스부로 전달하는 섹터 컨트롤러를 포함하여 구성됨을 특징으로 한다.
도 1은 일반적인 3GPP W-CDMA 비동기 시스템내의 모뎀 구성을 보인 도면이고,
도 2는 도 1의 모뎀내 변조기의 변조 동작을 보인 흐름도이고,
도 3은 본 발명에 의한 3GPP 비동기 시스템에서 2nd 인터리빙을 위한 변조장치의 구성도이고,
도 4는 도 3의 2nd 인터리브 메모리부 및 변조부의 내부 구성도이고,
도 5는 도 4의 2nd 인터리브 메모리부의 일 실시예를 보인 구성도이고,
도 6a ~ 도 6b는 본 발명에서 2nd 인터리브 메모리 분할 및 할당 과정을 설명하기 위한 설명도이다.
<도면의 주요 부분에 대한 부호의 설명>
300 ..... 변조장치
400 ..... 세컨드 인터리브 메모리부
500 ..... 변조부
600 ..... 섹터 컨트롤러
700 ..... 비-트랜스포트 채널 변조기
이하 상기와 같은 기술적 사상에 따른 본 발명의 바람직한 실시예를 첨부한 도면에 의거 상세히 설명한다.
먼저 본 발명에 의한 3GPP 비동기 시스템에서 2nd 인터리빙을 위한 변조장치구현을 위한 소정의 사항을 정의하면 다음과 같다.
1) 본 발명에 적용되는 세컨드 인터리브 메모리의 크기는 한 Tr-PhCH 변조기에서 처리해야 할 최대 데이터 양을 기준으로 하며, 멀티-코드 지원 구조에 적용시엔 본 발명에서 기준으로 하는 메모리의 배수로 적용하면 가능하다.
2) 코덱에서 세컨드 인터리브 메모리에 전달하는 데이터는 DTX 비트를 포함하므로 한 심벌이 2비트로 구성된다.
3) 세컨드 인터리빙 알고리즘이 30행을 기반으로 동작하므로 1워드를 32비트가 아닌 30비트로 구성한다. 한 Tr-PhCH 변조기에서 처리해야 할 최대 데이터 양은 SF=4인 경우, 무선 프레임 당 19200(데이터 : 18720, 제어 : 480) 심벌이므로, 세컨드 인터리브 메모리 크기는 37440 비트가 필요하다. 한 워드에 15심벌(2비트)이 포함되므로 필요한 세컨드 인터리브 메모리의 크기는 1248워드(30비트)가 된다.
4) 세컨드 인터리브 메모리를 공유하는 Tr-PhCH 변조기수(사용자수)는 SF=4인 경우 1명(최소)이며, SF=128인 경우 32명(최대)이다.
5) 코덱과 변조기가 서로 영향을 주지 않고 세컨드 인터리브 메모리를 액세스할 수 있어야 하므로 세컨드 인터리브 메모리에 이중 포트 메모리를 채택한다. 각 채널은 무선 프레임의 경계가 서로 다를 수 있으므로 시분할 액세스 등의 방법이 용이치 않다. 따라서 코덱은 세컨드 인터리브 메모리에 쓰기 동작만을 하며, 변조기의 각 채널은 세컨드 인터리브 메모리를 읽는 동작만을 한다.
6) 변조기가 낮은 데이터를 요구하는 채널의 경우, 최대로 많은 변조기를 지원할 수 있어야 하므로, 세컨드 인터리브 메모리를 논리적으로 일정 워드 크기로분할할 수 있도록 구성하고, 데이터 양에 따라 하나 이상의 연속된 세그먼트를 할당할 수 있다.
7) 메모리 컨트롤러는 세컨드 인터리브 메모리를 공유하고자 하는 변조기 각각이 생성한 메모리의 읽기 주소 및 제어 신호를 순차적으로 나열하고, 출력되는 메모리의 데이터를 병렬화하여 변조기 각각이 독립적으로 메모리를 읽을 수 있도록 한다.
이러한 요구사항을 정의한 상태에서, 이하 본 발명의 바람직한 실시예를 설명한다.
첨부한 도면 도 3은 본 발명에 의한 3지피피 비동기 시스템에서 2nd 인터리빙을 위한 변조장치의 구성도이다.
여기서 참조부호 100은 일반적인 모뎀에 구비되는 코덱을 나타내며, 참조부호 200은 프론트 앤드 인터페이스부를 나타내고, 참조부호 300은 본 발명에 의한 변조장치를 나타낸다.
여기서 코덱(100)과 프론트 앤드 인터페이스부(200)는, 주지한 도 1의 코덱(10) 및 프론트 앤드 인터페이스부(50)의 구성 및 동작과 동일하다.
다음으로 상기 변조장치(300)는, 세컨드 인터리빙 및 물리 채널 매핑에 필요한 메모리를 제공하고, 상기 코덱(100)과 후단의 변조부(500) 사이의 인터페이스를 제공하는 세컨드 인터리브 메모리부(400)와, 물리 채널 매핑 기능을 수행하며, W-CDMA의 기반 동작인 직접확산(DS) 기능을 수행하고, QPSK 변조를 수행하는 복수개의 변조기(510 ~ 510-N)로 이루어진 변조부(500)와, CPICH, SCH, AICH, AP-AI/CSICH, CD/CA-ICH, PICH 등의 3GPP에서 규정하는 공통 순방향 링크 물리 채널들의 변조를 수행하는 비-트랜스포트 채널 변조기(700)와, 상기 변조부(500) 및 비-트랜스포트 채널 변조기(700)에서 생성된 신호를 정해진 섹터에 따라 그 출력신호를 만들어 상기 프론트 앤드 인터페이스부(200)로 전달하는 섹터 컨트롤러(600)로 구성된다.
이와 같이 구성된 본 발명에 의한 3지피피 비동기 시스템에서 2nd 인터리빙을 위한 변조장치를 첨부한 도면 도4 내지 도6을 참조하여 상세히 설명하면 다음과 같다.
먼저 세컨드 인터리브 메모리부(400)는 도 4에 도시된 바와 같이, 크게 세컨드 인터리버 메모리(410)와, 메모리 컨트롤러(420)와, 코덱 인터페이스기(430)로 구성된다.
상기 세컨드 인터리버 메모리(410)는, 세컨드 인터리빙, 물리 채널 매핑, 변조 및 확산 과정에서 필요한 메모리 자원을 제공한다. 메모리의 구성은 구현하고자 하는 트랜스포트 물리 채널의 변조기 사양에 따라 결정한다. 3GPP 규격에서 정의한 물리 채널의 최대 데이터 레이트(사용자 : 384Kbps)를 기준으로 한 경우 한 트랜스포트 물리 채널 변조기에서 처리해야 할 최대 데이터 양은 무선 프레임 당 19200비트이고, 일반적인 DTX를 고려 할 경우 데이터 비트당 2비트가 그리고 판독 및 기록 동시 수행을 위해 2중의 액세스 구조가 필요하므로, 세컨드 인터리브 메모리는 19200*4(비트)가 필요하다. 또한 3GPP 규격의 세컨드 인터리빙 알고리즘이 30행을 기반으로 동작하므로, 30비트의 대역폭을 갖게 되어, 실제 2432*32비트(1216*32비트의 2뱅크 구조) 크기를 갖는 메모리가 된다. 멀티-코드의 경우 최대 6채널이 운영될 수 있으므로, 6배의 메모리가 지원되어야 한다.
여기서 세컨드 인터리버 메모리(410)의 라이트(wRITE)는 코덱에서 수행하며, 두 뱅크(411)(412)에 교차하여 라이트하여 리드와 라이트의 마진을 확보한다. 또한 상기 코덱은 세컨드 인터리빙을 처리하여 출력 순서로 라이트한다. 리드 동작은 코덱이 코덱 인터페이스기를 통해 전달한 어드레스 및 타이밍 정보를 이용하여 변조기들이 생성한 리드 어드레스, 출력 가능 신호(OE : Out Enable), 칩 선택(CS : Chip Select)을 메모리 컨트롤러가 칩/8의 속도로 역다중화하여 해당 변조기의 정보를 2비트 단위로 리드한다.
상기 세컨드 인터리브 메모리부(400)의 분할(세그먼테이션) 규칙은 다음과 같다.
분할은 최소 단위를 SF=128을 기준으로 한다. 따라서 세부 세그먼테이션 및 할당은 도 6a 내지 도 6e와 같다.
SF=128의 경우 코덱의 최대 데이터 처리량이 무선 링크 프레임 당 510심벌(=1020비트)이므로, 510/15(1워드=15심벌)=34워드 단위가 된다. 따라서 SF=4인 경우에서 최소 단위 SF=128로 계산하면 32세그먼트가 가능하고, 본 발명에서는 기본 세그먼트를 34워드로 한다.
여기서 SF=256 이하의 경우 세컨드 인터리브 메모리의 리드 경우수가 너무 많아 SF=128을 기준으로 한다. 또한 트랜스포트 물리채널 변조기 수를 32개로 제한한다.
다음으로 세그먼트 할당 방법을 간략히 살펴보면 다음과 같다.
세그먼테이션의 할당은 시작 인덱스와 할당 세그먼트 수로 정의한다. 필드 구성은 아래의 [표1]과 같다.
<S. S = 시작 세그먼트 할당 인덱스, A. S. N = Allocation Segment Number>
BankIndex S.SMSB(5) S.44 S.S3 S.S2 S.S1 S.SLSB A.S.NMSB(5) A.S.N4 A.S.N3 A.S.N2 A.S.N1 A.S.NLSB TimingOffset
프레임 단위로 뱅크0과 뱅크1을 교차하여 할당한다. 따라서 실제 한 사용자에 대한 세그먼테이션의 할당은 뱅크 각각에 프레임 워드 수만큼 할당한다. 코덱은 변조기의 이전 프레임 내에 현재 사용되지 않은 뱅크의 할당 세그먼트에 프레임 단위로 기록한다. 서로 다른 사용자에 할당은 이전 사용자에 할당한 다음 세그먼트부터 할당한다. 코덱은 현재의 할당 정보를 아래의 1), 2), 3)과 같이 관리한다.
1) 현재 할당된 세그먼트수와 할당 가능한 세그먼트 수를 계산하여 할당 가능한 데이터 속도 단위로 관리한다.
2) 분산된 소단위 할당 세그먼트는 다음 프레임 할당 시 세그먼트 갭이 발생되지 않도록 재 할당하여 할당 가능한 데이터 속도 경우를 확보한다.
3) 코덱은 상위 계층에게 현재 할당 가능한 최대 데이터 속도를 보고한다. 코덱은 세그먼트 할당 시 변조기내의 RAM-RD 컨트롤에 시작 인덱스와 할당 세그먼트 및 타이밍 오프셋을 전달하여 리드 관련 신호선을 생성할 수 있도록 한다. 여기서 시작 어드레스 = 시작 인덱스 *34, 끝 어드레스 = 시작 어드레스 + (할당 세그먼트 *34), 타이밍 오프셋은 Expire Time(읽기 시작) 및 SF 값이다.(읽기 속도 = 몇 칩당 리드 할 것인가를 나타냄).
다음으로, 상기 메모리 컨트롤러(420)는 변조부(500)내의 변조기들이 상기 세컨드 인터리브 메모리(410)를 액세스할 때 필요한 어드레스와 제어신호를 생성한다. 복수개의 변조기들이 각각 생성한 램(RAM)의 읽기 주소 및 제어 신호를 순차적으로 나열하고, 출력되는 RAM의 데이터를 병렬화하여 변조기들 각각이 독립적으로 램을 읽을 수 있도록 한다. 세컨드 인터리브 메모리의 데이터 너비는 15심벌이므로, 각 변조기에서 생성된 읽기 주소 중에서 하위 4비트는 출력 데이터 중에서 한 심벌을 선택하기 위해 사용되고, 나머지 비트들만이 램으로 입력된다.
변조기에서 읽는 빈도는 가장 빠른 경우(SF=4인 경우)에 2칩당 1번이므로, 각 트랜스포트 물리 채널 변조기의 SF를 고려하지 않고 다중화할 수 잇는 최대 채널 수는 메모리 컨트롤러(420)의 동작 주기에 따르게 된다.
다음으로, 코덱 인터페이스기(430)는 코덱이 상기 세컨드 인터리브 메모리(410)에 데이터를 기록할 때 관련 제어 신호, TFCI와 TPC 정보들을 해당 변조기에 전달하는 기능을 수행한다.
한편, 변조부(500)는, 크게 물리채널 S&S 유니트(510 ~ 510-N)와, 물리채널 가산기(520)로 구성된다.
상기 물리채널 S&S 유니트(510)는, 도 4에 도시된 바와 같이, 램 판독 컨트롤러(510m)와, 파일롯 발생기(510a)와, 멀티플렉서 컨트롤러(510c)와, 제1멀티플렉서(510b)와, S2P&STTD 인코더(510d)와, 제2멀티플렉서(510e)와, OVSF 코드발생기(510f)와, 확산기(510g)와, 스크램블링 코드 발생기(510h)와, 스크램블러(510i)와, DTX& 이득 제어기(510j)와, 이득 조정기(510k)로 구성된다.
이와 같이 구성된 물리채널 S&S 유니트(510)의 동작을 설명하면 다음과 같다.
프레임 컨트롤은 채널의 무선 프레임 오프셋 값에 따라 무선 프레임 타이밍 및 여러 세부 타이밍을 조절한다. 램 판독 컨트롤러는 세컨드 인터리버 메모리를 읽을 주소를 생성하는데, 세컨드 인터리빙 처리 후에 읽어갈 데이터의 주소를 생성하므로, 실제적으로 세컨드 인터리빙 과정은 램 판독 컨트롤러에서 생성한 주소의 데이터를 읽어오는 것으로 수행된다. 이렇게 읽혀진 인터리브 메모리의 내용은 데이터와 DTX로 분리되어 데이터는 멀티플렉서에서 다른 정보(TPC, TFCI, PILOT 등)와 같이 처리되며, DTX는 DTX&이득 제어기에서 처리된다. 파일롯 발생기는 두 안테나를 위한 파일롯 패턴을 발생시킨다. 멀티플렉서 컨트롤러는 슬롯 형식에 따라 DATA, TPC, TFCI, PILOT 또는 BLANK중 선택하도록 멀티플렉서를 제어한다. S2P & STTD 인코더에서는 데이터와 파일롯 신호를 각각 직렬/병렬 변환한 후, STTD 인코딩을 수행하고, 이 신호들을 조합하여 안테나0과 1의 I/Q신호를 생성한다. 확산기는 STTD 인코더의 출력 신호를 OVSF 코드 발생기에서 생성되는 OVSF 코드를 이용하여 확산한다. 스크램블러는 스크램블링 코드 발생기에서 생성된 코드로 스크램블링을 수행하고, DTX& 이득 제어기 부분의 제어를 받는 이득 조정기에 의하여 출력 크기가 조절된다.
다음으로, 물리채널 가산기(520)는, 상기 물리채널 S&S 유니트로부터 생성된신호를 가산하여 섹터 컨트롤러(600)에 전달하는 기능을 수행한다.
이상에서 상술한 본 발명 "3지피피 비동기 시스템에서 2nd 인터리빙을 위한 변조장치"에 따르면, 작은 크기의 메모리를 활용하여 3GPP 규격에서 제안하는 멀티-레이트, 멀티플 채널 구현이 가능하며, 모뎀의 구현이 용이하고 효과적으로 모뎀을 구현토록 도모해주는 이점이 있다.

Claims (4)

  1. 코덱 및 프론트 앤드 인터페이스부를 구비한 3GPP 비동기 시스템에서 2nd 인터리빙을 위한 변조장치에 있어서,
    세컨드 인터리빙 및 물리 채널 매핑에 필요한 메모리를 제공하고, 상기 코덱과 후단의 변조부 사이의 인터페이스를 제공하는 세컨드 인터리브 메모리부와;
    물리 채널 매핑 기능을 수행하며, W-CDMA의 기반 동작인 직접확산(DS) 기능을 수행하고, QPSK 변조를 수행하는 복수개의 변조기로 이루어진 변조부와;
    3GPP에서 규정하는 공통 순방향 링크 물리 채널들의 변조를 수행하는 비-트랜스포트 채널 변조기와;
    상기 변조부 및 비-트랜스포트 채널 변조기에서 생성된 신호를 정해진 섹터에 따라 그 출력신호를 만들어 상기 프론트 앤드 인터페이스부로 전달하는 섹터 컨트롤러를 포함하여 구성된 것을 특징으로 하는 3지피피 비동기 시스템에서 2nd 인터리빙을 위한 변조장치.
  2. 제1항에 있어서, 상기 세컨드 인터리브 메모리부는,
    세컨드 인터리빙, 물리 채널 매핑, 변조 및 확산 과정에서 필요한 메모리 자원을 제공하는 세컨드 인터리버 메모리와,
    상기 변조부내의 복수개의 변조기들이 상기 세컨드 인터리브 메모리를 액세스할 때 필요한 어드레스와 제어신호를 생성하는 메모리 컨트롤러와,
    상기 코덱이 상기 세컨드 인터리브 메모리에 데이터를 기록할 때 관련 제어 신호, TFCI와 TPC 정보들을 해당 변조기에 전달하는 기능을 수행하는 코덱 인터페이스기로 구성된 것을 특징으로 하는 3지피피 비동기 시스템에서 2nd 인터리빙을 위한 변조장치.
  3. 제1항에 있어서, 상기 변조부는,
    채널의 무선 프레임 오프셋 값에 따라 무선 프레임 타이밍 및 세부 타이밍을 조절하는 물리채널 S&S 유니트와;
    상기 물리채널 S&S 유니트로부터 생성된 신호를 가산하여 섹터 컨트롤러에 전달하는 물리채널 가산기로 구성된 것을 특징으로 하는 3지피피 비동기 시스템에서 2nd 인터리빙을 위한 변조장치.
  4. 제3항에 있어서, 상기 물리채널 S&S 유니트는,
    세컨드 인터리버 메모리를 읽을 주소를 생성하는 램 판독 컨트롤러와,
    두 안테나를 위한 파일롯 패턴을 발생시키는 파일롯 발생기와;
    슬롯 형식에 따라 DATA, TPC, TFCI, PILOT 또는 BLANK중 선택하도록 멀티플렉서를 제어하는 멀티플렉서 컨트롤러와,
    데이터와 파일롯 신호를 각각 직렬/병렬 변환한 후, STTD 인코딩을 수행하고, 이 신호들을 조합하여 안테나0과 1의 I/Q신호를 생성하는 S2P & STTD 인코더와,
    상기 STTD 인코더의 출력 신호를 OVSF 코드 발생기에서 생성되는 OVSF 코드를 이용하여 확산시키는 확산기와,
    스크램블링 코드 발생기에서 생성된 코드로 스크램블링을 수행하는 스크램블러와,
    DTX& 이득 제어기에서 출력되는 이득에 따라 상기 스크램블러에서 출력되는 데이터의 크기를 조절하는 이득 조정기로 구성된 것을 특징으로 하는 3지피피 비동기 시스템에서 2nd 인터리빙을 위한 변조장치.
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