KR20010071937A - 슬롯 페이징을 이용하여 무선 통신장치에서 어웨이크시간을 감소시키는 기술 - Google Patents

슬롯 페이징을 이용하여 무선 통신장치에서 어웨이크시간을 감소시키는 기술 Download PDF

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Abstract

본 발명은, 슬롯 페이징 메커니즘을 이용하여 통신시스템 내의 슬롯의 활성상태에서 이동 지국이 소비하는 시간량을 감소시키는 개선된 방법 및 회로에 관한 것이다. 본 발명은 핑거들의 타이밍 기준을 조절하여 PN 시퀀스 주기의 정수배가 아닌 슬립 기간을 보상하는 수단, 디인터리버 프레임 기준 타이밍을 조절하여 프레임 간격의 정수배가 아닌 슬립 기간을 보상하는 수단, 및 만일 존재한다면 아날로그 수신기 체인의 주파수 트래킹, 이득 스케일링, 및 DC 바이어스 루프를 초기화하여 이들 루프들을 리-로크하는 데에 필요한 시간을 최소화하는 수단을 포함한다.

Description

슬롯 페이징을 이용하여 무선 통신장치에서 어웨이크 시간을 감소시키는 기술{TECHNIQUE FOR REDUCTION OF AWAKE TIME IN A WIRELESS COMMUNICATION DEVICE UTILIZING SLOTTED PAGING}
발명의 배경
본 발명은 셀룰러 전화시스템 등의 이동 통신시스템에 관한 것으로, 더욱 자세하게는, 상기 시스템의 휴대용 전화내에서 전력소비를 감소시키기 위한 시스템에 관한 것이다.
통상적으로, 셀룰러 전화는 통화 및 대기의 2개의 모드들을 갖는 것으로 설명된다. 통화 모드에서, 이동 지국은, 음성 또는 데이터 호출용 채널 등의, 트래픽 채널 상에서 데이터를 활발하게 교환한다. 호출 중간에서, 이동 지국은, 대기 모드를 유지하면서, 호출을 개시하는 데에 필요한 페이지를 수신하는 것과 같이, 기지국으로부터 메시지를 수신하기 위해 페이징 채널을 감시하게 된다.
이 페이징 채널 상의 메시지의 단지 작은 부분만이 임의의 특정 이동 지국에 어드레스되기 때문에, 이동 지국은 그 자신의 전력소비를 줄일 수 있으므로, 착신 메시지용 채널을 계속해서 감시하기 보다는 주기적으로 감시함으로써 대기 시간 및 전지 수명을 증가시킬 수 있게 된다. 당해 기술분야에서 슬롯 페이징 채널로서종종 지칭되는 상기 시스템은, 여기서 참조하며 본 발명의 양수인에게 양도되며, 1995년 2월 21일 특허 허여된, 발명의 명칭이 "이동 수신기에서 전력소비를 감소시키는 장치 및 방법" 인 미국 특허 제 5,392,287 호 공보에 설명되어 있다.
상술한 특허 공보에서, 통신 시스템은 하나의 고정된 송신기 및 하나 이상의 이동 지국들을 갖는 것으로 설명되며, 송신기로부터 이동 지국들로의 주기적인 메시지들은 시간 "슬롯" 내에 예정된다. 각 이동 지국이 송신을 감시하는 동안, 각 이동 지국에는 시간 슬롯이 할당된다. 상기 송신기는 상기 이동 지국에 할당된 시간 슬롯동안에만 특정 이동 지국에 메시지를 송신한다. 이동 지국은 그 할당된 슬롯 동안에 "활성(활동) 상태" 로 된다. 메시지가 수신기에게 추가 활동을 수행할 것을 요구하는 경우에는 그 할당된 슬롯후에도 활성 상태로 유지될 수도 있다. 이 활성 상태를 종종 "어웨이크" 상태로 지칭한다.
송신기로부터 이동 지국으로 페이징 채널 상에서 송신된 메시지들은, 이동 지국에 착신 호출의 존재를 경고하는 메시지(예를 들어, "페이지" 메시지) 및 이동 수신기내의 시스템 변수들을 주기적으로 갱신하는 메시지들(예를 들어, "오버헤드" 메시지)을 포함하게 된다. 통상의 페이징 채널 상에서 발견되는 예시적인 메시지들의 리스트는, 그 명칭이 "듀얼 모드 광대역 스펙트럼 확산 셀룰러 시스템용 이동 지국-기지국 호환표준" 인 미국 전기 통신 공업 협회(TIA)/미국 전자 공업 협회(EIA) 잠정 표준(IS-95) 내의, 섹션 7.7.2.1. 에서 발견할 수도 있다. 상기 섹션내에 설명된 각 메시지들은 다른 메시지가 곧 출현하는 지를 표시하는 필드를 포함할 수도 있다. 추가 메시지가 곧 출현하는 것을 표시하는 메시지를 이동 지국이 수신하는 경우, 상기 이동 지국은 어웨이크 상태를 유지하면서 추가 메시지들을 수신하게 된다. 추가 메시지들이 존재하지 않으면, 이동 지국은 즉시비활성 상태로 들어간다. 그 할당된 슬롯의 연속된 발생들간의 시간기간 동안, 이동지국은 하나 이상의 구성요소들로의 전력 및/또는 클록들을 차단함으로써 상기 시간동안 전력을 보존하게 된다. 예를 들어, 상기 이동 지국으로는 어떠한 데이터도 전송되지 않으므로, 이동 지국의 할당된 슬롯외부에서는 송신들을 감시하는 데에 이용되는 구성요소들을 필요로 하지 않게 된다. 상기 비활성 상태를 "슬립" 상태로 종종 지칭한다.
이동 지국이 대기 모드에 있는 경우, 슬롯을 가로질러 소비되는 평균전류는 소정의 전지 크기로 달성될 수 있는 대기 시간량을 결정한다. 슬롯을 가로질러 소비되는 평균전류는, 슬롯의 슬립 단계에서 소비된 시간부분이 가중된 슬립 전류와 합산되는, 슬롯의 어웨이크 단계에서 소비된 시간부분이 가중된 어웨이크 전류와 동일하다.
소정의 전지 크기의 경우, 슬롯을 가로질러 소비되는 평균전류를 감소시킴으로써 대기 시간을 향상시킬 수 있다. 이는, 어웨이크 단계에서 소비되는 평균전류를 감소시켜 슬립 단계에서 소비되는 전류를 감소시키거나, 어웨이크 단계에서 시간을 덜 소비하여 슬립 단계에서 더 많은 시간을 소비함으로써, 달성될 수 있다. 통상적으로, 어웨이크 단계에서 소비되는 시간 부분은 슬립 단계에서의 시간 부분보다 훨씬 더 작은 간격이지만, 통상적으로 활성단계 전류가 슬립단계 전류보다 수 배 더 크기 때문에, 어웨이크 단계에서 소비되는 시간량을 감소시킴으로써 대기 시간에서의 직접적이며 중요한 향상을 달성할 수 있게 된다.
높은 신뢰성으로 메시지를 디코딩하기 위하여, 어웨이크 시간은, 아날로그수신기 체인을 다시 초기화하여 유효한 수신 샘플들을 제공하는 데에 필요한 시간, 다중경로를 위해 이들 샘플들을 검색하고 핑거를 할당하여 유효한 기호스트림을 제공하는 데에 필요한 시간, 및 해당 메시지와 관련된 기호 이전에 기호스트림으로 상태 미터를 초기화하는 데에 필요한 시간을 포함해야 한다. 아날로그 수신기 체인의 초기화동안, 수신된 신호를 기저대역 주파수와 혼합하는 데에 이용되는 주파수 합성기는, 로크되어야 하며, 이득 스케일링 및 DC 바이어스 루프는, 만일 이들 루프가 존재하면, 유효한 기저대역 수신 샘플 스트림을 제공하기 위해 로크되어야 한다. IS-95 에서 이용되는 페이징 채널은 K=9 레이트의 돌림형 부호로 계속해서 인코딩된다. 여러 제약길이들의 기호들을 비터비 디코더에 제공하여 해당 기호에 앞서 그 상태 미터값들을 초기화해야 한다.
페이징 채널을 복조하기 위해, 이동 지국은, 수신된 파형을 구비한 다중경로 구성성분들 각각에 대해 정확한 타이밍 기준을 획득할 필요가 있다. 그들 자신의 특정 시간 기준을 각각 갖는, 복조기 핑거들은 개개의 다중 경로 구성요소에 할당된다. 각 핑거는 상기 할당된 시간 기준에서 수신 샘플들을 디스프레드한다. 그 후, 각 핑거로부터의 디스프레드 결과를 조합하고 단일 기호스트림을 형성하여 디코딩한다. 레이크(RAKE) 수신기로 알려진, 상기 복조기는, 여기서 참조하며 본 발명의 양수인에게 양도되고, 1992년 4월 28일 특허 허여된, 발명의 명칭이 "CDMA 셀룰러 전화시스템에서의 다이버시티 수신기" 인 미국 특허 제 5,109,390 호 공보에 설명되어 있다.
초기 파워-온 획득동안에는, PN 시퀀스의 모든 가능한 시프트들을 검색하여각 핑거에 대한 타이밍 기준들을 획득하게 된다. 각 PN 오프셋 검색은, 획득도중의 채널 상태에 따라 수백 밀리초부터 수 초까지의 어디에서든 취할 수 있다. 대기 모드내의 모든 슬롯의 시작부분에서 상기와 같은 완전한 재획득을 수행하게 되면, 실용적인 크기의 휴대용 전화 전지로는, 시간이 많이 걸리며 너무 많은 대기 전류를 소비하게 된다. 그 대신에, 회로의 클록들이 게이트 백 온(gated back on)될 때 상기 회로들이 자동적으로 조절되도록 설계된 정확한 시간 기간동안 복조기 회로로의 클록은 게이트 오프된다. 상기 시간 주기는 슬립 타이머 클록 오프된 고정밀도 발진기에 의해 측정된다. 슬립 기간동안에는, 단지 발진기와 슬립 타이머만이 활성 상태로 된다.
IS-95 시스템에 있어서, 송신기내의 인터리버 및 이동 지국내의 디인터리버는 20 ms 프레임 경계 상에서 데이터를 처리하며, 상기 모두는 서로 얼라인되어야 한다. 송신기 및 이동 지국내의 PN 생성기들은 215의 시퀀스 길이를 갖는다. 각 PN 생성기는 1.2288 MHz 의 레이트로 갱신되므로, PN 시퀀스 주기는 26.66 ms 로 된다. 이동 지국내의 PN 생성기들은 송신기내의 각 PN 생성기들과 얼라인되어야 한다. 인터리버/디인터리버 타이밍과 PN 시퀀스 타이밍 모두에 공통인 최소 주기는 80 ms 로 된다. 정확히 26.66 ms 의 3개의 PN 시퀀스 주기와 정확히 20 ms 의 4개의 인터리버 프레임들은 80 ms 주기에 꼭 맞게 된다. 더욱 통상적으로, 슬립 간격은 2개의 인터벌들의 최소 공배수 단계에서 프로그램된다.
슬립 타이머는 80 ms 의 배수 주기동안 슬립되도록 프로그램되어, 핑거의 타이밍 기준과 디인터리버의 프레임 기준이 실제 시간, 또는 "월 클록" 시간에 대해변하지 않는 것을 보장한다. 만일 슬립 타이머가 80 ms 의 배수 이외의 값으로 프로그램되면, 복조기가 동작을 개시할 때 PN 생성기 및/또는 인터리버 타이밍이 적합한 시스템 시간과 얼라인되지 않으므로 복조가 불가능하게 된다.
슬립 타이머가 만료된 후, 복조기 회로는 다시 인에이블된다. 복조기 회로는 송신기와 정렬되며, 핑거는 이전 단계에 앞서 존재했던 다중 경로 환경에 대해 최적인 오프셋들에서 복조된다. 상기 다중 경로는 슬립 간격 동안에 변하게 되므로, 이전 슬롯 사이클에서 존재했던 다중 경로에 집중된 PN 오프셋들의 짧은 검색만으로 최적의 핑거 할당을 재획득할 수 있어, PN 시퀀스의 모든 가능한 PN 오프셋들을 완전히 검색할 필요가 없게 된다.
발명의 개요
본 발명은 슬롯 페이징 메커니즘을 이용하여 통신 시스템내의 슬롯의 활성 상태에서 이동 지국이 소비하는 시간량을 감소시키기 위한 개선된 방법 및 회로에 관한 것이다. PN 시퀀스 주기와 디인터리버 프레임 기간의 최소 공배수의 증분으로 양자화된 어웨이크 시간 대신에, 본 발명에서는, 아날로그 수신기 체인을 초기화하고, 핑거 시간 기준을 재획득하며, 디코더 상태 미터를 초기화하여, 해당 페이징 채널 메시지를 복조하는 데에 필요한 최소 간격동안 어웨이크 시간을 구성하게 된다.
본 발명은, 핑거의 타이밍 기준을 조절하여 PN 시퀀스 주기의 정수 배수가 아닌 슬립 기간을 보상한다. 또한, 본 발명은, 만일 존재한다면 아날로그 수신기 체인의 주파수 트래킹, 이득 스케일링, 및 DC 바이어스 루프를 초기화하여 이들루프를 리-로크(re-lock)하는 데에 필요한 시간을 최소화한다.
도면들의 간단한 설명
본 발명의 특징들, 목적들, 및 이점들은, 도면내내 동일 참조 부호가 대응하여 식별하는 상기 도면들과 함께 아래에 개시된 상세한 설명으로부터 더욱 분명하게 된다.
도 1 은 본 발명의 회로의 기능 블록도이다.
도 2 는 본 발명을 이용하지 않는 슬롯 시간라인이다.
도 3 은 본 발명의 바람직한 실시예에서 본 발명을 이용하는 슬롯 시간라인이다.
도 4 는 상기 바람직한 실시예를 수행하기 위한 단계들을 나타낸 흐름도이다.
도 5 는 본 발명의 다른 실시예를 이용한 슬롯 시간라인이다.
도 6 은 상기 다른 실시예를 수행하기 위한 단계들을 나타낸 흐름도이다.
바람직한 실시예들의 상세한 설명
본 발명은 슬롯 페이징 메커니즘을 이용하여 자신의 수신기를 조정하는 휴대용 무선전화 등의 무선 통신장치 또는 이동 지국에 특히 유용하다. 미국 특허 제 5,392,287 호 공보를 참조하여 상술한 바와 같이, 슬롯 페이징 동작시, 수신기는, 비할당된 페이징 슬롯동안 슬립 상태를 유지하며, 할당된 페이징 슬롯 이전에는 즉시 동작을 개시하게 된다(즉, 어웨이크 한다). 이동 지국은 프로그램된 갯수의 시간 주기동안 슬립한다. 상기 이동 지국은 할당된 페이징 슬롯 이전의적어도 하나의 시간 주기에서 어웨이크하여 페이징 채널을 복조하게 된다.
본 발명의 바람직한 실시예에서는, IS-95 표준이 이용된다. PN 확산 시퀀스는 1.2288 MHz 의 칩 레이트로 모든 215개의 칩들을 반복한다. 따라서, PN 시퀀스 주기는 26.66 ms 로 된다. 디인터리버 프레임은 20 ms 를 스팬하므로, 바람직한 실시예의 경우, 80 ms 는 20 ms 채널 프레임들과 26.66 ms PN 시퀀스 반복 모두의 최소 공배수로 된다. 슬롯 사이클 기간은 80 ms 의 배수이며, 전형적으로는, 1.28, 2.56, 또는 5.12 초로 된다. IS-95 는 연속적인 돌림형 부호를 이용한다. IS-95 페이징 채널 상에서 이용되는 것과 같은 연속적인 돌림형 부호를 비터비 디코더가 신뢰성있게 복조하기 위해서는, 슬롯 경계 상에서 시작하는 메시지를 디코딩하는 디코더의 상태 미터를 초기화하는 데에 슬롯 경계 앞에 있는 약 18 내지 20 ms 정도의 유효한 기호들을 필요로하게 된다.
도 1 은 IS-95 시스템의 블록도를 도시한다. 송신기 (100) 는 이동 지국 (50) 에 송신한다. 초기 획득동안에는, 아날로그 수신기 체인 (200) 을 초기화하여 안테나 (102) 상에 수신된 신호들로부터 유효한 기저대역 샘플들을 제공한다. 검색기 (205) 는 마이크로 프로세서 (106) 에 의해 프로그램되어 모든 가능한 PN 오프셋들에서 수신된 샘플들을 상관시켜(correlate), 임의의 반사 또는 근방의 송신기들로부터 다중 경로 신호들의 타이밍 기준들을 획득하게 된다. 그 후, 메모리 (104) 내에 저장된 소프트웨어 명령의 제어를 받는 마이크로 프로세서 (106) 는 핑거들 (207a 내지 207n) 각각에 명령하여 자신의 타이밍 기준을 검색기 (205) 에 의해 확인된 다중경로 신호들 중 하나의 다중경로 신호에 맞추게 된다. 상기 조절은, 핑거 시간계수기 (208) 및 PN 시퀀스 생성기 (209) 를 가속하거나 감속함으로써, 실행된다. 핑거 시간계수기 (208) 및 PN 시퀀스 생성기 (209) 는 모든 칩을 증분시켜 215개의 칩들을 계산한 후 리셋한다. 일단 할당된 시간기준에서, 핑거들 (207a 내지 207n) 은 그들 고유의 타이밍 기준에 적합한 PN 시퀀스를 이용하여 수신 샘플들을 디스프레드한다. 상기 디스프레드된 샘플들은 기호 기간에 대해 적분되고, 핑거 데이터경로 (210) 를 통해 트래킹되는 다중경로 신호의 강도만큼 가중된다. 핑거들 (207a 내지 207n) 각각은, 기입 인덱스로서 자신의 시간계수기 (208) 를 이용하는 각 디스큐 버퍼 (220a 내지 207n) 에 결과로서 생성되는 기호를 기입한다. 207a 내지 207n 의 각 핑거는 서로 다른 할당 오프셋에 존재하므로, 각 핑거로부터 유사 색인(like-indexed) 기호들은 서로 다른 시간에 디스큐 버퍼 (220a 내지 220n) 에 기입된다.
콤바이너 시간계수기 (224) 는 핑거들의 시간기준으로부터 지연된다. 콤바이너 시간계수기 (224) 는 모든 칩을 증분시켜 80 ms 의 칩들을 계산한 후 리셋시킨다. 디스큐 버퍼 (220a 내지 220n) 의 각 핑거 섹션으로의 판독 인덱스로서 콤바이너 시간계수기 (224) 를 이용하여, 각 핑거로부터 유사 색인된 기호들을 함께 판독하여 시간 정렬한다. 상기 시간 정렬된 기호들은 콤바이너 합산기 (222) 에 의해 서로 합산되어 디인터리버 (230) 에 제공된다. 그 후, 당해 기술분야 공지된 바와 같이, 디인터리브된 기호들을 비터비 디코더 (240) 에 제공하여 더 처리하게 된다. 바람직한 실시예에서, 디스큐 버퍼들 (220a 내지 220n) 은 "8" 기호 깊이이며, 콤바이너 시간계수기 (224) 는, 최초의 다중경로 신호를 트래킹하는 핑거의 핑거 시간계수기 (208) 로부터 4개의 기호들이 지연되는 상태로 초기화된다.
상기 할당된 페이징 채널 슬롯을 감시하여, 이동 지국 (50) 에 대해 더 이상의 메시지를 발견하지 않게 되면, 마이크로 프로세서 (106) 는 슬립 제어기 (204) 에 명령을 전달하여 슬립 상태로 하며, 슬립 계수기 (203) 를 프로그램하여 슬립 간격의 기간을 계산한다. 그 후, 슬립 제어기 (204) 는 이동 지국에 명령하여 슬롯의 슬립 단계로 진입하여 슬립 계수기 (203) 를 시동시킨다. 슬립 제어기 (204) 는 복조기 클록 생성기 (202) 의 입력에 디스에이블 신호를 전송하며, 아날로그 수신기 체인 (200) 에는 파워다운 신호를 전송한다. 클록 소스로서 정밀 발진기 (201) 를 이용하여, 슬립 계수기 (203) 는 슬립 간격을 카운트 다운한다. 슬립 간격 동안에는, 복조기 클록 (202) 이 디스에이블되며 아날로그 수신기 체인 (200) 이 파워 다운되므로, 슬립 계수기 (203) 및 정밀 발진기 (201) 가 이동 지국내의 전력 소비 모두를 차지하게 된다.
슬립 계수기 (203) 의 만료 이전에, 아날로그 수신기 체인 (200) 이 다시 초기화된다. 만료 이전에 요구되는 시간은 아날로그 수신기 체인 (200) 의 웜-업 시간에 따라 다르며, 통상적으로는 수 밀리초로 된다. 슬립 계수기 (203) 의 만료시, 복조기 클록 생성기 (202) 는 다시 인에이블되며, 이동 지국은 슬롯의 어웨이크 단계로 진입한다. 검색기 (205) 는 마이크로 프로세서 (106) 에 의해 프로그램되어, 이전의 어웨이크 단계동안에 존재하는 다중경로 상에 집중된 PN 오프셋들의 작은 그룹들과 수신 샘플들을 서로 상관시킨다. 그 후, 마이크로 프로세서 (106) 는 핑거들 (207a 내지 207n) 에 명령하여 그 자신의 타이밍 기준을 검색기 (205) 에 의해 확인된 다중경로 신호에 맞추므로, 유효한 기호 스트림은 디인터리버 (230) 에 제공된 후, 비터비 디코더 (240) 에 제공되어 페이징 채널 메시지를 디코딩할 수 있게 된다.
상술한 설명은, 본 발명을 이용하는지의 여부에 관계 없이, 슬립 슬롯 시간라인내의 기본적인 단계들만을 개시하고 있다. 종래 기술에서는, 슬롯 기간과 마찬가지로, 슬립 기간도 80 ms 의 배수로 한정하였다. 슬립 간격이 PN 시퀀스 주기의 배수가 아닌 경우, 복조기 회로가 다시 인에이블될 때 자신의 핑거 타이밍은 송신기에서 수신된 신호를 스프레드하는 데에 이용되는 PN 시퀀스에 비해 전체적으로 미스얼라인된다. 슬립 간격이 디인터리버 프레임 간격의 배수가 아닌 경우에는, 복조기 회로가 다시 인에이블될 때 자신의 디인터리버 스타트-오브-프레임 기준은 송신기에서 이용되는 실제 인터리버 프레이밍에 비해 전체적으로 미스얼라인된다. 본 발명은, 슬립 간격이 PN 시퀀스 주기 또는 디인터리버 프레임 간격의 정수배가 아닌 경우에도 페이징 메시지를 적절하게 디코딩할 수 있도록 핑거, 콤바이너, 및 슬립 타이머들을 구성하는 방법을 상세하게 개시하고 있다. 상기 구성 정보 및 단계들의 적절한 시퀀스는 메모리 (104) 내에 포함되며 마이크로 프로세서 (106) 에 의해 액세스된다.
도 2 는 종래 기술의 통상의 슬롯 시간라인을 나타낸다. 상기 사이클은 어웨이크 상태내의 슬롯 경계 (n-1) 에서 시작한다. 슬립 제어기는, 복조기 클록을 디스에이블하기 전에, 디인터리버 프레임 기준 및 PN 시퀀스 주기의 공배수,또는 바람직한 실시예의 경우 슬롯 경계 후 80 ms 때까지 대기한다. 슬립 간격은 슬롯 간격에서 어웨이크 간격을 뺀 것으로 프로그램되어, 복조기는 슬롯 경계 (n) 이전에 80 ms 로 다시 인에이블될 때까지 슬립하게 된다. 슬립 기간과 어웨이크 주기가 디인터리버 프레임 간격과 핑거 PN 시퀀스 주기의 배수인 경우, 관련된 복조기 회로들은 복조기 클록의 게이팅에 의해 영향을 받지 않는다. 상기 복조기 회로들은 게이트 오프된 슬립 간격에도 불구하고 PN 시퀀스와 디인터리버 프레이밍과의 기본적인 정렬을 유지한다. RF 회로들은 어웨이크 상태이전에 턴온되어, 충분한 시간으로 웜 업된다. 웨이크 업된 후, 다중경로를 재획득해야 한다. 도 3 의 시간라인에서, 어웨이크 단계의 최소 기간은 160 ms 로 된다. 통상의 메시지 파스(parse) 종료점은 슬롯 경계 (n) 의 시작점 이후 약 50 ms 로 된다.
도 3 은 바람직한 실시예에서 본 발명을 이용하는 통상의 시간라인을 나타낸다. 바람직한 실시예는 몇몇 IS-95 임플리멘테이션들에서 발견되는 임의의 타이밍 및 회로들을 이용한다. 본 발명은 이 실시예에 한정되지 않으며, 이하 더 일반적인 해를 더욱 상세하게 설명한다.
본 발명의 사이클은 어웨이크 상태내의 슬롯 경계 (n-1) 에서 시작한다. 슬롯 경계 (n-1) 후 80 ms 상에서 슬립 상태로 되기 보다, 상기 슬립 제어기는, 이동 지국에서 명령을 받은 임의의 페이지 메시지들의 파싱후에 처음 26.66 ms 상에서 복조기 클록을 디스에이블시킨다. 슬립 간격은 슬롯 간격에서 어웨이크 간격을 뺀 것으로 프로그램되므로, 슬롯 경계 (n) 이전 26.66 ms 에서 복조기를 다시인에이블할 때까지 복조기는 슬립하게 된다. 본 발명은 PN 시퀀스 주기의 배수를 포함하지 않는 시간라인들을 포함하지만, 바람직한 실시예에서는 임플리멘테이션의 용이성을 위해 어웨이크 간격과 슬립 주기를 PN 시퀀스 주기의 배수들로 제한한다. 상기 제한이 없어지면, 소정의 추가 대기시간 이득이 발생하지만, 도 3 의 시간라인도 최적에 가깝다. 슬롯 경계 이전 26.66 ms 에서 웨이킹 업함으로써, 이동 지국은, 슬롯 경계 (n) 상에서 개시되는 메시지를 디코드하는 데에 필요하게 되는 적절한 디코더 상태 미터 초기화를 위해 유효하게 될 필요가 있는 기호들 이전에 약 6 내지 8 ms 를 갖게 된다. 상기 시간은, 아날로그 수신기 체인을 재초기화하며 다중경로를 재획득하고 핑거들을 할당하여 복조하는 데에 이용된다.
충분하지만, 상기 재획득 시간량이 너무 많은 것은 아니다. 적절한 디코딩을 위해 유효한 기호들이 요구되는 지점이전에 페이징 채널을 재획득하는 것을 보장하기 위해, 마이크로 프로세서는 이전 어웨이크 간격내의 다중경로의 위치를 표시할 수 있으며, 이것을 이용하여 상기 위치에 집중된 작은 검색을 명령하여 검색 프로세스를 가속화할 수 있게 된다. 복조기는, 만일 존재한다면, 주파수 트래킹, 이득 스케일링 및 DC 바이어스 루프를 클로즈한다. 일단 복조기가 슬립 상태로 진행하면, 이들 트래킹 루프들은 오픈 루프 방식으로 동작한다. 그들 자신내의 재수렴을 돕기 위해, 마이크로 프로세서는 슬립 단계에 들어가기 전에 관측된 최종값들을 기록할 수 있으며, 어웨이크 간격의 개시 이전 수 밀리초는 이들 값들을 복조기 회로에 다시 로드할 수 있으므로, 일단 복조기가 다시 인에이블되면수렴할 가능성이 있는 적절한 추정값으로 구동된다. 이로 인해, 아날로그 수신기 체인을 재초기화하는 데에 필요한 어웨이크 시간량을 최소화시킬 수 있게 된다.
복조기 클록이 슬롯 경계이전 26.66 ms 에서 다시 인에이블될 때, 디인터리버 프레임 기준은 페이징 채널을 복조하는 데에 필요한 적합한 프레임 얼라인먼트를 갖지 않을 수도 있다(적절한 타이밍을 갖지 않을 때에는, 이는 단지 우연이다). 적절한 프레임 얼라인먼트를 생성하기 위해, 마이크로 프로세서는 복수의 핑거들 중 하나의 핑거에 명령하여, 그 자신의 시간 기준을, 정확히 6.66 ms, 즉 PN 시퀀스 주기와 디인터리버 프레임 간격간의 차이만큼 지연시키게 된다. 상기 핑거는 복조에서는 이용되지 않으며, 단지 지연된 타이밍 기준으로 콤바이너를 초기화하는 데에만 이용된다. 디인터리버 프레임 얼라인먼트는 콤바이너 시간계수기로부터 얻을 수 있다. 상기 콤바이너 시간계수기는 상기 지연된 핑거로부터 4개의 기호 공칭깊이까지 재초기화되므로, 콤바이너 시간계수기는 슬롯 경계에서 리셋하는 대신에, 슬롯 경계 (n) 이전 1 프레임, 또는 정확히 20 ms 에서 리셋한다. 콤바이너 시간 기준은 적절한 슬롯 경계 얼라인먼트에 비해 미스얼라인되지만, 모듈로 20 ms 는 정확하므로, 디인터리버 기호 프레임 얼라인먼트도 정확하게 된다. 그러나, 6.66 ms 지연은 디스큐 버퍼의 "8" 기호 길이에 의해 나눌 수 있기 때문에, 콤바이너에 의해 이용되는 판독 포인터는, 지연이 없었더라면 존재하고 있을 동일 위치로 에일리어스 백(aliased back)되므로, 디스큐 버퍼 동작은 영향을 받지 않으며 디인터리버에 제공된 기호 스트림도 정확하게 얼라인된다.
슬롯 경계 이전 20 ms 에서 적절한 디인터리버 얼라인먼트를 함으로써, 올바르게 디인터리브된 순서로 슬롯 경계 이전 프레임내의 기호들을 디코더에 제공할 수 있으므로, 상태 미터를 초기화할 수 있게 된다. 도 2 의 시간라인에서와 같이, 디코더는 기호 스트림을 디코드하여 그 결과를 마이크로 프로세서에 제공한다. 응답을 필요로 하는 어떠한 페이지도 수신되지 않는 경우, 마이크로 프로세서는 슬립 제어기에 명령하여 다음 콤바이너 26.66 ms 경계 상에서 이동 지국이 슬립되도록 한다. 바람직한 실시예에서는, 디코딩된 데이터의 제 1 프레임 후에 아이들 페이징 채널을 위해 종종 상기와 같은 결정을 하며, 상기 경우 슬립 제어기는 슬롯 경계후 제 1 의 26.66 ms 상에 이동 지국이 슬립하도록 하므로, 53.33 ms 의 어웨이크 간격으로 된다. 만일 그렇지 않다면, 통상적으로 마이크로 프로세서는 슬립 제어기에 명령하여 슬롯 경계후 제 2 의 26.66 ms 상에서 이동 지국이 슬립하도록 하므로, 80 ms 의 어웨이크 간격으로 된다. 어느 경우에든, 본 발명을 이용하는 도 3 의 어웨이크 간격은 본 발명을 이용하지 않는 도 2 의 어웨이크 간격 160 ms 보다 훨씬 더 작다. 디인터리버 초기화는 임의의 특정 시간위치에서 슬립 상태로 진행하는 것에 의존하지 않으므로, 시간라인이 80 ms 로부터 26.66 ms 로 단축되는 어웨이크 간격의 선단 상에서 뿐만 아니라, 끝단 상에서도 이득을 실현할 수 있으므로, 디인터리버 프레임 얼라인먼트에 대한 특정 고려 없이 메시징이 허용하는 한 가장 빠르게 복조기를 게이트 오프시킬 수 있게 된다.
이동 지국이 수신된 메시지에 응답하여 역방향 링크 상에서 송신을 개시하기 이전의 임의의 위치에서, 콤바이너 시간기준은 복조에서 이용된 최초 도착 다중경로로부터 "4" 기호 공칭지연으로 재정렬될 필요가 있다. 이는, 슬롯 경계에서수행되거나, 슬롯 경계 후 제 1 페이징 채널 메시지를 파스하는 데에 추가 시간을 허용하기 위해 나중에 수행될 수도 있다. 콤바이너 시간계수기가 지연된 시간기준 상에 여전히 존재하며 마이크로 프로세서가 슬립 제어기에 명령하여 콤바이너의 제 1 의 26.66 ms 시간 경계 상에서 이동 지국이 슬립하도록 하면, 이동 지국은 슬롯 경계 후 33.33 ms 에서 파워 다운된다. 26.66 ms 의 배수로 슬립 되기보다는, 슬립 계수기는, 26.66 ms 보다 적은 6.66 ms 의 배수로 프로그램되므로, 복조기 클록은 다음 슬롯 경계 이전 26.66 ms 로 다시 재인에이블된다.
도 4 는 본 발명의 바람직한 실시예를 실시하는 데에 필요한 단계들을 나타낸 흐름도이다. 상기 프로세스는, 이동 지국이 파워 온될 때 블록 (400) 에서 시작한다. 블록 (400) 으로부터 블록 (402) 로 진행하여, 아날로그 수신기 체인을 초기화시킨다. 블록 (402) 로부터 블록 (404) 로 진행하여, 검색기는 모든 가능한 PN 오프셋들을 검색하게 된다. 그 후 블록 (406) 으로 진행하여, 검색기에 의해 찾아낸 가장 바람직한 다중경로 신호에 핑거를 할당한다. 블록 (408) 로 진행하여, 동기 채널을 디코드하기 시작한다. 블록 (408) 로부터 블록 (410) 으로 진행하고, 가장 빠른 다중경로를 트래킹하는 핑거를 이용하여 콤바이너 타이머 카운트를 리셋한다. 블록 (412) 인, 체인지 서브스테이트 타이밍으로 진행한다. 일단 체인지 서브세트 타이밍이 종료되면, 블록 (414) 로 진행하여 복조에서 이용된 것들로부터 하나의 핑거를 6.66 ms 지연시킨다. 상기 핑거는 더 이상 복조에서 이용되지 않게 된다. 블록 (416) 으로 진행한다.
블록 (416) 에서는, 페이징 메시지를 디코딩하는 것을 시작한다. 블록(420) 에서는 특정 이동 지국으로 일반 페이지가 향하고 있는지를 판단한다. 그렇지 않은 경우, 블록 (424) 로 진행한다. 만약 그런 경우에는, 블록 (422) 로 진행하고, 페이지에 응답하여 활성 호출 상태를 입력한다.
블록 (424) 에서는, 페이지가 오버헤드 페이지인지를 판단한다. 그렇지 않은 경우, 블록 (428) 로 진행한다. 만약 그런 경우에는, 블록 (426) 내의 시스템 변수들을 갱신한 후 블록 (428) 로 진행한다.
블록 (428) 에서는, 임의의 추가 페이지 메시지들이 존재하는지를 판단한다. 만약 그런 경우, 블록 (416) 으로 진행하여 후속하는 단계들을 반복한다. 그렇지 않은 경우에는, 블록 (432a) 로 진행한다.
블록 (432a) 에서는, 슬립 계수기를 26.66 ms 의 배수로 프로그램한다. 블록 (434) 로 진행하여 다중경로 오프셋을 저장하고 루프 클로즈드 루프 값들을 트랙한다. 블록 (436a) 로 진행하여 26.66 ms 경계에서 콤바이너를 대기시켜 슬립을 개시한다. 블록 (438) 로 진행하여, 복조기 클록을 디스에이블하며, 아날로그 수신기 체인을 파워다운시킨다. 블록 (440) 으로 진행하여, RF 웜업 시간보다 짧은 슬립 계수기 기간 동안 대기한다. 블록 (442) 로 진행하여 이전의 클로즈드 루프 값들을 이용하여 아날로그 수신기 채널을 초기화한다. 블록 (444) 로 진행하여 슬롯 경계 이전 26.66 ms 까지 대기한다. 블록 (446) 으로 진행하여, 복조기 클록을 인에이블시킨다. 블록 (450) 으로 진행하여 이전 다중경로 상에 집중된 PN 오프셋 윈도우를 검색한다. 블록 (452) 로 진행하여 다중경로에 핑거를 할당한다. 블록 (454) 로 진행하고, 지연된 핑거를 이용하여콤바이너 시간계수기를 리셋한다. 블록 (456) 으로 진행하여, 슬롯 경계 이전 20 ms 에서 디인터리버 프레임 경계를 대기한다. 블록 (430) 으로 진행하고, 가장 빠른 다중경로를 트래킹하는 핑거를 이용하여 콤바이너 시간계수기를 리셋한다. 블록 (458) 로 진행하여, 지연된 핑거를 조절하여 재획득된 다중경로로부터 6.66 ms 지연되도록 한다. 블록 (460) 으로 진행하여, 슬롯 경계를 대기하면서 비터비 디코더 상태 미터를 초기화한다. 이제, 블록 (416) 으로 다시 되돌아가 페이징 메시지 디코딩 및 상술한 후속 단계들을 개시하게 된다.
방금 상술한 바람직한 실시예는, 프로그램된 슬립 간격이 PN 시퀀스 주기의 정수배가 아닌 더욱 일반적인 클래스의 시간라인들 중 하나의 시간라인이다. 이들 경우에서는, 전체적인 PN 시퀀스 미스얼라인먼트를 피하기 위해, 얼라인먼트에서의 변화(상기 예에서는 6.66 ms)에 대응하는 PN 마스크에서의 변화를 필요로 한다. 송신기 PN 오프셋만으로 얻어진 마스크 대신에, 상기 프로그램된 마스크는, 모든 이전의 슬롯 모듈로 PN 시퀀스 주기를 가로질러 적분된 프로그램된 슬립 간격들의 나머지를 트래킹하는 페이저 성분과 결합된 송신기 PN 오프셋으로부터 얻어진 베이스 PN 오프셋으로 이루어진다. 다른 방법으로는, 핑거의 PN 상태 및 시간계수기를, 상기 동일한 나머지내에 인수분해된 값들의 직접 기입을 통해, 또는 마이크로 프로세서에 의해 명령을 받은 타이밍 조절을 통해 간접적으로, 조절할 수 있다. 후자의 기술은, 여기서 참조하고, 본 발명의 양수인에게 양도되며, 1998년 7월 13일 특허 허여된 발명의 명칭이 "고속 오프셋 조절을 갖는 2의 누승(power-of-two) 길이 의사잡음 시퀀스 생성기"인 미국 특허 제 5,228,054 호공보에 설명되어 있다.
상술한 바람직한 실시예에서는, 복수의 핑거들 중 하나의 핑거를 이용하여 콤바이너 시간계수기를 재초기화한다. 바람직한 실시예에서는, 콤바이너 시간기준을 조절하는 상기 간접적인 방법을 이용하지만, 지연된 카운트로 콤바이너 시간기준의 직접적인 겹쳐쓰기 등의, 다른 수단도 본 발명의 범위내에서 구현할 수 있다.
도 5 는 본 발명의 다른 실시예의 시간라인을 나타낸다. 이 실시예에서는, 아이들 페이지 메시지 타이밍을 이용하여 도 3 에 도시된 것보다 더 빨리 이동 지국이 슬립 상태로 다시 되돌아가도록 한다. 통상적으로 아이들 페이지 메시지의 파싱은 약 30 ms 정도에서 종료되므로, 슬립 계수기 재초기화 및 RF 파워다운은, 26.66 ms 더하기 6.66 ms, 즉 33.33 ms 에서 일어나게 된다. 추가된 6.6 ms 에 대해서는, 아래의 단계들에서 더욱 완전하게 설명한다.
도 6 은 본 발명의 방금 상술한 다른 실시예를 실시하는 데에 필요한 단계들을 도시하는 흐름도이다. 상기 프로세스는, 이동 지국이 파워 온될 때 블록 (400) 에서 시작한다. 블록 (400) 으로부터 블록 (402) 로 진행되며, 아날로그 수신기 체인을 초기화한다. 블록 (402) 로부터 블록 (404) 로 진행되며, 검색기는 모든 가능한 PN 오프셋들을 검색하게 된다. 그 후, 블록 (406) 으로 진행되며, 검색기에 의해 찾아낸 가장 바람직한 다중경로 신호를 핑거에 할당한다. 블록 (408) 로 진행하여, 동기 채널 디코드를 시작한다. 블록 (408) 로부터 블록 (410) 으로 진행하고, 가장 빠른 다중경로를 트래킹하는 핑거를 이용하여 콤바이너 시간계수기를 리셋한다. 체인지 서브스테이트 타이밍인, 블록 (412) 로 진행한다. 일단 체인지 서브스테이트 타이밍이 종료되면, 블록 (414) 로 진행하여 복조에서 이용되는 것들로부터 하나의 핑거를 6.66 ms 지연시킨다. 상기 핑거는 복조에 이용되지 않게 된다. 블록 (416) 으로 진행한다.
블록 (416) 에서는, 페이징 메시지 디코딩을 시작한다. 페이징 채널이 아이들인지를 블록 (418) 에서 판정한다. 만일 그런 경우, 아래에 설명하는 바와 같이, 블록 (432b) 로 진행한다. 그렇지 않은 경우에는, 특정 이동 지국으로 일반 페이지가 향하는지를 블록 (420) 에서 판정한다. 그렇지 않은 경우, 블록 (424) 로 진행한다. 만일 그런 경우에는, 블록 (422) 로 진행하고, 페이지에 응답하여 활성호출 상태를 입력한다.
블록 (424) 에서는, 페이지가 오버헤드 페이지인지를 판정한다. 그렇지 않은 경우, 블록 (428) 로 진행한다. 만일 그런 경우에는, 블록 (426) 내의 시스템 변수들을 갱신한 후 블록 (428) 로 진행한다.
블록 (428) 에서는, 임의의 추가 페이지 메시지들이 존재하는지를 판정한다. 만일 그런 경우, 블록 (416) 으로 되돌아가서 후속하는 단계들을 반복한다. 그렇지 않은 경우에는, 블록 (430) 으로 진행하고, 가장 빠른 다중경로를 트래킹하는 핑거를 이용하여 콤바이너 시간계수기를 리셋한다. 블록 (432c) 로 진행한다.
블록 (432c) 에서는, 26.66 ms 의 배수로 슬립 계수기를 프로그램한다. 블록 (434) 로 진행하여, 다중경로 오프셋을 저장하고 루프 클로즈드 루프값들을 트랙한다. 블록 (436b) 로 진행하고 26.66 ms 경계에서 콤바이너 대기하여 슬립을 시작한다. 통상적으로, 채널이 아이들인 경우 슬롯 경계 후 33.33 ms 로 되며, 채널이 활성 페이징인 경우에는 슬롯 경계 후 53.33 ms 로 된다. 블록 (438) 로 진행하여, 복조기 클록을 디스에이블시키고, 아날로그 수신기 체인을 파워다운한다. 블록 (440) 으로 진행하여 RF 웜업 시간보다 짧은 슬립 계수기 기간동안 대기한다. 블록 (442) 로 진행하고, 이전의 클로즈드 루프값들을 이용하여 아날로그 수신기 채널을 초기화한다. 블록 (444) 로 진행하여, 슬롯 경계 이전 26.66 ms 까지 대기한다. 블록 (446) 으로 진행하여 복조기 클록을 인에이블시킨다. 블록 (448) 로 진행하여, 슬립 기간이 26.66 ms 의 배수가 아닌 경우 핑거 및 검색기 PN 마스크를 시프트시킨다. 블록 (450) 으로 진행하여, 이전 다중경로 상에 집중된 PN 오프셋 윈도우를 검색한다. 블록 (452) 로 진행하여 다중경로에 핑거들을 할당한다. 블록 (454) 로 진행하고, 지연된 핑거를 이용하여 콤바이너 시간계수기를 리셋한다. 블록 (456) 으로 진행하여, 슬롯 경계 이전 20 ms 에서 디인터리버 프레임 경계를 대기한다. 블록 (430) 으로 진행하고, 가장 빠른 다중경로를 트래킹하는 핑거를 이용하여 콤바이너 시간계수기를 리셋한다. 블록 (458) 로 진행하고, 지연된 핑거를 조절하여 재획득된 다중경로로부터 6.66 ms 지연되도록 한다. 블록 (460) 으로 진행하여 슬롯 경계를 대기하면서 비터비 디코더 상태 미터를 초기화한다. 이제, 블록 (416) 으로 되돌아가 페이징 메시지 디코딩 및 상술한 후속 단계들을 시작한다.
바람직한 실시예들의 상술한 설명은, 당해 기술분야에서 숙련된 사람들은 누구나 본 발명을 실시하거나 이용할 수 있도록 제공된다. 이들 실시예들에 대한여러 변형예들은, 당해 기술분야에서 숙련된 사람들에게는 명백하며, 여기서 정의된 일반 원리들은 창조적인 기술을 이용하지 않아도 다른 실시예들에 적용될 수 있다. 따라서, 본 발명은 여기서 개시된 실시예들에 한정되지 않으며, 여기서 개시된 원리들 및 새로운 특징들과 부합하는 가장 넓은 범위와 부합하게 된다.

Claims (14)

  1. 슬롯 페이징 메커니즘을 이용하여 통신 시스템내의 슬롯의 활성 단계에서 이동 수신기가 소비하는 시간량을 감소시키기 위한 기술로서,
    프레임 간격의 정수배가 아닌 슬립 기간에 대해 디인터리버 시간 기준을 조절하는 수단; 및
    PN 시퀀스 주기의 정수배가 아닌 슬립 기간을 보상하기 위하여 핑거들의 타이밍 기준을 조절하는 수단을 구비하는 것을 특징으로 하는 기술.
  2. 만일 존재한다면, 아날로그 수신기 체인의 주파수 트래킹, 이득 스케일링, 및 DC 바이어스 루프들을 초기화하여 이들 루프들을 리-로크하는 데에 필요한 시간을 최소화하는 수단을 더 구비하는 것을 특징으로 하는 제 1 항의 기술을 이용한 회로.
  3. 페이지 메시지를 수신하는 방법으로서,
    a) PN 시퀀스 기간과 동일한 페이지 메시지 이전 시간에 회로를 활성화시키는 단계; 및
    b) 더 이상 처리가 필요하지 않음을 메시지가 나타내면 회로를 비활성화시키는 단계를 포함하는 것을 특징으로 하는 방법.
  4. 단계 a) 는,
    a) 제 1 복조기 핑거를 이용하여 PN 시작 코드 시간에서 복조하는 단계;
    b) 제 2 디모드 핑거를 이용하여 디인터리버 경계에서 제 2 PN 코드를 생성하는 단계를 포함하는 것을 특징으로 하는 제 1 항의 기술을 이용한 방법.
  5. 제 3 항에 있어서,
    페이지 메시지를 디코딩하는 단계를 더 포함하는 것을 특징으로 하는 방법.
  6. 제 3 항에 있어서,
    상기 메시지는, 다른 가입자 유닛으로 상기 메시지가 향할 때, 더 이상 처리가 필요없음을 나타내는 것을 특징으로 하는 방법.
  7. 페이지 메시지를 수신하는 가입자 유닛으로서,
    PN 시퀀스 기간과 동일한 페이지 메시지 이전 시간에 회로를 활성화시키는 수단; 및
    더 이상 처리가 필요없음을 메시지가 나타내면 상기 회로를 비활성화시키는 수단을 구비하는 것을 특징으로 하는 가입자 유닛.
  8. 단계 a) 는,
    제 1 복조기 핑거를 이용하여 PN 시작 코드 시간에서 복조하는 수단; 및
    제 2 디모드 핑거를 이용하여 디인터리버 경계에서 제 2 PN 코드를 생성하는 수단을 포함하는 것을 특징으로 하는 제 3 항의 방법을 이용한 가입자 유닛.
  9. 페이지 메시지를 디코딩하는 수단을 더 구비하는 것을 특징으로 하는 제 3 항의 방법을 이용한 가입자 유닛.
  10. 상기 메시지는, 다른 가입자 유닛으로 상기 메시지가 향할 때, 더 이상 처리가 필요하지 않음을 나타내는 것을 특징으로 하는 제 3 항의 방법을 이용한 가입자 유닛.
  11. 이동 지국에서 단속적으로 데이터를 수신하는 방법으로서,
    a) 슬립 기간을 계산하는 단계;
    b) 상기 슬립 기간의 끝에서 존재하는 디인터리버 상태를 계산하는 단계;
    c) 상기 슬립 기간의 끝에서 존재하는 PN 코드 상태를 계산하는 단계;
    d) 상기 슬립 기간 동안 슬립하는 단계;
    e) 상기 디인터리버 상태에서는 디인터리버를 이용하며 상기 복조기 PN 코드 상태에서는 복조기를 이용하여 수신된 신호를 처리하는 단계를 포함하는 것을 특징으로 하는 방법.
  12. 이동 지국에서 단속적으로 데이터를 수신하는 방법으로서,
    a) 20 ms 의 배수인 슬립 기간을 계산하는 단계;
    b) 상기 슬립 기간의 끝에서 존재하는 PN 코드 상태를 계산하는 단계;
    c) 상기 슬립 기간동안 슬립하는 단계;
    d) 상기 복조기 PN 코드 상태에서 복조기를 이용하여 수신된 신호를 처리하는 단계를 포함하는 것을 특징으로 하는 방법.
  13. 이동 지국에서 단속적으로 데이터를 수신하는 방법으로서,
    a) 26 2/3 밀리초의 배수인 슬립 기간을 계산하는 단계;
    b) 상기 슬립 기간의 끝에서 존재하는 디인터리버 상태를 계산하는 단계;
    c) 상기 슬립 기간동안 슬립하는 단계;
    d) 상기 디인터리버 상태에서 디인터리버를 이용하여 수신된 신호를 처리하는 단계를 포함하는 것을 특징으로 하는 방법.
  14. 복수의 복조 핑거들을 포함한 이동 지국에서 단속적으로 데이터를 수신하는 방법으로서,
    a) 26 2/3 밀리초의 배수인 슬립 기간을 계산하는 단계;
    b) 복수의 정렬된 핑거들을 시간 기준으로 프로그램하는 단계;
    c) 하나의 지연 핑거를 상기 정렬된 핑거들로부터 6 2/3 밀리초 지연되도록 프로그램하는 단계;
    d) 상기 슬립 기간동안 슬립하는 단계;
    e) 상기 지연된 핑거로부터 타이밍에 기초하여 디인터리버 타이머계수기를 리셋하는 단계를 포함하는 것을 특징으로 하는 방법.
KR1020017000687A 1998-07-17 1999-07-15 슬롯 페이징을 이용하는 무선 통신장치에서 어웨이크 시간을 감소시키는 기술 KR100663247B1 (ko)

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US09/118,750 US6590886B1 (en) 1998-07-17 1998-07-17 Technique for reduction of awake time in a wireless communication device utilizing slotted paging
US09/118,750 1998-07-17

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