KR20010034181A - 정보신호에 대한 보조 데이터의 삽입 및 추출 - Google Patents

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린나르츠요한피.엠.지.
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요트.게.아. 롤페즈
코닌클리케 필립스 일렉트로닉스 엔.브이.
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Abstract

본 발명에서는 시그마-델타 변조된 오디오 신호와 같은 정보신호에 대한 보조 데이터를 삽입하기 위한 방법 및 장치가 개시되어 있다. 인코딩된 신호는 2개 이상의 채널, 예컨대 좌측 채널 비트 스트림(z1)과 우측 채널 비트 스트림(z2)을 포함한다. 동일한 보조 데이터(w)는 해당 소정 비트 위치, 예를 들면, 비트 스트림의 매 M 번째 위치에 포함된다. 이것은 신호내의 동기 패턴을 포함할 필요 없이 보조 데이터의 검출 및 추출을 허용한다. 수신 끝에, 제 1 채널로부터 M번째 비트의 시퀀스는 제 2 채널로부터 M 번째 비트의 대응 시퀀스와 비교된다. 이 비교에 의해 그 시퀀스들이 동일한 경우, 그 시퀀스는 후보 보조 데이터 시퀀스이다. 이는, 보조 데이터가 발견될 때까지 다른 시퀀스 위치(m)를 위해 행해진다.

Description

정보신호에 대한 보조 데이터의 삽입 및 추출{EMBEDDING AND EXTRACTING SUPPLEMENTAL DATA IN AN INFORMATION SIGNAL}
복수의 워터마크(watermark)를 오디오 및 비디오 신호에 포함시킬 필요성이 증대하고 있다. 워터마크는, 바람직하게는 시각적으로 인지할 수 없는 방법으로 멀티미디어 저작물에 삽입되는 보조 데이터 메시지를 의미한다. 이러한 워터마크는, 예를 들어 문서와 오디오비주얼 프로그램의 출처 또는 저작권 상태에 대한 정보를 포함한다. 이들은 저작권자를 법적으로 증명하는데 사용될 수 있고, 해적행위를 추적할 수 있도록 하며, 지적 재산권의 보호를 유지한다.
서두에서 정의된 것과 같이 정보신호 내부에 보조 데이터를 삽입하는 종래의 방법에 대해서는, 국제특허출원 WO-A-98/33324호에 개시되어 있다. 이 종래의 방법에서는, 워터마크 패턴이 (시그마) 델타 변조된 오디오 신호 내부에 삽입된다. 워터마크는 오디오 신호의 선택된 비트를 변형함으로써 인코딩된 오디오 신호 내부에 삽입된다. 예를 들면, 매 100번째 비트가 워터마크 패턴의 비트로 교체된다. 후속하는 인코딩 과정에서의 변형의 영향을 보상하기 위해, 인코딩된 오디오 신호를 변형하는 과정은 인코더의 피드백 루프 내부에서 수행된다.
이와 같은 종래의 방법은, 디지탈 다기능 디스크(Digital Versatile Disk: DVD)의 오디오 버전에 고품질 오디오를 기록하기 위해 고안된 것이다. 115 dB의 신호대 잡음비를 제공하기 위해 2,822,400 Hz(64*44,100)의 샘플링 주파수가 사용된다. 단지 1 dB을 희생시켜 시그마-델타 변조된 오디오 신호의 매 100번째 비트를 워터마크 비트로 교체하는 것은 양자화 노이즈를 증가시킨다. 이것은 초당 약 28000 비트의 워터마크 비트율에 해당한다.
전술한 특허출원 WO-A-98/33324호에는 워터마크를 추출하는 장치에 대해 개시되어 있다. 동기화 비트 패턴(이하, 간단히 동기 패턴)은 보조 데이터 비트 위치를 식별하기 위해 비트 스트림에 포함된다. 이 장치는 제산기 스테이지와 동기 검출기를 구비한다. 제산기 스테이지는, 비트율을 워터마크 비트가 이격된 만큼의 비트수(예를 들면, 신호의 매 100번째 비트가 보조 데이터 비트인 경우에는 100)로 나눈다. 이 동기 검출기는, 동기 패턴이 검출되기까지 제산기 스테이지의 위상을 변화시킨다. 이와 같은 동기 검출기는 비트 스트림의 부분을 기억하기 위해 비교적 긴 시프트 레지스터나 직렬 병렬 변환기를 포함한다. 신호의 매 M번째 비트가 보조 데이터 비트이고, 동기 패턴이 N개의 비트를 포함하는 경우에, 동기 검출기는 반드시 (N-1)·M+1개의 비트를 기억해야 한다.
독일 특허출원 DE-A-37 17 315호에는 이와 같은 동기 검출기에 대해 더 상세히 개시되어 있다. 본 문헌에서, 신호의 매 15번째 비트는 보조 비트이고, 동기 패턴은 4-비트 워드에 해당한다. 이에 따르면, 시프트 레지스터(DE-A 37 17 315의 도 2에 있는 직렬 병렬 변환기(5))는 46 비트를 유지한다.
이러한 시프트 레지스터의 길이를 감소하는 내용은, 워터마크 비트들간의 간격보다 상당히 작은 동기 패턴 비트들간의 간격으로 만들기 위한 계류중인 비공개 특허출원 PHN 17,148호에 제안되었다. 하지만, 이 방법은 코딩 성능에 영향을 미치고 시그마-델타 변조기의 신호 대 잡음비를 증가시킨다.
(발명의 요약)
본 발명은, 정보신호에 대한 보조 데이터를 삽입하기 위한 방법을 제공하여, 그 보조 데이터 비트 위치가 대체 방법으로 검출되게 하는데 목적이 있다.
상기한 목적을 달성하기 위해, 본 발명에 따른 방법은, 정보신호가 적어도 2개의 신호 채널을 포함하고, 상기 채널들의 해당 위치에 동일한 보조 데이터 샘플들을 삽입하는 단계를 포함하는 것을 특징으로 한다. 동기 패턴의 전송에 대해서는 생략할 수 있는데, 그 이유는 삽입된 워터마크 비트의 위치가, 적어도 2개의 채널 샘플이 동일한 위치에서 검색되어 쉽게 찾을 수 있기 때문이다.
정보신호로부터 보조 데이터를 추출하는 상기 방법에 대응한 본 발명의 방법은, 소정의 제 1 채널 신호 샘플들의 제 1 시퀀스와 제 2 채널 신호 샘플들의 해당제 2 시퀀스를 비교하는 단계와, 상기 제 1 및 제 2 시퀀스를 하나의 샘플 위치로 바꾸는 단계와, 그 시퀀스들이 동일하지 않는 한 상기 바뀐 제 1 및 제 2 시퀀스를 위해 상기 비교단계를 반복하는 단계를 포함한다.
본 발명은 정보신호 내부에 보조 데이터를 삽입하는 방법 및 장치에 관한 것이고, 그 정보신호의 소정 위치에 보조 데이터 샘플들을 삽입하는 단계를 포함한다. 또한 본 발명은 그와 같은 정보신호로부터 보조 데이터를 추출하는 방법 및 장치에 관한 것이다.
도 1은 본 발명에 따른 시그마-델타 변조된 오디오 신호에 보조 데이터를 삽입하기 위한 장치의 바람직한 실시예의 모식도이다.
도 2 및 도 3은 도 1에 도시된 시그마-델타 변조기의 동작을 설명하기 위한 파형도이다.
도 4는 본 발명에 따른 신호에 보조 데이터를 삽입하기 위한 장치의 동작을 설명하기 위한 파형도이다.
도 5는 신호로부터 보조 데이터를 추출하기 위한 장치의 실시예의 모식도이다.
도 6은 신호로부터 보조 데이터를 추출하기 위한 방법의 실시예를 설명하기 위한 단계들의 흐름도이다.
본 발명에 따른 시그마-델타 변조된 오디오 신호에 보조 데이터를 삽입하기 위한 장치의 바람직한 실시예의 모식도를 나타낸 도 1을 참조하여 본 발명을 설명한다. 이 장치는 좌측 채널 신호 x1와 우측 채널 신호 x2를 포함하는 스테레오 오디오 신호를 수신한다. 이 채널 x1및 x2는 각각 종래 시그마-델타 변조기(1) 및 (2)에 인가된다. 두 시그마-델타 변조기는 동일하므로 그들중 하나만을 설명하겠다.
시그마-델타 변조기(1)는, 감산기(11), 루프 필터(12), 극성 검출기(13) 및 피드백 경로(14)로 구성된다. 이때 감산기(11)는 입력신호 x1에서 인코딩된 출력신호 z1(+1V 또는 -1V 레벨을 가짐)을 뺀다. 루프 필터(12)는 차이 신호를 필터링한다. 이 필터링된 신호는, 샘플링 주파수 fs로 정해진 비율로, 비트 값 "1"(+1V) 또는 "0"(-1V)을 갖는 인코딩된 신호 y1을 생성하는 극성 검출기(13)에 인가된다.
도 2는 종래의 시그마-델타 변조기의 동작을 설명하기 위한 파형도이다. 특히, 이 도면에서는 입력신호 x와 인코딩된 신호 y를 나타낸다. 입력신호가 더 커짐에 따라, 시그마-델타 변조기는 더 많은 양의 샘플을 생성한다. 도면에 나타낸 것과 같이, -0.5V의 입력 전압은 비트 시퀀스 0001(3개의 -1V 펄스와 한 개의 +1V 펄스)로서 인코딩되고, 0V의 입력 전압은 고주파 비트 패턴 01010(교번하는 -1V 및 +1V)으로서 인코딩되며, +0.5V의 입력 전압은 비트 시퀀스 1110(3개의 +1V 펄스와 한 개의 -1V 펄스)으로서 인코딩된다.
이 인코딩된 신호는, 저역 필터를 통해 그 수신된 펄스들을 재정형하여 통과하여서 수신되는 끝에서 디코딩된다. 이러한 간단한 예에서는, 인코딩된 신호가 신호의 13개 샘플들로 평균하여서 복조된다고 가정한다. 상기한 저역 필터 동작에 의해 발생된 시간 지연은 별개로 하여, 복조된 신호 x'을 마찬가지로 도 2에 도시하였다. 따라서, 도면에 있어서, 복조된 신호 x'은 입력신호 x 와 시간 정렬된다.
변형회로 3과 4는, 극성 검출기(13)와 각 시그마-델타 변조기의 피드백 경로(14) 사이에 접속된다. 제어회로(5)에 의해 전달된 제어신호 c에 따라, 변형회로(멀티플렉서)는 인코딩된 신호 y1및 y2의 매 M번째 비트를 워터마크 비트 w로 바꾼다. 그 변형된 인코딩된 신호 z1및 z2는 멀티플렉서(6)에 의해 조합되어 수신기 또는 기억 매체의 기록물에 전송하기 위한 단일 비트 스트림을 형성한다. 워터마크 메시지 W는 제어회로(5)의 하나의 레지스터(501)에 기억된다. 이와 같은 워터마크 W를 두 변형회로(3) 및 (4)에 인가하는 것이 중요하다.
도 3은 각 변형회로가 액티브 상태일 경우, 시그마-델타 변조기의 동작을 설명하기 위한 파형도이다. 이 도면에서는 도 2에 도시된 것과 같은 입력신호 x와 변형된 인코딩된 신호 z를 나타낸다. 본 예에서는, 인코딩된 신호 y의 "-1" 샘플(20)(도 2)을 "+1" 샘플(30)로 바꾸어서 워터마크 비트 w=1을 나타낸다. 왜냐하면 이 변형은 입력으로 피드백되기 때문에, 그 결과로 그 변형의 역효과는 인코딩 단계에 의해서 보상될 것이다. 따라서, 보조 데이터 비트(3)를 바로 뒤따르는 출력신호 z의 부분은 도 2에 도시된 해당 부분과 다르다. 이에 따라, 또한 도 3의 복조된 신호 x'는 도 2의 동일 신호와 일시적으로 다르다. 도면에서 시간 정렬은 보조 데이터 비트가 삽입되기 전에 그 차이가 이미 명백해진다는 것을 주목해야 한다.
도 2 및 도 3의 비교에 의해서 알 수 있는 것과 같이, 실제 차이는 거의 알 수 없다. 샘플링 주파수 fs=2,822,400Hz(64*44,100)에서 고품질 오디오 신호들을 인코딩하기 위한 시그마-델타 변조기는 신호 대 잡음비가 115dB이다. 100샘플 당 1샘플 대체는 단지 1dB 만큼 양자화 잡음을 증가시킨다는 것을 알았다.
도 4는 도 1에 도시된 장치에 의해 생성된 멀티 채널 오디오 비트 스트림의 간단한 예를 나타낸다. 이 간단한 예에서는, 채널 비트 스트림 z1및 z2의 매 10번째 비트가 보조 데이터 비트이다. 도면에서, 삽입된 워터마크 데이터 비트들은 어두운 부분이다. 이들은 양 채널에서 동일하다. 인코딩된 신호 비트들은 일반적으로 동일하지 않다. 이는 오디오 신호가 모노 신호일 경우 실제로도 정확하다. 일련의 각 M 비트들내에 비트 위치 m은 0...M-1로 번호를 매긴다.
수신기 장치의 목적은 보조 데이터 비트들의 비트 위치(도 4의 m=2)를 식별하기 위한 것이다는 것을 알 것이다. 이 목적은, 신호 샘플 z1와 z2가 동일한 멀티 채널 비트 스트림의 비트 위치를 검색함으로써 달성된다. 이 목적이 달성되면, 이들 비트 위치를 검색하기 위한 장치를 당업자가 쉽게 설계할 수 있다. 이하, 2개의 실시예를 들어 설명하겠다.
도 5는 도 1에 도시된 인코더에 의해 생성된 비트 스트림 z로부터 보조 데이터를 추출하기 위한 장치의 하드웨어 구현의 모식도이다. 이 장치는, 그 오디오 비트 스트림 z를, 좌측 오디오 채널을 의미하는 비트 스트림 z1과 우측 오디오 채널을 의미하는 비트 스트림 z2로 역다중화하기 위한 디멀티플렉서(50)를 구비한다. 이 장치는 1/M 카운터(51)를 더 구비한다. M 번째 비트 주기마다 상기 카운터는 테스트할 현재 비트 위치 m(m=0..., M-1)을 의미하는 타이밍 펄스를 발생한다. 이때 상기 비트 스트림 z1와 z2는 비교기(52)에 인가된다. 위 타이밍 펄스 m에 따라, 비교기는 현재 인가된 비트들이 동일한 경우 펄스 EQ를, 또는 그들이 다른 경우 펄스 NQ를 발생한다.
그 비트들이 동일한 경우, 그들은 위치 워터마크 비트들이다. 이 경우에, 이 위치 워터마크 비트 z2(또는 z1)는 EQ 펄스에 따라 시프트 레지스터(53)에서 시프트된다. 다음 타이밍 펄스가 M 비트 주기 후에 발생한다. 이에 따라, z1의 매 M번째 비트와 z2의 대응 비트가 동일한 경우, 시프트 레지스터에서 특정 비트가 시프트된다. 그 비트가 동일하지 않은 경우, 비교기(52)는 펄스 NQ를 발생한다. 이때의 펄스는 카운터(51)의 시프트 입력 S에 인가되어서 그 1/M 카운터의 위상이 1비트 주기씩 시프트된다. 또한 펄스 NQ는 시프트 레지스터(53)의 클리어 입력 C에 인가되어 레지스터를 클리어시킨다.
도 5에 도시된 장치는 간단하고 비용면에서 효과가 있지만, 워터마크 비트 위치를 발견할 때까지 비교적 긴 시간 주기를 관측해야 하고, 워터마크 메시지를 초기부터 완전히 획득하지 못한다는 단점을 갖는다. 그 장치가 워터마크 비트 위치를 발견할 때까지 관측해야 할 예상 시간은, 워터마크 비트가 이격된 만큼의 비트 수(M)와 두 채널의 비트들이 동일(시그마-델타 변조된 오디오 신호들의 경우 p=1/2)할 확률(p)에 의존한다. 오류 록(false lock)이 인식되기까지의 시간의 예상 주기는 다음과 같다.
워터마크 비트 위치를 검출하기 위한 시간의 평균 주기는 다음과 같다.
다수의 병렬 검출회로를 사용하여, 바뀐 위치 워터마크 비트들의 시퀀스를 각각 처리하면, 워터마크의 검출 및 추출을 가속할 수 있다.
또한 워터마크의 검출 및 추출은 적절한 소프트웨어 프로그램이 로드된 마이크로프로세서에 의해서 수행할 수 있다. 도 6은 본 장치의 다른 실시예에 따라 그와 같은 마이크로프로세서에 의해 수행되는 동작 단계들의 흐름도이다. 또 각 채널 비트 스트림의 매 M 번째 비트를 워터마크 비트라고 가정한다.
마이크로프로세서는, 각 비트 위치 m(m=0...,M-1, 도 4 참조)을 위해, 상기 비트 위치의 위치 워터마크 비트가 (R(m)=1)인지 아니면 (R(m)=0)인지를 나타내기 위해 배열 요소 R(m)을 사용한다. 먼저 이 프로그램의 단계 60에서는 테스트할 비트 위치 m을 초기값 0으로 둔다. 그리고나서 이 프로그램에서는 채널 비트 스트림 z1및 z2로부터 새로운 비트의 수신을 기다린다. 단계 61에서는 양 비트를 비교한다. 그들이 동일한 경우, 후술할 선택적 단계 63을 수행한다. 이때의 해당 배열 요소 R(m)은 영향을 받지 않는다. 채널 비트가 동일하지 않을 경우, 해당 배열 요소 R(m)은, 현재 비트 위치 M이 찾으려는 워터마크 비트 위치가 명확히 아닌 것을 나타내기 위해 0 값(단계 64)으로 주어진다. 단계 65에서는, 그 비트 위치를 증가시킨다. 단계 66에서는, 그 증가된 비트 위치가 여전히 0...,M-1 범위 내에 있는지를 판단한다. 그 증가된 비트 위치가 그 범위 내에 있을 경우, 프로그램은 단계 62로 되돌아가서 다음 비트 위치를 테스트한다. 만약 그 증가된 비트 위치가 그 범위 내에 있지 않을 경우, 프로그램은 먼저 후술할 선택적 단계 67을 수행하고 나서, 단계 61(비트 위치 수 m이 리셋됨)로 되돌아가서 일련의 다음 M 채널 비트들을 테스트한다.
이와 같은 방법으로 먼저 일련의 M 채널 비트들을 처리한 후, 다수의 비트 위치는 워터마크 비트 위치가 아니다라는 것을 알았다. 도 4에 도시된 예를 참조하여, 이것을 비트 위치 1, 5 및 7에 적용한다. 이때의 해당 배열 요소 R(1), R(5) 및 R(7)은 0 값을 얻고, 상기 위치의 비트가 나중에 동일하더라도 더 이상 변화하지 않을 것이다.
일련의 M 채널 비트가 처리될 때마다, 그 이상의 많은 비트 위치는 후보 워터마크 비트 위치가 되는 것으로부터 제외될 것이다. 도 4에 도시된 예에서는 비트 위치 0, 4, 8 및 9가 제 2 런(run) 동안에 제외되고, 비트 위치 6은 제 3 런 동안에 제외되고, 마지막으로 비트 위치 3은 제 4 런 동안에 제외될 것이다. 본 장치는 이 간단한 실시예에서 워터마크 비트 위치 m=2라는 것을 알았다.
도 6에 도시된 방법은, 하나의 배열 요소 R(m)이 1 값을 갖고 모든 다른 배열 요소들이 0값을 갖자마자 워터마크 비트 위치 m을 검출한다. 이를 나타내기 위해서, 프로그램은 모든 배열요소의 합이 1인지를 테스트하는 처리 단계 67을 더 포함한다. 이 처리 단계 67은 프로그램의 여러 위치에 위치할 수도 있다. 이 실시예에서, 비트 위치 m을 M값으로 가정할 때, 즉 일련의 M 후보 비트 위치가 처리될 때마다 테스트를 수행한다.
워터마크 데이터 메시지의 획득은 워터마크 비트 위치가 발견될 때까지 연기해도 된다. 하지만, 그것의 위치를 검색하는 동안에 워터마크 메시지를 얻는 것이 가능하다. 이 때문에, 본 장치는 지금까지 수신된 각 후보 워터마크 메시지가 획득된 그 이상의 배열 W를 포함한다. 이 때문에, 도 6에 도시된 프로그램은 현재 수신된 메시지에 그 수신된 워터마크 비트 w를 가산하는 단계 63을 포함한다. 워터마크 비트 위치 m이 발견되자마자, 해당 배열 요소 W(m)는 이미 지금까지 수신된 워터마크 메시지를 획득한다.
워터마크 비트 위치를 검출하기 위한 장치는, 채널중의 하나에서 임시 시프트가 일어났는지를 더 연장하여 판단할 수 있다는 것을 주목해야 한다. 예를 들면, 워터마크가 3개 이상의 채널에 삽입되는 경우, 본 장치를 그 채널중 하나의 오프셋 검색하도록 구성할 수 있다. 또는 본 장치는, 워터마크가 신호의 소정 부분에 또는 시간의 소정 주기 내에 확인되지 않은 경우, 그 채널들 중의 하나에 시프트를 고의로 유도하도록 구성된다.
본 발명은 시그마-델타 변조된(단일 비트로 코딩된) 두 개의 채널 오디오 신호를 참조하여 설명하였지만, 이는 오디오 또는 단일 비트로 코딩된 신호로 한정하는 것이 아니다. 이 신호 샘플은 멀티 비트 샘플들(예 : PCM 샘플)일 수도 있고, 그 워터마크는 상기 샘플들의 하나 이상의 하위 비트들에 삽입될 수도 있다. 그 코딩 알고리듬은 관계없고(예를 들면, 그것은 펄스 코드 변조일 수 있음), 인코더의 피드백 루프내에서 보조 데이터를 삽입하는 단계를 수행할 필요도 없다. 이러한 본 발명의 중요한 특징은 동일한 보조 데이터 샘플들은 멀티 채널 정보 신호의 2개 이상의 채널의 해당 위치에 삽입된다는 것이다.
요약하면, 시그마-델타 변조된 오디오 신호와 같은 정보신호에 보조 데이터를 삽입하기 위한 방법 및 장치가 개시되어 있다. 이 인코딩된 신호는 2개 이상의 채널, 예를 들면 좌측 채널 비트 스트림(z1)과 우측 채널 비트 스트림(z2)을 포함한다. 동일한 보조 데이터(w)는, 해당 소정 비트 위치, 예를 들면 비트 스트림의 매 M 번째 비트 위치에 포함된다. 이는 신호내의 동기 패턴을 포함할 필요없이 보조 데이터의 검출 및 추출을 허용한다. 수신 끝에, 첫 번째로부터 M 번째 비트의 시퀀스는 두 번째 채널로부터 M 번째 비트의 대응 시퀀스와 비교된다. 이 비교에 의해 이들 시퀀스가 동일한 경우, 시퀀스는 후보 보조 데이터 시퀀스이다. 이는 다른 시퀀스 위치(m)를 위해 그 보조 데이터가 발견될 때까지 행해진다.

Claims (10)

  1. 정보신호의 소정 위치에 보조 데이터 샘플들(w)을 삽입하는 단계(3, 4)를 포함하는 상기 정보신호(z)에 대한 보조 데이터(W)를 삽입하기 위한 방법에 있어서,
    상기 정보신호는 적어도 2개의 신호 채널(z1, z2)을 포함하고, 상기 채널들의 해당 위치에 동일한 보조 데이터 샘플들(w)을 삽입하는 단계를 포함한 것을 특징으로 하는 방법.
  2. 제 1 항에 있어서,
    상기 채널들은 스테레오 오디오 신호의 좌우측 오디오 신호 성분이 있고, 각 채널(x1, x2)을 각 비트 스트림(y1, y2)으로 인코딩하고(1, 2), 상기 비트 스트림의 해당 비트 위치에 동일한 보조 데이터(w)를 삽입하는(3, 4) 단계를 포함한 것을 특징으로 하는 방법.
  3. 정보신호의 소정 위치에 보조 데이터 샘플들(w)을 삽입하기 위한 수단(3, 4)을 포함하는 상기 정보신호에 대한 보조 데이터를 삽입하기 위한 장치에 있어서,
    상기 정보신호는 적어도 2개의 신호 채널(z1, z2)을 포함하고, 상기 삽입수단 (3, 4)은 상기 채널들의 해당 위치에 동일한 보조 데이터 샘플들(w)을 삽입하기 위해 구성된 것을 특징으로 하는 장치.
  4. 제 3 항에 있어서,
    상기 채널들은 스테레오 오디오 신호의 좌우측 오디오 신호 성분이 있고, 각 채널(x1, x2)을 각 비트 스트림(y1, y2)으로 인코딩하고(1, 2), 상기 비트 스트림의 해당 비트 위치에 동일한 보조 데이터(w)를 삽입하기(3, 4) 위한 수단을 포함한 것을 특징으로 하는 장치.
  5. 소정 신호 샘플 위치에 삽입된 동일한 보조 데이터 샘플들(w)을 각각 갖는 적어도 제 1(z1) 및 제 2(z2) 채널을 포함하는 정보신호로부터 보조 데이터를 추출하기 위한 방법에 있어서,
    - 신호 샘플들의 수(M)에 의해 이격된 소정의 제 1 채널 신호 샘플들의 제 1 시퀀스와 제 2 채널 신호 샘플들의 해당 제 2 시퀀스를 비교하는 단계(52; 62)와,
    - 상기 제 1 및 제 2 시퀀스를 하나의 샘플 위치로 바꾸고, 시퀀스들이 동일하지 않으면 상기 바뀐 제 1 및 제 2 시퀀스를 위한 상기 비교 단계를 반복하는 단계(51; 65)를 포함하는 것을 특징으로 하는 방법.
  6. 제 5 항에 있어서,
    비교될 시퀀스들에서 동일한 신호 데이터 샘플들을 기억하는 단계(53; 63)를 더 포함한 것을 특징으로 하는 방법.
  7. 소정 신호 샘플 위치에 삽입된 동일한 보조 데이터 샘플들(w)을 각각 갖는 적어도 제 1(z1) 및 제 2(z2) 채널을 포함하는 정보신호로 부터 보조 데이터를 추출하기 위한 장치에 있어서,
    - 소정의 제 1 채널 신호 샘플들의 제 1 시퀀스와 제 2 채널 신호 샘플들의 해당 제 2 시퀀스를 비교하기 위한 수단(52; 62)과,
    - 상기 제 1 및 제 2 시퀀스를 하나의 샘플 위치로 바꾸고, 그 시퀀스들이 동일하지 않으면 상기 바뀐 제 1 및 제 2 시퀀스를 위한 상기 비교 단계를 반복하기 위한 수단(51; 65)을 포함한 것을 특징으로 하는 장치.
  8. 정보신호의 소정 위치에 삽입된 보조 데이터 샘플들을 갖는 정보신호에 있어서,
    상기 정보신호는 적어도 2개의 채널을 포함하고, 상기 동일한 보조 데이터 샘플들은 상기 채널들의 해당 위치에 삽입된 것을 특징으로 하는 정보신호.
  9. 제 3 항에 있어서,
    상기 채널들은 스테레오 오디오 신호의 좌우측 오디오 신호 성분이고, 각 성분은 각 비트 스트림으로 인코딩되고, 상기 동일한 보조 데이터 비트들은 상기 비트 스트림의 소정 비트 위치에 삽입되는 것을 특징으로 하는 정보신호.
  10. 청구항 8 또는 9에 기재된 신호가 기록된 것을 특징으로 하는 기억 매체.
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