KR19980701974A - 이용자 전제 장치용 다중 타임 슬롯 리턴 채널을 갖는 포인트 투 멀티포인트 광대역 서비스 드롭 - Google Patents

이용자 전제 장치용 다중 타임 슬롯 리턴 채널을 갖는 포인트 투 멀티포인트 광대역 서비스 드롭 Download PDF

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토마스 조엘 롱
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존스 제이 리챠드
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Abstract

통신 시스템에서의 원격 사이트는 실드안된 트위스트 페어로 이루어진 멀티드롭 통신 링크를 통해서 광파이버 링크에 포트되는 광네트워크부에 연결된다. 마스터 사이트(10)로부터 광네트워크에 다운링크된 광대역 정보 신호를 원격 사이트에 전송하고, 원격 사이트로부터의 리턴 메시지에 대비하기 위해, 포인트 투 멀티포인트 통신 방식이 제공된다. 이 방식에 따라, 광인터페이스부에서의 업스트림 트랜시버는 1이상의 원격 사이트에 줄 광대역 정보 신호를 포함하는 STS-1 프레임과, 멀티드롭 통신을 통해서 각 수신지 원격 사이트와 관련된 대표적인 리턴 타임 슬롯의 제어 코드를 원격 사이트에 전송한다. 원격 사이트에서, 다운스트림 트랜시버는 대표적인 리턴 타임 슬롯 제어 코드를 사용하여 업링크 슬롯된 버스 리턴 채널 상에서 그것의 전송 시간을 제어한다.

Description

이용자 전제 장치용 다중 타임 슬롯 리턴 채널을 갖는 포인트 투 멀티포인트 광대역 서비스 드롭
발명의 분야
본 발명은 일반적으로 디지탈 비디오 단자와 같은 1이상의 사용자 장치를 갖는 다수의 가입자 전제가, 광대역의 다운스트림 단부, 광파이버 전송 하이웨이, 광대역 서비스 마스터 사이트에 연결된 광대역의 업스트림 단부를 한정하는 광네트워크 인터페이스에 연결되는 광파이버 전기통신 시스템에 관한 것이다. 특히, 본 발명은 전화통신을 수행하는 것에 덧붙여, 가입자가 선택된 텔레비젼 채널을 요구하고 수신하는 이용자 전제 장치에 광네트워크 인터페이스를 연결하는 포인트 투 멀티포인트 광대역 서비스 드롭에 관한 것이다.
발명의 배경
1992년 9월 22일 발행된 제목 Fiber Optic Telecommunication System Employing Continuous Downlink, Burst Uplink Transmission Format with Preset Uplink Guard Band, R. Sharpe 등에 의해 발명된 미국 특허 5,150,247 호에(이후, 본 출원의 양도인에게 양도되며, 그것의 상세할 설명은 본 명세서에 합병된 '247 특허라고 칭한다) 기술된 바와 같이, 광파이버(또는 파이버 인 더 루프(fiber-in-the-loop : FITL)통신 시스템은 전통적인 '구리선' 전화망 및 '앤드 온(add-on)' 케이블 텔레비전 배선망(그것은 분리, 전용 도체 동축케이블을 사용한다)과 같은 다양한 통신망에 대한 광대역 대체물로서 고안되었다.
불행하게도, 광대역 네트워크를 위해 고안된 시스템을 충족시키는 비용은 그러한 방식이 종종 소스 및 검출부와 같은 다수의 광전자 및 상호접속 소자를 사용한다는 사실로 인해 비교적 고가이다. 광학 커넥터 및 광파이버 링크에 대한 스플라이스(splice)의 비용 및 서로 대향하는 링크의 단부 사이의 배선 케이블에서 그 자체의 광파이버의 수량에 더해진 경우, 그러한 다수의 소자는 전제 시스템 비용에 강한 영향을 준다. 그 결과, 1가입자를 기준으로, 소자의 총비용은 가입자마다 2개의 송수신장치 쌍을 이용할 뿐만 아니라 관례상 각 가입자에 대한 배선 케이블 내의 광파이버의 분리, 전용 쌍을 사용하는 전제 시스템의 가격표의 큰 소수부이다.
이 시스템에 필요한 광파이버 소자에 대한 비용이 많이는 경비를 줄이기 위한 하나의 접근법은 유니트마다 다수의 가입자선을 취급하며, 고도로 압축된 데이터 형식을 이용할 수 있는 신호 프로세싱 및 통신 아키텍처를 설계하는 것에 있었다. 불행하게도, 그러한 접근법은 다수의 가입자 상에서 광파이버 소자의 비용의 범위를 넓히기 위해, 이 시스템 아키텍처가 매우 복잡하게 되어, 그것을 완화하기보다는 그 비용의 문제점을 더욱 악화시키기 때문에, 사실상 자멸적이다.
이 문제점을 해결하기 위해, '247에 기술된 광파이버 전기통신 방식은 복수의 텔레비젼 및 전화신호가 다운스트림 방향으로 연속적인 시분할 형식으로 전송되는 시분할 다중 통신 방식을 사용하지만, 채널 선택 요구 및 이용자 전제 장치로부터의 전화신호는 슬롯 버스트 형식으로 다운스트림 방향으로 전송된다.
특히, 도 1을 참조하면, '247 특허 접근법을 도식적으로 나타낸 바와 같이, 마스터 사이트(10)에서 전화 및 비디오 신호가 공급되는 호스트 디지탈 단자(HDT)는 광파이버 케이블 쌍(20)에 의해 복수의 원격, 지리적으로 분리된 가입자 사이트에 링크된다. 다운스트림 방향의 전기통신 메시지(링크(12)를 통해서 중앙 오피스 스위치(14)에 의해 공급된 것과, 링크(16)를 통해서 인코드된 대표적인 텔레비젼 채널 디지탈 신호(18)에 의해 공급된 것과 같은 전화신호를 포함한다)는 제 1광파이버(12)를 통해서 마스터 사이트(10)에서 호스트 디지탈 단자로부터 다운스트림 방향으로 위치된 분할장치 사이트(23)로 연속모드 시분할 다중 형식으로 전송된다.
분할장치 사이트(23)는 다중 팬아웃, 다운링크 파이버(21) 상의 제 1공통 '분할' 포인트에 위치된 광학 분할장치(26) 및 업링크 파이버(22) 상의 제 2공통 '결합' 포인트에 위치된 다중 피드인(feed-in) 광학 결합장치(27)를 포함한다. 분할장치 사이트 내의 접속을 결합하는 이들 파이버, 즉 다운링크 및 업링크 파이버 쌍(21, 22)은 각각의 다운링크 및 업링크 파이버 링크(24, 25)에 의해 관련 광대역 서비스 드롭(35)을 통해서 1이상의 관련 가입자 전제(40)를 서비스하는 복수의 가입자 인터페이스 광네트워크부(30)에 연결된다.
마스터 사이트(10)로부터 다운링크 파이버(21) 상에 전송되는 다운링크 방향의 디지탈적으로 포맷된 전기통신 신호 프레임 내의 각각의 텔레비젼 채널은 이용자 전제 장치로부터 업링크 파이버(22) 상에 전송된 업링크 버스트 메시지 내에 포함되며, 가입자 채널 요구에 응답하여 선택된 이들 채널에 대응한다. 각 다운링크 메시지는 이 메시지가 의도하는 광네트워크부(30)를 분류하고, 디지탈 가입자 라인 패킷이 그것으로 직접 전해지도록 지정한다. 수신 광네트워크부(30)는 메시지의 내용을 디멀티플렉스하고, 각각의 텔레비젼 채널 신호 및 전화신호를 수신지 사이트(40)에서 텔레비젼 세트(43), 전환 핸드세트(미도시) 등과 관련된 TV 세트 톱 디코더(set top decoder)(41)와 같은 이용자 전제 장치(CPE)에 라우트한다.
업스트림 방향의 이용자 전제 장치로부터 마스터 사이트로의 버스트 전송은 시분할 다중 액세스 형식으로 발생한다. 연속적인 업링크 버스트 사이클의 미리 할당된 타임 슬롯에서, 가입자 사이트에는 전화채널의 샘플을 포함하는 디지탈 가입자 라인 데이터 패킷을 전송할 기회가 주어진다. 각 업링크 버스트 사이클은 네트워크 제어 및 텔레비젼 관련 신호 대해서, 경쟁원리를 기초로 하여 가입자 인터페이스 사이트에 의해 액세스할 수 있는 부가적인 타임 슬롯을 포함할 수도 있다.
'247 특허에 기술된 통신방식은 이전에 제안된 광대역 시스템에 중요한 개량을 제공하지만, 다운스트림 방향의 메시지에 이용하는 전형적인 연속 시분할 다중 형식 및 업스트림 방향의 메시지에 사용하는 슬롯 버스트 업스트림 형식은 모든 서비스 제공자에 의해 반드시 사용될 없거나 바람직하지 않을 수도 있다. 실제로, 처음의 '247 방식의 광대역 통식 산업은 다양한 데이터 형태의 전송에 적합한 국제적으로 승인된 표준, 특히 비동기 전송 모드(ATM) 데이터 셀이 전송되는 동기 광 네트워크 전송(SONET) 스트림 (STS) 베이스 전송을 발명했기 때문에, 여전히 이용자 전제 장치로부터 슬롯 버스 리턴 채널을 사용할 수 있다.
발명의 요약
본 발명에 따라, 그러한 국제적으로 승인된 기준 통신 형식, 특히 STS-1 프레임의 선택부가 드롭을 따라 관련 CPE에 업링크 버스트 전송 기회가 제공되는 타이밍 기준을 제공하는데 사용되는 상태로 복수의 이용자의 전제 장치에 ATM 셀 캡슐 밀봉된 STS-베이스 신호가 방송되는 포인트 투 멀티포인트 비동기 전송 모드(ATM) 전송 기준의 사용을 확장하도록 상기 '247에 기술된 시스템을 변경했다. STS-1 프레임의 논리적인 프레임 구조는 라인 오버헤드부와 섹션 오버헤드부로 이루어진 멀티바이트 전송 오버헤드부를 포함한다. 이 섹션 오버헤드부 내에는 사용자의 한정된 목적에 이용할 수 있는 F1 바이트가 있다. 이 F1 바이트는 슬롯 버스 리턴 채널에 대한 기준으로서 이용자의 장치 내의 회로 및 각각의 광네트워크부에 의해 사용된다.
STS-1프레임의 전송 오버헤드부는 동기 페이로드 포락선(Synchronous Payload Envelope : SPE) 전에 온다. 포인트 투 멀티포인트 비동기 전송 모드(ATM) 전송 셀은 STS-1프레임의 SPE에서 캡슐 밀봉된다. 슬롯 버스 리턴 채널의 형식은 복수의 STS-1 프레임 각각이 멀티포인트 드롭으로부터 업스트림 신호 트래픽을 수용하는데 충분한 다수의 타임 슬롯으로 분리되도록 하는 것이다. 비동기 전송모드 셀 및 관련 오버헤드가 타임 슬롯 중 하나의 슬롯동안 전송될 수 있다는 것은 업링크 방향의 채널의 데이터 속도가 충분히 크다는 것이다.
'247 특허에 기술된 시스템에서와 같이, 광네트워크부와 각 CPE 사이의 거리는 노드에서 노드까지 서로 달라, 광네트워크부에 의해 다운링크 STS 신호로부터 전송된 타이밍 기준의 전송 시간이 각 CPE에 대해서 다르고, 동일한 전송 오프셋이 리턴 채널에 대해서 발생한다. 다른 CPE의 리턴 채널에 충돌하는 것을 방지하기 위해, 보호대역은 업링크 채널 상의 연속적인 타임 슬롯의 전단부에 삽입된다. 이 보호대역은 CPE 사이의 가장 나쁜 경우의 라운드 트립(round trip) 전송 시간차를 수용하는 크기이고, CPE 대기시간에서의 어떤 변화에 대해서 준비한다.
업링크 슬롯 리턴 버스트의 각각의 데이터 세그먼트의 전단부는 멀티바이트 ATM 셀 헤더, ATM 셀 페이로드 세그먼트 및 에러 감시, 바이너리 인터리브 패리티 바이트(BIP8) 전에 오는 버스트 헤더를 포함한다. 리턴 채널 버스트 헤더는 위상 정렬용 수신장치에 의해 사용된 소정의 바이너리 패턴 프리앰블, 동기화 바이트(sync 워드) 및, 링크 관리용 다른 정보를 포함한다.
본 발명의 ATM 베이스 포인-멀티포인트 광대역 드롭 리턴 채널 제어 메카니즘은 물리적/전기적(PHY) 및 ATM 층부를 갖는 표준구성이 층을 이룬 인터페이스 모델을 한정한 국제적으로 승인된 프로토콜 및 신호 형식의 이점을 갖는다. PHY 층은 전기적 인터페이스, 프레이밍, 동기화 및 인터페이스의 액세스 기능을 제공하지만, ATM 층은 패킷 세그먼테이션(segmentation) 및 리어셈블리(reassembly)를 실행한다. ATM 포럼 기준 위원회는 ATM에 대한 유니버셜 테스트 앤드 오퍼레이션 PHY 인터페이스(Universal Test and Operations PHY Interface : UTOPIA)이라고 불려지는 ATM 층과 PHY층 사이의 인터페이스를 한정했는데, 그것은 공통 ATM 층으로부터 다중 PHY 층을 지지할 것이다.
본 발명에 따라서, '247 특허의 시스템의 광네트워크부는 ATM 셀 매입형 STS 신호 형식을 제공하도록 변경된다. 분할장치 사이트로부터 다운링크 파이버 링크에 연결된 광학 수신장치와 인터페이스하는 광네트워크부의 다운링크 단부는 전화 및 제어 채널을 전화/제어 디멀티플렉서부 또는 mux/demux부와 디멀티플렉스하고, ATM 셀을 ATM 인터페이스와 디멀티플렉스하는 디멀티플렉서에 인가된다.
ATM 인터페이스에 도달하는 ATM 셀은 ATM 셀 어드레스에 근거한 관련 셀 라우팅 정보를 갖는 UTOPIA 버스에 필터링되며, 버퍼링되고, 인가된다. UTOPIA 버스에 부착된 1이상의 복수의 PHY부는 관련 셀 라우팅 정보에 근거한 셀을 수신할 것이다. 이 ATM 인터페이스는 mux/demux 부의 업스트림 멀티플렉서부에 업스트림 또는 리턴 채널 방향의 신호를 제공한다. 업스트림 멀티플렉서의 출력은 업스트림 전송 파이버를 구동하는 광학 전송장치에 연결된다.
물리적인 인터페이스 기판에서, PHY 부는 UTOPIA 인터페이스에 결합되고, ATM 셀 스트림에 대한 물리적 인테페이스를 제공한다. 이 PHY 부는 양방향으로 각각의 전송 및 수신 필터를 통해서 단일 실드안된 트위스트 페어(unshielded twisted pair)(UTP) 상에서 양방향 전송을 허락하는 하이브리드 회로에 연결된다. 수신 필터는 수신된 신호에서 잡음 및 간섭을 받아들이지 않지만, 전송 필터는 전송신호를 대역한정한다.
각각의 PHY 부는 UTOPIA 인터페이스로부터 입력되는 광대역 서비스 드롭 ATM 데이터 스트림이 연결되는 속도 적응, 전송 선입선출(FIFO) 버퍼를 갖는 업스트림(UTP에 관하여) 트랜시버(transceiver)를 구비한다. 이 탄성 버퍼는 그 포트의 출력 데이터 속도와 관련된 속도로 판독된다. 판독 클럭 신호는 타이밍 발생기로부터 유도되고, 판독 인에이블 신호를 STS-1 프레이밍부로부터 유도된다. 이 타이밍 발생장치는 UTOPIA 인터페이스로부터 STS-1 기준 클럭을 수신한다. 멀티플렉서는 관련된 셀 지시의 시작을 가진 전송 FIFO로부터 STS-1 기준클럭을 수신한다. 멀티플렉서에 대한 제 2입력은 보조 기억수단에 저장되고, 전송 FIFO에 대기된 어떠한 셀도 없는 '공백' 셀을 수신한다. 이 멀티플렉서는 또한 헤더 오류 정정 코드(HEC)의 형태로 셀 헤더를 발생하고 삽입한다.
이 멀티플렉서의 ATM 셀 페이로드 출력은 이용자 전제 장치가 수신장치에서 거짓 셀 검출을 방지하도록 스크램블된다. 그 후, 이 스크램블된 ATM 데이터 셀은 STS-1 프레이머에 의해 STS-1 프레임 내에 삽입된다. 세분된 프레이밍 클럭을 참조하는 타임슬롯 카운터는 STS-1 프레임 내에서 사용자가 한정할 수 있는 F1 바이트를 삽입하기 위한 타이밍 신호를 제공한다.
상술한 바와 같이, F1 바이트는 CPE 장치로부터 슬롯된 버스 리턴 채널용 타임 슬롯 할당 식별자로서 사용된다. 그 후, STS-1 프레임은 SONET 프레임 동기 스크렘블러에 의해 스크램블되었고, UTP를 통해서 이용자 전제 장치에 전송하기 위한 캐리어리스 진폭 변조, 위상 변조(CAP) 인코더에 연결되었다.
ONU의 PHY 트랜시버부의 수신측에서, 수신필터의 출력은 리턴, 업링크 채널에서 활성 슬롯 횟수 동안 이용자 전제 장치로부터 수신된 CAP 변조된 신호 버스트를 복조하는 CAP 디코더에 연결된다. CPE로부터 스크램블된 리턴 채널 버스트는 리턴 채널 버스트 오버헤드로부터 ATM 셀을 디멀티플렉서하는 버스트 디멀티플렉서에 디스크램블되고 인가된다. 버스트 헤더의 디멀티플렉서된 부분은 관련 헤더 데이터 레지스터에 연결되고, 그것의 내용은 제어 마이크로프로세서에 의해 감시된다. 셀 라우터/필터부는 수신된 리턴 채널 버스트 내의 ATM 데이터 셀을 ONU의 전송 FIFO 와 같이 UTOPIA 인터페이스로부터의 신호에 의해 판독되는 수신 FIFO에 라우트한다.
텔레비젼 세트 톱 박스와 같은 이용자 전제 장치 내에 포함된 통신부는 또한 상술한 ATM 셀 매입형 STS 신호 형식에 대비하도록 변경된다. UTP 또는 동축케이블의 다운링크 단부는 실드안된 트위스트 페어 상에서 양방향 전송을 허용하도록 하이브리드 회로에 포트된다. 광네트워크부에서와 같이, 수신 필터는 수신된 신호로부터 대역외 에너지를 받아들이지 않고, 전송 필터는 전송된 신호가 대역외 방출을 잠재적으로 간섭하는 것을 절제하게 한다. 수신 필터의 출력은 다운링크(UTP 또는 동축케이블에 관한), CPE 상주 PHY 트랜시버부에 연결된다. CPE의 PHY부는 UTOPIA 인터페이스를 통해서 ATM 신호 프로세싱부에 연결된다. ATM부의 출력은 관련 비디오 장치를 구동하기 위한 동화상 엑스퍼트 그룹(Moving Pictures Experts Group : MPEG) 디코더와 같은 광대역 인터페이스 장치에 연결된다.
ONU(업스트림)의 PHY 트랜시버부와 같이, CPE 상주(다운스트림) 트랜시버 PHY부는 업스트림 광네트워크부로부터 수신된(16 CAP) 변조된 광대역 데이터 스트림를 복조하는 CAP 디코더를 구비하고, 리턴 채널 슬롯 버스트를 발생할 때 사용하기 위한 세분된 클럭을 발생하는 클럭 제산기를 포함하는 다양한 회로 소자에 회복된 클럭을 연결한다. 수신된 데이터 스트림은 수신된 SONET 프레임에 적합하고, 데이터 상의 비트 인터리브된 패리티(BIP8) 체크를 수행하는 STS-1 프레이머에 연결된다. 어떤 에러를 계속 카운트한다.
STS-1 프레이머는 회복된 클럭을 참조하여 다운스트림 신호 프로세싱 소자에 수신 바이트 클럭을 제공한다. 스크램블된 SONET 데이터 프레임은 다운링크 신호를 디스크램블하고, 디스크램블된 신호를 F1 바이트 검출기에 연결하는 STS-1 디스크램블러(scrambler)에 연결된다. F1 바이트 검출기는 디스크램블된 STS-1 프레임 오버헤드로부터 F1 바이트를 추출하고, 검출된 F1 바이트를 F1 바이트 비교기에 연결한다. 이 비교기는 F1 바이트를 사용하여 슬롯된 리턴 채널의 동작을 제어한다.
데이터 프레임은 또 STS-1 오버헤드부 내의 포인터를 사용하는 ATM 셀 페이로드 프로세서에 연결되어 상기 실질적인 (ATM) 데이터 페이로드를 포함하는 SONET 동기 페이로드 포락선을 지정한다. 그래서, 데이터 페이로드가 디스크램블되어 UTOPIA 인터페이스 상의 신호에 의해 제어되는 수신 FIFO에 연결된다. 수신 FIFO의 ATM 데이터 셀 출력은 CPE 장치의 ATM 셀 프로세싱부에 적용하기 위한 UTOPIA 인터페이스에 연결된다.
이용자가 텔레비젼 채널을 선택하는 리턴 채널에 대해서, 예를 들면, 속도 적응, 전송 FIFO는 UTOPIA 인터페이스로부터 ATM 셀을 수신하도록 연결된다. 전송 FIFO에 대한 판독 클럭은 수신 측에서의 회복된 클럭을 참조하는 클럭 제산기로부터 유도되고, 판독 인에이블 신호는 F1바이트 비교기로부터 유도된다. 전송 FIFO의 데이터 출력 경로는 헤더 오류 정정 코드(HEC)의 형태로 셀 헤더를 발생하여 삽입하는 논리회로에 연결된다. HEC 삽입 논리는 오버헤드를 포함하는 업링크 리턴 타임 슬롯을 소집하는 셀 갭슐밀봉부에 연결된다. 비트 에러 표시는 CPE의 상태에 관련된 정보를 포함하는 성능 감시 상태 바이트의 부분으로서 셀 캡슐밀봉부에 연결된다.
셀 캡슐밀봉부의 출력은 이용자 전제 장치에 포함된 수신장치에서 거짓 셀 검출을 방지하도록 ATM 셀 페이로드를 스크램블하는 ATM 자기 동기 스크램블러에 연결된다. 자기 동기 스크램블러의 출력은 회복된 클럭으로부터 유도된 세분된 클럭 신호에 의해 클럭되는 CAP 인코더(예를 들면, 4 CAP 인코더)에 연결되고, 비교기로부터 공급된 전송 인에이블 신호에 의해 인에이블된다.
상술한 바와 같이, 본 발명에 따르면, F1 바이트는 CPE 액세스 장치로부터 슬롯된 버스 리턴 채널용 타임 슬롯 식별자로서 사용된다. F1 바이트의 검출에 응답하여, F1 바이트 비교기는 업링크 채널 상에 리턴 타임 슬롯이 발생할 때 제어 전송 인에이블 신호를 제공한다. 따라서, 4 CAP 업링크 슬롯 전송은 다운링크 STS-1 프레임에서 검출된 F1 바이트에 의해 제어되는 버스트에서 발생한다.
비교기에 의해 발생된 전송 인에이블 신호의 발생 시간은 CPE 초기화 위상에 할당된 로컬 CPE ID와 F1 바이트에 수신된 CPE ID가 동시에 발생함으로써 유도된다. 4 CAP 인코더의 출력은 하이브리드 회로를 통해서 실드안된 트위스트 페어 또는 동축케이블에 적용하기 위한 전송 필터에 드라이버를 통해서 연결된다.
초기 타임 슬롯은 예를 들면, 알로하 경쟁 방식을 사용하여 초기 타임 슬롯 경쟁에 리턴 채널의 타임 슬롯중 하나를 제외함으로써 획득될 수 있다. 경쟁을 위해 타임 슬롯을 제공함으로써 신규 접속된 CPE가 이미 사용중인 CPE을 간섭하는 것을 방지한다. 일단 신규 접속된 CPE는 타임 슬롯을 획득한 후, 그 할당된 타임 슬롯은 필요에 따라 부가적인 타임 슬롯을 요구하도록 사용될 수도 있다. 본 발명의 멀티드롭(multidrop) 통신 메카니즘은 다양한 서비스 제공자로부터 신호가 공급되는 현재의 신호 드롭을 탄력적으로 수용할 수 있다.
이 목적을 위해, 다이플렉서(diplexer)는 이용자 전제에 일반적으로 설치된 전화 및 케이블 텔레비젼 신호 포트와 광네트워크부로부터 멀티드롭 링크의 실드안된 트위스트 페어를 인터페이스하는데 사용될 수도 있다. 주파수 상위 다이플렉서는 광네트워크부로부터 UTP가 접속되는 제 1업스트림 포트와, 가입자 전제에 아날로그 케이블 텔레비젼 신호를 전달하기 위한 케이블 텔레비젼 서비스 제공자에 의해 사용된 동축 케이블이 접속되는 제 2업스트림 포트를 갖는다. 다이플렉서는 또 이용자 전제 전화 장치용 트위스트 페어가 접속될 수도 있는 제 1다운 스트림, 전화 신호 포트를 포함한다. 그것은 부가적으로 텔레비젼 세트 톱 박스 또는 표준 케이블 준비 텔레비젼 세트가 접속될 수도 있는 제 2다운스트림, 동축 케이블 포트를 포함한다.
이 다이플렉서는 광네트워크 인터페이스로부터 실드안된 트위스트 페어 상에 수신된 다운스트림 방향의 16 CAP 변조된 STS-1 베이스 통신 신호 및 아날로그 케이블 텔레비젼 신호를 그것의 다운스트림 광대역 동축 케이블 출력 포트에 연결하도록 동작한다. 이 동축 케이블 포트는 동축 케이블 팬아웃 커넥터부에 연결되어, 세트 톱 박스, VCR 및 케이블 준비 텔레비젼 세트와 같은 1이상의 이용자 장치에 다중 동축 케이블 피드를 제공할 수도 있다. 이 다이플렉서는 또 광네트워크부로부터 멀티드롭 트위스트 페어 상에 수신된 전화신호를 그것의 다운스트림 전호 포트에 연결하도록 동작할 수도 있다.
다운스트림 방향에서, 다이플렉서는 세트 톱 박스의 CPE 상주 PHY부로부터의 다운스트림 방향의 4 CAP 변조된 ATM 셀 슬롯된 버스 통신 신호와 실드안된 트위스트 페어에 인가된 전화신호를 연결한다. 다운링크 방향의 16 CAP 및 업스트림 방향의 4 CAP 통신 신호의 주파수 스펙트럼 분리는 케이블 텔레비젼 서비스 제공자에 의해 공급된 아날로그 케이블 텔레비젼 신호의 대역 아래에서 각각 분리되는 것이다.
도 1은 Sharpe등이 발명한 U. S. 특허 5,150,247호에 기술된 것과 같은 광대역 광파이버 통신 시스템을 도식적으로 나타낸 도면.
도 2는 STS-1 프레임의 논리적 구조를 도식적으로 나타낸 도면.
도 3은 도 2의 STS-1 프레임의 전송 오버헤드부에 대한 정의를 기입한 테이블 1을 나타낸다.
도 4는 광파이버 링크의 다운스트림 단부에 입력되는 수신 STS-1 데이터 스트림에 따라 광네트워크부에 의해 발생된 슬롯 버스 리턴 채널의 형식을 도식적으로 나타낸 도면.
도 5는 ATM 셀 매입형 STS 신호 형식을 제공하도록 본 발명에 따른 변경을 합병하는 '247 특허의 시스템의 광네트워크부의 부분을 도식적으로 나타낸 도면.
도 6은 도 5의 PHY부(140)의 구성을 도식적으로 나타낸 도면.
도 7은 텔레비젼 세트 톱 박스와 같은 이용자 전제 장치에 포함되면, ATM 셀 매입형 STS 신호 형식을 제공하도록 본 발명에 따른 변경을 합병하는 통신부의 구성을 도식적으로 나타낸 도면.
도 8은 도 7의 CPE 통신부의 각각의 CPE 상주 PHY부(320)의 구성을 도식적으로 나타낸 도면.
도 9는 광네트워크부로부터 실드안된 트위스트 페어 멀티드롭 링크가 전형적으로 이용자 전제에 또는 부근에 제공된 전화 및 케이블 텔레비젼 신호 포트와 인터페이스되는 방법을 도식적으로 나타낸 도면.
도 10은 세트 톱 박스, VCR 및 케이블 준비 텔레비젼 세트와 같은 1이상의 이용자 장치에 다중 동축 케이블 피드를 제공하는 동축 케이블 팬아웃 커넥터부에 도 9의 다이플렉서의 결합을 도식적으로 나타낸 도면.
도 11은 다운링크 방향 16 CAP 및 업스트림 방향 4 CAP STS-1 베이스 통신 신호의 주파수 스펙트럼 분리 및 케이블 텔레비젼 서비스 제공자에 의해 공급된 아날로그 케이블 텔레비젼 신호의 밴드 하부에서의 그들의 듀얼 분리를 나타내는 도면.
상세한 설명
본 발명에 따른 ATM 셀 매입형 STS-1 베이스 광대역 서비스 드롭을 상세히 설명하기 전에, 본 발명은 우선 상기 언급된 '247 특허에 기술된 시스템의 관련 제어 소프트웨어 및 지정된 하드웨어 서브시스템 소자의 변경을 효율적으로 하는 것에 속한다. 따라서, 이 시스템 소자의 구성 및 전기통신 네트워크의 다른 통신 장치와 인터페이스되는 방법은 본 발명에 속하는 이들 상세한 설명만 나타내는 쉽게 이해가능한 블록도에 나타나 있다. 따라서, 이 도면의 블록도는 편리하게 기능적으로 분류한 시스템의 주요 소자를 나타냄으로써, 본 발명을 보다 쉽게 이해할 수 있게 한다.
간단히 상술한 바와 같이, 도 2에 도식적으로 나타낸 각각의 STS-1 프레임, 논리적인 프레임 구조는 라인 오버헤드부(53)(9바이트) 및 섹션 오버헤드부(55)(18 바이트)로 이루어진 멀티바이트(3바이트씩 9바이트) 전송 오버헤드부(51)(도 3에 나타낸 표 1에서 설명하는 정의)를 포함한다. 섹션 오버헤드부(55) 내에는 사용자의 한정된 목적을 위해 이용할 수 있는 F1 바이트가 있다. F1바이트는 슬롯 버스 리턴 채널에 대한 기준으로서 각각의 광네트워크부(30)에 의해 사용된다.
전송 오버헤드부(51)는 동기식 페이로드 포락선(SPE)(61) 앞에 오고, 그것의 전단부는 고정 스터프(stuff)부(65, 67)에 의해 분리되는 복수의 페이로드 세그먼트(64, 66, 68) 전에 오는 (9바이트) 패스 오버헤드부(63)(표 1에 설명된 정의)이다. 상기 설명된 9바이트씩 86바이트 페이로드 섹션에 대해서는, 데이터에 이용할 수 있는 784 바이트의 756 컷(cut)이 있다. 이 SPE 페이로드 섹션 내에는 포인트 투 멀티포인트 비동기식 전송 모드(ATM) 전송 표준 셀이 전송되어도 된다. 도 2에 나타낸 프레임 구조에 대해서, 상기 바이트는 좌측에서 우측, 상부에서 하부로 전송된다. 각 바이트의 비트는 가장 중요한 것부터 가장 덜 중요한 순서대로 전송된다.
도 4는 광파이버 링크의 다운스트림 단부에 입력되는 수신 STS-1 데이터 스트림에 따른 광네트워크부에 의해 발생되는 슬롯 버스 리턴 채널의 형식을 도식적으로 나타낸다. 슬롯 버스 네트워크에 있어서, 슬롯 버스 형식의 사이클 또는 반복 시간 간격이 어떤 소정의 타임 슬롯의 정수로 분리되고, 이 슬롯버스에 따른 노드(이 경우에, CPEs)는 이용가능한 타임 슬롯 중 정해진 하나의 기간동안 전송하도록 허용된다. 이 버스에 대한 액세스를 제어하기 위한 알로하(Aloha), 슬롯 알로하 예약 알로하(Slotted Aloha Reservation Aloha) 및 패킷 예약 다중 액세스(Packet Reservation Multiple Access : PRMA)와 같은 다양한 메카니즘을 이용할 수 있지만, 타임 슬롯을 획득한 노드가 전송을 완료할 때까지 그 슬롯을 보유함으로 용량을 발생하기 때문에, 후자의 방식이 바람직하다. 할당되지 않은 타임 슬롯은 요구불 대역폭을 제공하기 위해 다투게 될 것이다.
제한이 없는 예를 제공하기 위해, 입력 STS-1 프레임의 기간은 125μsec라고 간주될 것이다. 24 밀리초의 예시적인 사이클 기간을 사용하여, 192 STS-1 프레임 기간은 리턴 채널에 대해서 이용할 수 있을 것이다. 이 사이클 기간은 멀티포인트 드롭으로부터 업스트림 신호 트래픽을 수용하도록 실질적인 다수의 타임 슬롯 TS1...TSN으로 분리된다. 제한이 없는 예로서 N=64 타임 슬롯 TS1-TS64를 사용하면, 결과적으로 375μsec의 기간을 갖는 3개의 STS-1 프레임을 구비한 각 타임 슬롯으로 된다.
업링크 채널의 데이터 속도는 비동기식 전송 모드 셀 및 관련 오버헤드가 64 타임 슬롯의 각각 하나의 기간동안 전송될 수 있도록 충분히 커야 한다. 이 목적을 위해, 업링크 채널 데이터 속도는 51. 84 MB/s의 STS 비트 클럭 속도의 정해진 소수부에서, 예를 들어 1/32의 클럭속도에 달성되어 1. 62Mb/s 의 업링크 슬롯 데이터 속도를 제공한다.
'247 특허에 기술된 바와 같이, 광네트워크부와 각 CPE 사이의 거리는 노드에서 노드까지 서로 다르기 때문에, 광네트워크부에 의해 다운링크 STS 신호로부터 유도되고, 각 CPE에 전송된 타이밍 기준의 전송시간은 각 CPE에 대해서 다를 것이다. 다른 CPE의 리턴 채널에 충돌하는 것을 방지하기 위해, 보호대역(71)은 업링크 리턴 채널 상의 연속적인 타임 슬롯의 전단부에 삽입된다. 보호대역(71)의 기간은 광네트워크부와 CPE 사이의 트위스트 페어 링크상의 가장 큰 차이를 나타내는 전송 거리에 따라 성립된다. 즉, 보호대역(71)은 CPE 사이의 가장 나쁜 경우의 라운드 트립 전송 시간차를 수용하는 크기이고, CPE 대기시간에서의 어떤 변형에 대한 준비를 포함한다. 본 실시예의 파라미터에 대해서, 79μsec의 보호대역 기간을 제공함으로써, 296μsec의 ATM 셀 데이터 버스트 세그먼트 기간 또는 리턴 채널 타임 슬롯당 60 바이트의 ATM 셀 데이터를 허용할 것이다.
각 296 μsec 데이터 세그먼트(72)의 전단부는 (5바이트) 셀 헤더(75), ATM셀 페이로드 세그먼트(77) 및 바이너리 인터리브 패리티 바이트(BIP8)(78) 전에 오는 버스트 헤더(73)를 구비한 대로 도 4에 나타나 있다. 버스트 헤더(73)는 위상 정렬을 위한 수신장치에 의해 사용된 정해진 바이너리 패턴인 (3바이트)프리앰블(81)을 포함한다. 이 버스트 헤더는 동기화 바이트 또는 싱크워드(sync word)(83) 및 링크 유지보수 및 다른 기능에 대한 2개의 다른 바이트(85) 전에 온다. BIP8 바이트는 오류 감시용으로 사용된다. ATM 셀 페이로드 세그먼트(77)는 데이터의 48 바이트를 제공하여, 타임 슬롯당 총 60바이트의 상기 리턴 채널을 산출한다.
간단히 상술한 바와 같이, 본 발명의 포인트-멀티포인트 광대역 드롭 리턴 채널 제어 메카니즘은 ATM-베이스이고, 국제적으로 승인된 프로토콜 및 신호 형식의 이점을 갖는데, 그것의 표준구성은 층을 이룬 인터페이스 모델, 이하에 설명되는 물리적/전기적(PHY) 및 ATM층부를 규정하였다. PHY 층은 인터페이스, 프레이밍, 동기화 및 인터페이스의 액세스 기능을 제공하고, ATM 층은 패킷 세그먼테이션 및 재조립(패킷화)을 실행한다. ATM 포럼으로서 알려진 표준위원회는 ATM에 대한 유니버셜 테스트 앤드 오퍼레이션 PHY 인터페이스(UTOPIA)라고 칭한 PHY 층 및 ATM 층 사이의 인터페이스를 규정하였다. UTOPIA 인터페이스는 공통 ATM 층으로부터 다중 PHY 층을 지지할 것이다. 비제한적인 예로서, 표준 ATM 인터페이스는 STS-3c, DS3, STS-1 100 Mb/s 멀티모드 파이버(FDDI물리층), DS2 및 25. 92 Mb/s를 사용한다. 8비트 UTOPIA인터페이스는 155 Mb/s 데이터 전송 속도까지 지지할 수 있고, 16비트 인터페이스는 보다 높은 데이터 전송 속도를 지지할 수 있다.
도 5는 ATM 셀 매입형 STS 신호 형식에 대비하도록 본 발명에 따른 트랜시버 변경을 합병한 '247 특허의 시스템의 광네트워크부의 부분을 도식적으로 나타낸다. 받침대(23)로부터 다운링크 파이버 링크(24)에 연결된 광학 수신장치와 인터페이스되는 광네트워크부에 대한 광파이버 입력단은 링크(105) 상의 전화/제어 채널을 mux/demux 부(104)의 전화/제어 디멀티플렉서부(107)와 디멀티플렉스하고, 링크(111)상의 ATM 셀을 ATM 인터페이스(112)와 디멀티플렉스하도록 동작하는 고속 디멀티플렉서(103)에 입력(101)으로서 인가된다. ATM 인터페이스(112)는 mux/demux 부(104)의 업스트림 멀티플렉서부(109)에 링크(113) 상의 리턴 또는 업스트림 방향 신호를 제공한다. 그 후, ATM 인터페이스(112)는 UTOPIA 인터페이스(120)를 통해서 이들 셀을 후술하는 복수의 (예를 들면, 8개) PHY 부(140)를 포함하는 물리적 인터페이스 기판(138)에 전송한다.
업스트림 멀티플렉서(109)에 신호 셀을 라우팅하는 것에 덧붙여, ATM 인터페이스(112)는 마이크로프로세서(110)에 이용가능한 감시정보를 만든다. mux/demux 부(104)의 업스트림 멀티플렉서부(109)는 업링크 전송 파이버(25)를 분할장치 사이트(23)에 전송하기 위한 광학 전송장치 소스에 연결된 출력 포트(102)를 갖는다.
물리적 인터페이스 기판(138) 내에서, 도 6에 상세히 나타낸 PHY 부(140)가 UPOPIA 인터페이스(120)에 연결되고, ATM 셀 스트림에 물리적 인터페이스를 제공하도록 동작한다. PHY 부(140)는 전기적 인터페이스, 프레이밍, 동기화 및 액세스 프로토콜을 제공한다. PHY 부(140)는 각각의 필터(142, 144)를 통해서 하이브리드 회로(146)에 양방향으로 연결된다. 필터(142)는 수신된 신호에서 잡음 및 간섭을 받아들이지 않도록 동작하고, 필터(144)는 전송 신호를 대역한정하도록 동작한다. 하이브리드 회로(146)는 단일 실드안된 트위스트 페어(UTP) 상에서 양방향 전송을 허용하도록 동작한다. 하이브리드 회로(146)는 명도 보호 및 전원 크로스 보호 회로(147)를 통해서 UTP(148)에 포트되어 외부소스로부터 회로소자에 대한 손상을 방지한다.
도 6을 참조하면, 각각의 PHY 트랜시버 부의 구조는 UTOPIA 인터페이스(120)로부터 입력되는 광대역 서비스 ATM 데이터 스트림이 전송 데이터 링크(153)를 통해서 연결되는 속도 적응, 전송(Tx) 선입선출 탄성 버퍼(FIFO)(150)를 구비한 채로 도시적으로 나타나 있다. 전송 FIFO 버퍼(150)는 버스트 데이터 도착 및 서로 다른 데이터 속도를 수용하도록 동작한다. 그것은 포토의 출력 데이터 속도에 관련된 속도로 판독된다. 셀(SOC) 신호의 전송 Tx 시작점은 TxSOC 링크(155)를 통해서 전송 버퍼(150)에 연결된다. 전송 인에이블 및 전송 클럭 신호는 링크(154, 156)를 통해서 각각 FIFO(150)에 연결된다. 전송 풀 링크(157)는 전송 FIFO(150)이 완전하게 될 때를 표시하기 위해 사용된다.
각각의 판독 인에이블 및 판독 클럭 신호는 링크(161, 163)를 통해서 버퍼(150)에 연결된다. 이 판독 클럭은 타이밍 발생기(160)로부터 전송되고, 판독 인에이블 신호는 STS-1 프레이밍 부(180)로부터 전송된다. 타이밍 발생기(160)는 UTOPIA 인터페이스로부터 STS-1 기준 51. 84 MHz 클럭을 수신하도록 연결된다. 2 : 1 셀 멀티플렉서(170)는 링크(165)를 통해서 SOC 신호를 수신하도록 연결되고, 멀티플렉서(170)의 제 1입력(171)은 전송 버퍼(150)로부터 전송 데이터를 수신하도록 연결된다. 멀티플렉서(170)는 보조기억수단(미도시) 내에 저장되며, 전송 버퍼(150)에 대기된 어떠한 셀도 없는 '공백' 셀을 수신하도록 연결된 제 2입력(172)을 갖는다. 멀티플렉서(170)는 또한 셀 헤더가 불완전하면 헤더 오류 정정 모드(HEC)의 형태로 셀 헤더를 발생하여 삽입하도록 하는 논리를 포함한다.
멀티플렉서(170)의 출력(175)은 ATM 셀 페이로드를 스크램블하도록 동작하는 ATM 자기 동기 스크램블러(177)에 연결되어 이용자 전제 장치에 포함된 수신장치에서의 거짓 셀 검출을 방지한다. 자기 동기 스크램블러(177)의 출력은 STS-1 프레임 내에 ATM 셀을 삽입하도록 동작하는 STS-1 프레이머(180)에 연결되고, 그것의 형식은 상술한 도 2에 도시되어 있다. 타이밍 발생기(160)에 의해 공급되는 세분된 프레이밍 클럭(8 kHz/3)에 의해 클럭된 타임 슬롯 카운터(190)는 STS-1 프레임 내에 한정가능한 이용자 F1 바이트를 삽입하기 위한 타이밍 신호를 제공한다. 마이크로프로세서 인터페이스(240) 상에 제공되며, 타임슬롯 카운터값에 근거하여 타임슬롯 카운터(190)로부터 판독된 CPE ID 룩업 테이블(265)은 F1바이트에 전송을 위한 타임슬롯 정렬값을 제공한다.
상술한 바와 같이, 본 발명에 따르면, F1 바이트는 CPE 장치로부터 슬롯된 버스 리턴 채널용 타임 슬롯 할당 식별자로서 사용된다. STS-1 프레이머(180)의 출력은 UTP(148)를 통해서 이용자 전제 장치에 전송하기 위해, STS-1 프레임을 스크램블하고, 16 CAP인코더와 같은 캐리어리스(carrierless) 진폭 변조, 위상 변조(CAP) 인코더(195)에 스크램블된 프레임을 연결하는 표준 SONET 프레임 동기 스크램블러(192)에 연결된다. CAP 인코더(195)가 출력은 링크(197)를 통해서 전송 필터(142)에 연결된다.
PHY 트랜시버 부의 수신측에서, 수신 필터(144)의 출력은 리턴, 업링크 채널 에서 활성 슬롯 횟수 동안 이용자 전제 장치로부터 수신된 CAP 변조 신호 버스트를 복조하도록 동작하는 4 CAP 디코더와 같은 CAP 디코더(200)에 링크(198)를 통해서 연결된다. 바람직하게는, 슬롯된 리턴 버스트 신호의 데이터 속도가 전송 속도와 관련되어 있기 때문에, 수신장치에서의 주파수 회복이 요구된다. CPE로부터의 리턴 채널 버스트는 스크램블되고, 디스크램블되어야 한다.
이 목적을 위해, CAP 디코더(200)의 출력은 슬롯된 리턴 채널 신호를 디스크램블하고, 버스트 디멀티플렉서(220)에 디스크램블된 신호를 연결하는 디스크램블러(210)에 링크(201)를 통해서 연결된다. 버스트 디멀티플렉서(220)는 리턴 채널 버스트 오버헤드로부터 ATM 셀을 디멀티플렉스하도록 동작한다. 도 4를 참조하여 상술한 바와 같이, 버스트 오버헤드는 전송 감시에 관련된 정보를 포함한다.
버스트 헤더의 디멀티플렉서된 부분은 상태 레지스터(225) 및 패리티 에러 카운터(230)와 같은 관련 헤더 데이터 레지스터에 연결되고, 그것의 내용은 PHY 부 프로세서(250)를 통해서 제어 마이크로프로세서 인터페이스(240)에 의해 감시된다. 셀 필터(260)는 전송 자원의 낭비를 피하기 위해 공백 셀을 버린다. 수신 FIFO(270)은 또한 버스트 데이터 도착 및 서로다른 데이터 속도를 수용하도록 동작한다. 그것은 그 포트의 출력 데이터 속도에 관련된 속도로 판독된다.
필터 부(260)로부터 라인(271)을 통해 연결된 셀(SOC) 신호의 수신 시작점은 RxSOC 링크(275)를 통해서 수신 FIFO(270)으로부터 연결된다. 수신 인에이블 및 수신 클럭 신호는 링크(285, 286)를 통해서 UTOPIA 인터페이스로부터 수신 FIFO(270)에 연결된다. 수신 버퍼 공백 링크(287)는 수신 FIFO(270)가 공백상태에 있을 때를 표시하기 위해 사용된다. 각각의 기록 인에이블 및 기록 클럭 신호는 링크(291, 293)를 통해서 수신 FIFO(270)에 연결된다. 기록 클럭 WR Clk는 타이밍 발생기(160)로부터 유도되고, 기록 인에이블 WR en 신호는 셀 필터 부(260)로부터 유도된다. 그 데이터는 링크(278)를 통해서 출력된다.
도 7은 상술한 ATM 셀 매입형 STS 신호 형식에 대비하도록 본 발명에 따른 트랜시버 변경을 합병하는 텔레비젼 세트 톱 박스와 같은 이용자 전제 장치 내에 포함된 통신 부 또는 모듈(300)의 구성을 도식적으로 나타낸다. UTP 또는 동축케이블의 다운링크 단부에서, CPE 장치는 케이블(148) 상에서 양방향 전송을 허용하도록 동작하는 하이브리드 회로(301)를 갖는다. 하이브리드 회로(301)에는 각각 필터(302, 304)가 연결된다. 수신 필터(304)는 수신된 신호로부터 대역외 에너지를 받아들이지 않도록 동작하고, 전송 필터(304)는 전송된 신호가 수신장치, 방송 서비스를 손상시킬 수 있거나, FCC 배출 제한을 우연히 따르지 않는 대역외 배출을 방지하게 하도록 동작한다.
수신 필터(302)의 출력은 후술하는 도 8에 상세히 나타낸 CPE 상주 PHY 부(310)에 연결된다. PHY 부(310)는 UTOPIA 인터페이스(315)를 통해서 ATM 신호 프로세싱 부(320)에 연결된다. PHY 부(310)는 드라이버(314)를 통해서 전송 필터(304)에 연결된 전송 포트(312)를 갖는다. PHY 부(310) 및 ATM 신호 프로세싱 부(320) 각각은 버스(330)를 통해서 감시 제어 마이크로프로세서(340)에 연결된다. ATM 부(320)의 출력은 마이크로프로세서 버스(330)에 연결된 MPEG 디코더(331)에 연결된다.
도 8을 참조하면, 각각의 CPE 상주 PHY 트랜시버 부(320)의 구성은 CAP 디코더(400), 여기서는 다운링크 채널 상의 도 6의 광네트워크부로부터 수신된 16 CAP 변조된 51. 84 Mb/s 광대역 데이터 스트림을 복조하도록 동작하는 16 CAP 디코더를 구비한 상태로 도식적으로 나타나 있다. 신호 손실(LOS)의 경우에, LOS 신호는 링크(352)를 통해서 상태 레지스터(410)에 연결된다. 회복된 51. 84 MHz 클럭 신호는 회복된 클럭 링크(356)를 통해서 다운스트림 회로 소자에 연결된다. 또한 그것은 네트워크부의 전송장치 부분에서 사용하는 1. 62 MHz 을 발생하는 32로 나눈 제산기(415)에 연결된다.
수신된 데이터 스트림은 링크(358)를 통해서 수신된 SONET 프레임 상에 적합하게 하고, 데이터 상의 비트 인터리브된 패리티(BIP8) 체크를 수행하는 STS-1 프레이머(420)에 연결된다. 어떤 에러는 링크(362)를 통해서 B1 에러 카운터(430)에 연결된다. 또한 그것은 링크(367)를 통해서 리셋 신호를 CAP 디코더(400)에 인가한다. 프레임 손실(LOF)의 경우에, LOF 신호는 링크(364)를 통해서 상태 레지스터(410)에 연결된다.
STS 프레이머(420)는 링크(356) 상의 회복된 클럭을 참조하여, 후술하는 다운스트림 신호 프로세싱 소자에 링크(365) 상에 6. 48MHz의 수신 바이트 클럭을 제공한다. 스크램블된 SONET 데이터 프레임은 다운링크 신호를 디스크램블하고, 디스크램블된 STS-1 프레임 오버헤드를 조사하여 F1 바이트를 추출하는 F1 바이트 검출기(366)에 디스크램블된 신호를 연결하는 STS-1 디스크램블러(440)에 연결된다. 검출된 F1 바이트는 링크(368)를 통해서 후술하는 슬롯 리턴 채널의 동작을 제어하도록 F1바이트를 사용하는 비교기(450)에 연결된다.
또, 이 프레임은 STS-1 오버헤드부에서 포인터를 사용하는 셀 페이로드 프로세서(460)에 연결되어, 상술한 도 2에 도식적으로 나타낸 실질적인 데이터 페이로드를 포함하는 SONET 동기 페이로드 포락선을 식별한다. 셀 페이로드 프로세서(460)는 링크(376) 상의 셀(SOC) 신호의 시작점을 수신 FIFO(480)에 연결한다. 데이터 페이로드는 셀 페이로드를 디스크램블하여 수신 FIFO(480)에 디스크램블된 페이로드 데이터를 연결하는 셀 디스크램블러(470)에 연결된다.
수신 FIFO(480)은 버스트 데이터 도착 및 서로다른 데이터 속도를 수용하는 탄성 버퍼이다. 그것은 포트의 출력 데이터 속도와 관련된 속도로 판독된다. 수신 인에이블 및 수신 클럭 신호는 링크(385, 386) 각각을 통해서 UTOPIA 인터페이스(315)로부터 수신 FIFO(480)에 연결된다. 수신 버퍼 공백 링크(387)는 수신 FIFO(480)이 공백상태라는 것을 표시하는데 사용된다. 각각의 기록 인에이블 및 기록 클럭 신호는 링크(369, 365) 각각을 통해서 수신 FIFO(480)에 연결된다.
속도 적응, 전송 FIFO(500)은 UTOPIA 인터페이스(315)로부터 ATM 셀을 수신하도록 연결된다. 셀(SOC) 신호의 전송 Tx 시작은 TxSOC 링크(502)를 통해서 전송 버퍼(500)에 연결된다. 전송 인에이블 및 전송 클럭 신호는 링크(504, 506) 각각을 통해서 FIFO(500)에 연결된다. 전송 풀 링크(507)는 전송 FIFO(500)가 충만한 경우를 표시하기 위해 사용된다. 각각의 판독 인에이블 및 판독 클럭 신호는 링크(511, 513)를 통해서 전송 버퍼(500)에 연결된다. 판독 클럭은 32로 나눈 제산기(415)에 연결된 8로 나눈 제산기(530)로부터 유도되고, 판독 인에이블 신호는 비교기(450)으로부터 유도된다.
FIFO(500)의 데이터 출력 경로는 광네트워크부의 PHY부에서의 멀티플렉서(170)와 같이, 헤더 오류 정정 코드(HEC)의 형태로 셀 헤더를 발생하여 삽입하도록 동작하는 논리회로(540)에 연결된다. 셀 SOC 신호의 시작은 링크(541)를 통해서 상술한 도 4에 나타낸 오버헤드를 포함하는 업링크 리턴 타임 슬롯을 어셈블하는 HEC 삽입 논리회로(540) 및 셀 캡슐 밀봉부(550)에 연결된다. 비트 에러 링크(551)는 CPE의 조건에 관련이 있는 정보를 포함하는 성능 감시 상태 바이트의 부분으로서 셀 캡슐밀봉부(550)에 연결된다.
셀 캡슐밀봉부(550)의 출력은 ATM 셀 페이로드를 스크램블하는 ATM 자기 동기 스크램블러(560)에 연결되어 이용자 전제 장치에 포함된 수신장치에서 거짓 셀 검출을 방지한다. 자기 동기 스크램블러(560)의 출력은 32로 나눈 제산기(415)의 1. 62 MHz 클럭 출력에 의해 클럭되며, 비교기(450)로부터 링크 상에 공급된 전송 인에이블 신호에 의해 인에이블된 CAP-4 인코더(565)에 연결된다.
상술한 바와 같이, 본 발명에 따르면, F1 바이트는 검출된 F1 바이트가 링크(368)를 통해서 비교기(450)에 연결된 상태로 CPE 장치로부터 슬롯된 버스 리턴 채널용 타임 슬롯 할당 식별자로서 사용된다. 이 검출에 응답하여, F1 바이트 비교기는 업링크 채널 상에 리턴 타임 슬롯이 발생할 때 제어에 전송 인에이블 신호를 제공한다. 이와 같이, 4 CAP 업링크 슬롯 전송은 다운링크 STS-1 프레임에서 검출된 F1 바이트와 동기화하거나 그것을 참조한 버스트에서 발생한다.
비교기(450)에 의해 발생된 전송 인에이블 신호의 발생 시간은 관련 타임 슬롯 할당 테이블(570)에 저장된 슬롯 할당에 의해 유도되고, 그 타임 슬롯 할당 테이블(570)은 마이크로프로세서 버스(590)를 통해서 마이크로프로세서 인터페이스(600)에 의해 제공되며, 또 상기 마이크로프로세서 인터페이스(600)는 상태 레지스터(410) 및 B1 에러 카운터(430)에 연결된다. 상술한 바와 같이, 4 CAP 인코더(565)의 출력은 하이브리드 회로(300)에 적용하기 위해 드라이버(314)를 통해서 전송 필터(304)에 연결된다.
예컨대, 초기 타임 슬롯 경쟁에 알로하 경쟁 방식을 사용하여 도 4의 64 타임 슬롯중 하나를 제외함으로써 초기 타임 슬롯을 획득할 수 있다. 경쟁용 타임 슬롯을 제외함으로써, 신규 접속된 CPE가 이미 사용중인 CPE를 간섭하는 것을 방지할 수 있다. 일단 새롭게 부가된 CPE가 타임 슬롯을 요구하면, 그 할당된 타임 슬롯은 필요에 따라 부가적인 타임 슬롯을 요구하는데 사용될 수도 있다. 이들 관리기능은 마이크로프로세서 인터페이스(600)를 사용하여, 외부의 프로세서에 의해 달성될 수도 있다.
도 9는 광네트워크부로부터의 (실드안된 트위스트 페어)멀티드롭 링크가 이용자 전제에 일반적으로 제공된 전화 및 케이블 텔레비젼 신호 포트와 인터페이스되는 방법을 도식적으로 나타낸다. 여기서 나타낸 바와 같이, 주파수 상위 다이플렉서(diplexer)(600)는 광네트워크부로부터의 UTP(148)가 접속되는 제 1업스트림 포트(601) 및 이용자 전제에 아날로그 케이블 텔레비젼 신호를 전송하도록 케이블 텔레비젼 서비스 제공자에 의해 사용된 동축 케이블이 접속되는 제 2업스트림 포트(602)를 갖는다. 다이플렉서(600)는 이용자 전제 전화 장치용 트위스트 페어(604)가 접속되는 제 2업스트림, 전화 신호 포트(603)를 더 포함한다. 다이플렉서(600)는 또한 텔레비젼 세트 톱 박스 또는 표준 케이블 준비 텔레비젼 세트가 접속되는 제 2다운스트림, 동축 케이블 포트(605)를 포함한다.
그것의 각각의 업스트림 및 다운스트림 포트와 관련된 주파수 스펙트림 분리도로서 나타난 바와 같이, 다이플렉서(600)는 광네트워크 인터페이스로부터 실드안된 트위스트 페어(148) 상에 수신되고, 포트(601)에 인가된 다운스트림 방향의 16 CAP 변조된 STS-1 베이스 통신 신호와 동축 케이블 포트(602)에 인가된 아날로그 케이블 텔레비젼 신호를 (광대역)동축 케이블 출력 포트(605)에 연결하도록 동작한다. 동축 케이블 출력 포트(605)는 도 10에 도식적으로 나타낸 바와 같이, 세트 톱 박스, VCR 및 케이블 준비 텔레비젼 세트와 같은 1이상의 이용자 장치에 다중 동축 케이블 피드(607)를 제공하는 동축 케이블 팬아웃 커넥터부(606)에 연결된 것처럼 도시되어 있다. 다이플렉서(600)는 또한 멀티드롭 트위스트 페어 상에 수신된 전화 신호를 다운스트림 전화 신호 포트(603)에 연결하도록 동작한다.
업스트림 방향에서, 다이플렉서(600)는 세트 톱 박스의 CPE 상주 PHY부로부터 동축 케이블 포트(605)에 인가된 업스트림 방향의 4 CAP 변조된 STS-1 베이스 통신 신호와, 포트(603)에 인가된 전화신호를 업스트림 포트(601)가 접속되는 실드안된 트위스트 페어(148)에 연결하도록 동작한다. 도 11은 다운링크 방향의 16 CAP 및 업스트림 방향의 4 CAP ATM 베이스 통신 신호의 주파수 스펙트럼 분리와, 케이블 텔레비젼 서비스 제공자에 의해 다이플렉서 동축 케이블 포트(602)에 공급된 아날로그 케이블 텔레비젼 신호 대역 아래의 그들의 듀얼 분리를 나타낸다.
'247 특허에 기술된 광대역 통신 시스템의 변경에 관한 상기 설명으로부터 알 수 있는 것처럼, '247 특허의 시스템의 이용자 전제 장치와 관련된 세트 톱 박스 및 광네트워크부의 각각이 ATM 셀 매입형 STS 신호 형식에 대비하도록 변경되고, STS-1 프레임의 섹션 오버헤드를 제공하는 F1 바이트는 리턴 채널 타이밍 기준에 사용된다. 따라서, 본 발명은 국제적으로 승인된 표준 통신 프로토콜의 사용, 특히 ATM 셀 캡슐밀봉된 STS 베이스 신호가 복수의 이용자 전제 장치에 방송되는 포인트 투 멀티포인트 비동기 전송 모드(ATM)의 전송 표준의 사용을 확장할 수 있다.
본 발명에 따른 실시예에 설명되었고, 그것에 한정되는 것은 아니며 종래의 기술에 속하는 당업자에게서 이해할 수 있기 때문에 다양한 변형 및 변경을 할 수 있다.

Claims (30)

  1. 마스터 사이트로부터 1이상의 원격 사이트로, 또 상기 1이상의 원격 사이트로부터 상기 마스터 사이트로 광대역 통신 경로를 통해서 전기통신 메시지를 전송하고, 상기 1이상의 원격 사이트가 통신 링크를 통해서 상기 광대역 통신 경로에 포트되는 광대역 통신 경로 인터페이스 장치에 연결되도록 하는 광대역 통신 시스템을 사용하여, 상기 마스터 사이트로부터 상기 광대역 통신 경로 인터페이스 장치로, 또 상기 광대역 통신 경로 인터페이스 장치로부터 상기 1이상의 원격 사이트로 다운링크된 광대역 정보 신호를 전송하고, 상기 1이상의 원격 사이트로부터 상기 광대역 통신 경로 인터페이스 장치로 메시지 신호를 전송하여, 상기 메시지 신호가 상기 마스터 사이트에 전송되는 방법에 있어서,
    (a) 상기 광대역 통신 경로 인터페이스 장치에서, 수신지의 1이상의 원격 사이트에 대한 광대역 정보 신호를 포함하는 제 1통신 신호 및 수신지 원격 사이트와 관련된 대표적인 리턴 타임 슬롯 제어 코드를 발생하고, 멀티드롭 통신 링크를 통해서 상기 광대역 통신 경로 인터페이스 장치로부터 1이상의 원격 사이트로 상기 제 1통신 신호를 전송하는 단계와,
    (b) 수신지 원격 사이트에서, 수신된 상기 제 1통신 신호의 상기 오버헤드부에 포함된 상기 대표적인 리턴 타임 슬롯 제어 코드를 검출하고, 제 2통신 신호로서 메시지 신호를 소집하며, 상기 검출된 대표적인 리턴 타임 슬롯 제어 코드에 따라 한정된 타임 슬롯동안, 상기 멀티드롭 통신 링크를 통해서 시분할 슬롯 형식으로 상기 수신지 원격 사이트로부터 상기 광대역 통신 경로 인터페이스 장치로 상기 제 2통신 신호를 전송하는 단계를 구비한 것을 특징으로 하는 방법.
  2. 제 1 항에 있어서,
    상기 제 1 통신 신호는 동기 광 네트워크 베이스 통신 신호를 구비한 것을 특징으로 하는 방법.
  3. 제 1 항에 있어서,
    (a)단계는 상기 대표적인 리턴 타임 슬롯 제어 코드와 함께 제 1고정된 크기의 데이터 셀로서 상기 광대역 정보 신호를 상기 제 1통신 신호에 통합하는 단계와, 상기 멀티드롭 통신 링크를 통해서 상기 광대역 통신 경로 인터페이스 장치로부터 상기 1이상의 원격 사이트로 상기 제 1통신 신호를 전송하는 단계를 구비한 것을 특징으로 하는 방법.
  4. 제 3 항에 있어서,
    상기 제 1고정된 크기의 데이터 셀은 비동기 전송 모드 데이터 셀을 구비한 것을 특징으로 하는 방법.
  5. 제 4 항에 있어서,
    상기 제 1통신 신호는 동기 광 네트워크 베이스 통신 신호를 구비한 것을 특징으로 하는 방법.
  6. 제 3 항에 있어서,
    (b)단계는 제 2고정된 크기의 데이터 셀로서 상기 메시지 신호를 상기 제 2통신 신호에 소집하는 단계를 구비한 것을 특징으로 하는 방법.
  7. 제 6 항에 있어서,
    상기 제 2고정된 크기의 데이터 셀은 비동기 전송 모드 데이터 셀을 구비한 것을 특징으로 하는 방법.
  8. 제 1 항에 있어서,
    상기 1이상의 원격 사이트는 이용자 전제 광대역 통신 수신장치가 설치된 단일 원격 사이트에 대응하는 것을 특징으로 하는 방법.
  9. 제 1 항에 있어서,
    상기 1이상의 원격 사이트는 각각의 이용자 전제 광대역 통신 수신장치가 설치된 복수의 원격 사이트에 대응하는 것을 특징으로 하는 방법.
  10. 제 1 항에 있어서,
    (a)단계는 각각 서로다른 원격 사이트와 관련된 각각 서로다른 대표적인 리턴 슬롯 제어 코드를 상기 제 1통신 신호 중 연속적인 신호들의 공통 오버헤드부 내에 삽입하는 단계를 구비하고, (b)단계는 상기 원격 사이트 중 각각 서로다른 사이트에서, 수신된 상기 제 1통신 신호의 상기 공통 오버헤드부에 포함된 상기 각각 서로다른 대표적인 리턴 타임 슬롯 제어 코드를 검출하는 단계와, 상기 검출된 대표적인 리턴 슬롯 제어 코드에 따라 한정된 각각 서로다른 타임 슬롯 동안 제 2통신 신호를 전송하는 단계를 구비한 것을 특징으로 하는 방법.
  11. 제 1 항에 있어서,
    (a)단계는 브로드캐스트 케이블 텔레비젼 신호를 지정한 하부 제 1주파수 밴드에 상기 제 1통신 신호를 전송하는 단계를 구비하고, (b)단계는 브로드캐스트 케이블 텔레비젼 신호를 지정하고 상기 제 1주파수 밴드로부터 이격된 하부 제 2주파수 밴드에 상기 제 2통신 신호를 전송하는 단계를 구비한 것을 특징으로 하는 방법.
  12. 제 11 항에 있어서,
    상기 수신지 원격 사이트는 케이블 텔레비젼 서비스 제공자로부터 케이블 텔레비젼 신호가 공급되는 동축 케이블 포트와, 상기 수신지 원격 사이트에서 이용자 전제 전화장치가 접속되는 전화 신호 포트를 더 포함하고, (b)단계는 상기 동축 케이블 포트에서 상기 멀티드롭 통신 링크 상에 수신된 상기 제 1통신 신호 및 케이블 텔레비젼 신호를 광대역 출력 포트에 연결하며, 상기 멀티드롭 통신 링크 상에 수신된 전화신호를 상기 전화 신호 포트에 연결하도록 동작하는 다이플렉서 필터를 상기 동축 케이블 포트 및 상기 멀티드롭 통신 링크와 연결하는 단계를 더 포함한 것을 특징으로 하는 방법.
  13. 제 11 항에 있어서,
    (a)단계는 제 1캐리어리스 진폭 변조 위상 변조 신호로서 상기 제 1통신 신호를 전송하는 단계를 구비하고, (b)단계는 제 2캐리어리스 진폭 변조 위상 변조 신호로서 상기 제 2통신 신호를 전송하는 단계를 구비한 것을 특징으로 하는 방법.
  14. 제 1 항에 있어서,
    상기 멀티드롭 통신 링크는 실드안된 트위스트 페어를 구비한 것을 특징으로 하는 방법.
  15. 마스터 사이트로부터 1이상의 원격 사이트로, 또 상기 1이상의 원격 사이트로부터 상기 마스터 사이트로 광대역 통신 경로를 통해서 전기통신 메시지를 전송하고, 상기 원격 사이트가 멀티드롭 통신 링크를 통해서 상기 광대역 통신 경로에 포트되는 광대역 통신 경로 인터페이스 장치에 연결되도록 하는 광대역 통신 시스템을 사용하여, 상기 마스트 사이트로부터 상기 광대역 통신 경로 인터페이스 장치로, 또 상기 광대역 통신 경로 인터페이스 장치로부터 상기 1이상의 원격 사이트로 다운링크된 광대역 정보 신호를 전송하고, 상기 1이상의 원격 사이트로부터 상기 광대역 통신 경로 인터페이스 장치로 메시지 신호를 전송하여, 상기 메시지 신호가 상기 마스터 사이트에 전송되는 배열에 있어서,
    상기 광대역 통신 경로 인터페이스 장치 내에 설치되고, 적어도 한 개의 수신지 원격 사이트를 지정하는 광대역 정보 신호를 포함하는 제 1통신 신호 및 각각의 수신지 원격 사이트와 관련된 각각의 대표적인 리턴 타임 슬롯 제어 코드를 발생하도록 동작하며, 상기 멀티드롭 통신 링크를 통해서 상기 광대역 통신 경로 인터페이스 장치로부터 상기 1이상의 원격 사이트로 상기 제 1통신 신호를 전송하는 업스트림 트랜시버와,
    각각의 수신지 원격 사이트에 설치되고, 수신된 상기 제 1통신 신호의 오버헤드부에 포함된 각각의 대표적인 리턴 타임 슬롯 제어 코드를 검출하도록 동작하며, 제 2통신 신호로서 메시지 신호를 소집하고, 상기 검출된 대표적인 리턴 슬롯 제어 코드에 따라 한정된 각각의 타임 슬롯동안, 상기 멀티드롭 통신 링크를 통해서 시분할 슬롯 형식으로 상기 각각의 수신지 원력 사이트로부터 상기 광대역 통신 경로 인터페이스 장치로 상기 제 2통신 신호를 전송하는 다운스트림 트랜시버를 구비한 것을 특징으로 하는 배열.
  16. 제 15 항에 있어서,
    상기 제 1통신 신호는 동기 광 네트워크 베이스 통신 신호를 구비한 것을 특징으로 하는 배열.
  17. 제 15 항에 있어서,
    상기 업스트림 트랜시버는 상기 대표적인 리턴 타임 슬롯 제어 코드와 함께 제 1고정된 크기의 데이터 셀로서 상기 광대역 정보 신호를 상기 제 1통신 신호에 삽입하며, 상기 멀티드롭 통신 링크를 통해서 상기 광대역 통신 경로 인터페이스 장치로부터 상기 1이상의 원격 사이트로 상기 제 1통신 신호를 전송하도록 동작하는 것을 특징으로 하는 배열.
  18. 제 17 항에 있어서,
    상기 제 1고정된 크기의 데이터 셀은 비동기 전송 모드 데이터 셀을 구비한 것을 특징으로 하는 배열.
  19. 제 18 항에 있어서,
    상기 제 1통신 신호는 동기 광 네트워크 베이스 통신 신호를 구비한 것을 특징으로 하는 배열.
  20. 제 19 항에 있어서,
    상기 다운스트림 트랜시버는 제 2고정된 크기의 데이터 셀로서 상기 메시지 신호를 상기 제 2통신 신호에 소집하도록 동작하는 것을 특징으로 하는 배열.
  21. 제 20 항에 있어서,
    상기 제 2고정된 크기의 데이터 셀은 비동기 전송 모드의 데이터 셀을 구비한 것을 특징으로 하는 배열.
  22. 제 15 항에 있어서,
    상기 1이상의 원격 사이트는 단일 원격 사이트에 대응하는 것을 특징으로 하는 배열.
  23. 제 15 항에 있어서,
    상기 1이상의 원격 사이트는 복수의 원격 사이트를 구비한 것을 특징으로 하는 배열.
  24. 제 15 항에 있어서,
    상기 업스트림 트랜시버는 각각 서로다른 원격 사이트와 관련된 각각 서로다른 대표적인 리턴 슬롯 제어 코드를 상기 제 1통신 신호 중 연속적인 신호들의 공통 오버헤드부 내에 삽입하도록 동작하며, 복수의 다운스트림 트랜시버는 각각 서로다른 원격 사이트에 설치되고, 수신된 상기 제 1통신 신호의 상기 공통 오버헤드부에 포함된 상기 각각 서로다른 대표적인 리턴 타임 슬롯 제어 코드를 검출하며 상기 검출된 대표적인 리턴 슬롯 제어 코드에 따라 한정된 각각 서로다른 타임 슬롯동안 제 2통신 신호를 전송하도록 동작하는 것을 특징으로 하는 배열.
  25. 제 15 항에 있어서,
    상기 업스트림 트랜시버는 브로드캐스트 케이블 텔레비젼 신호를 지정한 하부 제 1주파수 대역에 상기 제 1통신 신호를 전송하도록 동작하며, 상기 다운스트림 트랜시버는 브로드캐스트 케이블 텔레비젼 신호를 지정하고, 상기 제 1주파수 대역으로부터 이격된 하부 제 2주파수 대역에 상기 제 2통신 신호를 전송하도록 동작하는 것을 특징으로 하는 배열.
  26. 제 25 항에 있어서,
    상기 수신지 원격 사이트는 케이블 텔레비젼 서비스 제공자로부터 케이블 텔레비젼 신호가 공급되는 동축 케이블 포트와, 상기 수신지 원격 사이트에서 이용자 전제 전화 장치가 접속되는 전화 신호 포트를 더 구비하고, 상기 수신지 원격 사이트에서는, 상기 동축 케이블 포트 및 상기 멀티드롭 통신 링크와 연결되고, 상기 멀티드롭 통신 링크 상에 수신된 상기 제 1통신 신호와 상기 동축 케이블 포토에서의 케이블 텔레비젼 신호를 상기 다운스트림 트랜시버에 적용하기 위한 광대역 출력 포트에 연결하며 상기 멀티드롭 통신 링크 상에 수신된 전화 신호를 상기 전화 신호 포트에 연결하도록 동작하는 다이플렉서 필터를 더 구비한 것을 특징으로 하는 배열.
  27. 제 26 항에 있어서,
    상기 업스트림 트랜시버는 제 1캐리어리스 진폭 변조 위상 변조 신호로서 상기 제 1통신 신호를 전송하도록 동작하고, 상기 다운스트림 트랜시버는 제 2캐리어리스 진폭 변조 위상 변조 신호로서 상기 제 2통신 신호를 전송하도록 동작하는 것을 특징으로 하는 배열.
  28. 제 15 항에 있어서,
    상기 멀티드롭 통신 링크는 실드안된 트위스트 페어를 구비한 것을 특징으로 하는 배열.
  29. 제 15 항에 있어서,
    상기 업스트림 트랜시버는 상기 다운스트림 트랜시버에 의해 전송된 상기 제 2통신 신호를 수신하고, 상기 광대역 통신 경로를 통해서 그 내부에 포함된 상기 메시지 신호를 상기 마스터 사이트에 전송하도록 동작하는 것을 특징으로 하는 배열.
  30. 제 15 항에 있어서,
    상기 업스트림 트랜시버는 상기 다운스트림 트랜시버에 의해 전송된 상기 제 2통신 신호를 수신하고, 상기 광대역 통신 경로를 통해서 그 내부에 포함된 제 1선택된 메시지 신호를 상기 마스터 사이트에 전송하며, 상기 광대역 통신 경로 인터페이스 장치로 사용을 위해 그 내부에 포함된 제 2 선택된 메시지 신호를 추출하도록 동작하는 것을 특징으로 하는 배열.
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