KR19980057864A - Manufacturing method of thin film type optical path control device - Google Patents

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Abstract

비어 홀을 정확하게 형성할 수 있는 박막형 광로 조절 장치의 제조 방법이 개시되어 있다. 상기 방법은, M×N(M, N은 정수)개의 트랜지스터가 내장되고 일측상부에 드레인 패드가 형성된 액티브 매트릭스를 제공하는 단계, 상기 액티브 매트릭스의 상부에 멤브레인, 하부 전극, 변형층 및 상부 전극을 포함하는 액츄에이터를 형성하는 단계, 상기 상부 전극, 상기 변형층 및 상기 하부 전극을 패터닝하는 단계, 상기 패터닝된 상부 전극, 변형층 및 하부 전극의 상부에 포토 레지스트를 도포한 후, 상기 포트 레지스트에 자외선을 조사하는 단계, 그리고 상기 액츄에이터의 일측에 상기 드레인 패드와 상기 하부 전극을 연결하는 비어 컨택을 형성하는 단계를 포함한다. 상기 방법에 따르면, 포토 레지스트의 표면을 자외선에 노출시킴으로써, 포트 레지스트의 표면 부위가 친수성으로 변화하며, 따라서 박막, 특히 질화물 멤브레인과의 접착성이 우수하게 되어 정확하게 비어 홀 및 비어 컨택을 형성할 수 있다. 그러므로, 희생층을 플루오르화 수소를 사용하여 식각할 때, 보호층의 일부가 함께 식각되어 비어 홀 내에 언더 컷이 발생되는 것을 방지할 수 있다.A method of manufacturing a thin film type optical path control apparatus capable of accurately forming a via hole is disclosed. The method includes providing an active matrix having M × N (M, N is an integer) transistors and a drain pad formed on one side thereof, wherein a membrane, a lower electrode, a strain layer, and an upper electrode are disposed on the active matrix. Forming an actuator comprising, patterning the upper electrode, the strain layer and the lower electrode, applying a photoresist on top of the patterned upper electrode, strain layer and the lower electrode, and then ultraviolet rays to the port resist Irradiating a light source and forming a via contact connecting the drain pad and the lower electrode to one side of the actuator. According to the above method, by exposing the surface of the photoresist to ultraviolet light, the surface portion of the port resist changes to hydrophilicity, so that the adhesion with the thin film, in particular the nitride membrane, is excellent, thereby accurately forming the via hole and the via contact. have. Therefore, when the sacrificial layer is etched using hydrogen fluoride, a portion of the protective layer is etched together to prevent undercuts from occurring in the via holes.

Description

박막형 광로 조절 장치의 제조 방법Manufacturing method of thin film type optical path control device

본 발명은 박막형 광로 조절 장치인 AMA(Actuated Mirror Array)의 패터닝 방법에 관한 것으로서, 보다 상세하게는 액츄에이터에 비어 홀을 형성할 때, 포트 레지스트(photo resist)에 자외선 처리를 하여 정확하게 비어 홀을 형성할 수 있는 박막형 광로 조절 장치의 제조 방법에 관한 것이다.The present invention relates to a patterning method of an Actuated Mirror Array (AMA), which is a thin film type optical path control device. More specifically, when forming a via hole in an actuator, an via treatment is performed on the photoresist to accurately form the via hole. The manufacturing method of the thin film type optical path control apparatus which can be performed.

일반적으로 광속을 조절하여 화상을 형성할 수 있는 광로 조절 장치는 크게 두 종류로 구분된다. 그 한 종류는 직시형 화상 표시 장치로서 CRT(Cathode Ray Tube) 등이 있으며, 다른 한 종류는 투사형 화상 표시 장치로서 액정 표시 장치(Liquid Crystal Display : LCD), 또는 DMD(Deformable Mirror Device), AMA 등이 이에 해당한다. 상기 CRT 장치는 화상의 질은 우수하지만 화면의 대형화에 따라 장치의 중량과 용적이 증가하며 그 제조 비용이 상승하게 되는 문제점이 있다. 이에 비하여 액정 표시 장치(LCD)는 광학적 구조가 간단하여 얇게 형성할 수 있어 그 중량 및 용적을 줄일 수 있는 장점이 있다. 그러나 상기 액정 표시 장치(LCD)는 입사되는 광속의 편광으로 인하여 1∼2%의 광효율을 가질 정도로 효율이 저하되며, 액정 물질의 응답 속도가 느리고 내부가 과열되기 쉬운 문제점이 있다.In general, an optical path adjusting device capable of forming an image by adjusting a light beam is classified into two types. One type is a direct view type image display device, such as a CRT (Cathode Ray Tube), and the other type is a projection type image display device, a Liquid Crystal Display (LCD), or a DMD (Deformable Mirror Device), AMA, etc. This corresponds to this. Although the CRT device has excellent image quality, the weight and volume of the device increases as the screen is enlarged, and the manufacturing cost thereof increases. In contrast, a liquid crystal display (LCD) has an advantage in that its optical structure is simple and can be formed thin, thereby reducing its weight and volume. However, the liquid crystal display (LCD) has a problem that the efficiency is lowered to have an optical efficiency of 1 to 2% due to the polarization of the incident light beam, and the response speed of the liquid crystal material is slow and the inside is easily overheated.

따라서 상기 문제점들을 해결하기 위하여 DMD(Digital Mirrors Device), 또는 AMA 등의 화상 표시 장치가 개발되었다. 현재, DMD 장치가 5% 정도의 광효율을 가지는 것에 비하여 AMA 장치는 10% 이상의 광효율을 얻을 수 있다. 또한 AMA 장치는 콘트라스트(contrast)를 향상시켜 보다 밝고 선명한 화상을 맺을 수 있으며, 입사되는 광속의 극성에 영향을 받지 않을 뿐만 아니라 광속의 극성에 영향을 끼치지도 않는다. 이러한 미합중국 특허 제5,126,836호(issued to Gregory Um)에 개시된 AMA의 엔진 시스템의 개략도를 도 1에 도시하였다.3 3 3크형 광로 조절 장치는 미합중국 특허 제5,085,497호(issued to Gregory Um et al.)에 개시되어 있다. 벌크형 광로 조절 장치는 다층 세라믹을 얇게 절단하여 내부에 금속 전극이 형성된 세라믹 웨이퍼(wafer)를 트랜지스터가 내장된 액티브 매트릭스(active matrix) 상에 장착한 후, 쏘잉(sawing) 방법으로 가공하고 그 상부에 거울을 설치하여 이루어진다. 그러나 벌크형 광로 조절 장치는 설계 및 제조에 있어서 높은 정밀도가 요구되고 변형부의 응답 속도가 느리다는 문제점이 있다. 이에 따라 반도체 공정을 이용하여 제조할 수 있는 박막형 광로 조절 장치가 개발되었다.Accordingly, in order to solve the above problems, an image display device such as a digital mirror device (DMD) or an AMA has been developed. Currently, AMA devices can achieve 10% or more light efficiency, while DMD devices have about 5% light efficiency. In addition, the AMA device improves contrast, resulting in brighter and clearer images, and is not affected by the polarity of the incident luminous flux and does not affect the polarity of the luminous flux. A schematic diagram of the engine system of AMA disclosed in this US Patent No. 5,126,836 (issued to Gregory Um) is shown in FIG. 3 3 3 The light path control device is disclosed in US Pat. No. 5,085,497 (issued to Gregory Um et al.). The bulk optical path control device cuts a thin layer of multilayer ceramic, mounts a ceramic wafer having a metal electrode therein on an active matrix in which a transistor is built, and then processes it by sawing. This is done by installing a mirror. However, the bulk optical path control device has a problem in that high precision is required in design and manufacturing and the response speed of the deformation part is slow. Accordingly, a thin film type optical path control apparatus that can be manufactured using a semiconductor process has been developed.

도 2 및 도 3을 참조하면, 상기 박막형 광로 조절 장치는 M×N(M, N은 정수)개의 MOS(Metal Oxide Semiconductor)트랜지스터(도시되지 않음)가 내장되고 일측 상부에 드레인(drain)(49)이 형성된 액티브 매트릭스(41)와 액티브 매트릭스(41)의 상부에 형성된 액츄에이터(actuator)(43)를 포함한다.2 and 3, the thin film type optical path control device includes M × N (M, N is an integer) metal oxide semiconductor (MOS) transistors (not shown) and a drain 49 on one side. Is formed on the active matrix 41 and the actuator (43) formed on the active matrix (41).

상기 액티브 매트릭스(41)는 액티브 매트릭스(41) 및 드레인(49) 상부에 적층된 보호층(passivation layer)(51)과 보호층(51)의 상부에 적층된 식각 방지층(etch stop layer)(53)을 포함한다.The active matrix 41 includes a passivation layer 51 stacked on the active matrix 41 and the drain 49 and an etch stop layer 53 stacked on the passivation layer 51. ).

상기 액츄에이터(43)는 상기 식각 방지층(53) 중 아래에 드레인(49)이 형성된 부분에 일측이 접촉되며 타측이 에어 갭(air gap)(55)을 개재하여 상기 식각 방지층(53)과 평행하도록 적층된 단면을 갖는 멤브레인(57), 멤브레인(57)의 상부에 적층된 하부 전극(61), 하부 전극(61)의 상부에 적층된 변형부(63), 변형부(63)의 상부에 적층된 상부 전극(65), 변형부(63)의 타측으로부터 하부 전극(61), 멤브레인(57), 식각방지층(53) 및 보호층(51)을 통하여 상기 드레인(49)까지 수직하게 형성된 비어 홀(via hole)(68), 그리고 비어 홀(68) 내에 상기 하부 전극(61)과 드레인(49)이 서로 전기적으로 연결되도록 형성된 비어 컨택(via contact)(69)을 포함한다.One side of the actuator 43 is in contact with a portion in which the drain 49 is formed in the lower portion of the etch stop layer 53, and the other side thereof is parallel to the etch stop layer 53 through an air gap 55. The membrane 57 having a stacked cross section, the lower electrode 61 stacked on the membrane 57, the deformation part 63 stacked on the lower electrode 61, and the upper part of the deformation part 63. Via holes vertically formed from the other side of the upper electrode 65 and the deformable part 63 to the drain 49 through the lower electrode 61, the membrane 57, the etch stop layer 53, and the protective layer 51. and a via contact 69 formed in the via hole 68 and the lower electrode 61 and the drain 49 are electrically connected to each other.

이하 상술한 박막형 광로 조절 장치의 제조 방법을 도면을 참조하여 설명한다.정도의 두께를 가지도록 형성한다. 식각 방지층(53)은 후속하는 식각 공정 동안 보호층(51) 및 액티브 매트릭스(41) 등이 식각되는 것을 방지한다. 식각방지층(53)의 상부에는 희생층(sacrificial layer)(56)이 적층된다. 희생층(56)은 인(P)의 농도가 높은 인 실리케이트 유리(PSG)를 대기압 화학 기상 증착(Atmospheric Pressure CVD : APCVD) 방법을 이용하여 1.0∼2.0μm 정도의 두께를 가지도록 형성한다. 이 경우, 희생층(56)은 트랜지스터가 내장된 액티브 매트릭스(41)의 상부를 덮고 있으므로 그 표면의 평탄도가 매우 불량하다. 따라서, 희생층(56)의 표면을 스핀 온 글래스(Spin On Galss : S○G)를 사용하는 방법, 또는 CMP(Chemical Mechanical Polishing) 방법을 이용하여 평탄화시킨다. 이어서, 희생층(56)의 상부에 포트 레지스트(photo resist)(도시되지 않음)를 도포한 후, 희생층(56) 중 아래에 드레인(49)이 형성되어 있는 부분을 패터닝하여 식각 방지층(53)의 일부를 노출시킨다.6 18 2 4 4장된 트랜지스터로부터 상기 드레인(49) 및 비어 컨택(69)을 통하여 인가된다. 그리고, 하부 전극(61)을 각 픽셀(pixel)별로 분리하기 위하여 Iso-Cutting을 한다.Hereinafter, the manufacturing method of the above-described thin film type optical path control apparatus will be described with reference to the drawings. The etch stop layer 53 prevents the protective layer 51, the active matrix 41, and the like from being etched during the subsequent etching process. A sacrificial layer 56 is stacked on the etch stop layer 53. The sacrificial layer 56 is formed of phosphorous silicate glass (PSG) having a high concentration of phosphorus (PG) to have a thickness of about 1.0 to 2.0 μm using an Atmospheric Pressure CVD (APCVD) method. In this case, since the sacrificial layer 56 covers the upper portion of the active matrix 41 in which the transistors are embedded, the flatness of the surface thereof is very poor. Accordingly, the surface of the sacrificial layer 56 is planarized by using a spin on glass (SG) or a chemical mechanical polishing (CMP) method. Subsequently, a photoresist (not shown) is applied on the sacrificial layer 56, and then a portion of the sacrificial layer 56 having a drain 49 formed thereon is patterned to prevent the etch stop layer 53. Part of the 6 18 2 4 4 is applied through the drain 49 and via contact 69 from the loaded transistor. Then, Iso-Cutting is performed to separate the lower electrode 61 for each pixel.

도 4d를 참조하면, 상부 전극(65)을 소정의 형상으로 패터닝한 후, 변형부(63) 및 하부 전극(61)을 차례로 패터닝한다. 이 때, 상부 전극(65)을 패터닝하는 방법과 같이 변형부(63) 및 상부 전극(65)의 상부에 포토 레지스트를 도포한 후, 변형부(63)를 소정의 화소 형상으로 패터닝한다. 하부 전극(61) 역시 이와 같은 방법으로 소정의 화소 형상으로 패터닝된다. 이어서, 변형부(63)의 타측 상부로부터 드레인(49)의 상부까지 변형부(63), 하부 전극(6l), 멤브레인(57), 식각 방지층(53) 및 보호층(51)을 순차적으로 식각하여 상기 변형부(63)로부터 드레인(49)까지 비어 홀(68)을 형성한다. 이 경우에 있어서도, 상기 맴브레인(57)의 상부에 포토 레지스트를 도포한 후, 이를 마스크로 사용하여 변형부(63), 하부 전극(61), 멤브레인(57), 식각 방지층(53) 및 보호층(51)을 식각하여 비어 홀(68)을 형성한다. 계속하여, 텅스텐(W), 백금, 또는 티타늄(Ti) 등의 금속을 스퍼터링 방법을 이용하여 상기 드레인(49)과 하부 전극(61)이 전기적으로 연결되도록 비어 컨택(69)을 형성한다. 따라서, 비어 컨택은(69)은 상기 비어 홀(68) 내에서 상기 하부 전극(61)으로부터 드레인(49)의 상부까지 수직하게 형성된다. 그러므로, 화상 신호는 액티브 매트릭스(41)에 내장된 트랜지스터로부터 드레인(49) 및 비어 컨택(69)을 통하여 하부 전극(61)에 인가된다. 그리고, 멤브레인(57)의 상부에 포토 레지스트를 도포한 후, 멤브레인(57)을 소정의 화소 형상으로 패터닝하고 희생층(56)을 플루오르화 수소(HF) 증기로 식각하여 에어 갭(55)을 형성한다. 상기와 같이 박막형 AMA 소자를 완성한 후, 크롬(Cr), 니켈(Ni), 금(Au) 등의 금속을 스퍼터링 방법, 또는 증착(evaporation) 방법을 이용하여 액티브 매트릭스(41)의 하단에 증착시켜 저항 컨택(ohmic contact)(도시되지 않음)을 형성한다. 이어서, 액티브 매트릭스(41) 상부에 포토 레지스트(photo resist)(도시하지 않음)를 코팅한 후, 후속하는 공통 전극인 상부 전극(65)에 바이어스 전압을 인가하는 동시에 신호 전극인 하부 전극(61)에 화상 신호를 인가하기 위한 TCP(Tape Carrier Package) 본딩(bonding)을 대비하여 액티브 매트릭스(41)를 자른다. 이 때, 후속되는 공정을 위하여 액티브 매트릭스(41)를 소정의 두께까지만 잘라 낸다. 계속하여, TCP 본딩에 요구되는 AMA 패널(pannel)의 패드(도시되지 않음)를 노출시키기 위해 AMA 패널의 패드의 상부에 포토 레지스트를 형성한 후, 건식 식각 방법을 이용하여 패터닝한다. 상기와 같이 박막형 AMA 소자가 형성된 액티브 매트릭스(41)를 소정의 형상으로 완전히 잘라낸 후, AMA 패널의 패드와 TCP를 연결하여 박막형 AMA 모듈(module)의 제조를 완성한다.Referring to FIG. 4D, after the upper electrode 65 is patterned into a predetermined shape, the deformable portion 63 and the lower electrode 61 are patterned in sequence. At this time, the photoresist is applied over the deformable portion 63 and the upper electrode 65 in the same manner as the patterning of the upper electrode 65, and then the deformable portion 63 is patterned into a predetermined pixel shape. The lower electrode 61 is also patterned in a predetermined pixel shape in this manner. Subsequently, the deformable portion 63, the lower electrode 6l, the membrane 57, the etch stop layer 53, and the protective layer 51 are sequentially etched from the other upper portion of the deformable portion 63 to the upper portion of the drain 49. As a result, a via hole 68 is formed from the deformable portion 63 to the drain 49. Also in this case, after the photoresist is applied on the membrane 57, the deformable portion 63, the lower electrode 61, the membrane 57, the etch stop layer 53 and the protective layer are used as a mask. The 51 is etched to form the via hole 68. Subsequently, a via contact 69 is formed such that the drain 49 and the lower electrode 61 are electrically connected to each other by a metal such as tungsten (W), platinum, or titanium (Ti). Thus, the via contact 69 is formed vertically from the lower electrode 61 to the top of the drain 49 in the via hole 68. Therefore, the image signal is applied to the lower electrode 61 through the drain 49 and the via contact 69 from the transistor embedded in the active matrix 41. After the photoresist is applied on the membrane 57, the membrane 57 is patterned into a predetermined pixel shape, and the sacrificial layer 56 is etched with hydrogen fluoride (HF) vapor to form an air gap 55. Form. After completing the thin-film AMA device as described above, by depositing a metal such as chromium (Cr), nickel (Ni), gold (Au) and the like on the bottom of the active matrix 41 using a sputtering method or evaporation method (evaporation) It forms an ohmic contact (not shown). Subsequently, after a photo resist (not shown) is coated on the active matrix 41, a bias voltage is applied to the upper electrode 65, which is a subsequent common electrode, and at the same time, the lower electrode 61, which is a signal electrode. The active matrix 41 is cut in preparation for TCP (Tape Carrier Package) bonding for applying an image signal to the tape. At this time, the active matrix 41 is cut out only to a predetermined thickness for the subsequent process. Subsequently, a photoresist is formed on top of the pads of the AMA panel to expose the pads (not shown) of the AMA panel required for TCP bonding, and then patterned using a dry etching method. After the active matrix 41 in which the thin film type AMA element is formed is completely cut into a predetermined shape, the pad of the AMA panel and the TCP are connected to complete the manufacture of the thin film type AMA module.

그러나, 상기 박막형 광로 조절 장치의 제조 방법에 있어서, 상기와 같이 비어 컨택을 형성한 후 포토 레지스트 패턴을 식각 마스크로 사용하고, 플루오르화 수소(HF)를 사용하여 상기 희생층을 제거할 경우, 포토 레지스트와 상기 박막들(특히 질화물 멤브레인) 사이의 점착(adhesion)이 불량하여 비어 홀 내의 인 실리케이트 유리(PSG)로 이루어진 보호층이 내부로부터 희생층과 함께 식각되어 언더 컷(under cut)이 발생하며, 이에 따라 비어 컨택에 단락이 일어나는 문제점이 있다. 즉, 상부에 포토 레지스트가 도포되는 질화물 멤브레인의 화학적 특성이 친수성에 가깝거나 소수성 박막일지라도 여러 차례 후속하는 패터닝 공정 동안 포토 레지스트를 제거하면서 염기(base)인 수산화 이온(OH-)이 공급됨으로 인하여 멤브레인의 표면이 친수성에 가깝게 되면, 고유의 특성이 소수성(hydrophobicity)인 포토 레지스트는 상기 친수성 멤브레인과는 점착성이 저하되어 소수성 포토 레지스트를 마스크로 하여 패터닝하는 공정에서 언더 컷이 발생하는 것과 같은 문제가 발생하여 정확하게 비어 홀을 형성하기 어렵다. 이러한 문제점 때문에, 포토 레지스트의 습윤성(wettability)을 증가시키기 위하여 계면 활성제 등을 첨가하지만 이 방법은 사용되는 포토 레지스트에 따른 적절한 계면 활성제의 선택뿐만 아니라 계면 활성제의 첨가량에 따라 포토 레지스트의 특성이 변화되므로 이를 정확히 제어하기 어려운 문제점이 있다.However, in the method of manufacturing the thin film type optical path control device, when the via contact is formed as described above, the photoresist pattern is used as an etching mask, and the sacrificial layer is removed using hydrogen fluoride (HF). A poor adhesion between the resist and the thin films (particularly the nitride membrane) causes a protective layer of insilicate glass (PSG) in the via hole to be etched from the inside together with the sacrificial layer, resulting in under cut. Therefore, a short circuit occurs in the via contact. That is, even if the chemical property of the nitride membrane to which the photoresist is applied on top is close to hydrophilic or hydrophobic thin film, the membrane is supplied by removing the photoresist during the subsequent patterning process and supplying the base hydroxide ions (OH ). When the surface of is close to hydrophilicity, the photoresist inherent in hydrophobicity has a poor adhesiveness with the hydrophilic membrane, which causes problems such as undercut in the process of patterning with hydrophobic photoresist as a mask. It is difficult to form the via hole accurately. Due to this problem, a surfactant or the like is added to increase the wettability of the photoresist, but this method changes the properties of the photoresist depending on the addition amount of the surfactant as well as the selection of an appropriate surfactant according to the photoresist used. It is difficult to control this accurately.

따라서, 본 발명의 목적은 포토 레지스트를 사용하여 박막의 상부에 소정 형상의 레지스트 패턴을 형성시킨 후, 정확한 형상으로 비어 홀을 형성할 수 있는 박막형 광로 조절 장치의 제조 방법을 제공하는 데 있다.Accordingly, it is an object of the present invention to provide a method of manufacturing a thin film type optical path control apparatus capable of forming a via hole in an accurate shape after forming a resist pattern having a predetermined shape on an upper portion of a thin film using a photoresist.

도 1은 종래의 광로 조절 장치의 엔진 시스템의 개략도이다.146 : 거울 160 : 자외선1 is a schematic diagram of an engine system of a conventional light path adjusting device.

상기 목적을 달성하기 위하여 본 발명은, M×N(M, N은 정수)개의 트랜지스터가 내장되고 일측 상부에 드레인 패드가 형성된 액티브 매트릭스를 제공하는 단계; 상기 액티브 매트릭스의 상부에 멤브레인, 하부 전극, 변형층 및 상부 전극을 포함하는 액츄에이터를 형성하는 단계; 상기 상부 전극, 상기 변형층 및 상기 하부 전극을 패터닝하는 단계; 상기 패터닝된 상부 전극, 변형층 및 하부 전극의 상부에 포토 레지스트를 도포한 후, 상기 포토 레지스트에 자외선을 조사하는 단계; 그리고 상기 액츄에이터의 일측에 상기 드레인 패드와 상기 하부 전극을 연결하는 비어 컨택을 형성하는 단계를 포함하는 박막형 광로 조절 장치의 제조 방법을 제공 한다.In order to achieve the above object, the present invention provides a method comprising: providing an active matrix having M × N (M, N is an integer) transistors and a drain pad formed on one side thereof; Forming an actuator on the active matrix, the actuator including a membrane, a lower electrode, a strained layer, and an upper electrode; Patterning the upper electrode, the strain layer, and the lower electrode; Applying a photoresist on top of the patterned upper electrode, the deforming layer and the lower electrode, and then irradiating the photoresist with ultraviolet light; And it provides a method of manufacturing a thin film type optical path control device comprising the step of forming a via contact connecting the drain pad and the lower electrode on one side of the actuator.

도 5는 본 발명에 따라 제조된 박막형 광로 조절 장치의 평면도를 도시한 것이며, 도 6은 도 5에 도시한 장치를 B-B' 선으로 자른 단면도를 도시한 것이다.FIG. 5 is a plan view of a thin film type optical path adjusting device manufactured according to the present invention, and FIG. 6 is a cross-sectional view taken along line B-B ′ of the device shown in FIG. 5.

상기 액츄에이터(135)는 상기 식각 방지층(109) 중 아래에 드레인 패드(103)가 형성된 부분에 일측이 접촉되며 타측이 제1 에어 갭(115)을 개재하여 상기 식각 방지층(109)과 평행하도록 적층된 단면을 갖는 멤브레인(118), 멤브레인(118)의 상부에 적층된 하부 전극(12l), 하부 전극(121)의 상부에 적층된 변형층(124), 변형층(124)의 상부에 적층된 상부 전극(127), 변형층(124) 중 아래에 드레인 패드(103)가 형성된 부분으로부터 하부 전극(121), 맴브레인(118), 식각 방지층(109) 및 보호층(l06)을 통하여 상기 드레인 패드(103)까지 수직하게 형성된 비어 홀(129), 그리고 비어 홀(129) 내에 상기 하부 전극(121)과 드레인 패드(103)가 서로 전기적으로 연결되도록 형성된 비어 컨택(132)을 포함한다.The actuator 135 is stacked such that one side of the actuator 135 is in contact with a portion in which the drain pad 103 is formed below, and the other side thereof is parallel to the etching prevention layer 109 via the first air gap 115. Membrane 118 having a cross section, a lower electrode 12l stacked on top of the membrane 118, a strained layer 124 stacked on top of the lower electrode 121, and stacked on top of the strained layer 124. The drain pad is formed through the lower electrode 121, the membrane 118, the etch stop layer 109, and the protective layer 110 from a portion of the upper electrode 127 and the deformation layer 124 having the drain pad 103 formed thereunder. The via hole 129 vertically up to the angle 103 and the via contact 132 formed in the via hole 129 to electrically connect the lower electrode 121 and the drain pad 103 to each other.

상기 상부 전극(127)의 일측 상부에는 거울 포스트(143)가 헝성되며, 거울 포스트(143)에 의하여 일측 하부가 지지되며 타측이 제2 에어갭(141)을 개재하여 상부 전극(127)과 평행하게 거울(146)이 형성된다.을 가지며, 이러한 오목한 부분이 양쪽 가장자리로 갈수록 계단형으로 넓어지는 형상으로 형성되며, 타측이 상기 오목한 부분에 대응하여 중앙부로 갈수록 계단형으로 좁아지는 사각형 형상의 돌출부를 가진다. 그러므로, 상기 멤브레인(118)의 오목한 부분에 인접한 액츄에이터의 멤브레인의 오목한 부분이 끼워지고, 상기 사각형 형상의 돌출부가 인접한 멤브레인의 오목한 부분에 끼워지게 된다.The mirror post 143 is formed on an upper portion of the upper electrode 127, one lower portion is supported by the mirror post 143, and the other side is parallel to the upper electrode 127 via the second air gap 141. The mirror 146 is formed. The concave portion is formed in a shape that is widened stepwise toward both edges, and the other side has a quadrangular protrusion that narrows stepwise toward the center corresponding to the concave portion. Has Therefore, the concave portion of the membrane of the actuator adjacent to the concave portion of the membrane 118 is fitted, and the rectangular projection is fitted into the concave portion of the adjacent membrane.

이하 본 발명에 따른 박막형 광로 조절 장치의 제조 방법을 상세하게 설명한다. 도 7a 내지 도 7g는 도 6에 도시한 장치의 제조 공정도이다. 도 7a 내지 도 7f에 있어서, 도 6과 동일한 부재들에 대해서는 동일한 참조 번호를 사용한다.Hereinafter, the manufacturing method of the thin film type optical path control apparatus according to the present invention will be described in detail. 7A to 7G are manufacturing process diagrams of the apparatus shown in FIG. 6. In Figs. 7A to 7F, the same reference numerals are used for the same members as Fig. 6.

도 7a를 참조하면, M×N(M, N은 정수)개의 트랜지스터(도시되지 않음)가 내장되고 일측 상부에 드레인 패드(103)가 형성된 액티브 매트릭스(100)의 상부에 인 실리케이트 유리(PSG)로 구성된 보호층(106)을 적층한다. 보호층(106)은 화학 기상 증착(CVD) 방법을 이용하여 0.1∼1.0μm 정도의 두께를 가지도록 형성한다. 상기 보호층(106)은 후속하는 공정 동안 트랜지스터가 내장된 액티브 매트릭스(100)를 보호한다.Referring to FIG. 7A, silicate glass (PSG) is formed on an active matrix 100 having M × N (M and N are integers) transistors (not shown) and a drain pad 103 formed on one side thereof. The protective layer 106 which consists of these is laminated | stacked. The protective layer 106 is formed to have a thickness of about 0.1 to 1.0 μm using a chemical vapor deposition (CVD) method. The protective layer 106 protects the active matrix 100 in which the transistor is embedded during subsequent processing.

식각 방지층(109)은 저압 화학 기상 증착(Low Pressure CVD : LPCVD) 방법을 이용하여 0.1∼1.0㎛ 정도의 두께를 가지도록 형성한다. 식각 방지층(109)은 후속하는 식각 공정 동안 보호층(106) 및 액티브 매트릭스(100) 등이 식각되는 것을 방지 한다. 식각 방지층(109)의 상부에는 제1 희생층(112)이 적층된다. 제1 희생층(112)은 인(P)의 농도가 높은 인 실리케이트 유리(PSG)를 대기압 화학 기상 증착(Atmospheric Pressure CVD : APCVD) 방법을 이용하여 0.5∼2.0μm 정도의 두께를 가지도록 형성한다. 이 경우, 제1 희생층(112)은 트랜지스터가 내장된 액티브 매트릭스(100)의 상부를 덮고 있으므로 그 표면의 평탄도가 매우 블량하다. 따라서, 제 1 희생층(112)의 표면을 스핀 온 글래스(SOG)를 사용하는 방법, 또는 CMP 방법을 이용하여 평탄화시킨다.The etch stop layer 109 is formed to have a thickness of about 0.1 μm to about 1.0 μm using a low pressure chemical vapor deposition (LPCVD) method. The etch stop layer 109 prevents the protective layer 106, the active matrix 100, etc. from being etched during the subsequent etching process. The first sacrificial layer 112 is stacked on the etch stop layer 109. The first sacrificial layer 112 is formed of a phosphorus silicate glass (PSG) having a high concentration of phosphorus (PG) to have a thickness of about 0.5 to 2.0 μm using an Atmospheric Pressure CVD (APCVD) method. . In this case, since the first sacrificial layer 112 covers the upper portion of the active matrix 100 in which the transistor is embedded, the flatness of the surface thereof is very poor. Therefore, the surface of the first sacrificial layer 112 is planarized by using a spin on glass (SOG) or a CMP method.

상기 멤브레인(118)의 상부에는 백금, 또는 탄탈륨(Ta), 또는 백금-탄탈륨(Pt-Ta) 등의 금속으로 구성된 하부 전극(121)이 적층된다. 하부 전극(121)은 스퍼터링 방법을 이용하여 0.1∼1.0μm 정도의 두께를 가지도록 형성한다. 신호 전극인 하부 전극(12l)에는 액티브 매트릭스(100)에 내장된 트랜지스터로부터 화상 신호가 상기 드레인 패드(103) 및 후에 형성되는 비어 컨택(132)을 통하여 인가된다.A lower electrode 121 made of a metal such as platinum, tantalum (Ta), or platinum-tantalum (Pt-Ta) is stacked on the membrane 118. The lower electrode 121 is formed to have a thickness of about 0.1 μm to 1.0 μm using the sputtering method. An image signal is applied to the lower electrode 12l, which is a signal electrode, from the transistor embedded in the active matrix 100 through the drain pad 103 and the via contact 132 formed later.

상기 하부 전극(121)의 상부에는 PZT, 또는 PLZT로 구성된 변형층(124)이 적층된다. 변형층(124)은 졸-겔법, 스퍼터링 방법, 또는 화학 기상 증착(CVD) 방법을 이용하여 0.1∼1. 0㎛, 바람직하게는 0.4μm 정도의 두께를 가지도록 형성한 후, 급속 열처리(RTA) 방법으로 열처리하여 상변이시킨다. 변형층(l24)은 후에 형성되는 공통 전극인 상부 전극(127)과 신호 전극인 하부 전극(121) 사이에 발생하는 전계에 의하여 변형을 일으킨다.점착이 매우 불량하다.A strained layer 124 made of PZT or PLZT is stacked on the lower electrode 121. The strained layer 124 is 0.1 to 1 using a sol-gel method, a sputtering method, or a chemical vapor deposition (CVD) method. It is formed to have a thickness of about 0 μm, preferably about 0.4 μm, and then subjected to heat treatment by a rapid heat treatment (RTA) method to perform phase shift. The strained layer l24 is deformed by an electric field generated between the upper electrode 127 which is a later formed common electrode and the lower electrode 121 which is a signal electrode. The adhesion is very poor.

다음에, 도 7d를 참조하면, 상기 제5 포토 레지스트 패턴(150)을 자외선(160)으로 처리하여 상기 제5 포트 레지스트 패턴(150)의 표면 부위의 소수성을 감소시킨다(즉, 친수성을 증가시킨다). 상기와 같이 자외선(160)을 조사함으로써, 상기 제5 포토 레지스트패턴(150)의 내에칭성(etch resistance), 접착성(adhesion)을 증가시키고, 제5 포토 레지스트 패턴(150) 내의 잔류 용매가 제거된다. 또한, 자외선(160)의 작용에 의해, 고분자 물질로 구성된 제5 포토 레지스트 패턴(150)의 표면 부위는 부분적으로 활성화되어 잔류하는 용매 중에 잔류하는 산소 분자와 결합하여 제5 포토 레지스트 패턴(150)의 소수성을 감소시키고 친수성을 증가시킨다고 생각된다. 상기 제5 포트 레지스트 패턴(150)의 표면상에 자외선(160)을 조사시키기 위한 장비는 상압 체임버(chamber)(도시되지 않음)를 포함한다. 상기 자외선(160) 조사는 상기 액티브 매트릭스(100)을 상기 체임버 내의 고온 플레이트(도시되지 않음)의 온도를 1차로 105℃ 내지 120℃의 온도에서, 10초 내지 35초 동안 수행한 후, 2차로 온도를 145℃내지 170℃의 온도로 상승시켜서, 40초 내지 80초 동안 수행한다. 이 때, 자외선(160)은 850W/㎤ 내지 870W/㎤, 바람직하게는 860W/㎤의 High Power 에서 80초동안, 20W/㎤ 내지 30W/㎤, 바람직하게는 25W/㎤의 Low Power에서 5초 동안 조사한다. 상기와 같이, 본 발명의 방법에 따라 제5 포토 레지스트 패턴(150)의 표면을 자외선(160)에 노출시킨 경우, 제5 포토 레지스트 패턴(150)의 표면 부위가 친수성으로 변화됨에 따라서 질화물 멤브레인(118)과의 접착성이 우수하게 되어 정확하게 비어 홀(129) 및 비어 컨택(132)을 형성할 수 있다. 그러므로, 후에 제1 희생층(112)을 플루오르화 수소를 사용하여 식각할 때, 보호층(106)이 식각되어 비어 홀(129) 내에 언더 컷이 발생되는 것을 방지할 수 있다.Next, referring to FIG. 7D, the fifth photoresist pattern 150 is treated with ultraviolet light 160 to reduce hydrophobicity of the surface portion of the fifth port resist pattern 150 (ie, increase hydrophilicity). ). By irradiating the ultraviolet light 160 as described above, the etch resistance and adhesion of the fifth photoresist pattern 150 are increased, and residual solvent in the fifth photoresist pattern 150 is increased. Removed. In addition, due to the action of the ultraviolet light 160, the surface portion of the fifth photoresist pattern 150 made of a polymer material is partially activated to combine with oxygen molecules remaining in the remaining solvent to form the fifth photoresist pattern 150. It is thought to reduce hydrophobicity and increase hydrophilicity. Equipment for irradiating the ultraviolet light 160 on the surface of the fifth port resist pattern 150 includes an atmospheric chamber (not shown). The ultraviolet ray 160 irradiation is performed by performing the active matrix 100 at a temperature of a high temperature plate (not shown) in the chamber at a temperature of 105 ° C. to 120 ° C. for 10 seconds to 35 seconds. The temperature is raised to a temperature between 145 ° C. and 170 ° C., followed by 40 seconds to 80 seconds. At this time, the ultraviolet light 160 is 5 seconds at a low power of 20 W / cm 3 to 30 W / cm 3, preferably 25 W / cm 3 for 80 seconds at a high power of 850 W / cm 3 to 870 W / cm 3, preferably 860 W / cm 3. Investigate while. As described above, when the surface of the fifth photoresist pattern 150 is exposed to the ultraviolet rays 160 according to the method of the present invention, the surface area of the fifth photoresist pattern 150 is changed to hydrophilic and thus the nitride membrane ( The adhesiveness with the 118 may be excellent to accurately form the via hole 129 and the via contact 132. Therefore, when the first sacrificial layer 112 is later etched using hydrogen fluoride, the protective layer 106 may be etched to prevent undercuts from occurring in the via hole 129.

이어서, 상기 개구부(155)를 통하여 변형층(124)으로부터 하부 전극(121), 멤브레인(118), 식각 방지층(109), 및 보호층(106)을 식각하여 비어 홀(129)을 형성한다.Subsequently, the via hole 129 is formed by etching the lower electrode 121, the membrane 118, the etch stop layer 109, and the protective layer 106 from the strained layer 124 through the opening 155.

도 7e를 참조하면, 상기 제5 포토 레지스트(150)를 제거한 후, 텅스텐, 백금, 또는 티타늄 등의 금속을 스퍼터링 방법을 이용하여 상기 비어 홀(129) 내에 상기 드레인 패드(l03)와 하부 전극(121)이 전기적으로 연결되도록 비어 컨택(132)을 형성한다. 따라서, 비어 컨택은(132)은 상기 비어 홀(129) 내에서 하부 전극(121)으로부터 드레인 패드(103)의 상부까지 수직하게 형성된다. 그러므로, 화상 신호는 액티브 매트릭스(100)에 내장된 트랜지스터로부터 드레인 패드(103) 및 비어 컨택(132)을 통하여 하부 전극(121)에 인가된다. 이어서, 크롬(Cr), 구리(Cu) 또는 금(Au) 등의 금속을 증착(evaporation), 또는 스퍼터링 방법을 이용하여 액티브 매트릭스(100)의 하단에 증착시켜 저항 컨택(도시되지 않음)을 형성한다. 그리고, 액티브 매트릭스(100) 상부에 제6 포트 레지스트(도시되지 않음)를 코팅한 후, 후속하는 공통 전곡인 상부 전극(127)에 바이어스 전압을 인가하는 동시에 신호 전극인 하부 전극(121)에 화상 신호를 인가하기 위한 TCP(Tape Carrier Package) 본딩을 대비하여 액티브 매트릭스(100)를 자른다. 이 때, 후속되는 공정을 위하여 액티브 매트릭스(100)를 소정의 정도의 두께까지만 잘라 낸다. 계속하여, TCP 본딩에 요구되는 AMA 패널(pannel)의 패드(도시하지 않음)를 노출시키기 위해 AMA 패널의 패드 부위를 건식 식각 방법을 이용하여 식각한다. 그리고, 상기 제1 희생층(112)을 플루오르화 수소 증기로 식각하여 제1 에어 갭(115)을 형성한다.Referring to FIG. 7E, after removing the fifth photoresist 150, the drain pad 110 and the lower electrode 11 may be formed in the via hole 129 by sputtering a metal such as tungsten, platinum, or titanium. The via contact 132 is formed so that 121 is electrically connected. Accordingly, the via contact 132 is vertically formed from the lower electrode 121 to the top of the drain pad 103 in the via hole 129. Therefore, the image signal is applied to the lower electrode 121 through the drain pad 103 and the via contact 132 from the transistor embedded in the active matrix 100. Subsequently, a metal such as chromium (Cr), copper (Cu), or gold (Au) is deposited on the bottom of the active matrix 100 using an evaporation or sputtering method to form a resistive contact (not shown). do. Then, after coating a sixth port resist (not shown) on the active matrix 100, a bias voltage is applied to the upper electrode 127, which is a subsequent common grain, and an image is applied to the lower electrode 121, which is a signal electrode. The active matrix 100 is cut in preparation for a tape carrier package (TCP) bonding for applying a signal. At this time, the active matrix 100 is cut out only to a predetermined thickness for subsequent processing. Subsequently, the pad portion of the AMA panel is etched using a dry etching method to expose a pad (not shown) of the AMA panel required for TCP bonding. The first sacrificial layer 112 is etched with hydrogen fluoride vapor to form a first air gap 115.

도 7f를 참조하면, 전술한 바와 같이 제1 에어 갭(115)을 형성한 후, 결과물 전면에 제2 희생층(138)을 형성한다. 상기 제2 희생층(138)은 거울(146)의 장착을 용이하게 하고 거울(146)의 수평도를 향상시키는 기능을 수행한다. 상기 제2 희생층(138)은 유동성이 좋은 폴리머 등을 스핀 코팅 방식으로 형성하며, 상기 제1 에어 갭(1l5) 및 비어 홀(129)을 완전히 채우면서 상부 전극(127)을 기준으로 일정한 두께를 갖도록 도포한다. 이와 같이, 액츄에이터(135)가 형성된 결과물 전면에 제2 희생층(138)을 도포하게 되면, 제1 에어 갭(115) 및 비어 홀(129)에 상기 제2 희생층(138)이 채워지면서 평평한 표면을 형성하게 된다.Referring to FIG. 7F, after forming the first air gap 115 as described above, the second sacrificial layer 138 is formed on the entire surface of the resultant. The second sacrificial layer 138 facilitates the mounting of the mirror 146 and improves the horizontality of the mirror 146. The second sacrificial layer 138 is formed by spin coating a polymer having good fluidity, and has a constant thickness with respect to the upper electrode 127 while completely filling the first air gap 11 and the via hole 129. Apply to have. As such, when the second sacrificial layer 138 is applied to the entire surface of the resultant on which the actuator 135 is formed, the second sacrificial layer 138 is filled in the first air gap 115 and the via hole 129 and is flat. To form a surface.

이어서, 제7 포토 레지스트(도시되지 않음)를 마스크로 이용하여 상기 제2 희생층(138)을 패터닝함으로서 상기 상부 전극(127)의 일측 상부를 노출시킨다. 계속하여, 상기 노출된 상부 전극(127)의 상부 및 제2 희생층(138)의 상부에 알루미늄, 은 또는 백금 등의 금속을 0.1∼1.0μm 정도의 두께로 스퍼터링 한다. 그리고, 상기 스퍼터링된 금속을 패터닝하여 상부 전극(127)의 일측 상부에 형성된 거울 포스트(143)와 거울 포스트(143)에 의하여 일측 하부가 지지되며, 타측이 상부 전극(127)에 평행하게 장착되는 거울(146)을 형성한다. 거울(146)은 액츄에이터(135)와 함께 소정의 각도로 기울어져 광원으로부터 입사되는 광속을 반사한다.2 Subsequently, the second sacrificial layer 138 is patterned using a seventh photoresist (not shown) as a mask to expose an upper portion of one side of the upper electrode 127. Subsequently, a metal such as aluminum, silver, or platinum is sputtered on the exposed upper electrode 127 and the second sacrificial layer 138 to a thickness of about 0.1 μm to 1.0 μm. The lower side of the sputtered metal is supported by the mirror post 143 and the mirror post 143 formed on one side of the upper electrode 127, and the other side is mounted in parallel with the upper electrode 127. The mirror 146 is formed. The mirror 146 is inclined at an angle with the actuator 135 to reflect the light beam incident from the light source. 2

상기와 같이 박막형 AMA 소자가 형성된 액티브 매트릭스(100)를 소정의 형상으로 완전히 잘라낸 후, AMA 패널의 패드와 TCP를 연결하여 박막형 AMA 모듈의 제조를 완성한다.이의 변형층(124)이 변형을 일으키게 된다.After the active matrix 100 having the thin film AMA element is completely cut into a predetermined shape as described above, the pad of the AMA panel and the TCP are connected to complete manufacture of the thin film AMA module. The deformation layer 124 causes deformation. do.

상기 변형층(124)은 전계와 수직한 방향으로 수축한다. 이에 따라, 변형층(124)을 포함하는 액츄에이터(135)가 소정의 각도로 휘어지며, 액츄에이터(135)의 상부 전극(127)의 상부에 장착된 거울(146)은 휘어진 상부 전극(127)에 의해 그 축이 움직여서 경사지게 되어 광원으로부터 입사되는 광속을 반사한다. 상기 거울(146)에 의하여 반사된 광속은 슬릿을 통하여 스크린에 투영됨으로서 화상을 맺게 된다.The strained layer 124 shrinks in a direction perpendicular to the electric field. Accordingly, the actuator 135 including the deformation layer 124 is bent at a predetermined angle, and the mirror 146 mounted on the upper electrode 127 of the actuator 135 is attached to the bent upper electrode 127. As a result, the axis is moved and tilted to reflect the light beam incident from the light source. The light beam reflected by the mirror 146 is projected onto the screen through the slit to form an image.

상술한 바와 같이 본 발명에 따른 박막형 광로 조절 장치의 제조 방법에 의하면, 포토 레지스트의 표면을 자외선에 노출시킴으로써, 포토 레지스트의 표면 부위가 친수성으로 변화하며, 따라서 박막, 특히 질화물 멤브레인과의 접착성이 우수하게 되어 정확하게 비어 홀 및 비어 컨택을 형성할 수 었다. 그러므로, 희생층을 플루오르화 수소를 사용하여 식각할 때, 보호층의 일부가 함께 식각되어 비어 홀 내에 언더 컷이 발생되는 것을 방지할 수 있다.As described above, according to the manufacturing method of the thin film type optical path control device according to the present invention, by exposing the surface of the photoresist to ultraviolet light, the surface portion of the photoresist is changed to hydrophilic, and thus the adhesion to the thin film, in particular the nitride membrane It was excellent enough to form via holes and via contacts accurately. Therefore, when the sacrificial layer is etched using hydrogen fluoride, a portion of the protective layer is etched together to prevent undercuts from occurring in the via holes.

Claims (6)

M×N(M, N은 정수)개의 트랜지스터가 내장되고 일측 상부에 드레인 패드가 형성된 액티브 매트릭스를 제공하는 단계; 상기 액티브 매트릭스의 상부에 멤브레인, 하부 전극, 변형층 및 상부 전극을 포함하는 액츄에이터를 형성하는 단계; 상기 상부 전극, 상기 변형층 및 상기 하부 전극을 패터닝하는 단계; 상기 패터닝된 상부 전극, 변형층 및 하부 전극의 상부에 포토 레지스트를 도포한 후, 상기 포토 레지스트에 자외선을 조사하는 단계; 그리고 상기 액츄에이터의 일측에 상기 드레인 패드와 상기 하부 전극을 연결하는 비어 컨택을 형성하는 단계를 포함하는 박막형 광로 조절 장치의 제조 방법.Providing an active matrix having M × N (M, N is an integer) transistors and a drain pad formed on one side thereof; Forming an actuator on the active matrix, the actuator including a membrane, a lower electrode, a strained layer, and an upper electrode; Patterning the upper electrode, the strain layer, and the lower electrode; Applying a photoresist on top of the patterned upper electrode, the deforming layer and the lower electrode, and then irradiating the photoresist with ultraviolet light; And forming a via contact connecting the drain pad and the lower electrode to one side of the actuator. 제1항에 있어서, 상기 멤브레인을 형성하는 단계는, i) 상기 액티브 매트릭스 및 상기 드레인 패드의 상부에 보호층을 형성하는 단계, ii) 상기 보호층의 상부에 식각 방지층을 형성하는 단계, 그리고 iii) 상기 식각 방지층의 상부에 제1 희생층을 형성한 후, 상기 제1 희생층을 패터닝하여 상기 식각 방지층 중 아래에 상기 드레인 패드가 형성된 부분을 노출시키는 단계 후에 수행되는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The method of claim 1, wherein forming the membrane comprises: i) forming a protective layer on top of the active matrix and the drain pad, ii) forming an etch stop layer on top of the protective layer, and iii And forming a first sacrificial layer on the etch stop layer, and then patterning the first sacrificial layer to expose a portion where the drain pad is formed below the etch stop layer. Method of manufacturing the device. 제1항에 있어서, 상기 자외선을 조사하는 단계는, 상기 포토 레지스트를 1차로 105℃ 내지 120℃의 온도로 가열하면서, 10초 내지 35초 동안 수행한 후, 2차로 상기 포토 레지스트를 145℃ 내지 170℃의 온도로 가열하면서, 40초 내지 80초 동안 수행하는 단계를 더 포함하는 것을 특징으로 하는 박막형 광로 조절 장치의 제조방법.The method of claim 1, wherein the irradiating with ultraviolet rays is performed for 10 seconds to 35 seconds while heating the photoresist to a temperature of 105 ° C. to 120 ° C. first, and then the photoresist to 145 ° C. The method of manufacturing a thin film type optical path control device further comprising the step of performing for 40 to 80 seconds while heating to a temperature of 170 ℃. 제3항에 있어서, 상기 자외선을 조사하는 단계는, 850W/㎤∼870W/㎤의 High Power에서 80초 동안, 20W/㎤∼30W/㎤의 Low Power에서 5초 동안 수행되는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The thin film type as claimed in claim 3, wherein the irradiating with ultraviolet rays is performed for 80 seconds at a high power of 850 W / cm 3 to 870 W / cm 3 and for 5 seconds at a low power of 20 W / cm 3 to 30 W / cm 3. Method of manufacturing the optical path control device. 제1항에 있어서, 상기 비어 컨택을 형성하는 단계는, 상기 패터닝된 상부 전극, 상기 패터닝된 변형층 및 상기 패터닝된 하부 전극을 차례로 식각하여, 상기 변형층으로부터 상기 드레인 패드의 상부까지 수직하게 비어 홀을 형성하는 단계 후에 수행되는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The method of claim 1, wherein the forming of the via contact comprises sequentially etching the patterned upper electrode, the patterned strain layer, and the patterned lower electrode to vertically via the strain pad to an upper portion of the drain pad. A method of manufacturing a thin film type optical path control device, characterized in that performed after the step of forming a hole. 제1항에 있어서, 상기 비어 컨택을 형성하는 단계는, a) 상기 멤브레인을 패터닝하는 단계, b) 상기 패터닝된 상부 전극, 상기 패터닝된 변형층, 상기 패터닝된 하부 전극 및 상기 패터닝된 멤브레인의 상부에 제2 희생층을 형성하는 단계, c) 상기 제2 희생층을 패터닝하여 상기 상부 전극의 일측 상부를 노출시키는 단계, d) 상기 노출된 상부 전극 및 상기 제2 희생층의 상부에 알루미늄, 백금 및 은으로 이루어진 그룹 중에서 선택된 어느 하나를 스퍼터링 하는 단계, e) 상기 스퍼터링된 알루미늄, 백금 및 은으로 이루어진 그룹 중에서 선택된 어느 하나를 패터닝하여 거울 지지부 및 거울을 동시에 형성하는 단계, 그리고 f) 상기 제2 희생층을 산소 플라즈마를 사용하여 제거한 후, 세정 및 건조하는 단계를 더 포함하는 것을 특징으로 하는 박막형 광로 조절 장치의 제조 방법.The method of claim 1, wherein forming the via contact comprises: a) patterning the membrane, b) the patterned top electrode, the patterned strain layer, the patterned bottom electrode, and the top of the patterned membrane Forming a second sacrificial layer on the substrate, c) patterning the second sacrificial layer to expose an upper portion of one side of the upper electrode, and d) aluminum and platinum on the exposed upper electrode and the second sacrificial layer. And sputtering any one selected from the group consisting of silver, e) simultaneously forming a mirror support and a mirror by patterning any one selected from the group consisting of the sputtered aluminum, platinum and silver, and f) the second After removing the sacrificial layer using an oxygen plasma, the thin film type optical path control further comprises the step of cleaning and drying Method of manufacturing the device.
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