KR102333610B1 - 이미지 센서 - Google Patents

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Abstract

본 기술은 복수의 픽셀블럭들이 배열된 픽셀 어레이를 포함하고, 상기 복수의 픽셀블럭들 각각은, 입사광에 응답하여 광전하를 생성하고 플로팅디퓨전을 공유하는 복수의 단위픽셀들을 포함하는 수광부; 상기 수광부의 일측에 위치하고 드라이버 트랜지스터를 포함하는 제1구동부; 상기 수광부의 타측에 위치하고 리셋 트랜지스터를 포함하는 제2구동부; 및 상기 드라이버 트랜지스터와 상기 플로팅디퓨전 사이를 연결하는 제1영역과 상기 플로팅디퓨전과 상기 리셋 트랜지스터를 연결하는 제2영역을 갖는 도전라인을 포함하고, 상기 드라이버 트랜지스터 및 상기 리셋 트랜지스터는 사선방향으로 상기 수광부의 일측 및 타측에 위치할 수 있다.

Description

이미지 센서{IMAGE SENSOR}
본 발명은 반도체 장치 제조 기술에 관한 것으로, 보다 구체적으로는 이미지 센서에 관한 것이다.
이미지 센서(image sensor)는 광학 영상을 전기 신호로 변환시키는 소자이다. 최근 들어, 컴퓨터 산업과 통신 산업의 발달에 따라 디지털 카메라, 캠코더, PCS(Personal Communication System), 게임 기기, 경비용 카메라, 의료용 마이크로 카메라, 로보트 등 다양한 분야에서 집적도 및 성능이 향상된 이미지 센서의 수요가 증대되고 있다.
본 발명의 실시예는 성능이 향상된 이미지 센서를 제공하기 위한 것이다.
본 발명의 실시예에 따른 이미지 센서는 복수의 픽셀블럭들이 배열된 픽셀 어레이를 포함하고, 상기 복수의 픽셀블럭들 각각은, 입사광에 응답하여 광전하를 생성하고 플로팅디퓨전을 공유하는 복수의 단위픽셀들을 포함하는 수광부; 상기 수광부의 일측에 위치하고 드라이버 트랜지스터를 포함하는 제1구동부; 상기 수광부의 타측에 위치하고 리셋 트랜지스터를 포함하는 제2구동부; 및 상기 드라이버 트랜지스터와 상기 플로팅디퓨전 사이를 연결하는 제1영역과 상기 플로팅디퓨전과 상기 리셋 트랜지스터를 연결하는 제2영역을 갖는 도전라인을 포함하고, 상기 드라이버 트랜지스터 및 상기 리셋 트랜지스터는 사선방향으로 상기 수광부의 일측 및 타측에 위치할 수 있다.
상기 제1영역의 도전라인과 상기 제2영역의 도전라인은 실질적으로 동일한 길이를 가질 수 있다. 상기 플로팅디퓨전을 기준으로 상기 제1영역의 도전라인은 상기 제2영역의 도전라인과 대칭일 수 있다. 상기 제1구동부는 선택 트랜지스터를 더 포함할 수 있고, 상기 픽셀블럭 내에서 상기 드라이버 트랜지스터의 게이트는 상기 선택 트랜지스터의 게이트보다 더 외측에 위치할 수 있다. 상기 선택 트랜지스터의 게이트는 상기 플로팅디퓨전과 동일선상에 위치할 수 있다. 상기 제1영역의 도전라인은 상기 드라이버 트랜지스터의 게이트에 전기적으로 연결될 수 있고, 상기 제2영역의 도전라인은 상기 리셋 트랜지스터의 소스에 전기적으로 연결될 수 있다. 상기 픽셀블럭 내에서 상기 리셋 트랜지스터의 게이트는 상기 리셋 트랜지스터의 소스보다 더 외측에 위치할 수 있다. 상기 복수의 단위픽셀들 중에서 상기 드라이버 트랜지스터에 인접한 단위픽셀과 상기 리셋 트랜지스터에 인접한 단위픽셀은 동일한 컬러를 센싱할 수 있다.
본 발명의 실시예에 따른 이미지 센서는 복수의 픽셀블럭들이 배열된 픽셀 어레이를 포함하고, 상기 복수의 픽셀블럭들 각각은, 입사광에 응답하여 광전하를 생성하고 플로팅디퓨전을 공유하며 상기 플로팅디퓨전을 중심으로 일측 상단에 위치하는 제1단위픽셀, 타측 상단에 위치하는 제2단위픽셀, 일측 하단에 위치하는 제3단위픽셀 및 타측 하단에 위치하는 제4단위픽셀을 포함하는 수광부; 상기 제1단위픽셀에 인접하게 위치하고 드라이버 트랜지스터를 포함하는 제1구동부; 상기 제4단위픽셀에 인접하게 위치하고 리셋 트랜지스터를 포함하는 제2구동부; 및 상기 드라이버 트랜지스터와 상기 플로팅디퓨전 사이를 연결하는 제1영역과 상기 플로팅디퓨전과 상기 리셋 트랜지스터를 연결하는 제2영역을 갖는 도전라인을 포함할 수 있다.
또한, 본 발명의 실시예에 따른 이미지 센서는 상기 복수의 픽셀블럭들 각각에 대응하도록 복수의 컬러패턴들이 배열된 컬러필터 어레이를 더 포함할 수 있고, 상기 복수의 컬러패턴들 각각은, 상기 제1단위픽셀에 대응하는 제1컬러필터, 상기 제2단위픽셀에 대응하는 제2컬러필터, 상기 제3단위픽셀에 대응하는 제3컬러필터 및 상기 제4단위픽셀에 대응하는 제4컬러필터를 포함하고, 상기 제1컬러필터와 상기 제4컬러필터는 동일한 색상을 가질 수 있다. 상기 제1컬러필터 및 상기 제4컬러필터는 그린필터를 포함할 수 있다.
상기 제1영역의 도전라인과 상기 제2영역의 도전라인은 실질적으로 동일한 길이를 가질 수 있다. 상기 플로팅디퓨전을 기준으로 상기 제1영역의 도전라인은 상기 제2영역의 도전라인과 대칭일 수 있다. 상기 제1구동부에서 상기 드라이버 트랜지스터가 상기 제1단위픽셀에 인접하게 위치할 수 있고, 상기 제2구동부에서 상기 리셋 트랜지스터가 상기 제4단위픽셀에 인접하게 위치할 수 있다. 상기 제1구동부는 선택 트랜지스터를 더 포함하고, 상기 픽셀블럭 내에서 상기 드라이버 트랜지스터의 게이트는 상기 선택 트랜지스터의 게이트보다 더 외측에 위치할 수 있다. 상기 선택 트랜지스터의 게이트는 상기 플로팅디퓨전과 동일선상에 위치할 수 있다. 상기 제1영역의 도전라인은 상기 드라이버 트랜지스터의 게이트에 전기적으로 연결될 수 있고, 상기 제2영역의 도전라인은 상기 리셋 트랜지스터의 소스에 전기적으로 연결될 수 있다. 상기 픽셀블럭 내에서 상기 리셋 트랜지스터의 게이트는 상기 리셋 트랜지스터의 소스보다 더 외측에 위치할 수 있다.
본 발명의 실시예에 따른 이미지 센서는 입사광에 응답하여 광전하를 생성하고 제1플로팅디퓨전을 공유하며 상기 제1플로팅디퓨전을 둘러싸도록 형성된 복수의 단위픽셀들을 포함하는 제1수광부, 상기 제1수광부 좌측 상단에 형성된 제1구동부 및 상기 제1수광부 우측 하단에 형성된 제2구동부를 포함하는 제1픽셀블럭; 및 입사광에 응답하여 광전하를 생성하고 제2플로팅디퓨전을 공유하며 상기 제2플로팅디퓨전을 둘러싸도록 형성된 복수의 단위픽셀들을 포함하는 제2수광부, 상기 제2수광부 좌측 상단에 형성된 제3구동부 및 상기 제2수광부 우측 하단에 형성된 제4구동부를 포함하는 제2픽셀블럭을 포함하고, 상기 제1픽셀블럭과 상기 제2픽셀블럭은 서로 인접하여 위치하고, 상기 제2구동부와 상기 제3구동부는 동일선상에 위치할 수 있다.
상기 제1구동부 및 상기 제3구동부는 각각 제1 및 제2드라이버 트랜지스터를 포함할 수 있고, 상기 제2구동부 및 제4구동부는 각각 제1 및 제2리셋 트랜지스터를 포함할 수 있다. 상기 제1드라이버 트랜지스터와 상기 제1플로팅디퓨전 사이를 연결하는 제1영역과 상기 제1플로팅디퓨전과 상기 제1리셋 트랜지스터를 연결하는 제2영역을 갖는 제1도전라인; 및 상기 제2드라이버 트랜지스터와 상기 제2플로팅디퓨전 사이를 연결하는 제3영역과 상기 제2플로팅디퓨전과 상기 제2리셋 트랜지스터를 연결하는 제4영역을 갖는 제2도전라인을 더 포함할 수 있고, 상기 제1영역의 제1도전라인과 상기 제2영역의 제1도전라인은 실질적으로 동일한 길이를 갖고, 상기 제3영역의 제2도전라인과 상기 제4영역의 제2도전라인은 실질적으로 동일한 길이를 가질 수 있다. 상기 복수의 단위픽셀들 중 상기 제1구동부에 인접한 단위픽셀, 상기 제2구동부에 인접한 단위픽셀, 제3구동부에 인접한 단위픽셀 및 상기 제4구동부에 인접한 단위픽셀은 모두 동일한 컬러를 센싱할 수 있다.
상술한 과제의 해결 수단을 바탕으로 하는 본 기술은 수광부의 일측 및 타측에 각각 제1구동부 및 제2구동부가 위치하고, 도전라인의 제1영역과 도전라인의 제2영역이 실질적으로 동일한 길이 및 형상을 가짐으로써, 공유 픽셀 구조를 갖는 복수의 단위픽셀들에서 출력되는 출력신호에 차이가 발생하는 것을 방지할 수 있다.
또한, 제1구동부 및 제2구동부에 인접한 단위픽셀들이 동일한 색상의 컬러필터를 구비하여 동일한 컬러를 센싱하는 단위픽셀들에서 출력되는 출력신호에 차이가 발생하는 것을 방지하여 이미지 변환시 오류(error) 및 노이즈(noise)를 최소화할 수 있다.
도 1은 본 발명의 실시예에 따른 이미지 센서의 픽셀블럭 및 픽셀블럭에 대응하는 컬러패턴을 도시한 평면도.
도 2는 본 발명의 실시예에 따른 이미지 센서의 픽셀 어레이 일부를 도시한 평면도.
도 3은 본 발명의 실시예에 따른 이미지 센서의 픽셀 어레이 일부에 대응하는 컬러필터 어레이를 도시한 평면도.
도 4는 본 발명의 실시예에 따른 이미지 센서를 개략적으로 도시한 블럭도.
도 5는 본 발명의 실시예들에 따른 이미지 센서를 구비한 전자장치를 간략히 도시한 도면.
이하 본 발명이 속하는 기술분야에서 통상의 지식을 가진자가 본 발명의 기술적 사상을 용이하게 실시할 수 있을 정도로 상세히 설명하기 위하여, 본 발명의 가장 바람직한 실시예를 도면을 참조하여 설명하기로 한다. 도면은 반드시 일정한 비율로 도시된 것이라 할 수 없으며, 몇몇 예시들에서, 실시예의 특징을 명확히 보여주기 위하여 도면에 도시된 구조물 중 적어도 일부의 비례는 과장될 수도 있다. 도면 또는 상세한 설명에 둘 이상의 층을 갖는 다층 구조물이 개시된 경우, 도시된 것과 같은 층들의 상대적인 위치 관계나 배열 순서는 특정 실시예를 반영할 뿐이어서 본 발명이 이에 한정되는 것은 아니며, 층들의 상대적인 위치 관계나 배열 순서는 달라질 수도 있다. 또한, 다층 구조물의 도면 또는 상세한 설명은 특정 다층 구조물에 존재하는 모든 층들을 반영하지 않을 수도 있다(예를 들어, 도시된 두 개의 층 사이에 하나 이상의 추가 층이 존재할 수도 있다). 예컨대, 도면 또는 상세한 설명의 다층 구조물에서 제1층이 제2층 상에 있거나 또는 기판상에 있는 경우, 제1층이 제2층 상에 직접 형성되거나 또는 기판상에 직접 형성될 수 있음을 나타낼 뿐만 아니라, 하나 이상의 다른 층이 제1층과 제2층 사이 또는 제1층과 기판 사이에 존재하는 경우도 나타낼 수 있다.
후술하는 본 발명의 실시예는 성능이 향상된 이미지 센서를 제공하기 위한 것이다. 여기서, 성능이 향상된 이미지 센서는 고화소 이미지를 제공할 수 있는 이미지 센서를 의미할 수 있으며, 이를 위해 실시예에 따른 이미지 센서는 공유 픽셀 구조(shared pixel structure)를 가질 수 있다. 보다 구체적으로, 본 발명의 실시예는 고화소 이미지를 제공하기 위해 공유 픽셀 구조를 적용함에 따라 각각의 단위픽셀들에서 출력되는 출력신호에 차이가 발생하는 것을 방지할 수 있는 이미지 센서를 제공하기 위한 것이다. 참고로, 레드컬러, 그린컬러 및 블루컬러를 센싱하여 이미지를 구현하는 이미지 센서에서, 상호 인접하게 배치되고 동일한 컬러를 센싱하는 둘 이상의 단위픽셀들 예컨대, 상호 인접하게 배치된 두 개의 그린픽셀들에서 출력되는 출력신호의 크기가 동일해야 이미지 변환시 오류(error) 및 노이즈(noise)를 최소화할 수 있다. 그러나, 공유 픽셀 구조를 갖는 이미지 센서에서는 각각의 단위픽셀들 주변에 배치되는 구조물들 예컨대, 픽셀 트랜지스터들이 서로 상이하기 때문에 발생하는 오버랩 캐패시턴스(Overlap capacitance)의 차이 또는 기생 캐패시턴스(Parasitic capacitance)의 차이로 인해 각각의 단위픽셀들에서 출력되는 출력신호에 차이가 발생한다. 따라서, 후술하는 본 발명의 실시예는 고화소 이미지를 제공하기 위해 공유 픽셀 구조를 적용함에 따라 각각의 단위픽셀들에서 출력되는 출력신호에 차이가 발생하는 것을 방지할 수 있는 이미지 센서를 제공한다. 이를 위해, 상호 인접하게 배치되고 동일한 컬러를 센싱하는 둘 이상의 단위픽셀들과 이들에 인접하게 배치되는 구조물들 사이에서 발생하는 오버랩 캐패시턴스의 크기 또는 기생 캐패시턴스의 크기를 최대한 동일하게 유지할 수 있는 이미지 센서를 제공한다.
도 1은 본 발명의 실시예에 따른 이미지 센서의 픽셀블럭 및 픽셀블럭에 대응하는 컬러패턴을 도시한 평면도이다. 참고로, 컬러패턴은 복수의 컬러필터들을 포함하고, 도 1에서 복수의 컬러필터들은 점선으로 도시하였다. 그리고, 도 1에서 제1방향(D1)은 로우방향 또는 좌우방향일 수 있고, 제2방향(D2)은 컬럼방향 또는 상하방향일 수 있으며, 제3방향(D3)은 사선방향일 수 있다.
도 1에 도시된 바와 같이, 실시예에 따른 이미지 센서는 픽셀블럭(110)을 포함할 수 있다. 픽셀블럭(110)은 입사광에 응답하여 광전하를 생성하고 공유 픽셀 구조를 갖는 복수의 단위픽셀들을 포함하는 수광부(210), 제2방향(D2)으로 각각 수광부(210)의 일측 및 타측에 위치하는 제1구동부(220) 및 제2구동부(230), 수광부(210)와 제1구동부(220) 및 제2구동부(230) 사이를 전기적으로 연결하는 도전라인(240)을 포함할 수 있다. 한편, 실시예에서는 픽셀블럭(110)이 하나의 수광부(210)를 구비하는 경우를 예시하였으나, 본 발명이 이에 한정되는 것은 아니다. 변형예로서, 픽셀블럭(110)은 둘 이상의 수광부(210)를 구비할 수 있고, 둘 이상의 수광부(210)는 제1구동부(220) 및 제2구동부(230)를 공유할 수 있다.
수광부(210)는 m×n(여기서, m,n은 0을 제외한 자연수) 매트릭스 구조로 배열되고 플로팅디퓨전(FD)을 공유하는 복수의 단위픽셀들을 포함할 수 있다. 예를 들어, 수광부(210)는 2×2 매트릭스 구조로 배열된 4개의 단위픽셀들 즉, 제1단위픽셀(211) 내지 제4단위픽셀(214)을 포함하는 4-공유 픽셀 구조(4-shared pixel structure)일 수 있다. 한편, 실시예에서는 수광부(210)가 4-공유 픽셀 구조인 경우를 예시하였으나, 본 발명이 이에 한정되는 것은 아니다. 변형예로서, 수광부(210)는 2n(여기서, n은 0을 제외한 자연수) 공유 픽셀 구조를 가질 수 있다.
수광부(210) 내에서 플로팅디퓨전(FD)은 센터에 위치할 수 있고, 제1단위픽셀(211) 내지 제4단위픽셀(214)은 플로팅디퓨전(FD)을 둘러싸도록 배치될 수 있다. 구체적으로, 수광부(210) 내에서 제1단위픽셀(211), 제2단위픽셀(212), 제3단위픽셀(213) 및 제4단위픽셀(214)은 각각 좌측 상단, 우측 상단, 좌측 하단 및 우측 하단에 위치할 수 있다. 따라서, 제1단위픽셀(211)은 제1구동부(220)에 인접할 수 있고, 제4단위픽셀(214)은 제2구동부(230)에 인접할 수 있다. 후술하겠으나, 상술한 배치는 상호 인접하게 배치되고, 동일한 컬러를 센싱하는 단위픽셀들에서 출력되는 출력신호에 차이가 발생하는 것을 방지하기 위함이다.
제1단위픽셀(211) 내지 제4단위픽셀(214) 각각은 입사광에 응답하여 광전하를 생성하는 광전변환소자(photoelectric conversion element, PD) 및 전송신호에 응답하여 광전변환소자(PD)에서 생성된 광전하를 플로팅디퓨전(FD)으로 전달하는 전송 트랜지스터(transfer transistor, Tx)를 포함할 수 있다. 광전변환소자(PD)는 유기 또는/및 무기 포토다이오드를 포함할 수 있다. 광전변환소자(PD)는 유기 또는 무기 포토다이오드 중 어느 하나로 구성되거나, 또는 유기 포토다이오드와 무기 포토다이오드가 적층된 형태로 구성될 수도 있다. 전송신호는 전송 게이트(TG)에 인가될 수 있고, 광전변환소자(PD) 및 플로팅디퓨전(FD)은 각각 전송 트랜지스터(Tx)의 소스 및 드레인으로 작용할 수 있다.
제1구동부(220)는 수광부(210)에서 생성된 광전하에 대응하는 출력신호를 생성하고, 로우라인(미도시)을 통해 인가되는 선택신호에 응답하여 출력신호를 컬럼라인(미도시)으로 출력할 수 있다. 이를 위해, 제1구동부(220)는 드라이버 트랜지스터(drive transister, Dx) 및 선택 트랜지스터(selection transistor, Sx)를 포함할 수 있다. 드라이버 트랜지스터(Dx) 및 선택 트랜지스터(Sx)는 제1활성영역(221)을 공유할 수 있으며, 각각 드라이버 게이트(DG) 및 선택 게이트(SG)를 포함할 수 있다. 드라이버 게이트(DG)는 도전라인(240)을 통해 플로팅디퓨전(FD)과 전기적으로 연결될 수 있고, 선택 게이트(SG)에는 로우라인(미도시)이 연결될 수 있다. 드라이버 게이트(DG) 및 선택 게이트(SG) 양측 제1활성영역(221)에서는 접합영역들(즉, 소스 및 드레인)이 형성될 수 있다. 드라이버 게이트(DG) 일측 제1활성영역(221)에는 제1접합영역(222)이 형성될 수 있고, 드라이버 게이트(DG) 타측 즉, 드라이버 게이트(DG)와 선택 게이트(SG) 사이의 제1활성영역(221)에는 제2접합영역(223)이 형성될 수 있으며, 선택 게이트(SG) 타측 제1활성영역(221)에는 제3접합영역(224)이 형성될 수 있다. 도면에 도시하지는 않았지만, 제1접합영역(222)은 드라이버 트랜지스터(Dx)의 드레인일 수 있고, 전원전압단이 연결될 수 있다. 그리고, 제3접합영역(224)은 선택 트랜지스터(Sx)의 소스일 수 있고, 컬럼라인(미도시)이 연결될 수 있다.
제1구동부(220)는 제1방향(D1) 및 제2방향(D2)으로 수광부(210)의 일측에 위치할 수 있다. 예를 들어, 제1구동부(220)는 수광부(210)의 좌측 상단에 위치할 수 있다. 제1활성영역(221)은 장축 및 단축을 갖고, 장축이 제1방향(D1)으로 연장된 바타입의 형상을 가질 수 있다. 제1방향(D1)으로 드라이버 게이트(DG)는 선택 게이트(SG)보다 큰 선폭 즉, 더 긴 채널길이를 가질 수 있다. 이는, 출력신호 생성시 노이즈가 발생하는 것을 효과적으로 방지하기 위함이다. 픽셀블럭(110) 내에서 드라이버 게이트(DG)는 선택 게이트(SG)보다 외측에 위치할 수 있다. 다시 말해, 드라이버 게이트(DG)는 선택 게이트(SG)보다 제1단위픽셀(211)에 인접하도록 배치될 수 있다. 예를 들어, 드라이버 게이트(DG)는 선택 게이트(SG)의 좌측에 위치할 수 있다. 후술하겠으나, 드라이버 게이트(DG)를 선택 게이트(SG)보다 제1단위픽셀(211)에 인접하도록 배치하는 것은 도전라인(240)에 기인하여 출력신호에 차이가 발생하는 것을 방지하기 위함이다. 또한, 드라이버 게이트(DG)가 선택 게이트(SG)보다 제1단위픽셀(211)에 인접하도록 배치됨에 따라, 제2방향(D2)으로 선택 게이트(SG)는 플로팅디퓨전(FD)과 동일선상에 위치할 수 있다. 이를 통해, 선택 트랜지스터(Sx)에 기인하여 출력신호에 차이가 발생하는 것을 방지할 수 있다.
제1구동부(220)는 픽업영역(224)을 더 포함할 수 있다. 픽업영역(224)은 제1방향(D1)으로 제1활성영역(221)과 소정 간격 이격되어 나란히 위치할 수 있다. 픽업영역(224)을 통해 수광부(210), 제1구동부(220) 및 제2구동부(230)가 형성된 기판에 소정의 바이어스 예컨대, 접지전압을 인가할 수 있다. 즉, 픽업영역(224)을 통해 이미지 센서의 동작특성을 향상시킬 수 있다.
제2구동부(230)는 리셋신호에 응답하여 수광부(210)의 플로팅디퓨전(FD)을 초기화시킬 수 있다. 이를 위해, 제2구동부(230)는 리셋 트랜지스터(reset transistor, Rx)를 포함할 수 있다. 리셋 트랜지스터(Rx)는 제2활성영역(231), 제2활성영역(231) 상에 형성된 리셋 게이트(RG), 리셋 게이트(RG) 양측 제2활성영역(231)에 각각 형성된 제4접합영역(232) 및 제5접합영역(233)을 포함할 수 있다. 리셋신호는 리셋 게이트(RG)에 인가될 수 있다. 제4접합영역(232)은 리셋 트랜지스터(Rx)의 소스일 수 있고, 도전라인(240)을 통해 플로팅디퓨전(FD)과 전기적으로 연결될 수 있다. 도면에 도시하지는 않았지만, 제5접합영역(233)은 리셋 트랜지스터(Rx)의 드레인일 수 있고, 제1접합영역(222)과 마찬가지로 접원전압단이 연결될 수 있다.
제2구동부(230)는 제1방향(D1) 및 제2방향(D2)으로 수광부(210)의 타측에 위치할 수 있다. 예를 들어, 제2구동부(230)는 수광부(210)의 우측 하단에 위치할 수 있다. 따라서, 제1구동부(220) 및 제2구동부(230)는 수광부(210)를 사이에 두고 제3방향(D3)으로 배치될 수 있다. 제2활성영역(231)은 장축 및 단축을 갖고, 장축이 제1방향(D1)으로 연장된 바타입의 형상을 가질 수 있다. 픽셀블럭(110) 내에서 리셋 게이트(RG)는 도전라인(240) 또는 제4접합영역(232)보다 외측에 위치할 수 있다. 다시 말해, 리셋 게이트(RG)는 제4단위픽셀(214)에 인접하도록 배치될 수 있으며, 도전라인(240)의 우측에 위치할 수 있다. 후술하겠으나, 리셋 게이트(RG)가 제4단위픽셀(214)에 인접하도록 배치하는 것은 도전라인(240)에 기인하여 출력신호에 차이가 발생하는 것을 방지하기 위함이다.
도전라인(240)은 수광부(210)와 제1구동부(220) 및 수광부(210)와 제2구동부(230) 사이를 전기적으로 연결하는 역할을 수행할 수 있다. 구체적으로, 도전라인(240)은 제1콘택(C1)을 통해 수광부(210)의 플로팅디퓨전(FD)과 전기적으로 연결되고, 제2콘택(C2)을 통해 제1구동부(220)의 드라이버 게이트(DG)와 전기적으로 연결되며, 제3콘택(C3)을 통해 제2구동부(230)의 리셋 트랜지스터(Rx) 소스 즉, 제4접합영역(232)과 전기적으로 연결될 수 있다.
도전라인(240)은 수광부(210)의 플로팅디퓨전(FD)과 제1구동부(220)의 드라이버 게이트(DG) 사이를 전기적으로 연결하는 제1영역(240A) 및 수광부(210)의 플로팅디퓨전(FD)과 제2구동부(230)의 제4접합영역(232) 사이를 전기적으로 연결하는 제2영역(240B)을 포함할 수 있다. 여기서, 도전라인(240)에 기인하여 출력신호에 차이가 발생하는 것을 방지하기 위해 도전라인(240)의 제1영역(240A) 및 도전라인(240)의 제2영역(240B)은 실질적으로 동일한 길이를 가질 수 있다. 또한, 제1콘택(C1)을 기준으로 도전라인(240)의 제1영역(240A)과 도전라인(240)의 제2영역(240B)은 실질적으로 동일한 형상을 가질 수 있다. 예를 들어, 제1콘택(C1) 또는 플로팅디퓨전(FD)을 기준으로 도전라인(240)의 제1영역(240A)과 도전라인(240)의 제2영역(240B)은 대칭일 수 있다. 즉, 제1콘택(C1)을 기준으로 도전라인(240)의 제1영역(240A)을 180° 회전시키면 도전라인(240)의 제2영역(240B)과 도전라인(240)의 제1영역(240A)은 중첩될 수 있다. 여기서, 도전라인(240)의 제1영역(240A) 및 도전라인(240)의 제2영역(240B)이 실질적으로 동일한 길이 및 형상을 가짐으로써, 플로팅디퓨전(FD)과 제1구동부(220) 및 제2구동부(230) 사이의 거리를 최소화시킬 수 있기 때문에 도전라인(240)에 기인한 전체 오버랩 캐패시턴스를 최소화할 수 있다. 이를 통해, 플로팅디퓨전(FD)의 유효 캐패시턴스(Effective capacitance)를 감소시킬 수 있으며, 전환이득(conversion gain)을 향상시킬 수 있다.
픽셀블럭(110)에 대응하는 컬러패턴(310)은 픽셀블럭(110) 내 복수의 단위픽셀들 각각에 대응하는 복수의 컬러필터들을 포함할 수 있다. 예를 들어, 컬러패턴(300)은 제1컬러필터(311) 내지 제4컬러필터(314)를 포함할 수 있다. 복수의 컬러필터들 각각은 레드필터(red filter), 그린필터(green filter), 블루필터(blue filter), 사이언필터(cyan filter), 옐로우필터(yellow filter), 마젠타필터(magenta filter), 화이트필터(white filter), 블랙필터(black filter), 적외선차단필터(IR cutoff filter), 적외선패스필터(IR pass filter) 및 특정 파장대역을 통과시키는 밴스패스필터(band pass filter)로 이루어진 그룹으로부터 선택된 어느 하나를 포함하는 단일필터 또는 둘 이상의 포함하는 다중필터일 수 있다.
컬러패턴(310) 내 복수의 컬러필터들 중 적어도 둘 이상의 컬러필터들은 서로 동일한 색상을 가질 수 있다. 예를 들어, 픽셀블럭(110)이 제1단위픽셀(211) 내지 제4단위픽셀(214)을 포함하는 경우, 컬러패턴(310)은 제1단위픽셀(211) 내지 제4단위픽셀(214)에 각각 대응하는 제1컬러필터(311) 내지 제4컬러필터(314)를 포함할 수 있다. 제1컬러필터(311) 내지 제4컬러필터(314) 중 두 개의 컬러필터들은 서로 동일한 색상을 가질 수 있다. 구체적으로, 컬러패턴(310)은 BGb/RGr이 반복되는 베이어 패턴(bayer pattern)일 수 있으며, 제1컬러필터(311), 제2컬러필터(312), 제3컬러필터(313) 및 제4컬러필터(314)는 각각 제1그린필터(Gb), 블루필터(B), 레드필터(R) 및 제2그린필터(Gr)일 수 있다. 따라서, 제1구동부(220)와 인접한 제1단위픽셀(211) 및 제2구동부(230)와 인접한 제4단위픽셀(214)에 각각 대응하는 제1컬러필터(311) 및 제2컬러필터(312)는 그 색상이 동일할 수 있다. 이처럼, 제1구동부(220) 및 제2구동부(230)에 인접하게 배치되는 단위픽셀들에 대응하는 컬러필터들이 동일한 색상을 갖기 때문에 이미지 변환시 오류 및 노이즈를 최소화할 수 있다.
상술한 바와 같이, 실시예에 따른 이미지 센서는 수광부(210)의 일측 및 타측에 각각 제1구동부(220) 및 제2구동부(230)가 위치하고, 도전라인(240)의 제1영역(240A)과 도전라인(240)의 제2영역(240B)이 실질적으로 동일한 길이 및 형상을 가짐으로써, 공유 픽셀 구조를 갖는 복수의 단위픽셀들에서 출력되는 출력신호에 차이가 발생하는 것을 방지할 수 있다.
또한, 제1구동부(220) 및 제2구동부(230)에 인접한 단위픽셀들이 동일한 색상의 컬러필터를 구비하여 동일한 컬러를 센싱하는 단위픽셀들에서 출력되는 출력신호에 차이가 발생하는 것을 방지하여 이미지 변환시 오류 및 노이즈를 최소화할 수 있다.
도 2는 본 발명의 실시예에 따른 이미지 센서의 픽셀 어레이 일부를 도시한 평면도이고, 도 3은 본 발명의 실시예에 따른 이미지 센서의 픽셀 어레이 일부에 대응하는 컬러필터 어레이 일부를 도시한 평면도이다. 참고로, 도 2 및 도 3에서 제1방향(D1)은 로우방향 또는 좌우방향일 수 있고, 제2방향(D2)은 컬럼방향 또는 상하방향일 수 있으며, 제3방향(D3)은 사선방향일 수 있다.
도 2 및 도 3에 도시된 바와 같이, 본 발명의 실시예에 따른 이미지 센서는 복수의 픽셀블럭(110)들이 2차원으로 배열된 픽셀 어레이(100)를 포함할 수 있다. 복수의 픽셀블럭(110)들 각각은 입사광에 응답하여 광전하를 생성하고 공유 픽셀 구조를 갖는 복수의 단위픽셀들을 포함하는 수광부(210), 제2방향(D2)으로 각각 수광부(210)의 일측 및 타측에 위치하는 제1구동부(220) 및 제2구동부(230), 수광부(210)와 제1구동부(220) 및 제2구동부(230) 사이를 전기적으로 연결하는 도전라인(240)을 포함할 수 있다. 픽셀블럭(110)은 앞서 도 1을 참조하여 상세히 설명하였는 바, 여기서는 자세한 설명을 생략하기로 한다.
픽셀 어레이(100)는 복수의 픽셀블럭(110)들 중에서 어느 하나의 픽셀블럭(이하, '제1픽셀블럭(110-1)'이라 함)과 제1방향(D1)으로 인접한 다른 어느 하나의 픽셀블럭(이하, '제2픽셀블럭(110-2)'이라 함)을 포함할 수 있다. 여기서, 제1방향(D1)으로 제1픽셀블럭(110-1)의 수광부(210), 제1구동부(220) 및 제2구동부(230)는 각각 제2픽셀블럭(110-2)의 수광부(210), 제1구동부(220) 및 제2구동부(230)와 동일선상에 위치할 수 있다.
또한, 픽셀 어레이(100)는 복수의 픽셀블럭(110)들 중에서 제2방향(D2)으로 제1픽셀블럭(110-1)과 인접한 또 다른 어느 하나의 픽셀블럭(이하, '제3픽셀블럭(110-3)'이라 함)을 포함할 수 있다. 여기서, 제1방향(D1)으로 제1픽셀블럭(110-1)의 제2구동부(230)와 제3픽셀블럭(110-3)의 제1구동부(220)가 동일선상에 위치할 수 있다. 한편, 도면에 도시하지는 않았지만, 제1방향(D1)으로 제1픽셀블럭(110-1)의 제1구동부(220)와 제3픽셀블럭(110-3)의 제2구동부(230)가 동일선상에 위치할 수도 있다.
컬러필터 어레이(300)는 복수의 픽셀블럭(110)들 각각에 대응하도록 2차원으로 배열된 복수의 컬러패턴(310)들을 포함할 수 있다. 복수의 컬러패턴(310)들 각각은 제1컬러필터(311) 내지 제4컬러필터(314)를 포함하고, 복수의 컬러패턴(310)들 각각은 제1컬러필터(311) 내지 제4컬러필터(314)의 배치 형상이 동일할 수 있다.
상술한 바와 같이, 실시예에 따른 이미지 센서에서 픽셀 어레이(100)는 제1방향(D1)으로 제1픽셀블럭(110)의 제2구동부(230)와 제3픽셀블럭(110)의 제1구동부(220)가 동일선상에 위치하도록 배치함으로써, 고집적화가 용이하고, 공유 픽셀 구조를 갖는 복수의 단위픽셀들에서 출력되는 출력신호에 차이가 발생하는 것을 보다 효과적으로 방지할 수 있다.
도 4는 본 발명의 실시예에 따른 이미지 센서를 개략적으로 도시한 블럭도이다.
도 4에 도시된 바와 같이, 이미지 센서는 복수의 픽셀블럭(110)들이 매트릭스 구조로 배열된 픽셀 어레이(pixel array, 100), 상관 이중 샘플링(correlated double sampling, CDS, 120), 아날로그-디지털 컨버터(analog digital converter, ADC, 130), 버퍼(Buffer, 140), 로우 드라이버(row driver, 150), 타이밍 제너레이터(timing generator, 160), 제어 레지스터(control register, 170) 및 램프 신호 제너레이터(ramp signal generator, 180)를 포함할 수 있다.
타이밍 제너레이터(160)는 로우 드라이버(150), 상관 이중 샘플링(120), 아날로그-디지털 컨버터(130) 및 램프 신호 제너레이터(180) 각각의 동작을 제어하기 위한 하나 이상의 제어 신호를 생성한다. 제어 레지스터(170)는 램프 신호 제너레이터(180), 타이밍 제너레이터(160) 및 버퍼(140) 각각의 동작을 제어하기 위한 하나 이상의 제어 신호를 생성한다.
로우 드라이버(150)는 픽셀 어레이(100)를 로우라인(row line) 단위로 구동한다. 예컨대, 로우 드라이버(150)는 복수의 로우라인(row line)들 중에서 어느 하나의 로우라인(row line)을 선택할 수 있는 선택 신호를 생성할 수 있다. 복수의 로우라인(row line)들 각각에는 복수의 픽셀블럭(110)들과 연결된다. 그리고, 복수의 픽셀블럭(110)들 각각에는 하나의 로우라인(row line)이 연결된다.
복수의 픽셀블럭(110)들 각각은 입사광을 감지하여 이미지 리셋 신호와 이미지 신호를 컬럼라인(column line)을 통해 상관 이중 샘플링(120)으로 출력한다. 상관 이중 샘플링(120)은 수신된 이미지 리셋 신호와 이미지 신호 각각에 대하여 샘플링을 수행한다. 복수의 컬럼라인(column line)들 각각에는 복수의 픽셀블럭(110)들이 연결된다. 복수의 픽셀블럭(110)들 각각에는 하나의 컬럼라인(column line)이 연결된다. 아날로그-디지털 컨버터(130)는 램프 신호 제너레이터(180)로부터 출력된 램프 신호와 상관 이중 샘플링(120)으로부터 출력되는 샘플링 신호를 서로 비교하여 비교 신호를 출력한다. 타이밍 제너레이터(160)로부터 제공되는 클럭 신호에 따라 비교 신호의 레벨 전이(transition) 시간을 카운트하고, 카운트 값을 버퍼(140)로 출력한다. 램프 신호 제너레이터(180)는 타이밍 제너레이터(160)의 제어 하에 동작할 수 있다.
버퍼(140)는 아날로그-디지털 컨버터(130)로부터 출력된 복수의 디지털 신호 각각을 저장한 후 이들 각각을 감지 증폭하여 출력한다. 따라서, 버퍼(140)는 메모리(미도시)와 감지증폭기(미도시)를 포함할 수 있다. 메모리는 카운트 값을 저장하기 위한 것이며, 카운트 값은 복수의 픽셀블럭(110)들로부터 출력된 신호에 연관된 카운트 값을 의미한다. 감지증폭기는 메모리로부터 출력되는 각각의 카운트 값을 감지하여 증폭한다.
상술한 실시예에 따른 이미지 센서는 다양한 전자장치 또는 시스템에 이용될 수 있다. 이하에서는, 도 5를 참조하여 카메라에 본 발명의 실시예에 따른 이미지 센서를 적용한 경우를 예시하여 설명하기로 한다.
도 5는 본 발명의 실시예들에 따른 이미지 센서를 구비한 전자장치를 간략히 도시한 도면이다.
도 5를 참조하여, 실시예들에 따른 이미지 센서를 구비한 전자장치는 정지영상 또는 동영상을 촬영할 수 있는 카메라일 수 있다. 전자장치는 광학 시스템(910, 또는, 광학 렌즈), 셔터 유닛(911), 이미지 센서(900) 및 셔터 유닛(911)을 제어/구동하는 구동부(913) 및 신호 처리부(912)를 포함할 수 있다.
광학 시스템(910)은 피사체로부터의 이미지 광(입사광)을 이미지 센서(900)의 픽셀 어레이(도 4의 도면부호 '100' 참조)로 안내한다. 광학 시스템(910)은 복수의 광학 렌즈로 구성될 수 있다. 셔터 유닛(911)은 이미지 센서(900)에 대한 광 조사 기간 및 차폐 기간을 제어한다. 구동부(913)는 이미지 센서(900)의 전송 동작과 셔터 유닛(911)의 셔터 동작을 제어한다. 신호 처리부(912)는 이미지 센서(900)로부터 출력된 신호에 관해 다양한 종류의 신호 처리를 수행한다. 신호 처리 후의 이미지 신호(Dout)는 메모리 등의 저장 매체에 저장되거나, 모니터 등에 출력된다.
본 발명의 기술 사상은 상기 바람직한 실시예에 따라 구체적으로 기술되었으나, 상기 실시예는 그 설명을 위한 것이며, 그 제한을 위한 것이 아님을 주의하여야 한다. 또한, 본 발명의 기술분야의 통상의 전문가라면 본 발명의 기술사상의 범위내의 다양한 실시예가 가능함을 이해할 수 있을 것이다.
100 : 픽셀 어레이 110 : 픽셀블럭
210 : 수광부 211 : 제1단위픽셀
212 : 제2단위픽셀 213 : 제3단위픽셀
214 : 제4단위픽셀 PD : 광전변환소자
FD : 플로팅디퓨전 TG : 전송 게이트
DG : 드라이버 게이트 RG : 리셋 게이트
SG : 선택 게이트 Tx : 전송 트랜지스터
Rx : 리셋 트랜지스터 Dx : 드라이버 트랜지스터
Sx : 선택 트랜지스터 220 : 제1구동부
221 : 제1활성영역 222 : 제1접합영역
223 : 제2접합영역 224 : 제3접합영역
225 : 픽업영역 230 : 제2구동부
231 : 제2활성영역 232 : 제4접합영역
233 : 제5접합영역 240 : 도전라인
240A : 제1영역 240B : 제2영역
300 : 컬러필터 어레이 310 : 컬러패턴
311 : 제1컬러필터 312 : 제2컬러필터
313 : 제3컬러필터 314 : 제4컬러필터
C1 : 제1콘택 C2 : 제2콘택
C3 : 제3콘택

Claims (22)

  1. 삭제
  2. 삭제
  3. 삭제
  4. 삭제
  5. 삭제
  6. 삭제
  7. 삭제
  8. 삭제
  9. 제1 내지 제4 픽셀블럭들이 2X2의 매트릭스 구조로 배열된 픽셀 어레이를 포함하고, 상기 제1 픽셀블럭과 상기 제2 픽셀블럭이 로우 방향으로 인접하고, 상기 제3 픽셀블럭과 상기 제4 픽셀블럭이 상기 로우 방향으로 인접하고, 상기 제1 픽셀블럭과 상기 제3 픽셀블럭이 컬럼 방향으로 인접하고, 및 상기 제2 픽셀블럭과 상기 제4 픽셀블럭이 상기 컬럼 방향으로 인접하고,
    상기 제1 내지 제4 픽셀블럭들 각각은,
    입사광에 응답하여 광전하를 생성하고 플로팅디퓨전을 공유하며 상기 플로팅디퓨전을 중심으로 좌측 상단에 위치하는 제1단위픽셀, 우측 상단에 위치하는 제2단위픽셀, 좌측 하단에 위치하는 제3단위픽셀 및 우측 하단에 위치하는 제4단위픽셀을 포함하는 수광부;
    상기 제1단위픽셀에 인접하게 위치하고 드라이버 트랜지스터를 포함하는 제1구동부;
    상기 제4단위픽셀에 인접하게 위치하고 리셋 트랜지스터를 포함하는 제2구동부; 및
    상기 드라이버 트랜지스터와 상기 플로팅디퓨전 사이를 연결하는 제1영역과 상기 플로팅디퓨전과 상기 리셋 트랜지스터를 연결하는 제2영역을 갖는 도전라인을 포함하고,
    상기 제3 픽셀블럭의 상기 제1 구동부의 상기 드라이버 트랜지스터, 상기 제1 픽셀블럭의 상기 제2 구동부의 상기 리셋 트랜지스터, 상기 제4 픽셀블럭의 상기 제1 구동부의 상기 드라이버 트랜지스터, 및 상기 제2 픽셀블럭의 상기 제2 구동부의 상기 리셋 트랜지스터가 상기 로우 방향으로 동일선상에 위치하고,
    상기 제3 픽셀블럭의 상기 제1 구동부의 상기 드라이버 트랜지스터는 상기 제1 픽셀블럭의 상기 제3 단위픽셀과 상기 제3 픽셀블럭의 상기 제1 단위픽셀의 사이에 위치하고,
    상기 제1 픽셀블럭의 상기 제2 구동부의 상기 리셋 트랜지스터는 상기 제1 픽셀블럭의 상기 제4 단위픽셀과 상기 제3 픽셀블럭의 상기 제2 단위픽셀의 사이에 위치하고,
    상기 제4 픽셀블럭의 상기 제1 구동부의 상기 드라이버 트랜지스터는 상기 제2 픽셀블럭의 상기 제3 단위픽셀과 상기 제4 픽셀블럭의 상기 제1 단위픽셀 사이에 위치하고,
    상기 제2 픽셀블럭의 상기 제2 구동부의 상기 리셋 트랜지스터는 상기 제2 픽셀블럭의 상기 제4 단위픽셀과 상기 제4 픽셀블럭의 상기 제2 단위픽셀 사이에 위치하는 이미지 센서.
  10. ◈청구항 10은(는) 설정등록료 납부시 포기되었습니다.◈
    제9항에 있어서,
    상기 제1 내지 제4 픽셀블럭들 각각에 대응하도록 복수의 컬러패턴들이 배열된 컬러필터 어레이를 더 포함하고, 상기 복수의 컬러패턴들 각각은,
    상기 제1단위픽셀에 대응하는 제1컬러필터, 상기 제2단위픽셀에 대응하는 제2컬러필터, 상기 제3단위픽셀에 대응하는 제3컬러필터 및 상기 제4단위픽셀에 대응하는 제4컬러필터를 포함하고, 상기 제1컬러필터와 상기 제4컬러필터는 동일한 색상을 갖는 이미지 센서.
  11. ◈청구항 11은(는) 설정등록료 납부시 포기되었습니다.◈
    제10항에 있어서,
    상기 제1컬러필터 및 상기 제4컬러필터는 그린필터를 포함하는 이미지 센서.
  12. ◈청구항 12은(는) 설정등록료 납부시 포기되었습니다.◈
    제9항에 있어서,
    상기 제1영역의 도전라인과 상기 제2영역의 도전라인은 실질적으로 동일한 길이를 갖는 이미지 센서.
  13. ◈청구항 13은(는) 설정등록료 납부시 포기되었습니다.◈
    제9항에 있어서,
    상기 플로팅디퓨전을 기준으로 상기 제1영역의 도전라인은 상기 제2영역의 도전라인과 점 대칭인 이미지 센서.
  14. 삭제
  15. ◈청구항 15은(는) 설정등록료 납부시 포기되었습니다.◈
    제9항에 있어서,
    상기 제1구동부는 선택 트랜지스터를 더 포함하고,
    상기 픽셀블럭 내에서 상기 드라이버 트랜지스터의 게이트는 상기 선택 트랜지스터의 게이트보다 더 외측에 위치하는 이미지 센서.
  16. ◈청구항 16은(는) 설정등록료 납부시 포기되었습니다.◈
    제15항에 있어서,
    상기 선택 트랜지스터의 게이트는 상기 플로팅디퓨전과 상기 컬럼 방향으로 동일선상에 위치하는 이미지 센서.
  17. ◈청구항 17은(는) 설정등록료 납부시 포기되었습니다.◈
    제9항에 있어서,
    상기 제1영역의 도전라인은 상기 드라이버 트랜지스터의 게이트에 전기적으로 연결되고,
    상기 제2영역의 도전라인은 상기 리셋 트랜지스터의 소스에 전기적으로 연결되는 이미지 센서.
  18. ◈청구항 18은(는) 설정등록료 납부시 포기되었습니다.◈
    제17항에 있어서,
    상기 픽셀블럭 내에서 상기 리셋 트랜지스터의 게이트는 상기 리셋 트랜지스터의 소스보다 더 외측에 위치하는 이미지 센서.
  19. 입사광에 응답하여 광전하를 생성하고 제1플로팅디퓨전을 공유하며 상기 제1플로팅디퓨전을 둘러싸도록 형성된 제1 내지 제4 단위픽셀들을 포함하는 제1수광부, 상기 제1수광부 좌측 상단에 형성된 제1구동부 및 상기 제1수광부 우측 하단에 형성된 제2구동부를 포함하는 제1픽셀블럭; 및
    입사광에 응답하여 광전하를 생성하고 제2플로팅디퓨전을 공유하며 상기 제2플로팅디퓨전을 둘러싸도록 형성된 제5 내지 제8 단위픽셀들을 포함하는 제2수광부, 상기 제2수광부 좌측 상단에 형성된 제3구동부 및 상기 제2수광부 우측 하단에 형성된 제4구동부를 포함하는 제2픽셀블럭을 포함하고,
    상기 제1 플로팅디퓨전은 상기 제1 수광부의 중앙에 위치하고,
    상기 제1 단위픽셀은 상기 제1 수광부 내에서 좌상에 위치하고,
    상기 제2 단위픽셀은 상기 제1 수광부 내에서 우상에 위치하고,
    상기 제3 단위픽셀은 상기 제1 수광부 내에서 좌하에 위치하고,
    상기 제4 단위픽셀은 상기 제1 수광부 내에서 우하에 위치하고,
    상기 제2 플로팅디퓨전은 상기 제2 수광부의 중앙에 위치하고,
    상기 제5 단위픽셀은 상기 제2 수광부 내에서 좌상에 위치하고,
    상기 제6 단위픽셀은 상기 제2 수광부 내에서 우상에 위치하고,
    상기 제7 단위픽셀은 상기 제2 수광부 내에서 좌하에 위치하고,
    상기 제8 단위픽셀은 상기 제2 수광부 내에서 우하에 위치하고,
    상기 제1픽셀블럭과 상기 제2픽셀블럭은 컬럼 방향으로 서로 인접하여 위치하고,
    상기 제1 픽셀블럭의 상기 제2구동부와 상기 제2 픽셀블럭의 상기 제3구동부는 로우 방향으로 연장하는 동일선상에 위치하고,
    상기 제1 픽셀블럭의 상기 제1 구동부, 상기 제1 픽셀블럭의 상기 제1 단위픽셀 및 상기 제3 단위픽셀, 상기 제2 픽셀블럭의 상기 제3 구동부, 및 상기 제2 픽셀블럭의 상기 제5 단위픽셀 및 상기 제7 단위픽셀이 상기 컬럼 방향으로 연장하는 제1 선 상에 위치하고, 및
    상기 제1 픽셀블럭의 상기 제2 단위픽셀 및 상기 제4 단위픽셀, 상기 제1 픽셀블럭의 상기 제2 구동부, 및 상기 제2 단위픽셀의 상기 제6 단위픽셀 및 상기 제8 단위픽셀이 상기 컬럼 방향으로 연장하는 제2 선 상에 사이에 위치하는 이미지 센서.
  20. ◈청구항 20은(는) 설정등록료 납부시 포기되었습니다.◈
    제19항에 있어서,
    상기 제1구동부 및 상기 제3구동부는 각각 제1 및 제2드라이버 트랜지스터를 포함하고,
    상기 제2구동부 및 제4구동부는 각각 제1 및 제2리셋 트랜지스터를 포함하고,
    상기 제1 플로팅디퓨전, 상기 제1 리셋 트랜지스터, 상기 제2 플로팅디퓨전, 및 상기 제2 리셋 트랜지스터는 상기 컬럼 방향으로 연장하는 동일선상에 위치하는 이미지 센서.
  21. ◈청구항 21은(는) 설정등록료 납부시 포기되었습니다.◈
    제20항에 있어서,
    상기 제1드라이버 트랜지스터와 상기 제1플로팅디퓨전 사이를 연결하는 제1영역과 상기 제1플로팅디퓨전과 상기 제1리셋 트랜지스터를 연결하는 제2영역을 갖는 제1도전라인; 및
    상기 제2드라이버 트랜지스터와 상기 제2플로팅디퓨전 사이를 연결하는 제3영역과 상기 제2플로팅디퓨전과 상기 제2리셋 트랜지스터를 연결하는 제4영역을 갖는 제2도전라인을 더 포함하고,
    상기 제1영역의 제1도전라인과 상기 제2영역의 제1도전라인은 실질적으로 동일한 길이를 갖고, 상기 제3영역의 제2도전라인과 상기 제4영역의 제2도전라인은 실질적으로 동일한 길이를 갖는 이미지 센서.
  22. ◈청구항 22은(는) 설정등록료 납부시 포기되었습니다.◈
    제19항에 있어서,
    상기 복수의 단위픽셀들 중 상기 제1구동부에 인접한 상기 제1 단위픽셀, 상기 제2구동부에 인접한 상기 제4 단위픽셀, 제3구동부에 인접한 상기 제5 단위픽셀 및 상기 제4구동부에 인접한 상기 제8 단위픽셀은 모두 동일한 컬러를 센싱하는 이미지 센서.
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