KR102295530B1 - 재구성가능한 멀티-모드 트랜시버 - Google Patents

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Abstract

본 발명은, 복수의 주파수 신시사이저들 및 복수의 CA(carrier aggregation) 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하는 방법에 관한 것이며, 이 방법은: 제 1 CA Tx 체인에 제 1 주파수 신시사이저를 연결하는 단계; 복수의 CA Rx 체인들에 복수의 주파수 신시사이저들을 연결하는 단계를 포함하고, 여기서 복수의 주파수 신시사이저들 중 제 2 주파수 신시사이저는 제 1 CA Rx 체인 및 제 2 CA Tx 체인에 공유 신시사이저로서 연결된다.

Description

재구성가능한 멀티-모드 트랜시버{RECONFIGURABLE MULTI-MODE TRANSCEIVER}
[0001] 본 발명은, 일반적으로 트랜시버들에 관한 것으로, 더욱 구체적으로 재구성가능한 멀티-모드 트랜시버(reconfigurable multi-mode transceiver)에 관한 것이다.
[0002] 통신 시스템에서의 트랜시버는 양방향 통신을 위해 송신기를 사용하여 데이터를 송신할 수 있고 수신기를 사용하여 데이터를 수신할 수 있다. 트랜시버는 또한, 다수의 캐리어들 상에서의 동시 동작인 CA(carrier aggregation)를 지원할 수 있다. LTE(Long Term Evolution)/FDD(Frequency Division Duplex), LTE/TDD(Time Division Duplex), CSFB(Circuit-Switched FallBack), SVLTE(Simultaneous Voice and LTE), SGLTE(Simultaneous GSM and LTE), DSDS(Dual SIM Dual Standby), 및 다른 유사하게-구성된 디바이스들을 포함하는 멀티-모드 트랜시버들은 전세계의 상이한 지역들에서 몇몇 상이한 조합들로 공존한다(co-exist). 게다가, 2개, 3개, 및 4개의 다운링크들을 갖는 LTE 캐리어 어그리게이션이 이미 출시되어 있거나 또는 곧 상용화될 것이다. 따라서, 무선 데이터에 대한 커져가는 요구들을 충족시키기 위해 무결절성의(seamless) FDD와 TDD 상호운용성을 제공하는 동시에 다수의 모드들 및 대역들을 핸들링할 수 있는 디바이스가 필요하다. 그러나, FDD 동작과 TDD 동작 둘 다의 지원은 멀티-모드 트랜시버의 RX(receive) 및 TX(transmit) 링크들로의 LO(local oscillator) 및 신시사이저 연결들을 복잡하게 한다.
[0003] 멀티-대역, 멀티-모드 디바이스들에 대한 필요성과 연관된 문제들을 해결하기 위해, 하나의 트랜시버(예컨대, FDD 트랜시버)가 제 1 칩 상에 상주하고 그리고 다른 트랜시버(예컨대, LTE-CA 및 다른 기술들을 지원하는 TDD 트랜시버)가 제 2 칩 상에 상주하는 2-칩 구성이 사용될 수 있다. 이러한 구성이 필요한 특징들을 제공할 수 있지만, 이러한 구성은 더 많은 칩 면적을 점유할 것이고, 더 많은 전류를 소비할 것이며, 그리고 단일-칩 솔루션보다 더 적은 수의 CA 조합들을 지원할 것이다. 이에 따라, FDD와 TDD 상호운용성을 개선시키기 위한 단일-칩 솔루션 및 더 나은 스펙트럼 활용을 제공하기 위해 최소의 하드웨어를 융통성 있게 갖춘 트랜시버를 재구성하고 재사용하기 위한 필요성이 존재한다.
[0004] 본 개시내용의 세부사항들은, 그 구조 및 동작 둘 다에 관해서, 첨부된 추가 도면들의 검토에 의해 부분적으로 얻어질 수 있으며, 도면들에서 유사한 참조 수치들은 유사한 부분들을 지칭한다.
[0005] 도 1a는 무선 통신 시스템과 통신하는 무선 디바이스이다.
[0006] 도 1b는 도 1a에 도시된 무선 디바이스의 예시적인 설계의 블록도이다.
[0007] 도 1c는 본 개시물의 일 실시예에 따라 정해진 수의 신시사이저들을 사용하여 DL(downlink)들 및 UL(uplink)들의 수를 최대화하도록 트랜시버 설계를 재구성하기 위한 방법을 예시하는 흐름도이다.
[0008] 도 2a는 도 1c에 설명된 방법을 사용하여 설계된 FDD/TDD CA 트랜시버의 일 예시의 경우 (LTE FDD(3DL+1UL)+LTE TDD(1DL+1UL))를 예시한다.
[0009] 도 2b는 도 2a에 도시된 FDD/TDD CA 트랜시버의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다.
[0010] 도 3a는 도 1c에 설명된 방법을 사용하여 설계된 TDD CA 트랜시버의 다른 예시의 경우 (LTE TDD(2DL/intra/non-contiguous+1UL+2DL/inter+1UL))를 예시한다.
[0011] 도 3b는 도 3a에 도시된 TDD CA 트랜시버의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다.
[0012] 도 4a는 도 1c에 설명된 방법을 사용하여 설계된 FDD CA 트랜시버의 다른 예시의 경우 (LTE FDD(4DL+1UL))를 예시한다.
[0013] 도 4b는 도 4a에 도시된 FDD CA 트랜시버의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다.
[0014] 도 5a는 도 1c에 설명된 방법을 사용하여 설계된 FDD CA 트랜시버의 다른 예시의 경우 (LTE FDD(2DL/intra+1UL+1DL+1UL))를 예시한다.
[0015] 도 5b는 도 5a에 도시된 FDD CA 트랜시버의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다.
[0016] 도 6a는 도 1c에 설명된 방법을 사용하여 설계된 FDD/TDD/GSM CA 트랜시버의 다른 예시의 경우 (LTE FDD(3DL+1UL)+GSM/TDD(1DL+1UL))를 예시한다.
[0017] 도 6b는 도 6a에 도시된 FDD/TDD/GSM CA 트랜시버의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다.
[0018] 도 7a는 도 1c에 설명된 방법을 사용하여 설계된 FDD/TDD/SVLTE CA 트랜시버의 다른 예시의 경우 (SVLTE TDD(3DL+1UL)+CDMA/FDD(1DL+1UL))를 예시한다.
[0019] 도 7b는 도 7a에 도시된 FDD/TDD/SVLTE CA 트랜시버의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다.
[0020] 도 8a는 도 1c에 설명된 방법을 사용하여 설계된 FDD/TDD/SVLTE+DSDS CA 트랜시버의 다른 예시의 경우 (SVLTE FDD(2DL+1UL)+LTE TDD(1DL+ 1UL)+CDMA(1DL))를 예시한다.
[0021] 도 8b는 도 8a에 도시된 FDD/TDD/SVLTE+DSDS CA 트랜시버의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다.
[0022] 위에 설명된 바와 같이, FDD 동작과 TDD 동작 둘 다를 지원하는 것은 멀티-모드 트랜시버의 RX(receive) 및 TX(transmit) 링크들로의 LO(local oscillator) 및 신시사이저 연결들을 복잡하게 한다.
[0023] 본원에 설명된 것과 같은 실시예는, FDD(Frequency Division Duplex)와 TDD(Time Division Duplex) 상호운용성을 개선시키기 위한 단일-칩 솔루션 및 더 나은 스펙트럼 활용을 제공하기 위해 최소의 하드웨어를 통해 트랜시버를 융통성 있게 재구성하고 재사용하는 것을 제공한다. 본 상세한 설명을 판독한 후, 본 발명을 다양한 구현들 및 애플리케이션들에서 구현시키는 방법이 명확하게 될 것이다. 본 개시내용의 다양한 구현들이 본원에 설명될 것이지만, 이러한 구현들이 한정이 아닌 단지 예시에 의해 제시된다는 점이 이해된다. 이로써, 다양한 구현들의 이러한 상세한 설명은 본 개시내용의 범위 또는 규모(breadth)를 제한하는 것으로 해석되지 않아야 한다.
[0024] 도 1a는 무선 통신 시스템(100)과 통신하는 무선 디바이스(110)이다. 무선 시스템(100)은 LTE(Long Term Evolution) 시스템, CDMA(Code Division Multiple Access) 시스템, GSM(Global System for Mobile Communications) 시스템, WLAN(wireless local area network) 시스템, 또는 몇몇 다른 무선 시스템일 수도 있다. CDMA 시스템은 WCDMA(Wideband CDMA), CDMA 1X, EVDO(Evolution-Data Optimized), TD-SCDMA(Time Division Synchronous CDMA), 또는 CDMA의 일부 다른 버전을 구현할 수 있다. 간략화를 위해, 도 1a는 2개의 기지국들(120 및 122) 및 하나의 시스템 제어기(130)를 포함하는 무선 시스템(100)을 도시한다. 일반적으로, 무선 시스템은 임의의 수의 기지국들 및 임의의 세트의 네트워크 엔티티들을 포함할 수 있다.
[0025] 무선 디바이스(110)는 또한 UE(user equipment), 이동국, 단말, 액세스 단말, 가입자 유닛, 스테이션 등으로 지칭될 수 있다. 무선 디바이스(110)는 셀룰러 폰, 스마트폰, 태블릿, 무선 모뎀, PDA(personal digital assistant), 핸드헬드 디바이스, 랩탑 컴퓨터, 스마트북, 넷북, 코드리스 폰, WLL(wireless local loop) 스테이션, 블루투스 디바이스 등일 수 있다. 무선 디바이스(110)는 무선 시스템(100)과 통신할 수 있다. 무선 디바이스(110)는 또한, 브로드캐스트 스테이션들(예컨대, 브로드캐스트 스테이션(124))로부터의 신호들, 하나 또는 그 초과의 GNSS(global navigation satellite system)내의 위성들(예컨대, 위성(140))로부터의 신호들 등을 수신할 수 있다. 무선 디바이스(110)는 무선 통신을 위한 하나 또는 그 초과의 라디오 기술들, 예컨대, LTE, WCDMA, CDMA 1X, EVDO, TD-SCDMA, GSM, 802.11 등을 지원할 수 있다.
[0026] 무선 디바이스(110)는, 1000 메가헤르츠(MHz)보다 낮은 주파수들을 커버하는 로우-대역(LB), 1000MHz 내지 2300MHz의 주파수들을 커버하는 중간-대역(MB), 및/또는 2300MHz보다 높은 주파수들을 커버하는 하이-대역(HB)에서 동작할 수 있다. 예컨대, 로우-대역은 698 내지 960 MHz를 커버할 수 있고, 중간-대역은 1475 내지 2170 MHz를 커버할 수 있고, 하이-대역은 2300 내지 2690 MHz 그리고 3400 내지 3800 MHz를 커버할 수 있다. 로우-대역, 중간-대역, 및 하이-대역은 3개의 그룹들의 대역들(또는 대역 그룹들)을 지칭하며, 여기서 각각의 대역 그룹은 다수의 주파수 대역들(또는 간단하게, "대역들")을 포함한다. 각각의 대역은 200MHz까지 커버할 수 있다. LTE Release 11은, LTE/UMTS 대역들로 지칭되고 공개적으로 이용가능한 문헌 3GPP TS 36.101에 열거된 35개의 대역들을 지원한다. 일반적으로, 임의의 수의 대역 그룹들이 정의될 수 있다. 각각의 대역 그룹은, 앞서 제공된 주파수 범위들 중 임의의 것과 일치할 수 있거나 또는 일치하지 않을 수 있는 임의의 범위의 주파수들을 커버할 수 있다. 각각의 대역 그룹은 임의의 수의 대역들을 포함할 수 있다.
[0027] 무선 디바이스(110)는 캐리어 어그리게이션을 지원할 수 있으며, 캐리어 어그리게이션은 FDD 및 TDD 모드들에서의 LTE-어드밴스드 기술을 위해 다수의 다운링크들(DL) 및 다수의 업링크들(UP)을 갖는 다수의 캐리어들 상에서의 동작이다. 따라서, 캐리어 어그리게이션은 멀티-캐리어 동작으로도 또한 지칭될 수 있다. 캐리어는 통신을 위해 사용되는 주파수들의 범위를 지칭할 수 있고 소정의 특성들과 연관될 수 있다. 예컨대, 캐리어는 캐리어 상에서의 동작을 설명하는 시스템 정보 및/또는 제어 정보와 연관될 수 있다. 캐리어는 또한 CC(component carrier), 주파수 채널, 셀 등으로서 지칭될 수도 있다. 대역은 하나 또는 그 초과의 캐리어들을 포함할 수 있다. 각각의 캐리어는 LTE에서 20MHz까지 커버할 수 있다. 무선 디바이스(110)는 하나 또는 두 개의 대역들 내에서 5개까지의 캐리어들을 갖도록 구성될 수 있다.
[0028] 무선 디바이스(110)는 상이한 주파수들에서 동시에 전송되는 다수의 송신된 신호들을 수신할 수 있다. 이러한 다수의 송신된 신호들은, (i) 캐리어 어그리게이션을 위해 상이한 주파수들에 있는 다수의 캐리어들 상에서 하나 또는 그 초과의 기지국들, 또는 (ii) CoMP(coordinated multi-point)를 위한 동일한 무선 시스템 내에서의 상이한 기지국들, 또는 (iii) 동시 서비스(concurrent service)들(예컨대, 동시 보이스/보이스, 보이스/데이터, 데이터/데이터 등)을 위한 하나 또는 그 초과의 무선 시스템들 내에서의 하나 또는 그 초과의 기지국들, 또는 (iv) 동시 송신들을 위한 하나 또는 그 초과의 기지국들에 의해 전송될 수 있다.
[0029] 도 1b는 도 1a에 도시된 무선 디바이스(110)의 예시적인 설계의 블록도이다. 이러한 예시적인 설계에서, 무선 디바이스(110)는 주(primary) 안테나(214)에 커플링된 트랜시버(220), 보조 안테나(212)에 커플링된 트랜시버(222), 및 데이터 프로세서/제어기(280)를 포함한다. 트랜시버(220)는 다수의 주파수 대역들, 다수의 라디오 기술들, 캐리어 어그리게이션 등을 지원하기 위해 다수의(k개) 수신기들(230pa 내지 230pk) 및 다수의(k개) 송신기들(250pa 내지 250pk)을 포함한다. 트랜시버(222)는 다수의 주파수 대역들, 다수의 라디오 기술들, 캐리어 어그게이션, 수신 다이버시티, 다수의 송신 안테나들로부터 다수의 수신 안테나들로의 MIMO(multiple-input multiple-output) 송신 등을 지원하기 위해 다수의(l개) 수신기들(230sa 내지 230sl) 및 다수의(l개) 송신기들(250sa 내지 250sl)을 포함한다.
[0030] 도 1b에 도시된 예시적인 설계에서, 각각의 수신기(230)는 LNA(240) 및 수신 회로들(242)을 포함한다. 데이터 수신을 위해, 안테나(214)는, 기지국들 및/또는 다른 송신기 스테이션들로부터 신호들을 수신하고, 안테나 인터페이스 회로(224)를 통해 라우팅되고 그리고 선택된 수신기에 입력 RF 신호로서 제시되는 수신된 RF 신호를 제공한다. 안테나 인터페이스 회로(224)는 스위치들, 듀플렉서들, 송신 필터들, 수신 필터들, 매칭 회로들 등을 포함할 수 있다. 이하의 설명은, 수신기(230pa)가 선택된 수신기임을 가정한다. 수신기(230pa)내에서, LNA(240pa)는 입력 RF 신호를 증폭시키고 그리고 출력 RF 신호를 제공한다. 수신 회로들(242pa)은, 출력 RF 신호를 RF로부터 기저대역으로 다운컨버팅하고, 다운컨버팅된 신호를 증폭하고 필터링하며, 아날로그 입력 신호를 데이터 프로세서(280)에 제공한다. 수신 회로들(242pa)은 혼합기들, 필터들, 증폭기들, 매칭 회로들, 오실레이터, LO(local oscillator) 생성기, PLL(phase locked loop) 등을 포함할 수 있다. 트랜시버들(220 및 222)에서의 각각의 나머지 수신기(230)는 수신기(230pa)와 유사한 방식으로 동작할 수 있다.
[0031] 도 1b에 도시된 예시적인 설계에서, 각각의 송신기(250)는 송신 회로들(252) 및 전력 증폭기(PA)(254)를 포함한다. 데이터 송신을 위해, 데이터 프로세서(280)는 송신될 데이터를 프로세싱(예컨대, 인코딩 및 변조)하고, 선택된 송신기에 아날로그 출력 신호를 제공한다. 이하의 설명은, 송신기(250pa)가 선택된 송신기임을 가정한다. 송신기(250pa) 내에서, 송신 회로들(252pa)은 아날로그 출력 신호를 증폭하고, 필터링하고, 기저대역에서 RF로 업컨버팅하여, 변조된 RF 신호를 제공한다. 송신 회로들(252pa)은 증폭기들, 필터들, 혼합기들, 매칭 회로들, 오실레이터, LO 생성기, PLL 등을 포함할 수 있다. PA(254pa)는 변조된 RF 신호를 수신하고 증폭시켜 적절한 출력 전력 레벨을 갖는 송신 RF 신호를 제공한다. 송신 RF 신호는 안테나 인터페이스 회로(224)를 통해 라우팅되고 안테나(214)를 통해 송신된다. 트랜시버들(220 및 222)에서의 각각의 나머지 송신기(250)는 송신기(250pa)와 동일한 방식으로 동작할 수 있다.
[0032] 도 1b는 또한 수신기(230) 및 송신기(250)의 예시적인 설계를 도시한다. 수신기 및 송신기는, 도 1b에 도시되지 않은 다른 회로들, 이를테면, 필터들, 매칭 회로들 등을 또한 포함할 수 있다. 트랜시버들(220 및 222) 둘 다 또는 일부는 하나 또는 그 초과의 아날로그 IC(integrated circuit)들, RF IC(RFIC)들, 혼합-신호 IC들 등 상에서 구현될 수 있다. 예컨대, 트랜시버들(220 및 222) 내의 LNA들(240) 및 수신 회로들(242)은, 다수의 IC 칩들 상에서 구현될 수 있다. 트랜시버들(220 및 222) 내의 회로들은 또한 다른 방식들로 구현될 수 있다.
[0033] 데이터 프로세서/제어기(280)는 무선 디바이스(110)에 대해 다양한 기능들을 수행할 수 있다. 예컨대, 데이터 프로세서(280)는, 수신기들(230)을 통해 수신되는 데이터 및 송신기들(250)을 통해 송신되는 데이터에 대한 프로세싱을 수행할 수 있다. 제어기(280)는 트랜시버들(220 및 222) 내의 다양한 회로들의 동작을 제어할 수 있다. 메모리(282)는 데이터 프로세서/제어기(280)에 대한 프로그램 코드들 및 데이터를 저장할 수 있다. 데이터 프로세서/제어기(280)는 하나 또는 그 초과의 ASIC(application specific integrated circuit)들 및/또는 다른 IC들 상에서 구현될 수 있다.
[0034] CA(Carrier aggregation)는 주 서빙 셀(Pcell; primary serving cell) 및 하나 또는 그 초과의 보조 서빙 셀(SCell; secondary serving cell)들을 포함할 수 있다. 수신(Rx) 및 송신(Tx) 주파수들은 PCell에서 페어링된다(paired). 단일의 업링크를 갖는 경우에서와 같은 일부 실시예들에서, 수신(Rx) 및 송신(Tx) 주파수들은 PCell에서 페어링될 수 있다. 다른 실시예들에서, 캐리어 어그리게이션이 업링크들에서 인에이블되는 경우, 다른 업링크는 Scell들의 다른 Tx 주파수들에서 송신되는 것이 가능하다. 특정 대역 조합에서, 특정된 제 1 셀은 보통 PCell이다. 예컨대, 대역 조합 B42+B17+B4+B2에서, B42는 PCell이고, 그리고 B17, B4, 및 B2는 SCell들이다. 일 실시예에서, FDD와 TDD 상호운용성을 개선시키기 위한 단일-칩 솔루션을 제공하기 위해 트랜시버를 재구성하는 것은 CA 모드들의 수신기 및 송신기 링크들/체인들에서의 신시사이저들을 적절하게 혼합하는 것을 수반한다. 예컨대, 하나의 CA 신시사이저(CA0)는, 이 CA 신시사이저(CA0)가 TDD 대역에 할당될 때 수신기 체인과 송신기 체인 사이에서 교번하여 공유될 수 있다. 이와 달리, FDD 모드에서, CA 신시사이저(CA0)는 수신기 체인 또는 송신기 체인에 대해 하나의 체인 또는 다른 체인을 디스에이블함으로써 별개로 사용된다. 동시에, 다른 CA 신시사이저들(CA1/2/3) 또는 TX 신시사이저는 수신기 체인 또는 송신기 체인에 별개로 LO 신호들을 제공하도록 구성될 수 있다. 이러한 구성은 부가된 이익들을 제공한다. 예컨대, FDD 부분에 대해, 분리된 신시사이저 접근법은: 수신기 감도저하(desensitization)를 회피하기 위해 수신 신호 경로와 송신 신호 경로 사이의 양호한 격리; 및 VCO(voltage-controlled oscillator) 풀링을 회피하기 위해 수신 VCO와 송신 VCO 사이의 양호한 격리를 허용하며, 이들은 IPN(integrated phase noise) 성능저하(degradation)를 초래할 수 있다. TDD 부분에 대해, 동시에 공유되는 신시사이저 접근법은 전류 소모를 감소시키기 위해 공유 신시사이저로의 단락(short) 송신기/수신기 LO 연결들을 허용한다.
[0035] 표 1은 다수의 기술들을 사용하여 재구성가능한 FDD/TDD 트랜시버 설계의 유연성(flexibility)을 입증하기 위한 몇몇 상이한 예시의 구성들을 도시한다. 예컨대, 혼합형 LTE FDD/TDD 구성들, 이를테면, 구성들 1-2에서, 공유 신시사이저(CA0)를 갖는 TDD Rx 및 Tx(CA0) 체인들 및 별도의 신시사이저를 갖는 FDD Rx 또는 Tx 체인을 구동시키는 것은, 이 예에서 오직 5개의 신시사이저들만을 이용하여 다운링크들의 수를 4개까지 그리고 업링크들의 수를 2개까지 최대화함으로써 최상의 하드웨어 활용을 달성할 수 있다. 비-LTE 기술들을 포함시키기 위해 유사한 구성들이 사용될 수 있다. 예컨대, 구성들 5-7(GSM을 TDD로 그리고 CDMA를 FDD로 가정함)은 TDD모드에서 GSM 또는 LTE를 구동시키기 위해 공유 신시사이저(CA0)를 사용하고, 다른 별도의 신시사이저들은 FDD 모드에서 다른 LTE 또는 CDMA 기술들을 구동시키는데 사용된다. 오직 FDD 기술만을 포함하는 구성들(3 및 4)의 경우, 공유 신시사이저(CA0)는 Rx 체인 또는 Tx 체인에 대한 FDD 신시사이저로서 사용될 수 있다.
Figure 112016115841674-pct00001
[0036] 도 1c는 본 개시내용의 일 실시예에 따라 정해진 수의 신시사이저들을 사용하여 다운링크(DL)들 및 업링크(UL)들의 수를 최대화하기 위해 트랜시버 설계를 재구성하기 위한 방법을 예시하는 흐름도(150)이다. 일 실시예에서, 최대 4개의 다운링크들 및 2개의 업링크들(대역-간 CA)은 5개의 신시사이저들, 4개의 수신기 체인들, 및 2개의 송신기 체인들로 구성된다. 하나의 주파수 신시사이저가 단계(160)에서 하나의 송신기 체인에 연결되며, 3개의 신시사이저들은 단계(162)에서 3개의 수신기 체인들에 연결된다. 다음으로, 주파수 신시사이저(예컨대, CA0)는 단계(164)에서 수신기 체인과 송신기 체인 사이에서 공유되도록 구성된다. 단계(170)에서, 공유 신시사이저가 TDD 체인을 구동시킬지 또는 FDD 체인(들)을 구동시킬지에 대한 결정이 행해진다. 공유 신시사이저가 TDD 체인들을 구동시키는 경우, 공유 신시사이저는 Rx 체인과 Tx 체인 사이에서 교번하여 공유되도록 할당된다. 이와 달리, 공유 신시사이저가 FDD 체인을 구동시키는 경우, 공유 신시사이저는, FDD 체인의 기술에 의존하여, Rx 체인 또는 Tx 체인에 대해 하나의 체인 또는 다른 체인을 디스에이블함으로써 별도로 사용되도록 구성된다. 따라서, 링크들의 수는, TDD에 할당되는, Rx 체인과 Tx 체인 사이에서 신시사이저를 공유함으로써 증가된다.
[0037] 링크들의 수는, 단계(180)에서, 대역-내/연속 캐리어 어그리게이션을 인에이블함으로써 더 증가될 수 있다. 예컨대, 대역-내/연속 CA의 경우, 하나의 다운링크는 2개의 다운링크 채널들을 수신하기 위해 확장형 수신 BBF(baseband filter) 대역폭을 갖는 동일한 신시사이저 주파수를 사용하도록 인에이블될 수 있다. 유사하게, 하나의 업링크는 2개의 업링크 채널들을 송신하기 위해 확장형 송신 BBF(baseband filter) 대역폭을 갖는 동일한 신시사이저 주파수를 사용하도록 인에이블될 수 있다. 단계(182)에서, intra/비연속 CA는 간단한 RF 프론트-엔드 및 덜 복잡한 PCB 라우팅을 지원하기 위해 LNA 출력을 분할함으로써 인에이블될 수 있다.
[0038] 도 1c의 방법은 복수의 주파수 신시사이저들 및 복수의 CA(carrier aggregation) 수신기(Tx) 및 송신기(Tx) 체인들을 사용하여 링크들의 수를 최대화하기 위해 트랜시버 설계를 재구성하는 것으로서 일반화될 수 있는데, 그 방법은, 제 1 CA Tx 체인에 제 1 주파수 신시사이저를 연결하는 단계; 복수의 CA Rx 체인들에 복수의 주파수 신시사이저들을 연결하는 단계를 포함하고, 여기서 공유 신시사이저가 TDD 체인들을 구동시킬 때, 복수의 주파수 신시사이저들 중 제 2 주파수 신시사이저는 제 1 CA Rx 체인과 제 2 CA Tx 체인 사이에서 공유되는 공유 신시사이저로서 구성된다. 일 실시예에서, 공유 신시사이저는, 공유 신시사이저가 FDD 체인을 구동시킬 때, 제 2 CA Tx 체인에 대해 또는 제 1 CA Rx 체인에 대해 별도로 사용되도록 구성된다. 다른 실시예에서, 다운링크에서 대역-내/연속 CA는 2개의 여분의 다운링크 채널들을 수신하기 위해 확장형 BBF(baseband filter) 대역폭을 갖는 동일한 신시사이저 주파수를 사용하도록 인에이블된다. 다른 실시예에서, 업링크에서 대역-내/연속 CA는 2개의 여분의 업링크 채널들을 수신하기 위해 확장형 BBF(baseband filter) 대역폭을 갖는 동일한 신시사이저 주파수를 사용하도록 인에이블된다. 추가의 실시예에서, 대역-내/비연속 CA는 LNA 출력들을 분할함으로써 인에이블될 수 있다.
[0039] 도 2a는 도 1c에 설명된 방법을 사용하여 설계된 FDD/TDD CA 트랜시버(200)의 일 예시의 경우 (LTE FDD(3DL+1UL)+LTE TDD(1DL+1UL))를 예시한다. 표 2는 도 2a에 도시된 대역 조합 B42+B17+B4+B2에 대한 Rx 및 Tx 체인들의 레이아웃을 특정한다. 따라서, CA0 신시사이저(210)가 공유될 수 있도록, LTD TDD 대역(42)은 Rx/CA0 및 TX1에 할당된다. 나머지 체인들(Rx/CA1, Rx/CA2, Rx/CA3, Tx0)은 LTE FDD 대역들(17, 4 및 2)에 할당된다. 어떠한 대역-내 링크들도 존재하지 않기 때문에, 모든 CA/intra 버퍼들은 디스에이블된다(도 2a에서의 음영 영역들).
Figure 112016115841674-pct00002
[0040] 도 2b는 도 2a에 도시된 FDD/TDD CA 트랜시버(200)의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다. 최상부 체인은 LTE FDD에 할당된 대역(17)에 대한 TX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(17)에 대한 RX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(4)에 대한 RX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(2)에 대한 RX 체인이다. 다음 2개의 체인들은 CA0 신시사이저(210)를 공유하고 LTE TDD에 할당된 대역(42)에 대한 RX 체인 및 TX 체인이다.
[0041] 도 3a는 도 1c에 설명된 방법을 사용하여 설계된 TDD CA 트랜시버(300)의 다른 예시의 경우(LTE TDD(2DL/intra/non-contiguous+1UL+2DL/inter +1UL))를 예시한다. 표 3는 도 3a에 도시된 대역 조합 B43+B41+B42+B41/intra에 대한 Rx 및 Tx 체인들의 레이아웃을 특정한다. 따라서, CA0 신시사이저(310)가 공유될 수 있도록, LTD TDD 대역(43)은 Rx/CA0 및 TX1에 할당된다. 나머지 체인들(Rx/CA1, Rx/CA2, Rx/CA3, Tx0)은 모두 LTE TDD 대역들(41 및 42)에 할당된다. 인트라/비연속 CA가 대역(41)에서 인에이블되기 때문에, B41/intra대한 LNA3은 디스에이블되고(음영됨), B41의 LNA1 출력은 Rx/CA1과 Rx/CA3 사이에서 LNA1의 출력을 공유하기 위해 2개의 버퍼들로 분할된다(교차 패터닝된다).
Figure 112016115841674-pct00003
[0042] 도 3b는 도 3a에 도시된 TDD CA 트랜시버(300)의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다. 최상부 체인은 LTE TDD에 할당된 대역(41)에 대한 TX 체인이다. 아래의 다음 체인은 LTE TDD에 할당된 대역(41)에 대한 RX 체인이다. 아래의 다음 체인은 LTE TDD에 할당된 대역(42)에 대한 RX 체인이다. 아래의 다음 체인은 대역(41/intra)에 대한 RX 체인이다. intra/비연속 CA가 인에이블되기 때문에, B41/intra에 대한 LNA3이 디스에이블되고(음영되고)(330), B41의 LNA1 출력은 대역(41) 및 대역(41/intra)의 RX 체인들에 대한 LNA1의 출력을 공유하기 위해 2개의 버퍼들(320, 322)로 분할된다(교차 패터닝된다). 다음 2개의 체인들은 CA0 신시사이저(310)를 공유하는 대역(43)에 대한 RX 체인 및 TX 체인이다.
[0043] 도 4a는 도 1c에 설명된 방법을 사용하여 설계된 FDD CA 트랜시버의 다른 예시의 경우 (LTE FDD(4DL+1UL))를 예시한다. 표 4는 도 4a에 도시된 대역 조합 B30+B17+B4+B2에 대한 Rx 및 Tx 체인들의 레이아웃을 특정한다. FDD 대역(30)은, CA0 신시사이저가 Rx/CA0에 의해 별개로 사용되도록, Rx/CA0에만 할당된다. TX1 체인은, CA0 신시사이저가 LTE FDD의 Rx 체인에 할당되기 때문에, 디스에이블된다. 또한, 나머지 체인들(Rx/CA1, Rx/CA2, Rx/CA3, TX0)은 LTE FDD 대역들(17, 4 및 2)에 할당된다. 어떠한 대역-내 링크들도 존재하지 않기 때문에, 모든 CA/intra 버퍼들은 디스에이블된다(도 4a에서의 음영 영역들).
Figure 112016115841674-pct00004
[0044] 도 4b는 도 4a에 도시된 FDD CA 트랜시버(400)의 RX 및 TX 체인들에 대한 신호 경로들을 예시한다. 최상부 체인은 LTE FDD에 할당된 대역(17)에 대한 TX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(17)에 대한 RX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(4)에 대한 RX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(2)에 대한 RX 체인이다. 다음 체인은 LTE FDD에 할당된 대역(30)에 대한 RX 체인이다.
[0045] 도 5a는 도 1c에 설명된 방법을 사용하여 설계된 FDD CA 트랜시버의 다른 예시의 경우 (LTE FDD(2DL/intra+1UL+1DL+1UL))를 예시한다. 표 5는 도 5a에 도시된 대역 조합 B1+B13+B1/intra+B1/inter에 대한 Rx 및 Tx 체인들의 레이아웃을 특정한다. 따라서, FDD 대역(1)은, CA0 신시사이저가 TX0 체인에 의해 별개로 사용되도록, TX1에 할당된다. 나머지 체인들(Rx/CA1, Rx/CA2, Rx/CA3, TX0)은 모두 LTE FDD 대역들(1 및 13)에 할당된다. Rx/CA0 체인은, CA0 신시사이저가 LTE FDD의 Tx 체인에 할당되기 때문에, 디스에이블된다. intra/비연속 CA가 인에이블되기 때문에, B1/intra에 대한 LNA2는 디스에이블되고(음영됨), B1의 LNA3 출력은 Rx/CA2와 Rx/CA3 사이에서 LNA3의 출력을 공유하기 위해 2개의 버퍼들로 분할된다(교차 패터닝된다).
Figure 112016115841674-pct00005
[0046] 도 5b는 도 5a에 도시된 FDD CA 트랜시버(500)의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다. 최상부 체인은 LTE FDD에 할당된 대역(13)에 대한 TX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(13)에 대한 RX 체인이다. 다음 2개의 체인들은 대역(1/intra)에 대한 RX 체인 및 LTE FDD에 할당된 대역(1)에 대한 다른 RX 체인이다. intra/비연속 CA가 인에이블되기 때문에, B1/intra 대한 LNA2는 디스에이블되고(음영됨)(530), B1의 LNA3 출력은 대역(1) 및 대역(1/intra)의 RX 체인들에 대한 LNA3의 출력을 공유하기 위해 2개의 버퍼들(520, 522)로 분할된다(교차 패터닝된다). Rx/CA0 체인은, CA0 신시사이저(510)가 LTE FDD 대역(1)의 TX1 체인에 할당되기 때문에, 디스에이블된다(540).
[0047] 도 6a는 도 1c에 설명된 방법을 사용하여 설계된 FDD/TDD/GSM CA 트랜시버의 다른 예시의 경우 (LTE FDD(3DL+1UL)+GSM/TDD(1DL+1UL))를 예시한다. 표 6는 도 6a에 도시된 대역 조합 B5+B12+B4+B2에 대한 Rx 및 Tx 체인들의 레이아웃을 특정한다. 따라서, CA0 신시사이저가 공유될 수 있도록, GSM/TDD 대역(5)은 Rx/CA0 및 TX1에 할당된다. 나머지 체인들(Rx/CA1, Rx/CA2, Rx/CA3, TX0)은 LTE FDD 대역들(12, 4 및 2)에 할당된다. 어떠한 대역-내 링크들도 존재하지 않기 때문에, 모든 CA/intra 버퍼들(도 6a에서의 음영 영역들)은 디스에이블된다.
Figure 112016115841674-pct00006
[0048] 도 6b는 도 6a에 도시된 FDD/TDD/GSM CA 트랜시버(600)의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다. 최상부 체인은 LTE FDD에 할당된 대역(12)에 대한 TX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(12)에 대한 RX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(4)에 대한 RX 체인이다. 아래의 다음 체인은 대역(2)에 대한 RX 체인이다. 다음 2개의 체인들은 CA0 신시사이저(610)를 공유하는 대역(5)에 대한 RX 체인 및 TX 체인이다.
[0049] 도 7a는 도 1c에 설명된 방법을 사용하여 설계된 FDD/TDD/SVLTE CA 트랜시버의 다른 예시의 경우 (SVLTE TDD(3DL+1UL)+CDMA/FDD(1DL+1UL))를 예시한다. 용어 SVLTE는 SVLTE(Simultaneous Voice Long Term Evolution)를 나타낸다. 표 7는 도 7a에 도시된 대역 조합 B41b+BC0+B41a+B41c에 대한 Rx 및 Tx 체인들의 레이아웃을 특정한다. 따라서, CA0 신시사이저가 공유될 수 있도록, TDD 대역(41b)은 Rx/CA0 및 TX1에 할당된다. 나머지 체인들은 이하와 같이 할당되는데: Rx/CA1 및 TX0은 CDMA BC0에 할당되고; Rx/CA2, Rx/CA3는 LTE TDD 대역(41a) 및 대역(41c)에 할당된다. 이 경우, 체인들 Rx/CA2, Rx/CA3, Rx/CA0은 LTE TDD 기술의 프론트-엔드를 간략화하기 위해 하나의-칩 intra-LNA를 사용함으로써 동일한 대역(41)을 사용한다. 따라서, B41a의 LNA2 출력은 Rx/CA2, Rx/CA3와 Rx/CA0 사이에서 LNA2의 출력을 공유하기 위해 3개의 버퍼들로 분할된다(교차 패터닝된다).
Figure 112016115841674-pct00007
[0050] 도 7b는 도 7a에 도시된 FDD/TDD/SVLTE CA 트랜시버(700)의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다. 최상부 체인은 CDMA에 할당된 대역(BC0)에 대한 TX 체인이다. 아래의 다음 체인은 CDMA에 할당된 대역(BC0)에 대한 RX 체인이다. 다음의 3개의 체인들은 LTE TDD에 각각 할당된 대역들(41a, 41c, 41b)에 대한 RX 체인들이다. 3개의 RX 체인들이 LTE TDD 기술의 프론트-엔드를 간략화하기 위해 원-칩 intra-LNA를 사용함으로써 동일한 대역(41)을 사용하기 때문에, B41a의 LNA2 출력은 대역들(41a, 41c, 41b)에 대한 체인들 사이에서 LNA2의 출력을 공유하기 위해 3개의 버퍼들(720, 722, 724)로 분할된다(교차 패터닝된다). 다음 체인은, LNA2 출력으로부터 분할된, Rx 체인(41b)과 CA0 신시사이저(710)를 공유하는 대역(41b)에 대한 TX 체인이다.
[0051] 도 8a는 도 1c에 설명된 방법을 사용하여 설계된 FDD/TDD/SVLTE+DSDS CA 트랜시버의 다른 예시의 경우 (SVLTE FDD(2DL+1UL)+LTE TDD(1DL+1UL)+CDMA(1DL))를 예시한다. 용어 DSDS는 Dual SIM Dual Standby를 나타낸다. 표 8는 도 8a에 도시된 대역 조합 B41+B1+B3+BC0에 대한 Rx 및 Tx 체인들의 레이아웃을 특정한다. 따라서, CA0 신시사이저가 공유될 수 있도록, TDD 대역(41)는 Rx/CA0 및 TX1에 할당된다. 나머지 체인들(Rx/CA1, Rx/CA2, TX0)은 LTE FDD 대역(1,3)에 할당되고, Rx/CA3는 CDMA/DSDS BC0에 할당된다. 어떠한 대역-내 링크들도 존재하지 않기 때문에, 모든 CA/intra 버퍼들은 디스에이블된다(도 8a에서의 음영 영역들).
Figure 112016115841674-pct00008
[0052] 도 8b는 도 8a에 도시된 FDD/TDD/SVLTE+DSDS CA 트랜시버(800)의 Rx 및 Tx 체인들에 대한 신호 경로들을 예시한다. 최상부 체인은 LTE FDD에 할당된 대역(1)에 대한 TX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(1)에 대한 RX 체인이다. 아래의 다음 체인은 LTE FDD에 할당된 대역(3)에 대한 RX 체인이다. 아래의 다음 체인은 CDMA/DSDS에 할당된 대역(BC0)에 대한 RX 체인이다. 다음 2개의 체인들은, CA0 신시사이저(810)를 공유하고 LTE TDD에 할당된 대역(41)에 대한 RX 체인 및 TX 체인이다.
[0053] 본 발명의 몇몇 실시예들이 앞서 설명되었지만, 본 발명의 수많은 변동들도 가능하다. 게다가, 다양한 실시예들의 특징들은 앞서 설명된 것들과는 상이한 조합들로 조합될 수 있다. 더욱이, 명료하고 간략한 설명을 위해, 시스템들 및 방법들의 수많은 설명들이 간략화되었다. 수많은 설명들은 특정 표준들의 용어 및 구조들을 사용한다. 그러나, 개시된 시스템들 및 방법들은 더욱 광범위하게 적용가능하다.
[0054] 당업자들은, 본원에 개시된 실시예들과 관련하여 설명된 다양한 예시적인 블록들 및 모듈들이 다양한 형태들로 구현될 수 있음을 인식할 것이다. 몇몇 블록들 및 모듈들은 그들의 기능 측면에서 일반적으로 위에서 설명되었다. 이러한 기능이 어떻게 구현되는지는 전체 시스템에 대하여 부과되는 설계 제약들에 따라 좌우된다. 당업자들은 각각의 특정한 애플리케이션에 대하여 다양한 방식들로 설명된 기능을 구현할 수 있으나, 이러한 구현 결정들은 본 발명의 범위를 벗어남을 야기하는 것으로 해석되어서는 안 된다. 이에 더해, 모듈, 블록, 또는 단계 내에서의 기능들의 그룹화는 설명의 용이함을 위해서이다. 특정 기능들 또는 단계들은 본 발명으로부터 벗어나지 않고 하나의 모듈 또는 블록으로부터 이동될 수 있다.
[0055] 본 명세서에 개시된 실시예들과 관련하여 설명된 다양한 예시적인 로지컬 블록들, 유닛들, 단계들, 컴포넌트들, 및 모듈들은 프로세서, 이를테면, 범용 프로세서, DSP(digital signal processor), 주문형 집적 회로(ASIC), 필드 프로그래머블 게이트 어레이(FPGA) 또는 다른 프로그래머블 로직 디바이스, 이산 게이트 또는 트랜지스터 로직, 이산 하드웨어 컴포넌트들, 또는 본원에서 설명된 기능들을 수행하도록 설계된 이들의 임의의 조합으로 구현되거나 또는 수행될 수 있다. 범용 프로세서는 마이크로프로세서일 수 있지만, 대안적으로 프로세서는 임의의 프로세서, 제어기, 마이크로프로세서, 또는 상태 머신일 수 있다. 프로세서는 또한 컴퓨팅 디바이스들의 조합, 예를 들어, DSP와 마이크로프로세서의 조합, 복수의 마이크로프로세서들, DSP 코어와 연결된 하나 또는 그 초과의 마이크로프로세서들 또는 임의의 다른 이러한 구성으로서 구현될 수 있다. 게다가, 본원에 설명된 실시예들과 기능 블록들 및 기능 모듈들을 구현하는 회로들은 다양한 트랜지스터 타입들, 로직 패밀리들, 및 설계 방법들을 사용하여 실현될 수 있다.
[0056] 개시된 실시예들의 이전 설명은, 임의의 당업자로 하여금 본 발명을 실시하게 하거나 또는 사용하게 하기 위해 제공된다. 이러한 실시예들에 대한 다양한 수정들이 당업자들에게는 쉽게 명백할 것이며, 본 명세서에 설명된 일반 원리들은 본 발명의 사상 또는 범위를 벗어나지 않고 다른 실시예들에 적용될 수 있다. 따라서, 본 명세서에 제시된 상세한 설명 및 도면들은 본 발명의 현재 바람직한 실시예들을 나타내며 이에 따라 본 개시내용에 의해 광범위하게 고찰된 청구대상을 나타낸다는 점이 이해되어야 한다. 본 개시내용의 범위는 당업자들에게 명백하게 될 수 있는 다른 실시예들을 완전하게 포함하고 그리고 이에 따라 본 개시내용의 범위는 첨부된 청구항들 이외의 어떤 것에 의해서도 제한되지 않는다는 점이 추가로 이해되어야 한다.

Claims (24)

  1. 복수의 주파수 신시사이저(synthesizer)들 및 복수의 CA(carrier aggregation) 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법으로서,
    제 1 주파수 신시사이저를 제 1 CA Tx 체인에 연결하는 단계;
    상기 복수의 주파수 신시사이저들 각각을 상기 복수의 CA Rx 체인들 중 하나에 연결하는 단계 ― 상기 복수의 주파수 신시사이저들 중 제 2 주파수 신시사이저는 상기 복수의 CA Rx 체인들 중 제 1 CA Rx 체인 및 제 2 CA Tx 체인에 공유(shared) 신시사이저로서 연결됨 ―; 및
    상기 공유 신시사이저가 TDD(time division duplex) 체인을 구동해야 하는지 아니면 FDD(frequency division duplex) 체인을 구동해야 하는지를 결정하는 단계를 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  2. 제 1 항에 있어서,
    상기 공유 신시사이저는, 상기 공유 신시사이저가 TDD(time division duplex) 체인을 구동시킬 때, 상기 제 2 CA Tx 체인 또는 상기 제 1 CA Rx 체인 중 하나에 대해 사용되도록 구성되고,
    상기 제 1 주파수 신시사이저는 FDD(frequency division duplex) 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고; 그리고
    나머지 주파수 신시사이저들은 상기 FDD 모드에서 나머지 Rx 체인들에 대해 사용되도록 구성되는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  3. 제 2 항에 있어서,
    상기 트랜시버는, 적어도: 상기 FDD 모드에서 3개의 CA Rx 체인들; TDD 모드에서 하나의 CA Rx 체인; 상기 FDD 모드에서 하나의 CA Tx 체인; 및 상기 TDD 모드에서 하나의 CA Tx 체인을 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  4. 제 1 항에 있어서,
    상기 공유 신시사이저는, 상기 공유 신시사이저가 TDD 체인을 구동시킬 때, 상기 제 2 CA Tx 체인 또는 상기 제 1 CA Rx 체인 중 하나에 대해 사용되도록 구성되고,
    상기 제 1 주파수 신시사이저는 TDD 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고; 그리고
    나머지 주파수 신시사이저들은 상기 TDD 모드에서 나머지 Rx 체인들에 대해 사용되도록 구성되는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  5. 제 4 항에 있어서,
    상기 트랜시버는, 적어도: 상기 TDD 모드에서 4개의 CA Rx 체인들; 및 상기 TDD 모드에서 2개의 CA Tx 체인들을 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  6. 제 1 항에 있어서,
    상기 공유 신시사이저는, 상기 공유 신시사이저가 TDD 체인을 구동시킬 때, 상기 제 2 CA Tx 체인 또는 상기 제 1 CA Rx 체인 중 하나에 대해 사용되도록 구성되고,
    상기 제 1 주파수 신시사이저는 TDD 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고; 그리고
    제 2 주파수 신시사이저 및 제 3 주파수 신시사이저는 상기 TDD 모드에서 제 2 Rx 체인 및 제 3 Rx 체인에 대해 사용되도록 구성되며,
    나머지 주파수 신시사이저들은 FDD 모드에서 나머지 Rx 체인들에 대해 사용되도록 구성되는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  7. 제 6 항에 있어서,
    상기 트랜시버는, 적어도: 상기 TDD 모드에서 3개의 CA Rx 체인들; 상기 FDD 모드에서 하나의 CA Rx 체인; 및 상기 TDD 모드에서 2개의 CA Tx 체인들을 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  8. 제 1 항에 있어서,
    상기 공유 신시사이저는 FDD 모드에서 상기 제 1 CA Rx 체인에 대해 사용되도록 구성되고;
    상기 제 1 주파수 신시사이저는 상기 FDD 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고;
    나머지 주파수 신시사이저들은 상기 FDD 모드에서 나머지 CA Rx 체인들에 대해 사용되도록 구성되고; 그리고
    상기 제 2 CA Tx 체인은 디스에이블되는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  9. 제 8 항에 있어서,
    상기 트랜시버는, 적어도: 상기 FDD 모드에서 4개의 CA Rx 체인들; 및 상기 FDD 모드에서 하나의 CA Tx 체인을 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  10. 제 1 항에 있어서,
    상기 공유 신시사이저는 FDD 모드에서 상기 제 2 CA Tx 체인에 대해 사용되도록 구성되고;
    상기 제 1 주파수 신시사이저는 상기 FDD 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고;
    나머지 주파수 신시사이저들은 상기 FDD 모드에서 나머지 Rx 체인들에 대해 사용되도록 구성되고; 그리고
    상기 제 2 CA Rx 체인은 디스에이블되는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  11. 제 10 항에 있어서,
    상기 트랜시버는, 적어도: 상기 FDD 모드에서 3개의 CA Rx 체인들; 및 상기 FDD 모드에서 2개의 CA Tx 체인들을 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  12. 제 1 항에 있어서,
    다운링크 채널들의 수를 증가시키기 위해 확장형 수신 BBF(baseband filter) 대역폭을 갖는 동일한 신시사이저 주파수를 사용하도록 대역-내/연속 수신 CA를 인에이블하는 단계를 더 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  13. 제 1 항에 있어서,
    업링크 채널들의 수를 증가시키기 위해 확장형 송신 BBF(baseband filter) 대역폭을 갖는 동일한 신시사이저 주파수를 사용하도록 대역-내/연속 송신 CA를 인에이블하는 단계를 더 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  14. 제 1 항에 있어서,
    LNA 출력을 분할함으로써 대역-내/비연속 CA를 인에이블하는 단계를 더 포함하는,
    복수의 주파수 신시사이저들 및 복수의 CA 수신기(Rx) 및 송신기(Tx) 체인들을 사용하여 트랜시버 설계를 재구성하기 위한 방법.
  15. 재구성가능한 트랜시버 회로(reconfigurable transceiver circuit)로서,
    제 1 CA Tx 체인에 연결하도록 구성된 제 1 주파수 신시사이저;
    복수의 주파수 신시사이저들을 포함하고,
    상기 복수의 주파수 신시사이저들 각각은 복수의 CA Rx 체인들 중 하나에 연결하도록 구성되고,
    상기 복수의 주파수 신시사이저들 중 제 2 주파수 신시사이저는 상기 복수의 CA Rx 체인들 중 제 1 CA Rx 체인 및 제 2 CA Tx 체인에 공유 신시사이저로서 연결되고,
    상기 공유 신시사이저는 TDD(time division duplex) 체인 또는 FDD(frequency division duplex) 체인을 구동하는,
    재구성가능한 트랜시버 회로.
  16. 제 15 항에 있어서,
    상기 공유 신시사이저는, 상기 공유 신시사이저가 TDD(time division duplex) 체인을 구동시킬 때, 상기 제 2 CA Tx 체인 또는 상기 제 1 CA Rx 체인에 대해 교번하여 사용되도록 구성되고,
    상기 제 1 주파수 신시사이저는 FDD(frequency division duplex) 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고; 그리고
    나머지 주파수 신시사이저들은 상기 FDD 모드에서 나머지 Rx 체인들에 대해 사용되도록 구성되는,
    재구성가능한 트랜시버 회로.
  17. 제 15 항에 있어서,
    상기 공유 신시사이저는, 상기 공유 신시사이저가 TDD 체인을 구동시킬 때, 상기 제 2 CA Tx 체인 또는 상기 제 1 CA Rx 체인에 대해 교번하여 사용되도록 구성되고,
    상기 제 1 주파수 신시사이저는 TDD 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고; 그리고
    나머지 주파수 신시사이저들은 상기 TDD 모드에서 나머지 Rx 체인들에 대해 사용되도록 구성되는,
    재구성가능한 트랜시버 회로.
  18. 제 15 항에 있어서,
    상기 공유 신시사이저는, 상기 공유 신시사이저가 TDD 체인을 구동시킬 때, 상기 제 2 CA Tx 체인 또는 상기 제 1 CA Rx 체인에 대해 교번하여 사용되도록 구성되고,
    상기 제 1 주파수 신시사이저는 TDD 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고; 그리고
    나머지 주파수 신시사이저들 중 2개는 상기 TDD 모드에서 나머지 Rx 체인들 중 2개에 대해 사용되도록 구성되고; 그리고
    나머지 주파수 신시사이저는 FDD 모드에서 나머지 Rx 체인에 대해 사용되도록 구성되는,
    재구성가능한 트랜시버 회로.
  19. 제 15 항에 있어서,
    상기 공유 신시사이저는 FDD 모드에서 상기 제 1 CA Rx 체인에 대해 사용되도록 구성되고;
    상기 제 1 주파수 신시사이저는 FDD 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고;
    나머지 주파수 신시사이저들은 상기 FDD 모드에서 나머지 CA Rx 체인들에 대해 사용되도록 구성되고; 그리고
    상기 제 2 CA Tx 체인은 디스에이블되는,
    재구성가능한 트랜시버 회로.
  20. 제 15 항에 있어서,
    상기 공유 신시사이저는 FDD 모드에서 상기 제 2 CA Tx 체인에 대해 사용되도록 구성되고;
    상기 제 1 주파수 신시사이저는 FDD 모드에서 제 1 CA Tx 체인에 대해 사용되도록 구성되고;
    나머지 주파수 신시사이저들은 상기 FDD 모드에서 나머지 Rx 체인들에 대해 사용되도록 구성되고; 그리고
    상기 제 2 CA Rx 체인은 디스에이블되는,
    재구성가능한 트랜시버 회로.
  21. 제 15 항에 있어서,
    다운링크 채널들의 수를 증가시키기 위해 확장형 수신 BBF(baseband filter) 대역폭을 갖는 동일한 신시사이저 주파수를 사용하도록 구성된 대역-내/연속 수신 CA를 더 포함하는,
    재구성가능한 트랜시버 회로.
  22. 제 15 항에 있어서,
    업링크 채널들의 수를 증가시키기 위해 확장형 송신 BBF(baseband filter) 대역폭을 갖는 동일한 신시사이저 주파수를 사용하도록 구성된 대역-내/연속 송신 CA를 더 포함하는,
    재구성가능한 트랜시버 회로.
  23. 제 15 항에 있어서,
    LNA 출력을 분할함으로써 인에이블되도록 구성된 대역-내/비연속 CA를 더 포함하는,
    재구성가능한 트랜시버 회로.
  24. 제 15 항에 있어서,
    상기 제 1 주파수 신시사이저, 상기 제 1 CA Tx 체인, 및 상기 복수의 주파수 신시사이저들은 단일-칩 상에 배치되는,
    재구성가능한 트랜시버 회로.
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